TW201926304A - 像素電路 - Google Patents

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Abstract

一種像素電路包括：發光元件、儲存電容、驅動電晶體、第一開關、第二開關、第三開關、及第四開關。驅動電晶體的第一端接收供應電壓，驅動電晶體的第二端電性連接發光元件的陽極端，且驅動電晶體的控制端電性連接儲存電容的第一端。第一開關用以提供第一參考電壓至儲存電容的第二端。第二開關用以提供供應電壓至儲存電容的第一端。第三開關電性連接儲存電容的第二端。第四開關電性連接第三開關，用以接收資料電壓。第三開關及第四開關用以提供相應於資料電壓與第三開關的臨界電壓之操作電壓至儲存電容的第二端。

Description

像素電路
本發明涉及一種電子電路。具體而言，本發明涉及一種像素電路。
隨著電子科技的快速進展，顯示裝置已被廣泛地應用在人們的生活當中，諸如行動電話或電腦等。
一般而言，顯示裝置可包括閘極驅動電路、源極驅動電路、與像素電路陣列。閘極驅動電路可依序提供複數筆閘極訊號至像素電路，以逐列開啟像素電路的開關電晶體。源極驅動電路可提供複數筆資料訊號至開關電晶體開啟的像素電路，以使像素電路根據資料訊號進行顯示操作。
典型的像素電路之驅動電晶體是根據資料訊號及其臨界電壓(threshold voltage)決定提供至發光二極體的驅動電流之電流量。然而，顯示裝置中不同的像素中的驅動電晶體的臨界電壓可能因製造過程而存在偏異。此些偏異會導致各個發光元件發光的亮度不一致，而造成畫面 亮度不均(mura)的問題。
是以，如何解決此一問題為本領域之重要研究方向。
本發明一實施態樣涉及一種像素電路。根據本發明一實施例，像素電路包括：發光元件、儲存電容、驅動電晶體、第一開關、第二開關、第三開關、及第四開關。驅動電晶體的第一端接收供應電壓，驅動電晶體的第二端電性連接發光元件的陽極端，且驅動電晶體的控制端電性連接儲存電容的第一端。第一開關用以提供第一參考電壓至儲存電容的第二端。第二開關用以提供供應電壓至儲存電容的第一端。第三開關電性連接儲存電容的第二端。第四開關電性連接第三開關，用以接收資料電壓。第三開關及第四開關用以提供相應於資料電壓與第三開關的臨界電壓之操作電壓至儲存電容的第二端。
本發明另一實施態樣涉及一種像素電路。根據本發明一實施例，像素電路包括：發光元件、儲存電容、驅動電晶體、第一開關、第二開關、第三開關、及第四開關。驅動電晶體的第一端接收供應電壓，驅動電晶體的第二端電性連接發光元件的陽極端，且驅動電晶體的控制端電性連接儲存電容的第一端。第一開關的第一端電性連接儲存電容的第二端，且第一開關的第二端用以接收第一參考電壓。第二開關的第一端電性連接儲存電容的第一端， 且第二開關的第二端用以接收供應電壓。第三開關的第一端電性連接儲存電容的第二端，且第三開關的第二端電性連接第三開關的控制端。第四開關的第一端電性連接第三開關的第二端，且第四開關的第二端用以接收資料電壓。
第一開關用以提供第一參考電壓至儲存電容的第二端。第二開關用以提供供應電壓至儲存電容的第一端。第三開關電性連接儲存電容的第二端。第四開關電性連接第三開關，用以接收資料電壓。第三開關及第四開關用以提供相應於資料電壓與第三開關的臨界電壓之操作電壓至儲存電容的第二端。
藉由應用上述一實施例，可實現一種像素電路。藉由應用此一像素電路於顯示裝置中，可避免因驅動電晶體的臨界電壓的偏移，而導致顯示裝置的畫面亮度不均的問題。
100‧‧‧顯示裝置
102‧‧‧像素陣列
106‧‧‧像素電路
106a‧‧‧像素電路
106b‧‧‧像素電路
106c‧‧‧像素電路
106d‧‧‧像素電路
110‧‧‧閘極驅動電路
120‧‧‧源極驅動電路
G(1)-G(N)‧‧‧閘極訊號
D(1)-D(M)‧‧‧資料訊號
T1-T4、T6-T7‧‧‧開關
T5‧‧‧驅動電晶體
Cst‧‧‧儲存電容
OLD‧‧‧發光元件
S1-S3‧‧‧閘極訊號
OVDD‧‧‧供應電壓
OVSS‧‧‧供應電壓
Vdata‧‧‧資料電壓
VREF、VREF1、VREF2‧‧‧參考電壓
A、B‧‧‧節點
IOLD‧‧‧驅動電流
D0-D3‧‧‧期間
為讓本發明之上述和其他目的、特徵、優點與實施例能更明顯易懂，所附圖式之說明如下：第1圖為根據本發明一實施例所繪示的顯示裝置的示意圖；第2圖為根據本發明一實施例所繪示的像素電路的示意圖；第3圖為根據本發明一操作例所繪示的像素電路的示意圖； 第4圖為根據本發明一操作例所繪示的像素電路的示意圖；第5圖為根據本發明一操作例所繪示的像素電路的示意圖；第6圖為根據本發明一操作例所繪示的像素電路的訊號示意圖；第7圖為根據本發明另一實施例所繪示的像素電路的示意圖；第8圖為根據本發明另一實施例所繪示的像素電路的示意圖；第9圖為根據本發明另一實施例所繪示的像素電路的訊號示意圖；第10圖為根據本發明另一實施例所繪示的像素電路的示意圖；第11圖為根據本發明另一實施例所繪示的像素電路的訊號示意圖；第12圖為根據本發明另一實施例所繪示的像素電路的示意圖；及第13圖為根據本發明另一實施例所繪示的像素電路的訊號示意圖。
以下將以圖式及詳細敘述清楚說明本揭示內容之精神，任何所屬技術領域中具有通常知識者在瞭解本揭 示內容之實施例後，當可由本揭示內容所教示之技術，加以改變及修飾，其並不脫離本揭示內容之精神與範圍。
關於本文中所使用之『第一』、『第二』、…等，並非特別指稱次序或順位的意思，亦非用以限定本發明，其僅為了區別以相同技術用語描述的元件或操作。
關於本文中所使用之『電性連接』，可指二或多個元件相互直接作實體或電性接觸，或是相互間接作實體或電性接觸，而『電性連接』還可指二或多個元件相互操作或動作。
關於本文中所使用之『包含』、『包括』、『具有』、『含有』等等，均為開放性的用語，即意指包含但不限於。
關於本文中所使用之『及/或』，係包括所述事物的任一或全部組合。
關於本文中所使用之用詞(terms)，除有特別註明外，通常具有每個用詞使用在此領域中、在此揭露之內容中與特殊內容中的平常意義。某些用以描述本揭露之用詞將於下或在此說明書的別處討論，以提供本領域技術人員在有關本揭露之描述上額外的引導。
第1圖為根據本發明實施例所繪示的顯示裝置100的示意圖。顯示裝置100可包括閘極驅動電路110、源極驅動電路120、以及像素陣列102。像素陣列102可包括複數個以矩陣排列的像素電路106。閘極驅動電路110可依序產生並提供複數筆閘極訊號G(1)、…、G(N)給像素 陣列102中的像素電路106，以逐列開啟像素電路106的資料開關(如第2圖中開關T3)，其中N為自然數。源極驅動電路120可產生複數筆資料訊號D(1)、…、D(M)，並提供此些資料訊號D(1)、…、D(M)給資料開關開啟的像素電路106，以使像素電路106根據資料訊號D(1)、…、D(M)進行顯示操作，其中M為自然數。藉此，顯示裝置100即可顯示影像。
第2圖為根據本發明實施例所繪示的像素電路106的示意圖。為使敘述簡單，以下段落僅以單一像素電路106為例進行說明。
在本實施例中，像素電路106接收前述閘極訊號G(1)、…、G(N)中的一者做為閘極訊號S1-S3(亦即，第1圖中閘極訊號G(1)、…、G(N)中的一者實際上包括閘極訊號S1-S3)，並接收前述資料訊號D(1)、…、D(M)中的一者做為資料電壓Vdata。在本實施例中，閘極訊號S1-S3彼此不同。
在本實施例中，像素電路106包括驅動電晶體T5、開關T1-T4、T6、儲存電容Cst以及發光元件OLD。在一實施例中，驅動電晶體T5及開關T1-T4、T6可用薄膜電晶體(thin film transistor，TFT)實現，然而其它種類的開關及/或電晶體亦在本案範圍之中。在一實施例中，驅動電晶體T5及開關T1-T4、T6可用p型電晶體實現，然而本案不以此為限。在一實施例中，發光元件OLD可用有機發光二極體實現，然其它種類的發光元件OLD亦在本 案範圍之中。
在本實施例中，驅動電晶體T5的第一端電性連接供應電壓OVDD的電壓源，驅動電晶體T5的第二端電性連接發光元件OLD的陽極端，且驅動電晶體T5的控制端電性連接儲存電容Cst的第一端(下稱節點A)。
在本實施例中，發光元件OLD的陰極端電性連接供應電壓OVSS的電壓源。
在本實施例中，開關T1的第一端電性連接供應電壓OVDD的電壓源並用以接收供應電壓OVDD，開關T1的第二端電性連接儲存電容Cst的第二端(下稱節點B)，且開關T1的控制端用以接收閘極訊號S1。在一實施例中，開關T1用以根據閘極訊號S1導通，以提供供應電壓OVDD至節點B。
開關T2的第一端電性連接供應電壓OVDD的電壓源並用以接收供應電壓OVDD，開關T2的第二端電性連接節點A，且開關T2的控制端用以接收閘極訊號S2。在一實施例中，開關T2用以根據閘極訊號S2導通，以提供供應電壓OVDD至節點A。
開關T3的第一端電性連接提供資料電壓Vdata的資料線並用以接收資料電壓Vdata，開關T3的第二端電性連接開關T4的第一端，且開關T3的控制端用以接收閘極訊號S2。在一實施例中，開關T3用以根據閘極訊號S2導通，以提供資料電壓Vdata至開關T4的第一端。
開關T4的第一端電性連接開關T4的控制 端，開關T4的第二端電性連接節點B。在一實施例中，開關T4用以接收來自開關T3的資料電壓Vdata，並根據資料電壓Vdata，提供一操作電壓至節點B，其中操作電壓相應於開關T4的臨界電壓Vth_T4(如開關T4中的電晶體的臨界電壓)及資料電壓Vdata。
換言之，開關T3、T4共同用以根據來自資料線的資料電壓Vdata及閘極訊號S2，提供相應於資料電壓Vdata及開關T4的臨界電壓Vth_T4之操作電壓至節點B。
開關T6的第一端電性連接節點B，開關T6的第二端電性連接參考電壓VREF的電壓源並用以接收參考電壓VREF，且開關T6的控制端用以接收閘極訊號S3。在一實施例中，開關T6用以根據閘極訊號S3導通，以提供參考電壓VREF至節點B。
以下將搭配第3圖至第6圖說明在一操作例中的像素電路106的操作。
同時參照第3圖、第6圖，第3圖為根據本發明一操作例所繪示的像素電路106的示意圖，第6圖根據本發明一操作例所繪示的像素電路106的訊號示意圖。
在期間D0中(如前一幀(frame)的發光階段)，節點A上的電壓VA可表示為：VA=OVDD+VREF-Vdata_PRE-|Vth_T4|。其中，電壓Vdata_PRE代表前一幀的資料電壓。節點B上的電壓VB可等於參考電壓VREF。關於此一階段中的電壓VA、VB 將在以下關於期間D3的段落中進一步說明。
在期間D1中(如重置階段)，閘極訊號S1具有第一電壓位準(如低電壓位準)，閘極訊號S2、S3具有第二電壓位準(如高電壓位準)。此時，開關T2、T3根據閘極訊號S2關斷，且開關T6根據閘極訊號S3關斷。此時，開關T1根據閘極訊號S1導通，以提供供應電壓OVDD至節點B，以令節點B上的電壓VB由參考電壓VREF改變為供應電壓OVDD。
另一方面，透過電容Cst的耦合效應，此時節點A上的電壓VA相應於節點B上的電壓VB的變化(即供應電壓OVDD-參考電壓VREF)而改變為VA=2OVDD-Vdata_PRE-|Vth_T4|。
此時，驅動電晶體T5的源極與閘極之電壓差Vsg_T5為-OVDD+Vdata_PRE+|Vth_T4|。因此，若希望在期間D1中驅動電晶體T5關斷，則電壓差Vsg_T5小於驅動電晶體T5的臨界電壓Vth_T5的絕對值，亦即，-OVDD+Vdata_PRE+|Vth_T4|<|Vth_T5|。是以，若將臨界電壓Vth_T4、Vth_T5設置為彼此相同，則上式可化簡為OVDD-Vdata_PRE>0。
換言之，藉由設置臨界電壓Vth_T4、Vth_T5彼此相同、且每一幀的資料電壓(如資料電壓Vdata_PRE、Vdata)小於供應電壓OVDD，則可使驅動電晶體T5在期間D1中關斷。
同時參照第4圖、第6圖，在期間D2中(如資 料寫入階段)，閘極訊號S1、S3具有第二電壓位準(如高電壓位準)，閘極訊號S2具有第一電壓位準(如低電壓位準)。此時，開關T1根據閘極訊號S1關斷，且開關T6根據閘極訊號S3關斷。此時，開關T2根據閘極訊號S2導通，以提供供應電壓OVDD至節點A，以使節點A上的電壓VA成為供應電壓OVDD。另一方面，開關T3根據閘極訊號S2導通，以提供資料電壓Vdata至開關T4的第一端及控制端，以透過開關T4提供操作電壓(如為資料電壓Vdata與開關T4的臨界電壓Vth_T4的總和)至節點B，以使節點B上的電壓VB成為操作電壓(即VB=Vdata+Vth_T4)。
同時參照第5圖、第6圖，在期間D3中(如發光階段)，閘極訊號S1、S2具有第二電壓位準(如高電壓位準)，閘極訊號S3具有第一電壓位準(如低電壓位準)。此時，開關T1根據閘極訊號S1關斷，且開關T2、T3根據閘極訊號S2關斷。此時，開關T6根據閘極訊號S3導通，以提供參考電壓VREF至節點B，以將節點B上的電壓VB由前述操作電壓(即Vdata+Vth_T4)改變為參考電壓VREF。
另一方面，透過電容Cst的耦合效應，節點A上的電壓VA相應於節點B上的電壓VB的變化(即參考電壓VREF-操作電壓(即VREF-Vdata-Vth_T4))而改變為VA=OVDD+VREF-Vdata-|Vth_T4|。
此時，根據電流公式，通過驅動電晶體T5的 驅動電流IOLD可表示為IOLD=1/2K(Vsg_T5-| Vth_T5|)2=1/2K(-VREF+Vdata+|Vth_T4|-|Vth_T5|)2。其中，Vsg_T5表示驅動電晶體T5的源極與閘極之電壓差，且K為常數。在預設臨界電壓Vth_T4、Vth_T5彼此相同的情況下，上式可化簡為IOLD=1/2K(Vdata-VREF)2。由上式可知，在期間D3中，驅動電流IOLD的大小僅相應於參考電壓VREF與資料電壓Vdata，而與驅動電晶體T5的臨界電壓Vth_T5無關。
是以，透過上述的設置，即可避免因驅動電晶體T5的臨界電壓Vth_T5偏移導致的顯示裝置100的畫面亮度不均的問題。
此外，在上述的實施例中，在期間D3中，由於驅動電流IOLD的電流路徑上可以沒有驅動電晶體T5外的其它開關，故可避免因其它開關的導通電阻而減低驅動電流IOLD，從而造成發光元件OLD的反應時間變慢。
應注意到，在不同實施例中，驅動電流1OLD的電流路徑上仍可能具有其它開關，故本案不以上述實施例為限。
第7圖為根據本發明實施例所繪示的像素電路106a的示意圖。在本實施例中，像素電路106a大致相似於像素電路106，故重覆的部份不再贅述。
在本實施例中，像素電路106a更包括開關T7。在一實施側中，開關T7可用薄膜電晶體實現，然而 其它種類的開關及/或電晶體亦在本案範圍之中。在一實施例中，開關T7可用p型電晶體實現，然而本案不以此為限。
在本實施例中，開關T7的第一端電性連接發光元件OLD的陽極端，開關T7的第二端電性連接參考電壓VREF的電壓源，且開關T7的控制端用以接收閘極訊號S1。在一實施例中，開關T7用以根據閘極訊號S1導通，以提供參考電壓VREF至發光元件OLD的陽極端。
在一實施例中，在前述期間D1中，開關T7根據閘極訊號S1導通，以提供參考電壓VREF至發光元件OLD的陽極端，以重置發光元件OLD的陽極端的電壓。在一實施例中，參考電壓VREF與供應電壓OVSS的電壓差可設置為小於發光元件OLD的臨界電壓，以避免在期間D1中使發光元件OLD誤發光。
另外，在前述期間D2、D3中，開關T7根據閘極訊號S1關斷。
第8圖為根據本發明實施例所繪示的像素電路106b的示意圖。在本實施例中，像素電路106b大致相似於像素電路106a，故重覆的部份不再贅述。
在本實施例中，相較於像素電路106a，像素電路106b省略開關T1，並使開關T7的控制端改為用以接收閘極訊號S2，以省略閘極訊號S1。另外，開關T6的第二端接收的參考電壓VREF可具有不同電壓位準。以下將具有第一參考電壓位準的參考電壓VREF稱為第一參考電壓VREF1，並將具有第二參考電壓位準的參考電壓 VREF稱為第二參考電壓VREF2。在一實施例中，第一參考電壓位準與第二參考電壓位準彼此不同，且第一參考電壓VREF1與第二參考電壓VREF2彼此不同。在一實施例中，閘極訊號S2、S3彼此相位為180度反相，閘極訊號S2、S3也可以是彼此不同時致能的訊號組合。
關於像素電路106b的驅動電晶體T5、開關T2-T4、T6、T7、儲存電容Cst以及發光元件OLD間的其它連接關係大致相同於像素電路106a中的連接關係，故在此不贅述。
應注意到，在不同實施例中，像素電路106b開關T7可選擇性省略，故本案不以第8圖中所繪示電路為限。
同時參照第8圖、第9圖，在期間D0中(如前一幀的發光階段)，節點A上的電壓VA可表示為：VA=OVDD+VREF1-Vdata_PRE-|Vth_T4|。節點B上的電壓VB可等於第一參考電壓VREF1。關於此一階段中的電壓VA、VB將在以下段落中進一步說明。
在期間D1中(如重置階段)，閘極訊號S3具有第一電壓位準(如低電壓位準)，閘極訊號S2具有第二電壓位準(如高電壓位準)。此時，開關T2、T3、T7根據閘極訊號S2關斷。此時，開關T6根據閘極訊號S3導通，以提供第二參考電壓VREF2至節點B，以令節點B上的電壓VB由第一參考電壓VREF1改變為第二參考電壓VREF2。
另一方面，透過電容Cst的耦合效應，節點A 上的電壓VA相應於節點B上的電壓VB的變化(即第二參考電壓VREF2-第一參考電壓VREF1)而改變為VA=OVDD-Vdata_PRE-|Vth_T4|+VREF2。在第二參考電壓VREF2設為與供應電壓OVDD具有相同電壓位準的情況下，上式可化簡為VA=2OVDD-Vdata_PRE-|Vth_T4|。
此時，驅動電晶體T5的源極與閘極之電壓差Vsg_T5為-OVDD+Vdata_PRE+|Vth_T4|。因此，若希望在期間D1中驅動電晶體T5關斷，則電壓差Vsg_T5小於驅動電晶體T5的臨界電壓Vth_T5的絕對值，亦即-OVDD+Vdata_PRE+|Vth_T4|<|Vth_T5|。是以，若將臨界電壓Vth_T4、Vth_T5設置為彼此相同，則上式可化簡為OVDD-Vdata_PRE>0。
換言之，藉由設置臨界電壓Vth_T4、Vth_T5彼此相同、且每一幀的資料電壓(如資料電壓Vdata_PRE、Vdata)小於供應電壓OVDD，則可使驅動電晶體T5在期間D1中關斷。
在期間D2中(如資料寫入階段)，閘極訊號S3具有第二電壓位準(如高電壓位準)，閘極訊號S2具有第一電壓位準(如低電壓位準)。此時，開關T6根據閘極訊號S3關斷。此時，開關T2根據閘極訊號S2導通，以提供供應電壓OVDD至節點A，以使節點A上的電壓VA成為供應電壓OVDD。另一方面，開關T3根據閘極訊號S2導通，以提供資料電壓Vdata至開關T4的第一端及控制端，以令開關T4提供操作電壓(如為資料電壓Vdata與開關T4 的臨界電壓Vth_T4的總和)至節點B，以使節點B上的電壓VB成為操作電壓(即VB=Vdata+Vth_T4)。另外，開關T7根據閘極訊號S2導通，以提供第一參考電壓VREF1至發光元件OLD的陽極端，以重置發光元件OLD的陽極端的電壓。在一實施例中，第一參考電壓VREF1與供應電壓OVSS的電壓差可設置為小於發光元件OLD的臨界電壓，以避免在期間D1中使發光元件OLD誤發光。在一實施例中，第一參考電壓VREF1可設為與供應電壓OVSS具有相同電壓位準。
在期間D3中(如發光階段)，閘極訊號S2具有第二電壓位準(如高電壓位準)，閘極訊號S3具有第一電壓位準(如低電壓位準)。此時，開關T2、T3、T7根據閘極訊號S2關斷。此時，開關T6根據閘極訊號S3導通，以提供第一參考電壓VREF1至節點B，以令節點B上的電壓VB由前述操作電壓(即Vdata+Vth_T4)改變為第一參考電壓VREF1。
另一方面，透過電容Cst的耦合效應，節點A上的電壓VA相應於節點B上的電壓VB的變化(即第一參考電壓VREF1-操作電壓(即Vdata+Vth_T4))而改變為VA=OVDD+VREF1-Vdata-|Vth_T4|。
此時，根據電流公式，通過驅動電晶體T5的驅動電流IOLD可表示為IOLD=1/2K(Vsg_T5-|Vth_T5|)2=1/2K(-VREF1+Vdata+|Vth_T4|-|Vth_T5|)2。其中， Vsg_T5表示驅動電晶體T5的源極與閘極之電壓差，且K為常數。在臨界電壓Vth_T4、Vth_T5彼此相同的情況下，上式可化簡為IOLD=1/2K(Vdata-VREF1)2。由上式可知，在期間D3中，驅動電流IOLD的大小僅相應於第一參考電壓VREF1與資料電壓Vdata，而與驅動電晶體T5的臨界電壓Vth_T5之數值無關。
是以，透過上述的設置，即可避免因驅動電晶體T5的臨界電壓Vth_T5偏移導致的顯示裝置100的畫面亮度不均的問題。
此外，在上述的實施例中，在期間D3中，由於驅動電流IOLD的電流路徑上沒有驅動電晶體T5外的其它開關，故可避免因其它開關的導通電阻而減低驅動電流IOLD，從而造成發光元件OLD的反應時間變慢。
應注意到，在不同實施例中，驅動電流IOLD的電流路徑上仍可能具有其它開關，舉例而言，驅動電流IOLD的電流路徑上可具有發光控制開關，亦即驅動電晶體T5與發光元件OLD之間可以透過發光控制開關電性連接，當發光控制開關導通時，驅動電流IOLD流經發光控制開關至發光元件OLD以使發光元件OLD進行發光，故本案不以上述實施例為限。
第10圖為根據本發明實施例所繪示的像素電路106c的示意圖。在本實施例中，像素電路106c大致相似於像素電路106b，故重覆的部份不再贅述。
在本實施例中，相較於像素電路106b，像素 電路106c中的開關T6可改為用n型電晶體實現，且像素電路106c中的開關T6的控制端接收閘極訊號S2，以省略閘極訊號S3。
應注意到，在不同實施例中，像素電路106c開關T7可選擇性省略，故本案不以第10圖中所繪示電路為限。
同時參照第10圖、第11圖，在期間D0中(如前一幀的發光階段)，節點A上的電壓VA可表示為：VA=OVDD+VREF1-Vdata_PRE-|Vth_T4|。節點B上的電壓VB可等於第一參考電壓VREF1。關於此一階段中的電壓VA、VB將在以下段落中進一步說明。
在期間D1中(如重置階段)，閘極訊號S2具有第二電壓位準(如高電壓位準)。此時，開關T2、T3、T7根據閘極訊號S2關斷。此時，開關T6根據閘極訊號S2導通，以提供第二參考電壓VREF2至節點B，以令節點B上的電壓VB由第一參考電壓VREF1改變為第二參考電壓VREF2。另一方面，節點A上的電壓VA可表示為VA=2OVDD-Vdata_PRE-|Vth_T4|。相關細節可參照前述關於像素電路106b的相應說明，故在此不贅述。
在期間D2中(如資料寫入階段)，閘極訊號S2具有第一電壓位準(如低電壓位準)。此時，開關T6根據閘極訊號S2關斷。此時，開關T2根據閘極訊號S2導通，以提供供應電壓OVDD至節點A。另一方面，開關T3根據閘極訊號S2導通，以提供資料電壓Vdata至開關T4的第一端及 控制端，以令開關T4提供操作電壓(如為資料電壓Vdata與開關T4的臨界電壓Vth_T4的總和)至節點B，以使節點B上的電壓VB成為操作電壓(即VB=Vdata+Vth_T4)。另外，開關T7根據閘極訊號S2導通，以提供第一參考電壓VREF1至發光元件OLD的陽極端。期間D2中像素電路106c的操作可參照前述關於像素電路106b的相應說明，故在此不贅述。
在期間D3中(如發光階段)，閘極訊號S2具有第二電壓位準(如高電壓位準)。此時，開關T2、T3、T7根據閘極訊號S2關斷。此時，開關T6根據閘極訊號S2導通，以提供第一參考電壓VREF1至節點B。此時，節點A上的電壓VA可表示為VA=OVDD+VREF1-Vdata-|Vth_T4|。期間D3中像素電路106c的操作可參照前述關於像素電路106b的相應說明，故在此不贅述。
第12圖為根據本發明實施例所繪示的像素電路106d的示意圖。在本實施例中，像素電路106d大致相似於像素電路106b，故重覆的部份不再贅述。
在本實施例中，相較於像素電路106b，像素電路106d中的開關T2、T3、T7可改為用n型電晶體實現，且像素電路106c中的開關T2、T3、T7的控制端改為用以接收閘極訊號S3，以省略閘極訊號S2。
應注意到，在不同實施例中，像素電路106d的開關T7可選擇性省略，故本案不以第12圖中所繪示電路為限。
同時參照第12圖、第13圖，在期間D0中(如前 一幀的發光階段)，節點A上的電壓VA可表示為：VA=OVDD+VREF1-Vdata_PRE-|Vth_T4|。節點B上的電壓VB可等於第一參考電壓VREF1。關於此一階段中的電壓VA、VB將在以下段落中進一步說明。
在期間D1中(如重置階段)，閘極訊號S3具有第一電壓位準(如低電壓位準)。此時，開關T2、T3、T7根據閘極訊號S3關斷。此時，開關T6根據閘極訊號S3導通，以提供第二參考電壓VREF2至節點B，以令節點B上的電壓VB由第一參考電壓VREF1改變為第二參考電壓VREF2。另一方面，節點A上的電壓VA可表示為VA=2OVDD-Vdata_PRE-|Vth_T4|。相關細節可參照前述關於像素電路106b的相應說明，故在此不贅述。
在期間D2中(如資料寫入階段)，閘極訊號S3具有第二電壓位準(如高電壓位準)。此時，開關T6根據閘極訊號S3關斷。此時，開關T2根據閘極訊號S3導通，以提供供應電壓OVDD至節點A。另一方面，開關T3根據閘極訊號S3導通，以提供資料電壓Vdata至開關T4的第一端及控制端，以令開關T4提供操作電壓(如為資料電壓Vdata與開關T4的臨界電壓Vth_T4的總和)至節點B，以使節點B上的電壓VB成為操作電壓(即VB=Vdata+Vth_T4)。另外，開關T7根據閘極訊號S3導通，以提供第一參考電壓VREF1至發光元件OLD的陽極端。期間D2中像素電路106d的操作可參照前述關於像素電路106b的相應說明，故在此不贅述。
在期間D3中(如發光階段)，閘極訊號S3具有第 一電壓位準(如低電壓位準)。此時，開關T2、T3、T7根據閘極訊號S3關斷。此時，開關T6根據閘極訊號S3導通，以提供第一參考電壓VREF1至節點B。此時，節點A上的電壓VA可表示為VA=OVDD+VREF1-Vdata-|Vth_T4|。期間D3中像素電路106d的操作可參照前述關於像素電路106b的相應說明，故在此不贅述。
雖然本發明已以實施例揭露如上，然其並非用以限定本發明，任何熟習此技藝者，在不脫離本發明之精神和範圍內，當可作各種之更動與潤飾，因此本發明之保護範圍當視後附之申請專利範圍所界定者為準。

Claims (20)

  1. 一種像素電路，包括：一發光元件；一儲存電容；一驅動電晶體，其中該驅動電晶體的一第一端接收一供應電壓，該驅動電晶體的一第二端電性連接該發光元件的一陽極端，且該驅動電晶體的一控制端電性連接該儲存電容的一第一端；一第一開關，用以提供一第一參考電壓至該儲存電容的一第二端；一第二開關，用以提供該供應電壓至該儲存電容的該第一端；一第三開關，電性連接該儲存電容的該第二端；以及一第四開關，電性連接該第三開關，用以接收一資料電壓；其中該第三開關及該第四開關用以提供相應於該資料電壓與該第三開關的一臨界電壓之一操作電壓至該儲存電容的該第二端。
  2. 如請求項1所述之像素電路，更包括：一第五開關，用以提供該第一參考電壓至該發光元件的該陽極端。
  3. 如請求項1所述之像素電路，更包括：一第六開關，用以提供該供應電壓至該儲存電容的該第二端。
  4. 如請求項3所述之像素電路，其中在一第一階段，該第六開關根據一第一閘極訊號導通，以提供該供應電壓至該儲存電容的該第二端，且該第一開關、該第二開關、及該第四開關關斷。
  5. 如請求項3所述之像素電路，其中在一第二階段，該第二開關根據一第二閘極訊號導通，以提供該供應電壓至該儲存電容的該第一端，該第四開關根據該第二閘極訊號導通，以提供該資料電壓至該第三開關，且該第一開關及該第六開關關斷。
  6. 如請求項3所述之像素電路，其中在一第三階段，該第一開關根據一第三閘極訊號導通，以提供該第一參考電壓至該儲存電容的該第二端，以令該驅動電晶體驅動該發光元件，且該第二開關、該第四開關、及該第六開關關斷。
  7. 如請求項1所述之像素電路，其中該第一開關更用以提供一第二參考電壓至該儲存電容的該第二端。
  8. 如請求項7所述之像素電路，其中在一第一階段，該第一開關根據一第一閘極訊號導通，以提供一第二參考電壓至該儲存電容的該第二端，且該第二開關及該第四開關關斷。
  9. 如請求項7所述之像素電路，其中在一第二階段，該第二開關根據一第二閘極訊號導通，以提供該供應電壓至該儲 存電容的該第一端，該第四開關根據該第二閘極訊號導通，以提供該資料電壓至該第三開關，且該第一開關關斷。
  10. 如請求項7所述之像素電路，其中在一第三階段，該第一開關根據該第一閘極訊號導通，以提供該第一參考電壓至該儲存電容的該第二端，以令該驅動電晶體驅動該發光元件，且該第二開關及該第四開關關斷。
  11. 如請求項7所述之像素電路，其中該第二開關及該第四開關根據一閘極訊號的一第一電壓位準導通，且該第一開關根據該閘極訊號的一第二電壓位準導通。
  12. 如請求項1所述之像素電路，其中該第三開關的一第一端電性連接該第三開關的一控制端。
  13. 如請求項1所述之像素電路，其中該第三開關的該臨界電壓大致相等於該驅動電晶體的一臨界電壓。
  14. 一種像素電路，包括：一發光元件；一儲存電容；一驅動電晶體，其中該驅動電晶體的一第一端接收一供應電壓，該驅動電晶體的一第二端電性連接該發光元件的一陽極端，且該驅動電晶體的一控制端電性連接該儲存電容的一第一端； 一第一開關，其中該第一開關的一第一端電性連接該儲存電容的一第二端，且該第一開關的一第二端用以接收一第一參考電壓；一第二開關，其中該第二開關的一第一端電性連接該儲存電容的該第一端，且該第二開關的一第二端用以接收該供應電壓；一第三開關，其中該第三開關的一第一端電性連接該儲存電容的該第二端，且該第三開關的一第二端電性連接該第三開關的一控制端；以及一第四開關，其中該第四開關的一第一端電性連接該第三開關的該第二端，且該第四開關的一第二端用以接收一資料電壓。
  15. 如請求項14所述之像素電路，更包括：一第五開關，其中該第五開關的一第一端電性連接該發光元件的該陽極端，且該第五開關的一第二端用以接收該第一參考電壓。
  16. 如請求項15所述之像素電路，更包括：一第六開關，其中該第六開關的一第一端電性連接該儲存電容的該第二端，且該第六開關的一第二端用以接收該供應電壓。
  17. 如請求項16所述之像素電路，其中該第一開關的一控制端用以接收一第一閘極訊號，該第二開關的一控制端與該第四開關的一控制端用以接收一第二閘極訊號，且該第五開關的一控制端與該第六開關的一控制端用以接收一第三閘極訊 號，其中該第一閘極訊號、該第二閘極訊號、與該第三閘極訊號彼此不同。
  18. 如請求項15所述之像素電路，其中該第一開關的該第二端更用以接收一第二參考電壓，其中該第二參考電壓不同於該第一參考電壓。
  19. 如請求項18所述之像素電路，其中該第一開關的一控制端用以接收一第一閘極訊號，該第二開關的一控制端、該第四開關的一控制端、與該第五開關的一控制端用以接收一第二閘極訊號，其中該第一閘極訊號與該第二閘極訊號不同。
  20. 如請求項18所述之像素電路，其中該第一開關的一控制端、該第二開關的一控制端、該第四開關的一控制端、與該第五開關的一控制端用以接收同一閘極訊號；在該第一開關利用p型電晶體製造而成的情況下，第二開關、該第四開關、與該第五開關利用n型電晶體製造而成；且在該第一開關利用n型電晶體製造而成的情況下，第二開關、該第四開關、與該第五開關利用p型電晶體製造而成。
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