TW201445884A - 移位暫存器電路及其操作方法 - Google Patents

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Abstract

移位暫存器電路中的第N級移位暫存器單元包含輸入電路、穩壓單元及輸出電路。該輸入電路係設置以根據第(N-K)級移位暫存器單元的第一掃描訊號或第(N+K)級移位暫存器單元的第二掃描訊號而控制第N級移位暫存器單元的控制端點的電壓。該穩壓單元包含第一耦合元件設置以接收第一時脈訊號、第一開關設置以接收該控制端點的電壓，及開關控制單元設置以根據該第一時脈訊號而控制該第一開關。該輸出電路係設置以接收該第一時脈訊號及該控制端點的電壓，及輸出第三掃描訊號。一種相對應的移位暫存器電路的操作方法亦揭露於此。

Description

移位暫存器電路及其操作方法
本發明係關於一種移位暫存器電路，尤指一種移位暫存器電路的穩壓單元及操作方法。
移位暫存器(shift register)電路目前已被廣泛使用於電子產品中，然而，現有的移位暫存器在使用時，內部電晶體容易發生漏電的情形，導致移位暫存器電路的效能下降及增加不必要的功率損耗。此外，漏電效應會使移位暫存器出現多脈波(multi-pulse)，使得移位暫存器的時序發生錯誤，若是在應用於液晶顯示器時，將導致顯示畫面具有水平亮紋(horizontal line)的情形，造成顯示品質大幅下降。因此，如何改善移位暫存器電路的漏電情形是極為重要的議題。
本發明之一實施例係關於一種移位暫存器電路，移位暫存器電路具有多個移位暫存器單元，多個移位暫存器單元中的第N級移位暫存器單元包含輸入電路、穩壓單元及輸出電路。輸入電路係設置以根據第(N-K)級移位暫存器單元的第一掃描訊號或第(N+K)級移位暫存器單元的第二掃描訊號而控制第N級移位暫存器單元的控制端點的電壓，N及K係為正整數且N≧K。穩壓單元包含第一耦合元件、第一開關及開關控制單元。第一耦合元件具有設置以接收第一時脈訊號的第一端，及第二端。第一開關具有電性耦接於第一耦合元件之第二端的第一端、電性耦接於輸入電路以接收控制端點的電壓 的控制端，及第二端。開關控制單元係電性耦接第一開關的第二端及地端，設置以根據第一時脈訊號而控制第一開關的第二端的電壓，以使第一開關的控制端與第一開關的第二端週期性的逆偏。輸出電路具有設置以接收第一時脈訊號的第一端、電性耦接於輸入電路以接收控制端點的電壓的控制端，及設置以輸出第N級移位暫存器單元的第三掃描訊號的第二端。
本發明之另一實施例係關於一種操作上述第N級移位暫存器電路的方法，包含根據第(N-K)級移位暫存器單元的第一掃描訊號或第(N+K)級移位暫存器單元的第二掃描訊號而控制控制端點的電壓、通過輸出電路接收第一時脈訊號及控制端點的電壓，並根據第一時脈訊號及控制端點的電壓輸出第三掃描訊號。及通過開關控制單元以根據第一時脈訊號控制第一開關的第二端的電壓以使第一開關的控制端與第一開關的第二端週期性的逆偏。
透過本發明實施例移位暫存器單元的設置，由於穩壓單元可使第一開關的控制端與第一開關的第二端週期性的逆偏，故可降低第一開關漏電的情形，且若將移位暫存器單元應用於顯示器時，可改善顯示器的顯示品質。
10‧‧‧移位暫存器電路
20‧‧‧輸入電路
30‧‧‧穩壓單元
32‧‧‧第一耦合元件
40‧‧‧輸出電路
50‧‧‧失能電路
70‧‧‧開關控制單元
72‧‧‧第二耦合元件
100、500‧‧‧第N級移位暫存器單元
202、204、206、208‧‧‧步驟
G(N-K)‧‧‧第一掃描訊號
G(N+K)‧‧‧第二掃描訊號
BOOST‧‧‧控制端點Q的電壓
Bi‧‧‧第一邏輯訊號
XBi‧‧‧第二邏輯訊號
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
T8‧‧‧第八開關
CK‧‧‧第一時脈訊號
Q‧‧‧控制端點
G(N)‧‧‧第三掃描訊號
XCK‧‧‧第二時脈訊號
VSS‧‧‧地端
N1、N2‧‧‧節點
第1圖係為本發明實施例移位暫存器電路之示意圖。
第2圖係為第1圖移位暫存器電路之第N級移位暫存器單元之示意圖。
第3圖係為操作第2圖第N級移位暫存器單元之方法。
第4圖係為操作第2圖第N級移位暫存器單元之時序圖。
第5圖係為本發明另一實施例之第N級移位暫存器單元之示意圖。
下文依本發明實施例配合所附圖式作詳細說明，但所提供之實施 例並非用以限制本發明所涵蓋的範圍。
請參考第1圖及第2圖，第1圖係為本發明實施例移位暫存器電路10之示意圖，第2圖係為第1圖移位暫存器電路10之第N級移位暫存器單元100之示意圖，移位暫存器電路10具有多個移位暫存器單元100，且第N級的移位暫存器單元100係為本發明移位暫存器電路10之第N級移位暫存器單元100，N係為正整數。
如第2圖所示，移位暫存器單元100包含輸入電路20、穩壓單元30、輸出電路40，除此之外，移位暫存器單元100還更包含失能電路(disable circuit)50。輸入電路20係設置以根據移位暫存器電路10之第(N-K)級移位暫存器單元(亦即第N級移位暫存器單元100的前K級移位暫存器單元)的第一掃描訊號G(N-K)或移位暫存器電路10之第(N+K)級移位暫存器單元(亦即第N級移位暫存器單元100的後K級移位暫存器單元)的第二掃描訊號G(N+K)而產生第N級移位暫存器單元100的控制端點Q的電壓BOOST，K係為正整數且N≧K。
穩壓單元30包含第一耦合元件32、第一開關T1及開關控制單元70。第一耦合元件32具有設置以接收第一時脈訊號CK的第一端，及第二端N1。第一開關T1具有電性耦接於第一耦合元件32之第二端N1的第一端、電性耦接於輸入電路20以接收控制端點Q的電壓BOOST的控制端，及第二端N2。開關控制單元70係設置以根據第一時脈訊號CK而控制第一開關T1的第二端N2的電壓，以使第一開關T1的控制端與第二端N2週期性的逆偏。
輸出電路40具有設置以接收第一時脈訊號CK的第一端、電性耦接於輸入電路20以接收控制端點Q的電壓BOOST的控制端，及設置以輸出 移位暫存器單元100的第三掃描訊號G(N)的第二端。失能電路50係電性耦接於第一耦合元件32之第二端N1及輸入電路20，並設置以接收第二時脈訊號XCK，以根據第一耦合元件32之第二端N1的電位及第二時脈XCK而控制控制端點Q的電壓BOOST及第三掃描訊號G(N)的準位。
根據本發明的其中一實施例，開關控制單元70包含第二開關T2及第二耦合元件72。第二開關T2具有第一端電性耦接於第一開關T1之第二端N2，控制端電性耦接於輸入電路20以接收控制端點Q的電壓BOOST，及第二端電性耦接於地端VSS。第二耦合元件72具有第一端電性耦接於第一開關T1之第二端N2，及第二端設置以接收第一時脈訊號CK。
根據本發明的其中一實施例，輸入電路20係設置以接收第一邏輯訊號Bi、第二邏輯訊號XBi、第一掃描訊號G(N-K)及第二掃描訊號G(N+K)，並根據第一掃描訊號G(N-K)及第二掃描訊號G(N+K)而決定響應第一邏輯訊號Bi或第二邏輯訊號XBi控制控制端點Q的電壓Boost。第一邏輯訊號Bi及第二邏輯訊號XBi在大部分時間可為互為反相之兩邏輯訊號。
根據本發明的其中一實施例，輸入電路20包含第三開關T3及第四開關T4。第三開關T3具有設置以接收第一邏輯訊號Bi的第一端、設置以接收第一掃描訊號G(N-K)的控制端，及電性耦接於第一開關T1之控制端及第二開關T2之控制端的第二端。第四開關T4具有電性耦接於第三開關T3之第二端的第一端、設置以接收第二掃描訊號G(N+K)的控制端，及設置以接收第二邏輯訊號XBi的第二端。在本實施例中，此設置係可以使得移位暫存器電路10據有雙向傳輸的功能，亦即可以使得移位暫存器電路10具有能夠選擇輸出的掃描訊號的脈波欲由上而下或者由下而上掃描的功能，但此功能僅為多種實施方式之一，並非所有的移位暫存器電路都須具備雙向傳輸的功 能。
根據本發明的其中一種實施例，輸出電路40包含第八開關T8，第八開關T8具有設置以接收第一時脈訊號CK的第一端，電性耦接於輸入電路20以接收控制端點Q的電壓Boost的控制端，及設置以輸出第N級移位暫存器單元100之第三掃描訊號G(N)的第二端。
根據本發明的其中一實施例，失能電路50包含第五開關T5、第六開關T6及第七開關T7。第五開關T5之第一端係電性耦接於第三開關T3之第二端以及第八開關T8之控制端，第五開關T5之控制端係電性耦接於第一耦合元件32之第二端N1，第五開關T5之第二端係電性耦接於輸出電路40之第二端。第六開關T6之第一端係電性耦接於第五開關T5之第二端，第六開關T6之控制端係電性耦接於第一耦合元件32之第二端N1，第六開關T6之第二端係電性耦接於地端VSS。第七開關T7之第一端係電性耦接於第五開關T5之第二端、第七開關T7之控制端係設置以接收第二時脈XCK，第七開關T7之第二端係電性耦接於地端VSS。第一時脈訊號CK及第二時脈訊號XCK可為互為反相之兩時脈。
以上所述之第一開關T1至第八開關T8可例如是NMOS或PMOS等元件，但本發明並不限定第一開關T1至第八開關T8的元件類型。此外，第一耦合元件32及第二耦合元件72可為電容或電阻等被動元件，而本發明並不限定第一耦合元件32及第二耦合元件72的元件類型。
請注意，雖然輸入電路20、穩壓單元30、輸出電路40及失能電路50中的細部元件已舉例於第2圖，然而，本發明並不限定輸入電路20、穩壓單元30、輸出電路40及失能電路50的細部元件須設置如第2圖，亦可 作其他設置，任何對第2圖輸入電路20、穩壓單元30、輸出電路40及失能電路50之均等變化與修飾，皆應屬本發明之涵蓋範圍。
請參考第3圖並搭配第2圖，第3圖係為操作第2圖第N級移位暫存器單元100之方法，說明如下：步驟202：通過輸入電路20根據第(N-K)級移位暫存器單元的第一掃描訊號G(N-K)或第(N+K)級移位暫存器單元的第二掃描訊號G(N+K)而產生控制端點Q的電壓Boost；步驟204：通過輸出電路40接收第一時脈訊號CK及控制端點Q的電壓Boost，以輸出第三掃描訊號G(N)；步驟206：通過失能電路50控制控制端點Q的電壓Boost及第三掃描訊號G(N)的準位；步驟208：通過開關控制單元70以根據第一時脈訊號CK控制第一開關T1的第二端的電壓，以使第一開關T1的控制端與第一開關T1的第二端週期性的逆偏。
在步驟202中，通過輸入電路20根據第一掃描訊號G(N-K)及第二掃描訊號G(N+K)而產生控制端點Q的電壓Boost可例如是透過輸入電路20根據第一邏輯訊號Bi、第二邏輯訊號XBi、第一掃描訊號G(N-K)及第二掃描訊號G(N+K)來產生控制端點Q的電壓Boost。在步驟204中，第三掃描訊號G(N)係設置以輸出至下一級移位暫存器單元之輸入單元。
在步驟206中，通過失能電路50控制控制端點的電壓Boost及第三掃描訊號G(N)的準位可例如是以根據第一耦合元件32之第二端的電位及第二時脈訊號XCK的方式下拉控制端點Q的電壓Boost及第三掃描訊號G(N)的準位。在步驟208中，通過開關控制單元70以根據第一時脈訊號CK控制 第一開關T1的第二端的電壓，以使第一開關T1的控制端與第二端週期性的逆偏可例如是，透過開關控制單元70的第二開關T2使第一開關T1的第二端與地端VSS斷開並且透過第二耦合元件32接收第一時脈訊號CK，以根據第一時脈訊號CK來控制第一開關T1的第二端的電位。
請參考第4圖，第4圖係為操作第2圖第N級移位暫存器單元100之時序圖，在第4圖中，第一邏輯訊號Bi、第二邏輯訊號XBi、第一掃描訊號G(N-K)、第三掃描訊號G(N)、第二掃描訊號G(N+K)、控制端點Q的電壓BOOST、節點N1、節點N2、第一時脈訊號CK及第二時脈訊號XCK的波形圖係依序由上至下排列。在t1至t2的時段，第二掃描訊號G(N+K)係為低準位，因此第四開關T4不導通，第一掃描訊號G(N-K)係為高準位，其會導通第三開關T3，因此控制端點Q的電壓BOOST會隨著第一邏輯訊號Bi而呈現高準位，進而導通第八開關T8、第一開關T1及第二開關T2。
第一開關T1及第二開關T2導通會使節點N1、N2隨著地端VSS呈現低準位，並進而不導通第五開關T5及第六開關T6，另由於此時第二時脈訊號XCK係為高準位，故第七開關T7會導通而使第三掃描訊號G(N)隨著地端VSS持續呈現低準位，並且第八開關T8的導通亦會使第三掃描訊號G(N)隨著第一時脈訊號CK持續呈現低準位。
在t2至t3的時段，第三開關T3會因第一掃描訊號G(N-K)轉為低準位而不導通，第四開關T4會因第二掃描訊號G(N+K)仍處於低準位而不導通，由於第八開關T8之第一端的第一時脈訊號CK由前一時段的低準位轉為高準位，因此控制端點Q的電壓BOOST的準位會因為第八開關T8之第一端與第八開關T8之控制端之間的寄生電容造成的耦合而進一步提高，並持續開啟第八開關T8而使第三掃描訊號G(N)隨著第一時脈訊號CK轉為高準位。
另由於第一時脈訊號CK在時間t2由低準位轉為高準位，第一耦合元件32的電容效應會將節點N1的電位瞬間拉高，第二耦合元件72的電容效應會將節點N2的電位瞬間拉高，然由於控制端點Q的電壓BOOST係在高準位，其會導通第一開關T1及第二開關T2，因此節點N1、N2的電位會在短暫的升高後立即被地端VSS拉至低準位，此時第五開關T5及第六開關T6仍然不導通，而第七開關T7會因第二時脈訊號XCK轉為低準位而不導通。
在t3至t4的時段，第一掃描訊號G(N-K)係為低準位，因此第三開關T3不導通，第二掃描訊號G(N+K)轉為高準位，其會導通第四開關T4，由於第二邏輯訊號XBi仍為低準位，其會將控制端點Q的電壓BOOST拉至低準位，進而使第八開關T8、第一開關T1及第二開關T2皆不導通。由於節點N1、N2在t2至t3的時段係為低準位，且第一時脈訊號CK在t3至t4的時段轉為低準位，節點N1、N2在t3至t4的時段仍會維持低準位，而維持第五開關T5及第六開關T6的不導通。第七開關T7會因第二時脈訊號XCK轉為高準位而導通，進而使地端VSS將第三掃描訊號G(N)拉至低準位。
在t4至t5的時段，第三開關T3會因第一掃描訊號G(N-K)維持於低準位而持續不導通，第四開關T4會因第二掃描訊號G(N+K)轉為低準位而不導通。由於第一時脈訊號CK由低準位轉為高準位，第一耦合元件32的電容效應會將節點N1的電位拉至高準位，第二耦合元件72的電容效應會將節點N2的電位拉至高準位，雖然節點N2會經由第二開關T2漏電，但節點N2的電位在t4至t5的時段仍會高於第一開關T1之控制端的準位，而使第一開關T1逆偏，使節點N1經由第一開關T1漏電，因此節點N1的電位可穩定地維持在高準位，進而穩定地開啟第五開關T5及第六開關T6，而使第三掃 描訊號G(N)及控制端點Q的電壓BOOST維持在低準位。假設第一開關T1係為N型金屬半電晶體，由於第一開關T1的閘極電位會低於源極電位，因此第一開關T1會逆偏，而有效地避免漏電流。
在t5至t6的時段，第三開關T3會因第一掃描訊號G(N-K)維持於低準位而持續不導通，第四開關T4會因第二掃描訊號G(N+K)維持於低準位而持續不導通，控制端點Q的電壓BOOST則因在t4至t5的時段係為低準位而於t5至t6的時段維持在低準位，進而維持第八開關T8、第一開關T1及第二開關T2的不導通。由於第一時脈訊號CK由高準位轉為低準位，第一耦合元件32的電容效應會將節點N1的電位拉至低準位，第二耦合元件72的電容效應會將節點N2的電位拉至低準位，進而使第五開關T5及第六開關T6不導通。另由於第二時脈訊號XCK由低準位轉為高準位，第三掃描訊號G(N)會因第七開關T7導通而被地端VSS維持在低準位。
除此之外，t6至t7的時段之波形圖係與t4至t5的時段的波形圖相同，t7至t8的時段之波形圖係與t5至t6的時段的波形圖相同，於此不再贅述。由t4至t5的時段及t6至t7的時段可知，在這些時段節點N1的波形趨近於理想方波，其會增強穩壓能力，不會讓移位暫存器電路出現多脈波。因此當應用於液晶顯示器時，將可避免顯示畫面出現水平亮紋(horizontal line)的情形，進而提升顯示品質。
請參考第5圖，第5圖係為本發明另一實施例之第N級移位暫存器單元500之示意圖。移位暫存器單元500與移位暫存器單元100的差異在於移位暫存器電路單元500不具有開關控制單元70，而係將第一開關T1的第二端設計成直接接地，因此如節點N1處會有經由第一開關T1漏電至地端VSS的情形發生。相較於第5圖的移位暫存器單元500，第2圖的移位暫存 器單元100透過開關控制單元70的設置，當控制端點Q的電壓Boost為低準位，而節點N2為較高準位時，第一開關T1將會逆偏，據以大幅降低第一開關T1漏電的情形。
綜上所述，本發明移位暫存器單元100透過開關控制單元70的設置使第一開關T1達到逆偏，而大幅降低第一開關T1漏電的情形，當移位暫存器單元100應用於顯示器時，可改善顯示器的顯示品質。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
20‧‧‧輸入電路
30‧‧‧穩壓單元
32‧‧‧第一耦合元件
40‧‧‧輸出電路
50‧‧‧失能電路
70‧‧‧開關控制單元
72‧‧‧第二耦合元件
100‧‧‧第N級移位暫存器單元
G(N-K)‧‧‧第一掃描訊號
G(N+K)‧‧‧第二掃描訊號
BOOST‧‧‧控制端點Q的電壓
Bi‧‧‧第一邏輯訊號
XBi‧‧‧第二邏輯訊號
T1‧‧‧第一開關
T2‧‧‧第二開關
T3‧‧‧第三開關
T4‧‧‧第四開關
T5‧‧‧第五開關
T6‧‧‧第六開關
T7‧‧‧第七開關
T8‧‧‧第八開關
CK‧‧‧第一時脈訊號
Q‧‧‧控制端點
G(N)‧‧‧第三掃描訊號
XCK‧‧‧第二時脈訊號
VSS‧‧‧地端
N1、N2‧‧‧節點

Claims (10)

  1. 一種移位暫存器電路，具有多個移位暫存器單元，該些移位暫存器單元中的第N級移位暫存器單元包含：一輸入電路，設置以根據該移位暫存器電路之一第(N-K)級移位暫存器單元的一第一掃描訊號或該移位暫存器電路之一第(N+K)級移位暫存器單元的一第二掃描訊號而控制該第N級移位暫存器單元的一控制端點的電壓，其中N及K係為正整數且N≧K；一穩壓單元，包含：一第一耦合元件，具有一第一端及一第二端，該第一端設置以接收一第一時脈訊號；一第一開關，具有一第一端電性耦接於該第一耦合元件之該第二端，一控制端電性耦接於該輸入電路以接收該控制端點的電壓，及一第二端；及一開關控制單元，電性耦接該第一開關的該第二端及一地端，設置以根據該第一時脈訊號而控制該第一開關的該第二端的電壓，並使該第一開關的該控制端與該第一開關的該第二端週期性的逆偏；以及一輸出電路，具有一第一端設置以接收該第一時脈訊號，一控制端電性耦接於該輸入電路以接收該控制端點的電壓，及一第二端設置以輸出該第N級移位暫存器單元的一第三掃描訊號。
  2. 如請求項第1項所述之移位暫存器電路，其中該開關控制單元包含：一第二開關，具有一第一端電性耦接於該第一開關之該第二端，一控制端電性耦接於該輸入電路以接收該控制端點的電壓，及一第二端電性耦接於該地端；及 一第二耦合元件，具有一第一端電性耦接於該第一開關之該第二端，及一第二端設置以接收該第一時脈訊號。
  3. 如請求項第1或2項所述之移位暫存器電路，其中該輸入電路還設置以接收一第一邏輯訊號、一第二邏輯訊號、該第一掃描訊號及該第二掃描訊號，並根據該第一掃描訊號及該第二掃描訊號來決定根據該第一邏輯訊號或該第二邏輯訊號而控制該控制端點的電壓。
  4. 如請求項第3項所述之移位暫存器電路，其中該輸入電路包含：一第三開關，具有：一第一端，設置以接收該第一邏輯訊號；一控制端，設置以接收該第一掃描訊號；及一第二端，電性耦接於該第一開關之該控制端；以及一第四開關，具有：一第一端，電性耦接於該第三開關之該第二端；一控制端，設置以接收該第二掃描訊號；及一第二端，設置以接收該第二邏輯訊號。
  5. 如請求項第4項所述之移位暫存器電路，其中該移位暫存器電路還包含一失能電路，電性耦接於該第一耦合元件之該第二端及該輸入電路，並設置以接收一第二時脈訊號，並根據該第一耦合元件之該第二端的電壓準位及該第二時脈訊號而控制該控制端點的電壓及該第三掃描訊號的準位，該失能電路包含：一第五開關，具有一第一端電性耦接於該控制端點，一控制端電性耦接於該第一耦合元件之該第二端，及一第二端電性耦接於該輸出電路之該第二端； 一第六開關，具有一第一端電性耦接於該第五開關之該第二端，一控制端電性耦接於該第一耦合元件之該第二端，及一第二端電性耦接於該地端；及一第七開關，具有一第一端電性耦接於該第五開關之該第二端，一控制端設置以接收該第二時脈訊號，及一第二端電性耦接於該地端。
  6. 如請求項第5項所述之移位暫存器電路，其中該輸出電路包含一第八開關，具有一第一端設置以接收該第一時脈訊號，一控制端電性耦接於該輸入電路以接收該控制端點的電壓，及一第二端設置以輸出該第N級移位暫存器單元的該第三掃描訊號。
  7. 一種移位暫存器電路的操作方法，設置以操作如請求項1所述的第N級移位暫存器單元，該操作方法包含：根據該第(N-K)級移位暫存器單元的該第一掃描訊號或該第(N+K)級移位暫存器單元的該第二掃描訊號而控制該控制端點的電壓；通過該輸出電路接收該第一時脈訊號及該控制端點的電壓，並根據該第一時脈訊號及該控制端點的電壓輸出該第三掃描訊號；及通過該開關控制單元以根據該第一時脈訊號控制該第一開關的該第二端的電壓，並使該第一開關的該控制端與該第一開關的該第二端週期性的逆偏。
  8. 如請求項第7項所述之方法，其中通過該輸入電路根據該第一掃描訊號或該第二掃描訊號而控制該控制端點的電壓係包含根據該第一掃描訊號及該第二掃描訊號以決定根據一第一邏輯訊號或一第二邏輯訊號而控制該控制端點的電壓。
  9. 如請求項第8項所述之方法，還包含通過一失能電路控制該控制端點的電壓及該第三掃描訊號的準位，其中通過該失能電路控制該控制端點的電壓及該第三掃描訊號的準位包含根據該第一耦合元件之該第二端的電位及一第二時脈訊號下拉該控制端點的電壓及該第三掃描訊號的準位。
  10. 如請求項第7、8或9項所述之方法，其中通過該開關控制單元以根據該第一時脈訊號控制該第一開關的該第二端的電壓，並使該第一開關的該控制端與該第一開關的該第二端週期性的逆偏包含透過該開關控制單元的一第二開關使該第一開關的該第二端與一地端斷開並且透過一第二耦合元件接收該第一時脈訊號而根據該第一時脈訊號而控制該第一開關的該第二端的電位。
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