TW201331921A - 面板驅動電路 - Google Patents
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Abstract
本發明為一種面板驅動電路，其包含一伽瑪電壓產生電路、複數選擇單元及至少一源極驅動電路。伽瑪電壓產生電路產生複數伽瑪電壓至該些選擇單元，則該些選擇單元依據一選擇資料而分時輸出該伽瑪電壓產生電路所產生之該些伽瑪電壓至該源極驅動電路，該源極驅動電路依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且源極驅動電路依據該目標電壓產生一驅動訊號，以驅動一面板。
Description
本發明為一種面板驅動電路，特別是指一種大幅減少晶片內部連接線的面板驅動電路，其可以大幅降低晶片面積的消耗而達到功率損失與生產成本的減少。
目前薄膜電晶體（Thin Film Transistor，TFT）之液晶顯示器（Liquid crystal display，LCD）的面板已被廣泛的應用於各種設備，例如：電視、電腦螢幕、手機螢幕或看板等等。薄膜電晶體之液晶顯示器的驅動方式為利用一閘極驅動電路控制一畫素內的閘極端開啟或關閉，且利用源極驅動電路輸出準確的電壓至該畫素內，且，源極驅動電路所輸出的電壓係由伽瑪（Gamma）電壓產生電路所產生，如此，液晶顯示器的驅動電路即控制顯示器內部液晶的轉向，以產生正確的色彩於液晶顯示器。
一個傳統液晶顯示器內的每一組源極驅動電路包含了數位類比轉換器（Digital Analog Converter，DAC）與緩衝器（Buffer）等元件。然而，傳統液晶顯示器中包含著數百組的源極驅動電路，而數位類比轉換器與伽瑪電壓產生電路相互連接之線路所佔據的面積會是最大的，這種情況在要求高畫素的顯示技術上尤為嚴重，因此，在不增加大量功率消耗而能達到降低晶片面積的技術就成為非常的重要。基於上述，當液晶顯示器的一色彩資料為6位元（Bits）時，則數位類比轉換器就有26個晶片接腳數，同樣的伽瑪電壓產生電路也需64個晶片接腳數，以拉64條連接線至數位類比轉換器而提供6位元解析度之伽瑪電壓(即64個伽瑪電壓)，然而，若紅色R、綠色G及藍色B之伽瑪電壓產生電路是獨立的，則紅色R、綠色G及藍色B之伽瑪電壓會分別由3個伽瑪電壓產生電路產生，如此，3個伽瑪電壓產生電路共需要拉192條連接線至數位類比轉換器。然而，當在8位元之更高解析度的液晶顯示器且紅色R、綠色G及藍色B之伽瑪電壓產生電路是獨立的時，則伽瑪電壓產生電路之接腳數需要768個，並有768條連接線將數位類比轉換器與伽瑪電壓產生電路相互連接。
故，傳統之液晶顯示器的驅動電路所需要的晶片接腳數與電路各元件上之相互連接的線路面積是非常的龐大，因此，本發明鑒於上述之缺點而利用分時的方式，以減少驅動電路之晶片接腳數與電路上各元件之相互連接的線路面積，進而降低液晶顯示器之驅動電路的生產成本與不必要的功率消耗。
一個傳統液晶顯示器內的每一組源極驅動電路包含了數位類比轉換器（Digital Analog Converter，DAC）與緩衝器（Buffer）等元件。然而，傳統液晶顯示器中包含著數百組的源極驅動電路，而數位類比轉換器與伽瑪電壓產生電路相互連接之線路所佔據的面積會是最大的，這種情況在要求高畫素的顯示技術上尤為嚴重，因此，在不增加大量功率消耗而能達到降低晶片面積的技術就成為非常的重要。基於上述，當液晶顯示器的一色彩資料為6位元（Bits）時，則數位類比轉換器就有26個晶片接腳數，同樣的伽瑪電壓產生電路也需64個晶片接腳數，以拉64條連接線至數位類比轉換器而提供6位元解析度之伽瑪電壓(即64個伽瑪電壓)，然而，若紅色R、綠色G及藍色B之伽瑪電壓產生電路是獨立的，則紅色R、綠色G及藍色B之伽瑪電壓會分別由3個伽瑪電壓產生電路產生，如此，3個伽瑪電壓產生電路共需要拉192條連接線至數位類比轉換器。然而，當在8位元之更高解析度的液晶顯示器且紅色R、綠色G及藍色B之伽瑪電壓產生電路是獨立的時，則伽瑪電壓產生電路之接腳數需要768個，並有768條連接線將數位類比轉換器與伽瑪電壓產生電路相互連接。
故，傳統之液晶顯示器的驅動電路所需要的晶片接腳數與電路各元件上之相互連接的線路面積是非常的龐大，因此，本發明鑒於上述之缺點而利用分時的方式，以減少驅動電路之晶片接腳數與電路上各元件之相互連接的線路面積，進而降低液晶顯示器之驅動電路的生產成本與不必要的功率消耗。
本發明之目的之一，在於提供一種面板驅動電路，其為大幅減少晶片每一組源極驅動電路的數位類比轉換器和內部連接線之面板驅動電路，以降低電路面積之消耗與生產成本。
本發明為一種面板驅動電路，其包含一伽瑪電壓產生電路、複數選擇單元及至少一源極驅動電路。伽瑪電壓產生電路產生複數伽瑪電壓至該些選擇單元，則該些選擇單元依據一選擇資料而分時輸出該伽瑪電壓產生電路所產生之該些伽瑪電壓至該源極驅動電路，該源極驅動電路依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且源極驅動電路依據該目標電壓產生一驅動訊號，以驅動一面板。
本發明為一種面板驅動電路，其包含一伽瑪電壓產生電路、複數選擇單元及至少一源極驅動電路。伽瑪電壓產生電路產生複數伽瑪電壓至該些選擇單元，則該些選擇單元依據一選擇資料而分時輸出該伽瑪電壓產生電路所產生之該些伽瑪電壓至該源極驅動電路，該源極驅動電路依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且源極驅動電路依據該目標電壓產生一驅動訊號，以驅動一面板。
茲為使貴審查委員對本發明之技術特徵及所達成之功效更有進一步之瞭解與認識，謹佐以較佳之實施例圖及配合詳細之說明，說明如後：
本發明致力於減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積，而增加電路上可應用的面積或減少電路板之尺寸，以降低各種電子裝置的生產成本或達到縮小電子裝置之尺寸。如此，本發明可以應用於大量傳輸一連串相關的邏輯資料或電性訊號之電子產品，而減少電子產品所應用之晶片內部的連接線，因此，本發明將以面板的驅動電路作為本發明之技術的說明。
首先，請參閱第一圖與第二圖，其為本發明之面板驅動電路的方塊圖。如圖所示，本發明包含一伽瑪電壓產生電路10、複數選擇單元（20、21…27）及至少一源極驅動電路30，而達到大幅減少晶片內部的連接線之面板驅動電路。其中，伽瑪電壓產生電路10產生複數伽瑪電壓（G0、G1…G63），該些選擇單元（20、21…27）耦接伽瑪電壓產生電路10，並依據一選擇資料GC而分時輸出該些伽瑪電壓（G0、G1…G63），源極驅動電路30耦接該些選擇單元（20、21…27）並依據一顯示資料SDSP而選擇接收該些選擇單元（20、21…27）之一輸出的該伽瑪電壓（GS0…GS6或GS7）為一目標電壓VTAR，且源極驅動電路30依據該目標電壓VTAR產生一驅動訊號SO，以驅動一面板。
該些伽瑪電壓（G0、G1…G63）為伽瑪電壓產生電路10依據一伽瑪曲線而產生，即本實施例係將伽瑪曲線分成64段電壓而產生該些伽瑪電壓（G0、G1…G63）。其中，伽瑪電壓產生電路10依據伽瑪曲線而產生該些伽瑪電壓（G0、G1…G63）為該技術領域中具有通常知識者熟知的技術，於此將不再加以贅述。
本發明之該些選擇單元（20、21…27）為一多工器，其可以由解碼器與複數邏輯閘組成或由複數開關與開關控制電路組成，於此並不詳述該些選擇單元（20、21…27）之電路架構，本發明之該些選擇單元（20及26…27）耦接伽瑪電壓產生電路10，並依據選擇資料GC而分時輸出伽瑪電壓產生電路10所產生之該些伽瑪電壓（G0、G1…G63）。本實施例所指之選擇資料GC包含三個位元的邏輯資料（GC0、GC1及GC2），此邏輯資料（GC0、GC1及GC2）全部為一二進制的邏輯資料，即邏輯資料（GC0、GC1及GC2）分別為0（低準位）或1（高準位）。當選擇資料GC為0時，則代表邏輯資料（GC0、GC1及GC2）分別為0（GC0）、0（GC1）及0（GC2），若選擇資料GC為1時，則代表邏輯資料（GC0、GC1及GC2）分別為1（GC0）、0（GC1）及0（GC2），若選擇資料GC為7時，則代表邏輯資料（GC0、GC1及GC2）分別為1（GC0）、1（GC1）及1（GC2），以此類推。
上述之選擇資料GC可以由一計數單元40、時脈產生單元或位準產生單元產生，而本發明之實施例以計數單元40說明選擇資料GC如何產生。計數單元40耦接複數選擇單元（20、21…27），且依據一時序（T1…T7或T8）依序產生選擇資料GC。此處所指之時序（T1…T7或T8）為計數單元40依序產生邏輯資料（GC0、GC1及GC2）分別對應的每一時序（T1…T7、T8），舉例來說，如第三圖所示，於第一時序T1時，第一選擇資料GC為000，於第二時序T2時，第二選擇資料GC為100，於第三時序T3時，第三選擇資料GC為010，以此依序類推，因此，每一時序（T1…T7、T8）皆各自產生一選擇資料GC。如此，計數單元40於每一時序（T1…T7、T8）將產生的選擇資料GC傳送至該些選擇單元（20、21…27），以控制該些選擇單元（20、21…27）分時輸出該些伽瑪電壓（G0、G1…G63）。此處所指之分時即為伽瑪電壓產生電路10於每一時序（T1…T7、T8）經由該些選擇單元（20、21…27）輸出不同的該些伽瑪電壓（G0…G62或G63），以驅動面板。
復參閱第一圖，其清楚的顯示伽瑪電壓產生電路10輸出64個伽瑪電壓（G0、G1…G63）至該些選擇單元（20、21…27），且該些選擇單元（20、21…27）分別耦接8個伽瑪電壓，即選擇單元20耦接伽瑪電壓G0～G7、選擇單元21耦接伽瑪電壓G8～G15…選擇單元27耦接伽瑪電壓G56～G63。如此，當選擇資料GC為0時，則選擇單元20選擇接收本身耦接的第一個伽瑪電壓G0、選擇單元21選擇接收本身耦接的第一個伽瑪電壓G8…選擇單元27選擇接收本身耦接的第一個伽瑪電壓G56，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G0、G8…G56；若選擇資料GC為1時，則選擇單元20選擇接收本身耦接的第二個伽瑪電壓G1、選擇單元21選擇接收本身耦接的第二個伽瑪電壓G9…選擇單元27選擇接收本身耦接的第二個伽瑪電壓G57，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G1、G9…G57。
承接上述，該些選擇單元（20、21…27）依據其他選擇資料GC選擇該些伽瑪電壓（G0、G1…G63）而輸出八個伽瑪電壓的詳細內容請參閱第四圖，其為本發明之伽瑪電壓產生電路的伽瑪電壓表。如圖所示，若選擇資料GC為7時，則選擇單元20選擇接收的第八個伽瑪電壓G7、選擇單元21選擇接收的第八個伽瑪電壓G15…選擇單元27選擇接收的第八個伽瑪電壓G63，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G7、G15…G63。因此，該些選擇單元（20、21…27）依據選擇資料GC而在不同的時序（T1…T7或T8）改變八個伽瑪電壓（GS0、GS1…GS7）的輸出伽瑪電壓值（G0…G62或G63），即本發明之該些選擇單元（20、21…27）利用分時概念而選擇伽瑪電壓產生電路10所產生之64個伽瑪電壓（G0、G1…G63）而產生八個伽瑪電壓（GS0、GS1…GS7）以提供源極驅動電路30選擇而驅動顯示器之面板的畫素。
如第四圖所示，其為依據一顯示器之色彩解析度的需求而改變，即當顯示器欲達成色彩解析度為3位元時，則伽瑪電壓表儲存8個伽瑪電壓準位；若顯示器欲達成色彩解析度為6位元時，則伽瑪電壓表儲存64個伽瑪電壓準位，而本發明之實施例即為6位元之色彩解析度。因此，當邏輯資料（GC0、GC1及GC2）為010＝2時，則該些選擇單元（20、21…27）依據邏輯資料（GC0、GC1及GC2）而輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G2、G10、G18、G26、G34、G42、G50、G58，該些選擇單元（20、21…27）之依據其餘邏輯資料（GC0、GC1及GC2）而輸出之八個伽瑪電壓（GS0、GS1…GS7）的結果請參閱第四圖，於此不再詳述。此外，本實施例所舉之伽瑪電壓表係用於清楚的說明該些選擇單元（20、21…27）如何依據選擇資料GC而分時選擇伽瑪電壓產生電路10所輸出之64個伽瑪電壓，進而產生八個伽瑪電壓（GS0、GS1…GS7）以提供源極驅動電路30選擇而驅動顯示器，但是，本實施例僅利用伽瑪電壓表清楚的說明該些選擇單元（20、21…27）如何依據選擇資料GC而分時選擇伽瑪電壓產生電路10所輸出之64個伽瑪電壓，然而，本實施例未限定需增加一儲存單元於顯示器之驅動電路的架構中，而用於儲存伽瑪電壓表，而該些選擇單元（20、21…27）才可以依據選擇資料GC而分時選擇64個伽瑪電壓。
復參閱第一圖、第二圖及第四圖。本發明之實施例為利用該些選擇單元（20、21…27）而減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積，如第一圖所示，當伽瑪電壓產生電路10產生符合顯示器之6位元色彩解析度的64個伽瑪電壓（G0、G1…G63）時，則需要64條連接線來輸出64個伽瑪電壓（G0、G1…G63），然而，當顯示器之色彩解析度提升到8位元，而伽瑪電壓產生電路10產生256個伽瑪電壓（G0、G1…G255），則需要256條連接線來輸出256個伽瑪電壓（G0、G1…G255）。因此，當使用一種8個資料埠與3個選擇埠的該些選擇單元（20、21…27）時，則如第一圖所示，原本伽瑪電壓產生電路10需要64條連接線已變為僅需要8條連接線。
若使用一種16個資料埠與4個選擇埠的該些選擇單元（20、21…23）時，則原本伽瑪電壓產生電路10由需要64條連接線即變為僅需要4條連接線，換言之，源極驅動電路30所佔用之電路面積大幅降低，且選擇資料GC所包含之邏輯資料也必須改為4位元的資料（GC0、GC1、GC2及GC3），以控制該些選擇單元（20、21…23）選擇64個伽瑪電壓（G0、G1…G63）而產生4個伽瑪電壓（GS0、GS1、GS2及GS3）。此外，該些選擇單元（20、21…27）之個數與該些伽瑪電壓（G0、G1…G63）之個數之間為一倍數之關係。如此，當顯示器之色彩解析度提升時，則不會因龐大之伽瑪電壓產生電路10的連接線，與伽瑪電壓產生電路10和源極驅動電路30相互耦接的線路，而提高電路面積的使用範圍。故，本發明可以降低顯示裝置的生產成本與減少線路傳輸的損耗，即本發明是一種大幅減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積之面板驅動電路，以增加電路可使用之面積。
如第二圖所示，源極驅動電路30耦接該些選擇單元（20、21…27），並依據顯示資料SDSP而選擇該些選擇單元（20…26或27）之一輸出的伽瑪電壓（GS0…GS6或GS7），且源極驅動電路30依據所選擇之選擇單元（20…26或27）的伽瑪電壓（GS0…GS6或GS7）產生一驅動訊號SO，以驅動顯示器的面板。本實施例所敘明之顯示資料SDSP為使用者於面板欲顯示之畫面的一資料，且顯示資料SDSP包含第一資料SDSP1與第二資料SDSP2，而本實施例是以6位元資料之顯示資料SDSP為說明，即顯示資料SDSP為000000～111111之二進制的變化。本實施例以顯示資料SDSP為010101作說明，則前面三個位元的位元資料（CD0、CD1及CD2）代表第一資料SDSP1為010而後面三個位元的位元資料（CD3、CD4及CD5）代表第二資料SDSP2為101。另外，本實施例僅以6位元資料之顯示資料SDSP做說明，而顯示資料SDSP並不局限在6位元資料，顯示資料SDSP也可以為4位元資料或8位元資料等等，且第一資料SDSP1與第二資料SDSP2之位元資料的分配並不限定為平均分配，也可以第一資料SDSP1為2個位元資料而第二資料SDSP2為4個位元資料，所以，若設計者欲改變6位元資料之顯示資料SDSP為其他位元之顯示資料SDSP或將位元資料重新分配於第一資料SDSP1與第二資料SDSP2時，則修改本發明之源極驅動電路30後一樣可以達到減少晶片上之源極驅動電路的數位類比轉換器和內部連接線之功效，於此不再詳述。
承上所述，源極驅動電路30包含一比較單元301、一數位類比轉換電路302、與一電容303。源極驅動電路30之比較單元301耦接計數單元40而接收選擇資料GC，且接收為010之第一資料SDSP1，爾後，比較單元301比較第一資料SDSP1與選擇資料GC而產生一時序訊號CMPO。由於計數單元40所產生的選擇資料GC為依據時序（T1…T7、T8）依序產生，即選擇資料GC分別由第一時序T1、第二時序T2…第八時序T8而依序產生選擇資料GC為000…011或111，所以，本發明之比較單元301依序比較000之選擇資料GC與第一資料SDSP1、比較100之選擇資料GC與第一資料SDSP1…比較111之選擇資料GC與第一資料SDSP1。但是，因第一資料SDSP1為010，所以，當計數單元40計數選擇資料GC為000…010而小於或等於010之第一資料SDSP1時，比較單元301則輸出高準位之時序訊號CMPO（即邏輯”1”），反之，若計數單元40計數選擇資料GC為110…111而大於010之第一資料SDSP1時，比較單元301則輸出低準位之時序訊號CMPO(即邏輯”0”)。
上述之比較單元301的比較方式僅為說明比較單元301的比較方式，而未限制比較單元301之設計範疇，所以，比較單元301也可以設計為計數單元40計數選擇資料GC大於第一資料SDSP1時輸出高準位之時序訊號CMPO，選擇資料GC小於或等於第一資料SDSP1時輸出低準位之時序訊號CMPO。此外，計數單元40可以遞增或遞減計數選擇資料GC而提供至比較單元301，同樣地，比較單元301還是可以依序比較選擇資料GC與第一資料SDSP1，而輸出低準位或高準位之時序訊號CMPO至數位類比轉換電路302。
承接上述，本發明之數位類比轉換電路302可以依據該時序訊號CMPO得知目標電壓VTAR為選擇單元(20…26或27)輸出至源極驅動電路30之伽瑪電壓（GS0…GS6或GS7）的該時序（T1…T7或T8）。即目標電壓VTAR對應於該時序（T1…T7或T8），且數位類比轉換電路302是依據該時序訊號CMPO而得知目標電壓VTAR對應於該時序（T1…T7或T8）。以第四圖為例，若顯示資料SDSP為010101，顯示資料SDSP之第一資料SDSP1為010，而比較單元301會從第一時序T1至第八時序T8依序比較計數單元40輸出的選擇資料GC與第一資料SDSP1，當選擇資料GC小於或等於第一資料SDSP1時輸出高準位之時序訊號CMPO，而當選擇資料GC大於第一資料SDSP1時輸出低準位之時序訊號CMPO，所以，在時序訊號CMPO之準位變化時，即可得知目標電壓VTAR所在的時序在第三時序T3。
復參閱第二圖及第五圖。第五圖為本發明之數位類比轉換電路之輸出電壓的選擇表。如圖所示，數位類比轉換電路302耦接該些選擇單元（20、21…27）與比較單元301，且數位類比轉換電路302接收時序訊號CMPO、第二資料SDSP2及該些選擇單元（20、21…27）輸出之該些伽瑪電壓（GS0…GS6、GS7）之一，其中，數位類比轉換電路302是依據第二資料SDSP2選擇該些選擇單元（20、21…27）輸出之該些伽瑪電壓（GS0…GS6、GS7）之一為數位類比轉換電路302的輸出電壓DACO，且當時序訊號CMPO為高準位時，數位類比轉換電路302即依據所選擇的伽瑪電壓（GS0…GS6或GS7）而輸出，然而，當時序訊號CMPO為低準位時，數位類比轉換電路302仍然依據第二資料SDSP2選擇該些伽瑪電壓（GS0…GS6、GS7）之一，但，數位類比轉換電路302因時序訊號CMPO為低準位而不會輸出該些伽瑪電壓（GS0…GS6、GS7）。換言之，當數位類比轉換電路302屢次接收到高準位之時序訊號CMPO，數位類比轉換電路302即一直輸出不同時序（T1…T7或T8）之第二資料SDSP2所選擇選擇單元（20、21…27）輸出的伽瑪電壓（GS0…GS6或GS7），直到數位類比轉換電路302接收到低準位之時序訊號CMPO才會停止輸出所選擇的伽瑪電壓（GS0…GS6或GS7）。如此，數位類比轉換電路302即得知目標電壓VTAR為停止輸出的伽瑪電壓（GS0…GS6或GS7）之時序的前一個時序之伽瑪電壓（GS0…GS6或GS7），例如：當數位類比轉換電路302於第三個時序T3停止輸出的伽瑪電壓（GS0…GS6或GS7）時，則數位類比轉換電路302得知第二個時序T2所產生之伽瑪電壓為目標電壓VTAR。
承接上述，請參閱第六圖，其為本發明之數位類比轉換電路之一實施例。如圖所示，本發明之數位類比轉換電路302包含複數反相器3020-3022及複數傳輸閘40-47、50-53、60-61。如此，該些反相器3020-3022依據第二資料SDSP2而控制該些傳輸閘40-47、50-53、60-61選擇性的傳輸伽瑪電壓GS0-GS7，以供源極驅動電路30驅動面板。該些傳輸閘40-47分別耦接該些選擇單元20-27(如第一圖)以分別接收該些伽瑪電壓GS0-GS7，傳輸閘50耦接該些傳輸閘40、41、60，傳輸閘51耦接該些傳輸閘42、43、60，傳輸閘52耦接該些傳輸閘44、45、61，傳輸閘53耦接該些傳輸閘46、47、61，該些傳輸閘60-61用於輸出輸出電壓DACO。反相器3020耦接該些傳輸閘40-47並依據位元資料CD3而控制該些傳輸閘40-47之導通或截止，反相器3021耦接該些傳輸閘50-53並依據位元資料CD4而控制該些傳輸閘50-53之導通或截止，反相器3022耦接該些傳輸閘60-61並依據位元資料CD5而控制該些傳輸閘60-61之導通或截止。該些傳輸閘40-47、50-53、60-61是由一N型金屬氧化半導體(NMOS)及一P型金屬氧化半導體(PMOS)構成，NMOS之第一端耦接PMOS之第一端，NMOS之第二端耦接PMOS之第二端。傳輸閘40之NMOS的第三端耦接反相器3020之輸出端，傳輸閘40之PMOS的第三端耦接反相器3020之輸入端，傳輸閘40之NMOS的第二端及傳輸閘40之PMOS的第二端更耦接傳輸閘50以傳輸伽瑪電壓GS0至傳輸閘50。傳輸閘41與傳輸閘40之差異為傳輸閘41之NMOS的第三端是耦接反相器3020之輸入端，及傳輸閘41之PMOS的第三端是耦接反相器3020之輸出端。
此外，傳輸閘41之NMOS的第二端及傳輸閘41之PMOS的第二端更耦接傳輸閘50，以傳輸伽瑪電壓GS1至傳輸閘50。爾後，傳輸閘42之NMOS的第二端、傳輸閘42之PMOS的第二端、傳輸閘43之NMOS的第二端及傳輸閘43之PMOS的第二端改為耦接傳輸閘51，其餘傳輸閘42、傳輸閘43及反相器3020之間的耦接關係如同傳輸閘40、傳輸閘41及反相器3020之間的耦接關係。此外，傳輸閘44-47、50-53、60-61及反相器3021-3022之間的耦接關也如同傳輸閘40-43及反相器3020之耦接方式耦接，所以，傳輸閘44-47、50-53、60-61及反相器3021-3022之間其餘之詳細耦接關係請參閱第六圖，於此不再贅述。
故，當數位類比轉換電路302之複數反相器3020-3022分別接收為1(CD3)、0(CD4)、1(CD5)的第二資料SDSP2時，為1之位元資料CD3經由反相器3020控制傳輸閘41、43、45、47為導通狀態以分別傳輸伽瑪電壓GS1至傳輸閘50、傳輸伽瑪電壓GS3至傳輸閘51、傳輸伽瑪電壓GS5至傳輸閘52及伽瑪電壓GS7至傳輸閘53。為0之位元資料CD4經由反相器3021控制傳輸閘50、52為導通狀態以分別傳輸伽瑪電壓GS1至傳輸閘60及傳輸伽瑪電壓GS5至傳輸閘61。為1之位元資料CD5經由反相器3022控制傳輸閘61輸出伽瑪電壓GS5，此伽瑪電壓GS5即為數位類比轉換電路302之輸出電壓DACO。然而，第六圖僅為本發明之數位類比轉換電路302之如何選擇複數伽瑪電壓GS0-GS7之一的實施例，本發明並未限定數位類比轉換電路302之構成方式，例如利用複數電晶體(NMOS或PMOS) 取代該些傳輸閘44-47、50-53、60-61，並配合其他電子元件而構成數位類比轉換電路，如此，由該些電晶體組成之數位類比轉換電路同樣也可以選擇性輸出複數伽瑪電壓GS0-GS7之一作為驅動面板之驅動訊號SO。
復第二圖所示，電容303耦接於數位類比轉換電路302之輸出端。電容303依據該目標電壓VTAR而產生一驅動訊號SO，以驅動面板。即當數位類比轉換電路302接收高準位之時序訊號CMPO時，數位類比轉換電路302會依據第二資料SDSP2選擇該些伽瑪電壓（GS0…GS6、GS7）之一並輸出所選擇的伽瑪電壓至電容303進行充放電，直到數位類比轉換電路302接收低準位之時序訊號CMPO時，數位類比轉換電路302的輸出訊號為浮動的，同時，控制電容303上所儲存的電壓SDRI為驅動訊號SO，以驅動面板。即數位類比轉換電路302在不輸出伽瑪電壓時，放大單元304輸出之驅動訊號SO的來源改由電容303上之驅動訊號SDRI提供，而不是由數位類比轉換電路302輸出之伽瑪電壓提供。因此，該驅動訊號SDRI即經由一放大單元304放大為驅動訊號SO而輸出，以驅動面板。又，源極驅動電路30更可以加入一緩衝單元305而儲存顯示資料SDSP，以加速比較單元301與數位類比轉換電路302分別讀取第一資料SDSP1與第二資料SDSP2，以產生驅動訊號SO而驅動該面板。
綜合上面所述的內容可知，當緩衝單元305接收的顯示資料SDSP為010101，計數單元40開始計數第一選擇資料GC為000時，如第五圖所示，數位類比轉換電路302依據1（CD3）0（CD4）1（CD5）＝5之第二資料SDSP2選擇該些選擇單元(20、21…27)所輸出之該些伽瑪電壓（GS0…GS6、GS7）之中的第六個選擇單元25輸出的伽瑪電壓GS5，而在下一時序（T1…T7或T8）且數位類比轉換電路302再接收到高準位之時序訊號CMPO時，數位類比轉換電路302一樣輸出第六個選擇單元25所輸出的伽瑪電壓GS5，以此類推，在計數單元40計數至第三選擇資料GC為010時，數位類比轉換電路302因屢次接收到高準位之時序訊號CMPO，而每次都將選擇之第六個伽瑪電壓GS5輸出至電容303以對電容充電，直到計數單元40計數至第四選擇資料GC為110，而數位類比轉換電路302接收到低準位之時序訊號CMPO後，數位類比轉換電路302即不會輸出已選擇的第六個選擇單元25所輸出的伽瑪電壓GS5。如第四圖所示。在第一選擇資料GC為000時數位類比轉換電路302依據第二資料SDSP2所選擇的第六個選擇單元25所輸出的伽瑪電壓GS5即為G40，在第二選擇資料GC為100時，數位類比轉換電路302依據第二資料SDSP2所選擇的第六個選擇單元25所輸出的伽瑪電壓GS5即為G41，而在第三選擇資料GC為010時第六選擇單元25所輸出的第六個個伽瑪電壓GS5即為G42，因此，數位類比轉換電路302最後輸出的電壓為G42之伽瑪電壓值。
承接上述，數位類比轉換電路302輸出的伽瑪電壓會對與其耦接之電容303充電而產生驅動訊號SDRI，且放大單元304耦接電容303與數位類比轉換電路302，所以，放大單元304會依據該驅動訊號SDRI而產生放大後之驅動訊號SO，以驅動顯示器或面板而產生所需之畫面。此外，因數位類比轉換電路302輸出的伽瑪電壓為G40之伽瑪電壓值改變至G41之伽瑪電壓值後再改變至G42之伽瑪電壓值，所以，電容303所產生之驅動訊號SDRI也是由G40之伽瑪電壓值逐漸改變至G42之伽瑪電壓值，而最後對電容303充電之伽瑪電壓G42為目標電壓VTAR，反之，若計數單元40為遞減計數，即選擇資料GC由7往0數，使電容303所產生之驅動訊號SDRI的電壓值為G42之伽瑪電壓值的目標電壓VTAR，此為該技術領域具有通常知識者依據上述可容易推知，於此不在加以贅述。然而，本實施例為遞增計數，所以，電容303之驅動訊號SDRI最後由G40之伽瑪電壓值變化至G42之伽瑪電壓值後即經由放大單元304放大為驅動訊號SO且輸出，以驅動面板。
然而，請參閱第七圖，其為本發明之源極驅動電路30之另一實施例。如圖所示，本發明之源極驅動電路30更可以依據驅動不同面板的特性，而不需要設計電容303及放大單元304於源極驅動電路30。如此，源極驅動電路30不須控制電容303的充放電而產生驅動訊號SDRI，及不須經由放大單元304放大驅動訊號SDRI而產生驅動訊號SO後再驅動面板。源極驅動電路30改為直接輸出數位類比轉換電路302產生的輸出電壓DACO至面板，以驅動面板。因此，本發明之源極驅動電路30在驅動不同的面板時亦可以達到大幅減少晶片內部連接線及減少數位類比轉換器302之數量，並依據不同的面板針對源極驅動電路30內部電路作一精簡設計，以降低晶片面積之消耗與更加節省生產成本。
綜上所述，本發明為一種面板驅動電路，其包含一伽瑪電壓產生電路、複數選擇單元及至少一源極驅動電路。伽瑪電壓產生電路產生複數伽瑪電壓至該些選擇單元，則該些選擇單元依據一選擇資料而分時輸出該伽瑪電壓產生電路所產生之該些伽瑪電壓至該源極驅動電路，該源極驅動電路依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且源極驅動電路依據該目標電壓產生一驅動訊號，以驅動一面板。
故本發明實為一具有新穎性、進步性及可供產業上利用者，應符合我國專利法專利申請要件無疑，爰依法提出發明專利申請，祈鈞局早日賜准專利，至感為禱。
惟以上所述者，僅為本發明一較佳實施例而已，並非用來限定本發明實施之範圍，故舉凡依本發明申請專利範圍所述之形狀、構造、特徵及精神所為之均等變化與修飾，均應包括於本發明之申請專利範圍內。
本發明致力於減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積，而增加電路上可應用的面積或減少電路板之尺寸，以降低各種電子裝置的生產成本或達到縮小電子裝置之尺寸。如此，本發明可以應用於大量傳輸一連串相關的邏輯資料或電性訊號之電子產品，而減少電子產品所應用之晶片內部的連接線，因此，本發明將以面板的驅動電路作為本發明之技術的說明。
首先，請參閱第一圖與第二圖，其為本發明之面板驅動電路的方塊圖。如圖所示，本發明包含一伽瑪電壓產生電路10、複數選擇單元（20、21…27）及至少一源極驅動電路30，而達到大幅減少晶片內部的連接線之面板驅動電路。其中，伽瑪電壓產生電路10產生複數伽瑪電壓（G0、G1…G63），該些選擇單元（20、21…27）耦接伽瑪電壓產生電路10，並依據一選擇資料GC而分時輸出該些伽瑪電壓（G0、G1…G63），源極驅動電路30耦接該些選擇單元（20、21…27）並依據一顯示資料SDSP而選擇接收該些選擇單元（20、21…27）之一輸出的該伽瑪電壓（GS0…GS6或GS7）為一目標電壓VTAR，且源極驅動電路30依據該目標電壓VTAR產生一驅動訊號SO，以驅動一面板。
該些伽瑪電壓（G0、G1…G63）為伽瑪電壓產生電路10依據一伽瑪曲線而產生，即本實施例係將伽瑪曲線分成64段電壓而產生該些伽瑪電壓（G0、G1…G63）。其中，伽瑪電壓產生電路10依據伽瑪曲線而產生該些伽瑪電壓（G0、G1…G63）為該技術領域中具有通常知識者熟知的技術，於此將不再加以贅述。
本發明之該些選擇單元（20、21…27）為一多工器，其可以由解碼器與複數邏輯閘組成或由複數開關與開關控制電路組成，於此並不詳述該些選擇單元（20、21…27）之電路架構，本發明之該些選擇單元（20及26…27）耦接伽瑪電壓產生電路10，並依據選擇資料GC而分時輸出伽瑪電壓產生電路10所產生之該些伽瑪電壓（G0、G1…G63）。本實施例所指之選擇資料GC包含三個位元的邏輯資料（GC0、GC1及GC2），此邏輯資料（GC0、GC1及GC2）全部為一二進制的邏輯資料，即邏輯資料（GC0、GC1及GC2）分別為0（低準位）或1（高準位）。當選擇資料GC為0時，則代表邏輯資料（GC0、GC1及GC2）分別為0（GC0）、0（GC1）及0（GC2），若選擇資料GC為1時，則代表邏輯資料（GC0、GC1及GC2）分別為1（GC0）、0（GC1）及0（GC2），若選擇資料GC為7時，則代表邏輯資料（GC0、GC1及GC2）分別為1（GC0）、1（GC1）及1（GC2），以此類推。
上述之選擇資料GC可以由一計數單元40、時脈產生單元或位準產生單元產生，而本發明之實施例以計數單元40說明選擇資料GC如何產生。計數單元40耦接複數選擇單元（20、21…27），且依據一時序（T1…T7或T8）依序產生選擇資料GC。此處所指之時序（T1…T7或T8）為計數單元40依序產生邏輯資料（GC0、GC1及GC2）分別對應的每一時序（T1…T7、T8），舉例來說，如第三圖所示，於第一時序T1時，第一選擇資料GC為000，於第二時序T2時，第二選擇資料GC為100，於第三時序T3時，第三選擇資料GC為010，以此依序類推，因此，每一時序（T1…T7、T8）皆各自產生一選擇資料GC。如此，計數單元40於每一時序（T1…T7、T8）將產生的選擇資料GC傳送至該些選擇單元（20、21…27），以控制該些選擇單元（20、21…27）分時輸出該些伽瑪電壓（G0、G1…G63）。此處所指之分時即為伽瑪電壓產生電路10於每一時序（T1…T7、T8）經由該些選擇單元（20、21…27）輸出不同的該些伽瑪電壓（G0…G62或G63），以驅動面板。
復參閱第一圖，其清楚的顯示伽瑪電壓產生電路10輸出64個伽瑪電壓（G0、G1…G63）至該些選擇單元（20、21…27），且該些選擇單元（20、21…27）分別耦接8個伽瑪電壓，即選擇單元20耦接伽瑪電壓G0～G7、選擇單元21耦接伽瑪電壓G8～G15…選擇單元27耦接伽瑪電壓G56～G63。如此，當選擇資料GC為0時，則選擇單元20選擇接收本身耦接的第一個伽瑪電壓G0、選擇單元21選擇接收本身耦接的第一個伽瑪電壓G8…選擇單元27選擇接收本身耦接的第一個伽瑪電壓G56，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G0、G8…G56；若選擇資料GC為1時，則選擇單元20選擇接收本身耦接的第二個伽瑪電壓G1、選擇單元21選擇接收本身耦接的第二個伽瑪電壓G9…選擇單元27選擇接收本身耦接的第二個伽瑪電壓G57，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G1、G9…G57。
承接上述，該些選擇單元（20、21…27）依據其他選擇資料GC選擇該些伽瑪電壓（G0、G1…G63）而輸出八個伽瑪電壓的詳細內容請參閱第四圖，其為本發明之伽瑪電壓產生電路的伽瑪電壓表。如圖所示，若選擇資料GC為7時，則選擇單元20選擇接收的第八個伽瑪電壓G7、選擇單元21選擇接收的第八個伽瑪電壓G15…選擇單元27選擇接收的第八個伽瑪電壓G63，換言之，該些選擇單元（20、21…27）輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G7、G15…G63。因此，該些選擇單元（20、21…27）依據選擇資料GC而在不同的時序（T1…T7或T8）改變八個伽瑪電壓（GS0、GS1…GS7）的輸出伽瑪電壓值（G0…G62或G63），即本發明之該些選擇單元（20、21…27）利用分時概念而選擇伽瑪電壓產生電路10所產生之64個伽瑪電壓（G0、G1…G63）而產生八個伽瑪電壓（GS0、GS1…GS7）以提供源極驅動電路30選擇而驅動顯示器之面板的畫素。
如第四圖所示，其為依據一顯示器之色彩解析度的需求而改變，即當顯示器欲達成色彩解析度為3位元時，則伽瑪電壓表儲存8個伽瑪電壓準位；若顯示器欲達成色彩解析度為6位元時，則伽瑪電壓表儲存64個伽瑪電壓準位，而本發明之實施例即為6位元之色彩解析度。因此，當邏輯資料（GC0、GC1及GC2）為010＝2時，則該些選擇單元（20、21…27）依據邏輯資料（GC0、GC1及GC2）而輸出之八個伽瑪電壓（GS0、GS1…GS7）分別為G2、G10、G18、G26、G34、G42、G50、G58，該些選擇單元（20、21…27）之依據其餘邏輯資料（GC0、GC1及GC2）而輸出之八個伽瑪電壓（GS0、GS1…GS7）的結果請參閱第四圖，於此不再詳述。此外，本實施例所舉之伽瑪電壓表係用於清楚的說明該些選擇單元（20、21…27）如何依據選擇資料GC而分時選擇伽瑪電壓產生電路10所輸出之64個伽瑪電壓，進而產生八個伽瑪電壓（GS0、GS1…GS7）以提供源極驅動電路30選擇而驅動顯示器，但是，本實施例僅利用伽瑪電壓表清楚的說明該些選擇單元（20、21…27）如何依據選擇資料GC而分時選擇伽瑪電壓產生電路10所輸出之64個伽瑪電壓，然而，本實施例未限定需增加一儲存單元於顯示器之驅動電路的架構中，而用於儲存伽瑪電壓表，而該些選擇單元（20、21…27）才可以依據選擇資料GC而分時選擇64個伽瑪電壓。
復參閱第一圖、第二圖及第四圖。本發明之實施例為利用該些選擇單元（20、21…27）而減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積，如第一圖所示，當伽瑪電壓產生電路10產生符合顯示器之6位元色彩解析度的64個伽瑪電壓（G0、G1…G63）時，則需要64條連接線來輸出64個伽瑪電壓（G0、G1…G63），然而，當顯示器之色彩解析度提升到8位元，而伽瑪電壓產生電路10產生256個伽瑪電壓（G0、G1…G255），則需要256條連接線來輸出256個伽瑪電壓（G0、G1…G255）。因此，當使用一種8個資料埠與3個選擇埠的該些選擇單元（20、21…27）時，則如第一圖所示，原本伽瑪電壓產生電路10需要64條連接線已變為僅需要8條連接線。
若使用一種16個資料埠與4個選擇埠的該些選擇單元（20、21…23）時，則原本伽瑪電壓產生電路10由需要64條連接線即變為僅需要4條連接線，換言之，源極驅動電路30所佔用之電路面積大幅降低，且選擇資料GC所包含之邏輯資料也必須改為4位元的資料（GC0、GC1、GC2及GC3），以控制該些選擇單元（20、21…23）選擇64個伽瑪電壓（G0、G1…G63）而產生4個伽瑪電壓（GS0、GS1、GS2及GS3）。此外，該些選擇單元（20、21…27）之個數與該些伽瑪電壓（G0、G1…G63）之個數之間為一倍數之關係。如此，當顯示器之色彩解析度提升時，則不會因龐大之伽瑪電壓產生電路10的連接線，與伽瑪電壓產生電路10和源極驅動電路30相互耦接的線路，而提高電路面積的使用範圍。故，本發明可以降低顯示裝置的生產成本與減少線路傳輸的損耗，即本發明是一種大幅減少晶片上之每一組源極驅動電路的數位類比轉換器和內部的連接線路面積之面板驅動電路，以增加電路可使用之面積。
如第二圖所示，源極驅動電路30耦接該些選擇單元（20、21…27），並依據顯示資料SDSP而選擇該些選擇單元（20…26或27）之一輸出的伽瑪電壓（GS0…GS6或GS7），且源極驅動電路30依據所選擇之選擇單元（20…26或27）的伽瑪電壓（GS0…GS6或GS7）產生一驅動訊號SO，以驅動顯示器的面板。本實施例所敘明之顯示資料SDSP為使用者於面板欲顯示之畫面的一資料，且顯示資料SDSP包含第一資料SDSP1與第二資料SDSP2，而本實施例是以6位元資料之顯示資料SDSP為說明，即顯示資料SDSP為000000～111111之二進制的變化。本實施例以顯示資料SDSP為010101作說明，則前面三個位元的位元資料（CD0、CD1及CD2）代表第一資料SDSP1為010而後面三個位元的位元資料（CD3、CD4及CD5）代表第二資料SDSP2為101。另外，本實施例僅以6位元資料之顯示資料SDSP做說明，而顯示資料SDSP並不局限在6位元資料，顯示資料SDSP也可以為4位元資料或8位元資料等等，且第一資料SDSP1與第二資料SDSP2之位元資料的分配並不限定為平均分配，也可以第一資料SDSP1為2個位元資料而第二資料SDSP2為4個位元資料，所以，若設計者欲改變6位元資料之顯示資料SDSP為其他位元之顯示資料SDSP或將位元資料重新分配於第一資料SDSP1與第二資料SDSP2時，則修改本發明之源極驅動電路30後一樣可以達到減少晶片上之源極驅動電路的數位類比轉換器和內部連接線之功效，於此不再詳述。
承上所述，源極驅動電路30包含一比較單元301、一數位類比轉換電路302、與一電容303。源極驅動電路30之比較單元301耦接計數單元40而接收選擇資料GC，且接收為010之第一資料SDSP1，爾後，比較單元301比較第一資料SDSP1與選擇資料GC而產生一時序訊號CMPO。由於計數單元40所產生的選擇資料GC為依據時序（T1…T7、T8）依序產生，即選擇資料GC分別由第一時序T1、第二時序T2…第八時序T8而依序產生選擇資料GC為000…011或111，所以，本發明之比較單元301依序比較000之選擇資料GC與第一資料SDSP1、比較100之選擇資料GC與第一資料SDSP1…比較111之選擇資料GC與第一資料SDSP1。但是，因第一資料SDSP1為010，所以，當計數單元40計數選擇資料GC為000…010而小於或等於010之第一資料SDSP1時，比較單元301則輸出高準位之時序訊號CMPO（即邏輯”1”），反之，若計數單元40計數選擇資料GC為110…111而大於010之第一資料SDSP1時，比較單元301則輸出低準位之時序訊號CMPO(即邏輯”0”)。
上述之比較單元301的比較方式僅為說明比較單元301的比較方式，而未限制比較單元301之設計範疇，所以，比較單元301也可以設計為計數單元40計數選擇資料GC大於第一資料SDSP1時輸出高準位之時序訊號CMPO，選擇資料GC小於或等於第一資料SDSP1時輸出低準位之時序訊號CMPO。此外，計數單元40可以遞增或遞減計數選擇資料GC而提供至比較單元301，同樣地，比較單元301還是可以依序比較選擇資料GC與第一資料SDSP1，而輸出低準位或高準位之時序訊號CMPO至數位類比轉換電路302。
承接上述，本發明之數位類比轉換電路302可以依據該時序訊號CMPO得知目標電壓VTAR為選擇單元(20…26或27)輸出至源極驅動電路30之伽瑪電壓（GS0…GS6或GS7）的該時序（T1…T7或T8）。即目標電壓VTAR對應於該時序（T1…T7或T8），且數位類比轉換電路302是依據該時序訊號CMPO而得知目標電壓VTAR對應於該時序（T1…T7或T8）。以第四圖為例，若顯示資料SDSP為010101，顯示資料SDSP之第一資料SDSP1為010，而比較單元301會從第一時序T1至第八時序T8依序比較計數單元40輸出的選擇資料GC與第一資料SDSP1，當選擇資料GC小於或等於第一資料SDSP1時輸出高準位之時序訊號CMPO，而當選擇資料GC大於第一資料SDSP1時輸出低準位之時序訊號CMPO，所以，在時序訊號CMPO之準位變化時，即可得知目標電壓VTAR所在的時序在第三時序T3。
復參閱第二圖及第五圖。第五圖為本發明之數位類比轉換電路之輸出電壓的選擇表。如圖所示，數位類比轉換電路302耦接該些選擇單元（20、21…27）與比較單元301，且數位類比轉換電路302接收時序訊號CMPO、第二資料SDSP2及該些選擇單元（20、21…27）輸出之該些伽瑪電壓（GS0…GS6、GS7）之一，其中，數位類比轉換電路302是依據第二資料SDSP2選擇該些選擇單元（20、21…27）輸出之該些伽瑪電壓（GS0…GS6、GS7）之一為數位類比轉換電路302的輸出電壓DACO，且當時序訊號CMPO為高準位時，數位類比轉換電路302即依據所選擇的伽瑪電壓（GS0…GS6或GS7）而輸出，然而，當時序訊號CMPO為低準位時，數位類比轉換電路302仍然依據第二資料SDSP2選擇該些伽瑪電壓（GS0…GS6、GS7）之一，但，數位類比轉換電路302因時序訊號CMPO為低準位而不會輸出該些伽瑪電壓（GS0…GS6、GS7）。換言之，當數位類比轉換電路302屢次接收到高準位之時序訊號CMPO，數位類比轉換電路302即一直輸出不同時序（T1…T7或T8）之第二資料SDSP2所選擇選擇單元（20、21…27）輸出的伽瑪電壓（GS0…GS6或GS7），直到數位類比轉換電路302接收到低準位之時序訊號CMPO才會停止輸出所選擇的伽瑪電壓（GS0…GS6或GS7）。如此，數位類比轉換電路302即得知目標電壓VTAR為停止輸出的伽瑪電壓（GS0…GS6或GS7）之時序的前一個時序之伽瑪電壓（GS0…GS6或GS7），例如：當數位類比轉換電路302於第三個時序T3停止輸出的伽瑪電壓（GS0…GS6或GS7）時，則數位類比轉換電路302得知第二個時序T2所產生之伽瑪電壓為目標電壓VTAR。
承接上述，請參閱第六圖，其為本發明之數位類比轉換電路之一實施例。如圖所示，本發明之數位類比轉換電路302包含複數反相器3020-3022及複數傳輸閘40-47、50-53、60-61。如此，該些反相器3020-3022依據第二資料SDSP2而控制該些傳輸閘40-47、50-53、60-61選擇性的傳輸伽瑪電壓GS0-GS7，以供源極驅動電路30驅動面板。該些傳輸閘40-47分別耦接該些選擇單元20-27(如第一圖)以分別接收該些伽瑪電壓GS0-GS7，傳輸閘50耦接該些傳輸閘40、41、60，傳輸閘51耦接該些傳輸閘42、43、60，傳輸閘52耦接該些傳輸閘44、45、61，傳輸閘53耦接該些傳輸閘46、47、61，該些傳輸閘60-61用於輸出輸出電壓DACO。反相器3020耦接該些傳輸閘40-47並依據位元資料CD3而控制該些傳輸閘40-47之導通或截止，反相器3021耦接該些傳輸閘50-53並依據位元資料CD4而控制該些傳輸閘50-53之導通或截止，反相器3022耦接該些傳輸閘60-61並依據位元資料CD5而控制該些傳輸閘60-61之導通或截止。該些傳輸閘40-47、50-53、60-61是由一N型金屬氧化半導體(NMOS)及一P型金屬氧化半導體(PMOS)構成，NMOS之第一端耦接PMOS之第一端，NMOS之第二端耦接PMOS之第二端。傳輸閘40之NMOS的第三端耦接反相器3020之輸出端，傳輸閘40之PMOS的第三端耦接反相器3020之輸入端，傳輸閘40之NMOS的第二端及傳輸閘40之PMOS的第二端更耦接傳輸閘50以傳輸伽瑪電壓GS0至傳輸閘50。傳輸閘41與傳輸閘40之差異為傳輸閘41之NMOS的第三端是耦接反相器3020之輸入端，及傳輸閘41之PMOS的第三端是耦接反相器3020之輸出端。
此外，傳輸閘41之NMOS的第二端及傳輸閘41之PMOS的第二端更耦接傳輸閘50，以傳輸伽瑪電壓GS1至傳輸閘50。爾後，傳輸閘42之NMOS的第二端、傳輸閘42之PMOS的第二端、傳輸閘43之NMOS的第二端及傳輸閘43之PMOS的第二端改為耦接傳輸閘51，其餘傳輸閘42、傳輸閘43及反相器3020之間的耦接關係如同傳輸閘40、傳輸閘41及反相器3020之間的耦接關係。此外，傳輸閘44-47、50-53、60-61及反相器3021-3022之間的耦接關也如同傳輸閘40-43及反相器3020之耦接方式耦接，所以，傳輸閘44-47、50-53、60-61及反相器3021-3022之間其餘之詳細耦接關係請參閱第六圖，於此不再贅述。
故，當數位類比轉換電路302之複數反相器3020-3022分別接收為1(CD3)、0(CD4)、1(CD5)的第二資料SDSP2時，為1之位元資料CD3經由反相器3020控制傳輸閘41、43、45、47為導通狀態以分別傳輸伽瑪電壓GS1至傳輸閘50、傳輸伽瑪電壓GS3至傳輸閘51、傳輸伽瑪電壓GS5至傳輸閘52及伽瑪電壓GS7至傳輸閘53。為0之位元資料CD4經由反相器3021控制傳輸閘50、52為導通狀態以分別傳輸伽瑪電壓GS1至傳輸閘60及傳輸伽瑪電壓GS5至傳輸閘61。為1之位元資料CD5經由反相器3022控制傳輸閘61輸出伽瑪電壓GS5，此伽瑪電壓GS5即為數位類比轉換電路302之輸出電壓DACO。然而，第六圖僅為本發明之數位類比轉換電路302之如何選擇複數伽瑪電壓GS0-GS7之一的實施例，本發明並未限定數位類比轉換電路302之構成方式，例如利用複數電晶體(NMOS或PMOS) 取代該些傳輸閘44-47、50-53、60-61，並配合其他電子元件而構成數位類比轉換電路，如此，由該些電晶體組成之數位類比轉換電路同樣也可以選擇性輸出複數伽瑪電壓GS0-GS7之一作為驅動面板之驅動訊號SO。
復第二圖所示，電容303耦接於數位類比轉換電路302之輸出端。電容303依據該目標電壓VTAR而產生一驅動訊號SO，以驅動面板。即當數位類比轉換電路302接收高準位之時序訊號CMPO時，數位類比轉換電路302會依據第二資料SDSP2選擇該些伽瑪電壓（GS0…GS6、GS7）之一並輸出所選擇的伽瑪電壓至電容303進行充放電，直到數位類比轉換電路302接收低準位之時序訊號CMPO時，數位類比轉換電路302的輸出訊號為浮動的，同時，控制電容303上所儲存的電壓SDRI為驅動訊號SO，以驅動面板。即數位類比轉換電路302在不輸出伽瑪電壓時，放大單元304輸出之驅動訊號SO的來源改由電容303上之驅動訊號SDRI提供，而不是由數位類比轉換電路302輸出之伽瑪電壓提供。因此，該驅動訊號SDRI即經由一放大單元304放大為驅動訊號SO而輸出，以驅動面板。又，源極驅動電路30更可以加入一緩衝單元305而儲存顯示資料SDSP，以加速比較單元301與數位類比轉換電路302分別讀取第一資料SDSP1與第二資料SDSP2，以產生驅動訊號SO而驅動該面板。
綜合上面所述的內容可知，當緩衝單元305接收的顯示資料SDSP為010101，計數單元40開始計數第一選擇資料GC為000時，如第五圖所示，數位類比轉換電路302依據1（CD3）0（CD4）1（CD5）＝5之第二資料SDSP2選擇該些選擇單元(20、21…27)所輸出之該些伽瑪電壓（GS0…GS6、GS7）之中的第六個選擇單元25輸出的伽瑪電壓GS5，而在下一時序（T1…T7或T8）且數位類比轉換電路302再接收到高準位之時序訊號CMPO時，數位類比轉換電路302一樣輸出第六個選擇單元25所輸出的伽瑪電壓GS5，以此類推，在計數單元40計數至第三選擇資料GC為010時，數位類比轉換電路302因屢次接收到高準位之時序訊號CMPO，而每次都將選擇之第六個伽瑪電壓GS5輸出至電容303以對電容充電，直到計數單元40計數至第四選擇資料GC為110，而數位類比轉換電路302接收到低準位之時序訊號CMPO後，數位類比轉換電路302即不會輸出已選擇的第六個選擇單元25所輸出的伽瑪電壓GS5。如第四圖所示。在第一選擇資料GC為000時數位類比轉換電路302依據第二資料SDSP2所選擇的第六個選擇單元25所輸出的伽瑪電壓GS5即為G40，在第二選擇資料GC為100時，數位類比轉換電路302依據第二資料SDSP2所選擇的第六個選擇單元25所輸出的伽瑪電壓GS5即為G41，而在第三選擇資料GC為010時第六選擇單元25所輸出的第六個個伽瑪電壓GS5即為G42，因此，數位類比轉換電路302最後輸出的電壓為G42之伽瑪電壓值。
承接上述，數位類比轉換電路302輸出的伽瑪電壓會對與其耦接之電容303充電而產生驅動訊號SDRI，且放大單元304耦接電容303與數位類比轉換電路302，所以，放大單元304會依據該驅動訊號SDRI而產生放大後之驅動訊號SO，以驅動顯示器或面板而產生所需之畫面。此外，因數位類比轉換電路302輸出的伽瑪電壓為G40之伽瑪電壓值改變至G41之伽瑪電壓值後再改變至G42之伽瑪電壓值，所以，電容303所產生之驅動訊號SDRI也是由G40之伽瑪電壓值逐漸改變至G42之伽瑪電壓值，而最後對電容303充電之伽瑪電壓G42為目標電壓VTAR，反之，若計數單元40為遞減計數，即選擇資料GC由7往0數，使電容303所產生之驅動訊號SDRI的電壓值為G42之伽瑪電壓值的目標電壓VTAR，此為該技術領域具有通常知識者依據上述可容易推知，於此不在加以贅述。然而，本實施例為遞增計數，所以，電容303之驅動訊號SDRI最後由G40之伽瑪電壓值變化至G42之伽瑪電壓值後即經由放大單元304放大為驅動訊號SO且輸出，以驅動面板。
然而，請參閱第七圖，其為本發明之源極驅動電路30之另一實施例。如圖所示，本發明之源極驅動電路30更可以依據驅動不同面板的特性，而不需要設計電容303及放大單元304於源極驅動電路30。如此，源極驅動電路30不須控制電容303的充放電而產生驅動訊號SDRI，及不須經由放大單元304放大驅動訊號SDRI而產生驅動訊號SO後再驅動面板。源極驅動電路30改為直接輸出數位類比轉換電路302產生的輸出電壓DACO至面板，以驅動面板。因此，本發明之源極驅動電路30在驅動不同的面板時亦可以達到大幅減少晶片內部連接線及減少數位類比轉換器302之數量，並依據不同的面板針對源極驅動電路30內部電路作一精簡設計，以降低晶片面積之消耗與更加節省生產成本。
綜上所述，本發明為一種面板驅動電路，其包含一伽瑪電壓產生電路、複數選擇單元及至少一源極驅動電路。伽瑪電壓產生電路產生複數伽瑪電壓至該些選擇單元，則該些選擇單元依據一選擇資料而分時輸出該伽瑪電壓產生電路所產生之該些伽瑪電壓至該源極驅動電路，該源極驅動電路依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且源極驅動電路依據該目標電壓產生一驅動訊號，以驅動一面板。
故本發明實為一具有新穎性、進步性及可供產業上利用者，應符合我國專利法專利申請要件無疑，爰依法提出發明專利申請，祈鈞局早日賜准專利，至感為禱。
惟以上所述者，僅為本發明一較佳實施例而已，並非用來限定本發明實施之範圍，故舉凡依本發明申請專利範圍所述之形狀、構造、特徵及精神所為之均等變化與修飾，均應包括於本發明之申請專利範圍內。
10．．．伽瑪電壓產生電路
20．．．選擇單元
21．．．選擇單元
23．．．選擇單元
25．．．選擇單元
26．．．選擇單元
27．．．選擇單元
30．．．源極驅動電路
301．．．比較單元
302．．．數位類比轉換電路
3020．．．反相器
3021．．．反相器
3022．．．反相器
303．．．電容
304．．．放大單元
305．．．緩衝單元
40．．．傳輸閘
41．．．傳輸閘
42．．．傳輸閘
43．．．傳輸閘
44．．．傳輸閘
45．．．傳輸閘
46．．．傳輸閘
47．．．傳輸閘
50．．．傳輸閘
51．．．傳輸閘
52．．．傳輸閘
53．．．傳輸閘
60．．．傳輸閘
61．．．傳輸閘
B．．．藍色
CD0．．．位元資料
CD1．．．位元資料
CD2．．．位元資料
CD3．．．位元資料
CD4．．．位元資料
CD5．．．位元資料
CMP0．．．時序訊號
DAC0．．．輸出電壓
G．．．綠色
G0．．．伽瑪電壓
G1．．．伽瑪電壓
G10．．．伽瑪電壓
G11．．．伽瑪電壓
G12．．．伽瑪電壓
G13．．．伽瑪電壓
G14．．．伽瑪電壓
G15．．．伽瑪電壓
G16．．．伽瑪電壓
G17．．．伽瑪電壓
G18．．．伽瑪電壓
G19．．．伽瑪電壓
G2．．．伽瑪電壓
G20．．．伽瑪電壓
G21．．．伽瑪電壓
G22．．．伽瑪電壓
G23．．．伽瑪電壓
G24．．．伽瑪電壓
G25．．．伽瑪電壓
G255．．．伽瑪電壓
G26．．．伽瑪電壓
G27．．．伽瑪電壓
G28．．．伽瑪電壓
G29．．．伽瑪電壓
G3．．．伽瑪電壓
G30．．．伽瑪電壓
G31．．．伽瑪電壓
G32．．．伽瑪電壓
G33．．．伽瑪電壓
G34．．．伽瑪電壓
G35．．．伽瑪電壓
G36．．．伽瑪電壓
G37．．．伽瑪電壓
G38．．．伽瑪電壓
G39．．．伽瑪電壓
G4．．．伽瑪電壓
G40．．．伽瑪電壓
G41．．．伽瑪電壓
G42．．．伽瑪電壓
G43．．．伽瑪電壓
G44．．．伽瑪電壓
G45．．．伽瑪電壓
G46．．．伽瑪電壓
G47．．．伽瑪電壓
G48．．．伽瑪電壓
G49．．．伽瑪電壓
G5．．．伽瑪電壓
G50．．．伽瑪電壓
G51．．．伽瑪電壓
G52．．．伽瑪電壓
G53．．．伽瑪電壓
G54．．．伽瑪電壓
G55．．．伽瑪電壓
G56．．．伽瑪電壓
G57．．．伽瑪電壓
G58．．．伽瑪電壓
G59．．．伽瑪電壓
G6．．．伽瑪電壓
G60．．．伽瑪電壓
G61．．．伽瑪電壓
G62．．．伽瑪電壓
G63．．．伽瑪電壓
G7．．．伽瑪電壓
G8．．．伽瑪電壓
G9．．．伽瑪電壓
GC．．．選擇資料
GC0．．．邏輯資料
GC1．．．邏輯資料
GC2．．．邏輯資料
GC3．．．邏輯資料
GS0．．．伽瑪電壓
GS1．．．伽瑪電壓
GS2．．．伽瑪電壓
GS3．．．伽瑪電壓
GS4．．．伽瑪電壓
GS5．．．伽瑪電壓
GS6．．．伽瑪電壓
GS7．．．伽瑪電壓
R．．．紅色
SDRI．．．驅動訊號
SDSP．．．顯示資料
SDSP1．．．第一資料
SDSP2．．．第二資料
S0．．．驅動訊號
T1．．．時序
T2．．．時序
T3．．．時序
T4．．．時序
T5．．．時序
T6．．．時序
T7．．．時序
T8．．．時序
VTAR．．．目標電壓
第一圖為本發明之閘極驅動電路的方塊圖；
第二圖為本發明之源極驅動電路的方塊圖；
第三圖為本發明之選擇資料時序圖；
第四圖為本發明之伽瑪電壓產生電路的伽瑪電壓表；
第五圖為本發明之輸出電壓的選擇表；
第六圖為本發明之數位類比轉換電路之一實施例；及
第七圖為本發明之源極驅動電路的另一方塊圖。
第二圖為本發明之源極驅動電路的方塊圖；
第三圖為本發明之選擇資料時序圖；
第四圖為本發明之伽瑪電壓產生電路的伽瑪電壓表；
第五圖為本發明之輸出電壓的選擇表；
第六圖為本發明之數位類比轉換電路之一實施例；及
第七圖為本發明之源極驅動電路的另一方塊圖。
10．．．伽瑪電壓產生電路
20．．．選擇單元
21．．．選擇單元
27．．．選擇單元
40．．．計數單元
G0．．．伽瑪電壓
G1．．．伽瑪電壓
G56．．．伽瑪電壓
G57．．．伽瑪電壓
G6．．．伽瑪電壓
G62．．．伽瑪電壓
G63．．．伽瑪電壓
G7．．．伽瑪電壓
G8．．．伽瑪電壓
GC．．．選擇資料
GC0．．．邏輯資料
GC1．．．邏輯資料
CC2．．．邏輯資料
Claims (9)
- 一種面板驅動電路，其包含：
一伽瑪電壓產生電路，產生複數伽瑪電壓；
複數選擇單元，耦接該伽瑪電壓產生電路，並依據一選擇資料而分時輸出該些伽瑪電壓；及
至少一源極驅動電路，耦接該些選擇單元，並依據一顯示資料而選擇接收該些選擇單元之一輸出的該伽瑪電壓為一目標電壓，且依據該目標電壓產生一驅動訊號，以驅動一面板。 - 如申請專利範圍第1項所述之面板驅動電路，其中更包含：
一計數單元，耦接該些選擇單元，並依據一時序依序產生該選擇資料，並傳送該選擇資料至該些選擇單元，以控制該些選擇單元分時輸出該些伽瑪電壓。 - 如申請專利範圍第1項所述之面板驅動電路，其中該源極驅動電路包含：
一比較單元，接收該顯示資料之一第一資料，並比較該第一資料與該選擇資料而產生一時序訊號；
一數位類比轉換電路，耦接該些選擇單元與該比較單元，該數位類比轉換電路依據該顯示資料之一第二資料與該時序訊號而選擇該些選擇單元之一輸出的該伽瑪電壓為該目標電壓；以及
一電容，耦接該數位類比轉換電路，並依據該目標電壓而產生一驅動訊號，以驅動該面板。 - 如申請專利範圍第3項所述之面板驅動電路，其中該源極驅動電路更包含：
一緩衝單元，接收該顯示資料，並輸出該顯示資料之該第一資料至該比較單元，且輸出該顯示資料之該第二資料至該數位類比轉換電路。 - 如申請專利範圍第3項所述之面板驅動電路，其中該源極驅動電路更包含：
一放大單元，耦接該數位類比轉換電路與該電容，該放大單元用以放大該驅動訊號，以驅動該面板。 - 如申請專利範圍第3項所述之面板驅動電路，其中該比較單元比較該選擇資料小於或等於該第一資料時，該數位類比轉換電路輸出該目標電壓而對該電容充電，該比較單元比較該選擇資料大於該第一資料時，該數位類比轉換電路控制該電容輸出該驅動訊號而驅動該面板。
- 如申請專利範圍第3項所述之面板驅動電路，其中該比較單元比較該選擇資料大於該第一資料時，該數位類比轉換電路輸出該目標電壓而對該電容充電，該比較單元比較該選擇資料小於或等於該第一資料時，該數位類比轉換電路控制該電容輸出該驅動訊號而驅動該面板。
- 如申請專利範圍第1項所述之面板驅動電路，其中該些選擇單元之個數與該些伽瑪電壓之個數之間為一倍數之關係。
- 如申請專利範圍第1項所述之面板驅動電路，其中該伽瑪電壓產生電路依據一伽瑪曲線而產生該些伽瑪電壓。
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