SU951291A1 - Устройство дл нормализации кодов Фибоначчи - Google Patents
Устройство дл нормализации кодов Фибоначчи Download PDFInfo
- Publication number
- SU951291A1 SU951291A1 SU803002942A SU3002942A SU951291A1 SU 951291 A1 SU951291 A1 SU 951291A1 SU 803002942 A SU803002942 A SU 803002942A SU 3002942 A SU3002942 A SU 3002942A SU 951291 A1 SU951291 A1 SU 951291A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- trigger
- convolution
- zero
- Prior art date
Links
Landscapes
- Complex Calculations (AREA)
Description
Изобретение относится к вычислительной технике и может быть использовано в специализированных вычислительных машинах.
Известны устройства для приведения кодов Фибоначчи к нормальной форме, содержащие блоки свертки по числу разрядов нормализуе- 5 мото кода, построенные на основе алгоритма нормализации, заключающегося в последовательном применении операции свертки двоичных разрядов [1] и [2]. 10
Недостатком известных устройств является значительное количество оборудования при разрядности реальных специализированных вычислительных машин.
Наиболее близким к предлагаемому по тех- (J нической сущности является устройство для приведения p-кодов Фибоначчи к минимальной форме, содержащее п однотипных блоков свертки, причем первый выход 1-ого блока свертки соединен с первым входом (1-1)-ого и 20 вторым входом (1—р—1)-ого блоков свертки, второй выход 1-ого блока свертки является 1-ым информационным выходом устройства и соединен с третьим входом (1+1)-ого и четвер2 тым входом (1+р+1)-ого блоков свертки, управляющий вход устройства соединен с пятыми входами всех блоков свертки, шестые входы каждого блока свертки являются информационными входами устройства. Кроме того, блок свертки содержит триггер, элемент И, первый и второй элементы ИЛИ, причем выход элемента И соединен с первым входом первого элемента ИЛИ и является первым выходом блока, единичный выход триггера является вторым ' выходом блока, первый и второй входы блока соединены соответственно с первым и вторым входами второго элемента ИЛИ, выход которого соединен с нулевым входом триггера, нулевой выход триггера соединен с первым входом элемента И, второй, третий и четвертый входы, которого являются соответственно третьим, четвертым и пятым входами блока, второй вход первого элемента ИЛИ является шестым входом блока, выход первого элемента ИЛИ соединен с единичным входом триггера (3].
Это устройство позволяет производить операцию нормализации кодов Фибоначчи, а также может использоваться как многовходовой , 951291 счетчик импульсов в кодах Фибоначчи. Однако недостатком его являются значительные аппаратурные затраты при построении многоразрядных нормализаторов кодов Фибоначчи.
Целью изобретения является снижение апла- 5 ратурных затрат.
Поставленная цель достигается тем, что в устройстве, содержащее блок свертки, дополнительно вводятся η-разрядный сдвиговый регистр, два триггера, три элемента И, генератор импуль-ю сов, счетчик, элемент задержки, причем первый вход первого элемента И соединен с входом задания режима работы устройства и первым входом блока свертки, второй вход - с выходом нулевого разряда сдвигового регистра, третий 15 вход с выходом первого разряда сдвигового регистра, а выход с единичным входом первого триггера, нулевой вход которого соединен с выходом элемента задержки, а нулевой выход · подключен к первому входу второго элемента 2о И, второй, вход которого соединен с выходом переполнения счетчика и входом элемента задержки, а выход подключен к нулевому входу второго триггера, единичный вход которого соединен с входом начала работы устройства , 2S а выход подключен к первому входу третьего элемента И, второй вход которого соединен с выходом генератора импульсов, а выход подключен к входу счетчика и тактовому входу сдвигового регистра, входы разрядов, с пер- 30 вого по (п-1)-ый которого являются информационными входами устройства, вход нулевого разряда соединен с первым выходом блока свертки, нулевой вход (п-2)-ого разряда и единичный вход (η-1)-ого разряда соединены с вторым выходом блока свертки, а выходы 35 (п-2)-ого, (n-l)-oro разрядов и выход переноса сдвигового регистра соединены с вторым, третьим и четвертым входами блока свертки соответственно, разрядный выход счетчика подключен к пятому входу блока свертки, выхо- 40 ды разрядов с первого по (п-1)-ый являются информационными, а третий выход блока свертки контрольным выходом устройства.
I
Кроме того, блок свертки содержит первый триггер, первый элемент И, два элемента ИЛИ, два элемента запрета, второй элемент И, элемент задержки, дешифратор, второй триггер, причем первый вход первого элемента И соединен с инверсным выходом первого элемента ИЛИ и с первым входом второго элемента И, второй вход — с первым информационным входом первого элемента запрета и вторым входом блока свертки, третий вход - соединен с управляющим входом первого элемента запрета и третьим входом блока свертки, а . выход подключен < к единичному входу первого триггера, первому входу второго элемента ИЛИ, информационному входу второго элемен та запрета, управляющий вход которого соединен с первым входом блока свертки, а выход соединен с единичным входом второго триггера, выход которого соединен с третьим выходом блока свертки, нулевой вход первого триггера Соединен с выходом элемента задержки и первым входом первого элемента ИЛИ, а выход соединен с входом элемента задержки и вторым входом первого элемента ИЛИ, кроме того выход первого, элемента запрета соединен с вторым выходом блока свертки, а его второй информационный вход соединен с выходом дешифратора, вход которого соединен с пятым входом блока свертки, второй вход второго элемента И соединен с четвертым входом блока свертки, а выход подключен к второму входу второго элемента ИЛИ, выход которого соединен с первым выходом блока свертки.
На'чертеже приведена функциональная схема устройства.
Устройство содержит блок свертки 1, сдвиговый регистра, контрольный выход 3, элементы И 4-6, триггеры 7 и 8, элемент задержки 9, счетчик 10, разрядные выходы счетчика 11, шину переполнения счетчика 12, генератор импульсов 13, выход 14 генератора импульсов, I элементы И 15 и 16, элементы запрета 17 и 18, элементы ИЛИ 19 и 20, триггеры 21 и 22, элемент задержки 23, дешифратор 24, шину задания режима работы 25, шину начала работы
26.
Работу устройства в режиме нормализации рассмотрим на примере приведения к нормальной форме фибоначчиевого восьмиразрядного . кода 11101000. Предварительно все триггеры и счетчик устанавливаются в нулевое состояние, и на сдвиговый регистр заносится код 011101000 (полагаем, что регистр’ девятиразрядный) . На шине 25 устанавливается единичный сигнал, который соответствует режиму нормализации и посредством элемента запрета 18 блокирует установку триггера 22 в единичное состояние. По шине 26 передается сигнал начала преобразования? который устанавливает в единичное состояние триггер 8, в результате чего импульсы от генератора поступают на вход счетчика и сдвигают содержимое регистра 2. В результате после первого тактового импульса в регистре находится код 001110100, после второго — 00011.1010, после третьего 000011101, после четвертого тактового импульса единица из старшего разряда регистра через элементы И 16 и ИЛИ 20 по цепи циклического переноса запишется в нулевой разряд регистра 2, так как триггер 21 находится в нулевом состоянии, а следовательно, на оба входа элемента ИЛИ 19 поступают нули, на его инверсном выходе устанавливается единица и в результате открывается элемент И 16. В сдвиговом регистре формируется кол 100001110.
Но пятому тактовому импульсу первоначально В. сдвиговом регистре образуется код 010000111. Однако, так как в двух старших разрядах регистра находятся единицы, то посредством элементов И 15 и ИЛИ 20 в нулевой разряд регистра 5 заносится единица и в результате формируется код 110000111. Параллельно с этим посредством триггера 21 элемента задержки 23, элементаИЛИ 19 блокируются циклический перенос и занесение единицы в младший разряд регистра 10 2 на время двух последующих тактовых импульсов. В двух младших разрядах регистра находятся единицы, в результате триггер 7. установится в единичное состояние. По шестому тактовому импульсу в регистре 2 формируется код15. 011000011, содержимое счетчика равно шести, что соответствует нахождению первого и второго разрядов нормализуемого кода соответственно в двух старших разрядах регистра, в результате возбуждается выход дешифратора. По седьмому 20 тактовому импульсу на регистре формируется код 001100001, по восьмому импульсу — 100110000, т. е. возникает единица циклического переноса, по девятому тактовому импульсу — 010011000 и на счетчике возникает сигнал 25 переполнения, однако, так как триггер 7 находится в единичном состоянии, этот сигнал не вызывает обнуления триггера 8, в результате на управляющий вход сдвигового регистра поступает новая серия на девяти тактовых им- 30 пульсов. Через время элемента, задержки 9 триггер 7 обнуляется. По шестому тактовому импульсу срабатывает дешифратор, на выходе элемента 17 устанавливается единица и в результате осуществляется сдвиг единицы в двух 35 старших разрядах регистра 2. В течение этой серии тактовых импульсов триггер 7 не устанавливается в единичное состояние, в результате чего сигнал переполнения счетчика устанавливает в нуль триггер 8, что блокирует прохождение 40 импульсов от генератора 13 на управляющий вход регистра. На этом нормализация заканчивается и со сдвигового регистра? 2 считывается нормализованный код - 01000100.
После этого снимается сигнал с шины 25. 45
В режиме контроля в отличие от режима, нормализации на шине 25 устанавливается нулевой сигнал. В результате после установки триггера 8 в единичное состояние на сдвинь вый регистр от генератора поступает только одна серия тактовых импульсов». При этом, если в каких-либо соседних разрядах кода окажутся две единицы, триггер 22 устанавливается в единичное состояние, и на контрольном выходе 3 устройства появляется сигнал ошибки. По сравнению с прототипом [3] в данном устройстве используется только один блок свертки вместо п, что позволяет сократить аппаратурные затраты для кодов, соответствующих диапазонам чисел реальных специализированных ЦВМ более, чем в 10 раз.
Claims (3)
- Изобретение относитс к вычислительной технике и может быть использовано в специализированных вычислительных машинах. Известны устройства дл приведени кодов Фибоначчн к нормальной форме, содержащие блоки свертки по чнслу разр дов нормализуемого кода, построенные на основе алгоритма нормализации, заключающегос в последователь ном применении операции свертки двоичных разр дов (1) и 2. F eдocтaткoм нзвестных устройств вл етс значительное количество оборудовани при разр дности реальных специализированных вычислительных машин. Наиболее близким к предлагаемому по технической сущности вл етс устройство дл приведени р-кодов Фибоначчи к минимальной форме, содержащее п однотипных блоков свертки , причем первый выход 1-ого блока свертки соединен с первым входом (1-1) -ого и вторым входом (l-p-l)-oro блоков свертки, второй выход 1-ого блока свертки вл етс 1-ым информационным выходом устройства и соединен с третьим входом (1+1)-ого и четвертым входом (1+р+1)-ого блоков свертки, управл ющий вход устройства соединен с п тыми входами всех блоков свертки, шестые входы каждого блока свертки вл ютс информационными входами устройства. Кроме того, блок свертки содержит триггер, злемент И, первый и второй злементы ИЛИ, причем выход злемента И соединен с первым входом первого злемента ИЛИ и вл етс первым выходом блока, единичный выход триггера вл етс вторым выходом блока, первый и второй входы блока соединены соответственно с первым и вторым входами второго злемента ИЛИ, выход которого соединен с нулевым входом триггера, нулевой выход триггера соединен с первым входом элемента И, второй, третий и четвертый входы, которого вл ютс соответственно третьим, четЬерТ1 1м и п тым входами блока, второй вход первого элемента ИЛИ вл етс шестым входом блока, выход первого злемента ИЛИ соединен с единичным входом триггера 3. Это устройство позвол ет производить операцию нормализации кодов Фибоначчи, а также может использоватьс как многовходовой счетчик илтульсов в кодах Фибоначчи. Oiwako недостатком его вл ютс значительные аппаратурные затраты при построении многоразр дных нормализаторов кодов Фибоначчи. Целью изобретени вл етс снижение аппаратурных затрат. Поставленна цель достигаетс тем, что в устройстве, содержащее блок свертки, дополни тельно ввод тс п-разр дный сдвиговый perHCT два триггера, три элемента И, генератор импул сов, счетчик, элемент задержки, причем первый |ВХод первого элемента И соединен с входом з дани режима работы устройства и первым вхо дом блока свертки, второй вход - с выходом нулевого разр да сдвигового регистра, третий вход с выходом первого разр да сдвигового регистра, а выход с единичным входом первого триггера, нулевой вход которого соединен с выходом элемечта задержки, а нулевой выход подключен к первому входу второго элемента И, второй, вход которого соединен с выходом переполнени счетчика и входом элемента задержки , а выход подключен к нулевому входу второго триггера, единичный вход которого соединен с входом начала работы устройства , а выход подключен к первому входу третьего элемента И, второй вход которого соединен с выходом генератора импульсов, а выход подключен к входу счетчика и тактовому входу сдвигового регистра, входы разр дов, с первого по (п-О-ый которого вл ютс информационными входами устройства, вход нулевого разр да соединен с первым выходом блока .свертки, нулевой вход (п-2)-ого разр да и единичный вход (n-l)-oro разр да соединены с вторым выходом блока свертки, а выходы {п-2)-ого, (n-l)-oro разр дов и выход переноса сдвигового регистра соединены с вторым, третьим и четвертым входами блока свертки соответственно, разр дный выход счетчика подключен к п тому входу блока свертки, выходы разр дов с первого по (п-1)-ый вл ютс информационными, а третий выход блока свертки контрольным выходом устройства. I Кроме того, блок свертки содержит первый триггер, первый элемент И, два элемента ИЛИ, два элемента запрета, второй элемент И, элемент задержки, дешифратор, второй триггер, причем первый вход первого элемента И соединен с инверсным выходом первого элемента ИЛИ и с первым входом второго элемента И, второй вход - с первым информационным входом первого элемента запрета и вторым входом блока свертки, третий вход - соединен с прйвл ющим входом первого элемента запрета и третьим входом блока свертки, а . выход подключен к единичному входу первого триггера, первому входу второго элемента ИЛИ, информациотюму входу второго элемента запрета, управл ющий вход которого соединен с первым входом блока свертки, а выход соединен с eди fflчным входом второго триггера, выход которого соединен с третьим выходом блока свертки, нулевой вход первого триггера Соединен с выходом элемента задержки и первым входом первого элемента ИЛИ, а выход соединен с входом элемента задержки и вторым входом первого элемента ИЛИ, кроме того выход первого, элемента запрета соединен с вторым выходом блока свертки, а его второй информационный вход соединен с выходом дешифратора , вход которого соединен с п тым входом блока свертки, второй вход второго элемента И соединен с четвертым входом блока свертки, а выход подключен к второму входу второго элемента ИЛИ, выход которого соединен с первым выходом блока свертки. Начертеже приведена функциональна схема устройства. Устройство содержит блок свергки 1, сдвиговый регистр 2, контрольный выход 3, элементы И 4-6, триггеры 7 и 8, элемент задержки 9, счетчик 10, разр дные выходы счетчика 11, шину переполнени счетчика 12, генератор импульсов 13, выход И генератора импульсов, 1элемен1Ъ1 И 15 и 16, элементы запрета 17 и 18, элементы ИЛИ 19 и 20, триггеры 21 и 22, элемент задержки 23, дешифратор 24, шину задани режима работы 25, шину начала работы 26. Работу устройства в режиме нормализации рассмотрим на примере приведе ш к нормальной форме фибоначчиевого восьмиразр дного . кода 11101000. Предварительно все триггеры и счетчик устанавливаютс в нулевое состо ние, и на сдвиговый регистр заноситс код 011101000 (полагаем, что регистрдев тиразр дный ) . На шине 25 устанавливаетс единичный сигнал , который соответствует режиму нормализации и посредством элемента запрета 18 блокирует установку триггера 22 в единичное состо ние. По шине 26 передаетс сигнал начала преобразованиЯд который устанавливает в единичное состо ние триггер 8, в результате чего импульсы от генератора поступают на вход счетчика и сдвигают содержимое регистра 2. В реэультате после первого тактового импульса в регистре находитс код 001110100, после второго - 00011.1010, после третьего - 000011101, после четвертого тактового импульса единица из старшего разр да регистра через элементы И 16 и ИЛИ 20 по цепи циклического переноса запишетс в нулевой разр д регистра 2, так как триггер 21 находитс в нулевом состо нии, а следовательно, на оба входа элемента ИЛИ 19 поступают нули, на его инверсном выходе устанавливаетс еди1™ца и в результате открываетс элемент И 16. В сдвиговом регистре формируетс кол 100001110. 5 flo п тому тактовому импульсу первоначально В. сдвиговом регистре образуетс код 0100001 Однако, так как в двух старших разр дах регистра наход тс единицы, то посредством эле ментов И 15 и ИЛИ 20 в нулевой разр д регистра заноситс единица и в результате формируетс код 110000111. Параллельно с этим посредств триггера 21 элемента задержки 23, элемента ИЛИ 19 блокируютс циклический перенос и занесение единицы в младший разр д регистра 2 на врем двух последующих тактовых импу сов. В двух младших разр дах регистра наход тс единицы, в результате триггер 7, установитс в единичное состо ние. По шестому тактовому импульсу в регистре 2 формируетс ко 011000011, содержимое счетчика равно шести, что соответствует нахождению первого и второго разр дов нормализуемого кода соответственно в двух старших разр дах регистра, в результат возбуждаетс выход дешифратора. По седьмом тактовому импульсу на регистре формируетс код 001100001, по восьмому импульсу 100110000 , т. с. возникает единица циклическо го переноса, по дев тому тактовому импульсу 010011000 и на счетчике возникает сигнал переполнени , однако, так как триггер 7 находитс в единичном состо нии, этот сигнал не вызывает обнулени триггера 8, в результат на управл ющий вход сдвигового регистра поступает нова сери на дев ти тактовых импульсов . Через врем элемента, задержки 9 триггер 7 обнул етс . По шестому тактовому импульсу срабатывает дешифратор, на выходе элемента 17 устанавливаетс единица и в результате осуществл етс сдвет единицы в двух старших разр дах регистра 2. В течение этой серии TakTOBbix импульсов триггер 7 не устанавливаетс в единичное состо ние, в результате чего сигнал переполнени счетчика устанавливает в нуль триггер 8, что блокирует прохождение импульсов от генератора 13 на .управл ющий вход регистра. На этом нормализаци заканчиваетс и со сдвигового регистра: 2 считываетс нормализованный код - 01000100. После этого снимаетс сигнал с шины 25. В режиме контрол в отличие от режима, нормализации на шине 25 устанавливаетс нулевой сигнал. В результате после установки триггера 8 в единичное состо ние на сдвиго; вый регистр от генератора поступает только одна сери тактовых импульсов.. При этом, если в каких-либо соседних разр дах кода окажутс две единицы, триггер 22 устанавливаетс в единичное состо ние, и на контрольном выходе 3 устройства по вл етс сигнал оижбки. По сравнению с прототипом 3 в данном устройстве используетс только один блок свертки нместо п, что позвол ет сокра16 тить аппаратурные затраты дл кодой, ссютветствующих диапазонам чисел реальных специализированных ЦВМ более, чем в 10 раз. Формула изобретени 1. Устройство дл нормализации кодов . Фибоначчи, содержащее блок свертки, отличающеес тем, что, с целью снижени аппаратурных затрат, устройство содержит празр дный сдвиговый регистр, два т тиггера, три элемента И, генератор импульсов, счетчик, элемент задержки, причем первый вход первого элемента И соединен со входом задани режима работы устройства и первым входом блока свертки, второй вход - с выходом нулевого разр да сдвигового регистра, третий вход с выходом первого разр да сдвигового регистра, а выход - с единичным входом первого триггера , нулевой вход которого соединен с выходом элемента задержки, .а нулевой выход подключен к первому входу второго элемента И, второй вход которого соединен с выходом переполнени счетчика и входом .элемента задержки, а выход подключен к нулевому входу второго триггера, единишаш вход которого соединен с -входом начала работы устройства, а выход подключен к первому входу третьего элемента И, второй вход которого соединен с выходом генератора импульсов, а выход подключен к входу счетчика и тактовому входу сдвигового регистра, входы разр дов с первого по (п-1)-й которого вл ютс информационными входами устройства, вход нулевого разр да регистра соединен с первым выходом блока свертки, нулевой вход (п-2)-го разр да и единичный вход (п-1)-го разр да соединены со вторым выходом блока свертки, а выходы (п-2)-го и (n-l)-ro разр дов и выход переноса сдвигового регистра соединены со вторым, третьим и четвертым входами блока свертки соответственно, разр дный выход счетчика подключен к п тому входу блока свертки, выходы разр дов счетчика, с первого по (п-1)- и, вл ютс информационными, а третий выход блока свертки - контрольным выходом устройства . 2. Устройство по п. 1, отличающее - с тем, что блок свертки содержит первый триггер, первый элемент И, два элемента ИЛИ, два элемента запрета, второй элемент И, элемент И, элемент задержки, дешифратор, второй триггер, причем первый вход первого элемента И соединен с инверсным выходом первого элеента ИЛИ и с первым входом второго элемента И, второй вход первого элемента И соединен первым информационным входом первого элемента запрета и вторым входом блока свергки , третий вход соединен с управл ющим входом первого элемента запрета и третьим входом блока свертки, а выход - подключен к единичному входу первого триггера, первому входу второго элемента ИЛИ и информационному входу второго элемента запрета, управл ющий вход которого соединен с первм входом блока свертки, а выход соединен с единичным входом второго триггера, выход которого соединен с. третьим выходом блока (жертки, нулевой вход первого триггера соединен с выходом элемента задержки и первьгм входом первого элемента ИЛИ, а выход - соединен со входом элемента задержки и вторым входом первого элемента ИЛИ, кроме того, выход первого элемента за прета соединен со вторым выходом блока свертки, а его второй информационный вход соединен с выходом дешифратора, вход которого соединен с п тым входом блока свертки, второй вход второго элемента И соединен с четвертым входом блока свертки, а выход подключен ко второму входу второго элемента ИЛИ, выход которого соединен с первым выходом блока свертки. Источники информации, прин тые во внимание при экспертизе 1.Авторское свидетельство СССР № 732864, кл. G 06 F 7/38, 1980.
- 2.Авторское свидетельство СССР по за вке N 2888652/18-24, кл. G 11 С 19/00, 1979.
- 3.Авторское свидетельство СССР № 662930, кл. G 06 F 5/00, 1979 (прототип).Lto
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU803002942A SU951291A1 (ru) | 1980-11-11 | 1980-11-11 | Устройство дл нормализации кодов Фибоначчи |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU803002942A SU951291A1 (ru) | 1980-11-11 | 1980-11-11 | Устройство дл нормализации кодов Фибоначчи |
Publications (1)
Publication Number | Publication Date |
---|---|
SU951291A1 true SU951291A1 (ru) | 1982-08-15 |
Family
ID=20925602
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU803002942A SU951291A1 (ru) | 1980-11-11 | 1980-11-11 | Устройство дл нормализации кодов Фибоначчи |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU951291A1 (ru) |
-
1980
- 1980-11-11 SU SU803002942A patent/SU951291A1/ru active
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU951291A1 (ru) | Устройство дл нормализации кодов Фибоначчи | |
US4159529A (en) | Fibonacci code adder | |
SU1084779A1 (ru) | Преобразователь двоичного кода в двоично-дес тичный | |
SU1396280A2 (ru) | Преобразователь двоичного кода в двоично-дес тичный код угловых единиц | |
SU1022153A1 (ru) | Устройство дл суммировани двоичных чисел | |
SU801258A1 (ru) | -Разр дный двоичный счетчик | |
SU1198749A1 (ru) | Многовходовый счетчик | |
SU928349A1 (ru) | Устройство дл возведени в квадрат число-импульсного кода | |
SU1104506A1 (ru) | Накапливающий сумматор | |
RU2029434C1 (ru) | Устройство для формирования остатка по произвольному модулю от числа | |
SU1120322A1 (ru) | Цифровой функциональный преобразователь | |
SU943704A1 (ru) | Преобразователь двоичного кода в число-импульсный код | |
SU391560A1 (ru) | Устройство для возведения в квадрат | |
SU418971A1 (ru) | ||
SU572781A1 (ru) | Преобразователь двоично-дес тичных чисел в двоичные | |
US5400272A (en) | Diagonal propagation digital multiplier | |
SU387529A1 (ru) | Ше | |
SU801259A1 (ru) | -Разр дный двоичный счетчик | |
SU1451681A1 (ru) | Суммирующее устройство | |
SU432485A1 (ru) | Устройство для преобразования целых троично-двоичных чисел в десятично-двоичныйкод | |
SU1667052A1 (ru) | Комбинационный сумматор кодов Фибоначчи | |
SU1120321A1 (ru) | Устройство дл извлечени корн седьмой степени | |
SU1105896A1 (ru) | Пирамидальна свертка по модулю три | |
SU941992A1 (ru) | Преобразователь число-импульсного кода в параллельный двоичный код | |
SU732946A1 (ru) | Стохастический преобразователь |