SU1405105A1 - Распределитель импульсов - Google Patents
Распределитель импульсов Download PDFInfo
- Publication number
- SU1405105A1 SU1405105A1 SU864142633A SU4142633A SU1405105A1 SU 1405105 A1 SU1405105 A1 SU 1405105A1 SU 864142633 A SU864142633 A SU 864142633A SU 4142633 A SU4142633 A SU 4142633A SU 1405105 A1 SU1405105 A1 SU 1405105A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- inputs
- group
- outputs
- Prior art date
Links
Landscapes
- Pulse Circuits (AREA)
- Complex Calculations (AREA)
- Tests Of Electronic Circuits (AREA)
Abstract
Изобретение может быть использовано в автоматизированных системах контрол и управлени и служит дл расимрени функциональных возможностей устройства. Распределитель импульсов содержит регистр 4, элементы И 17, 12, 19 и 20, элемент 8. задержки , элемент ИЛИ 9, триггер 10 и генератор 11 тактовых импульсов. В устройство введены счетчик 1 адреса , дешифратор 2 адреса, блок 3 пам ти , регистр 5, блок 6 коммутации моментов начала импульсов, триггер 13,
Description
(Л
4; О ел
о ел
группы 14 и 28 элементов И, группу 15 счетчиков, группу 16 элементов ИЛИ, элемент ИЛИ 17, элемент НЕ 18, счетчик 21 импульсов и деимфра- тор 22. Использование устройства позз1405105
вол ет формировать различные длины импульсных последовательностей и импульсные последовательности с перекрытием и упростить модификацию программы . 2 ил.
1
Изобретение относитс к импульсной и вычислительной технике и может быть использовано в автоматизированных системах контрол и управлени .
:Цель изобретени - расширение .. функциональных возможностей устройства за счет формировани импульсов произвольной длительности с произвольными моментами начала в пределах такта, а также за счет наличи мультипрограммного режима работы, что достигаетс путем введени счетчика адреса,, дешифратора адреса, блока- пам ти , регистра, блока коммутации моментов начала импульсов, триггера и группы логических элементов И, ИЛИ НЕ, которые обеспечивают хранение и модификацию программ вьщачи импульс- ;ibix последовательностей с произвольными длительност ми и произвольными моментами начала импульсов в пределах такта.
На фиг. 1 приведена функциональна схема распределител ; на фиг. 2 - функциональна схема блока коммутации , моментов начала импульсов.
Распределитель импульсов содержит счетчик 1 адреса, дешифратор 2 адреса , блок 3 пам ти, регистры 4 и 5, блок 6 коммутации моментов начала,импульсов , элемент И 7, элемент 8 задержки , элемент ИЛИ 9, триггер Ю, генератор 11 тактовых импульсов, элемент И 12, второй триггер 13, группу элементов И 14, группу счетчиков 15, группу элементов ИЛИ 16, второй элемент ИЛИ 17, элемент НЕ 18, третий 19 и четвертый 20 элементы И, счетчик 21 импульсов, дешифратор 22, группу элементов И 28,
На фиг. 1 обозначены также информационный вход 23,первый 24, второй 2.5 и третий 26 управл юшие входы и выходы 27. распределител импульсов.
0
5
0
5
0
5
0
5
Информационный вход 23 распределител соединен с информационным входом счетчика 1 , выход которого соединен с входом дешифратора 2 адреса . Выход дешифратора 2 адреса соеди- н ен с входом блока 3 пам ти. Первые информационные выходы блока 3 пам ти соединены с входами регистра 4 , а вторые информационные выходы блока 3 пам ти - с входами второго регистра 5. Управл ющий выход блока 3 пам ти соединен с входом установки в нуль первого 4 и второго 5 регистров и первым входом элемента ИЛИ 9. Выходы разр дов, кроме последнего, второго регистра 5 соединены с первыми входами блока 6 коммутации моментов начала импульсов, выходы которого соединены с первыми входами группы элементов И 14. Выходы разр дов первого регистра 4 соединены с вторыми входами группы элементов И 14. Выходы группы элементов И 14 соединены с информационными входами группы счетчиков 15, единичные выходы которьк соединены с входами группы элементов ИЛИ 16. Выходы группы элементов ИЛИ 16 соединены с вторыми входами группы элементов И 28, с выходами 27 распределител и входами элемента ИЛИ 17. Выход элемента ИЛИ 17 соеди-, нен с входом элемента НЕ 18, выход ito- торого соединен с первым входом элемента И 12.
Лервый управл ющий вход 24 распределител соединен с первым входом первого триггера 10, выход которого соединен с входом генератора 11 тйкто- вых импульсов. Лервьш выход генератора 11 тактовьпк импульсов соединен с вторым входом элемента И 12, выход которого соединен с синхронизирующим входом дешифратора 2 адреса и входом элемента 8 задержки.
314
Выход элемента 8 соединен с первым входом элемента И 7 и входами синхронизации первого 4 и второго 5 регистров . Выход элемента И 7 соединен со счетным входом счетчика адреса.
Выход генератора 11 тактовых импульсов соединен с первым входом элемента И 19, второй вход которого соединен с выходом последнего раз- р да второго регистра 5, Выход элемента И 19 соединен t первым входом элемента И 20, второй вход которого соединен с выходом элемента ИЛИ 17. Выход элемента И 20 соединен с первы- ми входами группы элементов И 28, выходы которых соединены с входами группы счетчиков 15, выход элемента И 19 соединен также со счетным входом счетчика 21. Выход счетчика 21 соединен с входом дешифратора 22. Выход дешифратора 22 соединен с вторыми входами блока 6 коммутации моментов начала импульсов. Второй управл ющий рход 25 распределител соеди- нен с вторым входом элемента ИЛИ 9 и вторым входом триггера 13. Выход элемента ИЛИ 9 соединен с вторым входом триггера 10. Третий управл ющий вход 26 распределител соединен с пер вым входом триггера 13, выход которого соединен с вторым входом элемента И 7.
Блок 6 коммутации моментов начала импульсов (фиг. 2) содержит группу дешифраторов 29, группу элементов И 30 и группу элементов ИЛИ 31.
Первые входы блока 6 коммутации соединены с входами группы дешифратора 29, Выходы группы дешифраторов 29 соединены с первыми входами группы элементов И 30. Вторые входы блока 6 коммутации соединены с вторыми входами группы элементов И 30, выходы которых соединены с входами группы эле- ментов ИЛИ 31. Выходы группы элементов ИЛИ 31 соединены с выходами блока 6 коммутации.
Распределитель импульсов может работать в двух режимах: однопрограм- мном и мультипрограммнсэм. В блоке 3 пам ти может хранитьс несколько программ .
В однопрограммном режиме работы адрес выполн емой программы с входа 23 распределител заноситс в счетчик 1 адреса. С входа 26 поступает на вход триггера 13 сигнал, который переводит триггер 13 в единичное состо
0 5 0 5 О
с
0 д
0
5
054
ние. Данный триггер выполн ет роль триггера режима.
Начало работы распределител начинаетс путем подачи импульса с входа 24 на вход триггера 10, Триггер 10 переходит в единичное состо ние и разрешает формирование с выходов генератора 11 тактовых импульсов. Так как группа счетчиков 15 находитс в нулевом состо нии, то на выходах группы
элементов ИЛИ 16 имеетс сигнал логи- .
ческого нул , который, проход через элемент ИЛИ 17 и элемент FIE 18, разрешает прохождение через элемент И 12 тактового импульса с первого выхода генератора 11 тактовьсх импульсов . Этот импульс поступает на синхронизирующий вход дешифратора 2 адреса и разрешает выборку информации из блока 3 пам ти по адресу, записанному в счетчике 1 адреса. Этбт импульс через элемент 8 задержки поступает на вход элемента И 7, который нулевым потенциалом, с триггера 13 закрьп . Поз;тому увеличение адреса на счетч:и- ке 1 адреса не происходит. Информаци , выбранна из блока 3 пам ти по импульсу, задержанному на элементе 8 задержки и поступающему на синхронизирующие входы регистров 4 и 5, заноситс в эти регистры.
После считывани информации из блока 3 пам ти в регистры 4 и 5 открываетс элемент И 19, и импульсы с генератора 11 с частотой, определ емой длительностью микротакта, заполн ют счетчик 21. Импульсы с выходов дешифратора 22 определ ют послед довательность микротактов и производ т опрос полей регистра 5, в которых хран тс коды импульсов. При совпадении кода микротакта с выхода дешифратора 22 с кодом начала импульса на соответствующем выходе группы элементов ИЛИ 31 блока 6 коммутации по вл етс сигнал начала импульсов. Сигнал начала импульсов в определенном мик- ротакте с выхода блока 6 коммутации открьшает группу элементов И 14, через которые из полей регистра 4 переписываютс в счетчики 15 коды длин импульсов, начавшихс в Данном микротакте . В результате на соответствующих вькодах 27 распределител по вл етс выходна последовательность импульсов.
Изменение нулевого состо ни определенных счетчиков 15 приводит к по влению сигналов на соответствующих выходах группы элементов ИЛИ 16, которые поступают на элемент ИЛИ 17. Сигнал о начале выполнени импульс- ной последовательности поступает на элемент И 20 и одновременно запрещает через элемент НЕ 18 формирование очередной импульсной последовательности до вьшолнени предыдущей. С на- чалом вьтолнени импульсной последовательности открываетс элемент И 20, и через группу элементов И 28 на вычитающие входы счетчиков 15 поступают сигналы с генератора 11 импуль- сов и измен ют состо ние кодов соответствующих счетчиков 15 по мере изменени номера микротакта. Импульсы на выходах 27 распределител вьщаютс до обнулени соответствующего счет- чика.
После обнулени всех счетчиков сигнал на выходе элемента ИЛИ 17 равен нулю, а на выходе элемента НЕ 18 по вл етс сигнал, который через
элемент И 12 разрешает считывание информации из блока 3 пам ти по адресу, вьщанному из счетчика 1 адреса. В данном случае считываетс информаци по предьщущему адресу, и программа вьщачи импульсной последовательности повтор етс аналогично рассмотренному .
При необходимости закончить вьщачу импульсных последовательностей с входа 25 на вход триггера 10 через элемент ИЛИ 9 поступает сигнал, который запрещает вьщачу тактовых импульсов ,с выходов генератора 11, На этом работа распределител в однопрограммном режиме заканчиваетс .
В мультипрограммном режиме так же как и в однопрограммном работа распределител начинаетс путем подачи на вход 23 начального адреса про-. граммы.
Три;ггер 13 находитс в нулевом состо нии. При подаче сигнала с входа 24 триггер 10 переходит в единичное состо ние. Генератор 11 тактовых импульсов формирует адрес, который через элемент И 12 производит выборку информации из блока 3 пам ти первой импульсной последовательности, заданной по адресу, хранимому в счетчике 1 адреса. Одновременно с выборкой информации о первой импульсной последовательности выбранной программы импульс через элемент 8 задержки и
г 0 5 0
5
Q
5
элемент И 7 увеличивает содержимое счетчика адреса на единицу. Далее распределитель функционирует аналогично его работе в однопрограммном режиме. После вьтолнени первой программы (первой последовательности импульсов) сигнал логического нул с выхода элемента ИЛИ 17 через элемент НЕ 18 разрешает по очередному тактовому импульсу с выхода генератора 11 выборку очередной импульсной последовательности. Работа распределител проходит аналогично до тех пор, пока с управл ющего вькода блока 3 пам ти не поступит метка окончани программы. По ЭТОЙ метке происходит обнуление триггера 10, счетчика 1 адреса , счетчика 21, регистров 4 и 5 и распределитель готов к продолжению работы в однопрограммном либо в мультипрограммном режиме.
Таким образом, предложенный распределитель обладает более широкими функциональными возможност ми, и, следовательно, более широкой областью применени чем известный за счет формировани разлиньк длин импульсных последовательностей, формировани импульсных последовательностей с перекрытием и простоты модификации программь:.
Claims (1)
- Формула изобретениРаспределитель импульсов, содержащий первый триггер, единичный вход которого соединен с первым управл ющим входом распределител , а пр мой выход - с входом генератора тактовых импульсов, первый выход которого соединен с первым входом первого элемента И, выход которого через элемент задержки соединен с первым входом второго элемента И и с первым управл ющим входом первого регистра, а нулевой вход первого триггера соединен с выходом первого элемента ИЛИ, первый вход которого подключен к второму управл ющему входу распределител , а второй выход генератора тактовых импульсов - к пе{эвому входу третьего элемента И, вькод которого соединен с первым входом четвертого элемента И, отличающийс тем, что, с целью расширени функциональных возможностей, дополнительно введены счетчик адреса, дешифратор адреса , блок пам ти, второй регистр, блоккоммутации моментов начала импульсов две группы элементов И, группа счетчиков , группа элементов ИЛИ, второй триггер, второй элемент ИЛИ, элемент НЕ, счетчик импульсов и дешифратор , причем шина входных сигналов распределител соединена с первым входом счетчика адреса, выход которого подключен к первому входу дешифрато- ра адреса, выход которого подключен к входу блока пам ти, а второй вход счетчика адреса соединен с выходом второго элемента И, второй вход которого соединен с инверсным выходом второго триггера, единичный вход которого подключен к третьему управл ющему входу распределител , нулевой вход - к второму управл ющему входу распределител , а второй вход деши- фратора адреса подключен к выходу первого элемента И, информационные выходы блока пам ти соединены с информационными входами первого и второго регистров соответственно, а первый и второй управл ющие входы второго регистра подключены к первому и второму управл ющим входам первого регистра соответственно, причем управл ющий выход блока пам ти соединен с вторыми управл ющими входами регистров , выходы первого регистра подключены к первым входам первой группы элементов И, вторые выходы которых соединены с выходами блока коммутации моментов начала импульсов, информационные входы которого соединены с выходами второго регистра, а выходы первой.группы элементов И подключены к первым входам группы счетчиков, выходы которых подключены к входам группы элементов ИЛИ, вторые входы группы счетчиков подключены к выходам второй группы элементов И, первые входы которых соединены с выходом , четвертого элемента И, а вторые входы - с выходами группы элементов ИЛИ, соединенными также с выходными шинами распределител и с входами второго элемента ИЛИ, выход которого подключен к второму четвертого элемента И, а также через элемент НЕ подключены к второму входу первого элемента И, первый вход четвертого элемента И соединен с входом счетчика импульсов, выходы которого подключены к входу дешифратора, выходы которого подключены к управл ющим входам блока коммутации моментов начала импульсов, а выход последнего разр да второго регистра подключен к второму входу третьего элемента И.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864142633A SU1405105A1 (ru) | 1986-11-04 | 1986-11-04 | Распределитель импульсов |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864142633A SU1405105A1 (ru) | 1986-11-04 | 1986-11-04 | Распределитель импульсов |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1405105A1 true SU1405105A1 (ru) | 1988-06-23 |
Family
ID=21265798
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864142633A SU1405105A1 (ru) | 1986-11-04 | 1986-11-04 | Распределитель импульсов |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1405105A1 (ru) |
-
1986
- 1986-11-04 SU SU864142633A patent/SU1405105A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР № 774534, кл. G 06 F 1/04, 1980. Букреев И.Н., Мансуров Б.М., Гор чев В.И. Микроэлектронные схемы цифровых .устройств. Изд. 2-е, М.: Советское радио, 1975, с. 300, рис. 6.30. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1405105A1 (ru) | Распределитель импульсов | |
SU1309275A1 (ru) | Генератор последовательности импульсов | |
SU1418656A1 (ru) | Коммутатор дл управлени шаговым двигателем | |
SU1649532A1 (ru) | Устройство дл поиска чисел | |
SU1145335A1 (ru) | Распределитель импульсов | |
SU1469505A1 (ru) | Устройство дл отладки программ | |
SU1226619A1 (ru) | Формирователь последовательности импульсов | |
SU1144107A1 (ru) | Многоканальный микропрограммный умножитель частоты | |
SU1587501A1 (ru) | Генератор нестационарного случайного импульсного процесса | |
SU1164890A1 (ru) | Устройство преобразовани кодов | |
SU1280600A1 (ru) | Устройство дл ввода информации | |
SU1319079A1 (ru) | Устройство дл контрол полупроводниковой пам ти | |
SU1513440A1 (ru) | Настраиваемое логическое устройство | |
SU1368880A1 (ru) | Устройство управлени | |
SU542192A2 (ru) | Автоматический программатор временных интервалов | |
SU1381419A1 (ru) | Цифровой измеритель длительности временных интервалов | |
SU1238194A1 (ru) | Умножитель частоты | |
SU1486991A1 (ru) | Устройство для программного • управления | |
SU1176346A1 (ru) | Устройство дл определени пересечени множеств | |
SU1425825A1 (ru) | Делитель частоты с переменным коэффициентом делени | |
SU1109803A1 (ru) | Блок формировани тактирующих сигналов дл доменного запоминающего устройства | |
SU1420648A1 (ru) | Формирователь импульсных последовательностей | |
SU1297032A1 (ru) | Распределитель импульсов | |
SU1049867A1 (ru) | Устройство дл формировани последовательностей управл ющих сигналов | |
SU1103230A1 (ru) | Микропрограммное устройство управлени |