RU1795482C - Устройство дл регистрации информации - Google Patents

Устройство дл регистрации информации

Info

Publication number
RU1795482C
RU1795482C SU904842908A SU4842908A RU1795482C RU 1795482 C RU1795482 C RU 1795482C SU 904842908 A SU904842908 A SU 904842908A SU 4842908 A SU4842908 A SU 4842908A RU 1795482 C RU1795482 C RU 1795482C
Authority
RU
Russia
Prior art keywords
information
output
inputs
outputs
group
Prior art date
Application number
SU904842908A
Other languages
English (en)
Inventor
Леонид Вольфович Друзь
Юрий Петрович Рукоданов
Original Assignee
Научно-производственное объединение "Кибернетика"
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Научно-производственное объединение "Кибернетика" filed Critical Научно-производственное объединение "Кибернетика"
Priority to SU904842908A priority Critical patent/RU1795482C/ru
Application granted granted Critical
Publication of RU1795482C publication Critical patent/RU1795482C/ru

Links

Landscapes

  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Abstract

Изобретение относитс  к вычислительной технике. Его использование в многоканальных системах обработки информации позвол ет повысить быстродействие устройства . Благодар  введению дополнительных блоков в устройстве обеспечиваетс  возможность автоматической регистрации информации в любых комбинаци х от М источников п блоками входа (регистрации ), причем очередность регистрации определ етс  готовностью источников и последовательным освобождением зан тых блоков вывода. 4 ил.

Description

Изобретение относитс  к вычислитель- ной технике, может быть использовано в многоканальных системах обработки информации .
Цель изобретени  - повышение быстродействи  устройства за счет обслуживани  М источников информации п блоками регистрации в любых сочетани х.
На фиг. 1 приведена функциональна  схема предлагаемого устройства; на фиг. 2 - схема коммутатора; на фиг. 3 - схема источника информации - блока ввода; на фиг. 4 - временна  диаграмма работы устройства .
Устройство содержит демультиплексор 1, группу регистров 2, группу демультиплек- соров 3, блоки 4 ввода информации, группу триггеров 5, счетчик 6, мультиплексор 7, демультиплексор 8, элемент И-НЕ 9, коммутатор 10, группу мультиплексоров 11, группу регистров 12, блоки 13 вывода информации, группу триггеров 14, демультиплексор 15,
счетчик 16, демультиплексор 17, мультиплексор 18, элемент ИЛИ 19, синхровход 20 устройства. Коммутатор 10 выполнен на счетчике 10. Блоки 4 ввода могут быть выполнены , например, на блоке памйти 21 с адресным счетчиком 22, формирователем 23, элементом задержки 24, ИЛИ 25. Блоки 13 вывода могут быть выполнены, например , на ленточных перфораторах ПЛ-150И. Устройство работает следующим образом . Блоки 4 ввода, готовые к выводу информации на регистрацию, устанавливают в единичное состо ние соответствующие триггеры 5, например блок 4-i включает триггер 5-i. Блоки 13 вывода, не зан тые выводом информации и исправные, устанавливают в нулевое состо ние соответствующие триггеры 14, например, блок 13-J устанавливает в нулевое положение триггер 14-j. При подаче тактовых импульсов по шине 20 счетчики 6, 16 включаютс  в режим непрерывного счета. При этом, счетчик б
СЛ N 00
ю
через мультиплексор 7 опрашивает пр мые выходы триггеров 5, счетчик 16 - через мультиплексор 18 инверсные выходы триггеров 14, при опросе включенного триггера 5-I на . выходе мультиплексора 7 формируетс  сигнал , запрещающий дальнейший счет импульсов в счетчике 6, а при опросе отключенного триггера 14-J на выходе мультиплексора 18 формируетс  сигнал, блокирующий счет импульсов в счетчике 16. На выходах счетчиков 6, 16 устанавливаютс  адреса блока 4-I и 13-J соответственно. Адрес блока 4-I со счетчика 6 подаетс  на информационные входы регистров 2 и управл ет демультиплексорами 8, 15. При этом, демультиплексор 8 подключает выход элемента ИЛИ 19 к нулевому входу триггера 54 демультиплексор 15 подключает первый выход коммутатора 10 к тактовому входу регистра 124. Адрес блока 13-j со счетчика 16 подаетс  на D-входы регистров 12 и адресные входы демультиплексора 17, который Подключает второй выход коммутатора 10 к входу запуска блока 13-j, и демультиплексора 1, который подключает первый выход коммутатора 10 к тактовому входу регистра 2-J. При наличии сигналов на выходах мультиплексоров 18, 7 открываетс  элемент И-НЕ 9 и включаетс  коммутатор 10. Коммутатор 10 формирует два сигнала. Первый сигнал через демультиплексор 1 записывает адрес счетчика 6 в регистр 2-j и через демультиплексор 15 - адрес счетчика 16 в регистр 124 Регистр 2-j управл ет демуль- типлексором З-j и подключает информационные выходы блока 4-i к соответствующим входам блока 13-j. Регистр 12-i управл ет мультиплексором 11-1 и подключает выход запроса информации блока 13-j к соответствующему входу блока 4-i, Второй сигнал коммутатора 10 через демультиплексор 17 включает блок 13-j в режим регистрации. Блок 13-j после включени  и выхода в режим регистрации включает триггер 14-j, через элемент ИЛИ 19 и демультиплексор 8 сбрасывает в нуль триггер 54 периодически выдает сигналы запросов информации через
мультиплексор 1 И на блок 4-i, информаци  которого через демультиплексор З-j регистрируетс  блоком 13-j. После включени  триггера 14-j снимаетс  сигнал с выхода
мультиплексора 18. а после сброса триггера 5-I - сигнал с выхода мультиплексора 7. При этом закрываетс  элемент И-НЕ 9 и коммутатор 10 устанавливаетс  в нулевое положение . После сброса выходных сигналов
мультиплексоров 7, 18 разблокируютс  счетчики 6, 16, которые снова включаютс  в режим опроса триггеров 5, 14, При наличии других блоков ввода, готовых к выдаче информации , т.е. других включенных триггеров 5, и свободных от регистрации других блоков 13, т.е. других отключенных триггеров 14, устройство работает аналогично и устанавливает соответствующие св зи между данным блоком ввода и блоком вывода
информации. В случае зан тости всех блоков 13 вывода или их неисправности все триггеры 14 наход тс  в единичном состо нии; сигналы на их инверсных выходах отсутствуют и счетчик 16 находитс  в режиме
непрерывного опроса этих триггеров. Блоки 4, готовые к выдаче информации, наход тс  в режиме ожидани , счетчик 6 фиксирует адрес очередного блока, а сигнал на выходе мультиплексора 7 подготавливает к открыванию элемент И-НЕ 9. По окончании вывода информации, например, при поступлении кода конец массива от блока 4-i, блок 13-j выдает сигнал, устанавливающий в нуль триггер 14-j, Счетчик 16фиксирует освободившийс  блок 13 и соедин ет его с очередным блоком 4 аналогично описанному выше.
В предложенном устройстве обеспечи- ваетс  автоматическа  регистраци  информации в любых комбинаци х от М источников n-ми блоками вывода (регистрации ), причем очередность регистрации определ етс  готовностью источников и последовательным освобождением зан тых блоков вывода, что сокращает врем  вывода информации в многоканальных системах.
Форму л а изобретени  Устройство дл  регистрации информации , содержащее блоки ввода и вывода ин- формации, первый и второй счетчики, коммутатор, элементы И-НЕ и ИЛИ, отличающеес  тем, что, с целью повышени  быстродействи , оно содержит две группы регистров, два мультиплексора, четыре демультиплексора , группу мультиплексоров, группу демультиплексоров, две группы триггеров, выход элемента И-НЕ соединен с управл ющим входом коммутатора, первый вход соединен с выходом первого мультиплексора и с управл ющим входом первого счетчика, а второй вход- с выходом второго мультиплексора и с управл ющим входом
второго счетчика, синхронизирующий вход коммутатора и счетные входы первого и второго счетчиков объединены и  вл ютс  синхронизирующим входом устройства, выходы первого счетчика соединены с соот- ветствующими адресными входами первого мультиплексора и первого и второго демультиплексоров и с информационными входами регистров первой группы, первый и второй выходы коммутатора сое- динены соответственно с информационными входами третьего демультиплексора и второго и четвертого демультиплексоров, выходы второго счетчика соединены соответственно с адресными входами второго мультиплексора, третьего и четвертого демультиплексоров и с информационными входами регистров второй группы, синхронизирующие входы которых соединены с соответствующими выходами второго де- мультиплексора, а выходы каждого регистра второй группы соединены соответственно с адресными входами соответствующих мультиплексоров группы, выходы Запрос блока вывода информации соединены соответственно с информационными входами каждого мультиплексора группы, информационные входы блока вывода соединены соответственно с выходами соответствующих демультиплексоров труп- пы, управл ющие входы Пуск соединены соответственно с выходами третьего демультиплексора , выходы первой группы блока вывода соединены соответственно с входами элемента ИЛИ и с S-входами триггеров первой группы, а выходы второй группы соединены соответственно с R-входами триггеров первой группы, выходы которых соединены соответственно с информацией ными входами второго мультиплексора, выход элемента ИЛИ соединен q информационным входом первого демультиплексора , выходы четвертого демультиплексора соединены синхронизирующими входами соответствующих регистров первой группы, выходы каждого из которых соединены соответственно с адресными входами соответствующих демультиплексоров группы, выходы триггеров второй группы соединены с соответствующими информационными входами первого мультиплексора , R-входы триггеров первой груп- пы соединены с соответствующими выходами-первого демультиплексора, a S- вхо ды -с соответствующими выходами блока ввода, входы Запрос блока ввода информации соединены с выходами соответствующих мультиплексоров группы, входы Режим и информационные входы блока ввода  вл ютс  соответствующими входами устройства, а информационные выходы блока ввода соединены с соответствующими информационными входами демультиплексоров группы.
Ahp.j/r
гЧ
ЖН
Ре#ун
(Зп I UmS)
ЗапрмЛ Зп
23
BMX},JS
VMX17
. vm.
-j
22
21
romog Тг5
SU904842908A 1990-06-25 1990-06-25 Устройство дл регистрации информации RU1795482C (ru)

Priority Applications (1)

Application Number Priority Date Filing Date Title
SU904842908A RU1795482C (ru) 1990-06-25 1990-06-25 Устройство дл регистрации информации

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
SU904842908A RU1795482C (ru) 1990-06-25 1990-06-25 Устройство дл регистрации информации

Publications (1)

Publication Number Publication Date
RU1795482C true RU1795482C (ru) 1993-02-15

Family

ID=21522941

Family Applications (1)

Application Number Title Priority Date Filing Date
SU904842908A RU1795482C (ru) 1990-06-25 1990-06-25 Устройство дл регистрации информации

Country Status (1)

Country Link
RU (1) RU1795482C (ru)

Non-Patent Citations (1)

* Cited by examiner, † Cited by third party
Title
Авторское свидетельство СССР N 1200307,кл. G 06 К 15/00, 1985. Авторское свидетельство СССР N51355984, кл. G 06 К 1/00, 1987. *

Similar Documents

Publication Publication Date Title
RU1795482C (ru) Устройство дл регистрации информации
SU1709315A1 (ru) Устройство дл управлени обслуживанием запросов
SU1427368A1 (ru) Многоканальное устройство дл распределени заданий процессорам
SU1474647A1 (ru) Устройство дл обработки запросов
SU1347081A1 (ru) Устройство дл распределени заданий процессорам
SU1474646A1 (ru) Устройство дл распределени заданий процессорам
SU1569831A1 (ru) Устройство дл распределени заданий процессорам
SU922744A1 (ru) Устройство дл обслуживани запросов в пор дке поступлени
SU1416986A1 (ru) Устройство дл подключени абонентов к общей магистрали
RU1783537C (ru) Устройство дл подключени источников информации к общей магистрали
SU1278870A1 (ru) Многоканальное устройство дл подключени абонентов к группе общих магистралей
SU840906A1 (ru) Многоканальное устройство приоритета
SU1061143A1 (ru) Многоканальное устройство дл управлени очередностью запросов
SU1144109A1 (ru) Устройство дл опроса информационных каналов
RU1797125C (ru) Многоканальное устройство дл подключени абонентов к общей магистрали
SU1656533A1 (ru) Устройство дл распределени запросов
SU1091150A1 (ru) Устройство дл ввода информации
SU1550518A1 (ru) Устройство дл обслуживани запросов
SU1277111A1 (ru) Устройство дл распределени заданий процессорам
RU1803918C (ru) Многоканальное устройство дл подключени абонентов к общей магистрали
SU1608665A1 (ru) Арбитр системной шины
SU1603393A2 (ru) Устройство дл управлени обменом процессора с пам тью
RU1798782C (ru) Устройство дл распределени за вок по процессорам
SU1119014A1 (ru) Многоканальное устройство приоритета
SU1758647A1 (ru) Устройство дл сопр жени двух процессоров через общую пам ть