KR970077332A - 반도체소자의 절연막 평탄화 방법 - Google Patents
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Abstract
본 발명은 반도체소자의 금속 배선간의 절연막이 평탄화 방법에 관한 것으로, 하부의 금속 배선을 형성하고, 그 상부에 실리콘 리치산화막을 얇은 두께로 증착하고, CF4또는 C2F6플라즈마 처리를 한 다음, 상기 금속 배선이 없는 지역의 실리콘 산화막 상부에서 금속 배선 상부에 있는 실리콘 리치 산화막 상부보다 빠르게 증착되는 O3-TEOS-O3TEOS USG막을 두껍게 증착하고 케미칼 메카니칼 폴리싱으로 평탄화 공정을 진행하는 기술이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도는 본 발명에 의해 금속 배선 상부에 절연막을 형성하고, 절연막의 일정 두께를 케미칼 메카니칼 폴리싱 공정으로 평탄화 작업을 실시한 단면도.
Claims (11)
- 하부 절연막 상부에 일정 간격 이격된 금속 배선을 형성하는 단계와, 전체적으로 실리콘리치 산화막을 얇은 두께로 증착하고, CF4또는 C2F6플라즈마 처리를 하는 단계와, 상기 금속 배선이 없는 지역의 실리콘 리치 산화막 상부에서 금속 배선 상부에 있는 실리콘 리치 산화막 상부보다 빠르게 증착되며, 넓은 금속 배선의 가장자리 부위가 더 빠르게 증착되는 O3-TEOS USG막을 두껍게 증착하는 단계와, 상기 O3TEOS USG막의 일정 두께를 CMP공정으로 제거하여 상부 표면이 평탄한 O3TEOS USG막을 형성하는 단계를 포함하는 반도체소자의 절연막 평탄화 방법.
- 제1항에 있어서, 상기 실리콘 리치 산화막은 700-1500Å의 두께로 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제1항에 있어서, 상기 플라즈마 처리 조건은 주파수가 13.56MHz, 전력 : 1-3KW, 온도는 300-500℃, 압력은 1-3Torr, 시간은 1-5분인 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제1항에 있어서, 상기 O3TEOS USG막은 6000-15000Å의 두께로 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제1항에 있어서, 상기 CMP 공정의 조건은 연마헤드 압력 5-10psi, 연마 테이블 회전수 20-80rpm, 헤드 회전수는 20-80rpm, 슬러리 투입량 150-250ml/min, 공정 시간 20-60초인 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 하부 절연막 상부에 일정 간격 이격된 금속 배선을 형성하는 단계와, 전체적으로 실리콘 리치 산화막을 얇은 두께로 증착하고, CF4또는 C2F6플라즈마 처리를 하는 단계와, 상기 금속 배선이 없는 지역의 실리콘 리치 산화막 상부에서 금속 배선 상부에 있는 실리콘 리치 산화막 상부보다 빠르게 증착되며 넓은 금속 배선의 가장자리 부위가 더 빠르게 증착되는 O3-TEOS USG막을 두껍게 증착하는 단계와, O3TEOS USG막의 일정 두께를 CMP공정으로 제거하여 상부 표면이 평탄한 O3TEOS USG막을 형성하는 단계와, 상기 O3TEOS USG막 상부에 PE-CVD 산화막을 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제1항에 있어서, 상기 PE-CVD 산화막은 1000-3000Å의 두께로 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제6항에 있어서, 상기 실리콘 리치 산화막은 700-1500Å의 두께로 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제6항에 있어서, 상기 플라즈마 처리 조건을 주파수가 13.56MHz, 전력 : 1-3KW, 온도는 300-500℃, 압력은 1-3Torr, 시간은 1-5분인 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제6항에 있어서, 상기 O3TEOS USG막은 6000-15000Å의 두께로 증착하는 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.
- 제6항에 있어서, 상기 CMP 공정의 조건은 연마헤드 압력 5-10psi, 연마 테이블 회전수 20-80rpm, 헤드 회전수는 20-80rpm, 슬러리 투입양 150-250ml/min, 공정 시간 20-60초인 것을 특징으로 하는 반도체소자의 절연막 평탄화 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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KR1019960019017A KR100197662B1 (ko) | 1996-05-31 | 1996-05-31 | 반도체 소자의 절연막 평탄화방법 |
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KR1019960019017A KR100197662B1 (ko) | 1996-05-31 | 1996-05-31 | 반도체 소자의 절연막 평탄화방법 |
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KR (1) | KR100197662B1 (ko) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR100224706B1 (ko) * | 1996-07-25 | 1999-10-15 | 윤종용 | 반도체 소자의 층간 절연층 형성방법 |
-
1996
- 1996-05-31 KR KR1019960019017A patent/KR100197662B1/ko not_active IP Right Cessation
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KR100224706B1 (ko) * | 1996-07-25 | 1999-10-15 | 윤종용 | 반도체 소자의 층간 절연층 형성방법 |
Also Published As
Publication number | Publication date |
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KR100197662B1 (ko) | 1999-06-15 |
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