KR970067874A - 반도체장치의 캐패시터 형성방법 - Google Patents
반도체장치의 캐패시터 형성방법 Download PDFInfo
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Abstract
반도체장치의 커패시터 형성방법이 개시되어 있다. 본 발명은 반도체기판 상에 하부전극을 형성하는 단계와 상기 하부전극의 표면에 유전막을 형성하는 단계와 상기 유전막 표면에 질소가 함유된 내산화성 금속막을 형성하는 단계와 상기 내산화성 금속막 전면에 플레이트 전극을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법을 제공한다. 본 발명에 의하면 유전막과 플레이트 전극 사이에 내산화성이면서 후속 열처리 온도에 따른 저항변화율이 작은 질소를 포함하는 내산화성 금속막을 형성함으로써 안정된 특성을 갖는 커패시터를 구현할 수 있다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 커패시터 형성방법을 설명하기 위한 단면도이다.
Claims (7)
- 반도체기판 상에 하부전극을 형성하는 단계; 상기 하부전극의 표면에 유전막을 형성하는 단계; 상기 유전막 표면에 질소가 함유된 내산화성 금속막을 형성하는 단계; 상기 내산화성 금속막 전면에 플레이트 전극을 형성하는 단계를 포함하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제1항에 있어서 상기 하부전극 및 상기 플레이트 전극은 모두 도우핑된 폴리실리콘막으로 형성하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제1항에 있어서 상기 유전막은 탄탈륨 산화막 BST막 및 PZT막으로 이루어진 일군중 선택된 어느 하나로 형성하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제1항에 있어서 상기 내산화성 금속막은 PVD(physical vapor deposition)공정 또는 CVD(chemical vapor deposition)공정으로 형성하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제1항에 있어서 상기 내산화성 금속막은 타이타늄 실리사이드 질화막, 탄탈륨 실리사이드 질화막, 텅스텐 실리사이드 질화막, 및 몰리브데늄 실리사이드 질화막으로 이루어진 일군중 선택된 어느 하나로 형성하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제5항에 있어서 상기 타이타늄 실리사이드 질화막은 아르곤 가스 및 질소 가스 분위기에서 타이타늄 실리사이드(TiSi)타게트를 사용하는 PVD공정(스퍼터링 공정)으로 형성하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
- 제6항에 있어서 상기 질소 가스는 상기 아르콘 가스 및 상기 질소가스의 부피에 비하여 3% 내지 10%의 비율로 주입하는 것을 특징으로 하는 반도체장치의 커패시터 형성방법
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Application Number | Priority Date | Filing Date | Title |
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KR1019960007740A KR100213197B1 (ko) | 1996-03-21 | 1996-03-21 | 반도체장치의 커패시터 형성방법 |
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KR1019960007740A KR100213197B1 (ko) | 1996-03-21 | 1996-03-21 | 반도체장치의 커패시터 형성방법 |
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KR100213197B1 KR100213197B1 (ko) | 1999-08-02 |
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KR1019960007740A KR100213197B1 (ko) | 1996-03-21 | 1996-03-21 | 반도체장치의 커패시터 형성방법 |
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KR (1) | KR100213197B1 (ko) |
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Publication number | Priority date | Publication date | Assignee | Title |
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KR101024717B1 (ko) * | 2008-09-12 | 2011-03-24 | 주식회사 하이닉스반도체 | 반도체소자의 캐패시터 및 그 형성방법 |
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- 1996-03-21 KR KR1019960007740A patent/KR100213197B1/ko not_active IP Right Cessation
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Publication number | Publication date |
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KR100213197B1 (ko) | 1999-08-02 |
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