KR970055562A - 디지탈 서비스 유니트(dsu) 클럭 발생회로 - Google Patents
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- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/16—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop
- H03L7/18—Indirect frequency synthesis, i.e. generating a desired one of a number of predetermined frequencies using a frequency- or phase-locked loop using a frequency divider or counter in the loop
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K23/00—Pulse counters comprising counting chains; Frequency dividers comprising counting chains
- H03K23/40—Gating or clocking signals applied to all stages, i.e. synchronous counters
Landscapes
- Synchronisation In Digital Transmission Systems (AREA)
- Manipulation Of Pulses (AREA)
Abstract
본 발명은 64K×N 데이타를 서비스할 수 있는 장치에서 생성된 클럭을 이용하여 56K군의 서비스에 적합하도록 한 디지탈 서비스 유니트의 클럭 발생회로에 관한 것이다.
종래 기술은 56K군의 PLL과 64K군의 PLL을 별도로 분리 구성함으로써 회로가 복잡하여 설계가 용이하지 못함은 물론 제품 코스트가 상승되는 문제점이 있었다.
이를 개선코자하여 본 발명은 56K×N PLL 회로를 별도로 구성하지 않고도 기준의 PLL을 이용하여 56K×N 클럭을 생성할 수 있도록 한 것이다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명에 의한 클럭 발생회로의 블럭 구성도.
Claims (2)
- 소정클럭(32.768MHZ)을 입력받아 128/21로 분주하여 소정클럭(5.376MHZ)을 생성하는 제1분주회로(10)와 상기 제1분주회로(10)로부터 소정클럭(5.376MHZ)을 입력받아 56K×N클럭을 생성하는 다수의 제2내지 제19분주회로(11~19)로 구성된 것을 특징으로 하는 디지탈 서비스 유니트(DSU)클럭 발생회로,
- 제1항에 있어서 상기 제1분주회로(10)는 소정클럭(32.768MHZ)을 인버터(IN1)를 거쳐서 27승 분주하여 소정클럭(256K)을 생성하는 제20분주회로(101)와 상기 제20분주회로(101)에서 출력되는 소정클럭(256K)을 입력받아 제1 디 플립플롭(102), 익스클루시브 오어게이트(EX1, EX2) 및 인버터(IN2)로 구성되어 2분주 카운터로 동작하고 제2, 제3 디 플립플롭(103,104), 앤드게이트(A1) 및 인버터(IN3)로 구성되어 3분주 카운터로 동작하여 소정클럭(5.376MHZ)을 출력하도록 구성된 것을 특징으로 하는 디지탈 서비스 유니트(DSU)클럭 발생회로,※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950053365A KR100258987B1 (ko) | 1995-12-21 | 1995-12-21 | 디지탈 서비스 유닛의 클럭신호 발생회로 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019950053365A KR100258987B1 (ko) | 1995-12-21 | 1995-12-21 | 디지탈 서비스 유닛의 클럭신호 발생회로 |
Publications (2)
Publication Number | Publication Date |
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KR970055562A true KR970055562A (ko) | 1997-07-31 |
KR100258987B1 KR100258987B1 (ko) | 2000-06-15 |
Family
ID=19442311
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019950053365A KR100258987B1 (ko) | 1995-12-21 | 1995-12-21 | 디지탈 서비스 유닛의 클럭신호 발생회로 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR100258987B1 (ko) |
-
1995
- 1995-12-21 KR KR1019950053365A patent/KR100258987B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR100258987B1 (ko) | 2000-06-15 |
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