KR970024574A - 위상 검출방법 및 회로 - Google Patents

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    • H03—ELECTRONIC CIRCUITRY
    • H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
    • H03D13/00—Circuits for comparing the phase or frequency of two mutually-independent oscillations
    • H03D13/001—Circuits for comparing the phase or frequency of two mutually-independent oscillations in which a pulse counter is used followed by a conversion into an analog signal

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Abstract

본 발명은 정현파(Sinusoidal wave) 전압의 위상 검출방법 및 회로에 관한 것으로서, 입력 정현파 신호를 영준위(Zero level)와 비교함으로써 소정 크기의 구형파 신호로 변환하는 제1 비교 수단; 상기 구형파 신호의 필스폭(Pulse width)을 계수하여 디지탈 데이터로서 출력하는 계수 수단; 및 상기 데이터를 소정의 기준 데이터와 비교하여, 상기 데이터가 기준 데이터보다 적으면 ‘0’을 출력하고, 크면 ‘1’을 출력하는 제2 비교수단;을 포함한 것을 그 특징으로 하여, 완전한 디지탈 신호처리(DigitaI signal process)가 가능함에 따라, 소자의 집적화를 증진시키고, 적용 시스템의 마이크로프로세서(Microprocessor)에 의한 제어 응용 범위 및 적용 주파수의 범위를 넓힐 수 있다.

Description

위상 검출방법 및 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 일 실시예에 따라서 단상 전압에 대한 위상 검출방법을 설명하기 위한 타이밍도(Timing diagram)이다.

Claims (21)

  1. 입력 정현파 신호를 영준위(Zero level)와 비교함으로써 소정 크기의 구형파 신호로 변환하는 제1 비교 단계; 상기 구헝파 신호의 펄스폭(Pulse width)을 계수하여 디지탈 데이터로서 출력하는 계수 단계; 및 상기 데이터를 소정의 기준 제이터와 비교하여, 상기 데이터가 기준 데이터보다 적으면 ‘0’을 출력하고, 크면 ‘1’을 출력하는 제2 비교 단계를 포함한 것을 그 특징으로 하는 위상(位相) 검출방법.
  2. 제1항에 있어서, 상기 입력 정현파 신호는, 적용되는 전원 전압이 소정의 크기로 강압된 정현파 신호인 것을 그 특징으로 하는 위상(位相) 검출방법.
  3. 제1항에 있어서, 상기 구형파 신호는, 상기 입력 정현파 신호가 단상 전원의 신호인 경우, 서로 180°의 위상차를 갖는 두 신호인 것을 그 특징으로 하는 위상(位相) 검출방법.
  4. 제1항에 있어서, 상기 구형파 신호는, 상기 입력 정현파 신호가 3상 전원의 신호인 경우, 서로 120°의 위상차를 갖는 세 신호인 것을 그 특징으로 하는 위상(位相) 검출방법.
  5. 제1항에 있어서, 상기 제2 비교 단계에 의하여 발생되는 신호는, 상기 입력 정현파 신호에 대한 위상 신호(Phase signal)인 것을 그 특징으로 하는 위상(位相) 검출방법.
  6. 제1항에 있어서, 상기 제2 비교 단계에 의하여 발생되는 신호는, 상기 입력 정현파 신호가 단상 전원의 신호인 경우, 서로 180°의 위상차를 갖는 두 신호인 것을 특징으로 하는 위상(位相) 검출방법.
  7. 제1항에 있어서, 상기 제2 비교 단계에 의하여 발생되는 신호는, 상기 입력 정현파 신호가 3상 전원의 신호인 경우, 서로 120°의 위상차를 갖는 세 신호인 것을 특징으로 하는 위상(位相) 검출방법.
  8. 제1항에 있어서, 상기 제2 비교 단계에 의하여 발생되는 신호의 펄스폭(Pulse width)은, 상기 기준 데이터로써 조정되는 것을 그 특징으로 하는 위상(位相) 검출방법.
  9. 입력 정현파 신호를 영준의(Zero level)의 비교함으로써 소정 크기의 구형파 신호로 변환하는 제1 비교 수단; 상기 구형파 신호의 펄스폭(Pulse width)을 계수하여 디지탈 데이터로서 출력하는 계수 수단; 및 상기 데이터를 소정의 기준 제이터와 비교하여, 상기 데이터가 기준 데이터보다 적으면 ‘0’을 출력하고, 크면 ‘1’을 출력하는 제2 비교 수단;을 포함한 것을 그 특징으로 하는 위상(位相) 검출회로.
  10. 제9항에 있어서, 상기 입력 정현파 신호는, 적용되는 전원 전압이 소정의 크기로 강압된 정현파 신호인 것을 그 특징으로 하는 위상(位相) 검출회로.
  11. 제9항에 있어서, 상기 구헝파 신호는, 상기 입력 정현파 신호가 단상 전원의 신호인 경우, 서로 180°의 위상차를 갖는 두 신호인 것을 그 특징으로 하는 위상(位相) 검출회로.
  12. 제8항에 있어서, 상기 구형파 신호는, 상기 입력 정현파 신호가 3상 전원의 신호인 경우, 서로 120°의 위상차를 갖는 세 신호인 것을 그 특징으로 하는 위상(位相) 검출회로.
  13. 제9항에 있어서, 상기 제2 비교 수단의 출력 신호는, 상기 입력 정현파 신호에 대한 위상 신호(Phase signal)인 것을 그 특징으로 하는 위상(位相) 검출회로.
  14. 제9항에 있어서, 상기 제2 비교 수단의 출력 신호는, 상기 입력 정현파 신호가 단상 전원의 신호인 경우, 서로 180°의 위상차를 갖는 두 신호인 것을 특징으로 하는 위상(位相) 검출회로.
  15. 제9항에 있어서, 상기 제2 비교 수단의 출력 신호는, 상기 입력 정현파 신호가 3상 전원의 신호인 경우, 서로 120°의 위상차를 갖는 세 신호인 것을 특징으로 하는 위상(位相) 검출회로.
  16. 제9항에 있어서, 상기 제2 비교 수단의 출력 신호의 필스폭(Pulse width)은, 상기 기준 데이터로써 조정되는 것을 그 특징으로 하는 위상(位相) 검출회로.
  17. 제11항 또는 제14항에 있어서, 상기 계수 수단 및 제2 비교 수단은, 각각 두 개씩인 것을 그 특징으로 하는 위상(位相) 검출회로.
  18. 제12항 또는 제15항에 있어서, 상기 계수 수단 및 제2 비교 수단은, 각각 세 개씩인 것을 그 특징으로 하는 위상(位相) 검출회로.
  19. 제9항에 있어서, 상기 기준 데이터는, 소정의 래치(Latch) 수단을 거쳐서 상기 제2 비교 수단에 입력되는 것을 그 특징으로 하는 위상(位相) 검출회로.
  20. 제9항에 있어서, 상기 기준 데이터는, 적용 시스템의 마이크로프로세서(Microprocessor)로부터 발생되는 것을 그 특징으로 하는 위상(位相) 검출회로.
  21. 제19항 또는 제20항에 있어서, 상기 래치(Latchd) 수단에 인가되는 인에이블 신호(Enable signal)는, 상기 마이크로프로세서(Microprocessor)에 의하여 제어되는 것을 그 특징으로 하는 위상(位相) 검출회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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* Cited by examiner, † Cited by third party
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KR100408101B1 (ko) * 2000-07-13 2003-12-03 닛뽕덴끼 가부시끼가이샤 Ｄｌｌ 회로 및 ｄｌｌ 제어방법

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