KR970002668A - 시스템 버스용 소프터웨어 드라이버 - Google Patents
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- G06F15/16—Combinations of two or more digital computers each having at least an arithmetic unit, a program unit and a register, e.g. for a simultaneous processing of several programs
Abstract
마스터-슬레이브 구성, 다수의 레지스터에 의해 제어되는 공유 메모리, 마스터 중앙처리장치, 및 마스터 버스 제어장치를갖는 시스템 버스에서 공유 메모리로 데이터를 기록 및 독출하는 처리방법이 개시된다. 상기 처리방법은 요구 비트를 제1레지스터상에 기록함으로써 마스터 중앙처리장치에 의해서 상기 공유 메모리를 엑세스하는 과정; 액세스 비트가 설정되는지를 결정하고 상기 공유 메모리로 액세스가 허용되는지를 결정하는 제2레지스터상에서 상기 액세스 비트를 독출하는 과정; 상기 마스터 중앙처리장치에 의해 상기 공유 메모리에 데이터를 기록 및 독출하는 과정; 및 상기 액세스 비트가 클리어되는지를 그리고 상기 공유 메모리 액세스가 완료되는지를 결정하는 상기 제2레지스터상에서 상기 액세스 비트를 독출하는 과정으로 이루어진다. 상기 액세스 비트는 상기 마스터-슬레이브 버스 제어장치에 의해 설정된다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 시스템 버스 구성의 개략 도면, 제2도는 마스터 및 슬레이브 모듈의 기능적 구성요소에 대한 개략 도면, 제3도는 SPU 버스 드라이버 기록 절차의 흐름도.
Claims (12)
- 마스터-슬레이브 구성, 다수의 레지스터에 의해 제어되는 공유 메모리, 마스터 중앙처리장치, 및 마스터버스 제어장치를 갖는 시스템 버스에서 상기 공유 메모리에 데이터를 기록하는 처리방법에 있어서, 요구 비트를 제1 레지스터상에 기록함으로써 상기 마스터 중앙처리장치에 의해 상기 공유 메모리를 액세스하는 과정; 액세스 비트가 설정되는지를, 그리고 상기 공유 메모리 액세스가 허용되는지를 결정하는 제2 레지스터상에서 상기 액세스 비트를 독출하는 과정;상기 마스터 중앙처리장치에 의해 상기 공유 메모리에 데이터를 기록하는 과정; 및 상기 액세스 비트가 클리어되는지를,그리고 상기 공유 메모리 액세스가 완료되는지를 결정하는 상기 제2 레지스터상에서 상기 액세스 비트를 독출하는 과정으로 이루어짐을 특징으로 하는 데이터 기록 처리방법.
- 제1항에 있어서, 상기 액세스 비트가 마스터 버스 제어장치에 의해 설정됨을 특징으로 하는 데이터 기록처리방법.
- 제1항에 있어서, 상기 데이터 기록 처리방법에 있어서, 공유 메모리가 액세스 타이머를 작동시키는 과정;상기 공유 메모리 액세스가 허용되지 않을 때 상기 타이머가 종료되는 지를 결정하는 과정; 상기 공유 메모리 액세스가허용되지 않고 상기 타이머가 종료되지 않을 경우 상기 액세스 과정을 반복하는 과정; 및 상기 공유 메모리 액세스가 허용되지 않고 상기 타이머가 종료된 경우에 기록 에러 통계치를 갱신하는 과정으로 더 이루어짐을 특징으로 하는 데이터기록 처리방법.
- 마스터-슬레이브 구성, 다수의 레지스터에 의해 제어되는 공유 메모리, 마스터 중앙처리장치, 및 마스터버스 제어장치를 갖는 시스템 버스에서 상기 공유 메모리로부터 데이터를 독출하는 처리방법에 있어서, 요구 비트를 제1레지스터상에 기록함으로서 상기 마스터 중앙처리장치에 의해 상기 공유 메모리를 액세스하는 과정; 액세스 비트가 설정되는지 그리고 상기 공유 메모리 액세스가 허용되는지를 결정하는 제2 레지스터상에서 상기 액세스 비트를 독출하는 과정; 패러티 에러가 있는지를 확인하는 과정; 패러티가 정확한 경우에 상기 마스터 중앙처리장치에 의해 상기 공유 메모리로부터 데이터를 독출하는 과정; 및 상기 액세스 비트가 클리어되는지를 그리고 상기 공유 메모리 액세스가 완료되는지를결정하는 상기 제2 레지스터상에서 상기 액세스 비트를 독출하는 과정으로 이루어짐을 특징으로 하는 데이터 독출 처리방법.
- 제4항에 있어서, 상기 액세스 비트가 상기 마스터 버스 제어장치에 의해 설정됨을 특징으로 하는 데이터독출 처리방법.
- 제5항에 있어서, 상기 데이터 독출 처리방법에 있어서, 상기 공유 메모리 액세스 타이머를 작동시키는 과정; 상기 공유 메모리 액세스가 허용되지 않을 때 상기 타이머가 종료되는지를 결정하는 과정; 상기 공유 메모리 액세스가 허용되지 않고 상기 타이머가 종료되지 않을 경우에 상기 액세스 과정을 반복하는 과정; 상기 공유 메모리 액세스가 허용되지 않고 상기 타이머가 종료된 경우에 독출 에러 통계치를 갱신하는 과정; 및 패러티가 확인될 경우에 패러티 에러 통계치를 갱신하는 과정으로 더 이루어짐을 특징으로 하는 독출 처리방법.
- 마스터-슬레이브 구성, 다수의 레지스터에 의해 제어되는 공유 메모리, 슬레이브 중앙처리장치, 및 슬레이브 버스 제어장치를 갖는 시스템 버스에서 상기 공유 메모리에 데이터를 기록하는 처리방법에 있어서, 요구 비트를 제1레지스터상에 기록함으로서 상기 슬레이브 중앙처리장치에 의해서 상기 공유 메모리를 액세스하는 과정; 액세스 비트가설정되는지를 그리고 상기 공유 메모리 액세스가 허용되는지를 결정하는 제2 레지스터상에서 상기 액세스 비트를 독출하는 과정; 상기 슬레이브 중앙처리장치에 의해 상기 공유 메모리에 데이터를 기록하는 과정; 및 상기 슬레이브 중앙처리장치에 의해서 사용된 비트를 제3 레지스터상에 기록함으로서 상기 데이터를 상기 마스터로 전송하는 과정으로 이루어짐을특징으로 하는 데이터 기록 처리방법.
- 제7항에 있어서, 상기 액세스 비트가 상기 슬레이브 버스 제어장치에 의해 설정됨을 특징으로 하는 데이터기록 처리방법.
- 제8항에 있어서, 상기 데이터 기록 처리방법에 있어서, 공유 메모리 액세스 타이머를 작동시키는 과정; 상기 공유 메모리 액세스가 허용되지 않을 경우에 상기 타이머가 종료되는지를 결정하는 과정; 상기 공유 메모리 액세스가허용되지 않고 상기 타이머가 종료되지 않을 경우에 상기 액세스 과정을 반복하는 과정; 및 상기 공유 메모리 액세스가허용되지 않고 상기 타이머가 종료된 경우에 기록 에러 통계치를 갱신하는 과정으로 더 이루어짐을 특징으로 하는 데이터기록 처리방법.
- 마스터-슬레이브 구성, 다수의 레지스터에 의해 제어되는 공유 메모리, 마스터 중앙처리장치, 및 마스터버스 제어장치를 갖는 시스템 버스에서 상기 공유 메모리로부터 데이터를 독출하는 처리방법에 있어서, 요구비트를 제1레지스터상에 기록함으로서 상기 슬레이브 중앙처리장치에 의해 상기 공유 메모리를 액세스하는 과정; 액세스 비트가 설정되는지, 그리고 상기 공유 메모리 액세스가 허용되는지를 결정하는 제2 레지스터상에서 상기 액세스 비트를 독출하는과정; 패러티 에러가 있는지를 확인하는 과정; 패러티가 정확한 경우에 상기 슬레이브 중앙처리장치에 의해 상기 공유 메모리로부터 데이터를 독출하는 과정; 및 상기 슬레이브 제어장치에 의해서 사용된 비트를 제3 레지스터에 기록함으로서상기 공유 메모리 액세스를 해제하는 과정으로 이루어짐을 특징으로 하는 데이터 독출 처리방법.
- 제10항에 있어서, 상기 액세스 비트가 상기 마스터 버스 제어장치에 의해 설정됨을 특징으로 하는 데이터독출 처리방법.
- 제11항에 있어서, 상기 데이터 독출 처리방법에 있어서, 상기 공유 메모리 액세스 타이머를 작동시키는 과정; 상기 공유 메모리 액세스가 허용되지 않을 경우에 상기 타이머가 종료되는지를 결정하는 과정; 상기 공유 메모리액세스가 허용되지 않고 상기 타이머가 종료되지 않을 경우에 상기 액세스 과정을 반복하는 과정; 상기 공유 메모리 액세스가 허용되지 않고 상기 타이머가 종료된 경우에 독출 에러 통계치를 갱신하는 과정; 및 패러티가 확인된 경우에 패러티에러 통계치를 갱신하는 과정으로 더 이루어짐을 특징으로 하는 독출 처리방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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US6834363B2 (en) * | 2001-03-22 | 2004-12-21 | International Business Machines Corporation | Method for prioritizing bus errors |
US6871300B1 (en) * | 2001-05-04 | 2005-03-22 | Rlx Technologies, Inc. | Embedded server chassis hardware master system and method |
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US6934786B2 (en) * | 2001-05-04 | 2005-08-23 | Rlx Technologies, Inc. | Server chassis hardware master system and method |
US7613699B2 (en) | 2001-08-03 | 2009-11-03 | Itt Manufacturing Enterprises, Inc. | Apparatus and method for resolving security association database update coherency in high-speed systems having multiple security channels |
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US4368514A (en) * | 1980-04-25 | 1983-01-11 | Timeplex, Inc. | Multi-processor system |
IT1151351B (it) * | 1982-01-19 | 1986-12-17 | Italtel Spa | Disposizione circuitale atta a realizzare lo scambio di dati tra una coppia di elaboratori operanti secondo il principio master-slave |
JPS58217069A (ja) * | 1982-06-10 | 1983-12-16 | Fuji Xerox Co Ltd | マルチ・マイクロコンピユ−タの通信方式 |
JPH0731627B2 (ja) * | 1985-08-10 | 1995-04-10 | 株式会社リコー | メモリ−装置 |
GB8622941D0 (en) * | 1986-09-24 | 1986-10-29 | Gen Electric Co Plc | Computer system |
FR2632139A1 (fr) * | 1988-05-24 | 1989-12-01 | April Sa | Reseau de transmission d'informations numeriques entre plusieurs stations |
DE3850881T2 (de) * | 1988-10-28 | 1995-03-09 | Ibm | Verfahren und Vorrichtung zur Nachrichtenübertragung zwischen Quellen- und Zielanwender durch einen anteilig genutzten Speicher. |
JPH0782475B2 (ja) * | 1988-11-02 | 1995-09-06 | 富士通株式会社 | メモリインタロック制御回路 |
DE69129841T2 (de) * | 1990-09-28 | 1998-12-03 | Fujitsu Ltd | Nachrichtensteuerungssystem in einem datenkommunikationssystem |
US5265252A (en) * | 1991-03-26 | 1993-11-23 | International Business Machines Corporation | Device driver system having generic operating system interface |
EP0543560B1 (en) * | 1991-11-19 | 1999-12-22 | Sun Microsystems, Inc. | Arbitrating multiprocessor accesses to shared resources |
JPH05181813A (ja) * | 1991-12-26 | 1993-07-23 | Nec Corp | 排他制御ビット制御方式 |
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