KR960038548A - 클럭지연회로 - Google Patents

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KR960038548A
KR960038548A KR1019950007946A KR19950007946A KR960038548A KR 960038548 A KR960038548 A KR 960038548A KR 1019950007946 A KR1019950007946 A KR 1019950007946A KR 19950007946 A KR19950007946 A KR 19950007946A KR 960038548 A KR960038548 A KR 960038548A
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delay
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이강복
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문정환
엘지반도체 주식회사
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Abstract

본 발명은 클럭지연 회로에 관한 것으로 각각 다른 지연시간을 갖는 클럭지연 회로를 구현함에 있어서, 레지스터에 지연시간과 관계된 데이터를 프로그래밍 하므로서 클럭지연 회로를 손쉽게 구현할 수 있는 클럭지연 회로를 제공하기 위한 것이다. 이를 위한 본 발명의 클럭지연 회로를 복수개의 인버터가 직렬로 연결되어 입력신호를 지연시키는 지연부와, 상기 지연부의 인버터 출력된 클럭신호 충, 방전하는 복수개의 캐패시터와, 상기 각 캐피시터와 인버터출력측에 병렬로 접속되어 각각의 인버터에 의해 출력된 플럭신호를 충, 방전하는 복수개의 캐패시터와, 상기 각 캐패시터와 인버터 사이에 직렬로 연결되어 캐패시터의 충, 발전을 스위칭하는 복수개의 트랜스미션(Transmission Gate)와, 원하는 지연시간에 따라 상기 각 트렌스미션게이트(Transmission Gate)의 온-오프(ON-OFF)를 제어하는 레지스터를 포함하여 구성됨을 특징으로 한다.

Description

클럭지연회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2도는 본 발명의 클럭지연 회로를 나타낸 회로도.

Claims (1)

  1. 복수개의 인버터가 직렬로 연결되어 입력신호를 지연시키는 지연부와, 상기 각 지연부의인버터 출력측에 병렬로 접속되어 각각의 인버터에 의해 출력된 클럭신호를 충, 방전하는 복수개의 캐패시터와, 상기 각 캐피시터와 인버터 사이에 직렬로 연결되어 캐패시터의 충, 방전을 스위칭하는 복수개의 트랜스미션(Transmission Gate)와, 원하는 지연시간에 따라 상기 각 트랜스미션(Tranmission Gate)의 온-오프(ON-OFF)를 제어하는 레지스터를 포함하여 구성됨을 특징으로 하는 클럭지연회로.
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