KR960035340A - 동화상 디코딩 회로 - Google Patents

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KR960035340A
KR960035340A KR1019960005804A KR19960005804A KR960035340A KR 960035340 A KR960035340 A KR 960035340A KR 1019960005804 A KR1019960005804 A KR 1019960005804A KR 19960005804 A KR19960005804 A KR 19960005804A KR 960035340 A KR960035340 A KR 960035340A
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시니치 우라모토
아키히코 타카바타케
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기다오까 다까시
미쓰비시 뎅끼 가부시끼가이샤
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Abstract

처리의 개시를 나타내는 매크로 블럭(MB)동기화 신호(MBSYNC)가 매크로 블럭헤더와 메크로 블럭에 의해 형성되는 하나의 처리부의 처리에서 어서트될때, 매크로 블럭(MB)의 블럭 데이터는 MBSYNC의 어서-트와 동기해서 디코드되고, 다음의 매크로 블럭 헤더정보는 처리부에서 연속해서 해석된다. 다음의 MB동기화 신호의어서-트는 소정의 조건이 성립하기 까지 정지된다.
매크로 블럭의 블럭 데이터의 처리는 하나의 처리부의 시작에서 통상적으로 실행되므로서, 동작 프로세서의 유효효율이 향상된다.

Description

동화상 디코딩 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따르는 화상 디코딩 회로의 1처리구간의 동작을 표시하는 도면, 제2A도, 제2B도는 본 발명에 따르는 화상 디코딩 회로의 1처리구간(단위)의 구성 및 파이프라인화의 효과를 설명하는 위한 도면, 제3도는 본 발명에 따르는 화상 디코딩 회로의 1처리구간의 동작 및 DRAM의 포트의 동작을 표시하는 도면. 제4도는 본 발명에 따르는 화상 디코딩 회로 및 DRAM 포트의 다른 동작 시퀸스를 표시하는 도면, 제5도는 본 발명에 따르는 화상 디코딩 회로에 사용되는 역양자화기의 입출력신호의 구성을 표시하는 도면.

Claims (32)

  1. 미리 정해진 수순에 따라서 압축처리된 동화상을 소정 사이즈의 세그먼트단위로 신장하는 화상 디코딩 회로에 있어서, 상기 세그먼트는 처리해야 할 데이터를 포함하는 데이터 블럭과, 상기 데이터블럭의 데이터속성을 나타내는 정보를 가지는 헤더를 가지며, 상기 동화상 정보를 나타내는 비트스트림을 수신하고 상기 세그먼트이 헤더의 정보를 해석하여 다음에 실행되어야할 처리를 표시하는 정보를 생성하는 헤더 디코딩 수단(3,6)과, 상기 헤더 디코딩 수단에서의 상기 세그멘트의 헤더의 정보의 해석 완료를 나타내는 신호(ØCPL)에 응답해서 데이터 처리개시지시신호(MBSYNC)를 발생시키는 제어수단(1226)과, 상기 데이터 처리 개시지시신호에 응답해서 기동되며, 상기 세그먼트이 헤더에 계속하는 데이터 블럭의 상기 헤더디코딩 수단의 해석 결과에 의거해서 처리를 실행하는 데이터 처리수단(1,1214,1216,1218,1220)을 구비하고, 상기 헤더 디코딩 수단은 각 상기 세그먼트에 계속해서 주어지는 헤더의 정보를 분석하고, 상기 종료신호를 발생하도록 선행의 세르먼트의 처리하는 화상디코딩 장치.
  2. 제1항에 있어서, 상기 제어수단(1226)은 상기 종료신호를 수신하게 결속되고 소정의 조건이 일치되는 것을 판정하고 상기 소정의 조건이 판정의 결과가 일치할때 상기 데이터 처리개시표시신호(MBSYNC)를 어서-트하는 상기 종료신호의 어서-트에 응답하는 구동수단(11,12,16)을 포함하는 화상디코딩 회로.
  3. 제1항에 있어서, 상기 데이터처리 개시표시신호(MBSYNC)는 세그먼트를 처리하는 주기를 판정하는 화상디코딩 회로.
  4. 제2항에 있어서, 상기 데이터 처리수단(4,1212,1214,1216)에서 주어지고 그에 의해 처리된 상기 비트 스트림의 데이터를 기억하는 외부 메모리(1230)를 더 구비하고, 상기 제어수단(1226)은 상기 외부 메모리로 억세스가 되지 않고 상기 종료신호가 어서-트될때 상기 데이터 처리개시 지시신호의 선행의 어서-트이인가되므로서 프리세트 시간이 경과되는 것을 확인하는 구동수단(11,12,16)을 구비하는 화장 디코딩 회로.
  5. 제1항에 있어서, 상기 제어수단(1226)은 프리세트 시간에 정각에 맞게 계수를 해서 어서-트되는 상기 데이터 처리 개시 신호에 응답해서 활성화되는 타이머(16)과, 적어도 상기 타이머가 시간 계수가 상기 프레스트 시간에 도달하는 것을 나타내는 정각 신호를 발생하는 조건에서, 상기 종료 신호의 어서-트에 응답해서 상기 데이터 처리 개시 지시신호(MBSYNC)를 어서-트하는 상기 헤더 디코딩 수단(3,6)에서 종료 신호를 수신하게 결속되는 동작 드라이버(11)를 포함하는 화상 디코딩 회로.
  6. 제5항에 있어서, 상기 타이머(16)는 상기 프리세트 시간이 가변으로 되게 하는 화상 디코딩 회로.
  7. 제5항에 있어서, 상기 제어수단(1226)은 헤더의 수신 정보에 따라 상기 프리세트 시간을 변경하는 상기 헤더 디코딩 수단(3,6)에서 헤더의정보를 수신하게 결속되는 수단(11)을 포함하는 화상 디코딩 회로.
  8. 제1항에 있어서, 상기 압축동화는 예상 인코딩을 행하는 화소 데이터를 포함하고,상기 데이터 처리수단(4,1212,1216,1218)은 원래의 화소 데이터를 복구하는 상기 데이터 블럭의 상기 데이터상의 예상 인코딩에 역으로 신장처리를 행하는 수단(1212,1216,1218,1220)과, 상기 제어수단(1226)은 메모리 수단(1230)의 외부에 설치되어 상기 데이터 처리수단에서 상기 복구 화소 데이터의 기억을 행하고, 메모리 장치로 상기 비트스트림의 데이터를 기록하고, 상기 메모리 장치에서 상기 복구된 화소 데이터사이에 나타나도록 데이터를 판독하며, 어서-트되는 상기 데이터 처리개시지시 신호에 응답해서 상기 단위 처리부에서 소정의 순서로 상기 데이터 처리 어서-트로 화소데이터의 복구를 요구하는 예상화상 화소 데이터를 순차적으로 판독하는 억세스수단(12)을 포함하는 화상 디코딩 회로.
  9. 제8항에 있어서, 상기 억세스 수단(12)은 상기 데이터 처리 개시 지시신호(MBSYNC)의 연속적인 어서-트 사이의 주기내에 상기 저장, 상기 기록, 상기 판독을 행하는 화상 디코딩 회로.
  10. 제8항에 있어서, 상기 억세스 수단(12)은 상기 데이터 처리개시 표시 신호의 어서-트에 응답해서, 메모리 장치로 복구된 화소 데이터의 저장고, 상기 메모리 장치로 비트 스트림의 데이터의 기록과, 상기 메모리장치에서 나타나도록 데이터의 판독과 상기 메모리 장칭서 상기 데이터 처리수단(1212,1214,1216)으로 예상화소 데이터의 데이터판독과, 상기 메모리 장치에서 이 소정의 순서로 연속해서 상기 데이터 처리수단으로 비트 스트림의 데이타를 판독을 행하는 화상 디코딩 회로.
  11. 제1항에 있어서, 상기 데이터 처리수단(4,1212,1214,1216,1218,1220)은 하나의 세그먼트를 담당하는 각 파이프라인 스테이지에 의해 상기 세그먼트상에 파이프라인 법으로 처리하는 복수의 파이프라인 스테이지를 포함하는 화상 디코딩 회로.
  12. 제11항에 있어서, 메모리 장치(1230)에서 예상 화상 데이터로드를 하고, 상기 데이터 블럭의 지교변환계수의 가변장 디코딩 및 역 양자화를 행하는 제1의 파이프라인 스테이즈와, 상기 로드된 예상화상화소 데이터에서 예상화상을 작성하는 제2의 파이프라인 스테이지와, 상기 역양자화된 화소 데이터의 역직교 변환처리 및 사이 예상화상 화소데이터와 상기 역직교 변환처리된 화소 데이터에서 상기 데이터 블럭의 화소 데이터의 복구를 행하는 제3파이프라인 스테이지와, 상기 복원된 화소 데이터의 상기 기억장치에의 기록을 행하는 제4파이프라인 스테지를 포함화상 신장회로.
  13. 제11항에 있어서, 상기 제어수단(4)에서 발생된 에러 검출신호에 응답해서 상기 데이터 처리수단(4,1212,1216,1218,1220)에서 처리순으로 검출된 상기 에러를 가지는 세그먼트 앞에 위치한 세그먼트의 데이터블럭의 상기 파이프라인 스테이지에서 소정의 에러 복구 처리를 행하는 수단을 더 구비하는 화상 디코딩 회로.
  14. 제1항에 있어서, 상기 데이터 처리수단(4,1212,1214,1216,1218,1220)은 고정장 데이터를 발생하는 상기 데이터 블럭의 가변장 디코딩 데이터용 가변장 디코더와, 수신된 고정장 데이터를 역양자화하는 상기 고정장 데이터를 수신하게 접속되는 역 양자화기(1214)와, 라스터 주사 순으로 수신된 역 양자화 고정장 데이터의 주사 순으로 변환하는 상기 역 양자화기에서 결속되는 주사 컨버터(1216)와, 상기 주사 컨버터에서 수신된 데니터상에 소정의 직교변환을 행하는 상기 주사 컨버터에 결속되는 역 직교 트랜스포머(1218)와, 원래의 화소 데이터를 복구하기 위한 상기 역 직교 트린스포머에서 수신된 데이터상에 소정의 동작을 행하는 상기 역 직교 트랜스퍼머에 결속되는 화소 재구성기(1220)를 구비하고, 상기 가변장 디코더, 상기 역 양자화기, 상기 주사컨버터, 상기 역 직교 트랜스퍼머 및 상기 화소 재구성기는 상기 데이터 처리 개시 지시 신호(MBSYNC)의 어서-트에 응답해서 각 처리를 개시하도록 활성화되는 화상 디코딩 회로.
  15. 제14항에 있어서, 상기 헤더 디코딩 수단(3,4)은 상기 가변장 디코더(1212)에서 상기 현재 세그먼트의 데이터 블럭의 처리 종료후, 적어도 상기 역 양자화기에서 현재 세그먼트의 처리 동작과 평행으로 다음 세그먼트의 헤더 정보의 해석을 행하는 해석수단(3)을 포함하는 화상 디코딩 회로.
  16. 제14항에 있어서, 상기 헤더 디코딩 수단(3,6)과, 상기 헤더 디코딩 수단에서 발생되는 에러를 검출하는 상기 데이터 처리수단(4)과, 에러 검출신호(ØER)를 어서-트하는 상기 데이터 처리수단을 더 구비하고, 상기 제어수단(1216)은 에러 처리신호(ØERR)를 어서-트하는 상기 에러 검출신호를 수신하도록 결속되는 에러 처리수단(13,15)을 포함하며, 상기 주사 컨버터(1216)는 에러 은폐 데이터를 저장하고, 상기 에러 처리 신호의 어세트에 응답해서 상기 역 직교 트랜스퍼머로 에러 은폐 데이터를 공급하는 에러 은폐수단(42,43,44,45)을 포함하는 화상 디코딩 회로
  17. 제16항에 있어서, 상기 주사 컨버터(1216)는 세그먼트 단위상에 라스터 주사순으로 데이터의 스퀸스를 재정리하는 역 양자화기에서 데이터를 수시나게 결속되는 디코더수단(40,41)과, 저장용 세그먼트의 단위상에 수신된 데이터의 평균값을 얻는 상기 재정리 수단에서 데이터를 수신하도록 결속되는 평균/저장 수단과, 상기 정치 수단의 데이터를 수산하고 상기 역 직교 트랜스퍼머상의 상기 에러 처리 신호의 어서-트에 응답해서 상기 평균/저장 수단으로부터 수신된 데이터를 선택 통과하는 상기 평균/저장 수단에 결속되는 선택수단(44,45)을 포함하는 화상 디코딩 회로.
  18. 제17항에 있어서, 상기 평균/저장 수단(44,43)은 퍼스트 인 퍼스트 아웃(first in first out)형에서 스크린의 하나의 라인의 세그먼트 가치량의 평균 데이터를 지정하는 저장수단(43)을 포함하는 화상 디코딩 회로.
  19. 제17항에 있어서, 상기 화상 재구성기(1220)는 상기 복구된 화소 데이터로서 상기 역직교 트랜스퍼머 (1218)에서 수신된 데이터를 선택 통과하는 상기 에러 처리신호(ØERR)의 어서-트에 응답해서 선택수단(33,35)을 포함하는 화상 디코딩 장치.
  20. 제16항에 있어서, 상기 비트 스트림을 수신하게 결속되고 상기 에러 검출신호(ØER)의 어서-트에 응답해서 스타트 코드 검출 신호(ØSD)를 발생하는 수신된 비트 스트림에서 소징패턴의 스타트 코드를 검출하는 상기 에러 검출기(5,6)와 결속되는 스타트 코드 검출 수단(2,6)을 더 구비하고, 상기 제어수단(1226)소정의 조건이 일치할때 상기 에러 처리신호(ØERR)를 디어서-트하는 상기 스타트 코드 검출신호의 어서-트에 응답하는 수단(11,13,15)을 포함하는 화상 디코딩 회로.
  21. 제20항에 있어서, 상기 비트 스트림은 에러에서 복귀한 세그먼트를 나타내는 어드레스를 포함하는 헤더정보에 다음에 상기 스타트 코드를 포함하고, 상기 제어수단(1226)은 상기 어레스와 상기 헤더 디코딩 수단(3,6)에서 상기 종료 신호와 상기 어드레스가 처리 개시 표시신호(MBSYNC)의 다음 어서-트에 응답해서 처리되는 세그먼트를 나타낼때 상기 소정의 조건을 판정하는 스타트 코드 검출신호를 수신하는 수단(11,13,15)을 포함하고 상기 종료신호와 상기 스타트 코드 검출 신호가 어서-트되는 화상 디코딩 회로.
  22. 제21항에 있어서, 상기 소정의 조건은 처리 개시 표시신호(MBSYNC)의 선행 어서-트가 비트 스트림 데이터르 저장하는 외부 메모리(1230)와, 복구 화소 데이터 및 외부 메모리에서 데이터 처리수단(4)으로 공급 되는 비트스트림 데이터로 엑세스되지 않으므로 소정의 시간이 경과하는 것을 더 포함하는 화상 디코딩 회로.
  23. 제1항에 있어서, 소정 패턴의 비트 스트림에서 헤더 정보의 다음에 이어지는 스타트 코드를 검출하는 비트 스트림을 수신하게 결속되는 스타트 코드 검출기(2,6)를 더 구비하고, 상기 제어수단(1226)은 디어서-트되는 상기 데이터 처리개시표시 신호(MBSYNC)를 유지하고 상기 스타트 코드 검출기가 스타트 코드를 검색 하도록 상기 스타트 코드 검출기상에 스타트 신호로 어서-트하는 리셋트 요구신호(ØRRQ)에 응답하는 초기화 수단(11,14)을 구비하고, 상기 스타트 신호는 또, 헤더 디코딩 수단이 스타트 코드에 이어지는 헤더의 정보를 해석하도록 상기 헤더 디코딩 수단(3,6)에 인가되며, 상기 데이터 처리개시표시 신호를 어서-트하기 위해 헤더 디코딩 수단에서 완료 신호와 상기 스타트 코드 검출기에서 어서-트되는 스타트 코드 검출 신호에 응답하는 구동 수단(11,15)을 구비하는 화상 디코딩 회로.
  24. 제23항에있어서, 비트스트림의 데이터와 상기 데이터 처리 수단(4,1212,1216,1218,1220)에 의해 복구 되는 화소 데이터를 저장하는 외부 메모리(1230)를 더 구비하고 상기 저어수단 (1226)은 상기 외부 메모리로의 엑세스와 상기 외부 메모리와 상기 데이터 처리수단 사이의 데이터 전송을 모니터하는 상기 외부 메모리에 결속된 버스 콘트롤러(12)와, 상기 구동 수단(11,14)에 결속되고 계수가 프리세트 시간에 다달았을때 타임 엎 신호를 바생하는 프리세트 시간까지 시간 계수완료하는 상기 데이터 처리 개시표시신호의 어서-트에 응답하는 타이머(16)과, 상기 구동 수단(11,15)은 상기 버스 콘느롤러와 상기 타이머에 결속되고 디스플레이 스크린상에 픽처를 나타내는 타이밍을 제공하는 픽쳐 동기화 신호를 수신하면, 상기 외부 메모리에서 상기 데이터 처리수단으로 전송되는 비트 스트림의 데이터와 상기 외부 메모리와 어서-트리되는 상기 타임 엎 신호와 상기 스타트 코드 검출 신호와 상기 완료 신호 모두가 어서-트될때 어서-트되는 상기 데이터 처리 개시 표시신호를 발생하는 어서-트된 상기 픽쳐 동기화 신호로 어세스가 되지 않는 것을 나타내는 상기 버스 콘트롤러에 응답하는 수단(11)을 포함하는 화상 디코딩 회로.
  25. 상기 구동 수단(11,15)은 상기 리셋트 신호가 어스-트될때 상기 데이터 처리수단(4,1212,1216,1218,1220)이 인가되는 세그먼트의 데이터상의 처리를 완료하기 까지 상기 스타트 신호의 어서-트를 지연하는 수단(15)을 포함하는 화상 디코딩 회로.
  26. 제24항에 있어서, 상기 외부 메모리에 저장되는 비트 스트림의 적어도 소정의 데이터량과 상기 외부메모리에서 상기 데이터 처리수단으로 전송된 적어도 비트 스트림 또다른 소정의 데이터량을 나타내는 상기 버스 콘트롤러(12)에 응답하는 상기 구동수단(11,15)을 구비하는 화상 디코딩 회로.
  27. 압축전 화상 데이터를 복구하는 소정 사이즈의 세그먼트 단위에서 소정의 수순에 따라 압축 동화를 신장하고, 상기 압축동화는 가변장으로 인코드되고, 피처리되는 데이터를 포함하는 데이터 블럭을 가지는 각 상기 세그먼트와, 상기 데이터 브럭의 속성을 나타내는 정보를 가지는 해더를 구비한 화상 디코딩 장치에 있어서,(i)공급된 비트스트림에서 헤더를 검출하고 상기 헤더 정보 모두의 해석의 신호 표시 완료(ØCPL)을 발생하는 수단(6)을 포함하는 상기 헤더의 정보를 해석하는 해석수단(3,6)과, (ii)상기 해석수단의 상기 해석결과에 의거해서 상기 세그먼트의 데이터 블럭의 화소 데이터를 가변장을 디코딩하고, 고정장 화소 데이터를 형성하며 상기 데이터 블럭의 화소 데이터가 원래의 화소 데이터로 복구하는 가변장 디코딩 수단(4,1212,1214,1216,1218,1220)을 구비하는 데이터 처리수단(4,1212,1216,1218,1220)과, 상기 해석수단과 상기 가변장 디코딩 수단의 처리중에 에러가 검출될때 상기 에러를 나타내는 에러 검출 신호에 발생하는 상기 해석 수단과 상기 가변장 디코딩 수단에 결속하는 검출수단(5,6)과 상기 에러 검출 신호에 응답해서 다가오는 상기 비트 스트림에서 소정의 패턴을 가지는 코드를 탐색하는 상기 검출수단에 결속되는 코드 탐색 수단(2,6)과, 상기 코드 탐색수단에 의해 코드 검출에 응답해서 상기 해석수단을 활성화하는 상기 코드 탐색 수단에 결속되는 활성화 수단(1226,6)과, 상기 해석수단으로부터 상기 헤더의 상기 정보의 해석을 완료를 나타내는 해석완료 표시신호에 응답해서 소정의 조건이 설정되기 까지 상기 데이터 처리수단에 의해 코드를 이어서 헤더 다음에 데이터 블럭 처리의 실행을 지연화는 수단(1226,6)을 구비하는 화상 디코딩 회로.
  28. 제27항에 있어서,상기 데이터 처리수단은 (4,1212,1216,1218,1220)은 처리 단위로서 상기 세그먼트를 파이프라인 방식으로 처리를 행하는 복수의 파일라인 스테이지를 포함하는 화상 디코딩 회로.
  29. 제28항에 있어서, 상기 파이프라인 스테이지는 역 양자화에 의해 이어지는 상기 데이터 블럭의 직교 변환 계수의 가변장을 인코딩하는 메모리 장치(1230)에서 예상 화상 데이터의 로딩을 행하는 제1파이프라인 스테이지와, 상기 로드된 예상 화상 화소 데이터에서 예상 화소를 형성하는 제2파이프라인 스테이지와, 역양자화 화소 데이터의 역 직교 변환 처리와 상기 예상 화상 화소 데이터와 역직교 변환 처리된 화소 데이터에서 상기 데이터 블럭의 상기 화소 데이터의 복구를 행하는 제3스테이지와, 상기 메모레 장치에서 상기 복구된 화소 데이터를 기록하는 제4파이프 라인 스테이지를 구비하는 화상 디코딩 회로.
  30. 제28항에 있어서, 상기 에러가 상기 데이터 처리수단(4,1212,1216,1218,1220)에서 처리 순으로 검출되는 세그먼트의 앞에 위치되는 세그먼트의 데이터 블럭에서 상기 파이프라인 스테이지에서 소정의 에러 복구처리를 행하는 에러 검출신호에 응답하는 수단(1226,1216,1220)을 더 구비하는 화상 디코딩 회로.
  31. 압축전 회로 데이터를 복구하는 소정 사이즈에 세그먼트 단위에서 소정의 수순에 따라 압축 동화를 신장하고, 상기 압축동화는 가변장으로 인코드되고, 각 상기 세그먼트는 상기 데이터 블럭의 속성을 나타내는 헤더를 이어서 화소 데이터를 포함하는 데이터 블럭을 가지는 화상 디코딩 장치에 있어서, 공급된 비트 스트림에 포함되는 세그먼트의 헤더에 포함되는 정보를 해석하는 비트 스트림을 수신하게 결속되는 해석수단(3,6)과, 과 상기 해석수단의 상기 해석 결과에 따라 헤더를 이어 데이터 블럭의 데이터상에 가변장 디코딩 처리를 행하고, 상기 데이터 블럭의 상기 데이터를 원래 화상 데이터로 복구하는 가변장 디코딩 수단을 포함하는 데이터 처리수단(4,1212,1214,1216,1218,1220)과 상기 스타트 신호에 응답해서 공급된 상기 비트 스트림에서 소정의 패턴을 가지는 코드를 탐색하는 탐색수단(2,6)과, 리셋트 요구 신호에 응답해서 상기 탐색수단을 개시하기 위한 스타트 신호를 발생하는 수단(6,11,14)과, 상기 탐색 수단에 의해 상기 코드의 검출에 응답하는 상기 해석수단을 활성화하는 수단(6,11,14)과, 상기 해석수단에서 상기 헤더의 상기 정보의 해석의 완료를 나타내는 해석 완료 표시 신호에 응답하는 소정의 조건이 설립하기 까지 상기 데이터 처리수단에 의해 상기 코드를 있는 헤더를 있는 데이터 블럭의 처리의 실행을 지연하는 수단(11,12,15,16)을 구비하는 화상 디코딩 회로.
  32. 제31항에 있어서, 상기 소정의 조건은 디스플레이되는 화상의 스타트 점을 나타내는 동기 신호(PSYNC)를 인가하는 것인 화상 디코딩 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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