KR960027244A - 발진기 회로의 출력 주파수를 제어하기 위한 시스템 - Google Patents
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Abstract
PPS CMOS 회로를 구동시키도록 설계된 간단하면서 전력 소모가 적은 발진기 회로의 출력 주파수는 폐쇄루프 시스템에 의해 제어된다. 규정치와 출력 주파수의 편차에 응답하여, 본 발명의 시스템은 개패시터로 이루어진 어레이에 인가되는 보정 신호를 발생시킨다. 이러한 방식에 있어서, 정전 용량은 발진기 회로의 직렬 공진 경로에서 전기적으로 가.감되므로, 발진기 회로의 출력 주파수 또는 규정치 근처에서 자동적으로 설정하여 그 상태를 유지한다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 원리에 따라 형성된 발진기 회로의 출력 주파수를 제어하기 위한 보정 회로를 포함하는 특정한 예증이 되는 시스템을 간략하게 도시한 블록도.
Claims (8)
- 캐피시터와 직렬로 접속된 이덕터로 구성하는 공진 경로를 포함하는 발진기 회로의 출력 주파수를 제어하고, 상기 인덕터와 상기 캐패시터 사이의 직렬 경로 내에 출력 노드 지점을 가지는 시스템에 있어서, 상기 발진기 회로의 출력 주파수가 마스터 타이밍 회로의 출력 주파수에 의해 결정된 기준 주파수 이상인지 이하인지의 여부를 나타내는 보정 신호를 발생시키기 위해 상기 발진기 회로의 출력 및 상기 마스터 타이밍 회로의 출력에 응답하는 제1수단 및 캐패시터를 상기 노드 지점과 전기적으로 접속시키거나 분리시키고, 상기 발진기 회로의 출력 주파수를 상기 기준 주파수로 추적하게 하기 위한 직렬 공진 경로 내의 캐패시터와 병렬로 접속시키거나 분리시키기 위해 보정 신호에 응답하는 제2수단을 포함하는 출력 주파수 제어 시스템.
- 제1항에 있어서, 상기 제1수단이 위상 비교기를 포함하는 출력 주파수 제어 시스템.
- 제2항에 있어서, 상기 위상 비교기는 상기 발진기 회로의 출력 주파수가 기준 주파수 이상일 때 하나의 값을 가지고 있고, 상기 발진기 회로의 출력 주파수가 기준 주파수 이하일 때 다른 값을 가지고 있는 보정신호를 제공하는 출력 주파수 제어 시스템.
- 제3항에 있어서, 상기 제2수단이 2개의 출력 리드를 가지고 있고; 보정 신호를 카운트 업하여, 연속 업카운트 신호에 대한 시퀀스(00,01,10,11 및 00)에 종용하는 카운트를 출력 리드상에 제공하기 위해 상기 한가지 값의 보정 신호에 응답하고, 보정 신호를 카운트 다운하여, 연속 다운 카운트 신호에 대한 시퀀스(00,01,10,11 및 00)에 종용하는 카운트를 출력 리드 상에 제공하기 위해 상기 다른 값의 보정 신호에 응답하는 2비트카운터, 상기 카운터의 출력 리드 상에 나타나는 신호에 응답하고, 각각의 출력(000,001,011 및 111)을 제공하기 위해 카운터 출력(00,01,10 및 11)에 응답하는 디코더 회로, 상기 디코더 회로의 출력 리드에 각각 관련된 x[F]의 값을 각각 가지고 있고, 상기 노드 지점에 각각 접속되기에 적합하며, 상기 발진기 회로의 직렬 공진경로 내의 캐패시터와 병렬로 접속되기에 적합한 캐패시터 및 상기 리드에 각각 관련된 캐패시터를 상기 노드지점에 접속시키기 위해 상기 디코더 회로의 출력 리드 상에 나타나는 "1"신호에 응답하고, 상기 리드에 각각 관련된 캐패시터를 상기 노드 지점에서 분리시키기 위해 상기 디코더 회로의 출력 리드 상에 나타나는"0"신호에 응답하는 수단을 포함하는 출력 주파수 제어 시스템.
- 제4항에 있어서, 상기 제2수단이 n개의 단을 가지고 있고, 상기 레지스터의 단으로부터 각각 나오는 n개의 출력 리드를 갖고 있는 n비트 쉬프트 레지스터, 상기 쉬프트 레지스터의 출력 리드에 각각 관련된 4x[F]의 값을 각각 가지고 있고, 상기 노드 지점에 각각 접속되기에 적합하며, 상기 발진기 회로의 직렬 공진 경로내의 캐패시터와 병렬로 접속되기에 적합한 n개의 캐패시터 및 상기 리드에 각각 관련된 캐패시터를 상기 노드지점에 접속시키기 위해 상기 쉬프트 레지스터의 출력 리드 상에 나타나는"1"신호에 응답하고, 상기 리드에 각각 관련된 캐패시터를 상기 노드 지점에서 분리시키기 위해 상기 쉬프트 레지스터의 출력 리드 상에 나타나는 "0" 신호에 응답하는 수단을 더 포함하는 출력 주파수 제어 시스템.
- 제5항에 있어서, 상기 제2수단이 추가 "1"을 상기 쉬프트 레지스터의 단 내에 삽입함으로써 111내지 000까지의 검출기 회로의 출력 리드를 나타내는 표시에 응답하고, 추가 "0"을 상기 쉬프트 레지스터의 단 내에 삽입함으로써 000 내지 111까지 상기 검출기 회로의 출력 리드를 나타내는 표시에 응답하는 검출기 회로를 더 포함하는 출력 주파수 제어 시스템.
- 제6항에 있어서, 상기 제2수단이 상기 쉬프트 레지스터의 특정 수의 단을 이의"1"상태로 초기에 설정하기 위한 수단을 더 포함하데, 상기 "l" 상태인 단으로부터 나오는 출력 리드에 각각 관련된 캐패시터가 상기 노드 지점에 초기에 접속되어 상기 발진기 회로의 직렬 공진 경로 내의 캐패시터와 병렬로 접속되는 출력 주파수 제어 시스템.
- 제7항에 있어서, 상기 제2수단이 상기 검출기 회로의 출력 리드에 관련되고, 캐패시터가 상기 노드 지에서 분리되는 규정된 충전 상태를 설정하기 위해 상기 쉬프트 레지스터의 출력 리드와 관련된 캐패시터 각각에 접속된 수단을 더 포함하는 출력 주파수 제어 시스템.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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