KR950704695A - 자기 기록 캐리어로부터 정보 신호를 판독하는 장치(Arrangement for reading information from a track on a record carrier comprising a fast settling read amplifier for magneto-resistive heads) - Google Patents

자기 기록 캐리어로부터 정보 신호를 판독하는 장치(Arrangement for reading information from a track on a record carrier comprising a fast settling read amplifier for magneto-resistive heads) Download PDF

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오토 부르만 요한네스
누노 빌라 로보스 라말호 이오아오
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프레데릭 얀 스미트
필립스 일렉트로닉스 엔.브이
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Abstract

자기 기록 캐리어로부터 정보 신호를 판독하는 장치가 개시된다. 상기 장치는 일정한 전위의 제1점(13)에 연결된 제1단자(3)와 제2단자(4)를 가지는 자기 저항성(MR) 소자 (Rm1)를 갖는 판독 헤드와, 바이어스 전류를 MR 소자에 공급하는 출력(5)을 갖는 바이어스 전류 발생기(2)와, 바이어스 전류 발생기(2)의 출력에 결합된 제1단자(6)와 자기 저항 헤드(Rm1)의 제2단자(4)에 결합된 제2단자(7)를 가짐으로써 바이어스 전류 발생기, 증폭기 회로 및 자기 저항성 소자를 직렬 배열시킨다. 출력 단자(8)에서 정보 신호가 사용가능하다, 증폭기 회로(1)는 출력 단자(8) 및 제2단자(7)간에 결합된 MOS 트랜지스터(T1)를 구비한다. 낮은 차단 주파수(R1, C1)을 갖는 피드백 회로는 바이어스 전압을 MOS트랜지스터(T1)의 게이트에 제공되고 바이어스 전류 발생기(2)의 바이어스 전류를 MR 소자를 통해 흐르게 한다. 상기 장치의 빠른 설정은 저항기(R1)를 쇼트 회로(S1)시킴으로써 가능하고, 캐패시터(C1)용 고 충전 전류는 버퍼 증폭기(310)에 의해 공급된다. 버퍼 증폭기(310), 저항기(R1) 및 스위치(S1)는 소망하지 않는 오프세트를 발생시킴이 없이 빠른 설정을 구비한다.

Description

자기 기록 캐리어로부터 정보 신호를 판독하는 장치(Arrangement for reading information from a track on a record carrier comprising a fast setting read amplifier for magneto-resistive heads)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제6도는 본 발명에 따른 평형된 장치도, 제7도는 MR 소자 및 증폭기 회로간의 전기적인 연결에 대해 구비된 차폐 수단을 갖는 장치도, 제8도는 디스크 형태로 된 기록 캐리어의 트랙으로부터 정보를 판독하는 도시도.

Claims (13)

  1. 일정한 전위의 제1점(13)에 연결된 제1단자(3)와, 제2단자(4)를 가지는 자기 저항성 소자(Rm1)을 갖는 판독 헤드와; 바이어스 전류를 공급하는 바이어스 전류 수단(2; T30,T31)과; 정보 신호(Vout)를 공급하는 출력단자(8)와, 바이어스 전류 수단(2;T30,T31) 및 출력단자 (8)에 결합된 제1단자와, 자기 저항성 헤드(Rm1)의 상기 제2단자(7)에 결합된 제2단자(7)를 구비하여 바이어스 전류 수단(2;T30,T31)의 직렬 배열을 형성하는 증폭기 회로(1)를 구비하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치로서, 상기 증폭기 회로(1) 및 상기 자기 저항성 소자(Rm1)가 일정한 전위의 제2점(12) 및 일정한 전위의 상기 제1점(13) 간에 있으며, 상기 증폭기 회로(1)는 제1트랜지스터(T1)와, 증폭기 회로(1)의 출력 단자(8)에 결합된 입력 단자(t2)와 증폭기 회로(1)의 출력 단자(8)에 결합된 입력 단자(t2)와 출력 단자(t1)을 갖는 피드백 회로(F1)와, 부하 임피던스(R1/1)와 캐패시터 소자(C1)를 더 구비하며, 상기 제1트랜지스터(T1)의 제1주요한 플로우(flow)단자가 증폭기 회로(1)의 제2단자(7)에 연결되며, 상기 제1트랜지스터(T1)의 제2주요한 플로우 단자가 증폭기 회로(1)의 제1단자(6)에 결합되며, 상기 제1트랜지스터(T1)의 제어 단자가 피드백 회로(F1)의 출력 단자(t1)에 결합되며, 상기 제어 단자는 최소한의 캐패시터 소자(C1)를 경유해 일정한 전위의 제1점(13)에 더 결합되며, 부하 임피던스(R1/1)는 증폭기 회로(1)의 출력 단자(8)에 결합되는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치에 있어서, 피드백 수단이, 피드백 회로(F1)의 입력 단자(t2)에 결합된 입력과, 출력을 갖는 전압 버퍼 수단과; 상기 전압 버퍼 수단의 출력 및 상기 피드백 회로(F1)의 출력 단자(t1)간에 연결된 제1직렬 저항기(R1)와; 제어 신호에 응답하여 동작 가능하며 상기 제1직렬 저항기(R1)와 병렬로 연결된 스위치(S1)를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  2. 제1항에 있어서, 상기 전압 버퍼 수단은, 제1전류원(24) 및 제2전류원(21)과, 다이오드로 연결된 제2트랜지스터(T3) 및 제3트랜지스터(T4)를 구비하며, 제2트랜지스터(T3)의 제1주요한 플로우 단자 및 제3트랜지스터(T4)의 제1주요한 플로우 단자는 상호 연결되고 제1전류원(24)을 경우해 일정한 저위의 제1점(13)에 결합되며, 제2트랜지스터(T3)의 제2주요한 플로우 단자는 제2전류원(21)을 경유해 일정한 전위의 제2점(12)에 결합되며 상기 전압 버퍼 수단의 출력을 형성하며, 제3트랜지스터의 제2주요한 플로우 단자는 일정한 전위의 제2점(12)에 결합되며, 제3트랜지스터(T4)의 제어 단자는 상기 전압 버퍼 수단의 입력을 형성하며 피드백 회로(F1)의 입력 단자(t2)에 결합되는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  3. 제2항에 있어서, 상기 전압 버퍼 수단은 제3트랜지스터(T4)의 제2주요한 플로우 단자 및 일정한 전위의 제2점(12)간에 연결된 제3전류원(22)를 더 구비하며 상기 제1전류원(2)은 다이오드 배열(25)과, 바이어스 저항(R24), 및 제1지점(13)에 연결된 제1주요한 플로우 단자와 제2(T3) 및 제3(T4) 트랜지스터의 제1주요한 플로우 단자에 연결된 제2주요한 플로우 단자와 다이오드 배열(25)을 경유해 제3트랜지스터(T4)의 제2주요한 플로우 단자에 그리고 바이어스 저항기(R24)를 경유해 제1점(13)에 결합된 제어 단자를 갖는 제4트랜지스터(T24)를 구비하는 것을 또한 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  4. 제3항에 있어서, 전압 버퍼 수단은 제5(T5) 및 다이오드(40)를 더 구비하며, 상기 제5트랜지스터(T5)의 제어 단자 및 제2주요한 플로우 단자는 상호 연결되고 다이오드 소자(40)를 경유해 제3전류원(21)에 결합되고, 제5트랜지스터(T5)의 제1주요한 플로우 단자는 제2트랜지스터(T3)의 제1주요한 플로우 단자에 연결되고, 제6트랜지스터(T6)는 제2트랜지스터(T3)의 제2주요한 플로우 단자에 결합된 제1주요한 플로우 단자와, 제2점(12)에 결합된 제2주요한 플로우 단자와, 다이오드 소자(40)를 경유해 제5트랜지스터(T5)의 제2주요한 플로우 단자에 결합된 제어 단자를 갖는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  5. 제1,2,3 또는 4항에 있어서, 상기 증폭기 회로는 제1트랜지스터(T1)의 제2주요한 플로우 단자에 연결된제1주요한 플로우 단자와, 증폭기 회로(1)의 제1단자(6)에 결합된 제2주요한 플로우 단자를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  6. 제1,2,3,4, 또는 5항에 있어서, 상기 증폭기 회로(1)는 증폭기 회로(1)의 제2단자(7)에 결합된 제어 단자와, 바이어스 전류원(36)을 경유해 일정한 전위의 제2점(12)에 결합된 제2주요한 플로우 단자와, 일정한 전위의 제1점(13)에 결합된 제2주요한 플로우 단자와, 증폭기 회로(1)의 출력 단자(8) 및 제8트랜지스터(T8)의 제1주요한 플로우 단자간에 결합되는 부하 임피던스(R1/1)를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  7. 제6항에 있어서, 상기 증폭기 회로(1)는 제7트랜지스터(T7)의 제어 단자에 결합된 제1주요한 플로우 단자와, 제8트랜지스터(T8)의 제1주요한 플로우 단자에 결합된 제어 단자를 갖는 제9트랜지스터(T9)를 더 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  8. 제7항에 있어서, 상기 증폭기 회로(1)는 제1트랜지스터(T1)의 제어 단자에 결합된 제어 단자와, 제8트랜지스터(T8)의 제어 단자에 결합된 제1주요한 플로우 단자를 갖는 제10트랜지스터(T10)를 더 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 기록 정보 신호를 판독하는 장치.
  9. 제6, 7 또는 8항에 있어서, 제8트랜지스터(T8)의 제2주요한 플로우 단자는 부가적인 부하 임피던스(R1/1)를 경유해 일정한 전위의 제1점(13)에 결합되어 정보 신호를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  10. 제1항에 있어서, 상기 제1단자(6)는 제1단자(6)에 연결된 제1주요한 플로우 단자, 및 증폭기 회로(1)의 출력 단자(8)에 결합된 제2주요한 플로우 단자를 갖는 제2트랜지스터(T31)를 경유해 증폭기 회로(1)의 출력단자(8)에 결합되고; 상기 전압 버퍼 수단은, 입력 단자(302) 및 출력 단자(304)를 갖는 전류 미러(300)와, 제2트랜지스터(T31)의 전도율에 반대인 전도율과, 전류 미러(300)의 출력 단자(304)에 결합된 제1주요한 플로우 단자와, 기준 전압을 수신하기 위해 연결된 제어 단자를 갖는 제3트랜지스터(T30)와, 제3트랜지스터(T30)의 제1주요한 플로우 단자, 및 증폭기 회로(1)의 출력 단자(8)간에 연결된 제2직렬 저항기(Ra)와, 제1트랜지스터(T1)와 동일한 형태이며, 제1트랜지스터(T1)의 제1주요한 플로우 단자에 연결된 제1주요한 플로우 단자와, 제3트랜지스터(T30)의 제2주요한 플로우 단자에 결합된 제2주요한 플로우 단자를 갖는 다이오드로 연결된 제4트랜지스터(T32)와, 제어 단자와, 제1트랜지스터(T1)의 대응하는 단자에 연결된 제1주요한 플로우 단자와, 전류 미러(300)의 입력 단자(302)에 결합된 제2주요한 플로우 단자를 갖는 제1트랜지스터(T1)와 같은 형태인 제5트랜지스터(T33)를 구비하며; 제4트랜지스터(T32)의 제어 단자에 연결된 입력과, 제1직렬 저항기(R1)에 연결된 출력을 갖는 버퍼 증폭기(310)를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  11. 제10항에 있어서, 상기 바이어스 전류 수단은 증폭기 회로(1)의 제1단자(6)에 연결된 출력(5)을 갖는 바이어스 전류 발생기(2)를 구비하는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  12. 제1,2,3,4,5,6,7,8,9,10 또는 11항에 있어서, 스위치(S1)는, 제1도전율 형태인 제1(ST1) 및 2(ST2) 스위칭 트랜지스터와; 공급 전압 단자(12)에 연결된 제1주요한 플로우 단자와, 제어 신호를 수신하는 제어 입력(100)에 연결된 제어 단자를 갖는 제2도전율 형태인 제1(DT1) 및 제2(DT2) 구동기 트랜지스터와; 제어 입력(100)에 연결된 제어 단자를 갖는 제1도전율 형태인 제3(DT3) 및 제4(DT4) 구동기 트랜지스터를 구비하며, 여기서, 상기 스위칭 트랜지스터(ST1)의제1주요한 플로우 단자는 상기 제2스위칭 트랜지스터(ST2)의 제2주요한 플로우 단자에 연결되며, 상기 제1스위칭 트랜지스터(ST1)의 제2주요한 플로우 단자는 상기 제2스위칭 트랜지스터(ST2)의 제1주요한 플로우 단자에 연결되며, 상기 제1구동기 트랜지스터(DT1)의 제2주요한 플로우 단자는 상기 제1스위칭 트랜지스터(ST1)의 제어 단자에 연결되며, 상기 제2구동기 트랜지스터(DT2)의 제2주요한 플로우 단자는 상기 제2스위칭 트랜지스터(ST2)의 제어 단자에 연결되며, 상기 제3구동기 트랜지스터(DT3)의 제1주요한 플로우 단자는 상기 제1스위칭 트랜지스터(ST1)의 제2주요한 플로우 단자에 연결되며, 상기 제4구동기 트랜지스터(DT4)의 제1주요한 플로우 단자는 상기 제2트랜지스터(ST2)의 제2주요한 플로우 단자에 연결되며, 상기 제3구동기 트랜지스터(DT3)의 제2주요한 플로우 단자는 상기 제1구동기 트랜지스터(DT1)의 제2주요한 플로우 단자에 연결되며, 상기 제4구동기 트랜지스터(DT4)의 제2주요한 플로우 단자는 주요한 구동기 트랜지스터(D2)의 제2주요한 플로우 단자에 연결되는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
  13. 선행항중 어느 한 항에 있어서, 상기 제1언급된 장치와 실제로 동일한 제2장치를 더 구비하며, 상기 제1장치의 증폭기 회로(1)의 캐패시터(C1)는 상기 제2장치의 증폭기 회로(6)의 제2단자(67)에 결합되며 상기 제2장치의 증폭기 회로(61)의 캐패시터(C2)는 상기 제1장치의 증폭기 회로(1)의 제2단자(7)에 결합되는 것을 특징으로 하는 자기 기록 캐리어로부터 정보 신호를 판독하는 장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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