KR950035451A - 매체 오류 코드를 압축 비디오 신호의 패킷에 삽입하기 위한 방법 및 장치 - Google Patents

매체 오류 코드를 압축 비디오 신호의 패킷에 삽입하기 위한 방법 및 장치 Download PDF

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Abstract

패킷 신호의 비디오 페이로드를 버퍼 메모리 공간(18)으로 전송하는 유형의 역전송 프로세서에 있어서, 본 장치는 각 패킷 페이로드 앞의 메모리(18)의 순차적인 제1메모리 어드레스 위치에 매체 오류 코드를 기입하기 위해 포함된다. 프로세서(101)는 현패킷이 적절한 시퀀스로 발생하는지의 여부를 판별하기 위해 현패킷을 조사한다. 패킷이 손실된 경우 순차적인 제1메모리 어드레스 위치는 요구되지 않은 매체 오류 코드를 제거하기 위해 패킷 페이로드에 의해 오버라이팅된다. 매체 오류 코드는 타이밍 장애를 발생하지 않고 패킷 페이로드 스트림에 삽입될 수 있다.

Description

매체 오류 코드를 압축 비디오 신호의 패킷에 삽입하기 위한 방법 및 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명을 구현한 다중 성분 신호의 패킷을 선택하여 처리하기 위한 수신 장치에 대한 블록도, 제4도는 제3도의 구성요소(7)용으로 사용될 수 있는 메모리 관리회로에 대한 블록도, 제5도는 손실 패킷 검출 회로에 대한 블록도.

Claims (9)

  1. 각각이 수신 신호의 무결성(integrety)을 나타내는 추가 데이타와 페이로드를 포함하는 패킷으로 발생하는 신호를 수신하는 장치에 있어서, 패킷화된 신호의 소스(11, 12)와:메모리(18)와:매체 오류 코드의 소스(100)와:상기 신호에 응답하여 잘못된 상기 신호 발생시에 제어 신호를 발생하는 검출 수단(101)과:상기 메모리에 각 패킷과 관련된 매체 오류 코드를 로딩하고 상기 제어 신호의 부재시에 현패킷 페이로드의 데이타로 현패킷과 관련된 매체 오류 코드를 오버라이팅하도록 조절된 메모리 관리 회로(80-9)와:상메모리에 접속되어 상기 메모리에 기억된 패킷 페이로드를 사용하는 이용 수단(22)을 구비하는 것을 특징으로 하는 수신 장치.
  2. 제1항에 있어서, 상기 메모리는 선입 선출 메모리로서 동작하며, 상기 매체 오류 코드의 각각은 관련 페이로드 앞의 메모리 어드레스 위치에 기입되고, 상기 제어 신호의 부재시에 상기 매체 오류 코드가 제1발생 페이로드 데이타에 의해 오버라이팅되는 것을 특징으로 하는 수신 장치.
  3. 제1항에 있어서, 상기 메모리 관리 회로는, 각각 상기 패킷 신호 소스 및 상기 매체 오류 코드 소스에 접속된 제1입력 포트와 제2입력 포트, 상기 메모리의 데이탸입력 포트에 접속된 출력 포트, 및 제어 입력 단자를 갖는 멀티플렉서와:어드레스 발생 회로와:어드레스 카운터에 접속되며 상기 매체 오류 쿄드를 상기 메모리에 로딩하기 위해 요구된 어드레스의 수와 동일한 다수의 어드레스 주기로 어드레스 신호를 지연하는 지연 수단과:지연된 어드레스나 지연되지 않은 어드레스를 상기 메모리의 어드레스 입력 포트에 대해 통과시키도록 배열된 추가 멀티플렉서와:제어 회로를 구비하는데, 상기 제어 회로는 a)각 패킷 페이로드의 발생전에 상기 메모리 데이타 입력 포트에 상기 매체 오류 쿄드 소스가 접속되도록 상기 멀티플렉서를 조절하고, b)각 패킷 페이로드의 발생시에 상기 메모리 데이타 입력 포트에 상기 패킷 신호 소스가 접속되도록 상기 멀티플렉서를 조절하며, c)각 패킷 페이로드의 발생전에 상기 메모리의 어드레스 입력 포트에 지연되지 않은 어드레스가 접속되게 하고, 패킷 페이로드 및 관련 제어 신호의 발생시에 상기 어드레스 입력 포트에 대한 상기 지연되지 않은 어드레스의 접속을 지속하도록 상기 추가멀티플렉서를 조절하고, d)각 패킷 페이로드의 발생전에 상기 수의 어드레스 주기 동안 상기 메모리의 어드레스 입력 포트에 지연되지 않은 어드레스가 접속되고, 각 패킷의 발생시 및 관련 제어 신호의 부재시에 상기 수의 어드레스 주기 동안 상기 어드레스 입력 포트에 지연된 어드레스가 접속되며 그리고 나서 지연되지 않은 어드레스가 접속되도록 상기 추가 멀티플렉서를 조정하는 것을 특징으로 하는 수신장치.
  4. 제3항에 있어서, 수신된 신호의 무결성을 나타내는 상기 추가 데이타는 연속 패킷에 대해 소정의 정수씩 증가되는 값인 패깃 연속성 카운트 CC를 갖는 패킷, 헤더 데이타를 포함하며, 상기 검출 수단은 각 패킷의 연속성 카운트 CC가 적절한 시퀀스인지의 여부를 검출하여 연속성 카운트 CC가 적절한 시퀀스가 아닌 경우에 상기 제어 신호를 발생하는 회로를 포함하는 것을 특징으로 하는 수신 장치.
  5. 제4항에 있어서, 수신 신호의 무결성을 나타내는 상기 추가 데이타는 소정 패킷의 상태를 변화시키는 토글 비트를 상기 패킷 헤더 데이타에 포함시키며, 상기 검출 수단은 각 패킷의 연속성 카운트 CC가 적절한 시퀀스인지의 여부 및 연속 패킷의 토글 비트가 정확한 상태에 있는지의 여부를 검출하여 만일 그렇지 않다.면 상기 제어 신호를 발생하는 회롤포함하는 것을 특징으로 하는 수신 장치.
  6. 제1항에 있어서, 수신된 신호의 무결성을 나타내는 상기 추가 데이타는 연속 패킷에 대해 소정의 정수씩 증가되는 값인 패킷 연속성 카운트 CC를 갖는 패킷 에더 데이타를 포함하며, 상기 검출 수단은 각 패킷의 연속성 카운트고 적절한 시퀀스인지의 여부를 검출하여 연속성 카운트가 적절한 시퀀스가 아닌 경우에 상기 제어 신호를 발생하는 회로를 포함하는 것을 특징으로 하는 수신 장치.
  7. 제6항에 있어서, 수신 신호의 무결성을 나타내는 상기 추가 데이타는 소정 패깃의 상태고 변화시키는 토글 비트를 상기 패킷 헤더 데이타에 포함시키며, 상기 검출 수단은 각 패킷의 연속성카운트 CC가 적절한 시퀀스인지의 여부 및 연속 패킷의 토글 비트가 영구하고한 상태에 있는지의 여부를 검출하여 만일 그렇지 않다면 상기 제어 신호를 발생하는 회로를 포함하는 것을 특징으로 하는 수신 장치.
  8. 제7항에 있어서, 각 패깃의 연속성 카운트 CC만이 적절한 시퀀스가 아닌 경우에는 제1모드로 복구 동작을 개시하며, 각 패킷의 연속성 카운트 CC가 적절한 시퀀스가 아니고 토글 비트가 정확한 상태가 아닌 경우에는 제2모드로 복구 동작을 개시하는 장치를 포함하는 것을 특징으로 하는 수신 장치.
  9. 수신된 패킷 데이타의 무결성을 판별하는데 유용한 추가데이타와 신호 페이로드를 갖는 패킷을 포함한 패킷화된 데이타를 수신하여 압축 해제하고, 각 페이로드가 순차적으로 기억되며 데이타 손실이 검출된 경우 패킷 페뢰드의 앞에 매체 오류 코드가 삽입되는 메모리를 포함한 시스템에서 매체 오류쿄드를 삽입하는 방법에 있어서, 패킷 페이로드의 발생전에 M 내지 M+N의 메모리 어드레스 위치의 시퀀스로 상기 메모리에 매체 오류 코드를 기억하는 단계와(여기서 M와 N은 정수이며 N은 매체오류 코드를 기억하기 위해 요구된 어드레스 위치의 수):페이로드의 발생시에, 데이타 손실이 검출된다면 M+N+1 내지 M+N+K의 추가 연속메모리 위치로 상기 메모리에 상기 패킷 페이로드를 기억하는 단계와:데이타 손실이 검출된다면, 페이로드의 발생시에 M 내지 M+K의 메모리 위치로 상기 메모리에 상기 패킷 페이로드를 기억시킴으로써 상기 매체 오류코드를 오버라이팅하는 단계를 포함하는 것을 특징으로 하는 매체 오류 코드 삽입 방법(여기서 K는 각 페이로드를 기억하기 위해 요구된 메모리 어드레스 위치의 수).
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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