KR940017397A - 클럭 감시 회로 - Google Patents

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박형준
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이선훈
권환우
이충근
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Abstract

본 발명은 필릅플롭과 카운터를 이용하여 디지탈 회로팩 내부의 클럭이나 데이터 전송에 사용되어지는 송신 또는 수신 클럭의 정확한 감시를 통하여 클럭의 에러를 신속하게 감지하여 에러를 처리하므로서 장애 발생에 대한 파급 효과를 극소화 하는데 그 목적이 있다.
감시하고자 하는 클럭의 감시클럭 수신부, 카운터 리셋 발생기, 리셋 신호 수신기, 기준 클럭 수신기, 감시 카운터회로, NAND 논리수단, 출력유지 회로로 구성되어 클럭을 감시한다.
디지탈 전송장치나 통신 시스템에 사용되어지는 클럭의 에러유무를 사용자의 에러 카운터의 정의에 따라 에러 감지의 속도를 조정 가능하며, 수신부에서의 정확한 에러 감지가 신속하게 이루어져 클럭 장애에 대한 파급 효과를 극소화 하는데 효과가 있다.

Description

클럭 감시 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 전체 블럭도, 제2도는 본 발명의 실시예, 제3도는 본 발명의 실시예 타이밍도.

Claims (4)

  1. 감시하고자 하는 대상 클럭을 입력하는 감시클럭 수신기(1), 상기 감시클럭 수신기(1)에 연결된 카운터 리셋 발생기(4), 디지탈 회로팩의 초기화를 위하여 사용되는 리셋신호를 감시대상 클럭이나 기준클럭과 동시화시키기 위한 리셋 신호 수신기(2), 상기 카운터 리셋 발생기(4)와 상기 리셋 신호 수신기(2)에 연결되어 감시 대상 클럭을 감시하기 위해 감시 대상 클럭의 2배 이상인 기준클럭을 샘플링하여 카운팅하기 위한 감시 카운터 회로(5), 상기 감시 카운터 회로(5)에 연결되어 사용자가 클럭의 에러를 결정하기 위한 NAND 논리수단(7), 및 상기 NAND 논리수단(7)에 의해 출력되는 값을 감시클럭이 에러일 경우 계속 유지하기 위한 출력 유지 회로(6)를 구비하고 있는 것을 특징으로 하는 클럭 감시회로.
  2. 제1항에 있어서, 상기 감시 카운터 회로(5)와 상기 출력 유지 회로(6)에 연결된 기준 클럭 수신기(3)를 더 포함하고 있는 것을 특징으로 하는 클럭 감시회로.
  3. 제2항에 있어서, 상기 감시 클럭 수신기(1)의 프리셋 단자를 제어하도록 상기 카운터 리셋 발생기(4)의 출력을 반 주기마다 프리셋 단자를 제어하는 것을 특징으로 하는 클럭 감시회로.
  4. 제2항에 있어서, 상기 감시 카운터 회로(5)는 2비트 이상의 카운터 사용을 포함하되 감시 결과의 출력을 정상적인 클럭이 입력될때까지 유지하도록 하는 것을 특징으로 하는 클럭 감시회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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