KR940012155A - 공통 디바이스 액세스 장치 - Google Patents
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Abstract
본 발명은 복수의 입력신호들이 공통의 디바이스로 액세스하고자 할때 우선 순위없이 입력순서대로 액세스하는 것으로, 특히 플립플롭등과 같은 멀티포트억소자의 액세스에 대하여 허용순위 결정이 공평하도록 하기 위한 공통 디바이스 액세스 장치에 관한것이다.
복수의 입력신호들에 대하여 우선순위 없이 입력순서대로 래치시키고 이를 이전에 래치된 신호와 비교하여 현재의 입력신호에 대한 변화를 감지하여 비교된 값을 FIFO의 새로운 입력으로 인가한 다음 적절한 타이밍 제어에 따라 FIFO의 데이타를 출력부의 래치회로에서 순차적으로 읽어낸다.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 공통 디바이스 액세스 장치의 구성도.
Claims (1)
- 복수의 입력신호를 데이타 입력으로 하는 D플립플롭(101-10n), 복수의 D플립플롭 (101-10n)으로 부터 출력되는 복수의 데이타를 순차적으로 래치하기 위한 래치회로(20), 복수의 D플립플롭(101-10n)으로 부터 출력되는 신호와 순차적으로 래치되는 각 신호의 상태를 비교하는 비교기(30), 외부로 부터의 클럭(CLK) 입력에 따라 복수의 상기 D플립플롭(101-10n)의 래치가 되는 클럭을 발생하는 카운터(70), 외부로 부터의 클럭입력(CLK)이 인가됨에 따라 구동되고 상기 D플립플롭(101-10n)으로 부터의 출력을 FIFO(50)에 인가시키기 위한 버퍼(40), 비교기(30)에서 비교된 값을 새로운 입력으로 판단하여 라이트하는 FIFO(50), 상기 카운터(70)를 구동하고 상기 버퍼(40) 및 FIFO(50)에 데이타를 리드할 수 있는 기준신호를 제공하는 타이밍제어부(60), 이전의 입력신호에 대한 처리종료신호를 기준으로 하여 상기 FIFO(50)에 라이트된 데이타를 순차적으로 읽어내는 제2 래치회로(21)를 구비하는 것을 특징으로 하는 공룡 디바이스 액세스 장치.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019920022869A KR0139966B1 (ko) | 1992-11-30 | 1992-11-30 | 공통 디바이스 액세스 장치 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019920022869A KR0139966B1 (ko) | 1992-11-30 | 1992-11-30 | 공통 디바이스 액세스 장치 |
Publications (2)
Publication Number | Publication Date |
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KR940012155A true KR940012155A (ko) | 1994-06-22 |
KR0139966B1 KR0139966B1 (ko) | 1998-07-01 |
Family
ID=56800388
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019920022869A KR0139966B1 (ko) | 1992-11-30 | 1992-11-30 | 공통 디바이스 액세스 장치 |
Country Status (1)
Country | Link |
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KR (1) | KR0139966B1 (ko) |
-
1992
- 1992-11-30 KR KR1019920022869A patent/KR0139966B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR0139966B1 (ko) | 1998-07-01 |
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