KR940003555B1 - 영상 데이타 압축 시스템 - Google Patents

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KR940003555B1
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유병구
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주식회사 금성사
이헌조
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    • G11—INFORMATION STORAGE
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    • G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
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Abstract

내용 없음.

Description

영상 데이타 압축 시스템
제1도는 제이 피 이 지 알고리즘에 대한 기능 불록도.
제2도는 영상 압축/신장 프로세서의 블록도.
제3도는 일반적인 영상 압축/신장 프로세서의 응용 블록도.
제4도는 본 발명의 영상 데이타 압축 시스템에 대한 블록도.
제5도의 (a) 내지 (n)은 제4도 각부의 파형도.
* 도면의 주요부분에 대한 부호의 설명
21 : 영상 압축/신장 프로세서 22 : 스타트신호 발생부
23 : 어드레스 발생부 24 : 제어신호 발생부
25 : 래치 26 : 32/8비트 변환기
27 : 메모리 28 : 클럭신호 발생기
본 발명은 디지탈 브이 씨 알의 영상압축 기술에 관한 것으로, 특히 JPEG(Joint Photograpic Experts Group)의 영상 압축 권고안을 따르면서 실시간으로 영상데이타를 압축하는데 적당하도록 한 영상 데이타 압축시스템에 관한 것이다.
흑백이나 컬러 영상을 압축하는 국제 표준 JPEG의 베이스라인 시스템은 DCT(Discrete Cosine Transform)를 기본으로 하여 한 화소당 8비트로 구현된 영상을 압축하는 알고리즘으로 이 알고리즘은 제1도와 같이 3개의 기능 블록으로 구성된다.
입력 영상 데이타가 정 디씨티 수행부(1A)에 공급되어 리던던시(Redundency)가 제거된후, 양자화부(2A)에 공급되어 인간의 시각 특성에 최적이 되게 양자화되며, 다시 엔코더(3A)에 공급되어 양자화된 디씨티 계수의 엔트로피(Entropy)가 최소화된 압축데이타로 출력되고, 이렇게 압축된 데이타는 상기의 반대 과정을 통해 원래의 영상 데이터로 복원된다.
제2도는 영상 데이타를 압축/신장 프로세서(CL550)의 기능 블록도로서 피씨용으로 개발된 영상 데이타 압축/신장 프로세서(CL550)의 제어신호는 주로 피씨의 중앙처리장치에서 소프트웨어 처리되어 동작속도가 매우 느린 단점이 있다.
제3도는 일반적으로 사용되는 영상 데이타 압축/신장 프로세서(CL550)의 응용 블록도로서, 영상 입출력부(11)에서 NTSC등의 영상신호를 디지탈신호로 변환하여 브이 램(VRAM)이나 선입 선출기로 구성된 픽셀 버퍼(12)에 저장하고, 그 픽셀 버퍼(12)에서 출력되는 데이타는 라스터 라인 오더(Raster Line Order)에서 8×8블록 오더로 변환되어 영상 압축/신장 프로세서(CL550)(14)로 입력되어야 하는데, 이런 기능을 수행하기 위하여 8라인 이상의 영상 데이타를 저장할 수 있는 스트럽 버퍼(13)를 필요하며, 이는 보통 에스램(SRAM)으로 구성된다.
상기 8×8블록 오더로 입력된 영상데이타는 영상 압축/신장 프로세서(14)에서 압축되어 호스트 버스 인터페이스에 전송되며, 영상 압축/신장 프로세서(14)의 호스트 버스 인터페이스에 존재하는 압축 데이타는 중앙처리장치(15)와 호스트 버스 인터페이스의 핸드 쉐이크 데이타 변환제어 신호에 의해 메모리(16)로 전송되어 최종적으로 디스크(17)에 저장된다.
그러나 이와같은 종래의 시스템에 있어서는 영상 압축/신장 프로세서 내에서 압축되어 호스트 버스 인터페이스에 임시 저장된 압축 데이타는 중앙처리장치내의 소프트웨어 처리에 의해 메모리로 전송되는데 따른 시간이 많이 소요되어 실시간으로 영상 데이타 압축을 요하는 디지탈 브이 씨 알 등에 적용할 수 없게 되는 결함이 있었다.
본 발명은 이와 같은 종래의 결함을 해결하기 위하여 영상데이타를 실시간 처리로 압축할 수 있게 창안한 것으로, 이를 첨부한 도면에 의하여 상세히 설명한다.
제4도는 본 발명의 영상 데이타 압축 시스템에 대한 블록도로서 이에 도시한 바와 같이, 영상데이타를 압축/신장 처리하는 영상 압축/ 신장 프로세서(21)와, 상기 영상 압축/신장 프로세서(21)에 스타트신호를 공급하는 스타트신호 발생부(22)와, 상기 영상 압축/신장 프로세서(21)에 어드레스 신호를 공급하는 어드레스 발생부(23)와, 시스템 각부에 제어신호를 공급하는 제어신호 발생부(24)와, 상기 영상 압축/신장 프로세서(21)에 출력되는 압축 데이타를 래치하는 래치(25)와, 상기 래치(25)로부터 공급되는 32비트의 압축 데이타를 8비트로 변환하는 32/8비트 변환기(26)와, 상기 32/8비트 변환기(26)에 출력되는 8비트의 압축 데이타를 저장하는 메모리(27)와, 시스템 각부에 클럭신호를 공급하는 클럭신호 발생기(28)로 구성한 것으로, 이와 같이 구성한 본 발명의 작용 및 효과를 첨부한 제5도를 참조하여 상세히 설명하면 다음과 같다.
영상 압축/신장 프로세서(21)에서 압축되어 호스트버스 인터페이스에 임시 저장된 데이타는 핸드쉐이크(Handshake)규약에 의해 메모리(27)로 전송되는 특징이 있다.
즉, 영상 압축/신장 프로세서(21)는 외부로부터 공급받은 스타트신호(ST)에 반응하여 압축된 데이타(D)를 데이타 버스(내부적으로는 코덱 레지스터)에 로딩시킨후, 인지신호를 외부 회로에 송출하여 유효 데이타(D)가 준비되어 있음을 알려주고, 이때 외부 회로는 압축된 데이타(D)를 래치하여 메모리(27)에 저장함으로써 한 단위의 전송을 완료한다.
이와 같이 스타트 신호(ST)로 시작되어 인지신호로 종료되는 단위 전송을 반복하여 압축된 데이타(D)가 메모리(27)에 전송되는 것으로 이의 처리 과정을 설명하면 하기와 같다.
먼저, 스타트신호 발생부(22)는 영상 압축/신장 프로세서(21)내부에서 메모리(27)로 전송할 압축 데이타(D)가 준비되어 있음을 알려주는 데이타 요구신호(DRQ)와, 제어신호 발생부(24)에서 메모리(27)로 출력되는 라이트 인에이블신호(WEN)를 공급받는다.
스타트신호(ST)는 데이타 요구신호(DRQ)가 로우이고, 라이트인에이블신호(WEN)가 로우일때 한 클럭주기의 로우신호 형태를 갖게 된다.
그리고 제어신호 발생부(24)에서는 스타트신호(ST)가 로우인 상태에서 타이밍 신호(TM1), (TM2)가 모두 하이가 되도록하며, 어드레스 발생부(23)부에서는 영상 압축/신장 프로세서(21) 내부에서 압축데이타를 임시저장하고 있는 코덱 레지스터(Codec Register)의 어드레스 K값(0000H)을 발생시킨다.
한편, 영상 압축/신장 프로세서(21)는 스타트신호(ST)에 반응하여 호스트버스 출력신호(HBOUT)를 제5도의 (마)와 같이 타이밍의 로우로 출력하게 되고, 이때, 32비트의 압축된 데이타가 영상 압축/신장 프로세서(21)로부터 출력되어 래치(25)에 래치 된다.
상기 래치(25)에서는 제어신호 발생부(24)로부터 입력되는 래치클럭신호(CLK)로 데이타(D)를 래치하여 32/8비트 변환기(26)로 출력하고, 그 32/8비트 변환기(26)에서는 32비트의 입력 데이타를 8비트 단위로 멀티플렉싱하여 메모리(27)로 출력한다.
상기 32/8비트 변환기(26)에서 멀티플렉싱을 하기 위해 필요로 하는 선택신호(SEL1), (SEL2)는 제5도와 같은 타이밍으로 제어신호 발생부(24)로부터 공급받는다.
상기 메모리(17)로 입력되는 8비트 데이타는 제어신호 발생부(24)에 출력되는 라이트 인에블신호(WE)와 라이트 리세트신호(WRE), 클럭신호 발생부(28)에 출력되는 클럭신호(CLK)에 의해 라이트된다.
이상에서 상세히 설명한 바와같이 본 발명은 영상 압축/신장 프로세서에서 압축되어 출력되는 데이타를 간단히 하드웨어 로직으로 메모리에 전송함으로서 영상 압축/신장 프로세서를 디지탈 브이 씨 알과 같은 실시간 처리를 필요로하는 시스템에 적용시킬 수 있는 잇점이 있다.

Claims (1)

  1. 영상데이타를 압축/신장 처리하는 영상 압축/신장 프로세서(21)와, 상기 영상 압축/신장 프로세서(21)에 스타트신호를 공급하는 스타트신호 발생부(22)와, 상기 영상 압축/신장 프로세서(21)에 어드레스 신호를 공급하는 어드레스 발생부(23)와, 시스템 각부에 제어신호를 공급하는 제어신호 발생부(24)와, 상기 영상 압축/신장 프로세서(21) 래치(25)에 출력되는 압축 데이타를 래치하는 래치(25)와, 상기 래치(25)로부터 공급되는 32비트의 압축 데이타를 8비트로 변환하는 32/8비트 변환기(26)와, 상기 32/8비트 변환기(26)에 출력되는 8비트의 압축 데이타를 저장하는 메모리(27)와, 시스템 각부에 클럭신호를 공급하는 클럭신호 발생기(28)로 구성한 것을 특징으로 하는 영상 데이타 압축 시스템.
KR1019920002686A 1992-02-21 1992-02-21 영상 데이타 압축 시스템 KR940003555B1 (ko)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN1094699C (zh) * 1995-10-21 2002-11-20 三星电子株式会社 数据压缩和扩展的存储器控制设备
US7088651B2 (en) 2001-12-04 2006-08-08 Samsung Electronics Co., Ltd. Method and apparatus for detecting land pre-pit address information recorded on optical disc

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