KR930018742A - Mosfet의 제조방법 - Google Patents

Mosfet의 제조방법 Download PDF

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KR930018742A
KR930018742A KR1019920001925A KR920001925A KR930018742A KR 930018742 A KR930018742 A KR 930018742A KR 1019920001925 A KR1019920001925 A KR 1019920001925A KR 920001925 A KR920001925 A KR 920001925A KR 930018742 A KR930018742 A KR 930018742A
Authority
KR
South Korea
Prior art keywords
forming
gate electrode
photoresist pattern
photoresist
silicon substrate
Prior art date
Application number
KR1019920001925A
Other languages
English (en)
Inventor
황준
박상훈
손희창
김학렬
Original Assignee
정몽헌
현대전자산업 주식회사
Filing date
Publication date
Application filed by 정몽헌, 현대전자산업 주식회사 filed Critical 정몽헌
Publication of KR930018742A publication Critical patent/KR930018742A/ko

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Abstract

본 발명은 MOSFET의 제조방법에 관한 것으로 실리콘 기판 상부에 게이트 산화막, 전도층, 감광막을 적층하고, 포토공정으로 게이트 전극용 감광막 패턴을 형성하고, 노출된 전도층을 제거하여 게이트 전극을 형성하는 단계와, 상기 감광막 패턴을 플로우시켜 게이트전극 측면에 감광막 스페이서를 형성하는 단계와, 고농도 불순물을 실리콘 기판으로 이온주입하여 소오스 및 드레인을 형성하는 단계와, 상기 감광막 스페이서를 제거한 후 저농도 불순물을 실리콘 기판으로 이온주입하여 LDD를 형성하는 단계로 이루어지는 기술이다.

Description

MOSFET의 제조방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제2a도 내지 제2c도는 본 발명의 제1실시예에 의해 MOSFET를 제조하는 단계를 도시한 단면도.
제3a도 내지 제3e도는 본 발명 제2실시예에 의해 MOSFET를 제조하는 단계를 도시한 단면도.

Claims (4)

  1. MOSFET의 제조방법에 있어서, 실리콘 기판 상부에 게이트 산화막, 전도층, 감광막을 적층하고, 포토공정으로 게이트 전극용 감광막 패턴을 형성하고, 노출된 전도층을 제거하여 게이트 전극을 형성하는 단계와, 상기 감광막 패턴을 플로우시켜 게이트전극 측면에 감광막 스페이서를 형성하는 단계와, 고농도 불순물을 실리콘 기판으로 이온주입하여 소오스 및 드레인을 형성하는 단계와, 상기 감광막 스페이서를 제거한 후 저농도 불순물을 실리콘 기판으로 이온주입하여 LDD를 형성하는 단계로 이루어지는 것을 특징으로 하는 MOSFET의 제조방법.
  2. 제1항에 있어서, 상기 감광막 스페이서를 형성하는 것을 핫플레이트 오븐에서 예정된 온도 및 예정된 시간을 유지시켜 감광막 패턴의 일부가 게이트전극 측면에 플로우되도록 하는 것을 특징으로 하는 MOSFET의 제조방법.
  3. CMOS 제조방법에 있어서, 실리콘 기판의 예정된 부분에 필드산화막을 형성하고, 노출된 실리콘 기판에 게이트 산화막, 전도층, 감광막을 적층하는 단계와, 포토공정으로 감광막 패턴을 형성하고, 노출된 전도층을 제거하여 게이트 전극을 형성하고, 감광막 패턴을 플로우시켜 게이트전극 측면에 감광막 스페이서를 형성하는 단계와, 예정된 PMOS 트랜지스터 상부에 감광막 패턴을 형성하고, 노출된 NMOS 트랜지스터의 시리콘 기판에 고농도 N형 불순물을 이온주입하여 소오스 및 드레인을 형성하는 단계와, 상기 감광막 패턴, 게이트전극 상부의 감광막 패턴 및 게이트전극 측면의 감광막 스페이서를 제거하고, 저농도 N형 불순물을 이온주입하여 LDD를 형성하는 단계와, 예정된 NMOS 트랜지스터 상부에 감광막 패턴을 형성하고, 노출된 PMOS 트랜지스터의 실리콘 기판에 고농도 P형 불순물을 이온주입하여 소오스 및 드레인을 형성하는 단계로 이루어지는 것을 특징으로 하는 CMOS 트랜지스터 제조방법.
  4. 제3항에 있어서, 상기 감광막 스페이서를 형성하는 것을 핫 플레이트 오븐에서 예정된 온도 및 예정된 시간을 유지시켜 감광막 패턴의 일부가 게이트 전극 측면에 플로우되도록 하는 것을 특징으로 하는 CMOS 트랜지스터의 제조방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019920001925A 1992-02-11 Mosfet의 제조방법 KR930018742A (ko)

Publications (1)

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KR930018742A true KR930018742A (ko) 1993-09-22

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100328690B1 (ko) * 1995-12-30 2002-11-08 주식회사 하이닉스반도체 반도체 소자의 접합 형성방법

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100328690B1 (ko) * 1995-12-30 2002-11-08 주식회사 하이닉스반도체 반도체 소자의 접합 형성방법

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