KR930015351A - 배럴시프터 - Google Patents

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KR930015351A
KR930015351A KR1019920024275A KR920024275A KR930015351A KR 930015351 A KR930015351 A KR 930015351A KR 1019920024275 A KR1019920024275 A KR 1019920024275A KR 920024275 A KR920024275 A KR 920024275A KR 930015351 A KR930015351 A KR 930015351A
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KR
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shift
cell
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shift unit
predetermined amount
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가즈유키 오모테
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사토 후미오
가부시키가이샤 도시바
오카모토 세이시
도시바 마이크로 일렉트로닉스 가부시키가이샤
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Abstract

본 발명은 구성의 소형화와 시프트처리에 있어서 데이터 배열조정의 간단화 및 처리속도를 향상시킬 수 있도록 하기 위한 것이다.
본 발명은 제1시프트 제어신호에 따라 입력데이터를 소정량 시프트하는 좌측 시프트셀과, 이 좌측 시프트셀에 연결되면서 제2시프트 제어 신호에 따라 상기 좌측 시프트셀은 독립적으로 입력데이터를 소정량 시프트하여 시프트아웃되는 데이터를 상기 좌측 시프트셀에 시프트인하는 우측 시프트셀로 이루어진 시프트셀을 적어도 1개 이상 포함하는 시프트 셀이 종속접속되어 입력데이터를 복수 비트 시프트하는 셀어레이를 구비하여 구성된 것을 특징으로 한다.

Description

배럴시프터
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 1실시예에 따른 배럴시프터의 구성을 나타낸 도면,
제2도는 제1도에 나타낸 배럴시프터에서의 시프트동작을 나타낸 도면,
제3도는 제1도에 나타낸 배럴시프터에서의 시프트동작을 나타낸 도면.

Claims (1)

  1. 제1시프트 제어신호에 따라 입력데이터를 소정량 시프트하는 제1시프트부(2aL,2bL,2cL)와, 이 제1시프트부(2aL,2bL,2cL)에 연결되면서 제2시프트 제어신호에 따라 상기 제1시프트부(2aL,2bL,2cL)와 독립적으로 입력데이터를 소정량 시프트하여 시프트아웃되는 데이터를 상기 제1시프트부(2aL,2bL,2cL)에 시프트인 하는 제2시프트부(2aR,2bR,2cR)로 이루어진 시프트셀을 적어도 1개 이상 포함하는 시프트셀이 종속접속되어 입력데이터를 복수비트 시프트하는 셀어레이(2)를 구비하여 구성된 것을 특징으로 하는 배열시프터.
    ※ 참고사항 : 최초출원 내용에 의하여 공개되는 것임.
KR1019920024275A 1991-12-16 1992-12-15 배럴시프터 KR960005102B1 (ko)

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JP3332143A JPH05165602A (ja) 1991-12-16 1991-12-16 バレルシフタ
JP91-332143 1996-04-20

Publications (2)

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KR930015351A true KR930015351A (ko) 1993-07-24
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ID=18251625

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KR1019920024275A KR960005102B1 (ko) 1991-12-16 1992-12-15 배럴시프터

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Families Citing this family (15)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5822231A (en) * 1996-10-31 1998-10-13 Samsung Electronics Co., Ltd. Ternary based shifter that supports multiple data types for shift functions
US5995579A (en) * 1996-12-19 1999-11-30 Vlsi Technology, Inc. Barrel shifter, circuit and method of manipulating a bit pattern
US6078937A (en) * 1996-12-19 2000-06-20 Vlsi Technology, Inc. Barrel shifter, circuit and method of manipulating a bit pattern
TW374885B (en) * 1997-06-06 1999-11-21 Matsushita Electric Ind Co Ltd The arithmetic unit
US6035310A (en) * 1997-12-19 2000-03-07 Advanced Micro Devices, Inc. Method and circuit for performing a shift arithmetic right operation
US5991786A (en) * 1997-12-19 1999-11-23 Advanced Micro Devices, Inc. Circuit and method for shifting or rotating operands of multiple size
US6006244A (en) * 1997-12-19 1999-12-21 Advanced Micro Devices, Inc. Circuit for shifting or rotating operands of multiple size
US6122651A (en) * 1998-04-08 2000-09-19 Advanced Micro Devices, Inc. Method and apparatus for performing overshifted rotate through carry instructions by shifting in opposite directions
US6393446B1 (en) * 1999-06-30 2002-05-21 International Business Machines Corporation 32-bit and 64-bit dual mode rotator
US6675181B1 (en) * 1999-12-23 2004-01-06 Ati International, Srl Method and apparatus for determining a byte select vector for a crossbar shifter
US6675182B1 (en) * 2000-08-25 2004-01-06 International Business Machines Corporation Method and apparatus for performing rotate operations using cascaded multiplexers
DE10051243A1 (de) * 2000-10-17 2002-04-25 Philips Corp Intellectual Pty Verfahren zum Auswählen (puncturing) von Datenbits
US20060031272A1 (en) * 2004-08-05 2006-02-09 International Business Machines Corporation Alignment shifter supporting multiple precisions
CN101782843B (zh) * 2009-01-20 2012-05-30 雷凌科技股份有限公司 桶式移位器的分解方法及分解电路和其控制方法
JP5433621B2 (ja) * 2011-04-11 2014-03-05 株式会社東芝 ハッシュ関数演算装置及び演算プログラム

Family Cites Families (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS58184649A (ja) * 1982-04-22 1983-10-28 Toshiba Corp シフト回路
JPS6428752A (en) * 1987-07-24 1989-01-31 Toshiba Corp Data processor
JPH0823809B2 (ja) * 1990-01-22 1996-03-06 株式会社東芝 バレルシフタ

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US5671166A (en) 1997-09-23
JPH05165602A (ja) 1993-07-02
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