KR930006537A - 고속 데이타처리 시스템의 그래픽처리 서브 시스템 - Google Patents

고속 데이타처리 시스템의 그래픽처리 서브 시스템 Download PDF

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KR930006537A
KR930006537A KR1019910017098A KR910017098A KR930006537A KR 930006537 A KR930006537 A KR 930006537A KR 1019910017098 A KR1019910017098 A KR 1019910017098A KR 910017098 A KR910017098 A KR 910017098A KR 930006537 A KR930006537 A KR 930006537A
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Inventor
이명한
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정용문
삼성전자 주식회사
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    • G—PHYSICS
    • G06—COMPUTING; CALCULATING OR COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
    • G06F3/14—Digital output to display device ; Cooperation and interconnection of the display device with other functional units
    • G06F3/153—Digital output to display device ; Cooperation and interconnection of the display device with other functional units using cathode-ray tubes

Abstract

본 발명은 고속데이타 처리시스템(high speed data processing system)의 그래픽처리 서브시스템9graphics processing sub system)에 관한 것이다.
본 발명은 소정의 클럭신호를 발생시키는 클럭발생부(60)와, 프레임버퍼(40) 및 영상신호변환부(50)를 제어하는 타이밍제어부(70)와, 그래픽처리수행명령들 및 관련 데이터를 저장하는 메모리(80)와, 적어도 하나의 그래픽 전용 프로세서(90)와, 상기 그래픽전용프로세서(90)로 입,출력되는 데이터의 일부를 일시 저장하는 버퍼(100)로 구성된다.
본 발명의 프레임버퍼(40)는 더블버퍼링(double buffering) 기능 및 오버레이(overlay) 기능을 지원할 수 있도록 구성되고, 영상신호변환부(50)는 프레임버퍼(40)로부터 입력되는 3가지의 R. G. B 신호들을 각각 받아들여서 아날로그 영상신호로 변환하여 화면(CRT)에 출력하는 3개의 RAMDAC(51, 52, 53)으로 구성되기 때문에 실물과 같은 풍부한 색상을 나타낼 수 있을뿐만 아니라 움직이는 물체를 자연스럽게 표시할 수 있고 주밍(zooming), 패닝(panning) 및 오버레이(overlay) 기능을 향상시켜 준다.

Description

고속 데이터처리 시스템의 그래픽처리 서브 시스템
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 의한 그래픽처리서브시스템의 블록도
제2도는 제1도의 프레임버퍼(40)의 구성도
제3도는 제1도의 영상신호변환부(50)의 상세회로도

Claims (1)

  1. 시스템버스(10)에 연결된 고속의 호스트프로세서(20)와, 상기 시스템버스(10)에 연결되어 상기 호스트프로세서(20)와 인터페이스기능을 수행하는 호스트인터페이스부(30)와, 화면에 표시하려는 영상과 관련된 화소데이타를 저장하는 프레임버퍼(40)와, 상기 프레임버퍼(40)에 저장된 상기 화소데이타를R. G. B 영상신호를 변환하여 출력하는 영상신호변환부(50)로 구성된 고속데이타처리시스템의 그래픽처리서브시스템에 있어서, 소정의 클럭신호를 발생시키는 클럭발생부(60)와, 상기 클럭발생부(60)의 출력을 소정의 신호들로 분자시켜 상기 프레임버퍼(40) 및 상기 영상신호변환부를 제어하는 타이밍제어부(70)와, 상기 호스트프로세서로부터 전달되는 그래픽처리수행명령들 및 관련 데이타를 저장하는 메모리(80)와, 상기 클럭발생부(60)의 상기 출력에 의해 동기되어 상기 메모리(80)를 엑세스하여 상기 호스트프로세서(20)로부터 전달된 명령들에 상응하는 그래픽처리동작들을 수행하는 적어도 하나의 그래픽전용프로세서(90)와, 상기 그래픽전용프로세서(90)로 입,출력되는 데이터의 일부를 일시 저장하는 버퍼(100)를 포함하되, 상기 프레임버퍼(40)는 더블버퍼링기능 및 오버레이기능을 수행하도록 메모리영역이 할당되고, 상기 영상신호변환부(50)는 상기 프레임버퍼(40)로부터 입력되는 3가지의 R. G. B신호들을 각각 받아들여서 화면에 출력되는 3개의 RAMDAC(51, 52, 53)으로 구성되는 것을 특징으로 하는 고속데이타 처리시스템의 그래픽처리 서브시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910017098A 1991-09-30 1991-09-30 고속데이타 처리시스템의 그래픽 처리 서브시스템 KR100228265B1 (ko)

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KR100602411B1 (ko) 2004-08-31 2006-07-20 주식회사 렛스비전 단일 버퍼 구조의 메모리 어드레스 제어방법

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