KR920017503A - 2.5MHz 색도 위상동기 루프(PLL)로부터 재생클럭을 발생시키기 위한 방법 및 장치 - Google Patents
2.5MHz 색도 위상동기 루프(PLL)로부터 재생클럭을 발생시키기 위한 방법 및 장치 Download PDFInfo
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Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 블록 다이어그램 형태의 실시예.
제2도는 본 발명에 따른 다이어그램 형태의 또 하나의 실시예.
제3-5도는 본 발명의 이해를 돕기위한 보조 그래프 도면이다.
Claims (18)
- 제1주파수를 갖고 있는 기준 신호원을 갖는 비디오 시그날 프로세싱 시스템을 구비한 비디오 레코더에 있어서, 상기 기준신호원과 연결된 입력과 제2주파수 신호를 제공하기 위한 출력을 갖고 있으며, 상기 제2주파수는 상기 제1주파수의 정수배인 제1주파수 배율회로; 상기 제1주파수 배율회로의 상기 출력과 연결된 입력, 출력 그리고 상기 제2주파수를 갖는 신호의 전송을 촉진시키는 응답 특성을 갖고 있는 필터 장치; 그리고 상기 필터 장치의 상기 출력에 연결된 입력을 갖고 있으며 소정의 출력을 갖고 있는 제2주파수 배율회로로 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제1항에 있어서, 상기 제2주파수 배율회로는 그의 출력에 제2주파수의 정수배인 제3주파수를 발생하도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제2항에 있어서, 상기 제1주파수의 배율회로, 제2주파수 배율회로가 각각 평형 변조기를 갖고 있도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제3항에 있어서, 상기 필터 장치가 대역필터를 갖고 있도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제3항에 있어서, 상기 필터 장치가 저역필터를 갖고 있도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제4항에 있어서, 상기 제1주파수와 상기 제2주파수의 비율이 1 : 2가 되도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제6항에 있어서, 상기 제2주파수와 상기 제3주파수의 비율이 1 : 2가 되도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제1주파수 2.517MHz의 기준신호원을 갖고 있는 비디오 시그날 프로세싱 시스템을 구비한 비디오 카세트 레코더(VCR)에 있어서, 상기 기준신호원과 연결된 입력과, 상기 제1주파수의 두배인 제2주파수를 갖고 있는 성분을 포함하는 신호를 제공하기 위한 출력을 갖고 있는 제1주파수 배율회로; 상기 제1주파수 배율회로의 상기 출력과 연결된 입력과, 출력을 가지며 상기 제2주파수에서 실질적으로 피크 응답 특성을 갖고 있는 대역필터 장치; 그리고 상기 대역 필터의 상기 출력과 연결된 입력과, 제2주파수의 두배인 제3주파수를 갖는 성분을 포함하는 신호를 제공하기 위한 출력을 갖고 있는 평형 변조기의 제2주파수 배율회로로 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제8항에 있어서, 상기 제3주파수 성분은 VCR에서의 재생클럭 신호이도록 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제1타임지터를 나타내는 경향이 있는 제1주파수의 기준신호선을 갖는 비디오 테이프 레코딩 시스템에 있어서, 상기 기준신호원에 연결된 입력과, 상기 제1주파수의 정수배인 제2주파수 신호를 제공하며, 상기 제1타임지터와 관련된 제2타임지터를 나타내기 위한 출력을 갖고 있는 제1주파수 배율회로; 상기 제1주파수 배율회로의 상기 출력에 연결된 입력과, 출력을 가지며, 제2주파수를 갖는 신호의 전송을 촉진시키는 응답 특성을 갖고 있는 필터 장치; 그리고 상기 필터 장치의 상기 출력과 연결된 입력을 가지며, 상기 제1타임지터와 관련된 제3타임지터를 보이는 제3주파수 출력신호를 갖는 제2주파수 배율회로로 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제10항에 있어서, 상기 제2주파수는 상기 제1부파수의 두배이며 상기 제3주파수는 상기 제2주파수의 두배이도록 구성됨을 특징으로 하는 클럭발생 회로.
- 제11항에 있어서, 상기 제1주파수는 수평동기 주파수의 정수배이도록 구성됨을 특징으로 하는 클럭신호발생 회로.
- 제12항에 있어서, 상기 제1주파수는 수평동기 주파수의 160배이며 상기 제3주파수는 수평동기 주파수의 640배이도록 구성됨을 특징으로 하는 클럭발생 회로.
- 제13항에 있어서, 상기 제1주파수는 약 2.517MHz이며 상기 제3주파수는 거의 10.07MHz이도록 구성됨을 특징으로 하는 클럭발생 회로.
- 제1지터시간을 보이고 약 2.517MHz주파수의 기준신호원을 갖는 비디오 시그날 프로세싱 시스템을 구비한 비디오 테이프 레코딩 시스템에 있어서, 상기 기준신호원에 연결된 입력을 갖고 있고 제2주파수의 제1출력신호를 제공하기 위한 출력을 갖고 있으며, 상기 제2주파수는 상기 제1타임지터와 관련된 제2타임지터를 나타내는 제1주파수 배율회로; 상기 제1주파수 배율회로의 상기 출력과 연결된 입력을 갖고, 출력을 갖고 있으며 상기 제2주파수를 갖는 신호의 전송을 촉진시키는 응답 특성을 갖고 있는 필터 장치; 상기 필터 장치의 출력과 연결된 입력을 갖고 있으며 상게 제2주파수의 두배인 제2출력 신호를 제공하고 상기 제1타임지터와 관련되어 제3타임지터를 나타내기 위한 출력을 갖고 제2주파수 배율회로; 그리고 상기 제2출력 신호가 클럭신호로써 A/D변환기에 가해지기 위한 출력을 갖는 A/D변환기로 구성됨을 특징으로 하는 클럭신호 발생회로.
- 제15항에 있어서, 상기 A/D변환기의 출력이 시축교정장치의입력에 가해지기 위해 제공되도록 구성됨을 특징으로 하는 클럭신호발생 회로.
- 제15항에 있어서, 시축교정 장치를 포함하여 이 회로내에서 상기 A/D변환기의 출력이 상기 시축교정 장치의 입력에 인가되도록 구성됨을 특징으로 하는 클럭신호발생 회로.
- 제1주파수의 기준신호원을 갖고 있는 비디오 시그날 프로세싱 시스템을 구비한 비디오 레코더에 있어서, 상기 제1주파수의 정배수인 제2주파수의 신호를 제공하기 위하여 제1주파수 배율회로에 기준신호를 인가하며; 상기 제2주파수의 상기 신호를 상기 제2주파수를 갖고 있는 신호의 전송을 촉진시키는 응답 특성을 갖고 있는 필터 장치에 인가하며; 그리고 상기 필터 장치의 출력을 제2주파수의 배율회로에 인가하는 단계를 구비함을 특징으로 하는 클럭 시그날을 발생시키는 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US07/607,709 US5097347A (en) | 1990-11-01 | 1990-11-01 | Method and apparatus for generating a playback clock from a 2.5 MHz chroma PLL |
| US07/607,709 | 1990-11-01 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR920017503A true KR920017503A (ko) | 1992-09-26 |
Family
ID=24433374
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019910003388A KR920017503A (ko) | 1990-11-01 | 1991-02-28 | 2.5MHz 색도 위상동기 루프(PLL)로부터 재생클럭을 발생시키기 위한 방법 및 장치 |
Country Status (2)
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| KR (1) | KR920017503A (ko) |
Families Citing this family (1)
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|---|---|---|---|---|
| US10749473B2 (en) * | 2017-12-20 | 2020-08-18 | Globalfoundries Inc. | Methods, apparatus, and system for a frequency doubler for a millimeter wave device |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6436186A (en) * | 1987-07-30 | 1989-02-07 | Mitsubishi Electric Corp | Low frequency chrominance signal converter |
| US4930005A (en) * | 1987-12-18 | 1990-05-29 | Victor Company Of Japan, Ltd. | Circuit for removing crosstalk components in a carrier chrominance signal |
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1990
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1991
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Also Published As
| Publication number | Publication date |
|---|---|
| US5097347A (en) | 1992-03-17 |
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