KR910012964A - 인터럽트 버스의 중재 방법 - Google Patents
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Abstract
내용 없음.
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 구성을 나타낸 블럭도,
제2도의 (가)는 본 발명의 인터럽트 아비터의 구성을 나타낸 블럭도,
(나)는 본 발명의 1비트 아비터의 회로도.
Claims (3)
- 여러개의 프로세서가 여러개의 메모리를 공유하는 다중처리기 시스템에서, 인터럽트 동기신호 구동 및 수신기(8)를 통하여 인터럽트 버스 동기신호(IBSYNC)를 받는 인터럽트 요청기(5)와, 인터럽트 요청기(5)의 인터럽트 요청에 의해 두인터럽트 처리기(3), (4)중 하나를 선택하는 인터럽트 아비터(7)로 구성하여 인터럽트 요청이 있는 경우에 우선 순위의 결정에 따라 내부의 높은 자리의 1비트 아비터부터 차례로 구동하면서 인터럽트 버스(6)의 사용을 위한 중재를 수행하도록 한 인터럽트 버스의 중재방법.
- 제1항에 있어서, 인터럽트 아비터(7)은 중재정보(Arbitation)와 요청신호(request)가 입력되어 NAMD게이트(N1)로는 인터럽트 처리기(3), (4)로 중재정보(Arbitation)가 출력되면서 인버터(I1)(I2)와 NAND게이트(N2)및 AND게이트(A)를 거쳐가는 다음 1비트아비터의 입력단(req)으로 중재 성공 신호(WIN)로 출력되도록 한 인터럽트 버스의 중재 방법.
- 제1항에 있어서, 인터럽트 아비터(7)의 마지막 1비트 이비터(12n)의 중재 성공 신호(WIN)는 인터럽트 요청기(5)로 입력되도록 하여 마지막 1비트아비터(12n)까지 구동을 수행한 경우에는 중재에 성공하였음을 알수 있도록 한 인터럽트 버스의 중재 방법.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019890019308A KR920000480B1 (ko) | 1989-12-22 | 1989-12-22 | 인터럽트 버스의 중재 방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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KR1019890019308A KR920000480B1 (ko) | 1989-12-22 | 1989-12-22 | 인터럽트 버스의 중재 방법 |
Publications (2)
Publication Number | Publication Date |
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KR910012964A true KR910012964A (ko) | 1991-08-08 |
KR920000480B1 KR920000480B1 (ko) | 1992-01-14 |
Family
ID=19293463
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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KR1019890019308A KR920000480B1 (ko) | 1989-12-22 | 1989-12-22 | 인터럽트 버스의 중재 방법 |
Country Status (1)
Country | Link |
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KR (1) | KR920000480B1 (ko) |
-
1989
- 1989-12-22 KR KR1019890019308A patent/KR920000480B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR920000480B1 (ko) | 1992-01-14 |
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