KR910005710A - 타임 스위치 - Google Patents

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KR910005710A
KR910005710A KR1019890011511A KR890011511A KR910005710A KR 910005710 A KR910005710 A KR 910005710A KR 1019890011511 A KR1019890011511 A KR 1019890011511A KR 890011511 A KR890011511 A KR 890011511A KR 910005710 A KR910005710 A KR 910005710A
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KR
South Korea
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time switch
address
terminal
dual port
srams
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KR1019890011511A
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Inventor
오돈성
강구홍
박권철
Original Assignee
경상현
재단법인 한국전자통신연구소
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Publication date
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    • H—ELECTRICITY
    • H04—ELECTRIC COMMUNICATION TECHNIQUE
    • H04Q—SELECTING
    • H04Q11/00—Selecting arrangements for multiplex systems
    • H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing

Landscapes

  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)

Abstract

내용 없음

Description

타임 스위치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 회로도.
제2도는 메모리소자.

Claims (5)

  1. 디지틀 교환 시스템에서 타임 슬롯을 교환하기 위한 타임 스위치에 있어서, 음성 정보의 데이타를 타임 슬롯 단위로 해당 어드레스를 기억하기 위해 어드레스 모듈(AL,AR)를 갖추고 있는 제1, 제2이중 포트 SRAM(1,2), 상기 제1, 제2이중 포트 SRAM(1,2)의 어드레스 모듈(AR) 단자에 읽기 어드레스를 제공하는 제어 메모리(3), 및 상기 제1, 제2이중 포트 SRAM(1,2)의 어드레스 모듈, (AL) 단자에 쓰기 어드레스를 제공하는 타이밍회로(4)로 구성되어 있는 것을 특징으로 하는 타임 스위치.
  2. 제1항에 있어서, 상기 타이밍 회로(4)로 부터 상기 어드레스 모듈 단자(AL)로 공급되는 클럭은 8.192KHz의 속도를 갖고 있는 것을 특징으로 하는 타임 스위치/.
  3. 제1항에 있어서, 상기 SRAM(1,2)의 용량은 각각 2K인 것을 특징으로 하는 타임 스위치.
  4. 제1항에 있어서, 상기 SRAM(1,2)으로 입출력되는 데이타를 래치 하기 위한 래치수단(5,6,7)을 더 포함하고 있는 것을 특징으로 하는 타임 스위치.
  5. 제1항에 있어서, 상기 SRAM(1,2)에서 데이타 쓰기와 읽기는 순차적으로 쓰고 램덤하게 읽어내는 방식에 의해 이루어지는 것을 특징으로 하는 타임 스위치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019890011511A 1989-08-12 1989-08-12 타임 스위치 KR920001858B1 (ko)

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