KR880011597A - 진폭 및 시간검정을 사용하는 펄스검출회로 및 방법 - Google Patents

진폭 및 시간검정을 사용하는 펄스검출회로 및 방법 Download PDF

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KR880011597A KR1019880002866A KR880002866A KR880011597A KR 880011597 A KR880011597 A KR 880011597A KR 1019880002866 A KR1019880002866 A KR 1019880002866A KR 880002866 A KR880002866 A KR 880002866A KR 880011597 A KR880011597 A KR 880011597A
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Abstract

내용 없음

Description

진폭 및 시간검정을 사용하는 펄스검출회로 및 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 종래의 진폭 검정을 사용하는 펄스검출회로의 개통도.
제2도는 진폭과 시간 검정을 사용하는 본 발명의 양호한 실시예의 개통도.

Claims (9)

  1. 입력신호내의 피이크들을 검출하고 또한 피이크가 검출될 때 피이크 검출신호를 발생기키기위한 수단과, 상기 입력신호를 임계치 레벨과 비교하기 위한 수단과, 피이크가 상기 임계치 레벨위에서 검출될 때 검정받은 피이크 출력신호를 발생시키기 위해 검출용 상기 수단과 비교용 상기 수단에 결합되는 수단과, 그리고 예정된 시간 기간내에 단일의 검정받은 피이크 출력신호만이 허용되도록 검정받은 피이크 출력신호를 발생기키기 위한 상기 수단에 결합되는 수단을 포함하는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  2. 제1항에서, 피이크들을 검출하기 위한 상기 수단은 상기 입력신호를 수신하도록 결합되는 미분기와, 상기 미분기의 출력에 결합되는 0교차 비교기를 포함하며, 상기 비교기의 출력은 상기 피이크 검출신호를 발생기키는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  3. 제2항에서, 상기 입력신호는 제1 및 제2입력라인들 양단에 결합되는 차동신호이며 또한 비교용 상기 수단은 상기 입력 라인들중 첫 번째 것에 결합되는 제1입력과 제1임계전압에 결합되는 제2입력을 갖는 음의 임계치 비교기와 상기 입력라인들중 둘재것에 결합되는 제1입력과 제2임계전압에 결합되는 제2입력을 갖는 양의 임계치 비교기를 포함하는 것이 특지인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  4. 제3항에서, 검정받은 피이크 출력신호를 발생시키기 위한 상기 수단은 상기 0교차 비교기의 양의 출력에 결합되는 데이터 입력을 갖고 있는 랫칭 플립플롭이며, 또한 상기 음의 임계치 비교기의 출력에 결합되는 제1입력과 상기 0교차 비교기의 양의 출력에 결합되는 제2입력을 갖는 제1 AND게이트와, 상기 양의 임계치 비교기의 출력에 결합되는 제1입력과 상기 0교차 비교기의 음의 출력에 결합되는 제2입력을 갖는 제2AND게이트와, 상기 음과 양의 임계치 비교기들에 결합되는 제1 및 제2입력들과 상기 플립플롭의 클록입력에 결합되는 출력을 갖는 OR 게이트를 더 포함하는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  5. 제4항에서 단일의 검정받은 피이크 출력신호를 허용하기 위한 수단은 상기 플립릎롭의 상기 클록 입력과 상기 OR게이트 출력간에 결합되는 원-쇼트 지연회로를 포함하는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  6. 제1항에서 상기 입력신호를 조정하여 상기 피이크들을 검출하기 위한 수단에 제시하게 위한 필터와 전치증폭기를 더 포함하는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  7. 제1 및 제2입력라인들 양단에 결합되는 차동신호인 입력신호를 수신하도록 결합되는 미분기와, 상기미분기의 출력에 결합되는 0교차 비교기와, 상기 입력라인들중 첫 번째것에 결합되는 제1입력과 제1임계전압에 결합되는 제2입력을 갖는 음의 임계치 비교기와, 상기 입력라인들중 둘째것에 결합되는 제1입력과 제2임계전압에 결합되는 제2입력을 갖는 양의 임계치 비교기와, 상기 음의 임계치 비교기의 출력에 결합되는 제1입력과 상기 0교차 비교기의 양의 출력에 결합되는 제2입력을 갖는 제1 AND게이트와, 상기 양의 임계치 비교기의 출력에 결합되는 제1입력과 상기 0교차 비교기의 음의 출력에 결합되는 제2입력을 갖는 제2 AND게이트와, 상기 음과 양의 임계치 비교기들의 출력들에 결합되는 제1 및 제2입력들을 갖는OR게이트와, 상기 OR게이트의 출력에 결합되는 입력을 갖는 원-쇼트 지연회로와, 그리고 상기 0교차 비교기의 양의 출력에 결합되는 데이터 입력과 상기 원-쇼트 지연회로의 출력에 결합되는 클록입력을 갖는 랫칭 플립플롭을 포함하는 것이 특징인 진폭 및 시간 검정을 사용하는 펄스 검출회로.
  8. 입력신호 내에서 피이크들을 검출하고 또한 피이크가 검출될 때 피이크 검출신호를 발생시키는 단계와, 상기 입력신호를 임계치 레벨과 비교하는 단계와, 피이크가 상기 임계치 레벨이상에서 검출될 때 검정받은 피이크 출력신호를 발생시키는 단계와, 그리고 피이크가 검출된 후 예정된 시간 기간동안 상기 출력신호를 디스에이블링하는 단계를 포함하는 것이 특징인 진폭 및 시간검정을 사용하는 펄스 검출 방법.
  9. 제8항에서 상기 검출단계는 미분신호를 발생시키도록 상기 입력신호를 미분하는 단계와, 상기 미분된 신호의 0교차들을 검출하는 간계를 포함하는 것이 특지인 진폭 및 시간검정을 사용하는 펄스 검출방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019880002866A 1987-03-23 1988-03-18 진폭 및 시간검정을 사용하는 펄스검출 회로 및 방법 KR910005904B1 (ko)

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