KR840003081A - 마이크로 프로그램 제어방식 - Google Patents

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KR840003081A
KR840003081A KR1019820005402A KR820005402A KR840003081A KR 840003081 A KR840003081 A KR 840003081A KR 1019820005402 A KR1019820005402 A KR 1019820005402A KR 820005402 A KR820005402 A KR 820005402A KR 840003081 A KR840003081 A KR 840003081A
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고우주 노구지 (외 2)
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미쓰다 가쓰시게
가부시기 가이샤 히다찌 세이사꾸쇼
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    • GPHYSICS
    • G06COMPUTING; CALCULATING OR COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/22Microcontrol or microprogram arrangements
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    • G06F9/262Arrangements for next microinstruction selection
    • G06F9/264Microinstruction selection based on results of processing
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Abstract

내용 없음

Description

마이크로 프로그램 제어방식
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도와 제2도는 조건부분기 명령(條件付分岐命令)을 포함하는 마이크로 명령열(命令列)의 서로 다른 예를 표시한 것이다.
제3도는 본 발명의 실시예에서 사용한 조건부 분기 명령의형식.
제4도는 본 발명의 실시예에서 사용한 일반 명령의 형식.
제5도는 본 발명의 실시예의 대략적인 회로도.

Claims (4)

  1. 어드레스 레지스터와, 일정 싸이클마다 구동되고, 상기 레지스터에 저장된 페이지 어드레스에 따라 정해진 복수개의 마이크로 명령을 호출하는 기억수단과, 이 기억수단은 각 마이크로 명령의 제1피일드에는 미리 정해진 수의 싸이클(상기 마이크로 명령의 호출 싸이클)후에 호출되는 후속의 마이크로 명령을 지정하는 페이지 어드레스가 포함되어 있고, 조건부 분기 명령이 아닌 일반 명령의 제2피일드에는 상기의 후속 명령을 지정하는 디스플레이스멘트 어드레스가 포함되어 있으며, 조건부 분기 명령의 제2피일드에는 분기 조건을 지정하는 정보가 포함되어 있어서 상기의 호출동작 마다 호출된 복수개의 마이크로 명령의 하나를 선택하는 수단과, 상기의 선택된 명령을 호출하기 위한 페이지 어드레스를 상기 어드레스 레지스터에 셋트한 타이밍 보다 상기의 미리 정해진 싸이클 수만큼 늦게 선택된 상기 명령의 제1,제2피일드를 상기 레지스터에 셋트하는 상기의 선택 동작에 동기 시킨 셋트 수단과, 상기의 선택된 마이크로 명령이 분기 명령일때에 이 분기 명령이 지정하는 분기가 성공 되었는지 안되었는지를 상기의 선택된 분기 명령의 제2피일드에 따라 검출하는 수단과, 상기의 선택동작이 완료할때마다 다음의 싸이클에서 선택될 마이크로 명령을 지정하기 위한 디스플레이스멘트어드레스를 발생하여 상기 선택 수단에 공급하기 위한 어드레스 발생 수단과, 이 발생 수단은 상기의 선택 수단에 의하여 현재까지의 미리 정해진 수의 싸이클 기간에서의 상기 검출수단의 출력과 현재 상기 어드레스 레지스터안에 있는 디스플레이스멘트 어드레스에 따라 상기의 지정을 하기 위한 디스플레이스멘트 어드레스를 발생하는 것으로 되는 마이크로 명령 제어의 데이터 처리 장치.
  2. 상기의 어드레스 발생 수단을 상기의 미리 정해진 수의 싸이클 기간내에 분기 명령이 없을때에는 상기 어드레스 레지스터에 현재 저장되어 있는 디스플레이스멘트 어드레스를 상기 지정을 하기 위한 디스플레이스멘트 어드레스로서 출력하고, 상기의 미리 정해진 수의 싸이클 기간내에 분기 명령이 있을 때에는 상기의 미리 정해진 수의 싸이클중에서 분기 명령이 존재하였든 싸이클과, 상기 분기 명령에 대한 분기 성공 검출 결과에 따라 상이한 디스플레이스멘트 어드레스를 발생하는 것인 특허청구 범위 1의 데이터 처리장치.
  3. 상기의 미리 정해진 수는 2이고, 상기의 어드레스 발생수단은 현재의 싸이클에서 출력된 디스플레이스멘트 어드레스를 기억하는 수단과, 현재보다 하나 먼저의 싸이클에서 선택된 명령이 분기 명령인지 아닌지를 표시하는 신호를 기억하는 수단과, 현재 선택된 명령이 분기 명령이 아니고, 또 현재보다 하나 먼저의 싸이클에서 선택된 명령이 분기 명령이 아닐때에는 상기 어드레스 레지스터에 현재 저장되어 있는 디스플레이스멘트 어드레스를 출력하고, 현재 선택된 명령이 분기명령이 아니고 하나 먼저의 싸이클에서 선택된 명령이 분기 명령일때에는 현재의 싸이클에서 출력한 디스플레이스멘트 어드레스이 일부와 1 또는 0중에서 미리 정해진 값으로된 디스플레이스멘트 어드레스를 출력하며, 현재 선택된 명령이 분기명령때에는 현재의 싸이클에서 출력된 디스플레이스멘트 어드레스의 일부와 분기의 성공 여부에 따라 정해지는 0또는 1로 되는 디스플레이스멘트 어드레스를 출력하는 수단과, 로 되는 특허청구 범위 1의 데이터 처리장치.
  4. 상기의 디스플레이스멘트 어드레스는 2빗트로 되어있고, 상기의 어드레스 발생 수단은 현재 선택된 명령이 분기 명려이 아니고, 또 하나 먼저의 싸이클에서 선택된 명령이 분기 명령일때에, 현재의 싸이클에서 출력된 하위 빗트 OMO와 같은 상위 빗트와, 값 0 또는 1중에서 미리 정하여진 어느 한쪽의 값을 갖는 상위 빗트로 된 디스플레이스멘트 어드레스를 발생하고, 현재 선택되어 있는 명령이 분기 명령일때에는 현재의 싸이클에서 출력된 하위 빗트와 같은 상위 빗트와, 분기의 성공 여부에 따라 1 또는 0의 값으로 되는 하위 빗트로 이루어지는 디이스플레이스멘트 어드레스를 발생하는 것인 특허청구 범위 3의 데이터 처리장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR8205402A 1981-12-02 1982-12-01 마이크로 프로그램 제어방식 KR880000994B1 (ko)

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Application Number Priority Date Filing Date Title
JP56192933A JPS5896349A (ja) 1981-12-02 1981-12-02 マイクロ命令制御のデータ処理装置
JP81-192933 1981-12-02
JP56-192933 1981-12-02

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KR840003081A true KR840003081A (ko) 1984-08-13
KR880000994B1 KR880000994B1 (ko) 1988-06-10

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KR8205402A KR880000994B1 (ko) 1981-12-02 1982-12-01 마이크로 프로그램 제어방식

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US4494195A (en) 1985-01-15
EP0080737A1 (en) 1983-06-08
KR880000994B1 (ko) 1988-06-10
EP0080737B1 (en) 1987-06-24
JPS5896349A (ja) 1983-06-08
JPH0221612B2 (ko) 1990-05-15

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