KR20200047839A - 표시모듈 - Google Patents

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KR20200047839A
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유인경
주성배
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삼성디스플레이 주식회사
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Abstract

표시모듈은 표시 영역 및 비표시 영역이 정의된 상면, 하면, 및 상기 상면과 상기 하면을 연결하는 복수 개의 측면들을 포함하는 베이스기판, 상기 베이스기판 상에 배치된 평탄화층을 포함하는 회로 소자층, 상기 평탄화층 상에 배치되고, 상기 표시 영역에 중첩하며 상기 평탄화층의 일부를 노출시키는 개구부를 포함하는 화소 정의막, 상기 개구부에 의해 노출된 상기 평탄화층 상에 배치된 제1 전극, 상기 제1 전극 상에 배치된 발광층, 및 상기 발광층 상에 배치된 제2 전극을 포함하는 표시 소자층, 상기 표시 소자층 상에 배치된 봉지층을 포함하고, 상기 베이스기판의 평면상에서 상기 측면들 중 두 개의 측면들이 연결되는 모서리에 인접하고, 상기 비표시 영역에 중첩하며 상기 평탄화층 및 상기 화소 정의막을 관통하는 댐홀이 정의된다.

Description

표시모듈{DISPLAY MODULE}
본 발명은 표시모듈에 관한 것으로, 보다 상세하게는 박막 봉지 신뢰성이 향상된 표시모듈에 관한 것이다.
표시 장치는 영상이 표시되는 표시 영역과 표시 영역 주변의 비표시 영역으로 구분될 수 있다. 최근 비표시 영역의 폭을 줄여 영상이 표시되는 표시 영역을 증가시키기 위한 다양한 연구가 진행되고 있다. 다만, 비표시 영역이 축소됨에 따라 비표시 영역에 집적된 소자들의 면적이 작아져 저항이 증가할 수 있다. 저항이 증가함에 따라 전압의 레벨이 위치에 따라 상이하게 되고, 그에 따라 화질의 불균일이 발생할 수 있다.
또한, 표시 장치 중 유기 발광 표시 장치의 발광층은 유기물을 포함할 수 있다. 산소 및 수분에 취약한 유기물을 보호하기 위해, 유기 발광 소자를 밀봉하기 위한 다양한 기술들이 개발되고 있다. 그 중 박막 봉지 기술은 유기 발광 소자 상에 봉지층을 배치시켜 공기 및 수분 등의 침투 경로를 차단하는 기술이다. 봉지층은 무기물을 포함하는 무기물 층과 유기물을 포함하는 유기물 층이 교대로 적층된 구조를 포함할 수 있다. 다만, 유기물 층을 형성하는 과정에서 유기물의 넘침이 발생하는 경우, 노출된 유기층이 공기 및 수분의 침투 경로로 제공될 수 있다.
본 발명은 목적은 균일한 화질의 영상을 표시하고, 박막 봉지 신뢰성이 향상된 표시모듈을 제공하는 것을 목적으로 한다.
본 발명의 목적을 달성하기 위한 일 실시 예에 따르면, 표시모듈은 표시 영역 및 비표시 영역이 정의된 상면, 하면, 및 상기 상면과 상기 하면을 연결하는 복수 개의 측면들을 포함하는 베이스기판, 상기 베이스기판 상에 배치된 평탄화층을 포함하는 회로 소자층, 상기 평탄화층 상에 배치되고, 상기 표시 영역에 중첩하며 상기 평탄화층의 일부를 노출시키는 개구부를 포함하는 화소 정의막, 상기 개구부에 의해 노출된 상기 평탄화층 상에 배치된 제1 전극, 상기 제1 전극 상에 배치된 발광층, 및 상기 발광층 상에 배치된 제2 전극을 포함하는 표시 소자층, 상기 표시 소자층 상에 배치된 봉지층을 포함하고, 상기 베이스기판의 평면상에서 상기 측면들 중 두 개의 측면들이 연결되는 모서리에 인접하고, 상기 비표시 영역에 중첩하며 상기 평탄화층 및 상기 화소 정의막을 관통하는 댐홀이 정의된다.
본 발명의 실시 예에 따르면, 상기 댐홀은 제1 방향으로 연장된 제1 홀 및 상기 제1 방향과 교차하는 제2 방향으로 연장된 제2 홀을 포함한다.
본 발명의 실시 예에 따르면, 상기 제1 홀은 상기 제1 방향으로 연장되고 상기 제2 방향으로 나열된 복수 개의 제1 메인 홀들을 포함하고, 상기 제2 홀은 상기 제2 방향으로 연장되고 상기 제1 방향으로 나열된 복수 개의 제2 메인 홀들을 포함한다.
본 발명의 실시 예에 따르면, 상기 제1 홀은 상기 제1 메인 홀들과 교차하며, 상기 제1 방향으로 나열되고 상기 제2 방향으로 연장된 복수 개의 제1 서브 홀들을 더 포함하고, 상기 제2 홀은 상기 제2 메인 홀들과 교차하며, 상기 제1 방향으로 연장되고 상기 제2 방향으로 나열된 복수 개의 제2 서브 홀들을 더 포함한다.
본 발명의 실시 예에 따르면, 상기 평면상에서, 상기 제1 홀 및 상기 제2 홀은 서로 이격된다.
본 발명의 실시 예에 따르면, 상기 측면들은 제1 내지 제4 측면들을 포함하고, 상기 댐홀은, 상기 제1 측면 및 상기 제2 측면이 연결되는 제1 모서리에 인접한 제1 댐홀, 상기 제2 측면 및 상기 제3 측면이 연결되는 제2 모서리에 인접한 제2 댐홀, 상기 제3 측면 및 상기 제4 측면이 연결되는 제3 모서리에 인접한 제3 댐홀, 상기 제4 측면 및 상기 제1 측면이 연결되는 제4 모서리에 인접한 제4 댐홀을 포함한다.
본 발명의 실시 예에 따르면, 상기 평면상에서, 상기 제1 내지 제4 댐홀들은 서로 이격된다.
본 발명의 실시 예에 따르면, 상기 봉지층은 상기 댐홀을 전체적으로 커버하며 상기 화소 정의막 상에 배치된다.
본 발명의 실시 예에 따르면, 상기 제2 전극의 일 부분은 상기 댐홀들을 전체적으로 커버하는 상기 봉지층과 중첩하고, 상기 제2 전극은 다른 부분은 상기 봉지층과 비중첩한다.
본 발명의 실시 예에 따르면, 상기 회로 소자층은 상기 비표시 영역에 중첩하며 상기 평탄화층 상에 배치된 전원 전극을 더 포함하고, 상기 제2 전극의 다른 부분은 상기 전원 전극에 연결된다.
본 발명의 실시 예에 따르면, 상기 회로 소자층은 복수 개의 박막 트랜지스터들을 포함하고, 상기 박막 트랜지스터 각각은, 상기 제1 전극과 연결되는 화소 전극을 포함하고, 상기 화소 전극은 상기 평탄화층에 의해 직접적으로 커버된다.
본 발명의 목적을 달성하기 위한 다른 실시 예에 따르면, 표시모듈은 표시 영역 및 비표시 영역이 정의된 상면, 하면, 및 상기 상면과 상기 하면을 연결하는 복수 개의 측면들을 포함하는 베이스기판, 상기 베이스기판 상에 배치된 평탄화층을 포함하는 회로 소자층, 상기 평탄화층 상에 배치되고, 상기 표시 영역에 중첩하며 상기 평탄화층의 일부를 노출시키는 개구부를 포함하는 화소 정의막, 상기 개구부에 의해 노출된 상기 평탄화층 상에 배치된 제1 전극, 상기 제1 전극 상에 배치된 발광층, 및 상기 발광층 상에 배치된 제2 전극을 포함하는 표시 소자층, 상기 비표시 영역에 중첩하고, 제1 방향으로 연장되며 상기 평탄화층 및 상기 화소 정의막을 관통하는 제1 홀 및 상기 제1 방향과 교차하는 제2 방향으로 연장되며 상기 평탄화층 및 상기 화소 정의막을 관통하는 제2 홀에 의해 정의된 댐부, 상기 댐부를 커버하며 상기 표시 소자층 상에 배치된 봉지층을 포함하고, 상기 댐부는 상기 베이스기판의 평면상에서 상기 측면들 중 두 개의 측면들이 연결되는 모서리에 인접한다.
본 발명의 실시 예에 따르면, 상기 댐부는 복수 개의 댐들을 포함하고, 상기 댐들 각각은 상기 평탄화층과 동일한 두께 및 동일한 물질로 제공된 제1 층, 상기 제1 층 상에 배치되고, 상기 화소 정의막과 동일한 두께 및 동일한 물질로 제공된 제2 층을 포함한다.
본 발명의 실시 예에 따르면, 상기 평면상에서, 상기 제1 층의 면적은 상기 제2 층의 면적보다 큰 것을 특징으로 한다.
본 발명의 실시 예에 따르면, 상기 댐부는 상기 제1 측면과 평행한 제1 서브 댐부 및 상기 제2 측면과 평행한 제2 서브 댐부를 포함한다.
본 발명의 실시 예에 따르면, 상기 평면상에서, 상기 제1 서브 댐부 및 상기 제2 서브 댐부는 서로 이격된다.
본 발명의 실시 예에 따르면, 상기 제1 홀은 상기 제2 방향에서 이격된 복수 개의 제1 서브 홀들을 포함하고, 상기 제2 홀은 상기 제1 방향에서 이격된 복수 개의 제2 서브 홀들을 포함한다.
본 발명의 실시 예에 따르면, 상기 평면상에서, 상기 봉지층과 비중첩하며 상기 모서리 및 상기 댐부 사이에 배치된 외각 댐부를 더 포함한다.
본 발명의 실시 예에 따르면, 상기 외각 댐부는 상기 표시 영역을 에워싼다.
본 발명의 실시 예에 따르면, 상기 외각 댐부는 상기 평탄화층 및 상기 화소 정의막 중 적어도 하나와 동일한 물질을 포함한다.
본 발명의 실시 예에 따르면, 제1 방향으로 연장되며 평탄화층 및 화소 정의막을 관통하는 제1 홀 및 제1 방향과 교차하는 제2 방향으로 연장되며 평탄화층 및 화소 정의막을 관통하는 제2 홀에 의해 댐부가 정의된다. 댐부는 봉지층에 의해 커버되어, 외부 이물질이 표시 소자층으로 전달되는 것을 방지할 수 있다. 또한, 봉지층이 댐부를 커버함에 따라, 봉지층의 전반적인 면적이 증가될 수 있다. 그 결과, 모서리 영역에서 봉지층과 표시 소자층 간의 결합력이 증가될 수 있다.
따라서, 균일한 화질의 영상을 표시하고, 박막 봉지 신뢰성이 향상된 표시모듈이 제공될 수 있다.
도 1은 본 발명의 실시 예에 따른 표시장치의 사시도이다.
도 2는 본 발명의 실시 예에 따른 표시장치의 블록도이다.
도 3은 본 발명의 실시 예에 따른 표시모듈의 단면도이다.
도 4는 본 발명의 실시 예에 따른 표시패널의 평면도이다.
도 5a는 본 발명의 실시 예에 따른 화소의 등가 회로도이다.
도 5b는 본 발명의 실시 예에 따른 표시패널의 부분 단면도이다.
도 6은 본 발명의 일 실시 예에 따른 표시패널의 베이스기판 및 봉지층을 보여주는 평면도이다.
도 7a는 도 6에 도시된 제1 홀을 확대한 평면도이다.
도 7b는 도 6에 도시된 제2 홀을 확대한 평면도이다.
도 8은 도 6에 도시된 I-I'를 따라 절단된 단면도이다.
도 9는 본 발명의 다른 실시 예에 따른 표시패널의 베이스기판 및 봉지층을 보여주는 평면도이다.
본 명세서에서, 어떤 구성요소(또는 영역, 층, 부분 등)가 다른 구성요소 "상에 있다", "연결 된다", 또는 "결합된다"고 언급되는 경우에 그것은 다른 구성요소 상에 직접 배치/연결/결합될 수 있거나 또는 그들 사이에 제3의 구성요소가 배치될 수도 있다는 것을 의미한다.
동일한 도면부호는 동일한 구성요소를 지칭한다. 또한, 도면들에 있어서, 구성요소들의 두께, 비율, 및 치수는 기술적 내용의 효과적인 설명을 위해 과장된 것이다.
"및/또는"은 연관된 구성들이 정의할 수 있는 하나 이상의 조합을 모두 포함한다.
제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다. 예를 들어, 본 발명의 권리 범위를 벗어나지 않으면서 제1 구성요소는 제2 구성요소로 명명될 수 있고, 유사하게 제2 구성요소도 제1 구성요소로 명명될 수 있다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
또한, "아래에", "하측에", "위에", "상측에" 등의 용어는 도면에 도시된 구성들의 연관관계를 설명하기 위해 사용된다. 상기 용어들은 상대적인 개념으로, 도면에 표시된 방향을 기준으로 설명된다.
다르게 정의되지 않는 한, 본 명세서에서 사용된 모든 용어 (기술 용어 및 과학 용어 포함)는 본 발명이 속하는 기술 분야의 당업자에 의해 일반적으로 이해되는 것과 동일한 의미를 갖는다. 또한, 일반적으로 사용되는 사전에서 정의된 용어와 같은 용어는 관련 기술의 맥락에서 의미와 일치하는 의미를 갖는 것으로 해석되어야 하고, 이상적인 또는 지나치게 형식적인 의미로 해석되지 않는 한, 명시적으로 여기에서 정의됩니다.
"포함하다" 또는 "가지다" 등의 용어는 명세서 상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부분품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.
이하, 도면을 참조하여 본 발명의 실시예들을 설명한다.
도 1은 본 발명의 실시 예에 따른 표시장치의 사시도이다. 도 2는 본 발명의 실시 예에 따른 표시장치의 블록도이다.
도 1을 참조하면, 표시장치(DD)는 표시 영역(DA)을 통해 이미지를 표시 할 수 있다. 도 1에서는 표시 영역(DA)이 제1 방향(DR1) 및 제1 방향(DR1)과 교차하는 제2 방향(DR2)이 정의하는 면에 제공된 것을 예시적으로 도시하였다. 하지만, 본 발명의 다른 실시 예에서 표시장치의 표시 영역은 휘어진 면에 제공될 수 있다. 또한, 도 1을 통해 도시되지 않았지만, 다른 예에 따르면, 표시장치(DD)는 표시 영역(DA)에 인접한 비표시 영역을 더 포함하고, 비표시 영역은 영상이 시인되지 않은 영역일 수 있다. 비표시 영역은 표시 영역(DA)의 일 영역에 인접하게 배치되거나, 표시 영역(DA)을 에워쌀 수 있다.
표시장치(DD)의 두께 방향은 제3 방향(DR3)이 지시한다. 제1 내지 제3 방향들(DR1, DR2, DR3)이 지시하는 방향은 상대적인 개념으로서 다른 방향으로 변환될 수 있다. 본 명세서 내에서 "평면 상에서 보았을 때 또는 평면상에서"의 의미는 제3 방향(DR3)에서 바라보는 경우를 의미할 수 있다. 또한, "두께 방향"은 제3 방향(DR3)일 수 있다.
도 1에서는 표시장치(DD)가 텔레비전인 것을 예시적으로 도시하였다. 하지만, 표시장치(DD)는 모니터, 또는 외부 광고판과 같은 대형 전자장치를 비롯하여, 퍼스널 컴퓨터, 노트북 컴퓨터, 개인 디지털 단말기, 자동차 내비게이션 유닛, 게임기, 스마트폰, 태블릿, 및 카메라와 같은 중소형 전자 장치 등에 사용될 수도 있다. 또한, 이것들은 단지 실시 예로서 제시된 것들로서, 본 발명의 개념에서 벗어나지 않은 이상 다른 전자 기기에도 채용될 수 있음은 물론이다.
도 2를 참조하면, 표시장치(DD)는 표시패널(DP), 신호 제어회로(TC), 데이터 구동회로(DDV), 및 스캔 구동회로(GDV)를 포함할 수 있다. 신호 제어회로(TC), 데이터 구동회로(DDV) 및 스캔 구동회로(GDV) 각각은 복수 개의 회로들을 포함할 수 있다.
표시패널(DP)은 복수의 데이터 라인들(DL1-DLm), 복수의 스캔 라인들(SL1-SLn) 및 복수의 화소들(PX)을 포함할 수 있다.
복수의 데이터 라인들(DL1-DLm)은 제2 방향(DR2)으로 연장되며, 제2 방향(DR2)과 교차하는 제1 방향(DR1)을 따라 배열될 수 있다. 복수의 스캔 라인들(SL1-SLn)은 제1 방향(DR1)으로 연장되며, 제2 방향(DR2)을 따라 배열될 수 있다.
화소들(PX) 각각은 발광 소자 및 발광 소자와 전기적으로 연결된 화소 회로를 포함할 수 있다. 화소 회로는 복수의 트랜지스터들을 포함할 수 있다. 제1 전원 전압(ELVDD) 및 제2 전원 전압(ELVSS)은 화소들(PX) 각각으로 제공될 수 있다.
화소들(PX)은 표시패널(DP)의 평면상에서 일정한 규칙으로 배치될 수 있다. 화소들(PX) 각각은 주요색(primary color) 중 하나 또는 혼합색 중 하나를 표시할 수 있다. 상기 주요색은 레드, 그린, 및 블루를 포함할 수 있고, 상기 혼합색은 옐로우, 시안, 마젠타 및 화이트 등 다양한 색상을 포함할 수 있다. 다만, 화소들(PX)이 표시하는 색상이 이에 제한되는 것은 아니다.
신호 제어회로(TC)는 외부로부터 제공되는 영상 데이터(RGB)를 수신한다. 신호 제어회로(TC)는 영상 데이터(RGB)를 표시패널(DP)의 동작에 부합하도록 변환하여 변환 영상 데이터(R'G'B')를 생성하고, 변환 영상 데이터(R'G'B')를 데이터 구동회로(DDV)로 출력한다.
또한, 신호 제어회로(TC)는 외부로부터 제공되는 제어 신호(CS)를 수신할 수 있다. 제어 신호(CS)는 수직동기신호, 수평동기신호, 메인 클럭신호, 및 데이터 인에이블 신호 등을 포함할 수 있다. 신호 제어회로(TC)는 제1 제어 신호(CONT1)를 데이터 구동회로(DDV)로 제공하고, 제2 제어 신호(CONT2)를 스캔 구동회로(GDV)로 제공한다. 제1 제어 신호(CONT1)는 데이터 구동회로(DDV)를 제어하기 위한 신호이고, 제2 제어 신호(CONT2)는 스캔 구동회로(GDV)를 제어하기 위한 신호이다.
데이터 구동회로(DDV)는 신호 제어회로(TC)로부터 수신한 제1 제어 신호(CONT1)에 응답해서 복수의 데이터 라인들(DL1-DLm)을 구동할 수 있다. 데이터 구동회로(DDV)는 독립된 집적 회로로 구현되어서 표시패널(DP)의 일 측에 전기적으로 연결되거나, 표시패널(DP) 상에 직접 실장될 수 있다. 또한, 데이터 구동회로(DDV)는 단일 칩으로 구현되거나 복수의 칩들을 포함할 수 있다.
스캔 구동회로(GDV)는 표시패널(DP)의 소정 영역에 집적될 수 있다. 예를 들어, 스캔 구동회로(GDV)는 화소들(PX)의 화소 회로와 동일한 공정, 예컨대 LTPS(Low Temperature Polycrystaline Silicon) 공정 또는 LTPO(Low Temperature Polycrystalline Oxide) 공정을 통해 형성된 복수 개의 박막 트랜지스터들을 포함할 수 있다. 또한, 스캔 구동회로(GDV)는 독립된 집적 회로 칩으로 구현되어 표시패널(DP)의 일측에 전기적으로 연결될 수 있다.
도 3은 본 발명의 실시 예에 따른 표시모듈의 단면도이다. 도 4는 본 발명의 실시 예에 따른 표시패널의 평면도이다. 도 5a는 본 발명의 실시 예에 따른 화소의 등가 회로도이다. 도 5b는 본 발명의 실시 예에 따른 표시패널의 부분 단면도이다.
도 3을 참조하면, 표시모듈(DM)은 도 2에 도시된 표시패널(DP) 및 추가적으로 입력 감지 유닛(TS, 또는 터치감지유닛)을 포함한다. 본 발명에 따르면, 표시모듈(DM)이 입력 감지 유닛(TS)을 포함하는 것으로 설명되지만, 입력 감지 유닛(TS)은 생략될 수 있다.
입력 감지 유닛(TS)은 절연층(TFL) 상에 직접 배치될 수 있다. 본 명세서에서 "A 구성이 B 구성 상에 직접 배치된다"는 것은 A 구성과 B 구성 사이에 접착층이 배치되지 않는 것을 의미한다.
입력 감지 유닛(TS)은 절연층(TFL) 상에 직접 배치되거나, 다른 예로 접착층을 통해 절연층(TFL)과 연결될 수 있다. 입력 감지 유닛(TS)은 단층 또는 다층의 도전층을 포함할 수 있다. 또한, 입력 감지 유닛(TS)은 단층 또는 다층의 절연층을 포함할 수 있다.
입력 감지 유닛(TS)은 예컨대, 정전용량 방식으로 외부에서 인가되는 입력을 감지할 수 있다. 외부에서 인가되는 입력은 다양한 형태로 제공될 수 있다. 예를 들어, 외부 입력은 사용자 신체의 일부, 스타일러스 펜, 광, 열, 또는 압력 등 다양한 형태의 외부 입력들을 포함한다. 또한, 사용자의 손 등 신체의 일부가 접촉하는 입력은 물론, 근접하거나 인접하는 공간 터치(예를 들어, 호버링)도 입력의 일 형태일 수 있다.
본 발명에 따른 입력 감지 유닛(TS)의 동작방식은 특별히 제한되지 않고, 입력 감지 유닛(TS)은 전자기 유도방식 또는 압력 감지방식으로 외부입력을 감지할 수도 있다. 한편, 본 발명의 다른 실시 예에 따르면, 입력 감지 유닛(TS)은 별도로 제조되어 접착층에 의해 표시패널(DP)에 부착되거나, 입력 감지 유닛(TS)은 생략될 수 있다.
표시패널(DP)은 유기발광 표시패널일 수 있고, 특별히 제한되지 않는다. 예컨대, 표시패널(DP)은 유기발광 표시패널 또는 퀀텀닷 발광 표시패널일 수 있다. 유기발광 표시패널은 발광층이 유기발광물질을 포함한다. 퀀텀닷 발광 표시패널은 발광층이 퀀텀닷, 및 퀀텀로드를 포함한다. 이하, 본 발명에 따른 표시패널(DP)은 유기발광 표시패널로 설명된다.
표시패널(DP)은 베이스기판(SUB), 베이스기판(SUB) 상에 배치된 회로 소자층(DP-CL), 표시 소자층(DP-OLED), 및 절연층(TFL)을 포함한다.
베이스기판(SUB)은 적어도 하나의 플라스틱 필름을 포함할 수 있다. 베이스기판(SUB)은 플렉서블한 기판으로 플라스틱 기판, 유리 기판, 메탈 기판, 또는 유/무기 복합재료 기판 등을 포함할 수 있다. 도 1을 참조하여 설명한 표시 영역(DA)은 베이스기판(SUB)에 정의된 표시 영역(DM-DA)에 대응될 수 있다. 또한, 도 1을 통해 도시되지 않았지만, 표시장치(DD)는 표시 영역(DA)에 인접한 비표시 영역을 포함할 수 있다. 도 3에 도시된 바와 같이, 베이스기판(SUB)에 비표시 영역(DM-NDA)이 정의되며, 비표시 영역(DM-NDA)은 표시 영역(DM-DA)의 일 측에 인접하거나 표시 영역(DM-DA)을 에워쌀 수 있다. 다른 예로, 비표시 영역(DM-NDA)은 생략될 수 도 있다.
회로 소자층(DP-CL)은 적어도 하나의 중간 절연층과 회로 소자를 포함한다. 중간 절연층은 적어도 하나의 중간 무기막과 적어도 하나의 중간 유기막을 포함한다. 상기 회로 소자는 신호 라인들, 화소의 구동 회로 등을 포함한다.
표시 소자층(DP-OLED)은 복수 개의 유기발광 다이오드들을 포함한다. 표시 소자층(DP-OLED)은 화소 정의막과 같은 유기막을 더 포함할 수 있다.
절연층(TFL)은 표시 소자층(DP-OLED)을 밀봉한다. 일 예로, 절연층(TFL)은 박막 봉지층일 수 있다. 절연층(TFL)은 수분, 산소, 및 먼지 입자와 같은 이물질로부터 표시 소자층(DP-OLED)을 보호한다. 한편, 도 3에 도시된 바에 따르면, 절연층(TFL)은 표시 영역(DM-DA) 및 비표시 영역(DM-NDA)에 각각 중첩하는 것으로 도시되나, 이에 한정되지 않으며 비표시 영역(DM-NDA)에 비중첩할 수 있다.
도 4를 참조하면, 표시패널(DP)은 표시 영역(DA) 및 비표시 영역(NDA)을 포함한다. 표시패널(DP)의 표시 영역(DA)은 도 1에 도시된 표시장치(DD)의 표시 영역(DA)에 대응될 수 있다.
표시패널(DP)은 스캔 구동회로(GDV), 복수 개의 신호 라인들(SGL), 복수 개의 화소들(PX), 및 복수 개의 구동 패드들(PD)을 포함한다. 복수 개의 화소들(PX)이 배치된 영역은 표시 영역(DA)으로 정의된다. 스캔 구동회로(GDV), 복수 개의 신호 라인들(SGL), 및 화소 구동회로는 도 3에 도시된 회로 소자층(DP-CL)에 포함될 수 있다.
스캔 구동회로(GDV)는 복수 개의 스캔 신호들을 생성하고, 복수 개의 스캔 신호들을 복수 개의 스캔 라인들(SL1~SLn, 도2 참조)에 순차적으로 출력한다.　스캔 구동회로(GDV)는 화소들(PX)의 구동 회로에 또 다른 제어 신호를 더 출력할 수 있다.
복수 개의 신호 라인들(SGL)은 스캔 라인들(SL), 데이터 라인들(DL), 전원 라인(PL), 및 제어신호 라인(CSL)을 포함한다. 스캔 라인들(SL) 및 데이터 라인들(DL)은 도 2를 통해 도시된 스캔 라인들(SL1~SLn) 및 데이터 라인들(DL1~DLm)에 대응될 수 있다.
스캔 라인들(SL)은 복수 개의 화소들(PX) 중 대응하는 화소(PX)에 각각 연결되고, 데이터 라인들(DL)은 복수 개의 화소들(PX) 중 대응하는 화소(PX)에 각각 연결된다. 전원 라인(PL)은 복수 개의 화소들(PX)에 연결된다. 또한, 스캔 라인들(SL)이 연결된 스캔 구동회로(GDV)가 비표시 영역(NDA)에 배치될 수 있다. 제어신호 라인(CSL)은 스캔 구동회로(GDV)에 제어신호들을 제공할 수 있다.
스캔 라인들(SL), 데이터 라인들(DL), 전원 라인(PL), 및 제어신호 라인(CSL) 중 일부는 동일한 층에 배치되고, 일부는 다른 층에 배치된다. 스캔 라인들(SL), 데이터 라인들(DL), 전원 라인(PL), 및 제어신호 라인(CSL) 중 어느 하나의 층에 배치된 신호 라인들이 제1 신호 라인으로 정의될 때, 다른 하나의 층에 배치된 신호 라인들은 제2 신호 라인으로 정의될 수 있다. 또 다른 하나의 층에 배치된 신호 라인들은 제3 신호 라인으로 정의될 수 있다.
표시패널(DP)은 데이터 라인들(DL), 전원 라인(PL), 및 제어신호 라인(CSL)에 전기적으로 연결된 복수 개의 구동 패드들(PD)을 포함할 수 있다. 구동 패드들(PD)은 비표시 영역(NDA)에 중첩할 수 있다.
도 5a를 참조하면, 어느 하나의 스캔 라인(SL)과 어느 하나의 데이터 라인(DL), 및 전원 라인(PL)에 연결된 화소(PX)를 예시적으로 도시하였다. 화소(PX)의 구성은 이에 제한되지 않고 변형되어 실시될 수 있다.
본 발명에 따르면, 화소(PX)는 유기발광 소자(ED), 제1 전극(AE), 제2 전극(CE), 및 화소 회로(PXC)를 포함한다. 화소(PX)는 표시소자로써 유기발광 소자(ED)를 포함한다.
유기발광 소자(ED), 제1 전극(AE), 및 제2 전극(CE)은 도 3에 도시된 표시 소자층(DP-OLED)에 포함될 수 있다. 유기발광 소자(ED)는 전면 발광형 다이오드이거나, 배면 발광형 다이오드일 수 있다.
화소 회로(PXC)는 유기발광 소자(ED)를 구동하기 위한 회로부로써 제1 트랜지스터(T1, 또는 스위칭 트랜지스터), 제2 트랜지스터(T2, 또는 구동 트랜지스터), 및 커패시터(Cap)를 포함한다. 화소 회로(PXC)는 도 3에 도시된 회로 소자층(DP-CL)에 포함될 수 있다.
유기발광 소자(ED)는 제1 및 제2 트랜지스터들(T1, T2)로부터 제공되는 전기적 신호의 의해 광을 생성한다.
제1 트랜지스터(T1)는 스캔 라인(SL)에 인가된 스캔 신호에 응답하여 데이터 라인(DL)에 인가된 데이터 신호를 출력한다. 커패시터(Cap)는 제1 트랜지스터(T1)로부터 수신한 데이터 신호에 대응하는 전압을 충전한다. 제1 전원 전압(ELVDD)은 제2 트랜지스터(T2)를 통해 제1 전극(AE)에 제공되고, 제2 전원 전압(ELVSS)은 제2 전극(CE) 에 제공된다. 제2 전원 전압(ELVSS)은 제1 전원 전압(ELVDD)보다 낮은 전압일 수 있다.
제2 트랜지스터(T2)는 제1 전극(AE)을 통해 유기발광 소자(ED)에 전기적으로 연결된다. 제2 트랜지스터(T2)는 커패시터(Cap)에 저장된 전하량에 대응하여 유기발광 소자(ED)에 흐르는 구동전류(ID)를 제어한다. 유기발광 소자(ED)는 제2 트랜지스터(T2)의 턴-온 구간 동안 발광한다.
도 5b를 참조하면, 도 5a에 도시된 등가 회로에 대응하는 표시패널(DP)의 부분 단면이 도시된다. 베이스기판(SUB) 상에 회로 소자층(DP-CL), 표시 소자층(DP-OLED), 및 절연층(TFL)이 순차적으로 배치된다.
회로 소자층(DP-CL)은 적어도 하나의 절연층과 회로 소자를 포함한다. 회로 소자는 신호 라인, 화소의 구동회로 등을 포함한다. 코팅, 증착 등에 의한 절연층, 반도체층 및 도전층 형성공정과 포토리소그래피 공정에 의한 절연층, 반도체층 및 도전층층의 패터닝 공정을 통해 회로 소자층(DP-CL)이 형성될 수 있다.
회로 소자층(DP-CL)은 무기막인 버퍼막(BFL), 제1 중간 무기막(10) 및 제2 중간 무기막(20)을 포함하고, 유기막인 중간 유기막(30)을 포함할 수 있다. 버퍼막(BFL)은 적층된 복수개의 무기막을 포함할 수 있다. 도 5b에는 스위칭 트랜지스터(T1) 및 구동 트랜지스터(T2)를 구성하는 제1 반도체 패턴(OSP1), 제2 반도체 패턴(OSP2), 제1 제어전극(GE1), 제2 제어전극(GE2), 제1 입력전극(DE1), 제1 출력전극(SE1), 제2 입력전극(DE2), 제2 출력전극(SE2)의 배치관계가 예시적으로 도시되었다. 제1 내지 제4 관통홀들(CH1, CH2, CH3, CH4) 역시 예시적으로 도시되었다.
표시 소자층(DP-OLED)은 유기발광 다이오드(OLED)를 포함할 수 있다. 표시 소자층(DP-OLED)은 화소 정의막(PDL)을 포함한다. 예컨대, 화소 정의막(PDL)은 유기층일 수 있다
중간 유기막(30, 이하 '평탄화층'으로 설명) 상에 제1 전극(AE)이 배치된다. 제1 전극(AE)은 평탄화층(30)을 관통하는 제5 관통홀(CH5)을 통해 제2 출력전극(SE2)에 연결된다. 화소 정의막(PDL)에는 개구부(OM)가 정의된다. 화소 정의막(PDL)의 개구부(OM)는 제1 전극(AE)의 적어도 일부분을 노출시킨다. 화소 정의막(PDL)의 개구부(OM)는 다른 개구부들과 구분하기 위해 발광 개구부로 명명된다.
별도로 도시하지 않았으나, 화소 정의막(PDL)의 상면 상에는 화소 정의막(PDL)의 일부분에 중첩하는 스페이서가 배치될 수 있다. 스페이서는 화소 정의막(PDL)와 일체의 형상이거나, 추가 공정에 의해 형성된 절연구조물 일 수 있다.
표시패널(DP)의 표시 영역(DA)은 발광영역(PXA)과 발광영역(PXA)에 인접한 비발광영역(NPXA)을 포함할 수 있다. 비발광영역(NPXA)은 발광영역(PXA)을 에워싸을수 있다. 본 실시예에서 발광영역(PXA)은 발광 개구부(OM)에 의해 노출된 제1 전극(AE)의 일부영역에 대응하게 정의되었다.
정공 제어층(HCL)은 발광영역(PXA)과 비발광영역(NPXA)에 공통으로 배치될 수 있다. 정공 제어층(HCL)은 정공 수송층을 포함하고, 정공 주입층을 더 포함할 수 있다. 정공 제어층(HCL) 상에 발광층(EML)이 배치된다. 발광층(EML)은 발광 개구부(OM)에 대응하는 영역에 배치될 수 있다. 즉, 발광층(EML)은 화소들 각각에 분리되어 형성될 수 있다. 발광층(EML)은 유기물질 및/또는 무기물질을 포함할 수 있다. 발광층(EML)은 소정의 유색 컬러광을 생성할 수 있다.
발광층(EML) 상에 전자 제어층(ECL)이 배치된다. 전자 제어층(ECL)은 전자 수송층을 포함하고, 전자 주입층을 더 포함할 수 있다. 정공 제어층(HCL)과 전자 제어층(ECL)은 오픈 마스크를 이용하여 복수 개의 화소들에 공통으로 형성될 수 있다. 전자 제어층(ECL) 상에 제2 전극(CE)이 배치된다. 제2 전극(CE)은 일체의 형상을 갖고 복수 개의 화소들 각각에 포함된 전자 제어층(ECL) 상에 공통적으로 배치된다.
제2 전극(CE) 상에 절연층(TFL)이 배치된다. 절연층(TFL)은 단일 봉지층으로 제공되거나, 복수 개의 박막들로 제공될 수 있다. 이하, 절연층(TFL)은 봉지층으로 설명된다.
도 6은 본 발명의 일 실시 예에 따른 표시패널의 베이스기판 및 봉지층을 보여주는 평면도이다. 도 7a는 도 6에 도시된 제1 홀을 확대한 평면도이다. 도 7b는 도 6에 도시된 제2 홀을 확대한 평면도이다.
도 6을 참조하면, 베이스기판(SUB)은 상면, 하면, 및 상면과 하면을 연결하는 제1 내지 제4 측면들(S1, S2, S3, S4)을 포함할 수 있다. 여기서, 베이스기판(SUB)의 상면은 회로 소자층(DP-CL, 도 5b 참조)과 마주하고, 베이스기판(SUB)의 하면은 상면과 대향할 수 있다. 제1 측면(S1) 및 제3 측면(S3)은 제2 방향(DR2)에서 이격되어 마주보고, 제2 측면(S2) 및 제4 측면(S4)은 제1 방향(DR1)에서 이격되어 마주할 수 있다.
앞서 설명된 바와 같이, 봉지층(TFL)은 외부의 수분, 산소, 및 먼지 입자와 같은 이물질로부터 표시 소자층(DP-OLED)을 보호한다. 봉지층(TFL)을 표시 영역(DA)을 에워쌀 수 있다. 다만, 봉지층(TFL) 중 일 부분이 박리될 경우, 봉지층의 박리된 일 부분을 통해 외부의 이물질이 표시 소자층(DP-OLED)으로 유입될 수 있다. 특히, 베이스기판(SUB)의 두 측면들이 연결되는 모서리에 인접한 봉지층의 일 부분을 통해 외부 이물질이 표시 소자층(DP-OLED)으로 유입될 가능성이 높다.
본 발명의 실시 예에 따르면, 비표시 영역(NDA)에 중첩하며 도 5b에 도시된 평탄화층(30) 및 화소 정의막(PDL)을 관통하는 댐홀이 정의될 수 있다. 댐홀은 봉지층의 박리된 일 부분으로부터 유입된 외부 이물질이 표시 소자층(DP-OLED)에 전달되는 것을 방지할 수 있다.
자세하게, 베이스기판(SUB)의 평면상에서, 댐홀은 제1 내지 제4 측면들(S1~S4) 중 인접한 두 개의 측면들이 연결되는 모서리에 인접할 수 있다. 예컨대, 봉지층의 박리된 일 부분을 통해 외부 이물질이 유입될 경우, 이물질이 댐홀에 채워질 수 있다. 그 결과, 이물질이 표시 소자층(DP-OLED)으로 전달되지 않을 수 있다.
본 발명에 따른 댐홀은 평탄화층(30) 및 화소 정의막(PDL)을 관통하며 봉지층(TFL)에 의해 커버되는 제1 내지 제4 댐홀들(OP1, OP2, OP3, OP4)을 포함할 수 있다. 평면상에서, 제1 내지 제4 댐홀들(OP1, OP2, OP3, OP4)은 표시 영역(DA) 및 봉지층(TFL)의 최외각 사이에 배치될 수 있다. 또한, 평면상에서, 제1 내지 제4 댐홀들(OP1, OP2, OP3, OP4)은 서로 이격될 수 있다.
제1 댐홀(OP1)은 제1 측면(S1) 및 제2 측면(S2)이 연결되는 베이스기판(SUB)의 제1 모서리에 인접할 수 있다. 제1 댐홀(OP1)은 제1 방향(DR1)으로 연장된 제1 홀(OP1a) 및 제2 방향(DR2)으로 연장된 제2 홀(OP1b)을 포함한다. 일 예로, 제2 홀(OP1b)은 제1 홀(OP1a)으로부터 연장된 형상으로 제공될 수 있다.
제2 댐홀(OP2)은 제2 측면(S2) 및 제3 측면(S3)이 연결되는 베이스기판(SUB)의 제2 모서리에 인접할 수 있다. 제2 댐홀(OP2)은 제1 방향(DR1)으로 연장된 제1 홀(OP2a) 및 제2 방향(DR2)으로 연장된 제2 홀(OP2b)을 포함한다. 일 예로, 제2 홀(OP2b)은 제1 홀(OP2a)으로부터 연장된 형상으로 제공될 수 있다.
제3 댐홀(OP3)은 제3 측면(S3) 및 제4 측면(S4)이 연결되는 베이스기판(SUB)의 제3 모서리에 인접할 수 있다. 제3 댐홀(OP3)은 제1 방향(DR1)으로 연장된 제1 홀(OP3a) 및 제2 방향(DR2)으로 연장된 제2 홀(OP3b)을 포함한다. 일 예로, 제2 홀(OP3b)은 제1 홀(OP3a)으로부터 연장된 형상으로 제공될 수 있다.
제4 댐홀(OP4)은 제4 측면(S4) 및 제1 측면(S1)이 연결되는 베이스기판(SUB)의 제4 모서리에 인접할 수 있다. 제4 댐홀(OP4)은 제1 방향(DR1)으로 연장된 제1 홀(OP4a) 및 제2 방향(DR2)으로 연장된 제2 홀(OP4b)을 포함한다. 일 예로, 제2 홀(OP4b)은 제1 홀(OP4a)으로부터 연장된 형상으로 제공될 수 있다.
도 7a를 참조하면, 제1 홀들(OP1a, OP2a, OP3a, OP4a) 중 하나의 제1 홀(OP1a)이 예시적으로 도시되었다. 본 발명에 따르면, 설명의 편의를 위해, 제1 홀(OP1a)을 중점으로 설명되었지만, 나머지 제1 홀들(OP2a, OP3a, OP4a) 역시 도 7a에 도시된 형상으로 제공될 수 있다.
도 7a에 도시된 바에 따르면, 제1 홀(OP1a)은 제1 방향(DR1)으로 연장되고 제2 방향(DR2)으로 나열된 복수 개의 제1 메인 홀들(SO1a) 및 제1 방향(DR1)으로 나열되고 제2 방향(DR2)으로 연장된 복수 개의 제1 서브 홀들(SO2a)을 포함한다. 제1 메인 홀들(SO1a) 및 제1 서브 홀들(SO2a)은 관통하며, 서로 교차할 수 있다.
제1 메인 홀들(SO1a)은 제1 측면(S1) 또는 제3 측면(S3)이 연장된 제1 방향(DR1)과 평행할 수 있다. 제1 서브 홀들(SO2a)은 제2 측면(S2) 및 제4 측면(S4)이 연장된 제2 방향(DR2)과 평행할 수 있다.
본 발명의 실시 예에 따르면, 제1 홀(OP1a)에 의해 제1 서브 댐부가 정의될 수 있다. 즉, 제1 서브 댐부는 평탄화층(30) 및 화소 정의막(PDL)을 관통하는 제1 메인 홀들(SO1a) 및 제1 서브 홀들(SO2a)에 의해 정의된 복수 개의 제1 댐들(DMa)을 포함할 수 있다. 예시적으로, 제1 댐들(DMa)은 매트릭스 형상으로 배열될 수 있다.
또한, 본 발명의 다른 예에 따르면, 제1 서브 홀들(SO2a)은 생략될 경우, 제1 홀(OP1a)이 제1 메인 홀들(SO1a)만을 포함할 수 있다. 이 경우, 제1 서브 댐부는 제1 메인 홀들(SO1a)들 중 서로 인접한 두 개의 메인 홀들에 의해 정의되며, 제1 방향(DR1)으로 연장된 형상으로 제공될 수 있다.
도 7b를 참조하면, 제2 홀들(OP1b, OP2b, OP3b, OP4b) 중 하나의 제2 홀(OP1b)이 예시적으로 도시되었다. 본 발명에 따르면, 설명의 편의를 위해, 제2 홀(OP1b)을 중점으로 설명되었지만, 나머지 제2 홀들(OP2b, OP3b, OP4b) 역시 도 7b에 도시된 형상으로 제공될 수 있다.
도 7b에 도시된 바에 따르면, 제2 홀(OP1b)은 제2 방향(DR2)으로 연장되고 제1 방향(DR1)으로 나열된 복수 개의 제2 메인 홀들(SO1b) 및 제2 방향(DR2)으로 나열되고 제1 방향(DR1)으로 연장된 복수 개의 제2 서브 홀들(SO2b)을 포함한다. 제1 서브 홀들(SO2a) 및 제2 서브 홀들(SO2b)은 화소 정의막(PDL) 및 평탄화층(30)을 관통하며, 서로 교차할 수 있다.
제2 메인 홀들(SO1b)은 제2 측면(S2) 또는 제4 측면(S4)이 연장된 제2 방향(DR2)과 평행할 수 있다. 제2 서브 홀들(SO2b)은 제1 측면(S1) 및 제3 측면(S3)이 연장된 제1 방향(DR1)과 평행할 수 있다.
본 발명의 실시 예에 따르면, 제2 홀(OP1b)에 의해 제2 서브 댐부가 정의될 수 있다. 제2 서브 댐부는 평탄화층(30) 및 화소 정의막(PDL)을 관통하는 제2 메인 홀들(SO1b) 및 제2 서브 홀들(SO2b)에 의해 정의된 복수 개의 제2 댐들(DMb)을 포함할 수 있다. 예시적으로, 제2 댐들(DMb)은 매트릭스 형상으로 배열될 수 있다.
또한, 본 발명의 다른 예에 따르면, 제2 서브 홀들(SO2b)은 생략될 경우, 제2 홀(OP1b)이 제2 메인 홀들(SO1b)만을 포함할 수 있다. 이 경우, 제2 서브 댐부는 제2 메인 홀들(SO1b)들 중 서로 인접한 두 개의 메인 홀들에 의해 정의되며, 제2 방향(DR2)으로 연장된 형상으로 제공될 수 있다.
본 발명의 실시 예에 따르면, 베이스기판(SUB)의 제1 모서리를 통해 봉지층(TFL)으로 유입된 이물질은 제1 홀(OP1a) 및 제2 홀(OP1b)에 채워질 수 있다. 즉, 이물질이 제1 홀(OP1a) 및 제2 홀(OP1b)에 채워짐에 따라, 이물질이 표시 소자층(DP-OLED)으로 전달되는 것이 방지될 수 있다.
별도로 설명되지 않았지만, 베이스기판(SUB)의 제2 내지 제4 모서리들을 통해 봉지층(TFL)으로 유입된 이물질 역시 제2 내지 제4 댐홀들(OP2, OP3, OP4)에 의해 표시 소자층(DP-OLED)으로 전달되는 것이 방지될 수 있다. 제2 내지 제4 댐홀들(OP2, OP3, OP4)의 구조는 앞서 설명된 제1 댐홀(OP1)과 실질적으로 동일할 수 있다. 따라서, 이에 대한 설명은 생략한다.
도 8은 도 6에 도시된 I-I'를 따라 절단된 단면도이다.
도 8에서는 도 5b를 통해 설명된 베이스기판(SUB), 회로 소자층(DP-CL), 표시 소자층(DP-OLED), 및 봉지층(TFL)의 구조와 실질적으로 동일한 구조가 개시된다. 도 8에서는 회로 소자층(DP-CL)이 표시 소자층(DP-OLED)과 연결되는 제2 트랜지스터(T2), 스캔 구동회로(GDV)에 포함된 신호 라인들(GDV-SL), 및 전원 전극(PE)을 포함하는 것으로 설명된다. 신호 라인들(GDV-SL) 및 전원 전극(PE)은 비표시 영역(NDA)에 중첩하며 평탄화층(30) 상에 배치될 수 있다.
자세하게, 도 8을 참조하면, 앞서 도 7a를 통해 개시된 비표시 영역(NDA)에 중첩하며 제1 메인 홀들(SO1a) 및 제1 서브 홀들(SO2a)에 의해 정의된 제1 댐들(DMa)이 도시된다. 제1 댐들(DMa)은 제2 방향(DR2)에서 서로 이격될 수 있다.
본 발명의 실시 예에 따르면, 제1 댐들(DMa) 각각은 제1 층(L1) 및 제1 층(L1) 상에 배치된 제2 층(L2)을 포함한다. 제1 층(L1)은 평탄화층(30)과 동일한 두께 및 동일한 물질로 제공될 수 있다. 예컨대, 제1 층(L1)은 평탄화층(30)이 증착될 때 동시에 형성될 수 있다. 제2 층(L2)은 화소 정의막(PDL)과 동일한 두께 및 동일한 물질로 제공될 수 있다. 예컨대, 제2 층(L2)은 화소 정의막(PDL)이 증착될 때 동시에 형성될 수 있다.
특히, 본 발명에 따르면, 평면상에서, 제1 층(L1)의 면적은 제2 층(L2)의 면적 보다 클 수 있다. 따라서, 제1 층(L1) 및 제2 층(L2)으로 구성된 제1 댐들(DMa) 각각의 외면은 경사질 수 있다.
본 발명의 실시 예에 따르면, 봉지층(TFL)은 제1 댐들(DMa)을 전체적으로 커버할 수 있다. 이 경우, 봉지층(TFL)이 제1 댐들(DMa)을 커버함에 따라, 제1 댐들이 생략된 경우와 비교하여 봉지층(TFL)의 면적이 증가될 수 있다. 그 결과, 제1 댐들(DMa)이 배치된 모서리 부근에서, 봉지층(TFL)과 표시 소자층(DP-OLED) 간의 결합력이 향상될 수 있다.
제2 전극(CE)은 제1 댐들(DMa)을 전체적으로 커버하며 화소 정의막(PDL) 상에 배치될 수 있다. 봉지층(TFL)은 제1 댐들(DMa)을 전체적으로 커버하며 제2 전극(CE) 상에 배치될 수 있다.
제2 전극(CE)의 일 부분은 봉지층(TFL)과 중첩하며, 제2 전극(CE)의 다른 부분은 봉지층(TFL)과 비중첩하며 평탄화층(30) 상에 배치된 전원 전극(PE)에 연결될 수 있다. 전원 전극(PE)은 제2 전원 전압(ELVSS)을 제2 전극(CE)에 전달할 수 있다. 전원 전극(PE)은 봉지층(TFL)과 비중첩하며 비표시 영역(NDA)에 배치될 수 있다.
평면상에서 서로 이격된 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)은 전원 전극(PE) 상에 배치될 수 있다. 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)은 단층이거나 적층 구조로 제공될 수 있다. 도 8에 도시된 바에 따르면, 제1 외각 댐(DM1) 및 제2 외각 댐(DM2) 각각은 제1 댐들(DMa)과 동일한 구조 및 동일한 물질로 제공된 것으로 도시되었다. 다만, 이에 한정되지 않으며, 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)의 구조는 단층 구조로 제공되거나, 제1 댐들(DMa)과 다른 형상으로 제공될 수 있다.
제1 외각 댐(DM1)은 단층일 수 있고, 평탄화층(30) 및 화소 정의막(PDL)과 동시에 형성될 수 있다. 제1 외각 댐(DM1)은 평탄화층(30) 및 화소 정의막(PDL)과 동일한 공정에 의해 형성되므로 동일한 두께를 갖고 동일한 물질을 포함할 수 있다.
제2 외각 댐(DM2)은 제1 외각 댐(DM1)에 비해 베이스기판(SUB)의 끝단에 더 인접할 수 있다. 제2 외각 댐(DM2)은 제1 외각 댐(DM1)의 외측에 배치될 수 있다. 예컨대, 제1 외각 댐(DM1)과 표시 영역(DA) 사이의 최단 거리보다 제2 외각 댐(DM2)과 표시 영역(DA) 사이의 최단 거리보다 길 수 있다.
일 예에 따르면, 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)은 표시 영역(DA)을 에워쌀 수 있다. 다른 예에 따르면, 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)은 표시 영역(DA)의 적어도 일 영역에 인접할 수 있다.
또한, 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)은 앞서 상술된 본 발명의 제1 댐들(DMa)과 동일한 효과를 가질 수 있다.
봉지층(TFL)은 순차적으로 적층된 제1 무기층(IOL1), 유기층(OL) 및 제2 무기층(IOL2)을 포함할 수 있다.
제1 무기층(IOL1)은 제1 댐들(DMa)과 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)을 커버할 수 있다. 일 예로, 제1 무기층(IOL1)의 끝단은 제2 중간 무기막(20)에 접촉할 수 있다. 유기층(OL)은 제1 무기층(IOL1) 상에 배치되고, 제1 댐들(DMa)을 커버할 수 있다.
제2 무기층(IOL2)은 제1 댐들(DMa)과 제1 외각 댐(DM1) 및 제2 외각 댐(DM2)을 커버할 수 있다. 제2 무기층(IOL2)의 끝단은 제1 무기층(IOL1)에 접촉할 수 있다.
한편, 도시되지 않았지만, 제2 무기층(IOL2) 상에 입력 감지 유닛(TS)이 배치될 수 있다. 입력 감지 유닛(TS)은 표시 영역(DA)에 중첩하며 제2 무기층(IOL2) 상에 직접 배치되거나, 별도의 접착 부재를 통해 제2 무기층(IOL2) 상에 배치될 수 있다.
도 9는 본 발명의 다른 실시 예에 따른 표시패널의 베이스기판 및 봉지층을 보여주는 평면도이다.
도 9에 도시된 평면도는 도 6에 도시된 평면도와 비교하여, 제1 홀들(OP1a, OP2a, OP3a, OP4a) 및 제2 홀들(OP1b, OP2b, OP3b, OP4b)의 구조가 달라졌을 뿐, 나머지 구조는 실질적으로 동일할 수 있다.
본 발명의 실시 예에 따르면, 평면상에서 제1 서브 댐부 및 제2 서브 댐부는 서로 이격될 수 있다. 즉, 평면상에서, 제1 홀(OP1a) 및 제2 홀(OP1b)은 서로 이격될 수 있다.
이상에서와 같이 도면과 명세서에서 실시 예가 개시되었다. 여기서 특정한 용어들이 사용되었으나, 이는 단지 본 발명을 설명하기 위한 목적에서 사용된 것이지 의미 한정이나 특허 청구범위에 기재된 본 발명의 범위를 제한하기 위하여 사용된 것은 아니다. 그러므로 본 기술분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허 청구범위의 기술적 사상에 의해 정해져야 할 것이다.
DP: 표시패널
GDV: 스캔 구동부
DDV: 데이터 구동부
SUB: 베이스기판
DP-CL: 회로 소자층
DP-OLED: 표시 소자층
TFL: 절연층, 봉지층

Claims (20)

  1. 표시 영역 및 비표시 영역이 정의된 상면, 하면, 및 상기 상면과 상기 하면을 연결하는 복수 개의 측면들을 포함하는 베이스기판;
    상기 베이스기판 상에 배치된 평탄화층을 포함하는 회로 소자층;
    상기 평탄화층 상에 배치되고, 상기 표시 영역에 중첩하며 상기 평탄화층의 일부를 노출시키는 개구부를 포함하는 화소 정의막;
    상기 개구부에 의해 노출된 상기 평탄화층 상에 배치된 제1 전극, 상기 제1 전극 상에 배치된 발광층, 및 상기 발광층 상에 배치된 제2 전극을 포함하는 표시 소자층; 및
    상기 표시 소자층 상에 배치된 봉지층을 포함하고,
    상기 베이스기판의 평면상에서 상기 측면들 중 두 개의 측면들이 연결되는 모서리에 인접하고, 상기 비표시 영역에 중첩하며 상기 평탄화층 및 상기 화소 정의막 중 적어도 하나를 관통하는 댐홀이 정의된 표시모듈.
  2. 제 1 항에 있어서,
    상기 댐홀은 제1 방향으로 연장된 제1 홀 및 상기 제1 방향과 교차하는 제2 방향으로 연장된 제2 홀을 포함하는 표시모듈.
  3. 제 2 항에 있어서,
    상기 제1 홀은 상기 제1 방향으로 연장되고 상기 제2 방향으로 나열된 복수 개의 제1 메인 홀들을 포함하고,
    상기 제2 홀은 상기 제2 방향으로 연장되고 상기 제1 방향으로 나열된 복수 개의 제2 메인 홀들을 포함하는 표시모듈.
  4. 제 3 항에 있어서,
    상기 제1 홀은 상기 제1 메인 홀들과 교차하며, 상기 제1 방향으로 나열되고 상기 제2 방향으로 연장된 복수 개의 제1 서브 홀들을 더 포함하고,
    상기 제2 홀은 상기 제2 메인 홀들과 교차하며, 상기 제1 방향으로 연장되고 상기 제2 방향으로 나열된 복수 개의 제2 서브 홀들을 더 포함하는 표시모듈.
  5. 제 2 항에 있어서,
    상기 평면상에서, 상기 제1 홀 및 상기 제2 홀은 서로 이격되는 표시모듈.
  6. 제 1 항에 있어서,
    상기 측면들은 제1 방향에서 마주하는 제1 측면과 제3 측면 및 상기 제1 방향과 교차하는 제2 방향에서 마주하는 제2 측면 및 제4 측면들을 포함하고,
    상기 댐홀은,
    상기 제1 측면 및 상기 제2 측면이 연결되는 제1 모서리에 인접한 제1 댐홀;
    상기 제2 측면 및 상기 제3 측면이 연결되는 제2 모서리에 인접한 제2 댐홀;
    상기 제3 측면 및 상기 제4 측면이 연결되는 제3 모서리에 인접한 제3 댐홀; 및
    상기 제4 측면 및 상기 제1 측면이 연결되는 제4 모서리에 인접한 제4 댐홀을 포함하는 표시모듈.
  7. 제 5 항에 있어서,
    상기 평면상에서, 상기 제1 내지 제4 댐홀들은 서로 이격되는 표시모듈.
  8. 제 1 항에 있어서,
    상기 봉지층은 상기 댐홀을 전체적으로 커버하며 상기 화소 정의막 상에 배치되는 표시모듈.
  9. 제 1 항에 있어서,
    상기 제2 전극의 일 부분은 상기 댐홀을 전체적으로 커버하는 상기 봉지층과 중첩하고, 상기 제2 전극은 다른 부분은 상기 봉지층과 비중첩하는 표시모듈.
  10. 제 9 항에 있어서,
    상기 회로 소자층은 상기 비표시 영역에 중첩하며 상기 평탄화층 상에 배치된 전원 전극을 더 포함하고,
    상기 제2 전극의 다른 부분은 상기 전원 전극에 연결된 표시모듈.
  11. 제 1 항에 있어서,
    상기 회로 소자층은 복수 개의 박막 트랜지스터들을 포함하고,
    상기 박막 트랜지스터 각각은, 상기 제1 전극과 연결되는 화소 전극을 포함하고,
    상기 화소 전극은 상기 평탄화층에 의해 직접적으로 커버되는 표시모듈.
  12. 표시 영역 및 비표시 영역이 정의된 상면, 하면, 및 상기 상면과 상기 하면을 연결하는 복수 개의 측면들을 포함하는 베이스기판;
    상기 베이스기판 상에 배치된 평탄화층을 포함하는 회로 소자층;
    상기 평탄화층 상에 배치되고, 상기 표시 영역에 중첩하며 상기 평탄화층의 일부를 노출시키는 개구부를 포함하는 화소 정의막;
    상기 개구부에 의해 노출된 상기 평탄화층 상에 배치된 제1 전극, 상기 제1 전극 상에 배치된 발광층, 및 상기 발광층 상에 배치된 제2 전극을 포함하는 표시 소자층;
    상기 비표시 영역에 중첩하고, 제1 방향으로 연장되며 상기 평탄화층 및 상기 화소 정의막을 관통하는 제1 홀 및 상기 제1 방향과 교차하는 제2 방향으로 연장되며 상기 평탄화층 및 상기 화소 정의막을 관통하는 제2 홀에 의해 정의된 댐부; 및
    상기 댐부를 커버하며 상기 표시 소자층 상에 배치된 봉지층을 포함하는 표시모듈.
  13. 제 12 항에 있어서
    상기 댐부는 복수 개의 댐들을 포함하고,
    상기 댐들 각각은
    상기 평탄화층과 동일한 두께 및 동일한 물질로 제공된 제1 층; 및
    상기 제1 층 상에 배치되고, 상기 화소 정의막과 동일한 두께 및 동일한 물질로 제공된 제2 층을 포함하는 표시모듈.
  14. 제 13 항에 있어서,
    상기 베이스기판의 평면상에서, 상기 제1 층의 면적은 상기 제2 층의 면적보다 큰 것을 특징으로 하는 표시모듈.
  15. 제 12 항에 있어서,
    상기 댐부는 상기 제1 측면과 평행한 제1 서브 댐부 및 상기 제2 측면과 평행한 제2 서브 댐부를 포함하는 표시모듈.
  16. 제 15 항에 있어서,
    상기 베이스기판의 평면상에서, 상기 제1 서브 댐부 및 상기 제2 서브 댐부는 서로 이격된 표시모듈.
  17. 제 12 항에 있어서,
    상기 제1 홀은 상기 제2 방향에서 이격된 복수 개의 제1 서브 홀들을 포함하고, 상기 제2 홀은 상기 제1 방향에서 이격된 복수 개의 제2 서브 홀들을 포함하는 표시모듈.
  18. 제 12 항에 있어서,
    상기 댐부는 상기 베이스기판의 평면상에서 상기 측면들 중 두 개의 측면들이 연결되는 모서리에 인접하는 표시모듈.
  19. 제 18 항에 있어서,
    상기 베이스기판의 평면상에서, 상기 봉지층과 비중첩하며 상기 모서리 및 상기 댐부 사이에 배치된 외각 댐부를 더 포함하는 표시모듈.
  20. 제 19 항에 있어서,
    상기 외각 댐부는 상기 표시 영역을 에워싸는 표시모듈.
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