KR20200007112A - 게이트 구동 장치 및 이를 포함하는 표시 장치 - Google Patents

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Abstract

표시 장치는 복수의 화소들을 포함하는 표시 패널, 게이트 구동 전압을 생성하는 전압 생성부, 클럭 제어 신호를 생성하는 타이밍 제어부, 게이트 구동 전압 및 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성하는 게이트 제어부, 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하는 게이트 구동부, 게이트 클럭 신호에 상응하는 게이트 클럭 전류가 기준 전류 이상인 경우 전압 생성부를 셧다운시키는 셧다운 제어 신호를 출력하는 과전류 보호 회로 및 클럭 제어 신호의 이상 여부를 검출하고, 클럭 제어 신호가 비정상(abnormal)인 경우 과전류 보호 회로에서 셧다운 제어 신호가 출력되는 것을 지연시키는 이상 신호 검출부를 포함한다.

Description

게이트 구동 장치 및 이를 포함하는 표시 장치 {DISPLAY DEVICE AND DRIVING METHOD OF THE SAME}
본 발명은 게이트 구동 장치 및 이를 포함하는 표시 장치에 관한 것이다.
최근, 음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시 장치들이 개발되고 있다. 평판 표시 장치로는 액정 표시 장치(Liquid Crystal Display; LCD), 전계 방출 표시 장치(Field Emission Display; FED), 플라즈마 표시 패널(Plasma Display Panel; PDP) 및 유기 발광 표시 장치(Organic Light Emitting Display; OLED) 등이 있다.
표시 장치는 영상을 표시하는 표시 패널 및 이를 구동하기 위한 구동부를 포함한다. 예를 들어, 액정 표시 장치는 복수의 게이트 라인들 및 상기 게이트 라인들과 교차하는 데이터 라인들에 의해 복수의 화소부가 형성된 액정 표시 패널, 상기 게이트 라인들에 게이트 신호를 출력하는 게이트 구동부 및 상기 데이터 라인들에 데이터 신호를 출력하는 데이터 구동부를 포함한다.
표시 장치의 구동 시 게이트 구동부의 신호 이상 또는 배선의 쇼트 등으로 인해 과전류가 흐르는 경우, 표시 장치의 전원을 셧다운시키는 과전류 보호(over current protection; OCP) 회로가 사용되고 있다. 과전류 보호 회로에 의해 셧다운된 전원부는 표시 장치 내의 소자들을 보호하기 위해 다시 동작하지 않을 수 있다. 이 때, 순간적인 정전기 또는 서지(surge) 등에 의해 일시적으로 이상 신호가 발생하는 경우에도 전원부가 셧다운되어, 신호가 정상적으로 돌아오더라도 표시 장치가 동작하지 않는 문제점이 있다.
본 발명의 일 목적은 게이트 구동부의 비정상(abnormal) 신호에 의한 과전류 보호 회로의 동작을 지연시키는 게이트 구동 장치를 제공하는 것이다.
본 발명의 다른 목적은 게이트 구동부의 비정상(abnormal) 신호에 의한 과전류 보호 회로의 동작을 지연시키는 표시 장치를 제공하는 것이다.
그러나, 본 발명이 목적은 상술한 목적으로 한정되는 것은 아니며, 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위에서 다양하게 확장될 수 있을 것이다.
본 발명의 일 목적을 달성하기 위하여, 본 발명의 실시예들에 따른 표시 장치는 복수의 화소들을 포함하는 표시 패널, 게이트 구동 전압을 생성하는 전압 생성부, 제1 구간에서 제1 레벨을 갖고, 제2 구간에서 상기 제1 레벨보다 낮은 제2 레벨을 갖는 클럭 제어 신호를 생성하는 타이밍 제어부, 상기 게이트 구동 전압 및 상기 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성하는 게이트 제어부, 상기 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하고, 상기 게이트 신호를 상기 화소들에 공급하는 게이트 구동부, 상기 게이트 클럭 신호들에 상응하는 게이트 클럭 전류를 감지하고, 상기 게이트 클럭 전류가 기 설정된 기준 전류 이상인 경우 상기 전압 생성부를 셧다운시키는 셧다운 제어 신호를 출력하는 과전류 보호 회로 및 기 설정된 기준 신호와 상기 클럭 제어 신호의 차에 기초하여 상기 클럭 제어 신호의 이상 여부를 검출하고, 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로에서 상기 셧다운 제어 신호가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호를 출력하는 이상 신호 검출부를 포함할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 제1 구간에서 상기 제1 레벨을 갖는 상기 클럭 제어 신호와 상기 기준 신호를 비교하고, 상기 제2 구간에서 상기 제2 레벨을 갖는 상기 클럭 제어 신호의 반전(inversion) 신호와 상기 기준 신호를 비교할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호가 입력되는 제1 입력단, 상기 클럭 제어 신호가 공급되는 제2 입력단 및 상기 기준 신호와 상기 클럭 제어 신호의 비교결과를 출력하는 출력단을 포함하는 비교기, 상기 클럭 제어 신호를 입력받고, 상기 제1 구간에서 턴온되며, 상기 제2 입력단과 연결되는 제1 스위치, 상기 클럭 제어 신호를 입력받고, 상기 제2 구간에서 턴온되는 제2 스위치 및 상기 제2 스위치와 상기 제2 입력단 사이에 연결되는 인버터를 포함할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호의 차가 기 설정된 임계값 이상인 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호가 상이한 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단할 수 있다.
일 실시예에 의하면, 상기 기준 신호는 상기 클럭 제어 신호의 상기 제1 레벨과 동일한 레벨을 가질 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 기 설정된 시간 동안 상기 과전류 보호 회로가 상기 셧다운 제어 신호를 출력하지 못하도록 할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로의 동작 전원을 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로와 상기 전압 생성부 사이에 연결되는 제3 스위치를 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 게이트 제어부와 상기 과전류 보호 회로 사이에 연결되는 제4 스위치를 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
본 발명의 다른 목적을 달성하기 위하여, 본 발명의 실시예들에 따른 게이트 구동 장치는 게이트 구동 전압을 생성하는 전압 생성부, 상기 구동 전압 및 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성하는 게이트 제어부, 상기 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하는 게이트 구동부, 상기 게이트 클럭 신호들에 상응하는 게이트 클럭 전류를 감지하고, 상기 게이트 클럭 전류가 기 설정된 기준 전류 이상인 경우 상기 전압 생성부는 셧다운시키는 셧다운 제어 신호를 출력하는 과전류 보호 회로 및 기 설정된 기준 신호와 상기 클럭 제어 신호의 차에 기초하여 상기 클럭 제어 신호의 이상 여부를 검출하고, 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로에서 상기 셧다운 제어 신호가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호를 출력하는 이상 신호 검출부를 포함할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 제1 구간에서 상기 제1 레벨을 갖는 상기 클럭 제어 신호와 상기 기준 신호를 비교하고, 상기 제2 구간에서 상기 제2 레벨을 갖는 상기 클럭 제어 신호의 반전(inversion) 신호와 상기 기준 신호를 비교할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호가 입력되는 제1 입력단, 상기 클럭 제어 신호가 공급되는 제2 입력단 및 상기 기준 신호와 상기 클럭 제어 신호의 비교 결과를 출력하는 출력단을 포함하는 비교기, 상기 클럭 제어 신호를 입력받고, 상기 제1 구간에서 턴온되며, 상기 제2 입력단과 연결되는 제1 스위치, 상기 클럭 제어 신호를 입력받고, 상기 제2 구간에서 턴온되는 제2 스위치 및 상기 제2 스위치와 상기 제2 입력단 사이에 연결되는 인버터를 포함할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호의 차가 기 설정된 임계값 이상인 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호가 상이한 경우, 상기 클럭 제어 신호가 비정상(abnormal)일 수 있다.
일 실시예에 의하면, 상기 기준 신호는 상기 클럭 제어 신호의 상기 제1 레벨과 동일한 레벨을 가질 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 기 설정된 시간 동안 상기 과전류 보호 회로가 상기 셧다운 제어 신호를 출력하지 못하도록 할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로의 동작 전원을 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로와 상기 전압 생성부 사이에 연결되는 제3 스위치를 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
일 실시예에 의하면, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 게이트 제어부와 상기 과전류 보호 회로 사이에 연결되는 제4 스위치를 턴오프시키는 상기 지연 제어 신호를 출력할 수 있다.
본 발명의 실시예들에 따른 게이트 구동 장치 및 이를 포함하는 표시 장치는 클럭 제어 신호의 이상 여부를 검출하고, 클럭 제어 신호가 비정상인 경우, 과전류 보호 회로의 동작을 지연시킴으로써, 일시적인 비정상 신호로 인해 전압 생성부가 셧다운되는 것을 방지할 수 있다. 따라서, 전압 생성부의 셧다운으로 인한 불량을 방지할 수 있다.
도 1은 본 발명의 실시예들에 따른 표시 장치를 나타내는 블록도이다.
도 2는 도 1의 표시 장치에 포함되는 게이트 제어부의 동작을 설명하기 위한 타이밍도이다.
도 3은 도 1의 표시 장치에 포함되는 과전류 검출 회로의 동작을 설명하기 위한 도면이다.
도 4는 도 1의 표시 장치에 포함되는 이상 신호 검출부의 일 예를 나타내는 블록도이다.
도 5a 내지 도 5c는 도 1의 표시 장치에 포함되는 이상 신호 검출부의 동작을 설명하기 위한 도면들이다.
도 6은 도 1의 표시 장치를 포함하는 전자 기기를 나타내는 블록도이다.
도 7은 도 6의 전자 기기가 스마트폰으로 구현되는 일 예를 나타내는 도면이다.
이하, 첨부한 도면들을 참조하여, 본 발명의 바람직한 실시예를 보다 상세하게 설명하고자 한다. 도면상의 동일한 구성요소에 대해서는 동일한 참조부호를 사용하고 동일한 구성요소에 대해서 중복된 설명은 생략한다.
도 1은 본 발명의 실시예들에 따른 표시 장치를 나타내는 블록도이다. 도 2는 도 1의 표시 장치에 포함되는 게이트 제어부의 동작을 설명하기 위한 타이밍도이다. 도 3은 도 1의 표시 장치에 포함되는 과전류 검출 회로의 동작을 설명하기 위한 도면이다.
도 1을 참조하면, 표시 장치(100)는 표시 패널(110), 전압 생성부(120), 타이밍 제어부(130), 게이트 제어부(140), 게이트 구동부(150), 과전류 보호 회로(160), 이상 신호 검출부(170) 및 데이터 구동부(180)를 포함할 수 있다.
표시 패널(110)은 데이터 라인(DL)들, 게이트 라인(GL)들 및 복수의 화소(PX)들을 포함할 수 있다. 게이트 라인(GL)들은 제1 방향(D1)으로 연장하고, 제1 방향(D1)에 수직한 제2 방향(D2)으로 배열될 수 있다. 데이터 라인(DL)들은 제2 방향(D2)으로 연장하고, 제1 방향(D1)으로 배열될 수 있다. 제1 방향(D1)은 표시 패널(110)의 장변과 평행할 수 있고, 제2 방향(D2)은 표시 패널(110)의 단변과 평행할 수 있다. 각각의 화소(PX)들은 데이터 라인(DL)들과 게이트 라인(GL)들이 교차되는 영역에 형성될 수 있다. 일 실시예에서, 각각의 화소(PX)들은 게이트 라인(GL) 및 데이터 라인(DL)에 전기적으로 연결된 박막 트랜지스터, 박막 트랜지스터에 연결된 액정 캐패시터 및 스토리지 캐패시터를 포함할 수 있다. 따라서, 상기 표시 패널(110)은 액정 표시 패널일 수 있고, 상기 표시 장치(100)는 액정 표시 장치일 수 있다. 다른 실시예에서, 각각의 화소(PX)들은 게이트 라인(GL) 및 데이터 라인(DL)에 전기적으로 연결된 박막 트랜지스터, 박막 트랜지스터에 연결된 저장 캐패시터, 저장 캐패시터에 연결된 구동 트랜지스터, 및 구동 트랜지스터에 연결되는 유기 발광 다이오드를 포함할 수 있다. 따라서, 상기 표시 패널(110)은 유기 발광 표시 패널일 수 있고, 상기 표시 장치(100)는 유기 발광 표시 장치일 수 있다. 표시 패널(110)은 표시 영역(DA) 및 비표시 영역(NDA)을 포함할 수 있다. 표시 영역(DA)에는 상기 화소(PX)들이 형성되어 영상을 표시할 수 있다. 비표시 영역(NDA)에는 상기 화소(PX)들을 동작시키기 위한 신호를 생성하거나 공급하는 회로 및 배선들이 형성될 수 있다.
전압 생성부(120)는 외부로부터 직류 전원(VDD)을 공급받아 표시 패널(110)을 동작시키는데 필요한 복수 개의 전압들을 생성할 수 있다. 전압 생성부(120)는 게이트 제어부(140)에 공급되는 게이트 구동 전압(DVG), 데이터 구동부(180)에 공급되는 데이터 구동 전압(DVD) 및 표시 패널(110)에 공급되는 패널 구동 전압을 생성할 수 있다. 예를 들어, 전압 생성부(120)는 게이트 온 전압 및 게이트 오프 전압을 포함하는 게이트 구동 전압(DVG)을 생성하여 게이트 제어부(140)에 공급할 수 있다. 게이트 온 전압 및 게이트 오프 전압은 게이트 라인(GL)에 인가되는 게이트 신호를 생성하기 위한 구동 전압이다. 전압 생성부(120)는 아날로그 전원 전압, 디지털 전원 전압 등을 포함하는 데이터 구동 전압(DVD)을 생성하여 데이터 구동부(180)에 공급할 수 있다. 아날로그 전원 전압 및 디지털 전원 전압은 데이터 라인(DL)에 인가되는 데이터 신호(DS)를 생성하기 위한 구동 전압이다. 전압 생성부(120)는 공통 전압, 스토리지 전압 등을 포함하는 패널 구동 전압을 생성하여 표시 패널(110)에 공급할 수 있다. 공통 전압은 화소(PX)에 포함되는 액정 캐패시터에 인가되는 구동 전압이고, 스토리지 전압은 화소(PX)에 포함되는 스토리지 캐패시터에 인가되는 구동 전압일 수 있다. 스토리지 전압은 공통 전압과 동일할 수 있다.
타이밍 제어부(130)는 게이트 제어부(140)를 제어하는 클럭 제어 신호(CPV)를 생성할 수 있다. 타이밍 제어부(130)는 외부 장치로부터 제어 신호를 수신하고, 게이트 제어부(140)에 공급되는 수직 개시 신호(STV) 및 클럭 제어 신호(CPV)를 생성할 수 있다. 예를 들어, 클럭 제어 신호(CPV)는 제1 구간에서 제1 레벨을 갖고, 제2 구간에서 제1 레벨보다 낮은 제2 레벨을 가질 수 있다. 타이밍 제어부(130)는 수직 개시 신호(STV) 및 클럭 제어 신호(CPV)를 게이트 제어부(140)로 공급할 수 있다. 또한, 타이밍 제어부(130)는 데이터 구동부(180)를 제어하는 수평 개시 신호 및 데이터 클럭 신호를 생성할 수 있다. 타이밍 제어부(130)는 외부 장치에서 공급되는 제1 영상 데이터를 제2 영상 데이터로 변환할 수 있다. 예를 들어, 타이밍 제어부(130)는 제1 영상 데이터의 화질을 보정하는 알고리즘을 적용하여 제1 영상 데이터를 제2 영상 데이터로 변환할 수 있다. 타이밍 제어부(130)는 수평 개시 신호, 데이터 클럭 신호 및 제2 영상 데이터를 데이터 구동부(180)로 공급할 수 있다.
게이트 제어부(140)는 게이트 구동 전압(DVG) 및 클럭 제어 신호(CPV)에 기초하여 게이트 클럭 신호들(CKG)을 생성할 수 있다. 게이트 제어부(140)는 전압 생성부(120)로부터 게이트 온 전압 및 게이트 오프 전압을 포함하는 게이트 구동 전압(DVG)을 수신할 수 있다. 또한, 게이트 제어부(140)는 타이밍 제어부(130)로부터 수직 개시 신호(STV) 및 클럭 제어 신호(CPV)를 수신할 수 있다. 게이트 제어부(140)는 타이밍 제어부(130)로부터 적어도 하나 이상의 클럭 제어 신호(CPV)를 공급받을 수 있다. 예를 들어, 게이트 제어부(140)는 타이밍 제어부(130)로부터 제1 클럭 제어 신호 및 제2 클럭 제어 신호를 공급받을 수 있다. 게이트 제어부(140)는 클럭 제어 신호(CPV)에 기초하여 게이트 온 전압과 게이트 오프 전압 사이를 스윙하는 게이트 클럭 신호들(CKG)을 생성할 수 있다. 예를 들어, 게이트 클럭 신호들(CKG)은 클럭 신호 및 클럭바 신호를 포함할 수 있다.
도 2를 참조하면, 게이트 제어부(140)는 타이밍 제어부(130)에서 제공된 클럭 제어 신호(CPV)에 응답하여 게이트 온 전압(Von) 및 게이트 오프 전압(Voff)을 이용하여 게이트 클럭 신호들(CKG) (즉, 클럭 신호(CKV) 및 클럭바 신호(CKVB))를 생성할 수 있다. 하나의 프레임은 액티브 구간(AP) 및 블랭크 구간(BP)을 포함할 수 있다. 클럭 제어 신호(CPV)는 액티브 구간(AP) 동안 제1 레벨(LV1)의 전압과 제2 레벨(LV2)의 전압 사이를 스윙하고, 블랭크 구간(BP)에서 제2 레벨(LV2)의 전압을 가질 수 있다. 클럭 신호(CKV) 및 클럭바 신호(CKVB)는 클럭 제어 신호(CPV)에 응답하여 액티브 구간(AP) 동안 게이트 온 전압(Von)과 게이트 오프 전압(Voff) 사이를 스윙하고, 블랭크 구간(BP) 동안 게이트 오프 전압(Voff)을 가질 수 있다. 이 때, 클럭 신호(CKV)와 클럭바 신호(CKVB)는 반대의 위상을 가질 수 있다. 클럭 신호(CKV) 및 클럭바 신호(CKVB)의 게이트 온 전압(Von)은 클럭 제어 신호(CPV)의 제1 레벨(LV1)보다 높고, 클럭 신호(CKV) 및 클럭바 신호(CKVB)의 게이트 오프 전압(Voff)은 클럭 제어 신호(CPV)의 제2 레벨(LV2)보다 낮을 수 있다. 정전기 또는 순간적인 서지(surge) 등에 의해 게이트 제어부(140)에 비정상(abnormal)적인 클럭 제어 신호(CPV)가 공급될 수 있다. 클럭 신호(CKV) 및 클럭바 신호(CKVB)는 클럭 제어 신호(CPV)에 응답하여 생성되므로, 비정상적인 클럭 제어 신호(CPV)가 공급되는 경우, 비정상적인 클럭 신호(CKV) 및 클럭바 신호(CKVB)가 출력될 수 있다. 비정상적인 클럭 제어 신호(CPV)는 동일 프레임 내에서 또는 블랭크 구간(BP)을 지나면서 정상적으로 회복될 수 있다. 클럭 제어 신호(CPV)가 정상적으로 출력되는 경우, 클럭 신호(CKV) 및 클럭바 신호(CKVB) 또한 게이트 온 전압(Von)과 게이트 오프 전압(Voff) 사이를 스윙하는 정상적인 신호로 출력될 수 있다.
게이트 구동부(150)는 게이트 클럭 신호들(CKG)에 기초하여 게이트 신호를 생성하고, 게이트 라인(GL)을 통해 상기 게이트 신호를 화소(PX)들에 공급할 수 있다. 게이트 구동부(150)는 표시 패널(110)의 비표시 영역(NDA)에 형성될 수 있다. 게이트 구동부(150)는 게이트 클럭 신호(CKG)들에 동기된 복수의 게이트 신호들을 순차적으로 출력할 수 있다. 게이트 구동부(150)는 복수의 스테이지(152, 154)들을 포함할 수 있다. 각각의 스테이지(152, 154)는 게이트 제어부(140)로부터 게이트 클럭 신호들(CKG)(예를 들어, 클럭 신호 및 클럭바 신호)을 공급받을 수 있다. 각각의 스테이지(152, 154)들은 표시 영역(DA)으로 연장되는 게이트 라인(GL)들의 일단부와 연결될 수 있다. 예를 들어, 제1 스테이지(152)는 게이트 클럭 신호들(CKG)에 기초하여 제1 게이트 신호를 생성하고, 제1 행에 제1 방향으로 배치되는 화소(PX)들과 연결되는 제1 게이트 라인(GL)을 통해 제1 게이트 신호를 공급할 수 있다. 또한, 제2 스테이지(154)는 게이트 클럭 신호들(CKG)에 기초하여 제2 게이트 신호를 생성하고, 제2 행에 제1 방향(D1)으로 배치되는 화소(PX)들과 연결되는 제2 게이트 라인(GL)을 통해 제2 게이트 신호를 공급할 수 있다. 게이트 구동부(150)의 스테이지들(152, 154)은 이와 같은 방법으로 게이트 라인(GL)들에 순차적으로 게이트 신호를 공급할 수 있다.
게이트 구동부(150)는 복수의 구동 칩들로 형성되어 가요성 인쇄회로 기판 상에 실장되고, 테이프 캐리어 패키지(Tape Carrier Package; TCP) 방식으로 표시 패널(110)에 연결될 수 있다. 또는, 게이트 구동부(150)는 복수의 구동 칩들로 형성되어 표시 패널(110)의 비표시 영역(NDA)에 칩 온 클래스(Chip on Glass; COG) 방식으로 실장될 수 있다. 또는, 게이트 구동부(150)는 화소(PX)들의 트랜지스터들과 함께 동시에 형성되어 ASG(Amorphous Silicon TFT Gate driver circuit) 또는 OSG(Oxide Silicon TFT Gate driver circuit) 형태로 표시 패널(110)에 실장될 수 있다.
과전류 보호 회로(160)는 게이트 클럭 신호들(CKG)에 상응하는 게이트 클럭 전류(IG)를 감지하고, 게이트 클럭 전류(IG)가 기 설정된 기준 전류 이상인 경우 전압 생성부(120)를 셧다운시키는 셧다운 제어 신호(CTL_SHUT)를 출력할 수 있다. 과전류 보호 회로(160)는 매 프레임마다 게이트 클럭 신호들(CKG)의 게이트 클럭 전류(IG)를 감지할 수 있다. 도 3을 참조하면, 과전류 보호 회로(160)는 게이트 클럭 전류(IG)가 기준 전류(IR) 이상인 경우 게이트 제어부(140)에 과전류가 발생한 것으로 판단할 수 있다. 과전류 보호 회로(160)는 게이트 제어부(140)에 과전류가 발생한 것으로 판단되는 경우, 전압 생성부(120)를 셧다운시키는 셧다운 제어 신호(CTL_SHUT)를 출력할 수 있다. 전압 생성부(120)는 셧다운 제어 신호(CTL_SHUT)에 응답하여 게이트 구동 전압(DVG)을 출력하지 않고, 게이트 제어부(140)의 동작을 정지시킴으로써, 표시 장치(100)의 소자들의 손상이 방지될 수 있다. 예를 들어, 전압 생성부(120)는 셧다운 제어 신호(CTL_SHUT)에 응답하여 외부로부터 공급되는 직류 전원을 차단 또는 공급하는 스위치(125)를 포함할 수 있다. 셧다운 제어 신호(CTL_SHUT)에 응답하여 상기 스위치(125)가 턴오프되는 경우, 게이트 구동 전압(DVG) 및 데이터 구동 전압(DVD)이 생성되지 않을 수 있다.
이상 신호 검출부(170)는 기 설정된 기준 신호와 클럭 제어 신호(CPV)의 차에 기초하여 클럭 제어 신호(CPV)의 이상 여부를 검출하고, 클럭 제어 신호(CPV)가 비정상인 경우, 과전류 보호 회로(160)에서 셧다운 제어 신호(CTL_SHUT)가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 게이트 제어부(140) 내의 배선 간의 쇼트 또는 정전기 등으로 인한 비정상 신호로 인해 게이트 제어부(140)의 과전류가 감지될 수 있다. 도 2에 도시된 바와 같이, 클럭 제어 신호(CPV)는 정전기, 서지 등에 의해 일시적으로 비정상적으로 출력되더라도, 소정의 시간이 흐르면서 정상적으로 회복될 수 있다. 이상 신호 검출부(170)는 비정상적인 클럭 제어 신호(CPV)가 정상으로 회복되는 시간 동안 과전류 보호 회로(160)에서 셧다운 제어 신호(CTL_SHUT)가 출력되는 것을 지연시킴으로써, 전압 생성부(120)가 즉각적으로 셧다운되는 것을 방지할 수 있다. 예를 들어, 이상 신호 검출부(170)는 1프레임 또는 2 프레임 동안 지연 제어 신호(CTL_D)를 출력할 수 있다.
이상 신호 검출부(170)는 제1 구간에서 제1 레벨을 갖는 클럭 제어 신호(CPV)와 기준 신호를 비교하고, 제2 구간에서 제2 레벨을 갖는 클럭 제어 신호(CPV)의 반전 신호와 기준 신호를 비교하여 클럭 제어 신호(CPV)의 이상 여부를 검출할 수 있다. 일 실시예에서, 이상 신호 검출부(170)는 기준 신호와 클럭 제어 신호(CPV)의 차가 기 설정된 임계값 이상인 경우, 클럭 제어 신호(CPV)가 비정상인 것으로 판단할 수 있다. 다른 실시예에서, 이상 신호 검출부(170)는 기준 신호와 클럭 제어 신호(CPV)가 상이한 경우, 클럭 제어 신호(CPV)가 비정상적인 것으로 판단할 수 있다. 이 때, 기준 신호는 클럭 제어 신호(CPV)의 제1 레벨과 동일한 레벨을 가질 수 있다. 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상인 것으로 판단되는 경우, 기 설정된 시간 동안 과전류 보호 회로(160)가 셧다운 제어 신호(CTL_SHUT)를 출력하지 못하도록 할 수 있다. 일 실시예에서, 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상적인 경우, 과전류 보호 회로(160)의 동작 전원을 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 다른 실시예에서, 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상적인 경우, 과전류 보호 회로(160)와 전압 생성부(120) 사이에 연결되는 스위치를 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 또 다른 실시예에서, 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상인 경우, 게이트 제어부(140)와 과전류 보호 회로(160) 사이에 연결되는 제4 스위치를 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다.
과전류 보호 회로(160)는 과전류가 감지되더라도 이상 신호 검출부(170)에서 공급되는 지연 제어 신호(CTL_D)에 응답하여 기 설정된 시간이 경과한 후 셧다운 제어 신호(CTL_SHUT)를 출력할 수 있다. 따라서, 일시적으로 비정상 신호가 공급되는 경우 전압 생성부(120)를 셧다운시키는 것을 방지할 수 있다. 한편, 과전류 보호 회로(160)는 과전류가 감지되고, 이상 신호 검출부(170)에서 지연 제어 신호(CTL_D)가 공급되지 않는 경우, 배선 간 쇼트가 발생한 것으로 판단하고, 즉각적으로 셧다운 제어 신호(CTL_SHUT)를 출력함으로써, 표시 장치(100) 내의 소자들이 손상되는 것을 방지할 수 있다.
도 1에는 게이트 구동 전압(DVG)을 생성하는 전압 생성부(120), 게이트 클럭 신호들(CKG)을 생성하는 게이트 제어부(140), 게이트 신호를 생성하는 게이트 구동부(150), 게이트 클럭 신호들(CKG)의 과전류를 검출하고, 전압 생성부(120)를 셧다운시키는 과전류 보호 회로(160) 및 이상 신호 검출 시 과전류 보호 회로(160)의 동작을 지연시키는 이상 신호 검출부(170)를 각각의 구성 요소로 도시하였으나, 상기 전압 생성부(120), 게이트 제어부(140), 게이트 구동부(150), 과전류 보호 회로(160) 및 이상 신호 검출부(170)는 하나의 게이트 구동 장치로 구현될 수도 있다.
데이터 구동부(180)는 데이터 라인(DL)을 통해 데이터 신호(DS)를 화소들에 공급할 수 있다. 데이터 구동부(180)는 타이밍 제어부(130)에서 공급되는 데이터 제어 신호 및 제2 영상 데이터에 기초하여 데이터 신호(DS)들을 생성할 수 있다. 데이터 제어 신호는 수평 개시 신호 및 데이터 클럭 신호를 포함할 수 있다. 데이터 구동부(180)는 타이밍 제어부(130)로부터 공급되는 수평 개시 신호 및 데이터 클럭 신호에 응답하여 제2 영상 데이터에 상응하는 데이터 신호(DS)를 표시 패널의 데이터 라인들로 출력할 수 있다.
상술한 바와 같이, 도 1의 표시 장치(100)는 클럭 제어 신호(CPV)의 이상 여부를 검출하고, 클럭 제어 신호(CPV)가 비정상으로 공급되는 경우, 과전류 보호 회로(160)의 동작을 지연시킴으로써, 일시적인 비정상 신호로 인해 전압 생성부(120)가 셧다운되는 것을 방지할 수 있다. 따라서, 전압 생성부(120)의 셧다운으로 인한 불량을 방지할 수 있다.
도 4는 도 1의 표시 장치에 포함되는 이상 신호 검출부의 일 예를 나타내는 블록도이다.
도 4를 참조하면, 이상 신호 검출부(170)는 비교기(171), 제1 스위치(172), 제2 스위치(173) 및 인버터(inverter)(174)를 포함할 수 있다.
비교기(171)는 제1 입력단(IN1), 제2 입력단(IN2) 및 출력단(OUT)을 포함할 수 있다. 제1 입력단(IN1)을 통해 기준 신호(S_REF)가 입력되고, 제2 입력단(IN2)을 통해 클럭 제어 신호(CPV)가 공급되며, 출력단(OUT)을 통해 기준 신호(S_REF)와 클럭 제어 신호(CPV)의 비교 결과가 지연 제어 신호(CTL_D)로써 출력될 수 있다.
기준 신호(S_REF)는 클럭 제어 신호(CPV)의 제1 레벨과 동일한 레벨을 갖고, 제1 입력단(IN1)을 통해 비교기(171)에 공급될 수 있다. 클럭 제어 신호(CPV)는 제1 구간 및 제2 구간을 포함할 수 있다. 제1 구간 동안 제1 레벨을 갖는 클럭 제어 신호(CPV)가 출력되고, 제2 구간 동안 제2 레벨을 갖는 클럭 제어 신호(CPV)가 출력될 수 있다. 제1 스위치(172)는 클럭 제어 신호(CPV)를 입력받고, 제1 구간에서 턴온되며, 제2 입력단(IN2)과 연결될 수 있다. 즉, 제1 구간 동안 제1 스위치(172)가 턴온되어 제1 스위치(172)를 통해 제1 레벨을 갖는 클럭 제어 신호(CPV)가 제2 입력단(IN2)에 제공될 수 있다. 제2 스위치(173)는 클럭 제어 신호(CPV)를 입력받고, 제2 구간에서 턴온될 수 있다. 또한, 인버터(174)는 제2 스위치(173)와 제2 입력단(IN2) 사이에 연결될 수 있다. 즉, 제2 구간 동안 제2 스위치(173)가 턴온되어 제2 스위치(173)를 통해 제2 레벨을 갖는 클럭 제어 신호(CPV)가 인버터(174)로 제공되어 반전(inverse)되고, 반전 신호가 제2 입력단(IN2)에 제공될 수 있다. 예를 들어, 클럭 제어 신호(CPV)의 제2 레벨이 음수인 경우, 인버터(174)를 통해 반전된 양수인 반전 신호가 제2 입력단(IN2)에 제공될 수 있다.
비교기(171)는 제1 구간 동안 기준 신호(S_REF)와 제1 레벨을 갖는 클럭 제어 신호(CPV)를 비교하고, 제2 구간 동안 기준 신호(S_REF)와 제2 레벨을 갖는 클럭 제어 신호(CPV)의 반전 신호를 비교할 수 있다. 일 실시예에서, 비교기(171)는 기준 신호(S_REF)와 클럭 제어 신호(CPV)의 차가 기 설정된 임계값 이상인 경우, 출력단(OUT)을 통해 과전류 보호 회로의 동작을 지연시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 다른 실시예에서, 비교기(171)는 기준 신호(S_REF)와 클럭 제어 신호(CPV)가 상이한 경우, 출력단(OUT)을 통해 과전류 보호 회로의 동작을 지연시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 이 때, 기준 신호(S_REF)는 클럭 제어 신호(CPV)의 제1 레벨과 동일한 레벨을 가질 수 있다. 비교기(171)는 기 설정된 시간 동안 지연 제어 신호(CTL_D)를 출력할 수 있다. 예를 들어, 지연 제어 신호(CTL_D)는 1프레임 또는 2프레임 동안 출력될 수 있다.
도 5a 내지 도 5c는 도 1의 표시 장치에 포함되는 이상 신호 검출부의 동작을 설명하기 위한 도면들이다.
도 5a를 참조하면, 이상 신호 검출부(170)는 과전류 보호 회로(160)에 지연 제어 신호(CTL_D)를 공급할 수 있다. 이상 신호 검출부(170)는 과전류 보호 회로(160)의 전원부(162)에 지연 제어 신호(CTL_D)를 공급할 수 있다. 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상인 경우, 기 설정된 시간 동안 과전류 보호 회로(160)의 전원부(162)를 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 따라서, 과전류 보호 회로(160)는 게이트 클럭 신호들(CKG)에 상응하는 게이트 전류(IG)가 기준 전류보다 큰 경우(즉, 과전류가 검출되는 경우)에도 기 설정된 시간이 지난 후에 셧다운 제어 신호(CTL_SHUT)를 출력할 수 있다.
도 5b를 참조하면, 과전류 보호 회로(160)와 전압 생성부 사이에 제3 스위치(164)가 연결될 수 있다. 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상인 경우, 기 설정된 시간 동안 제3 스위치(164)를 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 따라서, 과전류 보호 회로(160)는 게이트 클럭 신호들(CKG)에 상응하는 게이트 전류(IG)가 기준 전류보다 큰 경우(즉, 과전류가 검출되는 경우)에도 기 설정된 시간이 지난 후에 셧다운 제어 신호(CTL_SHUT)를 전압 생성부에 공급할 수 있다.
도 5c를 참조하면, 게이트 제어부(140)와 과전류 보호 회로(160) 사이에 제4 스위치(166)가 연결될 수 있다. 이상 신호 검출부(170)는 클럭 제어 신호(CPV)가 비정상인 경우, 기 설정된 시간 동안 제4 스위치(166)를 턴오프시키는 지연 제어 신호(CTL_D)를 출력할 수 있다. 따라서, 과전류 보호 회로(160)는 기 설정된 시간 동안 게이트 클럭 신호들(CKG)에 상응하는 게이트 전류(IG)를 검출하지 않으므로, 기 설정된 시간 동안 셧다운 제어 신호(CTL_SHUT)를 출력하지 않을 수 있다.
도 6은 도 1의 표시 장치를 포함하는 전자 기기를 나타내는 블록도이고, 도 7은 도 6의 전자 기기가 스마트폰으로 구현되는 일 예를 나타내는 도면이다.
도 6 및 도 7을 참조하면, 전자기기(200)는 프로세서(210), 메모리 장치(220), 저장 장치(230), 입출력 장치(240), 파워 서플라이(250) 및 표시 장치(260)를 포함할 수 있다. 이 때, 표시장치(260)는 도 1의 표시 장치(100)에 상응할 수 있다. 나아가, 전자기기(200)는 비디오 카드, 사운드 카드, 메모리 카드, USB 장치 등과 통신하거나, 다른 시스템들과 통신할 수 있는 여러 포트(port)들을 더 포함할 수 있다. 한편, 도 7에 도시된 바와 같이, 전자기기(200)는 스마트폰(300)으로 구현될 수 있으나, 전자기기(200)가 그에 한정되는 것은 아니다.
프로세서(210)는 특정 계산들 또는 태스크(task)들을 수행할 수 있다. 일 실시예에서, 프로세서(210)는 마이크로프로세서(microprocessor), 중앙 처리장치(CPU) 등일 수 있다. 프로세서(210)는 어드레스 버스(address bus), 제어 버스(control bus) 및 데이터 버스(data bus) 등을 통하여 다른 구성 요소들에 연결될 수 있다. 또한, 프로세서(210)는 주변 구성요소 상호연결(Peripheral Component Interconnect; PCI) 버스와 같은 확장 버스에도 연결될 수 있다. 메모리 장치(220)는 전자 기기(200)의 동작에 필요한 데이터들을 저장할 수 있다. 예를 들어, 메모리 장치(220)는 EPROM, EEPROM, 플래시 메모리, PRAM(Phase Change Random Access Memory), RRAM(Resistance Random Access Memory), MRAM(Magnetic Random Access Memory), FRAM(Ferroelectric Random Access Memory) 등과 같은 비휘발성 메모리 장치 및/또는DRAM(Dynamic Random Access Memory), SRAM(Static Random Access Memory), 모바일 DRAM 등과 같은 휘발성 메모리 장치를 포함할 수 있다. 저장장치(230)는 솔리드 스테이트 드라이브(Solid State Drive; SSD), 하드 디스크 드라이브(Hard Disk Drive; HDD), 씨디롬(CD-ROM) 등을 포함할 수 있다.
입출력 장치(240)는 키보드, 키패드, 터치패드, 터치스크린, 마우스 등과 같은 입력 수단 및 스피커, 프린터 등과 같은 출력 수단을 포함할 수 있다. 표시장치(260)는 입출력 장치(240) 내에 구비될 수도 있다. 파워 서플라이(250)는 전자 기기(200)의 동작에 필요한 파워를 공급할 수 있다. 표시장치(260)는 상기 버스들 또는 다른 통신 링크를 통해서 다른 구성 요소들에 연결될 수 있다.
상술한 바와 같이, 표시 장치(260)는 표시 패널, 전압 생성부, 타이밍 제어부, 게이트 제어부, 게이트 구동부, 과전류 보호 회로, 이상 신호 검출부 및 데이터 구동부를 포함할 수 있다. 표시 패널은 복수의 화소들을 포함하고, 각각의 화소들은 게이트 라인 및 데이터 라인과 연결될 수 있다. 전압 생성부는 외부로부터 직류 전원을 공급받아 표시 패널을 동작시키는 데 필요한 복수 개의 전압들을 생성할 수 있다. 예를 들어, 전압 생성부는 게이트 제어부에 공급되는 게이트 구동 전압, 데이터 구동부에 공급되는 데이터 구동 전압 및 표시 패널에 공급되는 패널 구동 전압을 생성할 수 있다. 타이밍 제어부는 외부 장치로부터 제어 신호를 수신하고, 게이트 제어부에 공급되는 클럭 제어 신호 및 데이터 구동부에 공급되는 데이터 클럭 신호를 생성할 수 있다. 또한, 타이밍 제어부는 외부 장치에서 공급되는 제1 영상 데이터를 보정하여 제2 영상 데이터를 생성하고, 제2 영상 데이터를 데이터 구동부로 공급할 수 있다. 게이트 제어부는 게이트 구동 전압 및 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성할 수 있다. 게이트 제어부는 전압 생성부로부터 게이트 온 전압 및 게이트 오프 전압을 포함하는 게이트 구동 전압을 수신할 수 있다. 또한, 게이트 제어부는 타이밍 제어부로부터 클럭 제어 신호를 수신할 수 있다. 게이트 제어부는 클럭 제어 신호에 기초하여 게이트 온 전압과 게이트 오프 전압 사이를 스윙하는 게이트 클럭 신호들을 생성할 수 있다. 예를 들어, 게이트 클럭 신호들은 클럭 신호 및 클럭바 신호를 포함할 수 있다. 게이트 구동부는 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하고, 게이트 라인(GL)을 통해 상기 게이트 신호를 화소들에 공급할 수 있다. 게이트 구동부는 복수의 스테이지들을 포함하고, 각각의 스테이지들은 게이트 클럭 신호들에 동기된 게이트 신호들을 순차적으로 출력할 수 있다. 과전류 보호 회로는 게이트 클럭 신호들에 상응하는 게이트 클럭 전류를 감지하고, 게이트 클럭 전류가 기 설정된 기준 전류 이상인 경우 전압 생성부를 셧다운시키는 셧다운 제어 신호를 출력할 수 있다. 이상 신호 검출부는 기 설정된 기준 신호와 클럭 제어 신호의 차에 기초하여 클럭 제어 신호의 이상 여부를 검출하고, 클럭 제어 신호가 비정상인 경우, 과전류 보호 회로에서 셧다운 제어 신호가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호를 출력할 수 있다. 정전기, 서지 등에 의해 일시적으로 비정상적인 클럭 제어 신호가 공급되더라도, 소정의 시간이 흐르면서 정상적으로 회복될 수 있다. 이상 신호 검출부는 비정상적인 클럭 제어 신호가 정상으로 회복되는 시간 동안 과전류 보호 회로에서 셧다운 제어 신호가 출력되는 것을 지연시킴으로써, 전압 생성부가 즉각적으로 셧다운되는 것을 방지할 수 있다. 이상 신호 검출부는 제1 구간에서 제1 레벨을 갖는 클럭 제어 신호와 기준 신호를 비교하고, 제2 구간에서 제2 레벨을 갖는 클럭 제어 신호의 반전 신호와 기준 신호를 비교하여 클럭 제어 신호의 이상 여부를 검출할 수 있다. 과전류 보호 회로는 과전류가 감지되더라도 이상 신호 검출부에서 공급되는 지연 제어 신호에 응답하여 기 설정된 시간이 경과한 후 셧다운 제어 신호를 출력할 수 있다. 따라서, 일시적으로 비정상 신호가 공급되는 경우 전압 생성부를 셧다운시키는 것을 방지할 수 있다.
상술한 바와 같이, 도 6의 전자 기기(200)는 클럭 제어 신호의 이상 여부를 검출하고, 클럭 제어 신호가 비정상인 경우, 과전류 보호 회로의 동작을 지연시킴으로써, 일시적인 비정상 신호로 인해 전압 생성부가 셧다운되는 것을 방지하는 표시 장치(260)를 포함할 수 있다. 따라서, 전압 생성부의 셧다운으로 인한 표시 장치(260)의 불량을 방지할 수 있다.
본 발명은 표시 장치를 구비한 모든 전자 기기에 적용될 수 있다. 예를 들어, 본 발명은 텔레비전, 컴퓨터 모니터, 노트북, 디지털 카메라, 휴대폰, 스마트폰, 스마트패드, 타블렛 PC, 피디에이(PDA), 피엠피(PMP), MP3 플레이어, 네비게이션, 비디오폰, 헤드 마운트 디스플레이(Head Mount Display; HMD) 장치 등에 적용될 수 있다.
이상에서는 본 발명의 예시적인 실시예들을 참조하여 설명하였지만, 해당 기술 분야에서 통상의 지식을 가진 자라면 하기의 특허 청구의 범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 수 있을 것이다.
100: 표시 장치 110: 표시 패널
120: 전압 생성부 130: 타이밍 제어부
140: 게이트 제어부 150: 게이트 구동부
160: 과전류 보호 회로 170: 이상 신호 검출부
200: 전자 기기 300: 스마트폰

Claims (20)

  1. 복수의 화소들을 포함하는 표시 패널;
    게이트 구동 전압을 생성하는 전압 생성부;
    제1 구간에서 제1 레벨을 갖고, 제2 구간에서 상기 제1 레벨보다 낮은 제2 레벨을 갖는 클럭 제어 신호를 생성하는 타이밍 제어부;
    상기 게이트 구동 전압 및 상기 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성하는 게이트 제어부;
    상기 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하고, 상기 게이트 신호를 상기 화소들에 공급하는 게이트 구동부;
    상기 게이트 클럭 신호들에 상응하는 게이트 클럭 전류를 감지하고, 상기 게이트 클럭 전류가 기 설정된 기준 전류 이상인 경우 상기 전압 생성부를 셧다운시키는 셧다운 제어 신호를 출력하는 과전류 보호 회로; 및
    기 설정된 기준 신호와 상기 클럭 제어 신호의 차에 기초하여 상기 클럭 제어 신호의 이상 여부를 검출하고, 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로에서 상기 셧다운 제어 신호가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호를 출력하는 이상 신호 검출부를 포함하는 표시 장치.
  2. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 제1 구간에서 상기 제1 레벨을 갖는 상기 클럭 제어 신호와 상기 기준 신호를 비교하고, 상기 제2 구간에서 상기 제2 레벨을 갖는 상기 클럭 제어 신호의 반전(inversion) 신호와 상기 기준 신호를 비교하는 것을 특징으로 하는 표시 장치.
  3. 제1 항에 있어서, 상기 이상 신호 검출부는
    상기 기준 신호가 입력되는 제1 입력단, 상기 클럭 제어 신호가 공급되는 제2 입력단 및 상기 기준 신호와 상기 클럭 제어 신호의 비교 결과를 출력하는 출력단을 포함하는 비교기;
    상기 클럭 제어 신호를 입력받고, 상기 제1 구간에서 턴온되며, 상기 제2 입력단과 연결되는 제1 스위치;
    상기 클럭 제어 신호를 입력받고, 상기 제2 구간에서 턴온되는 제2 스위치; 및
    상기 제2 스위치와 상기 제2 입력단 사이에 연결되는 인버터를 포함하는 것을 특징으로 하는 표시 장치.
  4. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호의 차가 기 설정된 임계값 이상인 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단하는 것을 특징으로 하는 표시 장치.
  5. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호가 상이한 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단하는 것을 특징으로 하는 표시 장치.
  6. 제1 항에 있어서, 상기 기준 신호는 상기 클럭 제어 신호의 상기 제1 레벨과 동일한 레벨을 갖는 것을 특징으로 하는 표시 장치.
  7. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 기 설정된 시간 동안 상기 과전류 보호 회로가 상기 셧다운 제어 신호를 출력하지 못하도록 하는 것을 특징으로 하는 표시 장치.
  8. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로의 동작 전원을 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 표시 장치.
  9. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로와 상기 전압 생성부 사이에 연결되는 제3 스위치를 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 표시 장치.
  10. 제1 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 게이트 제어부와 상기 과전류 보호 회로 사이에 연결되는 제4 스위치를 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 표시 장치.
  11. 게이트 구동 전압을 생성하는 전압 생성부;
    상기 구동 전압 및 클럭 제어 신호에 기초하여 게이트 클럭 신호들을 생성하는 게이트 제어부;
    상기 게이트 클럭 신호들에 기초하여 게이트 신호를 생성하는 게이트 구동부;
    상기 게이트 클럭 신호들에 상응하는 게이트 클럭 전류를 감지하고, 상기 게이트 클럭 전류가 기 설정된 기준 전류 이상인 경우 상기 전압 생성부는 셧다운시키는 셧다운 제어 신호를 출력하는 과전류 보호 회로; 및
    기 설정된 기준 신호와 상기 클럭 제어 신호의 차에 기초하여 상기 클럭 제어 신호의 이상 여부를 검출하고, 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로에서 상기 셧다운 제어 신호가 출력되는 것을 기 설정된 시간만큼 지연시키는 지연 제어 신호를 출력하는 이상 신호 검출부를 포함하는 게이트 구동 장치.
  12. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 제1 구간에서 상기 제1 레벨을 갖는 상기 클럭 제어 신호와 상기 기준 신호를 비교하고, 상기 제2 구간에서 상기 제2 레벨을 갖는 상기 클럭 제어 신호의 반전(inversion) 신호와 상기 기준 신호를 비교하는 것을 특징으로 하는 게이트 구동 장치.
  13. 제11 항에 있어서, 상기 이상 신호 검출부는
    상기 기준 신호가 입력되는 제1 입력단, 상기 클럭 제어 신호가 공급되는 제2 입력단 및 상기 기준 신호와 상기 클럭 제어 신호의 비교 결과를 출력하는 출력단을 포함하는 비교기;
    상기 클럭 제어 신호를 입력받고, 상기 제1 구간에서 턴온되며, 상기 제2 입력단과 연결되는 제1 스위치;
    상기 클럭 제어 신호를 입력받고, 상기 제2 구간에서 턴온되는 제2 스위치; 및
    상기 제2 스위치와 상기 제2 입력단 사이에 연결되는 인버터를 포함하는 것을 특징으로 하는 게이트 구동 장치.
  14. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호의 차가 기 설정된 임계값 이상인 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단하는 것을 특징으로 하는 게이트 구동 장치.
  15. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 기준 신호와 상기 클럭 제어 신호가 상이한 경우, 상기 클럭 제어 신호가 비정상(abnormal)인 것으로 판단하는 것을 특징으로 하는 게이트 구동 장치.
  16. 제11 항에 있어서, 상기 기준 신호는 상기 클럭 제어 신호의 상기 제1 레벨과 동일한 레벨을 갖는 것을 특징으로 하는 게이트 구동 장치.
  17. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 기 설정된 시간 동안 상기 과전류 보호 회로가 상기 셧다운 제어 신호를 출력하지 못하도록 하는 것을 특징으로 하는 게이트 구동 장치.
  18. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로의 동작 전원을 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 게이트 구동 장치.
  19. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 과전류 보호 회로와 상기 전압 생성부 사이에 연결되는 제3 스위치를 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 게이트 구동 장치.
  20. 제11 항에 있어서, 상기 이상 신호 검출부는 상기 클럭 제어 신호가 비정상(abnormal)인 경우, 상기 게이트 제어부와 상기 과전류 보호 회로 사이에 연결되는 제4 스위치를 턴오프시키는 상기 지연 제어 신호를 출력하는 것을 특징으로 하는 게이트 구동 장치.

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