KR20150141789A - Light emitting deviceand light emitting device package thereof - Google Patents
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Abstract
Description
실시 예는 발광소자에 관한 것이다.An embodiment relates to a light emitting element.
실시 예는 발광 소자를 갖는 발광소자 패키지에 관한 것이다.An embodiment relates to a light emitting device package having a light emitting element.
발광소자의 하나로서 발광 다이오드(LED: Light Emitting Diode)가 많이 사용되고 있다. 발광 다이오드는 화합물 반도체의 특성을 이용해 전기 신호를 적외선, 가시광선, 자외선과 같은 빛의 형태로 변환한다.Light emitting diodes (LEDs) are widely used as light emitting devices. Light emitting diodes convert electrical signals into light, such as infrared, visible, and ultraviolet, using the properties of compound semiconductors.
발광소자의 광 효율이 증가됨에 따라 표시장치, 조명기기를 비롯한 다양한 분야에 사용되고 있다.As light efficiency of a light emitting device is increased, it is used in various fields including a display device, a lighting device, and the like.
실시 예는 발광 구조물의 서로 반대측에 배치된 제1및 제2전극 중 지지부재를 갖는 제2전극의 접촉층이 서로 다른 영역에 접촉될 수 있도록 한 발광 소자를 제공한다.Embodiments provide a light emitting device in which a contact layer of a second electrode having a support member among first and second electrodes disposed on opposite sides of a light emitting structure can be brought into contact with different regions.
실시 예는 발광 구조물의 서로 반대측에 배치된 제1및 제2전극의 접촉 영역이 서로 오버랩되지 않도록 한 발광 소자를 제공한다.Embodiments provide a light emitting device wherein the contact regions of the first and second electrodes disposed on opposite sides of the light emitting structure do not overlap with each other.
실시 예는 전류 확산 구조를 갖는 발광 소자를 제공한다.The embodiment provides a light emitting device having a current diffusion structure.
실시 예에 따른 발광소자는, 제1 도전형반도체층, 상기 제1도전형반도체층 아래에 활성층, 및 상기 활성층 아래에 제2 도전형반도체층을 포함하는 발광구조물;상기 제2도전형 반도체층 아래에 복수의 오픈 영역을 갖는 절연층;상기 절연층의 각 오픈 영역에 배치된 접촉층;상기 접촉층 및 상기 절연층 아래에 배치된 반사층;상기 반사층 아래에 배치된 접합층;상기 접합층 아래에 배치된 전도성의 지지부재;및 상기 제1도전형 반도체층 위에 상기 복수의 오픈 영역과 수직 방향으로 어긋나게 배치된 제1전극을 포함한다.A light emitting device according to an embodiment includes a light emitting structure including a first conductive semiconductor layer, an active layer below the first conductive semiconductor layer, and a second conductive semiconductor layer below the active layer, A contact layer disposed on each of the open regions of the insulation layer, a reflection layer disposed below the contact layer and the insulation layer, a junction layer disposed below the reflection layer, And a first electrode disposed on the first conductive semiconductor layer so as to be shifted in the vertical direction from the plurality of open regions.
실시 예에 따른 발광 소자의 전류를 확산시켜 줄 수 있다.The current of the light emitting device according to the embodiment can be diffused.
실시 예는 발광 소자의 내부 양자 효율을 개선시켜 줄 수 있다.The embodiment can improve the internal quantum efficiency of the light emitting device.
실시 예는 발광 구조물의 서로 반대측에 배치된 제1및 제2전극의 접촉 영역이 수직 방향으로 오버랩되지 않도록 배치함으로써,광학적인 신뢰성을 개선시켜 줄 수 있다.Embodiments can improve the optical reliability by disposing the contact regions of the first and second electrodes on the opposite sides of the light emitting structure such that they do not overlap in the vertical direction.
실시 예는 발광 소자 및 이를 구비한 발광 소자 패키지의 신뢰성을 개선시켜 줄 수 있다.Embodiments can improve the reliability of the light emitting device and the light emitting device package having the same.
도 1은 제1실시 예에 따른 발광소자를 나타낸 도면이다.
도 2는 도 1의 발광 소자의 평면도이다.
도 3 내지 도 9는 도 1의 발광 소자의 제조 과정을 나타낸 도면이다.
도 10은 제2실시 예에 따른 발광소자를 나타낸 도면이다.
도 11은 제3실시 예에 따른 발광소자를 나타낸 도면이다.
도 12은 제4실시 예에 따른 발광소자를 나타낸 도면이다.
도 13은 실시 예에 따른 발광 소자를 갖는 발광 소자 패키지를 나타낸 측 단면도이다.1 is a view showing a light emitting device according to a first embodiment.
2 is a plan view of the light emitting device of FIG.
3 to 9 are views illustrating a manufacturing process of the light emitting device of FIG.
10 is a view illustrating a light emitting device according to the second embodiment.
11 is a view illustrating a light emitting device according to the third embodiment.
12 is a view illustrating a light emitting device according to a fourth embodiment.
13 is a side sectional view showing a light emitting device package having a light emitting device according to the embodiment.
실시 예의 설명에 있어서, 각 층(막), 영역, 패턴 또는 구조물들이 기판, 각 층(막), 영역, 패드 또는 패턴들의 "상/위(on)"에 또는 "하/아래(under)"에 형성되는 것으로 기재되는 경우에 있어, "상/위(on)"와 "하/아래(under)"는 "직접(directly)" 또는 "다른 층을 개재하여 (indirectly)" 형성되는 것을 모두 포함한다. 또한 각 층의 상/위 또는 하/아래에 대한 기준은 도면을 기준으로 설명한다.In the description of the embodiments, it is to be understood that each layer (film), region, pattern or structure may be referred to as being "on" or "under" a substrate, each layer It is to be understood that the terms " on "and " under" include both " directly "or" indirectly " do. In addition, the criteria for the top / bottom or bottom / bottom of each layer are described with reference to the drawings.
이하, 첨부된 도면을 참조하여 실시 예들에 따른 발광소자, 발광소자 패키지 및 발광소자 제조방법에 대해 상세히 설명하도록 한다.Hereinafter, a light emitting device, a light emitting device package, and a method of manufacturing a light emitting device according to embodiments will be described in detail with reference to the accompanying drawings.
도 1은 제1실시 예에 따른 발광소자를 나타낸 도면이며,도 2는 도 1의 발광 소자의 평면도이다.FIG. 1 is a view showing a light emitting device according to a first embodiment, and FIG. 2 is a plan view of the light emitting device of FIG.
도 1및 도 2를 참조하면,발광 소자(100)는 발광구조물(10), 상기 발광 구조물(10)의 아래에 배치된 제2전극(20)과, 상기 제2전극(20)과 상기 발광 구조물(10)의 사이에 배치된 절연층(41)과, 상기 절연층(41)의 둘레에 배치된 보호층(45)과,상기 발광 구조물(10)의 위에 배치된 제1전극(51)을 포함한다.1 and 2, the
상기 발광구조물(10)은 제1 도전형반도체층(11), 상기 제1도전형 반도체층(11) 아래에 활성층(12), 및 상기 활성층(12) 아래에 제2 도전형반도체층(13)을 포함할 수 있다. 상기 활성층(12)은 상기 제1 도전형반도체층(11)과 상기 제2 도전형반도체층(13) 사이에 배치될 수 있다. 상기 활성층(12)은 상기 제1도전형 반도체층(11)과 상기 제2도전형 반도체층(13)에 접촉될 수 있다.The
예로써, 상기 제1 도전형반도체층(11)이 제1 도전형도펀트로서 n형 도펀트가 첨가된 n형 반도체층으로 형성되고, 상기 제2 도전형반도체층(13)이 제2 도전형도펀트로서 p형 도펀트가 첨가된 p형 반도체층으로 형성될 수 있다. 또한 상기 제1 도전형반도체층(11)이 p형 반도체층으로 형성되고, 상기 제2 도전형반도체층(13)이 n형 반도체층으로 형성될 수도 있다. For example, the first conductivity
상기 제1 도전형반도체층(11)은 예를 들어, n형 반도체층을 포함할 수 있다. 상기 제1 도전형반도체층(11)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 구현될 수 있다. 상기 제1 도전형반도체층(11)은, 예를 들어 GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP 등에서 선택될 수 있으며, Si, Ge, Sn, Se, Te 등의 n형 도펀트가도핑될 수 있다.상기 제1도전형 반도체층(11)의 상면은 요철 구조(11A)로 형성될 수 있으며,이러한 요철 구조(11A)는 광 추출 효율을 개선시켜 줄 수 있다.The first
상기 제2 도전형반도체층(13)은 예를 들어, p형 반도체층으로 구현될 수 있다. 상기 제2 도전형반도체층(13)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 구현될 수 있다. 상기 제2 도전형반도체층(13)은, 예를 들어 GaN, AlN, AlGaN, InGaN, InN, InAlGaN, AlInN, AlGaAs, GaP, GaAs, GaAsP, AlGaInP 등에서 선택될 수 있으며, Mg, Zn, Ca, Sr, Ba 등의 p형 도펀트가도핑될 수 있다.상기 제2도전형 반도체층(13)은 상기 제1도전형 반도체층(11)의 두께보다 얇은 두께로 형성될 수 있다. 상기 제2도전형 반도체층(13)의 상면 너비는 상기 제1도전형 반도체층(11)의 하면너비보다 넓게 형성될 수 있으며,이에 대해 한정하지는 않는다.The second
상기 활성층(12)은 상기 제1 도전형반도체층(11)을 통해서 주입되는 전자(또는 정공)와 상기 제2 도전형반도체층(13)을 통해서 주입되는 정공(또는 전자)이 서로 만나서, 상기 활성층(12)의 형성 물질에 따른 에너지 밴드(Energy Band)의 밴드갭(Band Gap) 차이에 의해서 빛을 방출하는 층이다. 상기 활성층(12)은 단일 양자 우물 구조, 다중 양자 우물 구조(MQW: Multi Quantum Well), 양자점 구조 또는 양자선 구조 중 어느 하나로 형성될 수 있으나, 이에 한정되는 것은 아니다.상기 활성층(12)은 상기 제1도전형 반도체층(11)의 두께보다 얇은 두께로 형성될 수 있다.The
상기 활성층(12)은 예로서 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 구현될 수 있다. 상기 활성층(12)이 상기 다중 양자 우물 구조로 구현된 경우, 상기 활성층(12)은 복수의 우물층과 복수의 장벽층이적층되어 구현될 수 있으며, 예를 들어, 우물층/장벽층의페어는InGaN/GaN, InGaN/AlGaN, InGaN/InGaN, GaN/AlGaN, InAlGaN/InAlGaN, AlGaAs/GaAs,InGaAs/GaAs, InGaP/GaP, AlInGaP/InGaP,InP/GaAs의 페어로 구현될 수 있다.The
한편, 상기 제1 도전형반도체층(11)이 p형 반도체층을 포함하고 상기 제2 도전형반도체층(13)이 n형 반도체층을 포함할 수도 있다. 또한, 상기 제1 도전형반도체층(13) 위에는 n형 또는 p형 반도체층을 포함하는 반도체층이 더 형성될 수도 있다. 이에 따라, 상기 발광구조물(10)은 np, pn, npn, pnp 접합 구조 중 적어도 어느 하나를 가질 수 있다. 또한, 상기 제1 도전형반도체층(11) 및 상기 제2 도전형반도체층(13) 내의 불순물의 도핑 농도는 균일 또는 불균일하게 형성될 수 있다. 즉, 상기 발광구조물(10)의 구조는 다양하게 형성될 수 있으며, 이에 대해 한정하지는 않는다.Meanwhile, the first
또한, 상기 제1 도전형반도체층(11)과 상기 활성층(12) 또는 상기 제2도전형 반도체층(13)과 상기 활성층(12) 사이에는 제1 도전형InGaN/GaN슈퍼래티스(Super lattice) 구조 또는 InGaN/InGaN슈퍼래티스 구조가 형성될 수도 있다. 또한, 상기 제2 도전형반도체층(13)과 상기 활성층(12) 사이에는 제2 도전형의AlGaN층이 형성될 수도 있으며,예컨대 p형 AlGaN으로 형성될 수 있다.A first conductive InGaN / GaN superlattice is formed between the first
상기 발광구조물(10)의 위에 제1전극(51)이 배치되고,상기 발광 구조물(10)의 아래에 제2전극(20)이 배치될 수 있다.상기 발광 구조물(10)은 제1전극(51)과 제2전극(20) 사이에 배치될 수 있다.상기 제1전극(51)은 상기 제1도전형 반도체층(11)과 접촉될 수 있다.상기 제1전극(51)은 도 2과 같이,패드 영역의 둘레로 적어도 하나 또는 그 이상으로 분기된 암 패턴(52)를 포함할 수 있으며,이러한 암 패턴(52)은 전류를 확산시켜 줄 수 있다.상기 암 패턴(52)의 탑뷰형상은 직선 형상,곡선 형상,각진 형상 중에서 선택적으로 형성될 수 있으며, 상기 암 패턴(52)의 단면은 원형, 타원형, 다각형 중 하나로 형성될 수 있다.A
상기 발광 구조물(10)과 제2전극(20) 사이에는 절연층(41)이 배치된다.상기 절연층(41)은 상기 발광 구조물(10)의 하면 예컨대,제2도전형 반도체층(13)의 하면에 접촉될 수 있다.예를 들어, 상기 절연층(41)은 상기 제2도전형 반도체층(13)의 하면 아래에서 상기 제2도전형 반도체층(13)의 하면 면적의 20% 이상 예컨대,20% 내지 80% 범위로 접촉될 수 있다.상기 절연층(41)이 상기 제2도전형 반도체층(13)의 하면 면적의20% 이상으로 접촉되므로, 상기 제2도전형 반도체층(13)과 접촉층(15)의 접촉 면적을 80% 이하로 감소시켜 줄 수 있다.이에 따라 상기 절연층(41)에 의해 발광 구조물(10) 내의 결함(defect)을 통해 전류가 흐르는 것을 차단할 수 있고, 발광 소자의 수율은 개선될 수 있다.An insulating
상기 절연층(41)은 상기 접촉층(15)의 두께와 다른 두께로 형성 될 수 있으며,예컨대 상기 접촉층(15)보다 두꺼운 두께로 형성될 수 있다.상기 절연층(41)은 1nm 내지 100nm 범위의 두께로 형성될 수 있다.상기 절연층(41)은 실리콘,SiO2, SiOx, SiOxNy,Si3N4, Al2O3, TiO2또는 AlN와 재질 중에서 선택적으로 형성될 수 있다.상기 접촉층(15)이 서로 이격되어 배치됨으로써,다른 매질과의 굴절률 차이에 의해 광 추출 효율이 개선될 수 있다.The insulating
상기 제2전극(20)은 접촉층(15),반사층(17),접합층(19) 및 지지부재(21)를 포함한다.상기 접촉층(15)은 상기 제1전극(51)과 수직 방향으로 오버랩되지 않는 영역에 각각 배치될 수 있다.상기 접촉층(15)은 도 1 및 도 2와 같이,복수의 접촉 영역이 서로 이격되어 배치되며,상기 제2도전형 반도체층(13)의 서로 다른 영역에 접촉될 수 있다.상기 접촉층(15)의 복수의 접촉 영역은 상기 절연층(41)의 복수의오픈 영역(42)을 통해 상기 제2도전형 반도체층(13)과 각각 접촉될 수 있다.상기 복수의 접촉 영역은 상기 제1전극(51)과 수직 방향으로 오버랩되지 않게 배치된다. 이에 따라 상기 접촉층(15)과 상기 제1전극(51)의 영역이 수직 방향으로 서로 어긋나게 배치됨으로써,공급되는 전류를 확산시켜 줄 수 있다.이러한 확산된 전류는 활성층(12)의 전 영역에 균일하게 공급될 수 있어,내부 양자 효율을 개선시켜 줄 수 있다.상기 접촉층(15)의 각 접촉 영역은 상기 절연층(41)의 하면으로 연장될 수 있다.이러한 접촉층(15)은 하부에 리세스 구조를 포함할 수 있다.The
상기 접촉층(15)은 상기 절연층(41)보다 얇은 두께 예컨대,10nm 이하의 두께로 형성될 수 있으며,상기 두께를 초과한 경우 오믹 접촉 및 투광성 층으로의 기능이 저하되는 문제가 있다.The
상기 접촉층(15)은 예컨대,전도성 재질 또는 투명한 재질로 형성될 수 있다. 상기 접촉층(15)은 예로서, 전도성산화막 및 전도성질화막 중 적어도 하나를 포함할 수 있다.상기 접촉층(15)은예컨대,ITO(Indium Tin Oxide), ITON(ITO Nitride), IZO(Indium Zinc Oxide), IZON(IZO Nitride), AZO(Aluminum Zinc Oxide), AGZO(Aluminum Gallium Zinc Oxide), IZTO(Indium Zinc Tin Oxide), IAZO(Indium Aluminum Zinc Oxide), IGZO(Indium Gallium Zinc Oxide), IGTO(Indium Gallium Tin Oxide), ATO(Antimony Tin Oxide), GZO(Gallium Zinc Oxide), IZON(IZO Nitride), ZnO, IrOx, RuOx, NiO 중에서 선택된 적어도 하나의 물질로 형성될 수 있다. 상기 접촉층(15)은 금속 재질 예컨대,Ag, Ni, Rh, Pd, Pt, Hf, In, Zn 중 적어도 하나를 포함할 수 있다.상기 접촉층(15)은 상기 제2도전형 반도체층(13)과 접촉될 수 있으며,예컨대 오믹 접촉될 수 있다.상기 접촉층(15)은 다른 물질 예컨대,반도체 물질로 형성될 수 있다. 이러한 반도체 물질 내에 이온을 주입하여 전도층으로 기능하게 할 수 있다.The
상기 접촉층(15) 중에서 상기 제2도전형 반도체층(13)의 하면에 접촉된 면적은 상기 제2도전형 반도체층(13)의 하면 면적의 약 80% 이하 예컨대, 20% 내지 80% 범위일 수 있다.상기 접촉층(15)은상기 발광 구조물(10)의 하면 영역에 분산 배치될 수 있다.상기 제2도전형 반도체층(13)의하면에 접촉된 상기 절연층(41)과 상기 접촉층(15)의 관계를 보면,상기 절연층(41)의 접촉 면적이 넓어질수록 상기 접촉층(15)의 접촉 면적은 줄어들게 된다.상기 접촉층(15)의 접촉 면적이 줄어들수록 동작 전압은 상승하게 된다.The area of the
이에 따라, 상기 절연층(41)이 상기 제2도전형 반도체층(13)의 하면에 접촉된 면적은 상기 제2도전형 반도체층(13)의 하면 면적의 약 20% 내지 80%, 구체적으로 50% 내지 80% 범위일 수 있다.Accordingly, the area of the
이때 상기 절연층(41)이 상기 제2도전형 반도체층(13)의 하면에 접촉된 면적이 상기 제2도전형 반도체층(13)의 하면 면적의 약 50% 내지 약 80% 범위인 경우, 동작 전압은 상기 절연층(41)의 상기 제2도전형 반도체층(13)의 하면에 접촉 면적이 상기 제2도전형 반도체층(13)의 하면 면적의 40% 이하인 경우에 비해 약0.2V 정도 미미하게 상승하지만, 상기 절연층(41)의 상기 제2도전형 반도체층(13)의 하면에 접촉 면적이 상기 제2도전형 반도체층(13)의 하면 면적의 90%이상일 경우, 상승 폭이 2배 이상 예컨대, 약 0.4V 이상 상승하게 된다. 이러한 절연층(41)의 상기 제2도전형 반도체층(13)의 하면에 접촉 면적이 상기 제2도전형 반도체층(13)의 하면 면적의 80%를 벗어나면 발광 소자의 성능이 저하될 수 있다.When the area of the insulating
상기 반사층(17)은 고 반사율을 갖는 금속 재질로 형성될 수 있다. 예컨대 상기 반사층(17)은 Ag, Ni, Al, Rh, Pd, Ir, Ru, Mg, Zn, Pt, Cu, Au, Hf 중 적어도 하나를 포함하는 금속 또는 합금으로 형성될 수 있다. 또한, 상기 반사층(17)은 상기 금속 또는 합금과 ITO(Indium-Tin-Oxide), IZO(Indium-Zinc-Oxide), IZTO(Indium-Zinc-Tin-Oxide), IAZO(Indium-Aluminum-Zinc-Oxide), IGZO(Indium-Gallium-Zinc-Oxide), IGTO(Indium-Gallium-Tin-Oxide), AZO(Aluminum-Zinc-Oxide), ATO(Antimony-Tin-Oxide) 등의 투광성전도성 물질을 이용하여 다층으로 형성될 수 있다. 상기 반사층(17)은 Ag, Al, Ag-Pd-Cu 합금, 또는 Ag-Cu 합금 중 적어도 어느 하나를 포함할 수 있다.상기 반사층(17)은 상기 접촉층(15)의 너비보다 넓게 형성될 수 있다.상기 반사층(17)의 일부(17A)는 상기 접촉층(15)의 리세스 구조로 연장될 수 있다.이러한 반사층(17)의 일부(17A)가 상기 접촉층(15)의 리세스 구조에 접촉됨로써,반사층(17)과 접촉층(15) 사이의 접착력은 강화될 수 있다.즉,상기 반사층(17)의 일부(17A)는 상기 절연층(41)의 오픈 영역(42) 내에 배치될 수 있다.The
상기 반사층(17)은 상기 발광 구조물(10)의 하면 너비보다 작거나 넓게 배치될 수 있다.상기 반사층(17)은 상기 접촉층(15)과 접촉되고 전기적으로 연결될 수 있다.상기 반사층(17)은 상기 발광구조물(10)로부터 입사되는 빛을 반사시켜 외부로 추출되는 광량을 증가시키는 기능을 수행할 수 있다.상기 반사층(17)은 다층으로 형성될 수 있다.The
상기 접합층(19)은 상기 반사층(17) 아래에 배치된다.상기 접합층(19)은 상기 반사층(17)과 지지부재(21) 사이에 접합된다.상기 접합층(19)RHK 상기 반사층(17) 사이에 베리어층(미도시)이 더 형성될 수 있다.상기 베리어층은 상기 반사층(17) 방향으로 금속 물질이 확산되는 것을 방지할 수 있다.상기 접합층(19)의 너비는 상기 반사층(17)의 너비보다 넓게 형성될 수 있다.상기 접합층(19)의 외곽부는 상기 보호층(45)의 하면까지 연장될 수 있다. 다른 예로서, 상기 반사층(17)은 상기 접합층(19)과 상기 보호층(45) 사이로 연장될 수 있다.The
상기 접합층(19)은 상기 접촉층(15)의 방향으로 상기 접촉층(15)과 수직 방향으로 오버랩되게 돌출된 돌기(18)를 포함할 수 있다. 상기 접합층(19)은 돌기(18)에 의해 상기 반사층(17)과의 접촉 면적이 개선될 수 있다.The
상기 접합층(19)은 단층 또는 다층으로 형성될 수 있다.상기 접합층(19)은 금속, 예를 들어, Ti, Au, Sn, Ni, Cr, Ga, In, Bi, Cu, Ag, Nb, Pt, W, V, Fe, Mo, Pd 또는 Ta 중 적어도 하나를 포함하여 형성될 수 있다. 상기 접합층(19)은 Ni, Pt, Ti, W, V, Fe, Mo와 같은 씨드층을 포함할 수 있다. 상기 지지부재(21)는 실시 예에 따른 발광 소자(100)를 지지하며, 외부 전극과 전기적으로 연결되어 상기 발광구조물(10)에 전원을 제공할 수 있다. The
상기 지지부재(21)는 예를 들어, Ti, Cr, Ni, Al, Pt, Au, W, Cu, Mo, Cu-W중 적어도 하나의 금속 또는 둘 이상의 합금으로 형성되거나, 또는 불순물이 주입된 반도체 기판(예: Si, Ge, GaN, GaAs, ZnO, SiC, SiGe 등)로 형성될 수 있다. 상기 지지부재(21)는 상기 접합층(19)의 두께보다 두껍고 상기 발광 구조물(10)의 두께보다 두꺼운 두께로 형성될 수 있으며, 30㎛ 이상의 두께, 예컨대 100㎛ 내지 500㎛ 범위로 형성될 수 있다. 상기 지지 부재(21)가 상기 두께 범위 이하이면 지지 층으로서의 기능이 약하고, 상기 두께 범위를 초과하면 발광 소자의 두께가 두꺼워지는 문제가 있다.
The
상기 발광 구조물(10)과 제2전극(20)사이의 외측 둘레에는 보호층(45)이 형성될 수 있다.상기 보호층(45)은 상기 제2도전형 반도체층(13)과 상기 접합층(19) 사이에 배치될 수 있다.상기 보호층(45)은 상기 제2도전형 반도체층(13)의 하면 외측에 접촉된 내측부(44) 및 상기 발광 구조물(10)의 측벽보다 외측으로 연장된 외측부(43)를 포함한다.상기 보호층(45)의 내측부(44)는 상기 절연층(41) 및상기 반사층(17)의 둘레에 배치될 수 있다.상기 보호층(45)의 내측부(44)는 상기 절연층(41) 및상기 반사층(17)의 외측에 접촉될 수 있다.상기 보호층(45)의 내측은 오픈 영역이 배치되며,상기 오픈 영역에는 상기 접촉층(15)및 상기 절연층(41)이 배치된다.상기 보호층(45)의 두께는 상기 절연층(41) 및 상기 반사층(17)의 두께의 합과 동일한 두께이거나 더 얇은 두께로 형성될 수 있다. 상기 보호층(45)은 발광 구조물(10)과 상기 접합층(19)사이에 배치되어, 발광 구조물(10)로의 습기 침투 경로를 길게 제공할 수 있다. 상기 보호층(45)의 상면 및 하면 중 적어도 하나는 요철 형상으로 형성될 수 있으며, 상기 요철 형상은 상기 보호층(45)을 통해 추출되는 광의 추출 효율을 개선시켜 줄 수 있다.상기 보호층(45)와 상기 절연층(41)은 동일한 물질로 일체로 형성될 수 있으며, 이에 대해 한정하지는 않는다.A
상기 보호층(45)은 금속 산화물 또는 금속 질화물로 형성될 수 있다.상기 보호층(45)은 예를 들어, SiO2, SiOx, SiOxNy,Si3N4, Al2O3, TiO2, AlN과 같은 물질로 구현될 수 있다.상기 보호층(45)은 발광 구조물(10)의 하면 둘레를 보호하기 위한 채널층으로 정의될 수 있으며,이에 대해 한정하지는 않는다.상기 발광 구조물(10)의 표면에 표면 보호층이 형성될 수 있다.상기 표면 보호층은 발광 구조물(10)의 측면 및 상면 일부에 배치될 수 있으며,이에 대해 한정하지는 않는다.The
상기 제1전극(51)에는 와이어가본딩될 수 있다.상기 발광 소자(100)의 지지부재(21)는 보드 또는 리드 프레임 상에 다이 본딩될 수 있다.제1실시 예는 제2전극(20)의 접촉층(15)의 접촉 영역을 서로 이격시키고 제1전극(51)과 수직 방향으로 오버랩되지 않도록 배치함으로써,전류 확산 효과와 더블어,내부 양자 효율을 개선시켜 줄 수 있다. 또한 발광 구조물(10)의 하면에 접촉되는 절연층(41)의 접촉 면적을 최적화하여, 결함에 의한 수율 저하를 방지하고,칩의 성장에 영향을 주지 않는 범위 내에서 동작 전압의 상승을 조절할 수 있다.
A wire may be bonded to the
도 3내지 도 9는 도 1의 발광 소자의 제조 과정을 나타낸 도면이다.3 to 9 are views illustrating a manufacturing process of the light emitting device of FIG.
도 3을 참조하면,기판(5) 위에 상기 제1 도전형반도체층(11), 활성층(12), 제2 도전형반도체층(13)을 형성한다. 상기 제1 도전형반도체층(11), 상기 활성층(12), 상기 제2 도전형반도체층(13)은 발광구조물(10)로 정의될 수 있다.Referring to FIG. 3, the first conductivity
상기 기판(5)은 절연성 또는 전도성 기판일 수 있다.상기 기판(5)은 예를 들어, 사파이어 기판(Al2O3), SiC, GaAs, GaN, ZnO, Si, GaP, InP, Ge 중 적어도 하나로 형성될 수 있으며, 이에 대해 한정하지는 않는다. 상기 제1 도전형반도체층(11)과 상기 기판(5) 사이에는 버퍼층 및 언도프드반도체층 중 적어도 하나가 형성될 수 있다. The
상기 기판(5) 위에 성장된 반도체층은예를 들어, 유기금속 화학 증착법(MOCVD; Metal Organic Chemical Vapor Deposition), 화학 증착법(CVD; Chemical Vapor Deposition), 플라즈마 화학 증착법(PECVD; Plasma-Enhanced Chemical Vapor Deposition), 분자선 성장법(MBE; Molecular Beam Epitaxial), 수소화물 기상 성장법(HVPE; Hydride Vapor Phase Epitaxial) 등의 방법을 이용하여 형성될 수 있으며, 이에 대해 한정하지는 않는다.The semiconductor layer grown on the
예로써, 상기 제1 도전형반도체층(11)이 제1 도전형도펀트로서 n형 도펀트가 첨가된 n형 반도체층으로 형성되고, 상기 제2 도전형반도체층(13)이 제2 도전형도펀트로서 p형 도펀트가 첨가된 p형 반도체층으로 형성될 수 있다. 또한 상기 제1 도전형반도체층(11)이 p형 반도체층으로 형성되고, 상기 제2 도전형반도체층(13)이 n형 반도체층으로 형성될 수도 있다.For example, the first conductivity
상기 제1 도전형반도체층(11)은 예를 들어, n형 반도체층을 포함할 수 있다. 상기 제1 도전형반도체층(11)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 형성될 수 있다. 상기 제1 도전형반도체층(11)은, 예를 들어 InAlGaN, GaN, AlGaN, AlInN, InGaN, AlN, InN 등에서 선택될 수 있으며, Si, Ge, Sn 등의 n형 도펀트가도핑될 수 있다.The first
상기 제2 도전형반도체층(13)은 예를 들어, p형 반도체층으로 구현될 수 있다. 상기 제2 도전형반도체층(13)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 형성될 수 있다. 상기 제2 도전형반도체층(13)은, 예를 들어 InAlGaN, GaN, AlGaN, InGaN, AlInN, AlN, InN 등에서 선택될 수 있으며, Mg, Zn, Ca, Sr, Ba 등의 p형 도펀트가도핑될 수 있다.The second
상기 활성층(12)은 상기 제1 도전형반도체층(11)을 통해서 주입되는 전자(또는 정공)와 상기 제2 도전형반도체층(13)을 통해서 주입되는 정공(또는 전자)이 서로 만나서, 상기 활성층(12)의 형성 물질에 따른 에너지 밴드(Energy Band)의 밴드갭(Band Gap) 차이에 의해서 빛을 방출하는 층이다. 상기 활성층(12)은 단일 양자 우물 구조, 다중 양자 우물 구조(MQW: Multi Quantum Well), 양자점 구조 또는 양자선 구조 중 어느 하나로 형성될 수 있으나, 이에 한정되는 것은 아니다.The
상기 활성층(12)은 InxAlyGa1 -x- yN (0≤x≤1, 0≤y≤1, 0≤x+y≤1)의 조성식을 갖는 반도체 재료로 형성될 수 있다. 상기 활성층(12)이 상기 다중 양자 우물 구조로 형성된 경우, 상기 활성층(12)은 복수의 우물층과 복수의 장벽층이교대로 적층되어 형성될 수 있다.The
한편, 상기 제1 도전형반도체층(11)이 p형 반도체층을 포함하고 상기 제2 도전형반도체층(13)이 n형 반도체층을 포함할 수도 있다. 또한, 상기 제2 도전형반도체층(13) 아래에는 n형 또는 p형 반도체층을 포함하는 반도체층이 더 형성될 수도 있으며, 이에 따라, 상기 발광구조물(10)은 np, pn, npn, pnp 접합 구조 중 적어도 어느 하나를 가질 수 있다. 또한, 상기 제1 도전형반도체층(11) 및 상기 제2 도전형반도체층(13) 내의 불순물의 도핑 농도는 균일 또는 불균일하게 형성될 수 있다. 즉, 상기 발광구조물(10)의 구조는 다양하게 형성될 수 있으며, 이에 대해 한정하지는 않는다.Meanwhile, the first
또한, 상기 제1 도전형반도체층(11)과 상기 활성층(12) 사이에는 제1 도전형InGaN/GaN슈퍼래티스(Super lattice) 구조 또는 InGaN/InGaN슈퍼래티스 구조가 형성될 수도 있다. 또한, 상기 제2 도전형반도체층(13)과 상기 활성층(12) 사이에는 제2 도전형의AlGaN층이 형성될 수도 있다.A first conductivity type InGaN / GaN superlattice structure or an InGaN / InGaN superlattice structure may be formed between the first conductivity
이어서, 도 4에 도시된 바와 같이, 상기 발광구조물(10)의 상면 둘레에 보호층(45)이 형성된다.상기 보호층(45)은 내부에 오픈 영역(40)을 통해 상기 발광 구조물(10)의 상면을 노출시켜 준다.상기 보호층(45)은 금속 산화물 또는 금속 질화물로 증착될 수 있다.4, a
상기 보호층(45)의 오픈 영역(40)에는 절연층(41)이 상기 발광 구조물(10)의 상면에증착되며,상기 절연층(41)은 복수의 오픈 영역(42)을 갖고 형성된다.상기 복수의 오픈 영역(42)은 서로 이격된다.예컨대 도 2와 같이 접촉층(15)의 접촉 영역과 같이 이격될 수 있다.상기 보호층(45)은 상기 절연층(41)의 두께보다 두껍게 증착될 수 있다.An insulating
도 5및 도 6과 같이,발광 구조물(10)의 상면에 접촉층(15)이 형성된다.상기 접촉층(15)은 복수의 접촉 영역이 상기 절연층(41)의 오픈 영역(42)에 배치된다.상기 접촉층(15)의 각 접촉 영역의 외곽부는 상기 절연층(41)의 상면으로 연장될 수 있다.상기 접촉층(15)의 외곽부는 상기 절연층(41)과 반사층(17) 사이에 배치될 수 있다.5 and 6, a
상기 접촉층(15) 위에는반사층(17)이 형성된다.상기 반사층(17)은 상기 접촉층(15)의 접촉 영역들을 커버할 수 있는 너비로 형성된다.이에 따라 광 반사 효율을 개선시켜 줄 수 있다.상기 접촉층(15)은 금속 산화물 또는 금속으로 형성될 수 있으며,상기 반사층(17)은 금속 물질로 형성될 수 있다.상기 접촉층(15) 및 반사층(17)은 증착 공정 또는 도금 공정을 통해 형성될 수 있다.A
도 6및 도 7과 같이,상기 반사층(17)의 위에는 접합층(19)이 형성된다.상기 접합층(19) 위에는 전도성의 지지부재(21)가 형성된다.상기 접합층(19)과 반사층(17) 사이에는 씨드층 또는 확산 베리어층을 포함할 수 있으며,이에 대해 한정하지는 않는다.상기 접합층(19)은 증착 공정 또는 도금 공정을 통해 형성될 수 있으며,상기 지지부재(21)는 상기 접합층(19)에 접합된다.6 and 7, a
도 8은 도 7의 칩 구조를 뒤집은 후,상기 발광구조물(10)로부터 상기 기판(5)을 제거한다. 하나의 예로서, 상기 기판(5)은 레이저 리프트 오프(LLO: Laser Lift Off) 공정에 의해 제거될 수 있다. 레이저 리프트 오프 공정(LLO)은 상기 성장기판(5)의 하면에 레이저를 조사하여, 상기 기판(5)과 상기 발광구조물(10)을 서로 박리시키는 공정이다.상기 기판(5)는 제거되지 않을 수 있다.이때의 기판(5)은 투광성 재질일 수 있다.8 reverses the chip structure of FIG. 7, and then removes the
도 8 및 도 9와 같이,상기 발광구조물(10)의 개별 칩의 외측 영역(A1)을 따라 아이솔레이션(isolation) 에칭을 실시하여, 개별 발광 소자 단위로 구분할 수 있다. 상기 아이솔레이션에칭은 예를 들어, ICP(Inductively Coupled Plasma)와 같은 건식 식각에 의해 실시될 수 있으나, 이에 대해 한정하지는 않는다.즉,상기 발광 구조물(10)의 외측 영역(A1)이 에칭되어 제거되고,이때 상기 보호층(45)의 외곽부가 노출될 수 있다.또한, 상기 제1 도전형반도체층(11)의 상면에 요철 구조(11A)를 형성한다. 이에 따라, 상기 제1 도전형반도체층(11)을 통하여 외부로 빛이 추출되는 광 추출 효과를 상승시킬 수 있게 된다.8 and 9, isolation etching may be performed along the outer region A1 of the individual chip of the
상기 제1도전형 반도체층(11)의 상면에는 암 패턴(52)를 갖는 제1전극(51)이 형성될 수 있다.상기 제1전극(51)은 상기 접촉층(15)의 영역과 수직 방향으로 오버랩되지 않게 배치될 수 있다.A
상기 발광 구조물(10)의 표면에 표면보호층(미도시)이 형성될 수 있다. 상기 표면 보호층은 발광 구조물(10)의 측면 및 상면 일부에 증착될 수 있으며, 이에 대해 한정하지는 않는다.
A surface protection layer (not shown) may be formed on the surface of the
도 10은 제2실시 예에 따른 발광 소자를 나타낸 측 단면도이다.도 10을 설명함에 있어서,도 1과 동일한 구성은 도 1의 설명을 참조하기로 한다.10 is a cross-sectional side view showing a light emitting device according to the second embodiment. In describing FIG. 10, the same structure as FIG. 1 will be described with reference to FIG.
도 10을 참조하면,발광 소자는 발광 구조물(10) 내에 복수의 전위(14)가 배치될 수 있다.상기 전위(14)는 제1도전형 반도체층(11)의 상면부터 발광 구조물(10)의 하면방향으로 연장된다. 10, a plurality of
실시 예는 상기 전위(14)와 상기 절연층(41) 사이에차단막(47)이 형성된다.상기 차단막(47)은상기 발광 구조물(10)의 하면으로부터 상기 발광 구조물(10)의 상면 방향으로 연장된다.상기 차단막(47)은 상기 전위(14)와 대응되는 영역에 배치되며,상기 절연층(41)로부터활성층(12)의 상면 높이까지 연장될 수 있다.상기 전위(14)는 상기 제1도전형 반도체층(11)의 상면과 상기 차단막(47) 사이에 적어도 하나가 배치될 수 있다.상기 차단막(47)은절연층(41)과 상기 제1도전형 반도체층(11) 사이에 복수 개가 서로 이격되어배치될 수 있다.상기 차단막(47)은 상기 절연층(41)과 동일한 물질로 형성될 수 있으며,이에 대해 한정하지는 않는다.상기 차단막(47)의 단면은 하부가 넓고 상부가 좁은 형상 예컨대,뿔 형상으로 형성될 수 있으나 이에 한정하지 않으며, 원형, 타원형 또는 다각형 형상으로 형성될 수 있다.상기 차단막(47)은 상기 발광 구조물(10) 내에 배치되어,상기 전위(14)가 전파되는 것을 차단하여, 활성층(12)을 보호할 수 있다.The
또한 상기 전위(14) 중 적어도 하나는 상기 제1전극(51) 및 암 패턴(52)에 적어도 일부가 오버랩되게 배치될 수 있으며,이에 대해 한정하지는 않는다.상기 차단막(47)은 상기 접촉층(15)과 수직 방향으로 오버랩되지 않게 또는 어긋나게 배치된다.실시 예는 접촉층(15)을 이격시켜 주어 전류 확산 경로를 제공하고,또한 차단막(47)을 발광 구조물(10) 내에 배치하여,비 정상적인 전원이 전달되는 것을 차단하여 활성층(12)을 보호할 수 있다.
At least one of the
도 11은 제3실시 예에 따른 발광 소자를 나타낸 측 단면도이다.도 11을 설명함에 있어서,상기에 개시된 구성과 동일한 부분은 상기에 개시된 실시 예의 설명을 참조하기로 한다.11 is a side sectional view showing a light emitting device according to the third embodiment. In describing FIG. 11, the same parts as those described above will be described with reference to the description of the embodiments disclosed above.
도 11을 참조하면,발광 소자는 발광 구조물(10)의 아래에 제1및 제2접촉층(15A,15B)을 갖는접촉층(15)을 포함한다.상기 제1접촉층(15A)은 상기 절연층(41)의 오픈 영역(42) 내에서 배치되며,상기 제2도전형 반도체층(13)과 접촉된다.상기 제2접촉층(15B)는 상기 제1접촉층(15A)보다 넓은 너비를 갖고 상기 제1접촉층(15A)과 반사층(17) 사이에 배치된다.상기 제2접촉층(15B)은 상기 절연층(41)의 하면에 배치될 수 있다.상기 제2접촉층(15B)가 상기 제1접촉층(15A)의 너비보다 넓게 배치됨으로써, 상기 반사층(17)과 상기 절연층(41)의 하면에 접촉될 수 있다.이에 따라 제2접촉층(15B)의 접착력은 개선될 수 있다.상기 제1및 제2접촉층(15A,15B)를 갖는 접촉층(15)은 서로 다른 영역에 제1전극(51)과 수직 방향으로 오버랩되지 않게 배치될 수 있다.11, the light emitting device includes a
상기 제1접촉층(15A)은 상기 제2도전형 반도체층(13)과 오믹 접촉되며,제2접촉층(15B)는 상기 제1접촉층(15A)와 다른 물질로 형성될 수 있다.The
상기 제1접촉층(15A)는 투광성 물질인 경우,상기 제2접촉층(15A)는 상기 제1접촉층(15A)와 투과율이 다른 투광성 물질이거나 금속 물질로 형성될 수 있다.상기 제1접촉층(15A)는 ITO(Indium-Tin-Oxide), IZO(Indium-Zinc-Oxide), IZTO(Indium-Zinc-Tin-Oxide), IAZO(Indium-Aluminum-Zinc-Oxide), IGZO(Indium-Gallium-Zinc-Oxide), IGTO(Indium-Gallium-Tin-Oxide), AZO(Aluminum-Zinc-Oxide), ATO(Antimony-Tin-Oxide) 등의 투광성 물질을 이용하여 형성될 수 있다. 상기 제2접촉층(15B)은상기 제1접촉층(15A)와 다른 금속 산화물이거나,Ni, Pt, In, Zn, Ag와 같은 금속 중에서 선택될 수 있다.When the
상기 반사층(17)은 상기 제2접촉층(15B) 및 절연층(41)의 아래에 배치되어,입사되는 광을 반사시켜 줄 수 있다.
The
도 12는 제4실시 예에 따른 발광 소자를 나타낸 측 단면도이다.도 12를 설명함에 있어서,상기에 개시된 구성과 동일한 부분은 상기에 개시된 실시 예의 설명을 참조하기로 한다.12 is a side sectional view showing a light emitting device according to the fourth embodiment. In describing FIG. 12, the same parts as those described above will be described with reference to the description of the embodiments disclosed above.
도 12를 참조하면,발광 소자는 발광 구조물(10) 아래에 절연층(41) 및 제2전극(20)이 배치된다.Referring to FIG. 12, in the light emitting device, the insulating
상기 제2전극(20)은 접촉층(15C), 반사층(17), 접합층(19) 및 지지부재(21)를 포함한다.상기 접촉층(15C)는 절연층(41)의 서로 다른 오픈 영역(42)에 각각 접촉되는 복수의 접촉 영역을 포함한다.상기 접촉층(15C)는 내부에 구멍(31)이 배치되며,상기 절연층(41)의 하면으로 연장된다.상기 접촉층(15C)의 구멍(31)에는 반사층(17)의 돌출부(17B)가 배치되며,상기 돌출부(17B)는 상기 제2도전형 반도체층(13)의 하면에 접촉된다.상기 접촉층(15C)과 상기 반사층(17)의 돌출부(17B)는 상기 제2도전형 반도체층(13)의 하면에 접촉되며,예컨대 상기 접촉층(15C)는 오믹 접촉되며,상기 돌출부(17B)는 쇼트키 접촉될 수 있다.상기 접촉층(15C)는 상기 제1전극(51)과 수직 방향으로 오버랩되지 않게 배치됨으로,전류를 확산시켜 줄 수 있다.The
실시 예에 따른 발광 소자의 제1전극(51)은 다른 영역에 배치될 수 있다.예컨대,제1전극이 제1도전형 반도체층의 하부에 비아 구조로 접촉되거나,제1도전형 반도체층의 외 측벽 아래에 접촉될 수 있다.이러한 제1전극과 제1도전형 반도체층의 접촉 영역은 실시 예에 따른 접촉층(15,15C)와 오버랩되지 않게 배치될 수 있다.
The
도 13은 도 1의 발광 소자를 갖는 발광 소자 패키지를 나타낸 측 단면도이다.13 is a side sectional view showing a light emitting device package having the light emitting element of FIG.
도 13을 참조하면,발광 소자 패키지는 몸체(101)와, 상기 몸체(101)에 배치된 제1 리드전극(121) 및 제2 리드전극(123)과, 상기 몸체(101)에 제공되어 상기 제1 리드전극(121) 및 제2 리드전극(123)과 전기적으로 연결되는 실시 예에 따른 발광소자(100)와, 상기 발광소자(100)를 포위하는 몰딩부재(131)를 포함한다.13, the light emitting device package includes a
상기 몸체(101)는 실리콘 재질, 합성수지 재질, 또는 금속 재질을 포함하여 형성될 수 있으며, 상기 발광소자(100)의 주위에 경사면을 갖는 캐비티(103)을 제공할 수 있다.The
상기 제1 리드전극(121) 및 제2 리드전극(123)은 서로 전기적으로 분리되며, 상기 발광소자(100)에 전원을 제공한다. 또한, 상기 제1 리드전극(121) 및 제2 리드전극(123)은 상기 발광소자(100)에서 발생된 빛을 반사시켜 광 효율을 증가시킬 수 있으며, 상기 발광소자(100)에서 발생된 열을 외부로 배출시키는 역할을 할 수도 있다.The first
상기 발광소자(100)의 상기 제1 리드전극(121)위에 배치되고 상기 제2리드 전극(123)과 와이어(105)로 연결된다.상기 발광소자(100)는 예들 들어,상기 제1 리드전극(121) 위에 전도성 접착제(미도시)로 다이 본딩될 수 있다. The
상기 몰딩부재(131)는 상기 발광소자(100)를 포위하여 상기 발광소자(100)를 보호할 수 있다. 또한, 상기 몰딩부재(131)에는 형광체가 포함되어 상기 발광소자(100)에서 방출된 광의 파장을 변화시킬 수 있다.The
실시 예에 따른 발광소자 또는 발광소자 패키지는 복수 개가 기판 위에 어레이될 수 있으며, 상기 발광소자 패키지의 광 경로 상에 광학 부재인 렌즈, 도광판, 프리즘 시트, 확산 시트 등이 배치될 수 있다. 이러한 발광소자 패키지, 기판, 광학 부재는 라이트유닛으로 기능할 수 있다. 상기 라이트유닛은탑뷰 또는 사이드 뷰 타입으로 구현되어, 휴대 단말기 및 노트북 컴퓨터 등의 표시 장치에 제공되거나, 조명장치 및 지시 장치 등에 다양하게 적용될 수 있다. 또 다른 실시 예는 상술한 실시 예들에 기재된 발광소자 또는 발광소자 패키지를 포함하는 조명 장치로 구현될 수 있다. 예를 들어, 조명 장치는 램프, 가로등, 전광판, 전조등을 포함할 수 있다.
A plurality of light emitting devices or light emitting device packages according to the embodiments may be arrayed on a substrate, and a lens, a light guide plate, a prism sheet, a diffusion sheet, etc., which are optical members, may be disposed on the light path of the light emitting device package. Such a light emitting device package, a substrate, and an optical member can function as a light unit. The light unit may be implemented as a top view or a side view type, and may be provided in a display device such as a portable terminal and a notebook computer, or may be variously applied to a lighting device and a pointing device. Still another embodiment may be embodied as a lighting device including the light emitting device or the light emitting device package described in the above embodiments. For example, the lighting device may include a lamp, a streetlight, an electric signboard, and a headlight.
이상에서 실시 예들에 설명된 특징, 구조, 효과 등은 본 발명의 적어도 하나의 실시 예에 포함되며, 반드시 하나의 실시 예에만 한정되는 것은 아니다. 나아가, 각 실시 예에서 예시된 특징, 구조, 효과 등은 실시 예들이 속하는 분야의 통상의 지식을 가지는 자에 의해 다른 실시 예들에 대해서도 조합 또는 변형되어 실시 가능하다. 따라서 이러한 조합과 변형에 관계된 내용들은 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.The features, structures, effects and the like described in the embodiments are included in at least one embodiment of the present invention and are not necessarily limited to one embodiment. Further, the features, structures, effects, and the like illustrated in the embodiments can be combined and modified by other persons having ordinary skill in the art to which the embodiments belong. Therefore, it should be understood that the present invention is not limited to these combinations and modifications.
또한, 이상에서 실시 예를 중심으로 설명하였으나 이는 단지 예시일 뿐 본 발명을 한정하는 것이 아니며, 본 발명이 속하는 분야의 통상의 지식을 가진 자라면 본 실시 예의 본질적인 특성을 벗어나지 않는 범위에서 이상에 예시되지 않은 여러 가지의 변형과 응용이 가능함을 알 수 있을 것이다. 예를 들어, 실시 예에 구체적으로 나타난 각 구성 요소는 변형하여 실시할 수 있는 것이다. 그리고 이러한 변형과 응용에 관계된 차이점들은 첨부된 청구 범위에서 규정하는 본 발명의 범위에 포함되는 것으로 해석되어야 할 것이다.While the present invention has been particularly shown and described with reference to exemplary embodiments thereof, it is clearly understood that the same is by way of illustration and example only and is not to be taken by way of illustration, It can be seen that various modifications and applications are possible. For example, each component specifically shown in the embodiments can be modified and implemented. It is to be understood that all changes and modifications that come within the meaning and range of equivalency of the claims are therefore intended to be embraced therein.
10: 발광구조물
11: 제1도전형반도체층
12: 활성층
13: 제2도전형반도체층
15,15C: 접촉층
17: 반사층
19: 접합층
20: 제2전극
21: 지지부재
51: 제1전극
41: 절연층
45: 보호층
47: 차단막
100: 발광소자10: light emitting structure 11: first conductive type semiconductor layer
12: active layer 13: second conductivity type semiconductor layer
15, 15C: contact layer 17: reflective layer
19: bonding layer 20: second electrode
21: support member 51: first electrode
41: insulating layer 45: protective layer
47: a shielding film 100:
Claims (11)
상기 제2도전형 반도체층 아래에 복수의 오픈 영역을 갖는 절연층;
상기 절연층의 각 오픈 영역에 배치된 접촉층;
상기 접촉층 및 상기 절연층 아래에 배치된 반사층;
상기 반사층 아래에 배치된 접합층;
상기 접합층 아래에 배치된 전도성의 지지부재;및
상기 제1도전형 반도체층 위에 상기 복수의 오픈 영역과 수직 방향으로 어긋나게 배치된 제1전극을 포함하는 발광 소자.A light emitting structure including a first conductive semiconductor layer, an active layer below the first conductive semiconductor layer, and a second conductive semiconductor layer below the active layer;
An insulating layer having a plurality of open regions under the second conductive type semiconductor layer;
A contact layer disposed in each open region of the insulating layer;
A reflective layer disposed below the contact layer and the insulating layer;
A bonding layer disposed under the reflective layer;
A conductive support member disposed below the bonding layer;
And a first electrode arranged on the first conductivity type semiconductor layer so as to be shifted in the vertical direction from the plurality of open regions.
상기 차단막은 절연 재질로 상기 활성층의 상면 높이까지 연장되는 발광소자.The light emitting device according to any one of claims 1 to 3, further comprising a plurality of blocking films extending from the insulating layer toward the top surface of the light emitting structure,
Wherein the blocking layer extends from the insulating layer to the top surface of the active layer.
상기 반사층은 상기 구멍을 통해 상기 제2도전형 반도체층의하면에 접촉된 돌출부를 포함하는 발광소자.4. A method according to any one of claims 1 to 3, comprising a hole disposed within the contact layer,
And the reflective layer includes a protrusion that is in contact with the second conductive semiconductor layer through the hole.
상기 제1및 제2접촉층은 서로 다른 전도성 물질로 형성되는 발광 소자.The semiconductor light emitting device according to any one of claims 1 to 3, wherein the contact layer comprises: a first contact layer disposed on each of the open regions and in contact with a lower surface of the second conductive semiconductor layer; And a second contact layer disposed between the first contact layer and the reflective layer,
Wherein the first and second contact layers are formed of different conductive materials.
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