KR20150136669A - 게이트 구동 회로 및 이를 포함하는 표시 장치 - Google Patents

게이트 구동 회로 및 이를 포함하는 표시 장치 Download PDF

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Abstract

표시 장치는 표시 패널, 데이터 구동 회로, 게이트 구동 회로 및 타이밍 제어부를 포함한다. 게이트 구동 회로의 제N(N은 자연수) 스테이지는 제1 클럭 신호에 응답하여 입력 신호를 제1 노드에 인가하는 제1 입력부, 제1 노드에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력하는 제1 출력부, 제1 노드 신호에 응답하여 제1 클럭 신호를 제2 노드에 인가하는 제2 입력부, 제2 노드에 인가된 제2 노드 신호에 응답하여 제1 전압을 제N 게이트 출력 신호로 출력하는 제2 출력부, 및 출력 제어 신호에 응답하여 제1 출력부를 활성화시키는 출력 제어부를 포함한다.

Description

게이트 구동 회로 및 이를 포함하는 표시 장치{GATE DRIVING CIRCUIT AND DISPLAY DEVICE HAVING THE SAME}
본 발명은 표시 장치에 관한 것으로, 보다 상세하게는 게이트 구동 회로 및 게이트 구동 회로를 포함하는 표시 장치에 관한 것이다.
일반적으로, 표시 장치는 표시 패널 및 구동부를 포함한다. 표시 패널은 복수의 게이트 라인들, 복수의 데이터 라인들 및 복수의 화소들을 포함한다. 구동부는 복수의 게이트 라인들에 게이트 출력 신호를 공급하는 게이트 구동 회로 및 데이터 라인들에 데이터 전압을 공급하는 데이터 구동 회로를 포함한다. 게이트 구동 회로는 복수의 게이트 출력 신호들을 각각 출력하는 복수의 스테이지들을 포함한다.
최근, 폴더블(foldable) 표시 장치, 플렉서블(flexible) 표시 장치 등 다양한 종류의 표시 장치가 개발되고 있다. 휴대용 전자 기기에 포함되는 폴더블 표시 장치 또는 플렉서블 표시 장치는 배터리로부터 전원을 공급받아 구동 시간에 제한이 있으므로, 소비 전력을 절감시켜 구동 시간을 연장하기 위한 다양한 연구가 진행되고 있다.
본 발명의 일 목적은 게이트 출력 신호를 제어할 수 있는 게이트 구동 회로를 제공하는 것이다.
본 발명의 다른 목적은 상기 게이트 구동 회로를 포함하여 소비 전력을 절감할 수 있는 표시 장치를 제공하는 것이다.
다만, 본 발명의 목적은 상기 목적들로 한정되는 것이 아니며, 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위에서 다양하게 확장될 수 있을 것이다.
본 발명의 일 목적을 달성하기 위하여, 본 발명의 실시예들에 따른 게이트 구동 회로는 복수의 게이트 출력 신호들을 각각 출력하는 복수의 스테이지들을 포함할 수 있다. 제N(N은 자연수) 스테이지는 제1 클럭 신호에 응답하여 입력 신호를 제1 노드에 인가하는 제1 입력부, 상기 제1 노드에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력하는 제1 출력부, 상기 제1 노드 신호에 응답하여 상기 제1 클럭 신호를 제2 노드에 인가하는 제2 입력부, 상기 제2 노드에 인가된 제2 노드 신호에 응답하여 제1 전압을 상기 제N 게이트 출력 신호로 출력하는 제2 출력부, 및 출력 제어 신호에 응답하여 상기 제1 출력부를 활성화시키는 출력 제어부를 포함할 수 있다.
일 실시예에 의하면, 상기 제N 스테이지는 상기 제2 노드 신호 및 상기 제2 클럭 신호에 응답하여 상기 제N 게이트 출력 신호를 안정화하는 안정화부를 더 포함할 수 있다.
일 실시예에 의하면, 상기 안정화부는 직렬로 연결된 제1 안정화 트랜지스터 및 제2 안정화 트랜지스터를 포함하고, 상기 제1 안정화 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극 및 상기 제2 안정화 트랜지스터의 소스 전극에 연결된 드레인 전극을 포함하며, 상기 제2 안정화 트랜지스터는 상기 제2 클럭 신호가 인가되는 게이트 전극, 상기 제1 안정화 트랜지스터의 상기 드레인 전극에 연결된 소스 전극 및 상기 제1 노드에 연결된 드레인 전극을 포함할 수 있다.
일 실시예에 의하면, 상기 제N 스테이지는 상기 제1 클럭 신호에 응답하여 상기 제2 노드 신호를 유지시키는 유지부를 더 포함할 수 있다.
일 실시예에 의하면, 상기 출력 제어 신호가 제1 논리 레벨인 경우 상기 제1 클럭 신호 및 상기 제2 클럭 신호는 제2 논리 레벨일 수 있다.
본 발명의 다른 목적을 달성하기 위하여, 발명의 실시예들에 따른 표시 장치는 복수의 게이트 라인들, 상기 게이트 라인들과 교차하는 복수의 데이터 라인들 및 복수의 화소들을 포함하는 표시 패널, 상기 데이터 라인들에 복수의 데이터 신호를 각각 출력하는 데이터 구동 회로, 상기 게이트 라인들에 복수의 게이트 출력 신호들을 각각 출력하는 복수의 스테이지들을 포함하는 게이트 구동 회로, 및 상기 게이트 구동 회로 및 상기 데이터 구동 회로를 제어하는 타이밍 제어부를 포함할 수 있다. 상기 게이트 구동 회로의 제N(N은 자연수) 스테이지는 제1 클럭 신호에 응답하여 입력 신호를 제1 노드에 인가하는 제1 입력부, 상기 제1 노드에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력하는 제1 출력부, 상기 제1 노드 신호에 응답하여 상기 제1 클럭 신호를 제2 노드에 인가하는 제2 입력부, 상기 제2 노드에 인가된 제2 노드 신호에 응답하여 제1 전압을 상기 제N 게이트 출력 신호로 출력하는 제2 출력부, 및 출력 제어 신호에 응답하여 상기 제1 출력부를 활성화시키는 출력 제어부를 포함할 수 있다.
일 실시예에 의하면, 상기 표시 패널은 적어도 하나의 폴딩라인에서 폴드(fold)되는 폴더블(foldable) 표시 패널일 수 있다.
일 실시예에 의하면, 상기 타이밍 제어부는 상기 표시 패널이 폴드되는 경우, 상기 게이트 구동 회로의 상기 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력할 수 있다.
일 실시예에 의하면, 상기 표시 패널은 휘어질 수 있는 플렉서블(flexible) 표시 패널일 수 있다.
일 실시예에 의하면, 상기 표시 패널의 비표시 영역을 감지하여, 상기 타이밍 제어부에 상기 비표시 영역에 대한 비표시 영역 정보를 제공하는 플렉서블 감지부를 더 포함하고, 상기 타이밍 제어부는 상기 비표시 영역 정보를 이용하여 상기 게이트 구동 회로의 상기 스테이지들 중 상기 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력할 수 있다.
일 실시예에 의하면, 상기 타이밍 제어부는 상기 데이터 신호에 포함된 영상 데이터가 정지 영상인 경우, 기 지정된 길이의 비표시 구간 동안 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력할 수 있다.
일 실시예에 의하면, 상기 제N 스테이지는 상기 제2 노드 신호 및 상기 제2 클럭 신호에 응답하여 상기 제N 게이트 출력 신호를 안정화하는 안정화부를 더 포함할 수 있다.
일 실시예에 의하면, 상기 안정화부는 직렬로 연결된 제1 안정화 트랜지스터 및 제2 안정화 트랜지스터를 포함할 수 있다. 상기 제1 안정화 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극 및 상기 제2 안정화 트랜지스터의 소스 전극에 연결된 드레인 전극을 포함할 수 있다. 상기 제2 안정화 트랜지스터는 상기 제2 클럭 신호가 인가되는 게이트 전극, 상기 제1 안정화 트랜지스터의 상기 드레인 전극에 연결된 소스 전극 및 상기 제1 노드에 연결된 드레인 전극을 포함할 수 있다.
일 실시예에 의하면, 상기 제N 스테이지는 상기 제1 클럭 신호에 응답하여 상기 제2 노드 신호를 유지시키는 유지부를 더 포함할 수 있다.
일 실시예에 의하면, 상기 유지부는 상기 제1 클럭 신호가 인가되는 게이트 전극, 제2 전압이 인가되는 소스 전극, 및 상기 제2 노드에 연결된 드레인 전극을 포함하는 유지 트랜지스터를 포함할 수 있다.
일 실시예에 의하면, 상기 제1 입력부는 상기 제1 클럭 신호가 인가되는 게이트 전극, 상기 입력 신호가 인가되는 소스 전극, 및 상기 제1 노드에 연결된 드레인 전극을 포함하는 제1 입력 트랜지스터를 포함할 수 있다.
일 실시예에 의하면, 상기 제1 출력부는 제1 출력 트랜지스터 및 제1 커패시터를 포함할 수 있다. 상기 제1 출력 트랜지스터는 상기 제1 노드에 연결된 게이트 전극, 상기 제2 클럭 신호가 인가되는 소스 전극, 및 상기 제N 게이트 출력 신호를 출력하는 출력 단자에 연결된 드레인 전극을 포함할 수 있다. 상기 제1 커패시터는 상기 제1 노드에 연결된 제1 전극 및 상기 출력 단자에 연결된 제2 전극을 포함할 수 있다.
일 실시예에 의하면, 상기 제2 입력부는 상기 제1 노드에 연결된 게이트 전극, 상기 제1 클럭 신호가 인가되는 소스 전극, 및 상기 제2 노드에 연결된 드레인 전극을 포함하는 제2 입력 트랜지스터를 포함할 수 있다.
일 실시예에 의하면, 상기 제2 출력부는 제2 출력 트랜지스터 및 제2 커패시터를 포함할 수 있다. 상기 제2 출력 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극, 및 상기 제N 게이트 출력 신호를 출력하는 출력 단자에 연결된 드레인 전극을 포함할 수 있다. 상기 제2 커패시터는 상기 제2 노드에 연결된 제1 전극 및 상기 제1 전압을 출력하는 제1 전압 입력 단자에 연결된 제2 전극을 포함할 수 있다.
일 실시예에 의하면, 상기 출력 제어부는 상기 출력 제어 신호가 인가되는 게이트 전극, 제2 전압이 인가되는 소스 전극, 및 상기 제1 노드에 연결된 드레인 전극을 포함하는 출력 제어 트랜지스터를 포함할 수 있다.
본 발명의 실시예들에 따른 게이트 구동 회로는 출력 제어 신호에 상응하여 게이트 출력 신호의 출력을 제어함으로써, 게이트 출력 신호의 불필요한 출력을 방지할 수 있다.
본 발명의 실시예들에 따른 표시 장치는 상기 게이트 구동 회로를 포함함으로써 소비 전력을 절감할 수 있다. 상기 표시 장치는 표시 패널의 비표시 영역을 비활성화할 수 있다. 또한, 상기 표시 장치는 저주파 구동을 수행할 수 있다.
다만, 본 발명의 효과는 상기 효과들로 한정되는 것이 아니며, 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위에서 다양하게 확장될 수 있을 것이다.
도 1은 본 발명의 실시예들에 따른 표시 장치의 일 예를 나타내는 블록도이다.
도 2는 도 1의 표시 장치가 비표시 영역에서 게이트 출력 신호를 제어하는 일 예를 나타내는 도면이다.
도 3은 도 1의 표시 장치에 포함된 게이트 구동 회로의 일 예를 나타내는 블록도이다.
도 4는 도 3의 게이트 구동 회로에 포함된 제N 스테이지의 일 예를 나타내는 회로도이다.
도 5는 도 3의 게이트 구동 회로의 입력 신호들, 노드 신호들 및 출력 신호들의 일 예를 나타내는 파형도이다.
도 6은 도 3의 게이트 구동 회로의 입력 신호들, 노드 신호들 및 출력 신호들의 다른 예를 나타내는 파형도이다.
도 7은 본 발명의 실시예들에 따른 표시 장치의 다른 예를 나타내는 블록도이다.
도 8은 도 7의 표시 장치가 비표시 영역에서 게이트 출력 신호를 제어하는 일 예를 나타내는 도면이다.
이하, 첨부한 도면들을 참조하여, 본 발명의 실시예들을 보다 상세하게 설명하고자 한다. 도면상의 동일한 구성 요소에 대해서는 동일하거나 유사한 참조 부호를 사용한다.
도 1은 본 발명의 실시예들에 따른 표시 장치의 일 예를 나타내는 블록도이다.
도 1을 참조하면, 표시 장치(1000A)는 표시 패널(100), 타이밍 제어부(200), 게이트 구동 회로(300) 및 데이터 구동 회로(400)를 포함할 수 있다. 일 실시예에서, 표시 장치(1000A)는 유기 발광 표시 장치일 수 있다. 다른 실시예에서, 표시 장치(1000A)는 액정 표시 장치일 수 있다.
표시 패널(100)은 영상을 표시할 수 있다. 표시 패널(100)은 복수의 게이트 라인들(GL), 복수의 데이터 라인들(DL) 및 게이트 라인들(GL) 및 데이터 라인들(DL)에 연결된 복수의 화소들(P)을 포함할 수 있다. 예를 들어, 화소들(P)은 매트릭스 형태로 배치될 수 있다. 일 실시예에서, 게이트 라인들(GL)의 개수는 n개일 수 있다. 데이터 배선들(DL)의 개수는 m개일 수 있다. n 및 m은 자연수이다. 일 실시예에서, 화소들(P)의 개수는 n*m개일 수 있다. 일 실시예에서, 3개의 화소들(P)이 하나의 화소를 이룰 수 있고, 화소들(P)의 개수는 n*m의 1/3일 수 있다. 일 실시예에서, 표시 패널(100)은 적어도 하나의 폴딩라인에서 폴드(fold)되는 폴더블(foldable) 표시 패널일 수 있다. 다른 실시예에서, 표시 패널(100)은 휘어질 수 있는 플렉서블(flexible) 표시 패널일 수 있다.
타이밍 제어부(200)는 외부의 그래픽 기기와 같은 화상 소스로부터 입력 제어 신호(CONT) 및 입력 영상 데이터(DATA1)를 수신할 수 있다. 입력 제어 신호(CONT)는 메인 클럭 신호, 수직 동기 신호, 수평 동기 신호, 데이터 인에이블 신호 등을 포함할 수 있다. 타이밍 제어부(200)는 입력 제어 신호(CONT)에 기초하여 게이트 구동 회로(300)의 구동 타이밍을 제어하기 위한 제1 제어 신호(CONT1)를 생성하여 게이트 구동 회로(300)에 공급할 수 있다. 또한, 타이밍 제어부(200)는 입력 영상 데이터(DATA1)에 기초하여 표시 패널(100)의 동작 조건에 맞는 데이터 신호(DATA2)를 생성하여 데이터 구동 회로(400)에 공급할 수 있다. 타이밍 제어부(200)는 입력 제어 신호(CONT)에 기초하여 데이터 구동 회로(400)의 구동 타이밍을 제어하기 위한 제2 제어 신호(CONT2)를 생성하여 데이터 구동 회로(400)에 공급할 수 있다.
타이밍 제어부(200)는 표시 패널(100)의 출력을 제어하기 위해 제1 제어 신호(CONT1)에 포함된 출력 제어 신호, 제1 클럭 신호 및 제2 클럭 신호를 조정할 수 있다. 일 실시예에서, 타이밍 제어부(200)는 표시 패널(100)의 비표시 영역의 출력을 제한할 수 있다. 예를 들어, 표시 패널(100)이 적어도 하나의 폴딩라인에서 폴드(fold)되는 폴더블(foldable) 표시 패널인 경우, 타이밍 제어부(200)는 표시 패널(100)이 폴드되는 경우 게이트 구동 회로(300)의 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호를 제1 논리 레벨(예를 들면, 로우 레벨)로 출력하고, 제1 클럭 신호 및 제2 클럭 신호를 제2 논리 레벨(예를 들면, 하이 레벨)로 출력할 수 있다. 또한, 표시 패널(100)이 휘어질 수 있는 플렉서블(flexible) 표시 패널인 경우, 타이밍 제어부(200)는 비표시 영역 정보를 이용하여 게이트 구동 회로(300)의 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호를 제1 논리 레벨로 출력하고, 제1 클럭 신호 및 제2 클럭 신호를 제2 논리 레벨로 출력할 수 있다. 다른 실시예에서, 타이밍 제어부(200)는 구동 기간을 분할하여 저주파 구동을 수행할 수 있다. 예를 들어, 타이밍 제어부(200)는 이전 프레임의 영상 데이터와 비교하여 영상 데이터가 정지 영상인지 판단할 수 있다. 타이밍 제어부(200)는 영상 데이터가 정지 영상인 경우, 기 지정된 길이의 비표시 구간 동안 출력 제어 신호를 제1 논리 레벨로 출력하고, 제1 클럭 신호 및 제2 클럭 신호를 제2 논리 레벨로 출력할 수 있다.
게이트 구동 회로(300)는 타이밍 제어부(200)로부터 수신되는 제1 제어신호(CONT1)에 기초하여 각각의 프레임마다 게이트 라인들(GL)에 순차적으로 게이트 출력 신호를 인가할 수 있다. 게이트 구동 회로(300)는 출력 제어부를 포함하여 출력 제어 신호에 상응하여 게이트 출력 신호를 제어할 수 있다.
데이터 구동 회로(400)는 타이밍 제어부(200)로부터 수신되는 제2 제어신호(CONT2)에 기초하여 타이밍 제어부(200)로부터 수신되는 데이터 신호(DATA2)를 데이터 전압으로 변환하고 복수의 데이터 라인들(DL)에 데이터 전압을 인가할 수 있다.
이 밖에도, 표시 장치(1000A)는 전압 생성부 등을 더 포함할 수 있다. 전압 생성부는 외부 전원을 공급받고, 이에 기초하여 게이트 구동 회로(300)를 구동하기 위한 게이트 구동 전압을 생성하여 게이트 구동 회로(300)에 공급하고, 데이터 구동 회로(400)를 구동하기 위한 데이터 구동 전압을 생성하여 데이터 구동 회로(400)에 공급할 수 있다. 일 실시예에서, 표시 장치(1000A)가 유기 발광 표시 장치인 경우, 전압 생성부는 유기 발광 소자를 구동하기 위한 제1 전원 전압 및 제2 전원 전압을 생성하여 표시 패널(100)에 공급할 수 있다. 다른 실시예에서, 표시 장치(1000A)가 액정 표시 장치인 경우 전압 생성부는 공통 전압 및 스토리지 전압을 생성하여 표시 패널(100)에 공급할 수 있다.
표시 장치(1000A)는 출력 제어 신호에 상응하여 게이트 출력 신호를 제어함으로써, 게이트 출력 신호의 불필요한 출력을 방지할 수 있다. 특히, 표시 장치(1000A)는 폴더블 표시 패널 또는 플렉서블 표시 패널을 포함하고, 표시 패널의 비표시 영역을 비활성화함으로써 소비 전력을 절감할 수 있다. 또한, 표시 장치(1000A)는 영상 데이터가 정지 영상인 경우 저주파 구동을 수행할 수 있다.
도 2는 도 1의 표시 장치가 비표시 영역에서 게이트 출력 신호를 제어하는 일 예를 나타내는 도면이다.
도 2를 참조하면, 표시 패널(100A)는 적어도 하나의 폴딩라인에서 폴드되는 폴더블 표시 패널일 수 있다. 폴더블 표시 패널은 폴딩라인(FP)을 기준으로 폴드되고, 표시 영역(DA)과 비표시 영역(NA)으로 구분될 수 있다.
표시 장치에 포함된 게이트 구동 회로는 표시 영역(DA)에 상응하는 게이트 출력 신호들을 순차적으로 출력하고, 비표시 영역(NA)에 상응하는 게이트 출력 신호들의 출력을 제한할 수 있다. 예를 들어, 제1 게이트 출력 신호 내지 제n 게이트 출력 신호를 순차적으로 출력하는 게이트 구동 회로에서, 제m 게이트 출력 신호(G(m))를 기준으로 표시 영역(DA)과 비표시 영역(NA)이 구분될 수 있다. 즉, 표시 영역(DA)이 제1 게이트 출력 신호 내지 제m 게이트 출력 신호에 상응하는 경우, 게이트 구동 회로는 제1 게이트 출력 신호 내지 제m 게이트 출력 신호를 순차적으로 출력하고, 제m+1 게이트 출력 신호 내지 제n 게이트 출력 신호는 출력을 제한할 수 있다. 예를 들어, 폴더블 표시 장치는 센서를 이용하여 폴더블 표시 패널이 폴드됨을 인식할 수 있다. 폴더블 표시 패널이 폴드되는 경우, 출력 제어 신호 및 클럭 신호를 타이밍 제어부는 비표시 영역(NA)에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호, 제1 클럭 신호, 및 제2 클럭 신호를 조정함으로서, 비표시 영역(NA)에서 불필요한 영상이 표시되지 않을 수 있도록 제어할 수 있다.
도 3은 도 1의 표시 장치에 포함된 게이트 구동 회로의 일 예를 나타내는 블록도이다. 도 4는 도 3의 게이트 구동 회로에 포함된 제N 스테이지의 일 예를 나타내는 회로도이다. 도 5는 도 3의 게이트 구동 회로의 입력 신호들, 노드 신호들 및 출력 신호들의 일 예를 나타내는 파형도이다.
도 3 내지 도 5를 참조하면, 게이트 구동 회로(300)는 서로 종속적으로 연결된 복수의 스테이지들(SRC1, SRC2, SRC3, SRC4, ...)을 포함할 수 있다.
도 3에 도시된 바와 같이, 복수의 스테이지들(SRC1, SRC2, SRC3, SRC4, ...) 각각은 제1 클럭 단자(CK1), 제2 클럭 단자(CK2), 출력 제어 단자(GP), 입력 단자(G(n-1)), 및 출력 단자(G(n))를 포함할 수 있다. 또한, 복수의 스테이지들(SRC1, SRC2, SRC3, SRC4, ...) 각각은 제1 전압 입력 단자 및 제2 전압 입력 단자를 더 포함할 수 있다.
제1 클럭 단자(CK1) 및 제2 클럭 단자(CK2)에는 서로 다른 타이밍을 갖는 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)가 공급될 수 있다. 예를 들어, 제2 게이트 클럭 신호(CLK2)는 제1 게이트 클럭 신호(CLK1)의 반전 신호일 수 있다. 이웃한 스테이지에서 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)는 서로 반대로 인가될 수 있다. 예를 들어, 홀수 번째 스테이지(SRC1, SRC3, ...)의 제1 클럭 단자(CK1)에는 제1 게이트 클럭 신호(CLK1)가 인가되고, 제2 클럭 단자(CK2)에는 제2 게이트 클럭 신호(CLK2)가 공급될 수 있다. 반대로, 짝수 번째 스테이지(SRC2, SRC4, ...)의 제1 클럭 단자(CK1)에는 제2 게이트 클럭 신호(CLK2)가 인가되고, 제2 클럭 단자(CK2)에는 제1 게이트 클럭 신호(CLK1)가 인가될 수 있다.
출력 제어 단자(GP)에는 출력 제어 신호(GPS)가 인가될 수 있다. 출력 제어 신호(GPS)는 모든 스테이지들에 인가되어 표시 패널 전체의 출력을 제어할 수 있다.
입력 단자(G(n-1))에는 수직 개시 신호(SSP) 또는 이전 스테이지의 게이트 출력 신호가 인가될 수 있다. 즉, 첫 번째 스테이지인 제1 스테이지(SRC1)의 입력 단자(G(N-1))에는 수직개시신호(SSP)가 인가되고, 제2 내지 제n 스테이지(SRC2 내지 SRCn)의 입력 단자(G(n-1))에는 이전 스테이지의 게이트 출력 신호가 각각 인가될 수 있다.
출력 단자(G(n))는 전기적으로 연결된 게이트 라인에 게이트 출력 신호를 출력할 수 있다. 예를 들어, 홀수 번째 스테이지(SRC1, SRC3, ...)의 출력 단자(G(n))에서 출력되는 게이트 출력 신호(G(1), G(3), ...)는 제2 게이트 클럭 신호(CLK2)의 로우 레벨 구간에 출력될 수 있다. 또한, 짝수 번째 스테이지(SRC2, SRC4, ...)의 출력 단자(G(n))에서 출력되는 게이트 출력 신호(G(2), G(4), ...)는 제1 게이트 클럭 신호(CLK1)의 로우 레벨 구간에 출력될 수 있다.
제1 전압 입력 단자에는 전압 생성부로부터 제1 전압이 공급될 수 있다. 예를 들어, 제1 전압은 하이 레벨 전압일 수 있다. 제2 전압 입력 단자에는 전압 생성부로부터 제2 전압이 공급될 수 있다. 예를 들어, 제2 전압은 로우 레벨 전압일 수 있다.
도 4에 도시된 바와 같이, 게이트 구동회로의 제N(N은 자연수) 스테이지(300A)는 제1 입력부(310), 제1 출력부(320), 제2 입력부(330), 제2 출력부(340), 출력 제어부(350), 안정화부(360) 및 유지부(370)을 포함할 수 있다. 제N 스테이지(300A)의 입력 단자(G(n-1))에는 입력 신호, 제1 클럭 단자(CK1)에는 제1 클럭 신호, 제2 클럭 단자(CK2)에는 제2 클럭 신호, 제1 전압 입력 단자(VGH)에는 제1 전압, 제1 전압 입력 단자(VGL)에는 제2 전압이 각각 인가될 수 있다. 일 실시예에서, N이 홀수인 경우, 제1 클럭 신호는 제1 게이트 클럭 신호이고 제2 클럭 신호는 제2 게이트 클럭 신호일 수 있다. 또한, N이 짝수인 경우, 제1 클럭 신호는 제2 게이트 클럭 신호이고 제2 클럭 신호는 제1 게이트 클럭 신호일 수 있다. 제N 스테이지(300A)는 출력 단자(G(n))로 제N 게이트 출력 신호를 출력할 수 있다.
제1 입력부(310)는 제1 클럭 신호에 응답하여 입력 신호를 제1 노드(Q)에 인가할 수 있다. 제1 입력부(310)는 제1 클럭 신호가 인가되는 게이트 전극, 입력 신호가 인가되는 소스 전극, 및 제1 노드(Q)에 연결된 드레인 전극을 포함하는 제1 입력 트랜지스터(T1)를 포함할 수 있다.
제1 출력부(320)는 제1 노드(Q)에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력할 수 있다. 제1 출력부(320)는 제1 노드(Q)에 인가된 제1 노드 신호에 응답하여 제N 게이트 출력 신호를 제1 논리 레벨(예를 들면, 로우 레벨)로 제어할 수 있다. 제1 출력부(320)는 제1 출력 트랜지스터(T7) 및 제1 커패시터(C1)를 포함할 수 있다. 제1 출력 트랜지스터(T7)는 제1 노드(Q)에 연결된 게이트 전극, 제2 클럭 신호가 인가되는 소스 전극, 및 제N 게이트 출력 신호를 출력하는 출력 단자(G(n))에 연결된 드레인 전극을 포함할 수 있다. 제1 커패시터(C1)은 제1 노드(Q)에 연결된 제1 전극 및 제N 게이트 출력 신호를 출력하는 출력 단자(G(n))에 연결된 제2 전극을 포함할 수 있다.
제2 입력부(330)는 제1 노드 신호에 응답하여 제1 클럭 신호를 제2 노드(QB)에 인가할 수 있다. 제2 입력부(330)는 제1 노드(Q)에 연결된 게이트 전극, 제1 클럭 신호가 인가되는 소스 전극, 및 제2 노드(QB)에 연결된 드레인 전극을 포함하는 제2 입력 트랜지스터(T4)를 포함할 수 있다.
제2 출력부(340)는 제2 노드(QB)에 인가된 제2 노드 신호에 응답하여 제1 전압을 제N 게이트 출력 신호로 출력할 수 있다. 제1 출력부(320)는 제2 노드(QB)에 인가된 제2 노드 신호에 응답하여 제N 게이트 출력 신호를 제2 논리 레벨(예를 들면, 하이 레벨)로 제어할 수 있다. 제2 출력부(340)는 제2 출력 트랜지스터(T6) 및 제2 커패시터(C2)를 포함할 수 있다. 제2 출력 트랜지스터(T6)는 제2 노드(QB)에 연결된 게이트 전극, 제1 전압이 인가되는 소스 전극, 및 제N 게이트 출력 신호를 출력하는 출력 단자(G(n))에 연결된 드레인 전극을 포함할 수 있다. 제2 커패시터(C2)는 제2 노드(QB)에 연결된 제1 전극 및 제1 전압을 출력하는 제1 전압 입력 단자(VGH)에 연결된 제2 전극을 포함할 수 있다.
출력 제어부(350)는 출력 제어 신호에 응답하여 제1 출력부(320)를 활성화시킬 수 있다. 출력 제어부(350)는 출력 제어 신호가 인가되는 게이트 전극, 제2 전압이 인가되는 소스 전극, 및 제1 노드(Q)에 연결된 드레인 전극을 포함하는 출력 제어 트랜지스터(T8)를 포함할 수 있다. 모든 스테이지들에서 동시에 게이트 출력 신호를 출력할 필요가 있거나, 게이트 출력 신호를 출력할 필요가 없는 경우, 출력 제어부(350)에 출력 제어 신호를 인가하여 게이트 출력 신호를 제어할 수 있다. 일 실시예에서, 출력 제어 신호가 제1 논리 레벨인 경우, 제1 클럭 신호 및 제2 클럭 신호는 제2 논리 레벨을 갖도록 제어함으로써, 게이트 출력 신호의 출력을 제한할 수 있다. 즉, 제1 논리 레벨인 출력 제어 신호가 출력 제어부(350)에 인가되어 출력 제어부(350)가 턴-온되고, 제1 출력부(320)를 활성화시킬 수 있다. 제1 출력부(320)가 활성화되어 턴-온됨에 따라, 제N 게이트 출력 신호로 제2 클럭 신호인 제2 논리 레벨이 출력될 수 있다. 예를 들어, 폴더블 표시 패널 또는 플렉서블 표시 패널에서 비표시 영역을 갖는 경우, 게이트 구동 회로의 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호가 제1 논리 레벨로 출력되고, 제1 클럭 신호 및 제2 클럭 신호가 제2 논리 레벨로 출력될 수 있다. 또한, 영상 데이터가 정지 영상인 경우, 기 지정된 길이의 비표시 구간 동안 출력 제어 신호가 제1 논리 레벨로 출력되고, 제1 클럭 신호 및 제2 클럭 신호가 제2 논리 레벨로 출력될 수 있다.
안정화부(360)는 제2 노드 신호 및 제2 클럭 신호에 응답하여 제N 게이트 출력 신호를 안정화할 수 있다. 안정화부(360)는 직렬로 연결된 제1 안정화 트랜지스터(T2) 및 제2 안정화 트랜지스터(T3)를 포함할 수 있다. 제1 안정화 트랜지스터(T2)는 제2 노드(QB)에 연결된 게이트 전극, 제1 전압이 인가되는 소스 전극 및 제2 안정화 트랜지스터(T3)의 소스 전극에 연결된 드레인 전극을 포함할 수 있다. 제2 안정화 트랜지스터(T3)는 제2 클럭 신호가 인가되는 게이트 전극, 제1 안정화 트랜지스터(T2)의 드레인 전극에 연결된 소스 전극 및 제1 노드(Q)에 연결된 드레인 전극을 포함할 수 있다.
유지부(370)는 제1 클럭 신호에 응답하여 제2 노드 신호를 유지시킬 수 있다. 유지부(370)는 제1 클럭 신호가 인가되는 게이트 전극, 제2 전압이 인가되는 소스 전극, 및 제2 노드(QB)에 연결된 드레인 전극을 포함하는 유지 트랜지스터(T5)를 포함할 수 있다. 예를 들어, 유지부(370)는 제1 클럭 신호가 제2 논리 레벨을 가지면 유지 스위칭 소자(T5)는 턴-오프될 수 있다. 제1 클럭 신호가 제1 논리 레벨을 가지면 유지 스위칭 소자(T5)는 턴-온되어 제2 노드(QB)의 전압을 제2 전압으로 유지할 수 있다.
도 5에 도시된 바와 같이, 출력 제어 신호(GPS), 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)가 조정됨으로써, 표시 패널의 비표시 영역의 출력을 제한할 수 있다.
제1 스테이지 내지 제n 스테이지 중, 표시 영역에 대응되는 제1 스테이지 내지 제m 스테이지에 대응하여 출력 제어 신호(GPS)는 제2 논리 레벨(예를 들면, 하이 레벨)로 유지되고, 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)는 서로 다른 타이밍을 갖는 클럭 신호일 수 있다. 따라서, 제1 게이트 출력 신호 내지 제m 게이트 출력 신호(G(1), G(2), ..., G(m))는 순차적으로 출력되고, 표시 영역에서 영상 데이터가 표시될 수 있다.
반면에, 비표시 영역인 제m+1 스테이지 내지 제n 스테이지에 대응하여 출력 제어 신호(GPS)는 제1 논리 레벨(예를 들면, 로우 레벨)로 유지되고, 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)는 제2 논리 레벨(예를 들면, 하이 레벨)로 유지될 수 있다. 따라서, 제m+1 게이트 출력 신호 내지 제n 게이트 출력 신호(G(m+1), ..., G(n))는 출력이 제한되고, 비표시 영역에서 영상 데이터가 불필요하게 표시되는 것을 방지할 수 있다.
이와 같이, 표시 장치는 표시 패널의 비표시 영역의 출력을 제한함으로써 소비전력을 절감할 수 있다. 비표시 영역 스테이지에 대응하여 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)의 클럭 신호를 생성하지 않으므로 내부적으로 차징(charging) 횟수를 줄일 수 있다. 또한, 표시 장치가 유기 발광 표시 장치인 경우, 비표시 영역에서 게이트 출력 신호들의 출력을 제한함으로써, 유기 발광 소자가 발광하지 않도록 제어할 수 있다. 따라서, 표시 장치는 출력 제어 신호(GPS), 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)를 조정하고, 표시 패널의 비표시 영역의 출력을 제한함으로써 소비전력을 절감할 수 있다.
도 6은 도 3의 게이트 구동 회로의 입력 신호들, 노드 신호들 및 출력 신호들의 다른 예를 나타내는 파형도이다.
도 6을 참조하면, 영상 데이터가 정지 영상인 경우 기 지정된 길이의 비표시 구간 동안 출력 제어 신호(GPS)를 제1 논리 레벨(예를 들면, 로우 레벨)로 출력하고, 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)를 제2 논리 레벨(예를 들면, 하이 레벨)로 출력할 수 있다. 즉, 영상 데이터가 정지 영상인 경우 동일한 영상 데이터가 지속적으로 출력될 필요가 없으므로, 표시 장치는 출력 제어 신호(GPS), 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)를 조정하여 저주파 구동을 수행할 수 있다.
예를 들어, 제1 표시 기간 동안 제1 스테이지 내지 제n 스테이지에서 출력 제어 신호(GPS)는 제2 논리 레벨(예를 들면, 하이 레벨)로 유지되고, 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)는 서로 다른 타이밍을 갖는 클럭 신호일 수 있다. 따라서, 제1 게이트 출력 신호 내지 제m 게이트 출력 신호(G(1), G(2), ..., G(m))는 순차적으로 출력되고, 표시 영역에서 영상 데이터가 표시될 수 있다. 이후, 저주파 구동을 위해 기 지정된 길이의 제1 비표시 기간 동안, 출력 제어 신호(GPS)가 제1 논리 레벨로 출력되고, 제1 게이트 클럭 신호(CLK1) 및 제2 게이트 클럭 신호(CLK2)가 제2 논리 레벨로 출력될 수 있다. 표시 장치는 게이트 출력 신호들을 순차적으로 출력하는 표시 기간과 게이트 출력 신호들을 출력하지 않는 비표시 기간을 반복적으로 가짐으로써 저주파 구동을 수행할 수 있다. 이 때, 비표시 기간의 길이는 플리커(flicker) 현상이 발생하지 않는 길이로 조정될 수 있다. 플리커 현상은 표시 패널의 크기, 종류 및 영상 데이터의 계조에 상응하여 발생할 수 있다. 따라서, 저주파 구동 기간의 길이는 표시 패널에 따라 조정될 수 있다. 일 실시예에서, 비표시 기간은 표시 기간과 동일한 길이로 설정될 수 있다. 예를 들어, 1초에 60개의 프레임 데이터를 출력하는 표시 장치에서, 영상 데이터가 정지 영상인 경우 표시 기간과 비표시 기간을 반복함으로써 표시 장치는 1초에 30개의 프레임 데이터를 출력할 수 있다. 다른 실시예에서, 저주파 구동 기간은 영상 데이터의 계조를 분석하여 동적으로 설정할 수 있다. 이와 같이, 표시 장치는 저주파 구동을 수행함으로써 소비전력을 절감할 수 있다.
도 7은 본 발명의 실시예들에 따른 표시 장치의 다른 예를 나타내는 블록도이다.
도 7을 참조하면, 표시 장치(1000B)는 표시 패널(100), 타이밍 제어부(200), 게이트 구동 회로(300), 데이터 구동 회로(400) 및 플렉서블 감지부(500)를 포함할 수 있다. 다만, 본 실시예에 따른 표시 장치(1000B)는 플렉서블 감지부(500)가 추가된 것을 제외하면, 도 1의 표시 장치와 실질적으로 동일하므로, 동일 또는 유사한 구성 요소에 대해서는 동일한 참조 번호를 사용하고, 중복되는 설명은 생략하기로 한다.
표시 패널(100)은 영상을 표시할 수 있다. 표시 패널(100)은 복수의 게이트 라인들(GL), 복수의 데이터 라인들(DL) 및 게이트 라인들(GL) 및 데이터 라인들(DL)에 연결된 복수의 화소들(P)을 포함할 수 있다. 표시 패널(100)은 휘어질 수 있는 플렉서블(flexible) 표시 패널일 수 있다. 플렉서블 표시 패널은 롤링(rolling)될 수 있다. 일 실시예에서, 표시 패널(100)은 하나의 축을 기준으로 롤링될 수 있다. 다른 실시예에서, 표시 패널(100)는 표시 패널(100)에 복수의 축을 기준으로 롤링될 수 있다.
타이밍 제어부(200)는 외부의 그래픽 기기와 같은 화상 소스로부터 입력 제어 신호(CONT) 및 입력 영상 데이터(DATA1)를 수신할 수 있다. 타이밍 제어부(200)는 입력 제어 신호(CONT)에 기초하여 게이트 구동 회로(300)의 구동 타이밍을 제어하기 위한 제1 제어 신호(CONT1)를 생성하여 게이트 구동 회로(300)에 공급할 수 있다. 또한, 타이밍 제어부(200)는 입력 영상 데이터(DATA1)에 기초하여 표시 패널(100)의 동작 조건에 맞는 데이터 신호(DATA2)를 생성하여 데이터 구동 회로(400)에 공급할 수 있다. 타이밍 제어부(200)는 입력 제어 신호(CONT)에 기초하여 데이터 구동 회로(400)의 구동 타이밍을 제어하기 위한 제2 제어 신호(CONT2)를 생성하여 데이터 구동 회로(400)에 공급할 수 있다.
타이밍 제어부(200)는 표시 패널(100)의 출력을 제어하기 위해 제1 제어 신호(CONT1)에 포함된 출력 제어 신호, 제1 클럭 신호 및 제2 클럭 신호를 조정할 수 있다. 타이밍 제어부(200)는 플렉서블 감지부(500)로부터 수신한 비표시 영역 정보(NI)를 이용하여 게이트 구동 회로(300)의 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호를 제1 논리 레벨(예를 들면, 로우 레벨)로 출력하고, 제1 클럭 신호 및 제2 클럭 신호를 제2 논리 레벨(예를 들면, 하이 레벨)로 출력할 수 있다.
게이트 구동 회로(300)는 타이밍 제어부(200)로부터 수신되는 제1 제어신호(CONT1)에 기초하여 각각의 프레임마다 게이트 라인들(GL)에 순차적으로 게이트 출력 신호를 인가할 수 있다. 게이트 구동 회로(300)는 출력 제어부를 포함하여 출력 제어 신호에 상응하여 게이트 출력 신호를 제어할 수 있다.
데이터 구동 회로(400)는 타이밍 제어부(200)로부터 수신되는 제2 제어신호(CONT2)에 기초하여 타이밍 제어부(200)로부터 수신되는 데이터 신호(DATA2)를 데이터 전압으로 변환하고 복수의 데이터 라인들(DL)에 데이터 전압을 인가할 수 있다.
플렉서블 감지부(500)는 표시 패널(100)의 비표시 영역을 감지하여, 타이밍 제어부(200)에 비표시 영역에 대한 비표시 영역 정보(NI)를 제공할 수 있다. 플렉서블 감지부(500)는 표시 패널(100)이 롤링되면, 롤링 특성을 감지할 수 있다. 일 실시예에서, 플렉서블 감지부(500)는 표시 패널(100)에 배치된 벤드 센서(bend sensor)를 포함할 수 있다. 여기서, 벤드 센서는 그 자체로 구부러질 수 있으며 구부러지는 정도에 따라 저항값이 달라지는 특성을 가지는 센서를 의미한다. 벤드 센서는 광섬유 벤드 센서나, 압력 센서, 스트레인 게이지(strain gauge) 등과 같이 다양한 형태로 구현될 수 있다. 표시 패널(100)이 휘어지는 경우, 표시 패널(100)에 배치된 벤드 센서도 함께 휘어지며, 벤드 센서는 가해지는 장력의 세기에 대응되는 저항값을 출력할 수 있다. 즉, 플렉서블 감지부(500)는 벤드 센서에 인가되는 전압의 크기 또는 벤드 센서를 흐르는 전류의 크기를 이용하여 벤드 센서의 저항값을 감지하고, 그 저항값의 크기에 따라 해당 벤드 센서의 위치에서의 벤딩 상태를 감지함으로써, 비표시 영역을 감지할 수 있다. 플렉서블 감지부(500)는 비표시 영역에 대한 위치, 지속 시간 등에 대한 정보를 포함하는 비표시 영역 정보(NI)를 타이밍 제어부(200)에 제공할 수 있다.
이 밖에도, 표시 장치(1000B)는 전압 생성부 등을 더 포함할 수 있다.
도 8은 도 7의 표시 장치가 비표시 영역에서 게이트 출력 신호를 제어하는 일 예를 나타내는 도면이다.
도 8을 참조하면, 표시 패널(100B)은 휘어질 수 있는 플렉서블 표시 패널일 수 있다. 플렉서블 표시 패널은 표시 영역(DA)과 비표시 영역(NA)으로 구분될 수 있다.
표시 장치에 포함된 게이트 구동 회로는 표시 영역(DA)에 상응하는 게이트 출력 신호들은 순차적으로 출력하고, 비표시 영역(NA)에 상응하는 게이트 출력 신호들은 출력을 제한할 수 있다. 즉, 제1 게이트 출력 신호 내지 제n 게이트 출력 신호를 순차적으로 출력하는 게이트 구동 회로에서, 표시 영역(DA)이 제1 게이트 출력 신호 내지 제m 게이트 출력 신호에 상응하는 경우, 게이트 구동 회로는 제1 게이트 출력 신호(G(1)) 내지 제m 게이트 출력 신호(G(m))를 순차적으로 출력하고, 제m+1 게이트 출력 신호(G(m+1)) 내지 제n 게이트 출력 신호는 출력을 제한할 수 있다. 예를 들어, 플렉서블 표시 장치는 센서를 이용하여 플렉서블 표시 패널이 휘어짐으로 인해 비표시 영역(NA)이 발생함을 인식할 수 있다. 플렉서블 표시 패널이 비표시 영역(NA)이 존재하는 경우, 출력 제어 신호 및 클럭 신호를 타이밍 제어부는 비표시 영역(NA)에 상응하는 비표시 영역 스테이지에 대응하여 출력 제어 신호, 제1 클럭 신호, 및 제2 클럭 신호를 조정함으로서, 비표시 영역(NA)에서 불필요한 영상이 표시되지 않을 수 있도록 제어할 수 있다.
이상, 본 발명의 실시예들에 따른 게이트 구동 회로 및 게이트 구동 회로를 포함하는 표시 장치에 대하여 도면을 참조하여 설명하였지만, 상기 설명은 예시적인 것으로서 본 발명의 기술적 사상을 벗어나지 않는 범위에서 해당 기술 분야에서 통상의 지식을 가진 자에 의하여 수정 및 변경될 수 있을 것이다. 예를 들어, 상기에서는 표시 장치가 유기 발광 표시 장치인 것으로 설명하였으나, 표시 장치의 종류는 이에 한정되는 것이 아니다.
본 발명은 표시 장치를 구비한 전자 기기에 다양하게 적용될 수 있다. 예를 들어, 본 발명은 컴퓨터, 노트북, 휴대폰, 스마트폰, 스마트패드, 피엠피(PMP), 피디에이(PDA), MP3 플레이어, 디지털 카메라, 비디오 캠코더 등에 적용될 수 있다.
상기에서는 본 발명의 실시예들을 참조하여 설명하였지만, 해당 기술분야에서 통상의 지식을 가진 자는 하기의 특허청구범위에 기재된 본 발명의 사상 및 영역으로부터 벗어나지 않는 범위 내에서 본 발명을 다양하게 수정 및 변경시킬 수 있음을 이해할 것이다.
1000A, 1000B: 표시 장치 100, 100A, 100B: 표시 패널
200: 타이밍 제어부 300: 게이트 구동 회로
400: 데이터 구동 회로 310: 제1 입력부
320: 제1 출력부 330: 제2 입력부
340: 제2 출력부 350: 출력 제어부
360: 안정화부 370: 유지부

Claims (20)

  1. 복수의 게이트 출력 신호들을 각각 출력하는 복수의 스테이지들을 포함하고, 제N(N은 자연수) 스테이지는
    제1 클럭 신호에 응답하여 입력 신호를 제1 노드에 인가하는 제1 입력부;
    상기 제1 노드에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력하는 제1 출력부;
    상기 제1 노드 신호에 응답하여 상기 제1 클럭 신호를 제2 노드에 인가하는 제2 입력부;
    상기 제2 노드에 인가된 제2 노드 신호에 응답하여 제1 전압을 상기 제N 게이트 출력 신호로 출력하는 제2 출력부; 및
    출력 제어 신호에 응답하여 상기 제1 출력부를 활성화시키는 출력 제어부를 포함하는 게이트 구동 회로.
  2. 제1 항에 있어서, 상기 제N 스테이지는
    상기 제2 노드 신호 및 상기 제2 클럭 신호에 응답하여 상기 제N 게이트 출력 신호를 안정화하는 안정화부를 더 포함하는 것을 특징으로 하는 게이트 구동 회로.
  3. 제2 항에 있어서, 상기 안정화부는 직렬로 연결된 제1 안정화 트랜지스터 및 제2 안정화 트랜지스터를 포함하고,
    상기 제1 안정화 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극 및 상기 제2 안정화 트랜지스터의 소스 전극에 연결된 드레인 전극을 포함하며,
    상기 제2 안정화 트랜지스터는 상기 제2 클럭 신호가 인가되는 게이트 전극, 상기 제1 안정화 트랜지스터의 상기 드레인 전극에 연결된 소스 전극 및 상기 제1 노드에 연결된 드레인 전극을 포함하는 것을 특징으로 하는 게이트 구동 회로.
  4. 제1 항에 있어서, 상기 제N 스테이지는
    상기 제1 클럭 신호에 응답하여 상기 제2 노드 신호를 유지시키는 유지부를 더 포함하는 것을 특징으로 하는 게이트 구동 회로.
  5. 제1 항에 있어서, 상기 출력 제어 신호가 제1 논리 레벨인 경우 상기 제1 클럭 신호 및 상기 제2 클럭 신호는 제2 논리 레벨인 것을 특징으로 하는 게이트 구동 회로.
  6. 복수의 게이트 라인들, 상기 게이트 라인들과 교차하는 복수의 데이터 라인들 및 복수의 화소들을 포함하는 표시 패널;
    상기 데이터 라인들에 복수의 데이터 신호를 각각 출력하는 데이터 구동 회로;
    상기 게이트 라인들에 복수의 게이트 출력 신호들을 각각 출력하는 복수의 스테이지들을 포함하는 게이트 구동 회로; 및
    상기 게이트 구동 회로 및 상기 데이터 구동 회로를 제어하는 타이밍 제어부를 포함하고,
    상기 게이트 구동 회로의 제N(N은 자연수) 스테이지는
    제1 클럭 신호에 응답하여 입력 신호를 제1 노드에 인가하는 제1 입력부;
    상기 제1 노드에 인가된 제1 노드 신호에 응답하여 제2 클럭 신호를 제N 게이트 출력 신호로 출력하는 제1 출력부;
    상기 제1 노드 신호에 응답하여 상기 제1 클럭 신호를 제2 노드에 인가하는 제2 입력부;
    상기 제2 노드에 인가된 제2 노드 신호에 응답하여 제1 전압을 상기 제N 게이트 출력 신호로 출력하는 제2 출력부; 및
    출력 제어 신호에 응답하여 상기 제1 출력부를 활성화시키는 출력 제어부를 포함하는 표시 장치.
  7. 제6 항에 있어서, 상기 표시 패널은 적어도 하나의 폴딩라인에서 폴드(fold)되는 폴더블(foldable) 표시 패널인 것을 특징으로 하는 표시 장치.
  8. 제7 항에 있어서, 상기 타이밍 제어부는 상기 표시 패널이 폴드되는 경우, 상기 게이트 구동 회로의 상기 스테이지들 중 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력하는 것을 특징으로 하는 표시 장치.
  9. 제6 항에 있어서, 상기 표시 패널은 휘어질 수 있는 플렉서블(flexible) 표시 패널인 것을 특징으로 하는 표시 장치.
  10. 제9 항에 있어서,
    상기 표시 패널의 비표시 영역을 감지하여, 상기 타이밍 제어부에 상기 비표시 영역에 대한 비표시 영역 정보를 제공하는 플렉서블 감지부를 더 포함하고,
    상기 타이밍 제어부는 상기 비표시 영역 정보를 이용하여 상기 게이트 구동 회로의 상기 스테이지들 중 상기 비표시 영역에 상응하는 비표시 영역 스테이지에 대응하여 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력하는 것을 특징으로 하는 표시 장치.
  11. 제6 항에 있어서, 상기 타이밍 제어부는 상기 데이터 신호에 포함된 영상 데이터가 정지 영상인 경우, 기 지정된 길이의 비표시 구간 동안 상기 출력 제어 신호를 제1 논리 레벨로 출력하고, 상기 제1 클럭 신호 및 상기 제2 클럭 신호를 제2 논리 레벨로 출력하는 것을 특징으로 하는 표시 장치.
  12. 제6 항에 있어서, 상기 제N 스테이지는
    상기 제2 노드 신호 및 상기 제2 클럭 신호에 응답하여 상기 제N 게이트 출력 신호를 안정화하는 안정화부를 더 포함하는 것을 특징으로 하는 표시 장치.
  13. 제12 항에 있어서, 상기 안정화부는 직렬로 연결된 제1 안정화 트랜지스터 및 제2 안정화 트랜지스터를 포함하고,
    상기 제1 안정화 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극 및 상기 제2 안정화 트랜지스터의 소스 전극에 연결된 드레인 전극을 포함하며,
    상기 제2 안정화 트랜지스터는 상기 제2 클럭 신호가 인가되는 게이트 전극, 상기 제1 안정화 트랜지스터의 상기 드레인 전극에 연결된 소스 전극 및 상기 제1 노드에 연결된 드레인 전극을 포함하는 것을 특징으로 하는 표시 장치.
  14. 제6 항에 있어서, 상기 제N 스테이지는
    상기 제1 클럭 신호에 응답하여 상기 제2 노드 신호를 유지시키는 유지부를 더 포함하는 것을 특징으로 하는 표시 장치.
  15. 제14 항에 있어서, 상기 유지부는
    상기 제1 클럭 신호가 인가되는 게이트 전극;
    제2 전압이 인가되는 소스 전극; 및
    상기 제2 노드에 연결된 드레인 전극을 포함하는 유지 트랜지스터를 포함하는 것을 특징으로 하는 표시 장치.
  16. 제6 항에 있어서, 상기 제1 입력부는
    상기 제1 클럭 신호가 인가되는 게이트 전극;
    상기 입력 신호가 인가되는 소스 전극; 및
    상기 제1 노드에 연결된 드레인 전극을 포함하는 제1 입력 트랜지스터를 포함하는 것을 특징으로 하는 표시 장치.
  17. 제6 항에 있어서, 상기 제1 출력부는 제1 출력 트랜지스터 및 제1 커패시터를 포함하고,
    상기 제1 출력 트랜지스터는 상기 제1 노드에 연결된 게이트 전극, 상기 제2 클럭 신호가 인가되는 소스 전극, 및 상기 제N 게이트 출력 신호를 출력하는 출력 단자에 연결된 드레인 전극을 포함하며,
    상기 제1 커패시터는 상기 제1 노드에 연결된 제1 전극 및 상기 출력 단자에 연결된 제2 전극을 포함하는 것을 특징으로 하는 표시 장치.
  18. 제6 항에 있어서, 상기 제2 입력부는
    상기 제1 노드에 연결된 게이트 전극;
    상기 제1 클럭 신호가 인가되는 소스 전극; 및
    상기 제2 노드에 연결된 드레인 전극을 포함하는 제2 입력 트랜지스터를 포함하는 것을 특징으로 하는 표시 장치.
  19. 제6 항에 있어서, 상기 제2 출력부는 제2 출력 트랜지스터 및 제2 커패시터를 포함하고,
    상기 제2 출력 트랜지스터는 상기 제2 노드에 연결된 게이트 전극, 상기 제1 전압이 인가되는 소스 전극, 및 상기 제N 게이트 출력 신호를 출력하는 출력 단자에 연결된 드레인 전극을 포함하며,
    상기 제2 커패시터는 상기 제2 노드에 연결된 제1 전극 및 상기 제1 전압을 출력하는 제1 전압 입력 단자에 연결된 제2 전극을 포함하는 것을 특징으로 하는 표시 장치.
  20. 제6 항에 있어서, 상기 출력 제어부는
    상기 출력 제어 신호가 인가되는 게이트 전극;
    제2 전압이 인가되는 소스 전극; 및
    상기 제1 노드에 연결된 드레인 전극을 포함하는 출력 제어 트랜지스터를 포함하는 것을 특징으로 하는 표시 장치.
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