KR20140133589A - 액정 표시 패널 - Google Patents

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KR20140133589A
KR20140133589A KR20147027511A KR20147027511A KR20140133589A KR 20140133589 A KR20140133589 A KR 20140133589A KR 20147027511 A KR20147027511 A KR 20147027511A KR 20147027511 A KR20147027511 A KR 20147027511A KR 20140133589 A KR20140133589 A KR 20140133589A
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KR
South Korea
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common
electrode
lead
gate
sealing material
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KR20147027511A
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English (en)
Inventor
아카네 스기사카
아키히로 쇼라쿠
Original Assignee
샤프 가부시키가이샤
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Publication date
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Abstract

본 발명은 FFS 모드에서 표시 영역의 외측 테두리에 표시 불균일이 발생하는 것을 방지할 수 있는 액정 표시 패널을 제공한다. 본 발명의 액정 표시 패널은, 한 쌍의 기판과, 시일재와, 상기 한 쌍의 기판 및 상기 시일재에 의해 밀봉된 액정층을 구비하고, 상기 한 쌍의 기판 중 한쪽은, 복수의 슬릿을 갖는 화소 전극과, 절연막을 개재하여 상기 화소 전극과 상이한 계층에 위치하는, 평판형 공통 전극을 구비하고, 비표시 영역에, 게이트 드라이버와, 상기 게이트 드라이버로부터 표시 영역을 향하여 연신된 복수의 게이트 인출 배선과, 상기 공통 전극과 전기적으로 접속된 공통 인출 배선이 설치되어 있고, 상기 공통 인출 배선은 상기 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극은 상기 복수의 게이트 인출 배선과 교차하는 상기 공통 인출 배선과, 상기 공통 인출 배선을 따른 상기 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는다.

Description

액정 표시 패널{LIQUID CRYSTAL DISPLAY PANEL}
본 발명은 액정 표시 패널에 관한 것이다. 보다 상세하게는, 절연막을 사이에 두고 복수의 계층에 전극을 갖는 기판을 구비하는 액정 표시 패널에 관한 것이다.
액정 표시 패널은, 복굴절성을 갖는 액정 분자의 배향을 제어함으로써 광의 투과/차단(표시의 온/오프)을 제어하는 기기이다. 액정 표시 패널의 액정 배향 모드로서는, 플러스의 유전율 이방성을 갖는 액정 분자를 기판 법선 방향으로부터 보았을 때 90° 비틀어진 상태로 배향시키는 TN(Twisted Nematic) 모드, 마이너스의 유전율 이방성을 갖는 액정 분자를 기판면에 대하여 수직 배향시키는 수직 배향(VA : Vertical Alignment) 모드, 플러스 또는 마이너스의 유전율 이방성을 갖는 액정 분자를 기판면에 대하여 수평 배향시켜 액정층에 대하여 횡전계를 인가하는 면내 스위칭(IPS : In-Plane Switching) 모드 및 프린지 전계 스위칭(FFS : Fringe Field Switching) 모드 등을 들 수 있다.
액정 표시 패널의 구동 방식으로서는, 화소마다 박막 트랜지스터(TFT : Thin Film Transistor) 등의 능동 소자를 배치하여 고화질을 실현하는 액티브 매트릭스형 구동 방식이 보급되고 있다. TFT를 구비하는 기판(이하, TFT 기판이라고도 함)에 있어서는, 복수의 게이트 신호선과 복수의 소스 신호선이 서로 교차하도록 형성되고, 이들 교차점마다 TFT가 설치된다. TFT는 화소 전극과 접속되어 있고, TFT의 스위칭 기능에 의해, 화소 전극에의 화상 신호의 공급이 제어된다. TFT 기판 또는 대향 기판에는, 또한 공통 전극이 설치되고, 한 쌍의 전극을 통하여 액정층 내에 전압이 인가된다.
횡전계를 인가하여 액정 분자의 배향을 제어하는 방식 중, FFS 모드는 IPS 모드를 개량하여 개구율을 향상시킨 액정 배향 모드이다(예를 들면, 특허문헌 1 참조). FFS 모드에서 각 화소 영역 내에는, 화소 전극과 대향하는 전극으로서, 인듐 산화주석(ITO : Indium Tin Oxide) 등의 투명 재료를 포함하는 공통 전극이 설치된다. 공통 전극에 대해서는 공통 신호를 공급하는 공통 배선이 접속되어 있다. 화소 전극도 또한 ITO 등의 투명 재료를 포함하고, 내부에는 스트라이프형의 복수의 슬릿이 형성되어 있다. 화소 전극과 공통 전극 사이에는 절연막이 배치되어 있고, 화소 전극과 공통 전극 사이에 전압을 인가하면, 화소 전극에 설치된 슬릿의 영향에 의해, 가로 방향의 전계와 함께, 세로 방향의 전계가 발생한다. 이에 의해, 슬릿 상에 위치하는 액정 분자뿐만 아니라, 전극 상에 위치하는 액정 분자의 배향도 제어할 수 있으므로, IPS 모드보다도 개구율을 향상시킬 수 있다.
상기 특허문헌 1에서는, FFS 모드를 장시간 사용하면, IPS 모드와 비교하여 번인(image sticking) 현상이 일어나기 쉬워지는 원인으로서, FFS 모드에서는, 화소 전극으로부터 액정층에 이르기까지의 전기력선의 경로와, 액정층으로부터 게이트 신호선에 이르기까지의 전기력선의 경로가 비대칭이며, 게이트 신호선에 인가되는 신호에 기인하는 직류 전계에 의해 불가역적 영향을 받는 점을 들고 있다. 그리고, 게이트 신호선에 인가되는 전압에 기인하는 번인을 방지하기 위해서, 게이트 신호선과 동일 방향으로 연신(延伸)된 실드 전극을 사용하여, 게이트 신호선에 인가되는 고전압의 신호에 의해 발생하는 화소 전극으로부터 게이트 신호선을 향하는 전기력선을 차단하고 있다. 또한, 실드 전극을 플로팅 상태로 하면 실드 전극층의 전위가 불안정화되기 때문에, 이것을 방지하기 위해서 실드 전극과 공통 배선을 접속시켜 실드 전극의 전위를 안정화시키고 있다.
일본 특허 공개 제2009-69332호 공보
본 발명자들은, FFS 모드의 액정 표시 패널의 개발을 행하고 있던 참에, 표시를 행할 때, 표시 영역의 외측 테두리의 일부에 보라색을 띤 표시 불균일이 발생하는 것을 알아차렸다. 그리고, 표시 불균일이 게이트 블록에 대응하는 위치마다 발생하고 있는 점에 주목함과 함께, 그 원인을 규명하기 위해서, 게이트 인출 배선뿐만 아니라, 게이트 인출 배선이 형성되어 있지 않은, 플로팅 아일랜드 영역(floating island area)에도 게이트 전압(Vgl)을 인가한 바, 표시 불균일의 범위가 변화되었다.
도 16 및 도 17은 게이트 인출 배선 부근에 있어서의 표시 불균일의 발생의 모습을 도시하는 평면 모식도이다. 액정 표시 패널은, 통상, 화소 전극 등이 배치된 표시 영역과, 표시 영역의 외측 테두리(굵은 선)보다도 외측에 위치하는 비표시 영역을 갖고 있고, 도 16에 도시한 바와 같이, 비표시 영역에는, 표시 영역의 한 변을 따라서 게이트 드라이버(151)가 설치되고, 상기 게이트 드라이버(151)로부터는 게이트 인출 배선(112)이 인출된다. 도 16 및 도 17의 점선으로 둘러싸인 영역이 표시 불균일의 발생 영역이다. 게이트 인출 배선(112)이 배치된 영역 이외의 영역(플로팅 아일랜드 영역)(101)에는, 통상은 게이트 전압이 인가되지 않지만, 도 17에 도시한 바와 같이, 게이트 전압이 인가됨으로써 표시 불균일의 발생 영역이 확대되었다. 이것으로부터, 본 발명자들은 비표시 영역에 위치하는 게이트 인출 배선(112)에 인가되는 전압이, 표시 영역 외의 액정 분자에 그치지 않고, 표시 영역 내의 액정 분자에 대해서도 영향을 미치고 있는 것으로 생각하였다.
본 발명은, 상기 현상황을 감안하여 이루어진 것이며, FFS 모드에서 표시 영역의 외측 테두리에 표시 불균일이 발생하는 것을 방지할 수 있는 액정 표시 패널을 제공하는 것을 목적으로 하는 것이다.
본 발명자들은, 표시 영역의 외측 테두리 근방의 표시 불균일이 발생하는 것을 방지하기 위한 수단에 대하여 다양하게 검토한 바, FFS 모드에 고유의, 화소 전극과 동일한 기판에 형성되는 평판형 공통 전극에 주목하였다. 그리고, 종래에 있어서 공통 전극은, 적어도 표시 영역을 덮고 있으면 되고, 비표시 영역에 있어서 넓은 범위에서 형성되어 있지 않은 점에 주목함과 함께, 공통 전극의 범위를, 게이트 드라이버가 위치하는 측을 향하여, 표시 영역으로부터 적어도 공통 인출 배선이 위치하는 영역까지 확장함으로써, 게이트 전압에 기초하는 액정 분자의 배향의 흐트러짐을 억제하여, 표시 영역의 외측 테두리 근방의 표시 불균일의 발생을 방지할 수 있는 것을 알아냈다. 이렇게 하여, 본 발명자들은 상기 과제를 훌륭하게 해결할 수 있는 것에 상도하고, 본 발명에 도달한 것이다.
즉, 본 발명의 일측면은, 한 쌍의 기판과, 시일재(sealing material)와, 상기 한 쌍의 기판 및 상기 시일재에 의해 밀봉된 액정층을 구비하고, 상기 한 쌍의 기판 중 한쪽은, 복수의 슬릿을 갖는 화소 전극과, 절연막을 개재하여 상기 화소 전극과 상이한 계층에 위치하는 평판형 공통 전극을 구비하고, 비표시 영역에, 게이트 드라이버와, 상기 게이트 드라이버로부터 표시 영역을 향하여 연신된 복수의 게이트 인출 배선과, 상기 공통 전극과 전기적으로 접속된 공통 인출 배선이 설치되어 있고, 상기 공통 인출 배선은 상기 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극은, 상기 복수의 게이트 인출 배선과 교차하는 상기 공통 인출 배선과, 상기 공통 인출 배선을 따른 상기 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는 액정 표시 패널이다.
상기 액정 표시 패널은, 한 쌍의 기판과, 시일재와, 상기 한 쌍의 기판 및 상기 시일재에 의해 밀봉된 액정층을 구비하고, 상기 한 쌍의 기판 중 한쪽은, 복수의 슬릿을 갖는 화소 전극과, 절연막을 개재하여 상기 화소 전극과 상이한 계층에 위치하는 평판형 공통 전극을 구비한다. 상기 화소 전극에는 복수의 슬릿이 형성되어 있고, 상기 공통 전극은 평판형이기 때문에, 이들 전극을 통하여, 액정층 내에 프린지 전계를 형성할 수 있다. 즉, 상기 액정 표시 패널은 FFS 모드의 일 형태이다.
상기 액정 표시 패널은, 표시 영역과 비표시 영역으로 나누어진다. 표시 영역은 원하는 영상 표시를 행하는 영역이고, 비표시 영역은 영상 표시를 행하지 않는 영역이다. 비표시 영역에는, 게이트 드라이버와, 상기 게이트 드라이버로부터 표시 영역을 향하여 연신된 복수의 게이트 인출 배선이 설치되어 있다. 상기 복수의 게이트 인출 배선은, 예를 들면 표시 영역이 직사각형으로 구성되어 있는 경우에는, 상기 표시 영역의 적어도 한 변에 대하여 인출된 것이면 되지만, 복수의 변에 대하여 인출되어 있어도 된다.
상기 비표시 영역에는, 상기 공통 전극과 전기적으로 접속된 공통 인출 배선이 설치되어 있고, 상기 공통 인출 배선은 상기 복수의 게이트 인출 배선과 교차하고 있다. 상기 공통 인출 배선은 상기 공통 전극에 공통 전위를 공급하기 위한 버스 라인이다. 상기 공통 인출 배선은, 예를 들면 표시 영역이 직사각형으로 구성되어 있는 경우에는, 상기 표시 영역의 적어도 한 변을 따라서 설치되면 되지만, 상기 표시 영역의 외측 테두리의 외측을 둘러싸도록 설치되어 있어도 된다.
상기 공통 전극은, 상기 복수의 게이트 인출 배선과 교차하는 상기 공통 인출 배선과, 상기 공통 인출 배선을 따른 상기 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는다. 이와 같은 범위를 공통 전극이 덮음으로써, 게이트 전압의 영향에 의해 액정에 배향 흐트러짐이 발생하는 것을 효과적으로 저감할 수 있어, 표시 불균일의 발생 방지에 공헌한다.
상기 액정 표시 패널의 구성으로서는, 이와 같은 구성 요소를 필수로 하여 형성되는 것인 한, 그 밖의 구성 요소에 의해 특별히 한정되는 것은 아니다.
이하, 상기 액정 표시 패널의 바람직한 형태에 대하여 상세하게 설명한다. 또한, 이하에 기재되는 상기 액정 표시 패널의 개개의 바람직한 형태를 2개 이상 조합한 형태도, 상기 액정 표시 패널의 바람직한 형태이다.
상기 시일재는, 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고, 상기 시일재의 일부는 상기 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극은, 또한, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것이 바람직하다. 이에 의해, 액정층과 게이트 인출 배선이 겹치는 영역 모두를 공통 전극으로 덮을 수 있으므로, 게이트 전압의 영향에 의해 액정에 배향 흐트러짐이 발생하는 것을, 보다 확실하게 저감할 수 있어, 표시 불균일의 발생 방지에 크게 공헌한다.
상기 시일재는, 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고, 상기 시일재의 일부는 상기 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극이, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것이 바람직하다. 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극으로서는, (ⅰ) 상기 화소 전극과 동일한 계층에 위치하는 전극, (ⅱ) 상기 공통 전극과 동일한 계층에 위치하는 전극, (ⅲ) 상기 공통 인출 배선과 동일한 계층에 위치하는 전극 등을 들 수 있다. 이에 의해, 액정층과 게이트 인출 배선이 겹치는 영역 모두를, 상기 공통 전극과 전기적으로 접속된 전극으로 덮을 수 있으므로, 상기 공통 전극의 경우와 마찬가지로, 게이트 전압의 영향에 의해 액정에 배향 흐트러짐이 발생하는 것을 보다 확실하게 저감할 수 있어, 표시 불균일의 발생 방지에 크게 공헌한다. 또한, 상기 공통 전극과, 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극을 전기적으로 접속시키는 수단으로서는, 예를 들면 각 전극을, 적어도 서로 일부가 겹치도록 배치함과 함께, 각 전극간의 절연막의 일부에 콘택트부를 형성하는 수단을 들 수 있다.
또한, 액정층과 게이트 인출 배선이 겹치는 영역을 덮기 위해서, 상기 공통 전극과, 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극의 양쪽을 조합하여 사용해도 된다. 즉, 상기 시일재는, 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고, 상기 시일재의 일부는, 상기 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극 및 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극의 조합은, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것이 바람직하다. 이에 의해, 상기 각 전극을 단독으로 사용하는 경우와 마찬가지로, 게이트 전압의 영향에 의해 액정에 배향 흐트러짐이 발생하는 것을 보다 확실하게 저감할 수 있어, 표시 불균일의 발생 방지에 크게 공헌한다. 설계에 따라서는, 동일한 계층에 위치하는 전극만을 사용하는 것이 아니라, 상이한 복수의 층에 위치하는 전극을 연결함으로써 액정층과 게이트 인출 배선이 겹치는 영역을 덮는 쪽이 나은 경우가 있다.
상기 대향 기판이 블랙 매트릭스를 구비하는 경우에 있어서, 상기 시일재는, 블랙 매트릭스와 겹쳐 있어도, 겹쳐 있지 않아도 되지만, 상기 시일재가 블랙 매트릭스와 겹치는 것을 허용함으로써, 프레임 폭 협소화가 용이해져, 중소형 액정 디스플레이에 적용하기 쉬워진다. 한편, 예를 들면 시일재가 블랙 매트릭스와 겹쳐 있고, 또한 시일재가 게이트 인출 배선 등의 차광성을 갖는 전극과 겹쳐 있는 경우에는, 시일재를 경화하기 위한 자외광의 조사가 게이트 인출 배선 등에 의해 차단되어 버리지만, 상기 시일재와 상기 블랙 매트릭스가 겹치지 않도록, 이들을 배치함으로써, 게이트 인출 배선이 형성되어 있지 않은 기판측으로부터의 자외광 조사가 가능해져, 신속하면서 확실한 경화 처리가 가능해진다.
상기 시일재의 적어도 일부가 상기 블랙 매트릭스와 겹쳐 있는 경우에는, 상기 복수의 게이트 인출 배선과 동일한 계층에 위치하고, 또한 시일재와 겹치는 전극은 슬릿을 갖는 것이 바람직하다. 상술한 바와 같이, 시일재와 블랙 매트릭스를 일부 또는 전부 겹치는 경우에는, 미리 시일재와 겹치는 전극에 슬릿을 형성해 둠으로써, 게이트 인출 배선이 형성되어 있는 기판측으로부터의 자외광의 조사가 가능해진다.
상기 게이트 드라이버는, 하나의 액정 표시 패널에 대하여 반드시 하나일 필요는 없고, 예를 들면 표시 영역이 직사각형으로 구성되어 있는 경우는, 상기 표시 영역을 사이에 두고 대향하는 2개의 영역에, 각각 게이트 드라이버가 배치되어 있어도 된다. 이와 같은 경우에는, 양쪽 게이트 드라이버로부터 인출되는 복수의 게이트 인출 배선은, 모두 상기 공통 전극 등으로 덮여 있는 것이 바람직하다. 바꿔 말하면, 상기 게이트 드라이버는 제1 게이트 드라이버이고, 상기 게이트 드라이버로부터 인출된 복수의 게이트 인출 배선은 제1 복수의 게이트 인출 배선이며, 상기 표시 영역을 개재하여 상기 제1 게이트 드라이버와 대향하는 영역에는, 제2 게이트 드라이버와, 상기 제2 게이트 드라이버로부터 상기 표시 영역을 향하여 연신된 제2 복수의 게이트 인출 배선과, 상기 공통 전극과 전기적으로 접속된 제2 공통 인출 배선이 설치되어 있고, 상기 제2 공통 인출 배선은 상기 제2 복수의 게이트 인출 배선과 교차하고 있고, 상기 공통 전극은, 상기 제2 복수의 게이트 인출 배선과 교차하는 상기 제2 공통 인출 배선과, 상기 제2 공통 인출 배선을 따른 상기 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는 것이 바람직하다.
본 발명의 액정 표시 패널에 의하면, FFS 모드의 형태를 채용하는 경우에, 화소의 구동 제어를 위해서 게이트 전압을 인가하는 경우라도, 표시 영역의 외측 테두리 근방에 표시 불균일이 발생하는 것을 방지할 수 있다.
도 1은 실시 형태 1의 액정 표시 패널의 단면 모식도이다.
도 2는 실시 형태 1의 액정 표시 패널의 평면 모식도이다.
도 3은 실시 형태 1의 액정 표시 패널의 표시 영역과 비표시 영역의 경계 부근을 확대한 평면 모식도이다.
도 4는 도 3으로부터 공통 전극만을 발출(拔出)한 평면 모식도이다.
도 5는 실시 형태 1의 액정 표시 패널의 제1 변형예를 도시하는 평면 모식도이다.
도 6은 실시 형태 1의 액정 표시 패널의 제2 변형예를 도시하는 단면 모식도이다.
도 7은 실시 형태 1의 액정 표시 패널의 제3 변형예를 도시하는 단면 모식도이다.
도 8은 실시 형태 1의 액정 표시 패널의 제4 변형예를 도시하는 단면 모식도이다.
도 9는 실시 형태 1의 액정 표시 패널의 제4 변형예를 도시하는 평면 모식도이다.
도 10은 실시 형태 2의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다.
도 11은 실시 형태 2의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다.
도 12는 실시 형태 3의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다.
도 13은 실시 형태 3의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다.
도 14는 실시 형태 4의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다.
도 15는 실시 형태 4의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다.
도 16은 게이트 인출 배선 부근에 있어서의 표시 불균일의 발생의 모습을 도시하는 평면 모식도이다.
도 17은 게이트 인출 배선 부근에 있어서의 표시 불균일의 발생의 모습을 도시하는 평면 모식도이다.
이하에 실시 형태를 게재하고, 본 발명에 대하여 도면을 참조하여 더욱 상세하게 설명하지만, 본 발명은 이들 실시 형태에만 한정되는 것은 아니다.
본 명세서에 있어서 「전극」이란, 소위 「배선」에 상당하는 것도 포함한다.
본 명세서에 있어서 「게이트 신호선」이란, 게이트 신호를 공급하는 배선을 말하고, 「소스 신호선」이란, 소스 신호를 공급하는 배선을 말하고, 「공통 신호선」이란, 공통 신호를 공급하는 배선을 말한다. 이 중, 특히, 비표시 영역 내에 깔린 소스 신호선을 「소스 인출 배선」이라고도 하고, 비표시 영역 내에 깔린 공통 신호선을 「공통 인출 배선」이라고도 한다.
이하의 실시 형태 1 내지 4의 액정 표시 패널은, 구체적으로는, 텔레비전, 퍼스널 컴퓨터, 휴대 전화, 카 네비게이션, 인포메이션 디스플레이 등의 액정 표시 패널에 적용할 수 있다.
실시 형태 1
도 1은 실시 형태 1의 액정 표시 패널의 단면 모식도이다. 실시 형태 1의 액정 표시 패널은 TFT 기판(10)과, 대향 기판(20)과, 시일재(30)와, 액정층(40)을 구비하고, 상기 액정층(40)은 TFT 기판(10)과, 대향 기판(20)과, 시일재(30)에 의해 밀봉되어 있다. 액정층(40)은 액정 분자를 함유하고 있고, 전압 무인가 시에 있어서 액정 분자는, 각 기판면(10, 20)에 대하여 수평한 방향으로 배향되어 있다. TFT 기판(10)은, 지지 기판(11), TFT, 게이트 신호선(게이트 인출 배선을 포함함)(12), 소스 신호선(소스 인출 배선을 포함함), 공통 신호선(공통 인출 배선을 포함함), 공통 전극(13), 화소 전극 등을 구비한다. 또한, 도 1 등의 각 도면에 있어서의 양쪽 화살표로 나타내어진 영역은, 비표시 영역 중에서도 특히 게이트 드라이버, 소스 드라이버 등이 배치된 「단자 영역」을 나타낸다.
게이트 신호선(12)이 위치하는 계층과, 소스 신호선이 위치하는 계층 사이에는 절연막(제1 절연막)(61)이 형성되어 있다. 소스 신호선이 위치하는 계층과, 공통 전극(13)이 위치하는 계층 사이에는 절연막(제2 절연막)(62)이 형성되어 있다. 공통 전극(13)이 위치하는 계층과, 화소 전극(14)이 위치하는 계층 사이에는 절연막(제3 절연막)(63)이 형성되어 있다. 상기 제1 절연막(61), 상기 제2 절연막(62) 및 상기 제3 절연막(63)의 각각은, 단층으로 구성되거나, 복수층으로 구성되어 있어도 된다.
대향 기판(20)은 지지 기판(21), 컬러 필터, 블랙 매트릭스(22) 등을 구비한다. 컬러 필터 및 블랙 매트릭스(22)는 지지 기판(21)의 액정층측에 배치되어 있다. 컬러 필터 및 블랙 매트릭스(22)는, 대향 기판(20)측이 아니라, TFT 기판(10)측에 설치되어 있어도 된다. 블랙 매트릭스(22)는, 시일재(30)와 겹쳐 형성되어 있다. 지지 기판(21)의 액정층과 반대측에는, ITO 등을 재료로 하는 실드 전극(23)이 배치되어 있다. 이와 같은 실드 전극(23)은, 외부로부터의 정전기, 전기 신호(노이즈) 등에 의한 액정에의 영향을 방지할 수 있다. 전위를 안정시키는 관점에서는 실드 전극(23)은, 도전성 테이프 등을 통하여 패널외의 금속 부재와 접속되는 것이 바람직하지만, 실드 전극(23)에 대하여 일정한 전압을 인가할 필요는 없다. 실드 전극(23)은 후술하는 편광판에 의해 덮여진다.
도 1에 도시한 바와 같이, 공통 전극(13)은 비표시 영역 내의 시일재(30)와 겹치는 부분까지 신장되어 있다. 이에 의해, 게이트 인출 배선(12)과 액정층(40) 사이를 막도록 공통 전극(13)이 배치되게 되므로, 게이트 전압의 영향을 받아 발생하는 액정의 배향 흐트러짐을 저감시킬 수 있다.
도 2는 실시 형태 1의 액정 표시 패널의 평면 모식도이다. 도 2의 굵은 선으로 둘러싸인 영역이 표시 영역이고, 그 이외의 영역이 비표시 영역이다. 도 3은 실시 형태 1의 액정 표시 패널의 표시 영역과 비표시 영역의 경계 부근을 확대한 평면 모식도이다.
도 2에 도시한 바와 같이, 비표시 영역에는, 게이트 드라이버(51)와, 게이트 드라이버(51)로부터 표시 영역을 향하여 연신된 복수의 게이트 인출 배선(12)과, 소스 드라이버(52)와, 소스 드라이버(52)로부터 표시 영역을 향하여 연신된 복수의 소스 인출 배선(16)과, 표시 영역을 둘러싸도록 연신되며, 외부와 도통이 가능한 공통 인출 배선(17)이 설치되어 있다. 공통 인출 배선(17)은 복수의 계층에 나누어 형성되어 있다. 도 2에 도시한 예에서는, 표시 영역의 짧은 변을 따라서 형성된 공통 인출 배선은, 소스 인출 배선(16)과 동일한 계층에 형성되어 있고, 표시 영역의 긴 변을 따라서 형성된 공통 인출 배선 및 외부로 인출되는 공통 인출 배선은, 게이트 인출 배선(12)과 동일한 계층에 형성되어 있다. 각 계층에 위치하는 공통 인출 배선은, 절연막 내에 설치된 콘택트부(74)를 통하여 서로 접속되어 있다.
게이트 드라이버(51)로부터 인출된 복수의 게이트 인출 배선(12)을 통하여, 표시 영역을 향하여 게이트 신호가 공급된다. 또한, 소스 드라이버(52)로부터 인출된 복수의 소스 인출 배선(16)을 통하여, 표시 영역을 향하여 소스 신호가 공급된다. 게이트 드라이버(51)는, 직사각형 표시 영역의 한 변을 따라서 형성되어 있고, 소스 드라이버(52)는, 직사각형 표시 영역의 다른 한 변을 따라서 형성되어 있다. 도 2에 도시한 예에서는, 표시 영역의 나머지 2변을 따라서 게이트 드라이버 및 소스 드라이버 모두 배치되어 있지 않지만, 설계에 따라서는, 도 5에 도시한 바와 같이 2개의 게이트 드라이버(제1 게이트 드라이버(51a), 제2 게이트 드라이버(51b))를, 대향하는 2개의 변을 따라서 각각 형성해도 된다(제1 변형예). 그 경우에는, 공통 전극은, 표시 영역을 사이에 두고 양측으로부터 인출되는 게이트 인출 배선(제1 게이트 인출 배선(12a), 제2 게이트 인출 배선(12b))의 각각과 겹치도록 신장되는 것이 바람직하다. 제1 변형예에 있어서, 각 게이트 드라이버(51a, 51b)로부터 인출된 각 게이트 인출 배선(12a, 12b)은, 각각 교대로 표시 영역을 향하여 인출되어 있다.
실시 형태 1에서는, 외부로 인출된 공통 인출 배선(17)을 통하여, 공통 전극(13)에 공통 신호가 공급된다. 공통 인출 배선(17)에 대하여 공통 신호를 공급하는 부재로서는, 공통 신호 출력 회로를 구비하는 외장형 드라이버 등을 들 수 있다. 공통 인출 배선(17)은, 게이트 인출 배선(12) 및 소스 인출 배선(16)의 각각과, 절연막을 개재하여 교차하고 있다. 도 2에 도시한 예에서는, 표시 영역의 외측 테두리의 외측을 둘러싸도록 공통 인출 배선(17)이 설치되어 있지만, 반드시 표시 영역의 모든 변을 따라서 설치될 필요는 없다. 또한, 도 4에 도시한 예에서는, 표시 영역의 좌측에 깔린 공통 인출 배선(17)이 제1 공통 인출 배선(17a)에 상당하고, 표시 영역의 우측에 깔린 공통 인출 배선이 제2 공통 인출 배선(17b)에 상당하지만, 이들은 구성으로서는 일체화되어 있다.
한편, 도 3에 도시한 바와 같이, 실시 형태 1에 있어서의 TFT 기판을 평면에서 보았을 때, 표시 영역에서는, 게이트 신호선(12) 및 소스 신호선(16)이 서로 교차하도록, 또한 화소 전극(14)을 둘러싸도록 배치되어 있다. 게이트 신호선(12)과 소스 신호선(16)의 접점 근방에는, TFT(박막 트랜지스터)(54)가 설치되어 있다. 또한, 도 3에 있어서의 세로 방향의 굵은 선을 경계선으로 하여, 우측이 표시 영역이고, 좌측이 비표시 영역이다.
TFT(54)는 반도체층(55), 및, 게이트 전극, 소스 전극 및 드레인 전극의 3개의 전극을 구비하는 스위칭 소자이다. 드레인 전극은, 제2 절연막 및 제3 절연막을 관통하는 콘택트부를 통하여 화소 전극(14)과 접속되어 있다. 게이트 전극과 반도체층(55)은, 게이트 절연막을 개재하여 서로 겹쳐 있다. 소스 전극은 소스 신호선(16)과 접속되어 있고, 또한 반도체층(55)을 개재하여 드레인 전극과 접속되어 있다. 게이트 신호선(12)을 통하여 게이트 전극에 게이트 전압이 인가되는 타이밍에서, 소스 신호선(16)으로부터 입력되는 소스 신호가, 소스 전극, 반도체층(55), 드레인 전극 및 화소 전극(14)에 순서대로 공급된다.
화소 전극(14)은, 2개의 게이트 신호선(12)과 2개의 소스 신호선(16)으로 둘러싸이는 영역마다 배치된 전극이며, 복수의 슬릿(14a)을 갖고 있다. 화소 전극(14)의 형상은, 공통 전극(13)과의 사이에서 프린지 전계를 형성할 수 있는 것이면 특별히 한정되지 않고, 예를 들면 복수의 슬릿이 형성됨으로써 외측 테두리가 빗살 모양으로 된 것, 및 내부에 복수의 슬릿이 형성되고, 외측 테두리는 대략 직사각형을 유지하는 것을 들 수 있다. 화소 전극(14)이 복수의 슬릿(14a)을 가짐으로써, 화소 전극(14)과 공통 전극(13) 사이에서 형성되는 원호형 전계가 액정층 내에 형성된다. 각 슬릿(14a)은, 게이트 신호선(12)의 길이 방향과 평행한 방향에 대하여 수° 기운 방향으로 신장되어 형성되어 있다. 또한, 복수의 슬릿(14a)은, 화소 전극(14)의 세로변을 이등분하는 선을 경계선으로 하여, 서로 대칭 형상을 갖고 있다. 이와 같은 대칭 구조를 가짐으로써, 액정의 배향의 밸런스를 맞출 수 있다.
공통 전극(13)은 평판형 전극이며, 화소의 경계에 관계없이 넓게 형성되어 있다. 또한, 도 4는 도 3으로부터 공통 전극(13)만을 발출한 평면 모식도이다. 공통 전극(13)의 일부에는, TFT(54)와 화소 전극(14)을 도통하는 경로를 확보하기 위한 개구부(56a) 및 공통 전극(13)과 공통 인출 배선(17)을 도통하는 경로를 확보하기 위한 개구부(56b)가 형성되어 있다. 공통 전극(13)에는, 공통 인출 배선(17)을 통하여 일정한 공통 신호가 공급된다. 공통 인출 배선(17)의 일부는, 상기 소스 신호선(16)이 위치하는 계층과 동일한 계층에 배치되어 있고, 제1 절연막을 개재하여, 복수의 게이트 인출 배선(12)과 교차하고 있다. 또한, 공통 인출 배선(17)의 다른 일부는, 상기 게이트 신호선(12)이 위치하는 계층과 동일한 계층에 배치되어 있고, 제1 절연막을 개재하여, 복수의 소스 인출 배선(16)과 교차하고 있다. 공통 신호는, 반드시 공통 인출 배선(17)이 위치하는 계층으로부터 직접 공통 전극(13)에 공급될 필요는 없고, 게이트 신호선(12)이 위치하는 계층에 설치된 제1 공통 신호선(57), 또는, 화소 전극(14)이 위치하는 계층에 설치된 제2 공통 신호선을 통하여 접속된 것이어도 된다. 도 3에 도시한 예에서는, 공통 인출 배선(17)은, 제1 절연막에 설치된 콘택트부(71)를 통하여, 게이트 신호선(12)이 위치하는 계층에 설치된 제1 공통 신호선(57)과 접속되어 있고, 또한, 한편으로는, 제2 절연막에 설치된 콘택트부(72)를 통하여, 화소 전극(14)이 위치하는 계층에 설치된 제2 공통 신호선과 접속되어 있다. 즉, 게이트 신호선(12)이 위치하는 계층과, 화소 전극(14)이 위치하는 계층 중 어느 것으로부터도 공통 신호가 공급 가능한 구성으로 되어 있다. 상기 제1 공통 신호선(57)은, 게이트 신호선(12)을 따라서 동일한 방향으로 연신되어 있다. 공통 전극(13)에 형성된 개구부(56a)는, 보다 구체적으로는, TFT(54)의 드레인 전극과 화소 전극(14)을 도통하는 경로를 확보하기 위해서 형성된 것이다. 한편, 공통 전극(13)에 형성된 개구부(56b)는, 보다 구체적으로는, 공통 인출 배선(17)과 상기 화소 전극(14)이 위치하는 계층에 설치된 제2 공통 신호선을 도통하는 경로를 확보하기 위해서 형성된 것이다.
도 1 및 도 2에 도시한 바와 같이, 실시 형태 1에 있어서 공통 전극(13)은, 시일재(30)와 겹치는 영역까지 신장되어 있다. 그리고, 공통 전극(13)이, 시일재(30)와, 표시 영역의 외측 테두리 사이의 영역을 덮고 있으므로, 액정층(40)과 복수의 게이트 인출 배선(12)이 겹치는 영역의 전체가 공통 전극(13)으로 덮이게 된다. 또한, 도 1에 도시한 예에서는, 제2 절연막(62)과 제3 절연막(63) 사이에 공통 전극(13)이 위치하면 시일재(30)가 박리되기 쉬워지는 것을 고려하여, 시일재(30)와 액정층(40)의 경계를 따라서 공통 전극(13)의 말단이 위치하도록 설계가 이루어져 있다.
이에 의해, 게이트 전압의 인가에 기인하여 표시 영역의 외측 테두리 근방에 발생하는 표시 불균일을 해소할 수 있어, 양호한 표시 특성을 갖는 액정 표시 패널을 얻을 수 있다.
실시 형태 1의 액정 표시 패널의 다른 변형예로서는, 도 6에 도시한 바와 같이, 공통 전극(13)이, 시일재(30)의 더 외측의 영역으로까지 확장되어 있는 예(제2 변형예), 즉, 공통 전극(13)이 시일재(30)와 겹치는 영역을 덮는 예를 들 수 있다. 이에 의해, 보다 확실하게, 게이트 인출 배선으로부터의 영향을 저감시킬 수 있다.
실시 형태 1의 액정 표시 패널의 다른 변형예로서는, 도 7에 도시한 바와 같이, 공통 전극(13)이, 시일재(30)보다도 내측의 영역까지 확장되어 있는 예(제3 변형예), 즉, 공통 전극(13)의 말단이, 시일재(30)와 공통 인출 배선(17) 사이에 위치하는 예를 들 수 있다. 설계에 따라서는, 공통 전극(13)을 시일재(30)까지 확장할 수 없는 경우가 있지만, 이와 같은 형태라도, 게이트 인출 배선(12)으로부터의 영향을 저감시키는 것은 가능하다.
실시 형태 1의 액정 표시 패널의 다른 변형예로서는, 도 8 및 도 9에 도시한 바와 같이, 게이트 인출 배선(12)과 동일한 계층에 위치하고, 또한 시일재(30)와 겹치는 전극(81)에 슬릿이 형성되어 있는 예(제4 변형예)를 들 수 있다. 시일재(30)와 블랙 매트릭스(22)가 중복되는 영역을 형성함으로써, 프레임 폭 협소화를 행할 수 있어, 중소형 모바일 기기 등에 적합한 패널을 얻을 수 있다. 그러나 한편으로, 시일재(30)와 블랙 매트릭스(22)가 일부 중첩하고 있으면, 시일재(30)를 경화할 때, 대향 기판(20)측으로부터 자외선 조사를 행할 수 없다. 한편, TFT 기판(10)측에 대해서는, 게이트 인출 배선(12)의 간극(gap)을 통과하는 광을 사용하여 시일재(30)의 경화를 행하게 되지만, 도 9에 도시한 바와 같이 차광 목적으로 게이트 인출 배선(12)과 동일한 계층에 전극을 배치하는 경우, 충분한 경화가 행해지지 않을 우려가 있다. 따라서, 제3 변형예에 있어서는, 게이트 드라이버(51)로부터 인출된 게이트 인출 배선(12)과 동일한 계층에 위치하는 전극(81)에 복수의 슬릿(81a)을 형성하고 있으며, 상기 복수의 슬릿을 빠져나가 보다 많은 자외선이 시일재(30)에 조사되도록 고안이 이루어져 있다. 또한, 여기에서의 전극(81)의 폭과, 슬릿(81a)의 폭은 대략 1 : 1(즉, 개구율이 대략 50％)인 것이 바람직하다. 또한, 마찬가지의 관점에서, 각 게이트 인출 배선(12)의 전극 폭과, 각 게이트 인출 배선(12)끼리의 사이의 거리는 대략 1 : 1인 것이 바람직하다.
이하, 각 부재의 재료 및 제조 방법에 대하여 설명한다.
지지 기판(11, 21)의 재료로서는, 유리, 플라스틱 등의 투명한 재료가 적절하게 사용된다. 상기 제1 절연막(61), 상기 제2 절연막(62) 및 상기 제3 절연막(63)의 재료로서는, 질화실리콘, 산화실리콘, 감광성 아크릴 수지 등의 투명한 재료가 적절하게 사용된다. 또한, 상기 제1 절연막(61), 상기 제2 절연막(62) 및 상기 제3 절연막(63)은, 예를 들면 질화실리콘막을 플라즈마 유기 화학 기상 성장(Plasma Enhanced Chemical Vapor Deposition : PECVD)법에 의해 성막하고, 질화 실리콘막 상에 감광성 아크릴 수지막을 다이(die) 코트(도포)법에 의해 성막하여 형성된다. 콘택트부를 형성하기 위해서 제1 절연막(61), 제2 절연막(62) 및 제3 절연막(63) 중에 형성되는 구멍은, 드라이 에칭 등에 의해 형성할 수 있다.
게이트 신호선(게이트 인출 배선)(12), 소스 신호선(소스 인출 배선)(16), 공통 신호선(공통 인출 배선)(17) 및 TFT(54)를 구성하는 각종 전극은, 예를 들면 스퍼터링법 등에 의해, 티타늄, 크롬, 알루미늄, 몰리브덴 등의 금속, 또는, 그들의 합금을, 단층 또는 복수층으로 성막하고, 계속해서, 포토리소그래피법 등에 의해 패터닝을 행함으로써 형성할 수 있다. 이들 각종 배선 및 전극은, 동일한 층에 형성되는 것에 대해서는 각각 동일한 재료를 사용함으로써 제조가 효율화된다.
TFT(54)의 반도체층(55)은, IGZO(인듐-갈륨-아연-산소) 등의 산화물 반도체를 포함하는 것이 바람직하다. 이와 같은 산화물 반도체는, 종래의 아몰퍼스 실리콘에 비해 전자 이동도가 높기 때문에, TFT(54)의 사이즈를 작게 할 수 있어, 특히 고정밀 액정 디스플레이에 적합하다. 또한, 반도체층(55)으로서, 아몰퍼스 실리콘 및/또는 폴리실리콘을 포함하는 반도체층을 사용해도 된다.
화소 전극(14) 및 공통 전극(13)은, 예를 들면 산화인듐주석(ITO), 산화인듐아연(IZO), 산화아연(ZnO), 산화주석(SnO) 등의 투명 도전 재료, 또는, 그들의 합금을, 스퍼터링법 등에 의해 단층 또는 복수층으로 성막하여 형성한 후, 포토리소그래피법 등을 사용하여 패터닝할 수 있다. 화소 전극(14)에 형성되는 슬릿, 공통 전극(13)에 형성되는 개구부도 또한, 패터닝 시에 동시에 형성할 수 있다.
컬러 필터의 재료로서는, 각 색에 대응하는 광을 투과하는 감광성 수지(컬러 레지스트)가 적절하게 사용된다. 블랙 매트릭스(22)의 재료는, 차광성을 갖는 것인 한 특별히 한정되지 않고 흑색 안료를 함유한 수지 재료, 또는, 차광성을 갖는 금속 재료가 적절하게 사용된다.
이와 같이 하여 제작된 TFT 기판(10) 및 대향 기판(20)은, 예를 들면 절연 재료를 포함하는 기둥형 스페이서를 한쪽 기판에 복수 설치한 후, 시일재(30)를 사용하여 서로 접합된다. TFT 기판(10)과 대향 기판(20)과 시일재(30) 사이에는 액정층(40)이 형성되지만, 적하법을 사용하는 경우에는, 기판(10, 20)의 접합 전에 액정 재료의 적하가 행해지고, 진공 주입법을 사용하는 경우에는, 기판(10, 20)의 접합 후에 액정 재료가 주입된다. 그리고, 각 기판(10, 20)의 액정층(40)측과 반대측 면 상에, 편광판, 위상차 필름 등을 부착하고, 또한, 단자 영역에 게이트 드라이버(51), 소스 드라이버(52) 등을 실장함으로써, 액정 표시 패널이 완성된다.
실시 형태 2
실시 형태 2의 액정 표시 패널은, 공통 전극 그 자체가 아니라, 공통 전극으로부터 격리되고, 또한 공통 전극과 전기적으로 접속된 전극이, 공통 인출 배선과 시일 영역 사이를 덮고 있는 점 이외는 실시 형태 1의 액정 표시 패널과 마찬가지이다.
도 10은 실시 형태 2의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다. 실시 형태 2의 제1 예에서는, 공통 전극(13)으로부터 격리되고, 또한 공통 전극(13)과 전기적으로 접속된 전극으로서, 화소 전극과 동일한 계층에 형성된 전극(18a)을 이용하고 있다. 공통 전극(13)과, 상기 화소 전극과 동일한 계층에 형성된 전극(18a)은, 제3 절연막(63)에 형성된 콘택트부(73)를 통하여 서로 전기적으로 접속되어 있다.
도 11은 실시 형태 2의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다. 실시 형태 2의 제2 예에서는, 공통 전극(13)으로부터 격리되고, 또한 공통 전극(13)과 전기적으로 접속된 전극으로서, 공통 인출 배선(17)과 동일한 계층에 형성된 전극(18b)을 이용하고 있다. 공통 전극(13)과, 상기 공통 인출 배선(17)과 동일한 계층에 형성된 전극(18b)은, 제2 절연막(62)에 형성된 콘택트부(72)를 통하여 서로 전기적으로 접속되어 있다.
실시 형태 3
실시 형태 3의 액정 표시 패널은, 공통 전극뿐만 아니라, 공통 전극으로부터 격리되고, 또한 공통 전극과 전기적으로 접속된 전극을 사용하여, 공통 인출 배선과 시일 영역 사이의 영역을 덮고 있는 점 이외는 실시 형태 1의 액정 표시 패널과 마찬가지이다.
도 12는 실시 형태 3의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다. 실시 형태 3의 제1 예에서는, 공통 전극(13)으로부터 격리되고, 또한 공통 전극(13)과 전기적으로 접속된 전극으로서, 화소 전극(14)과 동일한 계층에 형성된 전극(18a) 및 공통 전극(13)과 동일한 계층에 형성된 전극(18c)을 이용하고 있다. 공통 전극(13)과, 화소 전극(14)과 동일한 계층에 형성된 전극(18a)은, 제3 절연막(63)에 형성된 콘택트부(73)를 통하여 서로 전기적으로 접속되어 있다. 공통 전극(13)과, 상기 공통 전극(13)과 동일한 계층에 형성된 전극(18c)은, 상기 화소 전극(14)과 동일한 계층에 형성된 전극(18a) 및 제3 절연막(63)에 형성된 2개의 콘택트부(73)를 통하여 서로 전기적으로 접속되어 있다.
도 13은 실시 형태 3의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다. 실시 형태 3의 제2 예에서는, 공통 전극(13)으로부터 격리되고, 또한 공통 전극(13)과 전기적으로 접속된 전극으로서, 공통 인출 배선(17)과 동일한 계층에 형성된 전극(18b) 및 공통 전극(13)과 동일한 계층에 형성된 전극(18c)을 이용하고 있다. 공통 전극(13)과, 공통 인출 배선(17)과 동일한 계층에 형성된 전극(18b)은, 제2 절연막(62)에 형성된 콘택트부(72)를 통하여 서로 전기적으로 접속되어 있다. 공통 전극(13)과, 상기 공통 전극(13)과 동일한 계층에 형성된 전극(18c)은, 공통 인출 배선(17)과 동일한 계층에 형성된 전극(18b) 및 제2 절연막(62)에 형성된 2개의 콘택트부(72)를 통하여 서로 전기적으로 접속되어 있다.
설계의 사정에 따라서는, 이와 같이 복수의 계층에 위치하는 전극을 이용하여, 전체로서 공통 인출 배선과 시일 영역 사이의 영역을 덮는 것으로 해도 된다.
실시 형태 4
실시 형태 4의 액정 표시 패널은, 블랙 매트릭스가 시일재의 전체와 겹치지 않도록 형성되어 있는 점 이외는 실시 형태 1의 액정 표시 패널과 마찬가지이다. 상기한 바와 같이, 시일재와 블랙 매트릭스가 일부 중첩되어 있으면, 시일재를 경화할 때, 대향 기판측으로부터 자외선 조사를 행할 수 없다. 따라서, 실시 형태 4에서는, 블랙 매트릭스가 시일재와 겹치지 않는 부분을 형성하고 있다.
도 14는 실시 형태 4의 액정 표시 패널의 제1 예를 도시하는 단면 모식도이다. 실시 형태 4의 제1 예에서는, 시일재(30)와 블랙 매트릭스(22)가 겹치지 않도록 각각이 형성되어 있다. 이 경우, 시일재(30)를 경화시키기 위한 자외선 조사는, 대향 기판(20)측으로부터 행할 수 있으므로, 보다 신속하게 또한 확실하게 시일재를 경화시킬 수 있다.
도 15는 실시 형태 4의 액정 표시 패널의 제2 예를 도시하는 단면 모식도이다. 실시 형태 4의 제2 예에서는, 시일재(30)와 블랙 매트릭스(22)가 일부 겹쳐 형성되어 있다. 이 경우, 시일재(30)를 경화시키기 위한 자외선 조사는, 대향 기판(20)측으로부터 행하는 것이 아니라, TFT 기판(10)측으로부터 행하는 것이 바람직하다. 또한, 이 경우, 실시 형태 1의 제3 변형예에서 나타낸 바와 같이, 게이트 인출 배선(12)에 슬릿이 형성되어 있는 것이 보다 바람직하다.
이상, 실시 형태 1 내지 4에 있어서 본 발명의 액정 표시 패널에 대하여 설명하였지만, 각 실시 형태 및 그 변형예는 적절히 조합하여 채용할 수 있다.
10 : TFT 기판
11, 21 : 지지 기판
12, 112 : 게이트 신호선, 게이트 인출 배선
12a : 제1 게이트 인출 배선
12b : 제2 게이트 인출 배선
13 : 공통 전극
14 : 화소 전극
14a : 화소 전극의 슬릿
16 : 소스 신호선, 소스 인출 배선
17 : 공통 인출 배선
17a: 제1 공통 인출 배선
17b : 제2 공통 인출 배선
18a : 화소 전극과 동일한 계층에 형성된 전극
18b : 공통 인출 배선과 동일한 계층에 형성된 전극
18c : 공통 전극과 동일한 계층에 형성된 전극
20 : 대향 기판
22 : 블랙 매트릭스
23 : 실드 전극
30 : 시일재
40 : 액정층
51, 151 : 게이트 드라이버(게이트 신호 출력 회로)
51a : 제1 게이트 드라이버
51b : 제2 게이트 드라이버
52 : 소스 드라이버(소스 신호 출력 회로)
54 : TFT(박막 트랜지스터)
55 : 반도체층
56a, 56b : 개구부
57 : 제1 공통 신호선
61 : 제1 절연막
62 : 제2 절연막
63 : 제3 절연막
71, 74 : 콘택트부(제1 절연막 내)
72 : 콘택트부(제2 절연막 내)
73 : 콘택트부(제3 절연막 내)
81 : 게이트 인출 배선과 동일한 계층에 위치하는 전극
81a : 게이트 인출 배선과 동일한 계층에 위치하는 전극의 슬릿
101 : 플로팅 아일랜드 영역

Claims (11)

  1. 한 쌍의 기판과, 시일재(sealing material)와, 상기 한 쌍의 기판 및 상기 시일재에 의해 밀봉된 액정층을 구비하고,
    상기 한 쌍의 기판 중 한쪽은, 복수의 슬릿을 갖는 화소 전극과, 절연막을 개재하여 상기 화소 전극과 상이한 계층에 위치하는 평판형 공통 전극을 구비하고,
    비표시 영역에, 게이트 드라이버와, 상기 게이트 드라이버로부터 표시 영역을 향하여 연신(延伸)된 복수의 게이트 인출 배선과, 상기 공통 전극과 전기적으로 접속된 공통 인출 배선이 설치되어 있고,
    상기 공통 인출 배선은, 상기 복수의 게이트 인출 배선과 교차하고 있고,
    상기 공통 전극은, 상기 복수의 게이트 인출 배선과 교차하는 상기 공통 인출 배선과, 상기 공통 인출 배선을 따른 상기 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는 것을 특징으로 하는 액정 표시 패널.
  2. 제1항에 있어서,
    상기 시일재는 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고,
    상기 시일재의 일부는 상기 복수의 게이트 인출 배선과 교차하고 있고,
    상기 공통 전극은, 또한, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것을 특징으로 하는 액정 표시 패널.
  3. 제1항에 있어서,
    상기 시일재는 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고,
    상기 시일재의 일부는 상기 복수의 게이트 인출 배선과 교차하고 있고,
    상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극이, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것을 특징으로 하는 액정 표시 패널.
  4. 제1항에 있어서,
    상기 시일재는 상기 공통 인출 배선보다도 상기 표시 영역으로부터 먼 위치에 설치되어 있고,
    상기 시일재의 일부는 상기 복수의 게이트 인출 배선과 교차하고 있고,
    상기 공통 전극 및 상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극의 조합은, 상기 복수의 게이트 인출 배선과 교차하는 상기 시일재의 일부와, 상기 표시 영역의 외측 테두리의 일부를 따른 상기 공통 인출 배선 사이의 영역을 덮는 것을 특징으로 하는 액정 표시 패널.
  5. 제3항 또는 제4항에 있어서,
    상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극은, 상기 화소 전극과 동일한 계층에 위치하는 전극인 것을 특징으로 하는 액정 표시 패널.
  6. 제3항 또는 제4항에 있어서,
    상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극은, 상기 공통 전극과 동일한 계층에 위치하는 전극인 것을 특징으로 하는 액정 표시 패널.
  7. 제3항 또는 제4항에 있어서,
    상기 공통 전극으로부터 격리되고, 또한 상기 공통 전극과 전기적으로 접속된 전극은, 상기 공통 인출 배선과 동일한 계층에 위치하는 전극인 것을 특징으로 하는 액정 표시 패널.
  8. 제1항 내지 제7항 중 어느 한 항에 있어서,
    상기 대향 기판은 블랙 매트릭스를 구비하고, 상기 시일재의 적어도 일부는 상기 블랙 매트릭스와 겹쳐 있는 것을 특징으로 하는 액정 표시 패널.
  9. 제1항 내지 제8항 중 어느 한 항에 있어서,
    상기 복수의 게이트 인출 배선과 동일한 계층에 위치하고, 또한 시일재와 겹치는 전극은 슬릿을 갖는 것을 특징으로 하는 액정 표시 패널.
  10. 제1항 내지 제7항 중 어느 한 항에 있어서,
    상기 대향 기판은 블랙 매트릭스를 구비하고, 상기 시일재는 상기 블랙 매트릭스와 겹쳐 있지 않은 것을 특징으로 하는 액정 표시 패널.
  11. 제1항 내지 제10항 중 어느 한 항에 있어서,
    상기 게이트 드라이버는 제1 게이트 드라이버이고,
    상기 게이트 드라이버로부터 인출된 복수의 게이트 인출 배선은 제1 복수의 게이트 인출 배선이고,
    상기 표시 영역을 개재하여 상기 제1 게이트 드라이버와 대향하는 영역에는, 제2 게이트 드라이버와, 상기 제2 게이트 드라이버로부터 상기 표시 영역을 향하여 연신된 제2 복수의 게이트 인출 배선과, 상기 공통 전극과 전기적으로 접속된 제2 공통 인출 배선이 설치되어 있고,
    상기 제2 공통 인출 배선은 상기 제2 복수의 게이트 인출 배선과 교차하고 있고,
    상기 공통 전극은, 상기 제2 복수의 게이트 인출 배선과 교차하는 상기 제2 공통 인출 배선과, 상기 제2 공통 인출 배선을 따른 표시 영역의 외측 테두리의 일부 사이의 영역을 덮는 것을 특징으로 하는 액정 표시 패널.
KR20147027511A 2012-03-30 2013-03-22 액정 표시 패널 KR20140133589A (ko)

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