KR20100120481A - 액정 표시 장치 - Google Patents

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Abstract

표시 품질을 향상시킬 수 있는 액정 표시 장치가 제공된다. 액정 표시 장치는, 제1 기판 상에 형성되고, 제1 방향으로 연장된 게이트선, 게이트선과 절연되어 교차하며 다수의 화소 영역을 정의하고, 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선, 게이트선과, 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터, 및 각 화소 영역에 형성되고, 제1 및 제2 박막 트랜지스터에 각각 연결된 제1 및 제2 부화소 전극을 포함하되, 다수의 화소 영역은 차례로 배열된 제1 내지 제3 화소 영역을 포함하고, 제2 화소 영역의 제1 및 제2 박막 트랜지스터 중 적어도 하나는 제1 또는 제3 화소 영역의 제1 및 제2 부화소 전극 측에 배치된다.
액정 표시 장치, 박막 트랜지스터, 게이트 배선

Description

액정 표시 장치{Liquid crystal display}
본 발명은 액정 표시 장치에 관한 것으로, 보다 상세하게는 특정 화소 영역의 투과 영역의 크기를 조절하여 표시 품질이 향상시킨 액정 표시 장치에 관한 것이다.
액정 표시 장치(Liquid Crystal Display: LCD)는 현재 가장 널리 사용되고 있는 평판 표시 장치(Flat Panel Display: FPD) 중 하나로서, 전극이 형성되어 있는 두 장의 기판과 그 사이에 삽입되어 있는 액정층으로 이루어져, 전극에 전압을 인가하여 액정층의 액정 분자들을 재배열시킴으로써 투과되는 빛의 양을 조절하는 표시 장치이다.
액정 표시 장치를 구성하는 두 장의 기판 중 박막 트랜지스터 기판에는 다수개의 박막 트랜지스터와 화소 전극이 구비되어 있다. 최근에는 액정 표시 장치의 평탄화 특성, 광학 특성 및 얼라인(align) 문제를 개선할 수 있도록 컬러 필터가 박막 트랜지스터 기판 상에 형성되는 COA(Color On Array) 구조가 연구되고 있다. 특히, 박막 트랜지스터 기판의 화소 영역 주위에 블랙 매트릭스를 형성하고, 잉크젯법을 이용하여 화소 영역에 컬러 필터를 형성하고, 컬러 필터에 콘택을 형성하여 화소 전극과 드레인 전극을 접촉시키는 방법이 연구되고 있다.
그러나, 빛이 각 화소 영역 마다 동일한 면적을 통과하더라도, 각 화소 영역에 배치된 컬러 필터의 타입, 예를 들어 레드, 그린, 및 블루 컬러 필터 중 어떤 것을 통과하는 지에 따라, ACC (Accurate Color Capture) 보정 후의 감마값의 차이가 발생하는 경우가 있었다. 더욱 구체적으로, 블루 컬러 필터의 ACC 보정 후의 감마값이, 레드 또는 그린 컬러 필터의 ACC 보정 후의 감마값과 차이가 발생하는 경우가 있었다. 이는 특히, 구름 배경 화면을 표시하는 경우, 구름의 계조 변화(gradation)이 없어지고 화면이 거칠어지는 이른바 떡짐 현상이 발생하여 표시 품질이 저해되는 어려움이 있었다.
본 발명이 해결하고자 하는 과제는 표시 품질이 향상된 액정 표시 장치를 제공하는 것이다.
본 발명의 과제들은 이상에서 언급한 과제들로 제한되지 않으며, 언급되지 않은 또 다른 과제들은 아래의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.
상기 과제를 해결하기 위한 본 발명의 일 실시예에 따른 액정 표시 장치는, 제1 기판 상에 형성되고, 제1 방향으로 연장된 게이트선, 상기 게이트선과 절연되어 교차하며 다수의 화소 영역을 정의하고, 상기 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선, 상기 게이트선과, 상기 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터, 및 상기 각 화소 영역에 형성되고, 상기 제1 및 제2 박막 트랜지스터에 각각 연결된 제1 및 제2 부화소 전극을 포함하되, 상기 다수의 화소 영역은 차례로 배열된 제1 내지 제3 화소 영역을 포함하고, 상기 제2 화소 영역의 상기 제1 및 제2 박막 트랜지스터 중 적어도 하나는 상기 제1 또는 제3 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치된다.
상기 과제를 해결하기 위한 본 발명의 다른 실시예에 따른 액정 표시 장치는, 기판 상에 형성되고, 제1 방향으로 연장된 게이트선; 상기 게이트선과 절연되어 교차하며 다수의 화소 영역을 정의하고, 상기 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선; 상기 게이트선과, 상기 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터; 및 상기 각 화소 영역에 형성되고, 상기 제1 및 제2 박막 트랜지스터에 각각 연결된 제1 및 제2 부화소 전극을 포함하되, 상기 다수의 화소 영역은 차례로 배열된 제1 및 제2 화소 영역을 포함하고, 상기 제2 화소 영역의 상기 제1 데이터선과, 상기 제1 화소 영역의 상기 제2 데이터선은 상기 제2 화소 영역의 상기 제1 박막 트랜지스터를 ㄷ자 형태로 둘러싸며 연장된다.
본 발명의 기타 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발 명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 것이며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하며, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 따라서, 몇몇 실시예에서, 잘 알려진 공정 단계들, 잘 알려진 소자 구조 및 잘 알려진 기술들은 본 발명이 모호하게 해석되는 것을 피하기 위하여 구체적으로 설명되지 않는다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
공간적으로 상대적인 용어인 "아래(below)", "아래(beneath)", "하부(lower)", "위(above)", "상부(upper)" 등은 도면에 도시되어 있는 바와 같이 하나의 소자 또는 구성 요소들과 다른 소자 또는 구성 요소들과의 상관관계를 용이하게 기술하기 위해 사용될 수 있다. 공간적으로 상대적인 용어는 도면에 도시되어 있는 방향에 더하여 사용시 또는 동작시 소자의 서로 다른 방향을 포함하는 용어로 이해되어야 한다. 예를 들면, 도면에 도시되어 있는 소자를 뒤집을 경우, 다른 소자의 "아래(below)"또는 "아래(beneath)"로 기술된 소자는 다른 소자의 "위(above)"에 놓여질 수 있다. 따라서, 예시적인 용어인 "아래"는 아래와 위의 방향을 모두 포함할 수 있다. 소자는 다른 방향으로도 배향될 수 있고, 이에 따라 공간적으로 상대적인 용어들은 배향에 따라 해석될 수 있다.
본 명세서에서 사용된 용어는 실시예들을 설명하기 위한 것이며 본 발명을 제한하고자 하는 것은 아니다. 본 명세서에서, 단수형은 문구에서 특별히 언급하지 않는 한 복수형도 포함한다. 명세서에서 사용되는 "포함한다(comprises)" 및/또는 "포함하는(comprising)"은 언급된 구성요소, 단계, 동작 및/또는 소자는 하나 이상의 다른 구성요소, 단계, 동작 및/또는 소자의 존재 또는 추가를 배제하지 않는다.
다른 정의가 없다면, 본 명세서에서 사용되는 모든 용어(기술 및 과학적 용어를 포함)는 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 공통적으로 이해될 수 있는 의미로 사용될 수 있을 것이다. 또 일반적으로 사용되는 사전에 정의되어 있는 용어들은 명백하게 특별히 정의되어 있지 않은 한 이상적으로 또는 과도하게 해석되지 않는다.
본 명세서에서는 설명의 편의상 미세 전극으로 패터닝된 화소 전극을 포함하고, 각 화소 전극을 2개의 서브 화소 전극으로 분할한 액정 표시 장치를 예로 들어 설명한다. 그러나, 본 발명의 기술적 사상이 적용될 수 있는 액정 표시 장치는 이에 한정되지 않고, 하나의 화소 영역에 수 개의 도메인 분할 수단을 가지는 PVA(Patterned Vertical Alignment) 구조, 또는 화소 전극이 패터닝되지 않은 구조의 액정 표시 장치, 및 서브 화소 전극으로 분할되지 않은 화소 전극을 가지는 액정 표시 장치 등에도 적용될 수 있음은 물론이다.
이하, 첨부된 도면들을 참조하여 본 발명의 일 실시예에 의한 액정 표시 장치에 대하여 상세히 설명한다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 화소 어레이를 개략적으로 나타낸 도면이다. 도 2는 도 1의 액정 표시 장치의 한 화소에 대한 등가 회로도이다.
본 발명의 일 실시예에 따른 액정 표시 장치는 액정 패널 어셈블리(liquid crystal panel assembly)와, 이에 연결된 게이트 구동부 및 데이터 구동부와, 데이터 구동부에 연결된 계조 전압 생성부와, 이들을 제어하는 신호 제어부를 포함할 수 있다.
액정 패널 어셈블리는 다수의 표시 신호선과 이에 연결되어 있으며 실질적으로 행렬의 형태로 배열된 다수의 화소(PX)를 포함한다. 여기서, 액정 패널 어셈블리는 서로 마주 보는 제1 기판과 제2 기판, 그리고 이들 사이에 개재된 액정층을 포함한다.
도 1 및 도 2를 참조하면, 표시 신호선은 하부 표시판에 구비되어 있으며, 게이트 신호를 전달하는 다수의 게이트선(GL)과 데이터 신호를 전달하는 제1 및 제2 데이터선(DLa, DLb)을 포함한다. 게이트선(GL)은 예를 들어 행 방향으로 뻗어 있으며 서로가 거의 평행하고, 제1 및 제2 데이터선(DLa, DLb)은 예를 들어 열 방향으로 뻗어 있으며 서로가 거의 평행하다. 더욱 구체적으로, 게이트선(GL)은 하부 표시판 상에 제1 방향으로 연장되어 형성되고, 제1 및 제2 데이터선(DLa, DLb)은 게이트선(GL)과 절연되어 교차하며 다수의 화소 영역을 정의하고, 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장되어 형성된다.
각 화소(PX)는 한 쌍의 부화소(PXa, PXb)를 포함하며, 각 부화소(PXa, PXb)는 해당 제1 또는 제2 데이터선(DLa, DLb) 및 하나의 게이트선(GL)에 연결되어 있는 제1 및 제2 스위칭 소자(T1, T2)와 연결된다. 또한, 제1 및 제2 부화소(PXa, PXb)는 각 화소 영역에 대응되어 형성된다. 여기서, 제1 부화소 전극(PXa)에 상대적으로 높은 데이터 전압이 인가되고, 제2 부화소 전극(PXb)에 상대적으로 낮은 데 이터 전압이 인가되는 경우를 가정한다. 여기서, 데이터 전압의 높고 낮음은 공통 전압과 데이터 전압의 차이의 높고 낮음을 의미할 수 있다.
도 1에 도시된 바와 같이, 다수의 화소 영역은 연속 배열된 제1 내지 제3 화소 영역을 포함하고, 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2) 중 적어도 하나는 제1 또는 제2 화소 영역의 제1 및 제2 부화소(PXa, PXb) 측에 배치된다. 더욱 구체적으로, 제2 화소 영역의 제1 박막 트랜지스터(T1)는 제2 화소 영역의 제1 데이터선(DLa)을 기준으로 제1 화소 영역의 제1 및 제2 부화소(PXa, PXb) 측에 배치될 수 있다.
다시 말하면, 제1 및 제2 박막 트랜지스터(T1, T2)는, 게이트선(GL)과 제1 및 제2 데이터선(DLa, DLb)에 각각 연결된다. 이 때, 각 화소 영역에 배치되는 화소의 색상 타입에 따라, 제1 및 제2 박막 트랜지스터(T1, T2)는 각 화소 영역에 대하여 서로 다른 위치에 배치된다.
예를 들어, 연속하는 제1 내지 제3 화소 영역에 대하여, 제1 화소 영역에는 그린 컬러 필터, 제2 화소 영역에는 블루 컬러 필터, 그리고 제3 화소 영역에는 레드 컬러 필터가 배치될 수 있다. 이 때, 블루 컬러 필터가 배치된 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)의 적어도 하나는, 제2 화소 영역의 제1 및 제2 데이터선(DLa, DLb)으로부터 인접하는 화소 영역, 즉 제1 또는 제3 화소 영역 방향으로 연결되도록 형성된다. 이에 대한 더욱 상세한 설명은 도 3에서 설명한다.
나아가, 제1 및 제2 박막 트랜지스터(T1, T2)는 액정 커패시터(liquid crystal capacitor)(Clca, Clcb) 및 스토리지 커패시터(storage capacitor)(Csta, Cstb)와 각각 연결될 수 있다. 경우에 따라서, 스토리지 커패시터(Csta, Cstb)는 생략될 수도 있다.
각 부화소(PXa, PXb)의 스위칭 소자(T1, T2)는 하부 표시판에 구비되어 있는 박막 트랜지스터 등으로 이루어지며, 게이트 신호가 인가되는 게이트선(GL)에 연결되어 있는 제어 단자(이하, 게이트 전극), 데이터선(DLa, DLb)에 연결되어 있는 입력 단자(이하, 소오스 전극), 그리고 액정 커패시터(Clca, Clcb) 및 스토리지 커패시터(Csta, Cstb)에 연결되어 있는 출력 단자(이하, 드레인 전극)를 가지는 삼단자 소자, 즉 박막 트랜지스터이다.
액정 커패시터(Clca, Clcb)는 하부 표시판의 부화소 전극과 상부 표시판의 공통 전극을 두 단자로 하며, 부화소 전극과 공통 전극 사이의 액정층은 유전체로서 기능을 한다. 각 부화소 전극(PXa, PXb)은 각 스위칭 소자(T1, T2)에 연결되며 공통 전극은 상부 표시판의 전면에 형성되어 있고 공통 전압(Vcom)을 인가 받는다.
액정 커패시터(Clca, Clcb)의 보조적인 역할을 하는 스토리지 커패시터(Csta, Cstb)는 하부 표시판에 구비된 스토리지 배선과 제1 및 제2 부화소 전극(PXa, PXb)이 절연체를 사이에 두고 중첩되어 형성될 수 있다. 또한, 스토리지 배선에는 공통 전압(Vcom) 등의 정해진 전압이 인가될 수 있다.
한편, 색 표시를 구현하기 위해서는 각 화소가 원색(primary color) 중 하나를 고유하게 표시하거나(공간 분할) 각 화소가 시간에 따라 번갈아 삼원색을 표시하게(시간 분할) 하여 이들 삼원색의 공간적, 시간적 합으로 원하는 색상이 인식되도록 한다. 원색의 예로는 적색, 녹색 및 청색을 들 수 있다. 공간 분할의 한 예로 서 각 화소가 상부 표시판의 영역에 원색 중 하나를 나타내는 컬러 필터를 구비할 수 있다.
게이트 구동부는 게이트선(GL)에 연결되어 외부로부터의 게이트 온 전압(Von)과 게이트 오프 전압(Voff)의 조합으로 이루어진 게이트 신호를 게이트선(GL)에 인가한다.
계조 전압 생성부(gray volT1ge generator)는 화소의 투과율과 관련된 두 개의 계조 전압 집합(또는 기준 계조 전압 집합)을 생성하여, 데이터 구동부에 제공할 수 있다. 즉, 두 개의 계조 전압 집합은 하나의 화소를 이루는 한 쌍의 부화소에 독립적으로 제공될 수 있다. 다만, 본 발명은 이에 한정되지 않으며, 두 개의 계조 전압 집합 대신 하나의 계조 전압 집합만을 생성할 수도 있다.
데이터 구동부는 한 쌍의 데이터선(DLa, DLb)에 각각 연결되어 있다. 데이터 구동부는 제1 또는 제2 데이터선(DLa, DLb)을 통하여 하나의 화소를 구성하는 한 쌍의 부화소(PX1, PXb) 중 어느 하나의 부화소에 데이터 전압을 전달하고, 데이터선(DLb)을 통하여 하나의 화소를 구성하는 한 쌍의 부화소 중 다른 하나의 부화소에 별도의 데이터 전압을 전달한다. 예를 들어, 도 1에 도시된 바와 같이, 각 화소 영역의 제1 데이터선(DLa)은 제1 부화소(PXa)에 제1 데이터 전압을 전달하고, 제2 데이터선(DLb)은 제2 부화소(PXb)에 제2 데이터 전압을 전달할 수 있다.
이러한 게이트 구동부 또는 데이터 구동부는 다수의 구동 집적 회로 칩의 형태로 액정 패널 어셈블리 위에 직접 장착되거나, 가요성 인쇄 회로 필름(flexible printed circuit film) 위에 장착되어 테이프 캐리어 패키지(T1pe carrier package)의 형태로 액정 패널 어셈블리에 부착될 수도 있다.
이와는 달리, 게이트 구동부 또는 데이터 구동부는 표시 신호선(GL, DLa, DLb)과 박막 트랜지스터 스위칭 소자(T1, T2) 등과 함께 액정 패널 어셈블리에 집적(integration)될 수도 있다.
신호 제어부는 게이트 구동부 및 데이터 구동부 등의 동작을 제어한다.
하나의 화소는 두 개의 스위칭 소자와, 각 스위칭 소자에 연결된 부화소 전극(PXa, PXb)을 포함한다. 여기서, 제1 부화소 전극(PXa)에 상대적으로 높은 데이터 전압이 인가되고, 제2 부화소 전극(PXb)에 상대적으로 낮은 데이터 전압이 인가되는 경우를 가정한다. 여기서, 데이터 전압의 높고 낮음은 공통 전압과 데이터 전압의 차이의 높고 낮음을 의미할 수 있다. 이 때, 제1 및 제2 데이터선(DLa, DLb)을 제1 및 제2 부화소 전극(PXa, PXb)과 중첩하도록 배치하고, 제2 부화소 전극(PXb)이 제1 부화소 전극(PXa)을 감싸도록 형성할 수 있다. 이로써, 제1 및 제2 부화소 전극(PXa, PXb)과, 양 측에 위치하는 제1 및 제2 데이터선(DLa, DLb) 사이의 커플링(coupling)의 발생을 방지할 수 있다.
이하, 도 3 내지 도 5를 참조하여, 본 발명의 일 실시예에 따른 액정 표시 장치를 상세하게 설명한다. 본 발명의 일 실시예에 따른 액정 표시 장치는 박막 트랜지스터 어레이(thin film transistor array)가 형성된 제1 기판, 이와 대향하여 대치된 제2 기판 및 이들 사이에 개재된 액정층(미도시)을 포함할 수 있다.
도 3은 본 발명의 일 실시예에 따른 액정 표시 장치의 차례로 배열된 제1 내지 제3 화소 영역을 포함한 제1 기판의 배치도이다. 도 4는 도 3의 제1 화소 영역 을 포함한 제1 기판의 배치도이다. 도 5는 도 4의 V-V'선으로 자른 단면도이다. 이하에서, 제1 내지 제3 화소 영역 중 어느 하나의 구성 요소로 지칭하지 않은 경우, 제1 내지 제3 화소 영역에 공통적으로 해당하는 구성요소에 대한 설명이다.
도 3을 참조하면, 다수의 화소 영역이 게이트선(22)과, 제1 및 제2 데이터선(162a, 162b, 262a, 262b, 362a, 362b)에 의하여 정의된다. 즉, 각각의 화소 영역은 가로 방향으로 연장된 게이트선(22)과, 세로 방향으로 연장된 한 쌍의 제1 및 제2 데이터선(162a, 162b, 262a, 262b, 362a, 362b)에 의해 형성된 영역으로 정의할 수 있다. 따라서, 신호 배선, 특히 제1 또는 제2 데이터선(162a, 162b, 262a, 262b, 362a, 362b)의 형태에 따라 각 화소 영역의 형태는 인접하는 화소 영역의 형태와 서로 다를 수 있다.
예를 들어, 도 3의 가장 좌측의 화소 영역을 제1 화소 영역이라고 하고, 차례로 배열된 화소 영역을 각각 제2 및 제3 화소 영역이라고 할 때, 제2 화소 영역은 직사각형의 형태를 가지지만, 제1 화소 영역은 제2 데이터선(162b)의 배선 형태로 인하여 우측 하단이 일그러진 직사각형의 형태를 가질 수 있다. 마찬가지로, 제3 화소 영역도 제1 데이터선(362a)의 배선 형태로 인하여 좌측 하단이 일그러진 직사각형의 형태를 가질 수 있다.
게이트 신호를 전달하는 게이트선(22)은, 투명한 유리 등으로 이루어진 절연 기판(10) 위에 제1 방향, 예를 들어, 가로 방향으로 연장되도록 형성될 수 있다.
제2 화소 영역을 중심으로 살펴보면, 게이트선(22)은 각 화소 영역에 대응하여 돌출된 한 쌍의 제1 및 제2 게이트 전극(226a, 226b)을 포함할 수 있다. 이 때, 차례로 배열된 제1 내지 제3 화소 영역에 대하여, 제2 화소 영역의 제1 게이트 전극(226a)은 제2 화소 영역의 제1 데이터선(262a)을 기준으로 제1 화소 영역의 제1 및 제2 부화소 전극(112a, 112b) 측에 배치될 수 있다.
또한, 제2 화소 영역의 제2 게이트 전극(226b)은 제2 화소 영역의 제2 데이터선(262b)을 기준으로 제3 화소 영역의 제1 및 제2 부화소 전극(312a, 132b) 측에 배치될 수 있다. 다시 말하면, 제2 화소 영역의 제1 및 제2 게이트 전극(226a, 226b)은 제2 화소 영역의 외곽에 배치된다고 할 수 있다.
또한, 절연 기판(10) 위에는 화소 영역을 가로질러 게이트선(22)과 실질적으로 평행하게 가로 방향으로 연장된 스토리지선(storage line)(미도시)이 형성될 수 있고, 스토리지선은 연결되어 소정의 너비를 가지는 스토리지 전극(미도시)을 포함할 수 있다. 스토리지 전극은 화소 전극(112a, 112b, 212a, 212b, 312a, 312b)과 중첩되어 화소의 전하 보존 능력을 향상시키는 스토리지 커패시터(storage capacitor)를 형성할 수 있다.
게이트선(22) 및 스토리지선 상에는 예를 들어, 질화규소(SiNx) 등을 포함하는 게이트 절연막(30)이 형성되어 있다.
게이트 절연막(30) 위에는 수소화 비정질 규소(hydrogenated amorphous silicon) 또는 다결정 규소 등으로 이루어진 한 쌍의 반도체층(40a, 40b)이 형성될 수 있다. 반도체층(40a, 40b)은 섬 모양, 선형 등과 같이 다양한 형상을 가질 수 있으며, 예를 들어 본 실시예에서와 같이 섬 모양으로 형성될 수 있다.
데이터 전압을 전달하는 제1 및 제2 데이터선(162a, 162b, 262a, 262b, 362a, 362b)은 제2 방향, 예를 들어 세로 방향으로 연장되어 게이트선(22)과 절연되어 교차하며 다수의 화소 영역을 정의한다.
예를 들어, 제2 화소 영역을 중심으로 살펴보면, 제1 및 제2 데이터선(262a, 262b)은 제2 화소 영역의 양 측에 각각 하나씩 세로 방향으로 연장되어 형성된다. 이 때, 제1 및 제2 데이터선(262a, 262b)은 제1 및 제2 드레인 전극(266a, 266b)을 향하여 각각 연장된 제1 및 제2 소오스 전극(265a, 265b)을 포함할 수 있다. 하나의 화소 영역에는 한 쌍의 제1 및 제2 부화소(212a, 212b)로 구분될 수 있으며, 제1 데이터선(262a)은 제1 및 제2 부화소 전극(212a, 212b) 중 어느 하나에 데이터 신호를 전달하고 제2 데이터선(262b)은 다른 하나에 별도의 데이터 신호를 전달한다.
요컨대, 차례로 배치된 제1 내지 제3 화소 영역은, 각 화소 영역에 포함된 제1 부화소 전극(112a, 212a, 312a)과 연결된 제1 박막 트랜지스터(T1)와, 제2 부화소 전극(112b, 212b, 312b)과 연결된 제2 박막 트랜지스터(T2)를 포함하되, 제2 화소 영역의 제1 박막 트랜지스터(T1)는 제2 화소 영역의 제1 데이터선(262a)을 기준으로 제1 화소 영역의 제1 및 제2 부화소 전극(112a, 112b) 측에 배치될 수 있다.
마찬가지로, 제2 화소 영역의 제2 박막 트랜지스터(T2)는 제2 화소 영역의 제2 데이터선(262b)을 기준으로 제3 화소 영역의 제1 및 제2 부화소 전극(312a, 132b) 측에 배치될 수 있다. 즉, 제1 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)와, 제3 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 각각 제1 및 제3 화소 영역의 내부 쪽에 형성되는 것에 반하여, 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 제2 화소 영역의 외부 쪽으로 형성된다.
여기서, 각 화소 영역의 내부 및 외부는, 각 화소 영역의 양 측에 형성된 제1 데이터선(162a, 262a, 362a) 및 제2 데이터선(162b, 262b, 362b)을 기준으로 결정할 수 있다. 예를 들어, 제1 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 제1 화소 영역의 제1 및 제2 데이터선(162a, 162b)을 기준으로 제1 화소 영역의 제1 및 제2 부화소 전극(112a, 112b) 측에 배치되므로, 제1 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 제1 화소 영역의 내부에 배치된다고 할 수 있다.
이에 반하여, 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 제2 화소 영역의 제1 및 제2 데이터선(262a, 262b)을 기준으로 제1 화소 영역의 제1 및 제2 부화소 전극(112a, 112b) 측과, 제3 화소 영역의 제1 및 제2 부화소 전극(312a, 132b) 측에 배치되므로, 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)는 제2 화소 영역의 외부에 배치된다고 할 수 있다.
또한, 각 화소 영역은 제1 박막 트랜지스터(T1)와 제1 부화소 전극(112a, 212a, 312a)을 전기적으로 연결하는 제1 콘택(106a, 206a, 306a)과, 제2 박막 트랜지스터(T2)와 제2 부화소 전극(112b, 212b, 312b)을 전기적으로 연결하는 제2 콘택(106b, 206b, 306b)을 포함할 수 있다.
이 때, 상술한 바와 같이, 연속 배열된 제1 내지 제3 화소 영역의 제1 및 제2 콘택은 화소 영역에 따라 다르게 배치될 수 있다. 더욱 구체적으로, 제1 화소 영역의 제1 및 제2 콘택(106a, 106b)과, 제3 화소 영역의 제1 및 제2 콘택(306a, 306b)은 각각 제1 및 제3 화소 영역의 내부에 형성될 수 있다. 이에 반하여, 제2 화소 영역의 제1 및 제2 콘택(206a, 206b)은 제3 화소 영역의 외부에 형성될 수 있다.
여기서, 제1 화소 영역에는 그린 컬러 필터 및 레드 컬러 필터 중 어느 하나가 배치되고, 제3 화소 영역에는 나머지 하나가 배치되고, 제2 화소 영역에는 블루 컬러 필터가 배치될 수 있다. 나아가, 본 발명의 실시예에 따른 액정 표시 장치는 그린, 레드 및 블루 컬러 필터가 제1 기판(10) 상에 형성되는 COA 구조일 수 있다. 제2 화소 영역에 블루 컬러 필터가 배치되는 경우, 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)와, 제1 및 제2 콘택(206a, 206b)을 제2 화소 영역의 외부에 배치함으로써, 블루 컬러 필터에서 빛이 통과하는 영역의 넓이가 증가된다.
따라서, 화이트 밸런스(white balance)를 보정하는 ACC (Accurate Color Capture) 보정을 진행하여도, ACC 보정 후의 레드 컬러 필터와 그린 컬러 필터의 감마값 대비 블루 컬러 필터의 감마값이 이격되는 현상을 방지할 수 있다. 이 때, 각 화소 영역의 제1 및 제2 부화소 전극의 비율이나, 기존 컬러 필터의 재질, 성분 또는 두께 등을 유지하여도 무방하다 할 것이다. 즉, 박막 트랜지스터 및/또는 콘택의 배치 변화만으로 표시 품질을 개선할 수 있다.
다만, 도면에서 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2) 모두, 제1 및 제2 콘택(206a, 206b) 모두가 제2 화소 영역의 외부에 형성된 경우를 도시하였으나, 경우에 따라서 제1 및 제2 박막 트랜지스터(T1, T2) 중 어느 하나, 혹은 제1 및 제2 콘택(206a, 206b) 중 어느 하나만을 제2 화소 영역의 외부에 형성할 수 도 있음은 물론이다.
도 4를 참조하여, 제1 화소 영역의 데이터선(162a, 162b)과, 제2 화소 영역의 데이터선(262a)의 배치 관계에 대하여 살펴본다. 설명의 편의를 위하여, 도 4에서는 제1 화소 영역의 제1 부화소 전극(112a)을 중심으로 도시하였으나, 제3 화소 영역의 주변부도 이와 실질적으로 동일하게 형성된다고 할 것이다.
도면에 도시된 바와 같이, 부화소 전극(112a)은 슬릿 패턴으로 형성될 수 있다. 제1 화소 영역은 제1 및 제2 데이터선(162a, 162b)과, 게이트선(22)에 의해 정의되고, 화소 영역에 대응하여 컬러 필터가 형성될 수 있다. 예를 들어, 제1 화소 영역에는 그린 또는 레드 컬러 필터가 형성될 수 있다.
제2 화소 영역의 제1 박막 트랜지스터(T1)는 제2 화소 영역의 일측에 배치된 제1 데이터선(262a)과, 제1 화소 영역의 타측에 배치된 제2 데이터선(162b) 사이에 형성될 수 있다. 여기서, 각 화소 영역의 일측 및 타측은, 제1 및 제2 데이터선(162a, 162b)이 배치된 각 화소 영역의 양 측을 의미할 수 있다.
예를 들어, 제1 화소 영역의 제2 데이터선(162b)이 배치된 우측을 일측이라고 하면, 제1 화소 영역의 제1 데이터선(162a)이 배치된 좌측을 타측이라고 할 수 있다. 따라서, 제1 화소 영역의 제2 데이터선(162b)과, 제2 화소 영역의 제1 데이터선(262a)은 서로 인접하여 배치되며, 실질적으로 평행하게 연장되도록 형성될 수 있다.
이 때, 제1 화소 영역의 제2 데이터선(162b)과, 제2 화소 영역의 제1 데이터선(262a)이 제1 거리로 서로 인접하여 실질적으로 평행하게 연장되는 부분은 제1 영역이라고 하고, 제1 거리보다 큰 제2 거리로 서로 인접하여 연장되는 부분을 제2 영역이라고 할 때, 제2 화소 영역의 제1 박막 트랜지스터(T1) 및/또는 제1 콘택(206a)은 제2 영역의 양 데이터선(162b, 262a) 사이에 배치될 수 있다.
다시 말하면, 제1 화소 영역의 제2 데이터선(162b)과 제2 화소 영역의 제1 데이터선(262a)이, 제2 화소 영역의 제1 박막 트랜지스터(T1) 및/또는 제1 콘택(206a)을 둘러싸며 형성될 수 있다. 더욱 구체적으로, 제2 화소 영역의 제1 데이터선(262a)은 제2 방향, 예를 들어 세로 방향으로 곧게 형성되고, 제1 화소 영역의 제2 데이터선(162b)이 ㄷ자 형상으로 제2 화소 영역의 제1 박막 트랜지스터(T1)의 3 면을 둘러싸며 연장될 수 있다.
상술한 바와 같이, 제2 화소 영역의 제1 박막 트랜지스터(T1)는 제1 콘택(206a)을 통해 제2 화소 영역의 제1 부화소 전극(212a)과 연결된다. 이 때, 제2 화소 영역의 제1 박막 트랜지스터(T1) 및 제1 콘택(206a)은 제2 화소 영역의 외곽, 즉 제2 화소 영역의 제1 데이터선(262a)의 좌측에 형성되므로, 제2 화소 영역의 제1 부화소 전극(212a)은 제1 데이터선(262a)과 교차되도록 형성될 수 있다. 즉, 제2 화소 영역의 제1 부화소 전극(212a)은 제2 화소 영역의 제1 데이터선(262a)과 절연되어 교차하여 제2 화소 영역의 제1 박막 트랜지스터(T1)와 전기적으로 연결될 수 있다.
도 5를 참조하면, 제1 화소 영역의 제2 데이터선(162b)과, 제2 화소 영역의 제1 데이터선(262a) 사이에 제2 화소 영역의 제1 박막 트랜지스터(265a, 226a, 266a)가 배치될 수 있다.
또한, 도면에 도시된 바와 같이, 소오스 전극(165b, 265a)은 각각 반도체층(40a, 40b)과 적어도 일부분이 중첩되고, 드레인 전극(166b, 266a)은 각각 게이트 전극(126b, 226a)을 중심으로 소오스 전극(165b, 265a)과 대향하며 반도체층(40a, 40b)과 적어도 일부분이 중첩될 수 있다.
게이트선(22), 데이터선(162b, 262a)과, 제1 및 제2 박막 트랜지스터를 포함하는 제1 기판(10) 상에 패시베이션막(passivation layer)(70)이 형성될 수 있다.
패시베이션막(70)에는 콘택(contact)(106b, 206a)을 통하여 각각 드레인 전극(166b, 266a)과 전기적으로 연결되어 있으며 화소 영역에 대응하는 부화소 전극(112b, 212a)이 형성될 수 있다. 부화소 전극(112b, 212a)은 예를 들어, ITO 또는 IZO 따위의 투명 도전체 또는 알루미늄 따위의 반사성 도전체를 포함할 수 있다.
부화소 전극(112b, 212a)은 콘택(106b, 206a)을 통하여 드레인 전극(166b, 266a)과 물리적, 전기적으로 연결되어 드레인 전극(166b, 266a)으로부터 데이터 전압을 각각 인가 받을 수 있다. 데이터 전압이 인가된 부화소 전극(112b, 212a)은 제2 기판(미도시)의 공통 전극과 함께 전기장을 생성하여 부화소 전극(112b, 212a)과 공통 전극 사이의 액정 분자들의 배열을 결정한다. 이 때, 공통 전극은 패턴이 형성되지 않는 패턴리스(patternless) 구조로 형성될 수 있다.
또한 앞서 설명하였듯이, 각 부화소 전극과 공통 전극은 액정 커패시터(Clca, Clcb)를 이루어 박막 트랜지스터(T1, T2)가 턴 오프된 후에도 인가된 전압을 유지하며, 전압 유지 능력을 강화하기 위하여 액정 커패시터(Clca, Clcb)와 병렬로 연결된 스토리지 커패시터(Csta, Cstb)는 부화소 전극(112b, 212a) 또는 이에 연결되어 있는 드레인 전극(166b, 266a)과 스토리지 배선이 오버랩되도록 배치되어 형성될 수 있다.
나아가, 부화소 전극(112b, 212a), 및 패시베이션막(70) 상에는 액정층을 배향할 수 있는 배향막(미도시)이 도포될 수 있다. 또한, 제1 기판(10) 상에는 빛샘을 방지하고 화소 영역을 정의하는 블랙 매트릭스(80)가 형성될 수 있다. 예를 들어, 블랙 매트릭스(80)는 게이트선(22)과, 데이터선(162b, 262a)에 대응하는 부분과 박막 트랜지스터에 대응하는 부분에 형성될 수 있다. 또한, 블랙 매트릭스(94)는 부화소 전극(112b, 212a)과 박막 트랜지스터 부근에서의 빛샘을 차단하기 위하여 다양한 모양을 가질 수 있다. 블랙 매트릭스(80)는 크롬, 크롬 산화물 등의 금속(금속 산화물), 또는 유기 블랙 레지스트 등으로 이루어질 수 있다.
그리고 블랙 매트릭스(80) 사이의 화소 영역에는 적색, 녹색, 청색의 컬러필터(미도시)가 순차적으로 배열될 수 있다.
본 발명의 일 실시예에 따른 액정 표시 장치에 따르면, 제2 화소 영역, 특히 블루 컬러 필터가 배치되는 화소 영역의 박막 트랜지스터 및/또는 콘택을 화소 영역의 외곽에 배치함으로써, 블루 컬러 필터를 통과할 수 있는 빛의 양을 증가시킬 수 있다. 이로 인해, ACC 보정 후 블루에 대응하는 감마값이 레드 및 그린에 대응하는 감마값과 차이가 벌어지는 현상을 방지할 수 있다. 따라서, 표시 품질이 향상되는 장점이 있다.
이하, 도 6을 참조하여, 본 발명의 다른 실시예에 따른 액정 표시 장치를 설 명한다. 도 6은 본 발명의 다른 실시예에 따른 액정 표시 장치의 제1 기판의 배치도이다. 본 발명의 다른 실시예에 따른 액정 표시 장치는 제2 화소 영역의 제1 데이터선과 제1 화소 영역의 제2 데이터선이, 제2 화소 영역의 제1 박막 트랜지스터를 ㄷ자 형태로 둘러싸며 연장되는 돌출부를 포함한다는 점에서 본 발명의 일 실시예에 따른 액정 표시 장치와 구별된다. 이하에서는 상기 구별점을 중심으로 설명하고, 실질적으로 동일한 구성 요소에 대한 자세한 설명은 생략하거나 간략화한다.
도 6을 참조하면, 본 발명의 다른 실시예에 따른 액정 표시 장치는, 제1 기판 상에 제1 방향으로 연장된 게이트선(22)과, 게이트선(22)과 절연되어 교차하며 다수의 화소 영역을 정의하고, 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선(162a, 162b, 262a, 262b, 362a, 362b)과, 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터(), 및 제1 및 제2 박막 트랜지스터(T1, T2)에 각각 연결된 제1 및 제2 부화소 전극(112a, 112b, 212a, 212b, 312a, 312b)을 포함한다.
이 때, 다수의 화소 영역은 연속하는 제1 및 제2 화소 영역을 포함하고, 제2 화소 영역의 제1 데이터선(262a)과, 제1 화소 영역의 제2 데이터선(132b)이, 제2 화소 영역의 제1 박막 트랜지스터(T1)를 ㄷ자 형태로 둘러싸며 연장된다(162bb, 462a).
여기서, 제2 화소 영역에는 블루 컬러 필터가 배치되고, 제1 화소 영역에는 그린 컬러 필터 및 레드 컬러 필터 중 어느 하나가 배치될 수 있다.
도면에서 제2 화소 영역의 제1 및 제2 박막 트랜지스터(T1, T2)의 제1 및 제 2 드레인 전극(466a, 466b)은 제2 화소 영역의 제1 및 제2 데이터선(262a, 262b)의 ㄷ자 형상으로 형성된 제1 및 제2 소오스 전극(462a, 462b)에 삽입되어 형성될 수 있다.
또한, 도면으로 도시하지는 않았으나, 제2 화소 영역의 제1 및 제2 소오스 전극(462a, 462b)은 제2 화소 영역의 제1 및 제2 데이터선(262a, 262b)으로부터 돌출되어 형성될 수도 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명이 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다.
도 1은 본 발명의 일 실시예에 따른 액정 표시 장치의 화소 어레이를 개략적으로 나타낸 도면이다.
도 2는 도 1의 액정 표시 장치의 한 화소에 대한 등가 회로도이다.
도 3은 본 발명의 일 실시예에 따른 액정 표시 장치의 차례로 배열된 제1 내지 제3 화소 영역을 포함한 제1 기판의 배치도이다.
도 4는 도 3의 제1 화소 영역을 포함한 제1 기판의 배치도이다.
도 5는 도 4의 V-V'선으로 자른 단면도이다.
도 6은 본 발명의 다른 실시예에 따른 액정 표시 장치의 제1 기판의 배치도이다.
(도면의 주요부분에 대한 부호의 설명)
10: 제1 기판 22: 게이트선
30: 게이트 절연막 40: 반도체층
70: 패시베이션막 80: 블랙 매트릭스
100: 평탄화막 106, 206, 306: 콘택
112, 212, 312: 부화소 전극 126, 226, 326: 게이트 전극
165, 265, 365: 소오스 전극 166, 266, 366: 드레인 전극

Claims (17)

  1. 제1 기판 상에 형성되고, 제1 방향으로 연장된 게이트선;
    상기 게이트선과 절연되어 교차하며 다수의 화소 영역을 정의하고, 상기 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선;
    상기 게이트선과, 상기 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터; 및
    상기 각 화소 영역에 형성되고, 상기 제1 및 제2 박막 트랜지스터에 각각 연결된 제1 및 제2 부화소 전극을 포함하되,
    상기 다수의 화소 영역은 차례로 배열된 제1 내지 제3 화소 영역을 포함하고,
    상기 제2 화소 영역의 상기 제1 및 제2 박막 트랜지스터 중 적어도 하나는 상기 제1 또는 제3 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되는 액정 표시 장치.
  2. 제1 항에 있어서,
    상기 제2 화소 영역의 상기 제1 박막 트랜지스터는,
    상기 제2 화소 영역의 상기 제1 데이터선을 기준으로 상기 제1 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되는 액정 표시 장치.
  3. 제2 항에 있어서,
    상기 제2 화소 영역의 상기 제2 박막 트랜지스터는,
    상기 제2 화소 영역의 상기 제2 데이터선을 기준으로 상기 제3 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되는 액정 표시 장치.
  4. 제1 항에 있어서,
    상기 제1 화소 영역의 상기 제1 및 제2 박막 트랜지스터는 상기 제1 화소 영역의 상기 제1 및 제2 데이터선을 기준으로 상기 제1 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되고,
    상기 제3 화소 영역의 상기 제1 및 제2 박막 트랜지스터는 상기 제3 화소 영역의 상기 제1 및 제2 데이터선을 기준으로 상기 제3 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되는 액정 표시 장치.
  5. 제1 항에 있어서,
    상기 다수의 화소 영역에 배치되는 다수의 컬러 필터를 더 포함하되,
    상기 제1 화소 영역에는 그린 컬러 필터 및 레드 컬러 필터 중 어느 하나가 배치되고,
    상기 제3 화소 영역에는 상기 그린 컬러 필터 및 상기 레드 컬러 필터 중 나머지 하나가 배치되고,
    상기 제2 화소 영역에는 블루 컬러 필터가 배치되는 액정 표시 장치.
  6. 제5 항에 있어서,
    상기 다수의 컬러 필터는 상기 제1 기판 상에 형성되는 액정 표시 장치.
  7. 제1 항에 있어서,
    상기 각 화소 영역은 상기 제1 박막 트랜지스터와 상기 제1 부화소 전극을 전기적으로 연결하는 제1 콘택과, 상기 제2 박막 트랜지스터와 상기 제2 부화소 전극을 전기적으로 연결하는 제2 콘택을 포함하되,
    상기 제2 화소 영역의 상기 제1 및 제2 콘택 중 적어도 하나는 상기 제1 또는 제3 화소 영역의 상기 제1 및 제2 부화소 전극 측에 배치되는 액정 표시 장치.
  8. 제1 항에 있어서,
    상기 제2 화소 영역의 상기 제1 박막 트랜지스터는 상기 제2 화소 영역의 일측에 배치된 상기 제1 데이터선과, 상기 제1 화소 영역의 타측에 배치된 상기 제2 데이터선의 사이에 형성되는 액정 표시 장치.
  9. 제8 항에 있어서,
    상기 제1 화소 영역의 상기 제2 데이터선과, 상기 제2 화소 영역의 상기 제1 데이터선이 제1 거리로 이격된 제1 영역과, 상기 제1 거리보다 큰 제2 거리로 이격 된 제2 영역을 포함하고,
    상기 제2 화소 영역의 상기 제1 박막 트랜지스터는 상기 제2 영역에 형성되는 액정 표시 장치.
  10. 제9 항에 있어서,
    상기 각 화소 영역은 상기 제1 박막 트랜지스터와 상기 제1 부화소 전극을 전기적으로 연결하는 제1 콘택과, 상기 제2 박막 트랜지스터와 상기 제2 부화소 전극을 전기적으로 연결하는 제2 콘택을 포함하되,
    상기 제2 화소 영역의 상기 제1 콘택은 상기 제2 영역에 형성되는 액정 표시 장치.
  11. 제9 항에 있어서,
    상기 제2 화소 영역의 상기 제1 데이터선은 상기 제2 방향으로 곧게 연장되어 형성되고,
    상기 제1 화소 영역의 상기 제2 데이터선은 상기 제1 영역에서 상기 제2 화소 영역의 상기 제1 데이터선과 평행하고, 상기 제2 영역에서 ㄷ자 형태를 가지도록 형성되는 액정 표시 장치.
  12. 제8 항에 있어서,
    상기 제2 화소 영역의 상기 제1 부화소 전극은 상기 제2 화소 영역의 상기 제1 데이터선과 절연되어 교차하여 상기 제2 화소 영역의 상기 제1 박막 트랜지스터와 전기적으로 연결되는 액정 표시 장치.
  13. 제1 항에 있어서,
    상기 게이트선, 상기 제1 및 제2 데이터선, 및 상기 제1 및 제2 박막 트랜지스터를 포함하는 상기 제1 기판 상에 형성된 패시베이션막을 더 포함하고,
    상기 제1 및 제2 부화소 전극은 상기 패시베이션막 상에 패턴을 가지는 액정 표시 장치.
  14. 제1 항에 있어서,
    상기 제1 기판과 대향하여 배치된 제2 기판을 더 포함하되,
    상기 제2 기판 상에는 패턴이 없는(patternless) 공통 전극이 형성된 액정 표시 장치.
  15. 기판 상에 형성되고, 제1 방향으로 연장된 게이트선;
    상기 게이트선과 절연되어 교차하며 다수의 화소 영역을 정의하고, 상기 각 화소 영역을 중심으로 양 측에 서로 분리되어 제2 방향으로 연장된 제1 및 제2 데이터선;
    상기 게이트선과, 상기 제1 및 제2 데이터선에 각각 연결된 제1 및 제2 박막 트랜지스터; 및
    상기 각 화소 영역에 형성되고, 상기 제1 및 제2 박막 트랜지스터에 각각 연결된 제1 및 제2 부화소 전극을 포함하되,
    상기 다수의 화소 영역은 차례로 배열된 제1 및 제2 화소 영역을 포함하고, 상기 제2 화소 영역의 상기 제1 데이터선과, 상기 제1 화소 영역의 상기 제2 데이터선은 상기 제2 화소 영역의 상기 제1 박막 트랜지스터를 ㄷ자 형태로 둘러싸며 연장되는 액정 표시 장치.
  16. 제15 항에 있어서,
    상기 제2 화소 영역에는 블루 컬러 필터가 배치되고,
    상기 제1 화소 영역에는 그린 컬러 필터 또는 레드 컬러 필터가 배치되는 액정 표시 장치.
  17. 제16 항에 있어서,
    상기 다수의 컬러 필터는 상기 기판 상에 형성되는 액정 표시 장치.
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