KR20100020793A - Test socket for high-frequency semiconductor ic test - Google Patents
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Abstract
Description
본 발명은 반도체 테스트 소켓에 관한 것으로, 보다 상세하게는 RF(Radio Frequency) 반도체 소자 패키지의 전기적 특성 검사에 사용되는 고주파수용 반도체 테스트에 관한 것이다.BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to semiconductor test sockets, and more particularly, to high-frequency semiconductor tests used for inspecting electrical characteristics of radio frequency (RF) semiconductor device packages.
일반적으로 가공이 완료된 반도체 소자 패키지는 사용자에게 제공되기 전에 전기 검사 공정을 거치게 된다. 전기 검사 공정에서는 테스트 소켓을 이용하여 반도체 소자 패키지의 전기적 특성을 검사하게 된다.In general, the completed semiconductor device package undergoes an electrical inspection process before being provided to the user. In the electrical inspection process, a test socket is used to inspect electrical characteristics of a semiconductor device package.
종래에 QFN, MLF, LGA, BGA 형태를 가진 반도체 소자를 테스트하기 위한 테스트 소켓에는 스프링 프로브(포고핀) 방식, 판재핀(Stamping Pin) 방식, 및 가압전도 실리콘 고무(Pressure Sensitive Conductive Rubber : PCR) 방식 등이 있었다. RF(Radio Frequency) 반도체 소자와 같이 고주파에서의 테스트가 요구되는 경우에는 전기적 경로를 최소화해야 할 필요가 있으므로 짧은 스프링 프로브를 사용하거나 다양한 형상의 판재핀을 사용한 테스트 소켓들이 개발되어져 왔다. Conventionally, test sockets for testing semiconductor devices having QFN, MLF, LGA, and BGA types include spring probe (pogo pin), plate pin (Stamping pin), and pressure sensitive conductive rubber (PCR). There was a way. When testing at high frequencies, such as RF (radio frequency) semiconductor devices, is required to minimize the electrical path, test sockets using short spring probes or plate pins of various shapes have been developed.
최근에는 짧은 도전 경로 구현 및 디바이스 볼에 데미지를 최소화 할 수 있다는 정 점 때문에 실리콘 고무를 탄성체로 한 가압전도 실리콘 고무 방식의 사용이 점차 확산되어 가고 있으나, RF 반도체 소자의 테스트용으로 사용되기에는 최대 허용 전류가 1A 이하로 작다는 문제가 있다. 또한, 고주파수 테스트 시 노이즈와 크로스토크가 발생하는 문제가 있다.Recently, due to the fact that the short conductive path and the damage to the device ball can be minimized, the use of the pressure-conducting silicone rubber method using the silicone rubber as an elastomer has gradually spread, but it is the largest to be used for the test of the RF semiconductor device. There is a problem that the allowable current is small below 1A. In addition, there is a problem that noise and crosstalk occurs during the high frequency test.
본 발명은 상기와 같은 문제점을 해결하기 위하여 안출된 것으로서, 반도체 소자와 테스트 기판 간의 전기적 경로를 최소화하고, 고주파수용 반도체 소자의 테스트시 요구되는 허용 전류를 최대화할 수 있는 반도체 테스트 소켓을 제공하는데 그 목적이 있다.The present invention has been made to solve the above problems, to provide a semiconductor test socket that can minimize the electrical path between the semiconductor device and the test substrate, and can maximize the allowable current required for testing the high frequency semiconductor device. There is a purpose.
본 발명의 다른 목적은 고주파수용 반도체 소자 테스트시 노이즈와 크로스 토크를 최소화할 수 있는 반도체 테스트 소켓을 제공하는데 있다.Another object of the present invention is to provide a semiconductor test socket capable of minimizing noise and cross talk during high frequency semiconductor device testing.
본 발명의 목적들은 이상에서 언급한 목적들로 제한되지 않으며, 언급되지 않은 또 다른 목적들은 아래의 기재로부터 당업자에게 명확하게 이해되어질 수 있을 것이다.The objects of the present invention are not limited to the above-mentioned objects, and other objects not mentioned can be clearly understood by those skilled in the art from the following description.
상기 목적을 달성하기 위한 본 발명의 일 실시예에 따른 반도체 테스트 소켓은, 실리콘 고무로 구성되는 소켓 몸체, 및 상기 소켓 몸체에 구비되며, 반도체 소자의 리드단자와 테스트 기판의 테스트단자 사이에 전기적 흐름이 가능하도록 적어도 하나의 금속부재에 의해 도전 경로를 형성하는 도전경로형성부를 포함한다.A semiconductor test socket according to an embodiment of the present invention for achieving the above object is provided in the socket body made of silicon rubber, and the socket body, the electrical flow between the lead terminal of the semiconductor device and the test terminal of the test substrate A conductive path forming portion for forming a conductive path by at least one metal member to enable this.
또한, 상기 도전경로형성부는, 상기 소켓 몸체의 상부에 적어도 하나 형성되며, 상기 리드단자와 전기적으로 접촉하는 제 1 접촉부, 상기 제 1 접촉부와 상호 대응되도록 상기 소켓 몸체의 하부에 적어도 하나 형성되며, 상기 테스트단자와 전기적으로 접촉하는 제 2 접촉부, 및 상기 제 1 접촉부와 상기 제 2 접촉부를 전기 적으로 연결하는 금속부재를 포함한다.In addition, the conductive path forming unit is formed on at least one upper portion of the socket body, at least one first contact portion in electrical contact with the lead terminal, at least one lower portion of the socket body to correspond to the first contact portion, And a second contact portion in electrical contact with the test terminal, and a metal member electrically connecting the first contact portion and the second contact portion.
또한, 상기 금속부재는 금속선 또는 금속판재인 것이 바람직하다.In addition, the metal member is preferably a metal wire or a metal plate material.
또한, 상기 소켓 몸체에는 상기 금속부재가 삽입되는 적어도 하나의 관통홀이 형성되는 것이 바람직하다.In addition, the socket body is preferably formed with at least one through-hole in which the metal member is inserted.
또한, 상기 관통홀과 상기 금속부재 사이에는 상기 실리콘 고무가 충진되는 것이 바람직하다.In addition, the silicon rubber is preferably filled between the through hole and the metal member.
또한, 상기 소켓 몸체의 상부면에서 상기 제 1 접촉부가 형성되지 않은 영역에 제 1 절연체가 피복되는 것이 바람직하다.In addition, it is preferable that a first insulator is coated on an area of the upper surface of the socket body where the first contact portion is not formed.
또한, 상기 소켓 몸체의 하부면에서 상기 제 2 접촉부가 형성되지 않은 영역에 제 2 절연체가 피복되는 것이 바람직하다.In addition, it is preferable that a second insulator is coated on an area of the lower surface of the socket body where the second contact portion is not formed.
또한, 상기 제 1 접촉부는 상부가 상기 제 1 절연체 보다 돌출되는 것이 바람직하다.In addition, it is preferable that the first contact portion protrude above the first insulator.
또한, 상기 제 2 접촉부는 하부가 상기 제 2 절연체 보다 돌출되는 것이 바람직하다.In addition, the lower portion of the second contact portion preferably protrudes from the second insulator.
또한, 상기 제 1 접촉부의 상부에는 니켈을 포함한 도전성 도금층이 형성되는 것이 바람직하다. In addition, it is preferable that a conductive plating layer including nickel is formed on the first contact portion.
또한, 상기 도전성(니켈) 도금층은 다수의 금속(니켈)볼을 포함하는 것이 바람직하다.In addition, the conductive (nickel) plating layer preferably includes a plurality of metal (nickel) balls.
또한, 본 발명의 일 실시 예에 따른 반도체 테스트 소켓은, 상기 금속부재의 접지를 위해 상기 소켓 몸체에 구비되는 차폐부를 더 포함하는 것이 바람직하다. In addition, the semiconductor test socket according to an embodiment of the present invention, preferably further comprises a shield provided on the socket body for the ground of the metal member.
또한, 상기 차폐부는 상기 금속부재에 대하여 수직하게 배치되도록 상기 소켓 몸체에 삽입되는 접지판인 것이 바람직하다.In addition, the shield is preferably a ground plate which is inserted into the socket body to be disposed perpendicular to the metal member.
또한, 상기 접지판에는 상기 금속부재와 대응하는 위치에 적어도 하나의 접지홀이 형성되는 것이 바람직하다.In addition, the ground plate is preferably formed with at least one ground hole in a position corresponding to the metal member.
또한, 상기 접지판은 상기 금속부재의 주위에 형성되는 접지선과 전기적으로 연결되는 것이 바람직하다.In addition, the ground plate is preferably electrically connected to a ground wire formed around the metal member.
상기 목적을 달성하기 위한 본 발명의 다른 실시 예에 따른 반도체 테스트 소켓은, 실리콘으로 구성되는 적어도 하나의 탄성체, 상기 탄성체에 삽입되며 반도체 소자의 리드단자와 소켓 기판의 테스트단자 사이에 전기적 흐름이 가능하도록 도전 경로를 형성하는 제 1 도전체, 및 상기 탄성체가 삽입되는 홀이 적어도 하나 형성되며 상기 제 1 도전체의 접지를 형성하는 제 2 도전체를 포함한다. The semiconductor test socket according to another embodiment of the present invention for achieving the above object, at least one elastic body made of silicon, is inserted into the elastic body is capable of electrical flow between the lead terminal of the semiconductor device and the test terminal of the socket substrate And a second conductor forming a conductive path so that at least one hole into which the elastic body is inserted is formed and forming a ground of the first conductor.
또한, 상기 제 1 도전체는 상단부에 상기 리드단자와 전기적으로 접촉하는 제 1 접촉부가 구비되고, 하단부에 상기 테스트단자와 전기적으로 접촉하는 제 2 접촉부가 구비되는 것이 바람직하다.The first conductor may include a first contact portion in electrical contact with the lead terminal at an upper end thereof, and a second contact portion in electrical contact with the test terminal at a lower end thereof.
또한, 본 발명의 다른 실시예에 따른 반도체 테스트 소켓은, 상기 제 1 접촉부가 형성되지 않은 상기 탄성체 및 상기 제 2 도전체의 상부 영역에 도포되는 제 1 절연체, 및 상기 제 2 접촉부가 형성되지 않은 상기 탄성체 및 상기 제 2 도전체의 하부 영역에 도포되는 제 2 절연체를 더 포함하는 것이 바람직하다.In addition, the semiconductor test socket according to another exemplary embodiment of the present invention may include a first insulator applied to an upper region of the elastic body and the second conductor in which the first contact part is not formed, and the second contact part is not formed. It is preferable to further include a second insulator applied to the elastic region and the lower region of the second conductor.
또한, 상기 제 1 도전체는 금속선 또는 금속판재인 것이 바람직하다.In addition, the first conductor is preferably a metal wire or a metal sheet.
기타 실시예들의 구체적인 사항들은 상세한 설명 및 도면들에 포함되어 있 다.Specific details of other embodiments are included in the detailed description and drawings.
상기한 바와 같은 본 발명의 반도체 테스트 소켓 및 그 제조 방법에 따르면 다음과 같은 효과가 하나 혹은 그 이상 있다.According to the semiconductor test socket and the manufacturing method of the present invention as described above has one or more of the following effects.
첫째, 탄성을 갖는 실리콘 고무로 테스트 소켓의 몸체를 구성하고 금속선 또는 금속판재를 도전 경로로 사용함으로써, 반도체 소자와 소켓 기판 간의 전기적 경로를 최소화할 수 있으며, 고주파수용 반도체 소자의 테스트시 요구되는 최대 허용전류인 3~5A를 제공하며 이론적으로는 40A 이상도 제공할 수 있다.First, by constructing the body of the test socket with elastic silicone rubber and using a metal wire or metal plate as a conductive path, it is possible to minimize the electrical path between the semiconductor device and the socket substrate, the maximum required for testing high-frequency semiconductor devices It provides 3 ~ 5A of allowable current and can theoretically provide more than 40A.
둘째, 테스트 소켓의 몸체에 접지판을 구비하고 각각의 신호라인 외부에 접지 처리함으로써, 고주파수용 반도체 소자 테스트시 노이즈와 크로스 토크를 최소화할 수 있다.Second, by providing a ground plate on the body of the test socket and grounding outside of each signal line, noise and crosstalk can be minimized when testing a high frequency semiconductor device.
본 발명의 효과들은 이상에서 언급한 효과들로 제한되지 않으며, 언급되지 않은 또 다른 효과들은 청구범위의 기재로부터 당업자에게 명확하게 이해될 수 있을 것이다.The effects of the present invention are not limited to the above-mentioned effects, and other effects not mentioned will be clearly understood by those skilled in the art from the description of the claims.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시 예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 수 있으며, 단지 본 실시예들은 본 발명의 개시가 완전하도록 하고, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자에게 발명의 범주를 완전하 게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성요소를 지칭한다.Advantages and features of the present invention, and methods for achieving them will be apparent with reference to the embodiments described below in detail in conjunction with the accompanying drawings. However, the present invention is not limited to the embodiments disclosed below, but can be implemented in various different forms, only the embodiments are to make the disclosure of the present invention complete, and the general knowledge in the art to which the present invention belongs It is provided to fully convey the scope of the invention to those skilled in the art, and the present invention is defined only by the scope of the claims. Like reference numerals refer to like elements throughout.
이하, 첨부된 도면을 참조하여 본 발명의 바람직한 실시예에 따른 반도체 테스트 소켓 및 그 제조 방법을 상세히 설명하기로 한다. 참고로 본 발명을 설명함에 있어서 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우 그 상세한 설명을 생략한다.Hereinafter, a semiconductor test socket and a method of manufacturing the same according to a preferred embodiment of the present invention will be described in detail with reference to the accompanying drawings. For reference, in the following description of the present invention, if it is determined that a detailed description of related known functions or configurations may unnecessarily obscure the subject matter of the present invention, the detailed description thereof will be omitted.
도 1은 본 발명의 일 실시예에 따른 반도체 테스트 소켓을 개략적으로 도시한 단면도이고, 도 2 및 도 3은 반도체 테스트 소켓의 평면도이고, 도 4 및 도 5는 도 1에 나타낸 금속부재의 사시도이며, 도 6은 도 1의 'A' 부분에 대한 확대 단면도이다.1 is a cross-sectional view schematically showing a semiconductor test socket according to an embodiment of the present invention, FIGS. 2 and 3 are plan views of a semiconductor test socket, and FIGS. 4 and 5 are perspective views of the metal member shown in FIG. 1. 6 is an enlarged cross-sectional view of a portion 'A' of FIG. 1.
도 1 내지 도 6에 도시된 바와 같이, 본 발명의 일 실시예에 따른 반도체 테스트 소켓(100)은 소켓 몸체(110), 도전경로형성부(120) 및 차폐부(130) 등을 포함한다.As illustrated in FIGS. 1 to 6, the
소켓 몸체(110)는 단면이 사각형 또는 원형(미도시)인 블록체의 형태로 형성되며, 탄성체로 구성되며, 실리콘 고무로 구성될 수 있다.The
소켓 몸체(110)에는 후술할 금속부재(123)가 삽입되는 관통홀(111)이 상하방향으로 적어도 하나 형성된다. 예를 들어, 관통홀(111)은 원형(도 2 참조) 또는 사각형(도 3 참조)의 단면을 가지며, 반도체 소자(10)의 리드단자(11)들과 대응되도록 소켓 몸체(110)의 가장자리를 따라 대향면에 대하여 서로 대칭되게 다수 개로 형성될 수 있다.The
본 실시예에서는 관통홀(111)과 금속부재(123) 사이를 소정의 탄성을 가지고, 전기적으로 부도체의 성질을 가진 탄성체로 매립할 수 있다. 다만, 실시의 형태에 따라서, 관통홀(111)과 금속부재(123) 사이를 빈공간으로 남겨둘수도 있다.In this embodiment, the through-
소켓 몸체(110)의 상부면에는 후술할 제 1 접촉부(121)가 형성되지 않은 영역에 제 1 절연체(141)가 균일하게 피복되고, 소켓 몸체(110)의 하부면에는 제 2 접촉부(122)가 형성되지 않은 영역에 제 2 절연체(142)가 균일하게 피복되어 형성된다. 제 1 절연체(141) 및 제 2 절연체(142)는 테프론 필름 또는 폴리이미드 필름 등과 같은 절연성 필름 형태로 구성될 수 있다. 예컨대, 상기 제 1 절연체(141)에 홀을 형성하고, 홀 상에 제 1 접촉부(121)가 형성될 수 있다. 또한, 제 2 절연체(142)에 홀이 형성되고, 형성된 홀에 제 2 접촉부(122)가 형성되는 기술적 구성이 선택될 수 있다.The
도전경로형성부(120)는 소켓 몸체(110)에 구비되며, 반도체 소자(10)의 리드단자(11)와 테스트 기판(20)의 테스트단자(21) 사이에 전기적 흐름이 가능하도록 적어도 하나의 금속부재(123)에 의해 도전 경로를 형성한다.The conductive
도전경로형성부(120)는 제 1 접촉부(121), 제 2 접촉부(122) 및 금속부재(123) 등을 구비할 수 있다.The conductive
제 1 접촉부(121)는 소켓 몸체(110)의 관통홀(111)의 상부에 형성되며, 반도체 소자(10)의 전기적 특성 검사시 리드단자(11)와 전기적으로 접촉된다. The
제 1 접촉부(121)는 상부가 제 1 절연체(141) 보다 돌출되는 것이 바람직하다.Preferably, the
제 1 접촉부(121)는 관통홀(111)의 상부 내주면에 도포되는 동박층(121a)과, 동박층(121a)을 감싸는 형태로 도포되는 도금층(121b)과, 도금층(121b)의 상부면에 돌출되게 도포되며 금속(니켈)을 주성분으로 하는 다수의 미세 볼을 함유하는 금속(니켈)층(121c)을 구비할 수 있다. 여기서, 금속층(121c)은 하부에 자석을 위치한 상태에서 도금층(121b)의 상부면에 니켈을 주성분으로 하는 다수의 미세 볼을 도포하고 그 표면을 코팅처리하여 형성할 수 있다.The
제 2 접촉부(122)는 제 1 접촉부(121)와 상호 대응되도록 소켓 몸체(110)의 관통홀(111)의 하부에 형성되며, 반도체 소자(10)의 전기적 특성 검사시 테스트단자(21)와 전기적으로 접촉된다. 제 2 접촉부(122)는 하부가 제 2 절연체(142) 보다 5 ~ 100 mm 정도 돌출되는 것이 바람직하다. 예컨대, 제 2 접촉부(122)는 제 1 접촉부(121)와 동일한 기술적 구성을 가질 수도 있다. 다만, 제 2 접촉부(122)에서 각각의 부재들이 돌출되는 방향은 테스트단자(21)와 접촉이 용이하도록 구성됨이 바람직하다.The
금속부재(123)는 각각의 관통홀(111)에 삽입되어 상하방향으로 배치되며, 제 1 접촉부(121)와 제 2 접촉부(122)를 전기적으로 연결한다. 보다 상세하게는, 금속부재(123)는 상단부가 제 1 접촉부(121)의 도금층(121b) 및 니켈층(121c)에 접합되고, 하단부가 제 2 접촉부(122)에 접합된다. The
금속부재(123)는 관통홀(111)의 내경 보다 작은 두께를 가지며, 바람직하게는 15 ~ 500 mm의 두께로 형성된다.The
금속부재(123)는 양단부가 제 1 접촉부(121) 및 제 2 접촉부(122)와 연결되 므로 소켓 몸체(110)의 높이보다 길이가 길게 형성되는 것이 바람직하다. Since both ends of the
금속부재(123)는 Cu, BeCu, Ag 또는 Au 등과 같이 연성 및 인장이 우수한 어떠한 금속재질 또는 합금재질 등으로 구성될 수 있다. 이에 따라 테스트시 요구되는 최대 허용전류 값을 10A 이상 제공할 수 있다.The
금속부재(123)는 다양한 형상으로 형성될 수 있으며, 바람직하게는 단면이 직사각형인 금속판재(123a)(도 4 참조) 또는 단면이 원형인 금속선(123b)(도 5 참조) 형태로 구성될 수 있다. 금속부재(123)가 직사각형인 금속판재(123a)인 경우에는 금속판재(123a)가 소켓 몸체(110)의 측면에 대하여 평행하게 배치되거나(도 2, 3 참조) 임의의 각도를 가지고 배치될 수 있다(미도시).The
차폐부(130)는 금속부재(123)의 외곽을 감싸는 형상으로 구비된다. 차폐부(130)는 전기적으로 접지처리되며, 금속부재(123)를 외부로부터 차단하는 역할을 수행한다. 즉, 전송선로인 금속부재(123)의 외곽을 감싸는 구성을 통해, 외부로부터 전달되는 전자기파를 차폐한다. 상술한 바와 같이 고주파 신호를 전달하는 금속부재(123)는 높은 주파수 대역에서 외부 전자기파에 매우 민감한 특성을 가진다. 즉, 높은 주파수의 테스트 신호가 인가되거나, 리드 단자(11)로부터 높은 주파수의 신호가 금속부재(123)로 전달되는데, 차폐부(130)는 전자기파의 차폐를 통해 노이즈에 의한 외란을 최소화한다. The
차폐부(130)는 금속부재(123)에 대하여 수직하게 배치되도록 소켓 몸체(110)의 대략 중간부위에 수평방향으로 삽입되는 접지판으로 구성될 수 있다.The shielding
도 7은 도1의 차폐부를 접지판으로 나타낸 평면도이고, 도 8은 접지판에 적 용되는 접지 구조의 일 예를 도시한 예시도이다.FIG. 7 is a plan view illustrating the shield of FIG. 1 as a ground plate, and FIG. 8 is an exemplary view showing an example of a ground structure applied to the ground plate.
도 7 및 도 8에 도시된 바와 같이, 접지판(131)은 소켓 몸체(110)와 동일한 단면, 예컨대 사각형 또는 원형(미도시)의 단면으로 형성된다. 접지판(131)은 SUS(Steel Use stainless)나, BeCu 같은 금속재질로 구성되는 것이 바람직하다.As shown in FIGS. 7 and 8, the
접지판(131)에는 관통홀(111)과 대응하는 위치에 적어도 하나의 접지홀(133)이 형성된다. 보다 상세하게는 접지홀(133)은 접지판(131)의 가장자리를 따라 대향면에 대하여 서로 대칭되게 다수 개로 형성될 수 있다. 접지홀(133)은 관통홀(111)의 형상과 동일하게 사각형 또는 원형(미도시)의 형상을 가지며, 관통홀(111)을 충분히 수용할 수 있도록 관통홀(111) 보다 크게 형성되는 것이 바람직하다. 또한, 상기 접지홀(133)과 관통홀(111) 사이의 이격공간에는 소켓 몸체를 구성하는 절연성 탄성부재로 충진된다.At least one
도면에는 도시된 바 없지만, 접지판(131)은 소켓 몸체(110)의 외각으로 확장되어 소켓 하우징에 연결된다.Although not shown in the drawing, the
이하, 도 9를 참조하여, 본 발명의 일 실시예에 따른 반도체 테스트 소켓의 작동 상태를 구체적으로 설명한다.Hereinafter, an operating state of a semiconductor test socket according to an exemplary embodiment of the present invention will be described in detail with reference to FIG. 9.
도 9는 본 발명의 일 실시예에 따른 반도체 테스트 소켓의 작동 상태를 도시한 단면도이다.9 is a cross-sectional view illustrating an operating state of a semiconductor test socket according to an exemplary embodiment of the present invention.
본 발명의 반도체 테스트 소켓은 반도체 소자의 제조 공정이 끝난 후 고주파수용 반도체 소자의 전기적 특성을 검사하는데 사용하게 된다The semiconductor test socket of the present invention is used to inspect the electrical characteristics of the semiconductor device for high frequency after the manufacturing process of the semiconductor device
보다 상세하게는, 도 9에 도시된 바와 같이, 반도체 테스트 소켓(100) 위에 고주파수용 반도체 소자(10)를 안착시키면 반도체 소자(10)의 리드단자(11)들이 소켓 몸체(110)의 상부에 형성된 제 1 접촉부(121)들과 각각 접촉하게 된다. More specifically, as shown in FIG. 9, when the high
그 상태에서 반도체 소자를 하방으로 더 눌러주면, 테스트 소켓(100)이 하방으로 내려가고 소켓 몸체(110)의 하부에 형성된 제 2 접촉부(122)들이 소켓 기판(20)의 테스트단자(21)들과 각각 접촉하게 된다. 이때, 실리콘 고무로 구성된 소켓 몸체(110)는 반도체 소자(10) 및 소켓 기판(20)과 접촉시 상대에 대하여 소정의 탄성을 부여하게 된다.When the semiconductor device is pressed further downward in this state, the
제 1 접촉부(121)와 제 2 접촉부(122)는 소켓 몸체(110)의 관통홀(111)에 삽입된 금속판재(123a) 또는 금속선(123b) 등과 같은 도전성 금속부재(123)로 연결되므로, 금속부재(123)를 통해 반도체 소자(10)의 리드단자(11)와 소켓 기판(20)의 테스트단자(21) 사이에 전기적 흐름이 가능하게 되어 고주파수용 반도체 소자의 전기적 특성을 검사할 수 있다.Since the
본 발명은 금속판재(123a) 또는 금속선(123b)을 도전 경로로 사용함으로써, 고주파수용 반도체 소자(10)와 소켓 기판(20) 간의 전기적 경로를 최소화하고, 고주파수용 반도체 소자의 테스트시 요구되는 최대 허용전류 값을 10A 이상으로 제공할 수 있다.The present invention minimizes the electrical path between the high
또한, 소켓 몸체(110)에 접지판(131)을 구비하고 각각의 신호라인 외부에 접지 처리하여 고주파수용 반도체 소자 테스트시 노이즈와 크로스 토크를 최소화할 수 있다. 이에 따라 고주파수용 반도체 테스트의 경우 종래의 포고핀이나 판재핀 대비 월등한 주파수 대역을 확보할 수 있다.In addition, the
도 10은 본 발명의 다른 실시예에 따른 반도체 테스트 소켓을 개략적으로 도시한 단면도이다.10 is a schematic cross-sectional view of a semiconductor test socket according to another exemplary embodiment of the present invention.
도 10에 도시된 바와 같이, 본 발명의 다른 실시예에 따른 반도체 테스트 소켓(200)은 탄성체(210), 제 1 도전체(220), 제 2 도전체(230), 제 1 절연체(240) 및 제 2 절연체(250)를 가진다.As shown in FIG. 10, the
상기 도 10에서, 제 1 도전체(220)가 삽입되는 탄성체(210)를 제외한 테스트 소켓의 몸체 대부분의 영역을 접지신호 처리를 위한 제 2 도전체(230)로 구성하는 것을 제외하고는 도 1 내지 도 9를 참조하여 설명한 본 발명의 일 실시예와 동일하다. 따라서, 상기 일 실시 예와 동일한 구성 및 작용에 대해서는 상세한 설명은 생략한다.In FIG. 10, except for configuring the majority of the body of the test socket except for the
탄성체(210)는 소정의 탄성을 갖는 실리콘 고무로 구성되며, 원형 또는 사각형의 단면을 가진다.The
제 1 도전체(220)는 탄성체(210)에 삽입되며, 반도체 소자(10)의 리드단자(11)와 소켓 기판(20)의 테스트단자(21) 사이에 전기적 흐름이 가능하도록 도전 경로를 형성한다.The
제 1 도전체(220)는 다양한 형상으로 형성될 수 있으며, 바람직하게는 단면이 직사각형인 금속판재(도 4 참조) 또는 단면이 원형인 금속선(도 5 참조) 형태로 구성될 수 있다. The
제 1 도전체(220)는 상단부에 리드단자(11)와 전기적으로 접촉하는 제 1 접촉부(221)가 구비되고, 하단부에 테스트단자(21)와 전기적으로 접촉하는 제 2 접촉 부(222)가 구비된다.The
제 1 접촉부(221)는 상기 일 실시예에서 도 6을 참조하여 설명한 바와 같이, 후술할 제 1 절연체(240)에 형성되는 홀의 주변 상하면에 각각 도포되는 동박층(121a)과, 동박층(121a)을 감싸는 형태로 도포되는 도금층(121b)과, 도금층(121b)의 상부면에 도포되며 니켈을 주성분으로 하는 다수의 미세 볼을 함유하는 금속(니켈)층(121c)을 구비할 수 있다. 도면에는 도시된 바 없지만, 제 2 접촉부(222)도 제 1 접촉부(221)의 구성요소와 동일하게 형성되는 것이 바람직하다.As described with reference to FIG. 6 in the above embodiment, the
제 2 도전체(230)는 탄성체(210)가 삽입되는 홀(231)이 상하방향으로 적어도 하나 형성된다. 예를 들어, 홀(231)은 원형 또는 사각형의 단면을 가지며, 반도체 소자(10)의 리드단자(11)들과 대응되도록 가장자리를 따라 대향면에 대하여 서로 대칭되게 다수 개로 형성될 수 있다.The
제 2 도전체(230)는 두께가 0.5 ~ 6 mm로 형성되고, SUS(Steel Use stainless) 또는 BeCu 와 같은 금속재질로 구성되는 것이 바람직하다.The
제 1 절연체(240)는 제 1 접촉부(221)가 형성되지 않은 탄성체(210) 및 제 2 도전체(230)의 상부 영역에 도포되고, 제 2 절연체(250)는 제 2 접촉부(222)가 형성되지 않은 탄성체(210) 및 제 2 도전체(230)의 하부 영역에 절연성 필름 형태로 도포된다.The
결국, 도 1 내지 도 10의 구성은 고주파 신호를 전달하는 도체의 외곽에 도전체가 형성되고, 형성된 도전체는 접지 처리되는 구성을 가진다. 따라서, 도체를 통해 전달되는 고주파 신호를 외부로부터 차폐함으로써, 전송선로가 외부로부터 받 는 영향을 최소화할 수 있다.As a result, the configuration of FIGS. 1 to 10 has a configuration in which a conductor is formed outside the conductor that transmits a high frequency signal, and the formed conductor is grounded. Therefore, by shielding the high frequency signal transmitted through the conductor from the outside, it is possible to minimize the influence of the transmission line from the outside.
이상 첨부된 도면을 참조하여 본 발명의 실시 예를 설명하였지만, 본 발명이 속하는 기술분야에서 통상의 지식을 가진 자는 본 발명이 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다. 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 균등 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.Although embodiments of the present invention have been described above with reference to the accompanying drawings, those skilled in the art to which the present invention pertains may implement the present invention in other specific forms without changing the technical spirit or essential features thereof. I can understand that. Therefore, it should be understood that the embodiments described above are exemplary in all respects and not restrictive. The scope of the present invention is shown by the following claims rather than the above description, and all changes or modifications derived from the meaning and scope of the claims and their equivalents should be construed as being included in the scope of the present invention. do.
도 1은 본 발명의 일 실시예에 따른 반도체 테스트 소켓을 개략적으로 도시한 단면도이다.1 is a cross-sectional view schematically illustrating a semiconductor test socket according to an exemplary embodiment of the present invention.
도 2 및 도 3은 본 발명의 일 실시예에 따른 반도체 테스트 소켓의 평면도이다.2 and 3 are plan views of a semiconductor test socket according to an exemplary embodiment of the present invention.
도 4 및 도 5는 도 1에 나타낸 금속부재의 사시도이다.4 and 5 are perspective views of the metal member shown in FIG.
도 6은 도 1의 'A' 부분에 대한 확대 단면도이다.6 is an enlarged cross-sectional view of a portion 'A' of FIG. 1.
도 7은 도 1에 나타낸 접지판의 평면도이다.FIG. 7 is a plan view of the ground plate shown in FIG. 1. FIG.
도 8은 접지판에 적용되는 접지 구조의 일 예를 도시한 예시도이다.8 is an exemplary diagram illustrating an example of a ground structure applied to a ground plate.
도 9는 본 발명의 일 실시예에 따른 반도체 테스트 소켓의 작동 상태를 도시한 단면도이다.9 is a cross-sectional view illustrating an operating state of a semiconductor test socket according to an exemplary embodiment of the present invention.
도 10은 본 발명의 다른 실시예에 따른 반도체 테스트 소켓을 개략적으로 도시한 단면도이다.10 is a schematic cross-sectional view of a semiconductor test socket according to another exemplary embodiment of the present invention.
< 도면의 주요 부분에 대한 부호의 설명 ><Description of Symbols for Main Parts of Drawings>
100, 200 : 반도체 테스트 소켓 110 : 소켓 몸체 100, 200: semiconductor test socket 110: socket body
111 : 관통홀 120 : 도전경로형성부111: through hole 120: conductive path forming unit
121 : 제 1 접촉부 122 : 제 2 접촉부121: first contact portion 122: second contact portion
123 : 금속부재 130 : 차폐부123: metal member 130: shield
131 : 접지판 135 : 접지선131: ground plate 135: ground wire
141 : 제 1 절연체 142 : 제 2 절연체141: first insulator 142: second insulator
210 : 탄성체 220 : 제 1 도전체210: elastic body 220: first conductor
230 : 제 2 도전체230: second conductor
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