KR20070109296A - Driving liquid crystal display and apparatus for driving the same - Google Patents

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KR20070109296A
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신기택
권극상
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엘지.필립스 엘시디 주식회사
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Abstract

An LCD device and a driving method thereof are provided to prevent unbalance of charge amounts by removing brightness difference generated between odd-number and even-number horizontal lines. An LCD(Liquid Crystal Display) device includes a liquid crystal panel(64), a gate driver(63) and a data driver(62). The liquid crystal panel includes plural data and gate lines, which are formed to cross with each other, and plural liquid crystal cells. The gate driver supplies a first scan pulse to odd-number gate lines and a second scan pulse, which is partially overlapped with the first scan pulse, to even-number gate lines. The data driver supplies data, whose polarity is periodically converted according to a predetermined polarity conversion pattern, to the data lines. The predetermined polarity conversion pattern is shifted for every frame so as to equalize summation of charge times during successive two frame periods between adjacent liquid crystal cells.

Description

액정표시장치와 그 구동방법{DRIVING LIQUID CRYSTAL DISPLAY AND APPARATUS FOR DRIVING THE SAME}Liquid crystal display and its driving method {DRIVING LIQUID CRYSTAL DISPLAY AND APPARATUS FOR DRIVING THE SAME}

도 1은 1 도트 인버젼 방식에서 구동되는 액정패널의 데이터 극성을 개략적으로 나타내는 도면. 1 is a view schematically showing the data polarity of a liquid crystal panel driven in a one dot inversion scheme.

도 2는 2 도트 인버젼 방식에서 구동되는 액정패널의 데이터 극성을 개략적으로 나타내는 도면. FIG. 2 is a diagram schematically illustrating data polarity of a liquid crystal panel driven in a two dot inversion scheme. FIG.

도 3은 2 도트 인버젼 방식에서 프레임 단위로 쉬프트되는 액정패널의 데이터 극성을 나타내는 도면.3 is a diagram illustrating data polarity of a liquid crystal panel shifted in units of frames in a 2-dot inversion scheme;

도 4는 본 발명의 실시예에 따른 액정표시장치를 나타내는 블록도.4 is a block diagram illustrating a liquid crystal display according to an exemplary embodiment of the present invention.

도 5는 본 발명의 실시예에 따른 게이트 구동회로를 나타내는 블록도.5 is a block diagram illustrating a gate driving circuit according to an exemplary embodiment of the present invention.

도 6은 게이트 구동회로로부터 발생되는 스캔펄스의 파형도.6 is a waveform diagram of a scan pulse generated from a gate driving circuit.

도 7은 본 발명의 실시예에 따른 데이터 구동회로를 나타내는 블록도. 7 is a block diagram illustrating a data driving circuit according to an exemplary embodiment of the present invention.

도 8은 본 발명의 실시예에 따른 데이터 구동회로로 공급되는 프레임 단위로 쉬프트 되는 극성신호의 파형도.8 is a waveform diagram of a polarity signal shifted in units of frames supplied to a data driving circuit according to an exemplary embodiment of the present invention.

도 9는 본 발명의 실시예에 따른 프레임 단위로 1 수평기간씩 극성이 쉬프트되는 데이터 출력파형 및 오버랩 구동방식에 따라 1 수평기간씩 오버랩되는 게이트 출력파형을 도시한 도면.FIG. 9 illustrates a data output waveform in which polarity is shifted by one horizontal period in frame units and a gate output waveform overlapping by one horizontal period according to an overlap driving scheme according to an exemplary embodiment of the present invention.

도 10은 본 발명의 다른 실시예에 따른 데이터 구동회로로 공급되는 프레임 단위로 쉬프트 되는 극성신호의 파형도.10 is a waveform diagram of a polarity signal shifted in units of frames supplied to a data driving circuit according to another exemplary embodiment of the present invention.

도 11은 본 발명의 다른 실시예에 따른 프레임 단위로 1 수평기간씩 극성이 쉬프트되는 데이터 출력파형 및 오버랩 구동방식에 따라 1 수평기간씩 오버랩되는 게이트 출력파형을 도시한 도면.FIG. 11 illustrates a data output waveform whose polarity is shifted by one horizontal period in frame units and a gate output waveform which is overlapped by one horizontal period according to an overlap driving scheme according to another embodiment of the present invention.

< 도면의 주요 부분에 대한 부호의 설명 ><Description of Symbols for Main Parts of Drawings>

61 : 타이밍 콘트롤러 62 : 데이터 구동회로61: timing controller 62: data driving circuit

63 : 게이트 구동회로 64 : 액정패널63 gate driving circuit 64 liquid crystal panel

81 : 제1 래치 82 : 쉬프트 레지스터81: first latch 82: shift register

83 : 제2 래치 84 : 디지털-아날로그 변환기83: second latch 84: digital-to-analog converter

85 : 프리차지전압 공급부 86 : 버퍼85: precharge voltage supply unit 86: buffer

1011 내지 101n : 레벨 쉬프터1011 to 101n: level shifter

본 발명은 액정표시장치에 관한 것으로, 특히 오버랩 방식으로 구동되는 액정표시장치의 표시품질을 높이도록 한 액정표시장치와 그 구동방법에 관한 것이다. BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a liquid crystal display device, and more particularly, to a liquid crystal display device and a driving method thereof for improving display quality of a liquid crystal display device driven in an overlapping manner.

액정표시장치는 비디오신호에 따라 액정셀들의 광투과율을 조절하여 화상을 표시하게 된다. 액티브 매트릭스(Active Matrix) 타입의 액정표시장치는 액정셀마다 스위칭소자가 형성되어 동영상을 표시하기에 유리하다. 스위칭소자로는 주로 박막트랜지스터(Thin Film Transistor; 이하 "TFT"라 함)가 이용되고 있다. The liquid crystal display device displays an image by adjusting light transmittance of liquid crystal cells according to a video signal. In an active matrix type liquid crystal display, switching elements are formed in each liquid crystal cell, which is advantageous for displaying a moving image. As the switching device, a thin film transistor (hereinafter referred to as "TFT") is mainly used.

액정표시장치는 액정셀에 충전되는 데이터의 극성을 주기적으로 반전시킴으로써 플리커와 잔상을 줄이기 위한 인버젼 방식으로 구동되고 있다. 인버젼 방식으로는 수직라인 방향에서 인접한 액정셀들간 데이터의 극성을 반전시키는 라인 인버젼 방식, 수평라인 방향에서 인접한 액정셀들간 데이터의 극성을 반전시키는 컬럼 인버젼 방식, 수직라인 방향과 수평라인 방향에서 인접한 액정셀들간 데이터의 극성을 반전시키는 도트 인버젼 방식이 있다. 이러한 인버젼 방식 중에서 도트 인버젼 방식이 수직 및 수평방향에서 플리커가 거의 나타나지 않기 때문에 주로 선택되고 있다.The LCD is driven in an inversion manner to reduce flicker and afterimage by periodically inverting the polarity of data charged in the liquid crystal cell. The inversion method includes a line inversion method for inverting polarities of data between adjacent liquid crystal cells in a vertical line direction, a column inversion method for inverting polarities of data between adjacent liquid crystal cells in a horizontal line direction, a vertical line direction and a horizontal line direction. There is a dot inversion method of inverting the polarity of data between adjacent liquid crystal cells. Of these inversion methods, the dot inversion method is mainly selected because flicker hardly appears in the vertical and horizontal directions.

도트 인버젼 방식은 도 1과 같이 수직방향에서 인접하는 액정셀에 각각 공급되는 데이터의 극성이 상반됨과 아울러 수평방향에서 인접하는 액정셀에 각각 공급되는 데이터의 극성이 상반된다. 그리고 그 데이터의 극성은 매 프레임(Fn-1,Fn)마다 반전된다. 이러한 도트 인버젼 방식은 수직 및 수평방향 모두에서 플리커가 최소화되기 때문에 현재 액정표시장치에서 가장 많이 적용되고 있다. In the dot inversion scheme, as illustrated in FIG. 1, polarities of data supplied to adjacent liquid crystal cells in the vertical direction are opposite to each other, and polarities of data supplied to adjacent liquid crystal cells in the horizontal direction are opposite to each other. The polarity of the data is inverted every frame (Fn-1, Fn). The dot inversion method is most widely used in liquid crystal display devices because flicker is minimized in both the vertical and horizontal directions.

도 2의 도트 인버젼 방식은 수직방향에서 2 도트 단위로, 수평방향에서 1 도트 단위로 데이터의 극성을 반전시킨다. 도 2와 같은 수직 2 도트 인버젼 방식은 도 1과 같은 1 도트 인버젼 방식에 비하여 소비전력이 낮은 장점이 있다. 이러한 수직 2 도트 인버젼 방식에 따라 구동되는 종래의 액정표시장치는 2 수평기간(2H) 주기로 데이터라인들(미도시)에 공급되는 데이터전압의 극성을 반전시키고 그 데이터전압을 소스 출력 인에이블신호(Source Output Enable : SOE)에 따라 액정패널(미도시)의 데이터라인들에 공급하게 된다. The dot inversion scheme of FIG. 2 inverts the polarity of data in units of 2 dots in the vertical direction and in units of 1 dot in the horizontal direction. The vertical two-dot inversion method as shown in FIG. 2 has the advantage of lower power consumption than the one-dot inversion method as shown in FIG. The conventional liquid crystal display device driven according to the vertical two dot inversion scheme inverts the polarity of the data voltages supplied to the data lines (not shown) in two horizontal periods (2H) periods, and converts the data voltages into the source output enable signal. According to (Source Output Enable: SOE), data lines are supplied to data lines of a liquid crystal panel (not shown).

또한, 종래의 액정표시장치는 도 3에 도시된 극성신호(POL)에 따라 구동되어 매 프레임(Fn-1,Fn)마다 데이터의 극성을 반전시킨다. 도시된 바와 같이, 수직 2 도트 인버젼 방식을 취하는 경우 현재의 프레임(Nth Frame)은 그 이전 프레임(N-1th Frame)에 비하여 2 수평주기(2H) 만큼 극성신호가 위 또는 아래로(하나의 수직라인에서) 쉬프트 된 것으로 귀결된다.In addition, the conventional liquid crystal display device is driven according to the polarity signal POL shown in FIG. 3 to invert the polarity of data every frame Fn-1, Fn. As shown, when the vertical two-dot inversion method is used, the current frame (Nth Frame) has a polarity signal up or down by one horizontal period (2H) compared to the previous frame (N-1th Frame). On the vertical line).

그런데, 이러한 인버젼 방식에 따른 구동을 위해 종래 액정표시장치는 매 프레임마다 극성신호를 2 수평주기(2H) 만큼 위 또는 아래로 쉬프트 시킴으로써 기수번째 수평라인과 우수번째 수평라인간에 충전량의 불균형을 초래한다. 특히, 최근 회로 비용 절감 및 공정수 단축을 위해 게이트 구동회로를 액정패널의 유리기판상에 실장하는 GIP(Gate-Drive-Ic In Panel)방식의 경우 충전특성을 양호하게 하기 위해서는 충전시간을 늘려주어야 하는데, 이때 상기 충전량 불균형은 더욱 심화되어 라인간 휘도차의 증가로 이어지는 문제가 있다.However, in order to operate according to the inversion method, the conventional liquid crystal display device shifts the polarity signal up or down by 2 horizontal periods (2H) every frame, thereby causing an unbalance of charge between the odd and even horizontal lines. do. In particular, in the case of GIP (Gate-Drive-Ic In Panel) method in which the gate driving circuit is mounted on the glass substrate of the liquid crystal panel to reduce the circuit cost and the number of processes, the charging time should be increased to improve the charging characteristics. In this case, there is a problem that the charge amount imbalance is further deepened, leading to an increase in luminance difference between lines.

따라서, 본 발명의 목적은 액정표시장치의 표시품질을 높이도록 한 액정표시장치와 그 구동방법을 제공하는 데 있다. Accordingly, it is an object of the present invention to provide a liquid crystal display device and a driving method thereof to improve the display quality of the liquid crystal display device.

또한, 본 발명의 다른 목적은 오버랩 방식에 따라 구동되는 액정표시장치의 표시품질을 높이도록 한 액정표시장치와 그 구동방법을 제공하는 데 있다. In addition, another object of the present invention is to provide a liquid crystal display device and a driving method thereof to improve the display quality of the liquid crystal display device driven according to the overlap method.

상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 액정표시장치는 다수의 데이터라인들과 다수의 게이트라인들이 교차하고 다수의 액정셀들이 배치되는 액정패널과; 제1 스캔펄스를 기수 번째 게이트라인에 공급하고 상기 제1 스캔펄스와 일부 중첩되는 제2 스캔펄스를 우수 번째 게이트라인에 공급하는 게이트 구동회로와; 소정의 극성반전패턴을 따라 극성이 주기적으로 반전되는 데이터들을 상기 데이터라인들에 공급하는 데이터 구동회로를 구비하고; 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 상기 극성반전패턴은 프레임기간 단위로 쉬프트되는 것을 특징으로 한다.In order to achieve the above object, a liquid crystal display according to an embodiment of the present invention includes a liquid crystal panel in which a plurality of data lines and a plurality of gate lines intersect and a plurality of liquid crystal cells are disposed; A gate driving circuit configured to supply a first scan pulse to an odd gate line and a second scan pulse partially overlapping the first scan pulse to an even gate line; A data driving circuit for supplying data to the data lines whose polarities are periodically inverted along a predetermined polarity inversion pattern; The polarity inversion pattern is shifted in units of frame periods such that the sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells is the same.

상기 극성반전패턴은 2 수평기간을 주기로 극성이 반전되는 것을 특징으로 한다.The polarity inversion pattern is characterized in that the polarity is inverted every two horizontal periods.

상기 극성반전패턴은 한 프레임 주기로 1 수평기간만큼씩 쉬프트되는 것을 특징으로 한다.The polarity inversion pattern is shifted by one horizontal period in one frame period.

상기 제1 및 제2 스캔펄스는 각각 2 수평기간동안 하이논리 레벨을 유지하도록 발생되고, 상기 제2 스캔펄스는 1 수평기간만큼 상기 제1 스캔펄스와 중첩되도록 발생되는 것을 특징으로 한다.Each of the first and second scan pulses is generated to maintain a high logic level for two horizontal periods, and the second scan pulses are generated to overlap the first scan pulse by one horizontal period.

상기 데이터 구동회로는, 상기 제1 스캔펄스에 응답하여 n 번째 프레임의 기수번째 액정셀에는 1 수평기간 동안 데이터가 충전되도록 하고, 상기 제2 스캔펄스에 응답하여 n 번째 프레임의 우수번째 액정셀에는 2 수평기간 동안 데이터가 충전 되도록 하며; 상기 제1 스캔펄스에 응답하여 n+1 번째 프레임의 기수번째 액정셀에는 2 수평기간 동안 데이터가 충전되도록 하고, 상기 제2 스캔펄스에 응답하여 n+1 번째 프레임의 우수번째 액정셀에는 1 수평기간 동안 데이터가 충전되도록 하는 것을 특징으로 한다.The data driving circuit allows data to be filled in the odd-numbered liquid crystal cell of the n-th frame in response to the first scan pulse for one horizontal period, and in the even-numbered liquid crystal cell of the n-th frame in response to the second scan pulse. Allow data to be charged for two horizontal periods; Data is filled in the odd-numbered liquid crystal cell of the n + 1 th frame in response to the first scan pulse for two horizontal periods, and one horizontal in the even-numbered liquid crystal cell of the n + 1 th frame in response to the second scan pulse. Characterized in that data is charged for a period of time.

또한, 본 발명의 실시예에 따른 액정표시장치의 구동방벙은 제1 스캔펄스를 기수 번째 게이트라인에 공급하고 상기 제1 스캔펄스와 일부 중첩되는 제2 스캔펄스를 우수 번째 게이트라인에 공급하는 단계와; 소정의 극성반전패턴을 따라 극성이 주기적으로 반전되는 데이터들을 데이터라인들에 공급하는 단계를 구비하고;In addition, the driving method of the liquid crystal display according to the embodiment of the present invention is the step of supplying the first scan pulse to the odd gate line and the second scan pulse partially overlapping the first scan pulse to the even gate line Wow; Supplying data lines with data whose polarity is periodically inverted along a predetermined polarity inversion pattern;

상기 데이터들을 공급하는 단계에서 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 상기 극성반전패턴을 프레임기간 단위로 쉬프트시키는 것을 특징으로 한다.The polarity inversion pattern may be shifted in units of frame periods such that the sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells is equal in the supplying of data.

상기 데이터들을 공급하는 단계에서, 상기 데이터들의 극성을 2 수평기간을 주기로 반전시키는 것을 특징으로 한다.In the supplying of the data, the polarity of the data may be inverted every two horizontal periods.

상기 데이터들을 공급하는 단계에서, 상기 극성반전패턴을 한 프레임 주기로 1 수평기간만큼씩 쉬프트하는 것을 특징으로 한다.In the supplying of the data, the polarity inversion pattern is shifted by one horizontal period by one frame period.

상기 스캔펄스를 공급하는 단계에서,상기 제1 및 제2 스캔펄스를 각각 2 수평기간 동안 하이논리 레벨을 유지하고, 상기 제2 스캔펄스를 1 수평기간만큼 상기 제1 스캔펄스와 중첩시켜 공급하는 것을 특징으로 한다.In the supplying of the scan pulses, the first and second scan pulses are maintained at a high logic level for two horizontal periods, respectively, and the second scan pulses are supplied by overlapping the first scan pulses by one horizontal period. It is characterized by.

상기 데이터들을 공급하는 단계는, 상기 제1 스캔펄스에 응답하여 1 수평기간 동안 n 번째 프레임의 기수번째 액정셀에 데이터를 공급하고, 상기 제2 스캔펄 스에 응답하여 2 수평기간 동안 n 번째 프레임의 우수번째 액정셀에 데이터를 공급하는 제1 단계와; 상기 제1 스캔펄스에 응답하여 2 수평기간 동안 n+1 번째 프레임의 기수번째 액정셀에는 데이터를 공급하고, 상기 제2 스캔펄스에 응답하여 1 수평기간 동안 n+1 번째 프레임의 우수번째 액정셀에 데이터를 공급하는 제2 단계를 포함하는 것을 특징으로 한다.The supplying of data may include supplying data to an odd-numbered liquid crystal cell of an n-th frame for one horizontal period in response to the first scan pulse, and n-th frame for two horizontal periods in response to the second scan pulse. Supplying data to the even-numbered liquid crystal cell of the first step; Data is supplied to the odd-numbered liquid crystal cell of the n + 1 th frame in two horizontal periods in response to the first scan pulse, and the even-numbered liquid crystal cell of the n + 1 th frame in one horizontal period in response to the second scan pulse. And supplying data to the second step.

상기 목적 외에 본 발명의 다른 목적 및 이점들은 첨부한 도면들을 참조한 본 발명의 바람직한 실시예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.Other objects and advantages of the present invention in addition to the above object will become apparent from the description of the preferred embodiment of the present invention with reference to the accompanying drawings.

이하, 도 4 내지 도 11을 참조하여 본 발명의 바람직한 실시예에 대하여 설명하기로 한다.Hereinafter, exemplary embodiments of the present invention will be described with reference to FIGS. 4 to 11.

도 4는 본 발명의 실시예에 따른 액정표시장치의 블록도이다. 4 is a block diagram of a liquid crystal display according to an exemplary embodiment of the present invention.

도 4를 참조하면, 본 발명의 실시예에 따른 액정표시장치는 타이밍 콘트롤러(61)로부터의 제어신호(DDC)에 응답하여 2 도트 인버젼 방식으로 극성이 반전되는 데이터전압을 액정패널(64)의 데이터라인(D1 내지 Dm)에 공급하기 위한 데이터 구동회로(62)와, 타이밍 콘트롤러(61)로부터의 제어신호(GDC)에 응답하여 스캔펄스를 액정패널(64)의 게이트라인(G1 내지 Gn)에 공급하기 위한 게이트 구동회로(63)와, 데이터 구동회로(62) 및 게이트 구동회로(63)를 제어하기 위한 타이밍 콘트롤러(61)를 구비한다. Referring to FIG. 4, the liquid crystal display according to the exemplary embodiment of the present invention uses a data voltage whose polarity is reversed in a 2-dot inversion scheme in response to the control signal DDC from the timing controller 61. The scan pulse is supplied to the data driving circuit 62 for supplying the data lines D1 to Dm and the gate lines G1 to Gn of the liquid crystal panel 64 in response to the control signal GDC from the timing controller 61. ), And a timing controller 61 for controlling the data driving circuit 62 and the gate driving circuit 63.

액정패널(64)은 두 장의 유리기판 사이에 액정이 주입되며, 그 하부 유리기판 상에 데이터라인들(D1 내지 Dm)과 게이트라인들(G1 내지 Gn)이 상호 직교되도록 형성된다. 데이터라인들(D1 내지 Dm)과 게이트라인들(G1 내지 Gn)의 교차부에 형 성된 TFT는 게이트라인들(G1 내지 Gn)로부터의 스캔펄스에 응답하여 데이터라인들(D1 내지 Dm)상의 데이터를 액정셀(Clc)에 공급하게 된다. 이를 위하여 TFT의 게이트전극은 게이트라인(G1 내지 Gn)에 접속되며, 소스전극은 데이터라인(D1 내지 Dm)에 접속된다. TFT의 드레인전극은 액정셀(Clc)의 화소전극에 접속된다. 화소전극과 대향하는 공통전극에는 공통전압(Vcom)이 공급된다. Liquid crystal is injected between the two glass substrates, and the liquid crystal panel 64 is formed such that the data lines D1 to Dm and the gate lines G1 to Gn cross each other on the lower glass substrate. TFTs formed at the intersections of the data lines D1 to Dm and the gate lines G1 to Gn have data on the data lines D1 to Dm in response to scan pulses from the gate lines G1 to Gn. Is supplied to the liquid crystal cell Clc. For this purpose, the gate electrodes of the TFTs are connected to the gate lines G1 to Gn, and the source electrodes are connected to the data lines D1 to Dm. The drain electrode of the TFT is connected to the pixel electrode of the liquid crystal cell Clc. The common voltage Vcom is supplied to the common electrode facing the pixel electrode.

데이터 구동회로(62)는 타이밍 콘트롤러(61)로부터 입력되는 디지털 데이터(RGB)를 타이밍 콘트롤러(61)로부터 입력되는 제어신호(DDC)에 응답하여 액정패널(64)의 데이터라인들(D1 내지 Dm)에 공급하게 된다. 즉, 데이터 구동회로(62)는 타이밍 콘트롤러(61)로부터의 제어신호(DDC)에 포함된 극성제어신호(POL)에 따라 2 수평기간 동안 동일한 극성의 데이터를 발생한 후 데이터의 극성을 반전시키고, 수평으로 이웃한 데이터의 극성들을 서로 반전시킨다. 또한, 데이터 구동회로는(62)는 타이밍 콘트롤러(61)로부터의 제어신호(DDC)에 포함된 극성제어신호(POL)에 따라 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 상기 극성반전패턴을 프레임기간 단위로 쉬프트시킨다. 이러한 데이터 구동회로(62)에 대하여는 도 7 및 도 8을 결부하여 상세하게 설명하기로 한다.The data driving circuit 62 responds to the digital data RGB input from the timing controller 61 and the data lines D1 to Dm of the liquid crystal panel 64 in response to the control signal DDC input from the timing controller 61. ) Will be supplied. That is, the data driving circuit 62 generates data having the same polarity for two horizontal periods according to the polarity control signal POL included in the control signal DDC from the timing controller 61, and then reverses the polarity of the data. Inverts the polarities of horizontally neighboring data to each other. In addition, the data driving circuit 62 has a charging time for two consecutive frame periods between adjacent liquid crystal cells in accordance with the polarity control signal POL included in the control signal DDC from the timing controller 61. The polarity inversion pattern is shifted in units of frame periods so that the sum is equal. The data driving circuit 62 will be described in detail with reference to FIGS. 7 and 8.

게이트 구동회로(63)는 타이밍 콘트롤러(61)로부터의 제어신호(GDC)에 응답하여 게이트라인들(G1 내지 Gn)에 순차적으로 스캔펄스를 공급한다. 특히, 게이트 구동회로(63)는 제1 스캔펄스를 기수 번째 게이트라인에 공급하고, 제1 스캔펄스와 일부 중첩되는 제2 스캔펄스를 우수 번째 게이트라인에 공급하는 오버랩(Overlap) 구동 방식을 취한다. 이러한 게이트 구동회로(63)에 대하여는 도 5 및 도 6을 참조하여 상세하게 설명하기로 한다.The gate driving circuit 63 sequentially supplies scan pulses to the gate lines G1 to Gn in response to the control signal GDC from the timing controller 61. In particular, the gate driving circuit 63 takes an overlap driving method of supplying the first scan pulse to the odd-numbered gate line and supplying the second scan pulse partially overlapping the first scan pulse to the even-numbered gate line. do. The gate driving circuit 63 will be described in detail with reference to FIGS. 5 and 6.

타이밍 콘트롤러(61)는 수직/수평 동기신호(V,H)와 클럭(CLK)을 이용하여 게이트 구동회로(63)를 제어하기 위한 게이트 제어신호(GDC)와, 데이터 구동회로(622)를 제어하기 위한 데이터 제어신호(DDC)를 발생한다. 데이터 제어신호(DDC)는 소스 스타트 펄스(SSP), 소스 쉬프트 클럭(SSC), 소스 출력신호(SOE), 극성신호(POL) 등을 포함한다. 게이트 제어신호(GDC)는 게이트 쉬프트 클럭(GSC), 게이트 출력신호(GOE), 게이트스타트 펄스(GSP) 등을 포함한다. The timing controller 61 controls the gate control signal GDC for controlling the gate driving circuit 63 and the data driving circuit 622 by using the vertical / horizontal synchronization signals V and H and the clock CLK. A data control signal DDC is generated. The data control signal DDC includes a source start pulse SSP, a source shift clock SSC, a source output signal SOE, a polarity signal POL, and the like. The gate control signal GDC includes a gate shift clock GSC, a gate output signal GOE, a gate start pulse GSP, and the like.

도 5는 본 발명의 실시예에 따른 게이트 구동회로를 나타내는 블록도이고, 도 6은 게이트 구동회로로부터 발생되는 스캔펄스의 파형도이다.5 is a block diagram illustrating a gate driving circuit according to an exemplary embodiment of the present invention, and FIG. 6 is a waveform diagram of a scan pulse generated from the gate driving circuit.

도 5를 참조하면, 게이트 구동회로(63)는 다수의 스테이지(1001 내지 100n)를 가지는 쉬프트 레지스터(102)와, 쉬프트 레지스터(102)에 입력된 레벨 쉬프터(1011 내지 101n)를 구비한다. Referring to FIG. 5, the gate driving circuit 63 includes a shift register 102 having a plurality of stages 1001 to 100n, and level shifters 1011 to 101n input to the shift register 102.

쉬프트 레지스터(102)의 제1 스테이지(1001)는 타이밍 콘트롤러(61)로부터의 게이트 스타트 펄스(GSP)와 게이트 쉬프트 클럭(GSC)에 응답하여 스캔펄스를 발생한다. 그리고 제2 내지 제n 스테이지(1002 내지 100n)는 전단 게이트라인(G1 내지 Gn-1) 상의 전압을 게이트 스타트 펄스로서 입력받아 그 신호와 게이트 쉬프트 클럭(GSC)에 응답하여 스캔펄스를 순차적으로 발생한다. 이때, 각각의 스캔펄스는 2 수평기간 동안 하이논리 레벨을 유지하도록 발생되고, 기수 번째 게이트 라인에 공급되는 제1 스캔펄스와 우수 번째 게이트라인에 공급되는 제2 스캔펄스는 1 수평기 간 동안 오버랩(Overlap)된다. 이러한 오버랩 구동방식은 게이트 구동회로를 액정패널의 유리기판상에 실장하는 GIP(Gate-Drive-Ic In Panel)방식에서 충전특성을 양호하게 하기 위해 충전시간을 늘려주는 방편으로 많이 이용되고 있다.The first stage 1001 of the shift register 102 generates a scan pulse in response to the gate start pulse GSP and the gate shift clock GSC from the timing controller 61. The second to nth stages 1002 to 100n receive a voltage on the front gate lines G1 to Gn-1 as gate start pulses and sequentially generate scan pulses in response to the signal and the gate shift clock GSC. do. At this time, each scan pulse is generated to maintain a high logic level for two horizontal periods, and the first scan pulse supplied to the odd-numbered gate line and the second scan pulse supplied to the even-numbered gate line are overlapped for one horizontal period. Overlap). This overlap driving method is widely used as a method of increasing the charging time in order to improve the charging characteristics in the gate-drive-in panel (GIP) method in which the gate driving circuit is mounted on the glass substrate of the liquid crystal panel.

레벨 쉬프터(1011 내지 101n)는 쉬프트 레지스터(102)의 출력단자에 각각 접속되어 쉬프트 레지스터(102)의 각 출력신호의 스윙폭을 액정셀(Clc)의 구동에 스윙폭으로 변환한다. 이 레벨 쉬프터(1011 내지 101n)로부터 출력되는 스캔펄스는 Vgh와 Vgl의 두 전압레벨을 가지게 된다. 이 레벨 쉬프터(1011 내지 101n)와 게이트라인(G1 내지 Gn) 사이에는 버퍼가 설치될 수 있다. The level shifters 1011 to 101n are respectively connected to the output terminals of the shift register 102 to convert the swing width of each output signal of the shift register 102 into a swing width for driving the liquid crystal cell Clc. The scan pulses output from the level shifters 1011 to 101n have two voltage levels, Vgh and Vgl. A buffer may be provided between the level shifters 1011 to 101n and the gate lines G1 to Gn.

도 7은 본 발명의 실시예에 따른 데이터 구동회로를 나타내는 블록도이고, 도 8은 데이터 구동회로로 공급되는 프레임 단위로 쉬프트 되는 극성신호의 파형도이다.7 is a block diagram illustrating a data driving circuit according to an exemplary embodiment of the present invention, and FIG. 8 is a waveform diagram of a polarity signal shifted in units of frames supplied to the data driving circuit.

도 7을 참조하면, 데이터 구동회로(62)는 다수의 집적회로(IC)를 포함하며, 각각의 집적회로는 입력라인과 데이터라인 사이에 종속적으로 접속된 쉬프트 레지스터(82), 제1 래치(81), 제2 래치(83), 디지털-아날로그 변환기(Digital to Analog Convertor : 이하, "DAC"라 한다)(84), 프리차지전압 공급부(85) 및 버퍼(86)를 구비한다. Referring to FIG. 7, the data driving circuit 62 includes a plurality of integrated circuits (ICs), each integrated circuit including a shift register 82 and a first latch (13) connected in a dependent manner between an input line and a data line. 81, a second latch 83, a digital-to-analog converter (hereinafter referred to as "DAC") 84, a precharge voltage supply 85 and a buffer 86.

쉬프트 레지스터(82)는 타이밍 콘트롤러(61)로부터의 소스 스타트 펄스(SSP)를 소스 쉬프트 클럭신호(SSC)에 따라 쉬프트시켜 샘플링신호를 발생한다. 또한, 쉬프트 레지스터(82)는 소스 스타트 펄스(SSP)를 쉬프트시켜 다음 단의 쉬프트 레지스터(82)에 캐리신호(CAR)를 전달한다. The shift register 82 shifts the source start pulse SSP from the timing controller 61 in accordance with the source shift clock signal SSC to generate a sampling signal. In addition, the shift register 82 shifts the source start pulse SSP to transfer a carry signal CAR to the next stage shift register 82.

제1 래치(81)는 쉬프트 레지스터(82)로부터 입력되는 샘플링신호에 따라 디지털 데이터(RGB)를 샘플링하여 저장하고 저장된 디지털 데이터를 제2 래치(83)에 공급한다. The first latch 81 samples and stores the digital data RGB according to the sampling signal input from the shift register 82, and supplies the stored digital data to the second latch 83.

제2 래치(83)는 제1 래치(81)로부터 입력되는 데이터(EFD,RGB)를 래치한 다음, 타이밍 콘트롤러(61)로부터의 소스 출력 신호(SOE)에 응답하여 다른 집적회로 내의 제2 래치(83)와 함께 래치된 1 수평라인분의 디지털 데이터를 동시에 출력한다. The second latch 83 latches the data EFD and RGB input from the first latch 81 and then a second latch in another integrated circuit in response to the source output signal SOE from the timing controller 61. The digital data for one horizontal line latched together with 83 is simultaneously output.

DAC(84)는 제2 래치(83)로부터의 디지털 데이터(RGB)를 타이밍 콘트롤러(61)로부터의 극성신호(POL)에 따라 정극성 아날로그 데이터전압(VPG)이나 부극성 아날로그 데이터전압(VNG)으로 변환한다. DAC(84)는 타이밍 콘트롤러(61)로부터의 극성신호(POL)에 응답하여 수직 2 도트 인버젼 방식에 따라 2 수평기간 동안 동일한 극성의 데이터를 발생한 후 데이터의 극성을 반전시키고, 수평으로 이웃한 데이터의 극성들을 서로 반전시킨다. 또한, DAC(84)는 도 8에 도시된 바와 같이 타이밍 콘트롤러(61)로부터의 극성신호(POL), 즉 상기 극성반전패턴(수직 2 도트 인버젼 방식)을 매 프레임마다 1 수평기간씩 쉬프트 시켜 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 한다. The DAC 84 converts the digital data RGB from the second latch 83 to the positive analog data voltage VPG or the negative analog data voltage VNG according to the polarity signal POL from the timing controller 61. Convert to In response to the polarity signal POL from the timing controller 61, the DAC 84 generates data having the same polarity for two horizontal periods according to the vertical two-dot inversion scheme, and then reverses the polarity of the data and horizontally neighbors the data. Invert the polarities of the data. In addition, as shown in FIG. 8, the DAC 84 shifts the polarity signal POL from the timing controller 61, that is, the polarity inversion pattern (vertical two-dot inversion method) by one horizontal period every frame. The sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells is made equal.

프리차지전압 공급부(85)는 수직으로 동일한 극성이 연속되는 두 번째 액정셀(예를 들어, N-1번째 프레임에서는 우수 번째 액정셀, N번째 프레임에서는 기수 번째 액정셀)에 2 수평기간만큼 공급되는 스캔펄스 공급기간 중, 앞선 1 수평기간 동안 전단 액정셀에 공급되는 데이터를 프리차지 시킨다. 이에 따라, N-1 번째 프 레임에서는 우수 번째 액정셀들의 충전시간이 2 수평기간으로 늘어나게 되는 효과 가 있고, N 번째 프레임에서는 기수 번째 액정셀들의 충전시간이 2 수평기간으로 늘어나게 되는 효과가 있다. 결과적으로 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합은 동일하게 되어 GIP 방식에서의 충전특성은 양호하게 된다. The precharge voltage supply unit 85 supplies two horizontal periods to the second liquid crystal cell (eg, even-numbered liquid crystal cell in the N-1th frame and the odd-numbered liquid crystal cell in the Nth frame) having the same polarity. During the scan pulse supply period, the data supplied to the front end liquid crystal cell is precharged during the preceding one horizontal period. Accordingly, in the N-1th frame, the charging time of the even-numbered liquid crystal cells is increased to two horizontal periods, and in the N-th frame, the charging time of the odd-numbered liquid crystal cells is increased to two horizontal periods. As a result, the sum of the charging times during two consecutive frame periods between vertically neighboring liquid crystal cells becomes the same, and the charging characteristic in the GIP method is good.

버퍼(186)는 DAC(184)로부터 입력되는 아날로그 데이터전압(VPG,VNG)과 변조전압 공급부(85)로부터 입력되는 변조데이터 전압을 신호감쇠없이 데이터라인(D1 내지 Dm)으로 출력하는 역할을 한다.The buffer 186 outputs the analog data voltages VPG and VNG input from the DAC 184 and the modulated data voltages input from the modulation voltage supply unit 85 to the data lines D1 to Dm without signal attenuation. .

도 7에 있어서, 도면부호 'R'은 데이터 구동회로(62)의 출력단과 데이터라인(D1 내지 Dm) 사이의 선저항이다.In Fig. 7, reference numeral 'R' denotes a line resistance between the output terminal of the data driving circuit 62 and the data lines D1 to Dm.

도 9는 본 발명의 실시예에 따른 프레임 단위로 1 수평기간씩 극성이 쉬프트되는 데이터 출력파형 및 오버랩 구동방식에 따라 1 수평기간씩 오버랩되는 게이트 출력파형을 도시한 도면이다.9 is a diagram illustrating a data output waveform whose polarity is shifted by one horizontal period in frame units and a gate output waveform which is overlapped by one horizontal period according to an overlap driving scheme according to an exemplary embodiment of the present invention.

도 9에 도시된 바와 같이, 본 발명의 실시예에 따른 액정표시장치의 구동방법은 수직 2 도트 인버젼 방식에 따라 극성이 반전되는 데이터의 출력 파형의 극성을 프레임이 바뀔 때마다 왼쪽으로 1 수평기간 만큼 쉬프트 시킨다. 이에 따라, 기수 번째 수평라인(Hn,Hn+2)에 접속되어 있는 액정셀들은 N-1 번째 프레임에서는 1 수평기간의 충전시간을 갖지만 N 번째 프레임에서는 2 수평기간의 충전시간을 갖는다. 또한, 우수 번째 수평라인(Hn+1,Hn+3)에 접속되어 있는 액정셀들은 N-1 번째 프레임에서는 2 수평기간의 충전시간을 갖지만 N 번째 프레임에서는 1 수평기간 의 충전시간을 갖는다. 결과적으로 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합은 동일하게 되어 기수 번째 수평라인(Hn,Hn+2)과 우수 번째 수평라인(Hn+1,Hn+3)간에 발생되는 충전량의 불균형 문제는 해소된다.As shown in FIG. 9, the driving method of the liquid crystal display according to the exemplary embodiment of the present invention is one horizontal line of the polarity of the output waveform of the data whose polarity is inverted according to the vertical two-dot inversion method. Shift by period. Accordingly, the liquid crystal cells connected to the odd horizontal lines Hn and Hn + 2 have a charging time of one horizontal period in the N−1th frame but a charging time of two horizontal periods in the Nth frame. In addition, the liquid crystal cells connected to even-numbered horizontal lines Hn + 1 and Hn + 3 have a charging time of two horizontal periods in the N-1th frame but a charging time of one horizontal period in the Nth frame. As a result, the sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells becomes equal, and the even-numbered horizontal line (Hn, Hn + 2) and the even-numbered horizontal line (Hn + 1, Hn + 3) The problem of imbalance in the amount of charge generated in the liver is solved.

도 10은 본 발명의 다른 실시예에 따른 데이터 구동회로로 공급되는 프레임 단위로 쉬프트 되는 극성신호의 파형도이고, 도 11은 본 발명의 다른 실시예에 따른 프레임 단위로 1 수평기간씩 극성이 쉬프트되는 데이터 출력파형 및 오버랩 구동방식에 따라 1 수평기간씩 오버랩되는 게이트 출력파형을 도시한 도면이다.10 is a waveform diagram of a polarity signal shifted in units of frames supplied to a data driving circuit according to another exemplary embodiment of the present invention, and FIG. 11 is a polarity shifted by one horizontal period in units of frames according to another exemplary embodiment of the present invention. FIG. 1 is a diagram illustrating gate output waveforms overlapping by one horizontal period according to a data output waveform and an overlap driving scheme.

도 10 및 도 11을 참조하면, 본 발명의 다른 실시예에 따른 액정표시장치의 구동방법은 수직 2 도트 인버젼 방식에 따라 극성이 반전되는 데이터의 출력 파형의 극성을 프레임이 바뀔 때마다 오른쪽으로 1 수평기간 만큼 쉬프트 시킨다. Referring to FIGS. 10 and 11, the driving method of the liquid crystal display according to another exemplary embodiment of the present invention shifts the polarity of the output waveform of the data whose polarity is inverted according to the vertical two-dot inversion method to the right whenever the frame is changed. 1 Shift by horizontal period.

이에 따라, 기수 번째 수평라인(Hn,Hn+2)에 접속되어 있는 액정셀들은 N-1 번째 프레임에서는 1 수평기간의 충전시간을 갖지만 N 번째 프레임에서는 2 수평기간의 충전시간을 갖는다. 또한, 우수 번째 수평라인(Hn+1,Hn+3)에 접속되어 있는 액정셀들은 N-1 번째 프레임에서는 2 수평기간의 충전시간을 갖지만 N 번째 프레임에서는 1 수평기간의 충전시간을 갖는다. 결과적으로 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합은 동일하게 되어 기수 번째 수평라인(Hn,Hn+2)과 우수 번째 수평라인(Hn+1,Hn+3)간에 발생되는 충전량의 불균형 문제는 해소된다. Accordingly, the liquid crystal cells connected to the odd horizontal lines Hn and Hn + 2 have a charging time of one horizontal period in the N−1th frame but a charging time of two horizontal periods in the Nth frame. In addition, the liquid crystal cells connected to even-numbered horizontal lines Hn + 1 and Hn + 3 have a charging time of two horizontal periods in the N-1th frame but a charging time of one horizontal period in the Nth frame. As a result, the sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells becomes equal, and the even-numbered horizontal line (Hn, Hn + 2) and the even-numbered horizontal line (Hn + 1, Hn + 3) The problem of imbalance in the amount of charge generated in the liver is solved.

상술한 바와 같이, 본 발명의 실시예에 따른 액정표시장치와 그 구동방법은 소정의 극성반전 패턴에 따라 극성이 반전되는 데이터의 출력 파형의 극성을 프레임이 바뀔 때마다 왼쪽 또는 오른쪽으로 쉬프트시켜 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합을 동일하게 함으로써 기수 번째 수평라인과 우수 번째 수평라인간에 발생되는 충전량의 불균형 문제를 해소할 수 있다.As described above, the liquid crystal display device and the driving method thereof according to the embodiment of the present invention shift the polarity of the output waveform of the data whose polarity is inverted according to a predetermined polarity inversion pattern to the left or the right every time the frame is changed to be vertical. As a result, the sum of charging times during two consecutive frame periods between neighboring liquid crystal cells may be equal to solve the unbalance problem of charge amount generated between the odd-numbered horizontal line and the even-numbered horizontal line.

또한, 본 발명의 실시예에 따른 액정표시장치와 그 구동방법은 기수 번째 수평라인과 우수 번째 수평라인간에 발생되는 라인간 휘도차를 제거하여 액정표시장치의 표시장치의 표시품질을 높일 수 있다.In addition, the liquid crystal display device and the driving method thereof according to the embodiment of the present invention can improve the display quality of the display device of the liquid crystal display device by eliminating the luminance difference between the lines generated between the odd-numbered horizontal line and the even-numbered horizontal line.

이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 예컨대, 본 발명의 실시예는 2 도트 인버젼 방식을 중심으로 설명되었지만, N(단, N은 2 이상의 양의 정수) 도트 인버젼 방식 방식 등에도 적용될 수도 있다. 또한, GIP 방식뿐만 아니라 Non-GIP 방식에도 적용될 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.Those skilled in the art will appreciate that various changes and modifications can be made without departing from the technical spirit of the present invention. For example, although the embodiment of the present invention has been described based on the two dot inversion method, N (where N is a positive integer of 2 or more) may also be applied to the dot inversion method. In addition, it may be applied to the non-GIP method as well as the GIP method. Therefore, the technical scope of the present invention should not be limited to the contents described in the detailed description of the specification but should be defined by the claims.

Claims (10)

다수의 데이터라인들과 다수의 게이트라인들이 교차하고 다수의 액정셀들이 배치되는 액정패널과;A liquid crystal panel in which a plurality of data lines and a plurality of gate lines intersect and a plurality of liquid crystal cells are disposed; 제1 스캔펄스를 기수 번째 게이트라인에 공급하고 상기 제1 스캔펄스와 일부 중첩되는 제2 스캔펄스를 우수 번째 게이트라인에 공급하는 게이트 구동회로와;A gate driving circuit configured to supply a first scan pulse to an odd gate line and a second scan pulse partially overlapping the first scan pulse to an even gate line; 소정의 극성반전패턴을 따라 극성이 주기적으로 반전되는 데이터들을 상기 데이터라인들에 공급하는 데이터 구동회로를 구비하고;A data driving circuit for supplying data to the data lines whose polarities are periodically inverted along a predetermined polarity inversion pattern; 수직으로 이웃하는 액정셀들간에 연속되는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 상기 극성반전패턴은 프레임기간 단위로 쉬프트되는 것을 특징으로 하는 액정표시장치.And the polarity inversion pattern is shifted in units of frame periods so that the sum of charge times during two consecutive frame periods between vertically neighboring liquid crystal cells is the same. 제 1 항에 있어서,The method of claim 1, 상기 극성반전패턴은 2 수평기간을 주기로 극성이 반전되는 것을 특징으로 하는 액정표시장치.And wherein the polarity inversion pattern is inverted in polarity every two horizontal periods. 제 2 항에 있어서,The method of claim 2, 상기 극성반전패턴은 한 프레임 주기로 1 수평기간만큼씩 쉬프트되는 것을 특징으로 하는 액정표시장치.And the polarity inversion pattern is shifted by one horizontal period in one frame period. 제 3 항에 있어서,The method of claim 3, wherein 상기 제1 및 제2 스캔펄스는 각각 2 수평기간동안 하이논리 레벨을 유지하도록 발생되고, 상기 제2 스캔펄스는 1 수평기간만큼 상기 제1 스캔펄스와 중첩되도록 발생되는 것을 특징으로 하는 액정표시장치.Wherein the first and second scan pulses are generated to maintain a high logic level for two horizontal periods, respectively, and the second scan pulses are generated to overlap the first scan pulses by one horizontal period. . 제 4 항에 있어서,The method of claim 4, wherein 상기 데이터 구동회로는, The data driving circuit, 상기 제1 스캔펄스에 응답하여 n 번째 프레임의 기수번째 액정셀에는 1 수평기간 동안 데이터가 충전되도록 하고, 상기 제2 스캔펄스에 응답하여 n 번째 프레임의 우수번째 액정셀에는 2 수평기간 동안 데이터가 충전되도록 하며;The odd-numbered liquid crystal cell of the n-th frame is filled with data for one horizontal period in response to the first scan pulse, and the even-numbered liquid crystal cell of the n-th frame is filled with data for two horizontal periods in response to the second scan pulse. To be charged; 상기 제1 스캔펄스에 응답하여 n+1 번째 프레임의 기수번째 액정셀에는 2 수평기간 동안 데이터가 충전되도록 하고, 상기 제2 스캔펄스에 응답하여 n+1 번째 프레임의 우수번째 액정셀에는 1 수평기간 동안 데이터가 충전되도록 하는 것을 특징으로 하는 액정표시장치.Data is filled in the odd-numbered liquid crystal cell of the n + 1 th frame in response to the first scan pulse for two horizontal periods, and one horizontal in the even-numbered liquid crystal cell of the n + 1 th frame in response to the second scan pulse. Liquid crystal display characterized in that the data is to be charged during the period. 제1 스캔펄스를 기수 번째 게이트라인에 공급하고 상기 제1 스캔펄스와 일부 중첩되는 제2 스캔펄스를 우수 번째 게이트라인에 공급하는 단계와;Supplying a first scan pulse to an odd-numbered gate line and supplying a second scan pulse partially overlapping the first scan pulse to an even-numbered gate line; 소정의 극성반전패턴을 따라 극성이 주기적으로 반전되는 데이터들을 데이터라인들에 공급하는 단계를 구비하고;Supplying data lines with data whose polarity is periodically inverted along a predetermined polarity inversion pattern; 상기 데이터들을 공급하는 단계에서 수직으로 이웃하는 액정셀들간에 연속되 는 두 프레임기간 동안의 충전시간의 합이 동일하게 되도록 상기 극성반전패턴을 프레임기간 단위로 쉬프트시키는 것을 특징으로 하는 액정표시장치의 구동방법.The polarity inversion pattern is shifted in units of frame periods so that the sum of charging times for two consecutive frame periods between vertically neighboring liquid crystal cells is the same in the step of supplying the data. Driving method. 제 6 항에 있어서,The method of claim 6, 상기 데이터들을 공급하는 단계에서,In the step of supplying the data, 상기 데이터들의 극성을 2 수평기간을 주기로 반전시키는 것을 특징으로 하는 액정표시장치의 구동방법.And inverting the polarity of the data every two horizontal periods. 제 7 항에 있어서,The method of claim 7, wherein 상기 데이터들을 공급하는 단계에서, In the step of supplying the data, 상기 극성반전패턴을 한 프레임 주기로 1 수평기간만큼씩 쉬프트하는 것을 특징으로 하는 액정표시장치의 구동방법.And the polarity inversion pattern is shifted by one horizontal period in one frame period. 제 8 항에 있어서,The method of claim 8, 상기 스캔펄스를 공급하는 단계에서,In the step of supplying the scan pulse, 상기 제1 및 제2 스캔펄스를 각각 2 수평기간 동안 하이논리 레벨을 유지하고, 상기 제2 스캔펄스를 1 수평기간만큼 상기 제1 스캔펄스와 중첩시켜 공급하는 것을 특징으로 하는 액정표시장치의 구동방법.Driving the first and second scan pulses at a high logic level for two horizontal periods, and supplying the second scan pulses overlapping the first scan pulses for one horizontal period. Way. 제 9 항에 있어서,The method of claim 9, 상기 데이터들을 공급하는 단계는, Supplying the data, 상기 제1 스캔펄스에 응답하여 1 수평기간 동안 n 번째 프레임의 기수번째 액정셀에 데이터를 공급하고, 상기 제2 스캔펄스에 응답하여 2 수평기간 동안 n 번째 프레임의 우수번째 액정셀에 데이터를 공급하는 제1 단계와;Supply data to the even-numbered liquid crystal cell of the n-th frame in one horizontal period in response to the first scan pulse, and supply data to the even-numbered liquid crystal cell of the n-th frame in two horizontal periods in response to the second scan pulse. A first step of doing; 상기 제1 스캔펄스에 응답하여 2 수평기간 동안 n+1 번째 프레임의 기수번째 액정셀에는 데이터를 공급하고, 상기 제2 스캔펄스에 응답하여 1 수평기간 동안 n+1 번째 프레임의 우수번째 액정셀에 데이터를 공급하는 제2 단계를 포함하는 것을 특징으로 하는 액정표시장치의 구동방법.Data is supplied to the odd-numbered liquid crystal cell of the n + 1 th frame in two horizontal periods in response to the first scan pulse, and the even-numbered liquid crystal cell of the n + 1 th frame in one horizontal period in response to the second scan pulse. And a second step of supplying data to the liquid crystal display device.
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