KR20070109011A - 액정패널, 액정표시장치 그의 구동방법 - Google Patents

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Abstract

본 발명은 데이터라인과 이와 전기적으로 연결된 데이터 드라이버 IC의 출력 채널 수를 감소시켜 제조비용을 절감할 수 있는 액정패널, 액정표시장치 및 그의 구동방법이 개시된다.
본 발명에 따른 액정패널은 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인;을 포함하는 것을 특징으로 한다.
데이터라인 감소, 서브픽셀

Description

액정패널, 액정표시장치 그의 구동방법{Liquid crystal panel and Liquid crystal display device and method driving for the same}
도 1은 종래의 액정표시장치의 액정패널을 개략적으로 나타낸 도면.
도 2는 본 발명의 실시예에 따른 액정표시장치를 나타낸 도면.
도 3은 도 2의 액정패널을 개략적으로 나타낸 도면.
도 4는 도 2의 게이트 드라이버의 게이트 구동전압을 나타낸 파형도.
도 5는 도 3의 액정패널에 실제로 공급되는 데이터 전압을 나타낸 도면.
도 6은 도 2의 액정패널의 다른 실시예를 나타낸 도면.
도 7은 도 3의 액정패널의 또 다른 실시예를 나타낸 도면.
도 8은 도 7의 액정패널에 실제로 공급되는 데이터 전압을 나타낸 도면.
<도면의 주요부분에 대한 간단한 설명>
102, 202, 302:액정패널 104:게이트 드라이버
106:데이터 드라이버 108:타이밍 컨트롤러
110a ~ 110c:제 1 내지 제 3 화소전극
310a ~ 310d:제 1 내지 제 4 화소전극
본 발명은 표시장치에 관한 것으로, 특히 라인의 개수와 드라이버 IC의 출력채널 수를 감소 시켜 제조비용을 절감할 수 있는 액정패널, 액정표시장치 및 그의 구동방법에 관한 것이다.
정보화 사회가 발전함에 따라 표시장치에 대한 요구도 다양한 형태로 점증하고 있다. 이에 부응하여 근래에는 LCD(Liquid Crystal Display device, 이하 '액정표시장치'라 함), PDP(Plasma Display Panel), ELD(Electro Luminescent Display) 등 여러가지 평판표시장치가 연구되어 왔고 일부는 이미 여러장비에서 표시장치로 활용되고 있다.
그 중에, 현재 화질이 우수하고 경량, 박형, 저소비 전력 등의 장점으로 인하여 이동형 화상 표시장치의 용도로 브라운관(CRT)을 대체하면서 액정표시장치가 가장 널리 사용되고 있으며, 액정표시장치는 노트북 컴퓨터의 모니터와 같은 이동형의 용도 이외에도 텔레비전 모니터 등으로 다양하게 개발되고 있다.
액정표시장치는 액정의 광학적 이방성과 분극성질을 이용하여 화상을 표시한다. 상기 액정은 구조가 가늘고 길기 때문에 분자의 배열에 방향성을 가지고 있으며, 인위적으로 액정에 전기장을 인가하여 분자배열의 방향을 제어할 수 있다.
상기 액정표시장치는 소정의 화상을 표시하는 액정패널과 상기 액정패널을 구동하는 구동부로 구분된다.
도 1은 종래의 액정표시장치의 액정패널을 개략적으로 나타낸 도면이다.
도 1에 도시된 바와 같이, 종래의 액정패널(2)에는 복수의 화소영역(P)을 정 의하는 제 1 내지 제 4 게이트라인(GL1 ~ GL4)과 제 1 내지 제 5 데이터라인(DL1 ~ DL5)이 배열되어 있고, 그 교차부에는 박막트랜지스터(TFT)와, 상기 박막트랜지스터(TFT)와 전기적으로 연결된 화소전극(10)이 형성되어 있다.
상기 화소영역(P)은 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 이루어져 있고 상기 제 1 서브픽셀(SP1)은 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)과 제 1 및 제 4 데이터라인(DL1, DL4)이 교차되는 영역으로 정의되고, 제 2 서브픽셀(SP2)은 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)과 제 2 데이터라인(DL2)이 교차되는 영역으로 정의되고, 제 3 서브픽셀(SP3)은 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)과 제 3 데이터라인(DL3)이 교차되는 영역으로 정의된다.
상기 제 1 서브픽셀(SP1)에는 도시되지 않은 제 2 기판의 적색 컬러필터(R)와 대응되는 제 1 화소전극(10a)이 형성되고 상기 제 2 서브픽셀(SP2)에는 제 2 기판의 녹색 컬러필터(G)와 대응되는 제 2 화소전극(10b)이 형성되고, 상기 제 3 서브픽셀(SP3)에는 제 2 기판의 청색 컬러필터(B)와 대응되는 제 3 화소전극(10c)이 형성되어 있다.
상기 제 2 게이트라인(GL2)으로 게이트 스캔신호가 공급되면, 상기 제 2 게이트라인(GL2)과 연결된 박막트랜지스터(TFT)는 턴-온(turn-on)된다. 상기 박막트랜지스터(TFT)가 턴-온(turn-on) 되면 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)에 형성된 제 1 내지 제 3 화소전극(10a ~ 10c)에는 데이터라인(DL1 ~ DL5)을 통해 데이터 전압이 공급된다.
상기 제 1 내지 제 3 화소전극(10a ~ 10c)에 공급된 각각의 데이터 전압이 조합을 이루며 하나의 화소영역(P)에 해당하는 계조를 표시하게 된다.
이와 같이, 종래 액정패널(2)의 서브픽셀(SP)들은 상기 게이트라인(GL1 ~ GL4)과 데이터라인(DL1 ~ DL5)의 교차부에 형성되기 때문에 상기 데이터라인(DL1 ~ DL5) 수만큼 수직라인을 형성한다. 상기 서브픽셀(SP)들은 5개의 수평라인 및 4개의 수평라인을 이루도록 매트릭스 형태로 배치된다.
여기서 알 수 있듯이, 종래에는 상기 서브픽셀(SP)들을 구동하기 위하여 5개의 데이터라인(DL1 ~ DL5)을 필요로 한다. 따라서, 상기 서브픽셀(SP)을 구동하기 위하여 5개의 복수의 데이터라인이 형성되고, 이에 따른 공정 시간 및 제조비용이 증가되는 단점이 있다.
또한, 상기 데이터라인을 각각 구동하기 위한 드라이버 IC의 출력채널 수가 증가하게 된다. 상기 드라이버 IC의 출력채널 수가 증가함에 따라 이에 따른 제조비용 또한 증가하게 된다.
따라서, 본 발명은 라인의 개수와 드라이버 IC의 출력채널 수를 감소시켜 제조비용을 절감할 수 있는 액정패널, 액정표시장치 및 그의 구동방법을 제공함에 그 목적이 있다.
상기 목적을 달성하기 위한 본 발명의 제 1 실시예에 따른 액정패널은 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인;을 포함하는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명의 제 1 실시예에 따른 액정표시장치는 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정패널과, 상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 게이트 드라이버 및 상기 제 1 및 제 2 데이터라인으로 제 1 내지 제 3 데이터 전압을 공급하는 데이터 드라이버를 포함하는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명의 제 1 실시예에 따른 액정표시장치의 구동방법은 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정표시장치에 있어서, 상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 단계와, 상기 게이트라인의 구동에 따라 상기 제 1 및 제 2 데이터라인에 선택적으로 제 1, 제 2 및 제 3 데이터 전압을 공급하는 단계 및 상기 제 1, 제 2 및 제 3 데이터 전압에 해당하는 영상을 표시하는 단계를 포함하는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명의 제 2 실시예에 따른 액정패널은 제 1, 제 2, 제 3 및 제 4 서브픽셀과, 상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인과, 상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인 및 상 기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함하는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명의 제 2 실시예에 따른 액정표시장치는 제 1, 제 2, 제 3 및 제 4 서브픽셀과, 상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인과, 상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정패널과, 상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 게이트 드라이버 및 상기 제 1 및 제 2 데이터라인으로 제 1 내지 제 4 데이터 전압을 공급하는 데이터 드라이버를 포함하는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명의 제 2 실시예에 따른 액정표시장치의 구동방법은 제 1, 제 2, 제 3 및 제 4 서브픽셀과, 상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인과, 상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정표시장치에 있어서, 상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 단계와, 상기 게이트라인의 구동에 따라 상기 제 1 및 제 2 데이터라인에 선택적으로 제 1, 제 2, 제 3 및 제 4 데이터 전압을 공급하는 단계 및 상기 제 1, 제 2, 제 3 및 제 4 데이터 전압에 해당하는 영상을 표시하는 단계를 포함하는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 실시예를 설명한다.
도 2는 본 발명의 실시예에 따른 액정표시장치를 나타낸 도면이다.
도 2에 도시된 바와 같이, 본 발명에 따른 액정표시장치는 복수의 게이트라인(GL1 ~ GLn)과 데이터라인(DL1 ~ DLm)이 배열되어 소정의 화상을 표시하는 액정패널(102)과, 상기 액정패널(102)을 구동하는 게이트 드라이버(104) 및 데이터 드라이버(106)와, 상기 게이트 드라이버(104) 및 데이터 드라이버(106)를 제어하는 타이밍 컨트롤러(108)를 포함한다.
상기 액정패널(102)은 2개의 유리기판과, 상기 2개의 유리기판 사이에 형성된 액정층으로 구성된다. 상기 액정패널(102)에는 복수의 화소영역을 정의하는 복수의 게이트라인(GL1 ~ GLn)과 데이터라인(DL1 ~ DLm)이 배열되어 소정의 화상을 표시한다.
상기 액정패널(102)에 대한 상세 설명은 도 3을 통해 후술할 것이다.
상기 게이트 드라이버(104)는 상기 타이밍 컨트롤러(108)로부터 공급된 게이트 제어신호에 따라 상기 복수의 게이트라인(GL1 ~ GLn)으로 스캔신호를 공급한다.
상기 데이터 드라이버(106)는 상기 타이밍 컨트롤러(108)로부터 공급된 데이터 제어신호에 따라 상기 복수의 데이터라인(DL1 ~ DLm)으로 데이터 전압을 공급한다. 상기 데이터 전압은 상기 타이밍 컨트롤러(108)로부터 공급된 R, G, B 데이터 신호를 아날로그 전압으로 변환한 전압이다.
상기 데이터 드라이버(106)는 복수의 데이터 드라이버 IC를 구비하는데 상기 데이터 드라이버 IC는 상기 액정패널(102) 상에 형성된 데이터라인과 대응되는 출력 채널을 갖고 있다.
상기 타이밍 컨트롤러(108)는 도시되지 않은 시스템으로부터 공급된 수직/수 평동기신호(Vsync/Hsync)와 데이터 이네이블(DE) 신호 및 소정의 클럭신호(CLK)를 이용해서 상기 게이트 제어신호 및 데이터 제어신호를 생성한다.
또한, 상기 타이밍 컨트롤러(108)는 상기 시스템으로부터 공급된 R, G, B 데이터 신호를 상기 액정패널(102)의 모드에 맞도록 정렬하여 상기 데이터 드라이버(106)로 공급한다.
도 3은 본 발명의 제 1 실시예에 따른 액정패널을 나타낸 도면이다.
도 3에 도시된 바와 같이, 상기 액정패널(102)에는 제 1 내지 제 4 게이트라인(GL1 ~ GL4)과 제 1 내지 제 4 데이터라인(DL1 ~ DL4)이 배열된다. 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)은 상기 제 1 내지 제 4 데이터라인(DL1 ~ DL4)과 교차되어 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)을 정의한다.
구체적으로, 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)은 제 1 또는 제 3 데이터라인(DL1, DL3)과 교차되어 각각 제 1 및 제 2 서브픽셀(SP1, SP2)을 정의하고, 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)은 제 2 또는 제 4 데이터라인(DL2, DL4)과 교차되어 각각 제 3 서브픽셀(SP3)을 정의한다.
즉, 상기 제 1 데이터라인(DL1)의 좌우측에 제 1 및 제 2 서브픽셀(SP1, SP2)이 형성되고, 상기 제 2 데이터라인(DL2)의 좌측에 제 3 서브픽셀(SP3)이 형성된다.
도 3에서는 상기 제 2 데이터라인(DL2)의 좌측에 제 3 서브픽셀(SP3)이 형성되는 것으로 도시되었지만, 상기 제 3 서브픽셀(SP3)은 상기 제 2 데이터라인(DL2)의 우측에 형성될 수도 있다.
마찬가지로, 상기 제 3 및 제 4 데이터라인(DL3, DL4)도 그 좌우측에 각각 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)이 형성될 수 있다.
상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)에 의해 단위 화소영역(P)이 정의된다. 예컨대, 상기 제 1 서브픽셀(SP1)은 적색 화상이 표시되는 영역이고, 상기 제 2 서브픽셀(SP2)은 녹색 화상이 표시되는 영역이며, 상기 제 3 서브픽셀(SP3)은 청색 화상이 표시되는 영역일 수 있다.
상기 제 1 및 제 2 서브픽셀(SP1, SP2)은 동일 데이터라인 즉, 제 1 및 제 3 데이터라인(DL1, DL3)을 공유하는 반면에, 상기 제 3 서브픽셀(SP3)은 제 2 및 제 4 데이터라인(DL2, DL4)을 독립적으로 연결한다.
상기 제 1 서브픽셀(SP1)에는 도시되지 않은 제 2 기판의 적색 컬러필터(R)와 대응되는 제 1 화소전극(110a)이 형성되고, 상기 제 2 서브픽셀(SP2)에는 제 2 기판의 녹색 컬러필터(G)와 대응되는 제 2 화소전극(110b)이 형성되고, 상기 제 3 서브픽셀(SP3)에는 제 2 기판의 청색 컬러필터(B)와 대응되는 제 3 화소전극(110c)이 형성된다.
이하에서는 설명의 편의를 위해 제 2 게이트라인(GL2)과 제 1 및 제 2 데이터라인(DL1, DL2)에 의해 정의된 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 한정하여 설명하지만, 두개의 데이터라인에 의해 또 다른 제 1 내지 제 3 서브픽셀이 반복 배열되어 액정패널이 구성됨을 자명하다.
상기 제 1 서브픽셀(SP1)에는 2 개의 박막트랜지스터 즉, 제 1 및 제 2 박막트랜지스터(TFT-1, TFT-2)가 형성된다.
상기 제 1 박막트랜지스터(TFT-1)는 소스 단자와 화소전극(R)과 연결되고 드레인 단자가 제 1 데이터라인(DL1)과 연결되고, 상기 제 2 박막트랜지스터(TFT-2)는 소스 단자가 상기 제 1 박막트랜지스터(TFT-2)의 게이트 단자와 연결되고 드레인 단자가 다음단의 게이트라인, 즉 제 3 게이트라인(GL3)에 연결되며 게이트 단자가 현재 단의 게이트라인 즉, 제 2 게이트라인(GL2)에 연결된다.
따라서, 상기 제 2 게이트라인(GL2)으로 공급된 제 2 스캔신호(SP2)에 의해 상기 제 2 박막트랜지스터(TFT-2)가 턴-온(turn-on)될때, 상기 제 2 박막트랜지스터(TFT-2)를 경유하여 상기 제 3 게이트라인(GL3)으로 공급된 제 1 스캔신호(SP1)가 상기 제 1 박막트랜지스터(TFT-1)로 공급된다.
이러한 경우, 상기 제 1 박막트랜지스터(TFT-1)가 상기 제 2 스캔신호(SP2)에 의해 턴-온(turn-on)되게 되어, 상기 제 1 박막트랜지스터(TFT-1)를 경유하여 상기 제 1 데이터라인(DL1)으로 공급된 제 1 데이터 전압이 제 1 화소전극(110a)으로 인가된다.
그러므로, 상기 제 1 화소전극(110a)에 상기 제 1 데이터라인(DL1)으로부터 공급된 제 1 데이터 전압을 인가하기 위해서는 상기 제 1 및 제 2 박막트랜지스터(TFT-1, TFT-2)가 동시에 턴-온(turn-on) 되어야 하고, 이를 위해 상기 제 1 및 제 2 스캔신호(SP1, SP2)가 일부 구간 동안 중첩되어야 한다.
상기 제 2 및 제 3 게이트라인(GL2, GL3)으로 제 2 및 제 1 스캔신호(SP2, SP1)가 동시에 공급되는 경우, 상기 제 2 박막트랜지스터(TFT-2)를 경유한 제 1 스캔신호(SP1)에 의해 상기 제 1 박막트랜지스터(TFT-1)가 턴-온(turn-on) 되어 상기 제 1 데이터라인(DL1)으로부터 공급된 제 1 데이터 전압이 상기 제 1 박막트랜지스터(TFT-1)를 경유하여 상기 제 1 화소전극(110a)에 인가된다.
이에 반하여, 상기 제 2 게이트라인(GL2)으로 제 2 스캔신호(SP2)가 공급되는 한편 상기 제 3 게이트라인(GL3)으로 상기 제 1 스캔신호(SP1)가 공급되지 않는 경우, 상기 제 2 박막트랜지스터(TFT-2)는 턴-온(turn-on) 되지만 상기 제 2 박막트랜지스터(TFT-2)를 경유하는 제 1 스캔신호(SP1)가 공급되지 않기 때문에 상기 제 1 박막트랜지스터(TFT-1)는 턴-오프(turn-off) 되어, 상기 제 1 데이터라인(DL1)으로 공급된 제 1 데이터 전압은 상기 제 1 화소전극(110a)으로 공급되지 않는다.
결국, 상기 제 2 및 제 1 스캔신호(SP2, SP1)가 동시에 공급될때 상기 제 1 화소전극(110a)에 제 1 데이터라인(DL1)으로부터 공급된 제 1 데이터 전압이 인가되고, 상기 제 2 스캔신호(SP2)만 공급되는 경우에는 상기 제 1 화소전극(110a)에 어떠한 데이터 전압도 인가되지 않는다.
상기 제 2 서브픽셀(SP2)에는 하나의 박막트랜지스터, 제 3 박막트랜지스터(TFT-3)가 형성된다. 상기 제 3 박막트랜지스터(TFT-3)는 소스 단자가 제 2 화소전극(110b)에 연결되고 드레인 단자가 상기 제 1 데이터라인(DL1)에 연결되며 게이트 단자가 상기 제 2 게이트라인(GL2)에 연결된다.
따라서, 상기 제 3 박막트랜지스터(TFT-3)는 상기 제 2 게이트라인(GL2)으로 공급된 제 2 스캔신호(SP2)에 의해서만 턴-온(turn-on)되고, 상기 제 3 박막트랜지스터(TFT-3)가 턴-온(turn-on) 될때 상기 제 3 박막트랜지스터(TFT-3)를 경유하여 상기 제 1 데이터라인(DL1)으로부터 공급된 제 2 데이터 전압이 상기 제 2 화소전극(110b)으로 인가된다.
상기 제 3 서브픽셀(SP3)에는 2개의 박막트랜지스터 즉, 제 4 및 제 5 박막트랜지스터(TFT-4, TFT-5)가 형성된다. 즉, 상기 제 3 서브픽셀(SP3)은 상기 제 2 데이터라인(DL2)이 연결되는 것을 제외하고는 상기 제 1 서브픽셀(SP1)과 유사하다.
상기 제 4 박막트랜지스터(TFT-4)는 소스 단자가 제 3 화소전극(110c)과 연결되고 드레인 단자가 제 2 데이터라인(DL2)과 연결되고 제 5 박막트랜지스터(TFT-5)는 소스 단자가 상기 제 4 박막트랜지스터(TFT-4)의 게이트 단자와 연결되고 드레인 단자가 다음단의 게이트라인 즉, 제 3 게이트라인(GL3)에 연결되며 게이트 단자는 현재 단의 게이트라인, 즉 제 2 게이트라인(GL2)에 연결된다.
따라서, 상기 제 2 게이트라인(GL2)으로 공급된 제 2 스캔신호(SP2에 의해 상기 제 5 박막트랜지스터(TFT-5)가 턴-온(turn-on)될 때, 상기 제 5 박막트랜지스터(TFT-5)를 경유하여 상기 제 3 게이트라인(GL3)으로부터 공급된 제 1 스캔신호(SP1)가 상기 제 4 박막트랜지스터(TFT-4)로 공급된다.
이러한 경우, 상기 제 4 박막트랜지스터(TFT-4)가 상기 제 2 스캔신호(SP2)에 의해 턴-온(turn-on)되게 되어, 상기 제 4 박막트랜지스터(TFT-4)를 경유하여 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압이 제 3 화소전극(110c)으로 인가된다.
그러므로, 상기 제 3 화소전극(110c)에 상기 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압을 인가하기 위해서는 상기 제 4 및 제 5 박막트랜지스터(TFT-4, TFT-5)가 동시에 턴-온(turn-on)되어야 하고, 이를 위해 상기 제 2 및 제 1 스캔신호(SP2, SP1)가 일부 구간 동안 중첩되어야 한다.
상기 제 2 및 제 3 게이트라인(GL2, GL3)으로 상기 제 2 및 제 1 스캔신호(SP2, SP1)가 동시에 공급되는 경우, 상기 제 5 박막트랜지스터(TFT-5)를 경유한 제 1 스캔신호(SP1)에 의해 상기 제 4 박막트랜지스터(TFT-4)가 턴-온(turn-on)되어 상기 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압이 상기 제 4 박막트랜지스터(TFT-4)를 경유하여 제 3 화소전극(110c)으로 인가된다.
이에 반하여, 상기 제 2 게이트라인(GL2)으로 제 2 스캔신호(SP2)가 공급되는 한편 상기 제 3 게이트라인(GL3)으로 제 1 스캔신호가 공급되지 않는 경우, 상기 제 5 박막트랜지스터(TFT-5)는 턴-온(turn-on) 되지만 상기 제 5 박막트랜지스터(TFT-5)를 경유하는 제 1 스캔신호(SP1)가 공급되지 않기 때문에 상기 제 4 박막트랜지스터(TFT-4)가 턴-온(turn-on) 되지 않는다.
이로인해, 상기 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압이 상기 제 3 화소전극(110c)에 인가되지 않는다.
결국, 상기 제 2 및 제 1 스캔신호(SP2, SP1)가 동시에 공급될때 상기 제 3 화소전극(110c)에 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압이 인가되고, 상기 제 2 스캔신호(SP2)만 공급될때에는 상기 제 3 화소전극(110c)에 어떠한 데이터 전압도 공급되지 않는다.
따라서, 제 1 구간 동안 제 2 및 제 1 스캔신호(SP2, SP1)가 상기 제 2 및 제 3 게이트라인(GL2, GL3)으로 동시에 공급되는 경우, 상기 제 1 데이터라인DL1)으로부터 공급된 제 1 데이터 전압이 상기 제 1 서브픽셀(SP1)의 제 1 화소전극(110a)에 공급되는 한편 상기 제 2 데이터라인(DL2)으로부터 공급된 제 3 데이터 전압이 상기 제 3 서브픽셀(SP3)의 제 3 화소전극(110c)으로 인가된다.
이어서, 제 2 구간 동안 상기 제 2 스캔신호(SP2) 만이 상기 제 2 게이트라인(GL2)으로 공급되는 경우, 상기 제 1 데이터라인(DL1)으로부터 공급된 제 2 데이터 전압이 상기 제 2 서브픽셀(SP2)의 제 2 화소전극(110b)으로 인가된다.
이와 같이, 상기 제 1 및 제 2 서브픽셀(SP1, SP2)은 동일 데이터라인(DL)인 제 1 데이터라인(DL1)을 공유하여 정의되고 상기 제 3 서브픽셀(SP3)은 제 2 데이터라인(DL2)으로 정의된다.
결국, 상기 제 1 및 제 2 서브픽셀(SP1, SP2)이 동일 데이터라인(DL1)을 공유하여 정의됨에 따라 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 정의되는 화소영역(P)은 2개의 데이터라인으로도 정의될 수 있다.
이로인해, 상기 액정패널(102) 상에 배열된 데이터라인(DL1 ~ DL4)의 수는 종래의 액정패널에 비해
Figure 112006032394034-PAT00001
정도 감소될 수 있다.
또한, 상기 데이터라인과 전기적으로 연결된 상기 데이터 드라이버 IC의 출력채널 수가 감소될 수 있다. 상기 데이터라인 수와 데이터 드라이버 IC의 출력채널 수가 감소함에 따라 이를 제조하는데에 따른 제조비용을 절감할 수 있다.
도 4는 도 2의 게이트 드라이버의 게이트 구동전압을 나타낸 파형도이다.
도 3 및 도 4에 도시된 바와 같이, 상기 게이트 드라이버(도 2의 104)는 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)에 순차적으로 게이트 스캔신호를 공급한다.
상기 게이트 드라이버(104)는 상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)으로 각각 제 1 스캔신호(SP1)와 제 2 스캔신호(SP2)를 공급한다. 상기 제 2 스캔신호(SP2)는 상기 제 1 스캔신호(SP1) 보다 넓은 폭을 갖도록 설정된다.
상기 게이트 드라이버(104)는 상기 제 1 게이트라인(GL1)에 공급된 제 2 스캔신호(SP2)와 제 2 게이트라인(GL2)에 공급된 제 1 스캔신호(SP1)가 1/2 수평구간(예를 들어, 1/2H) 동안 중첩되도록 한다. 상기 제 1 게이트라인(GL1)에는 1 수평구간(1H) 동안 제 2 스캔신호(SP2)만 공급된다.
상기 게이트 드라이버(104)는 상기 제 1 게이트라인(GL1)에 1 수평구간(1H) 동안 상기 제 2 스캔신호(SP2)를 공급하고 상기 제 2 게이트라인(GL2)에 1/2 수평구간(1/2H) 동안 상기 제 1 스캔신호(SP1)를 공급한다. 이어, 상기 게이트 드라이버(104)는 나머지 1/2 수평구간(1/2H) 동안 상기 제 2 게이트라인(GL2)으로 상기 제 1 및 제 2 스캔신호(SP1, SP2)를 공급하지 않는다.
연속하여, 상기 게이트 드라이버(104)는 제 2 게이트라인(GL2)에 1 수평구간(1H) 동안 상기 제 2 스캔신호(SP2)를 공급하고 상기 제 3 게이트라인(GL3)에 1/2 수평구간(1/2H) 동안 상기 제 1 스캔신호(SP1)를 공급한다.
상기 제 1 내지 제 4 게이트라인(GL1 ~ GL4)으로 공급된 게이트 스캔신호에 대해 구체적으로 설명하면 다음과 같다.
상기 제 2 게이트라인(GL2)으로 1 수평구간(1H) 동안 제 2 스캔신호(SP2)가 공급되고 상기 제 3 게이트라인(GL3)으로 1/2 수평구간(1/2H) 동안 제 1 스캔신호(SP1)가 공급되어 상기 1/2 수평구간(1/2H) 동안 중첩되는 구간을 A 구간이라고 정의한다.
상기 A 구간 동안 상기 제 2 게이트라인(GL2)으로 정의된 제 1 및 제 3 서브픽셀(SP1, SP3)의 제 2 및 제 5 박막트랜지스터(TFT-2, TFT-5)와 제 2 서브픽셀(SP2)의 제 3 박막트랜지스터(TFT-3)는 턴-온(turn-on) 된다.
상기 제 2 게이트라인(GL2)과 전기적으로 연결된 상기 제 2 및 제 3 박막트랜지스터(TFT-2, TFT-3)의 게이트 단자로 상기 제 2 스캔신호(SP2)가 공급되고 이와 동시에, 상기 제 3 게이트라인(GL3)과 전기적으로 연결된 상기 제 2 박막트랜지스터(TFT-2)의 소스 단자와 상기 제 5 박막트랜지스터(TFT-5)의 소스 단자로 상기 제 1 스캔신호(SP1)가 공급된다.
상기 제 2 박막트랜지스터(TFT-2)의 소스 단자는 제 1 박막트랜지스터(TFT-1)의 게이트 단자와 전기적으로 연결되고 상기 제 5 박막트랜지스터(TFT-5)의 소스 단자는 상기 제 4 박막트랜지스터(TFT-4)의 게이트 단자와 전기적으로 연결되기 때문에, 상기 제 1 및 제 3 서브픽셀(SP1, SP3)의 제 1 및 제 4 박막트랜지스터(TFT-1, TFT-4)의 게이트 단자로 상기 제 1 스캔신호(SP1)가 공급되면서 상기 제 1 및 제 4 박막트랜지스터(TFT-1,TFT-4)가 턴-온(turn-on) 된다.
이로인해, 제 1 내지 제 4 데이터라인(DL1 ~ DL4)으로부터 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 제 1 및 제 3 데이터 전압이 공급된다. 상기 제 1 및 제 3 데이터 전압은 상기 제 1 및 제 3 서브픽셀(SP1, SP3)에 각각 형성된 제 1 및 제 3 화소전극(R, B)으로 공급된다.
상기 A 구간 동안 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 데이터 전압이 공급된다. 이때, 상기 A 구간 동안 상기 제 2 서브픽셀(SP2)로 공급된 데이터 전압은 더미 데이터 전압이다. 즉, 상기 A 구간 동안 상기 제 2 서브픽셀(SP2)로 공급된 데이터 전압은 실제 화상을 표시하기 위한 전압이 아니다.
연속하여, 상기 제 2 게이트라인(GL2)으로 상기 제 2 스캔신호(SP2)가 공급된 상태가 지속되고, 상기 제 3 게이트라인(GL3)으로 제 1 스캔신호(SP1)가 공급되지 않는 구간을 B 구간이라고 정의한다.
상기 B 구간 동안 상기 제 2 게이트라인(GL2)으로만 제 2 스캔신호(SP2)가 공급되기 때문에 상기 제 2 게이트라인(GL2)과 연결된 제 2, 제 3 및 제 5 박막트랜지스터(TFT-2, TFT-3, TFT-5)가 모두 턴-온(turn-on) 되더라도, 어떠한 신호도 상기 제 2 및 제 5 박막트랜지스터(TFT-2, TFT-5)를 경유하지 않게 되어 상기 제 2 및 제 5 박막트랜지스터(TFT-2, TFT-5)에 연결된 제 1 및 제 4 박막트랜지스터(TFT-1, TFT-4)가 턴-온(turn-on) 되지 않고, 상기 제 2 서브픽셀(SP2)에 형성된 제 3 박막트랜지스터(TFT-3)만 턴-온(turn-on) 된다.
따라서, 상기 제 2 서브픽셀(SP2)에 제 2 데이터 전압이 공급된다.
결국, 상기 B 구간 동안 상기 제 2 서브픽셀(SP2)에 형성된 제 2 화소전극(B)으로 제 2 데이터 전압이 공급된다. 상기 B 구간 동안 상기 제 2 서브픽셀(SP2)로 공급된 제 2 데이터 전압이 실제 화상을 표시하기 위한 전압이 된다.
상기 A와 B 구간 동안 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 데이터 전압이 공급되어 액정패널(도 2의 102) 상에 소정의 화상이 표시된다.
이어서, 상기 제 3 게이트라인(GL3)으로 제 2 스캔신호(SP2)가 공급되고, 제 4 게이트라인(GL4)으로 상기 제 1 스캔신호(SP1)가 공급되는 구간을 C 구간이라 정의한다. 상기 C 구간 동안 상기 제 2 게이트라인(GL2)에는 상기 제 1 및 제 2 스캔신호(SP1, SP2)가 공급되지 않는다.
상기 C 구간 동안 상기 제 3 게이트라인(GL3)으로 정의된 제 1 및 제 3 서브픽셀(SP1, SP3)에 형성된 제 2 및 제 5 박막트랜지스터(TFT-2, TFT-5)와 제 2 서브픽셀(SP2)에 형성된 제 3 박막트랜지스터(TFT-3)로 제 2 스캔신호(SP2)가 공급된다. 이로인해, 상기 제 2, 제 3 및 제 5 박막트랜지스터(TFT-2, TFT-3, TFT-5)는 턴-온(turn-on) 된다.
상기 제 2 및 제 5 박막트랜지스터(TFT-2, TFT-5)가 턴-온(turn-on)됨에 따라 상기 제 1 및 제 3 서브픽셀(SP1, SP3)에 형성된 상기 제 1 및 제 4 박막트랜지스터(TFT-1, TFT-4)가 턴-온(turn-on) 된다.
상기 C 구간 동안 상기 제 1 및 제 3 서브픽셀(SP1, SP3)에 형성된 제 1 및 제 4 박막트랜지스터(TFT-1, TFT-4)가 턴-온(turn-on)되고 이로인해, 제 1 내지 제 4 데이터라인(DL1 ~ DL4)을 통해 상기 제 1 및 제 3 서브픽셀(SP1, SP3)로 제 1 및 제 3 데이터 전압이 공급된다.
즉, 상기 제 1 및 제 3 서브픽셀(SP1, SP3)에 형성된 제 1 및 제 3 화소전극(R, B)으로 상기 제 1 및 제 3 데이터 전압이 공급된다.
상기 C 구간 동안 상기 제 2 서브픽셀(SP2)로 공급된 데이터 전압은 더미 데이터 전압이다. 상기 C 구간 동안 상기 제 2 화소전극(B)으로 공급된 데이터 전압은 실제 화상을 표시하기 위한 전압이 아니다.
상기 A 구간과 마찬가지로 상기 C 구간 동안 상기 제 2 서브픽셀(SP2)로 공급된 데이터 전압은 더미 데이터 전압이다.
연속하여, 상기 제 3 게이트라인(GL3)에 공급된 상기 제 2 스캔신호(SP2)가 지속되고 상기 제 4 게이트라인(GL4)으로 상기 제 1 스캔신호(SP1)가 공급되지 않는 구간을 D 구간으로 정의한다.
상기 D 구간 동안 상기 제 2 서브픽셀(SP2)에 형성된 제 3 박막트랜지스터(TFT-3)만 턴-온(turn-on) 된다. 상기 제 3 박막트랜지스터(TFT-3)가 턴-온(turn-on) 됨에 따라 상기 제 2 서브픽셀(SP2)로 제 2 데이터 전압이 공급된다.
상기 D 구간 동안 상기 제 2 서브픽셀(SP2)로 공급되는 제 2 데이터 전압이 실제 화상을 표시하기 위한 전압이다.
도 5는 도 3의 액정패널에 실제로 공급되는 데이터 전압을 나타낸 도면이다.
도 4 및 도 5에 도시된 바와 같이, 상기 A 구간동안 제 1 데이터 전압(R)이 기수번째 데이터라인(DL1, DL3)으로 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 1 데이터 전압(R)은 상기 기수번째 데이터라인(DL1, DL3)과 전기적으로 연결된 제 1 서브픽셀(SP1)로 공급된다.
또한, 상기 A 구간동안 제 3 데이터 전압(B)이 우수번째 데이터라인(DL2, DL4)으로 공급되고 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 3 데이터 전압(B)은 상기 우수번째 데이터라인(DL2, DL4)과 연결된 제 3 서브픽셀(SP3)로 공급된다.
연속하여, 상기 B 구간동안 제 2 데이터 전압(G)이 기수번째 데이터라인(DL1, DL3)으로 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 2 데이터 전압(G)은 상기 기수번째 데이터라인(DL1, DL3)과 전기적으로 연결된 제 2 서브픽셀(SP2)로 공급된다. 또한 상기 B 구간동안에 상기 우수번째 데이터라인(DL2, DL4)에는 어떠한 데이터 전압도 공급되지 않는다.
결국, 상기 B 구간에서는 상기 기수번째 데이터라인(DL1, DL3)으로만 제 2 데이터 전압(G)이 공급된다.
상기 A 구간동안 공급된 제 1 및 제 3 데이터 전압(R, B)과 상기 B 구간동안 공급된 제 2 데이터 전압(G)은 각각 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 공급되어 하나의 계조를 표시하게 된다.
상기 A 구간과 마찬가지로 C 구간동안 제 1 데이터 전압(R)이 기수번째 데이터라인(DL1, DL3)으로 공급되고, 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 1 데이터 전압(R)은 상기 기수번째 데이터라인(DL1, DL3)과 연결된 제 1 서브픽셀(SP1)로 공급된다.
또한, 상기 C 구간동안 제 3 데이터 전압(B)이 우수번째 데이터라인(DL2, DL4)으로 공급되고, 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 3 데이터 전압(B)은 상기 우수번째 데이터라인(DL2, DL4)과 연결된 제 3 서브픽셀(SP3)로 공급된다.
연속하여, 상기 B 구간과 마찬가지로 상기 D 구간동안 제 2 데이터 전압(G)이 기수번째 데이터라인(DL1, DL3)으로 공급되고, 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 2 데이터 전압(G)은 상기 기수번째 데이터라인(DL1, DL3)과 연결된 제 2 서브픽셀(SP2)로 공급된다. 또한, 상기 D 구간동안 상기 우수번째 데이터라인(DL2, DL4)으로는 어떠한 데이터 전압도 공급되지 않는다.
결국, 상기 D 구간에서는 상기 기수번째 데이터라인(DL1, DL3)으로만 제 2 데이터 전압(G)이 공급된다.
상기 C 구간동안 공급된 제 1 및 제 3 데이터 전압(R, B)과 상기 D 구간동안 공급된 제 2 데이터 전압(G)은 각각 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)로 공급되어 하나의 계조를 표시하게 된다.
상기 제 1 및 제 3 데이터 전압(R, B)은 상기 A 및 C 구간동안 제 1 및 제 3 서브픽셀(SP1, SP3)로 공급되고, 상기 제 2 데이터 전압(G)은 상기 B, D 구간동안 제 2 서브픽셀(SP2)로 공급된다. 상기 제 1 내지 제 3 서브픽셀(SP1 ~ SP3)에 각각 제 1, 제 2, 제 3 데이터 전압(R, G, B)이 공급되어 상기 액정패널(도 3의 102) 상에 소정의 화상이 표시될 수 있다.
이와 같이, 본 발명에 따른 액정패널은 동일 데이터라인을 공유하는 제 1 및 제 2 서브픽셀(SP1, SP2)과 상기 데이터라인과 인접한 데이터라인으로 정의된 제 3 서브픽셀(SP3)로 화소영역을 구성함에 따라 데이터라인 수를 감소시킬 수 있다. 화소영역당 2개의 데이터라인만을 필요로 하므로 데이터라인 수 감소 및 상기 데이터라인과 전기적으로 연결된 데이터 드라이버 IC의 출력채널 수 또한 감소된다.
상기 데이터라인 수와 상기 데이터라인과 전기적으로 연결된 데이터 드라이버 IC의 출력채널 수가 감소됨에 따라 이를 제조하는 제조비용이 절감될 수 있다.
도 6은 본 발명의 제 2 실시예에 따른 액정패널을 나타낸 도면이다.
도 6에 도시된 바와 같이, 다른 실시예에 따른 액정패널(202)은 우수번째 데이터라인(DL2, DL4)을 공유하여 정의된 제 2 및 제 3 서브픽셀(SP2, SP3)과 상기 우수번째 데이터라인(DL2, DL4)과 인접한 기수번째 데이터라인(DL1, DL3)으로 정의된 제 1 서브픽셀(SP1)로 구성된 복수의 화소영역(P)을 구비한다.
상기 액정패널(202)에 대한 상세한 설명 중 도 3에 도시된 액정패널(102)과 동일한 부분은 생략하기로 한다.
이때, 상기 제 2 서브픽셀(SP2)은 우수번째 데이터라인(DL2, DL4)의 좌측에 형성되고 상기 제 3 서브픽셀(SP3)은 상기 우수번째 데이터라인(DL2, DL4)의 우측에 형성된다. 상기 제 1 서브픽셀(SP1)은 기수번째 데이터라인(DL1, DL3)의 좌측에 형성된다.
상기 제 1 서브픽셀(SP1)에는 제 1 및 제 2 박막트랜지스터(TFT-1, TFT-2)가 형성되고, 상기 제 2 서브픽셀(SP2)에는 제 4 및 제 5 박막트랜지스터(TFT-4, TFT-5)가 형성되며 상기 제 3 서브픽셀(SP3)에는 상기 제 3 박막트랜지스터(TFT-3)가 형성된다.
상기 제 1 내지 제 5 박막트랜지스터(TFT-1 ~ TFT-5)는 도 3에 도시된 제 1 내지 제 5 박막트랜지스터(TFT-1 ~ TFT-5)와 동일하다.
도 7은 본 발명의 제 3 실시예에 따른 액정패널을 나타낸 도면이다.
도 7에 도시된 바와 같이, 상기 액정패널(302)은 제 1 데이터라인(DL1)을 공유하는 제 1 및 제 2 서브픽셀(SP1, SP2)과 제 2 데이터라인(DL2)을 공유하는 제 3 및 제 4 서브픽셀(SP3, SP4)로 구성된 복수의 화소영역을 구비한다.
상기 액정패널(302)에 대한 상세한 설명 중 도 3에 도시된 액정패널(102)과 동일한 부분은 생략하기로 한다.
상기 제 1 서브픽셀(SP1)에는 도시되지 않는 적색 컬러필터(R)와 대응되는 제 1 화소전극(310a)이 형성되고, 상기 제 2 서브픽셀(SP2)에는 제 1 녹색 컬러필터(G1)와 대응되는 제 2 화소전극(310b)이 형성되며 상기 제 3 서브픽셀(SP3)에는 제 2 녹색 컬러필터(G2)와 대응되는 제 3 화소전극(310c)이 형성되고, 상기 제 4 서브픽셀(SP4)에는 청색 컬러필터(B)와 대응되는 제 4 화소전극(310d)이 형성된다.
상기 제 1 내지 제 4 서브픽셀(SP1 ~ SP4)은 화소영역(P)을 정의한다.
상기 제 1 및 제 2 서브픽셀(SP1, SP2)은 제 1 데이터라인(DL1)을 공유하는데, 상기 제 1 서브픽셀(SP1)은 상기 제 1 데이터라인(DL1)의 좌측에 형성되고 상기 제 2 서브픽셀(SP2)은 상기 제 1 데이터라인(DL1)의 우측에 형성된다.
상기 제 3 및 제 4 서브픽셀(SP3, SP4)은 제 2 데이터라인(DL2)을 공유하는데, 상기 제 3 서브픽셀(SP3)은 상기 제 2 데이터라인(DL2)의 좌측에 형성되고 상기 제 4 서브픽셀(SP4)은 상기 제 2 데이터라인(DL2)의 우측에 형성된다.
상기 제 1 서브픽셀(SP1)에는 제 1 및 제 2 박막트랜지스터(TFT-1, TFT-2)가 형성되고, 상기 제 2 서브픽셀(SP2)에는 제 3 박막트랜지스터(TFT-3)가 형성되고, 상기 제 3 서브픽셀(SP3)에는 제 4 박막트랜지스터(TFT-4)가 형성되고, 상기 제 4 서브픽셀(SP4)에는 제 5 및 제 6 박막트랜지스터(TFT-5, TFT-6)가 형성된다.
상기 제 1 내지 제 6 박막트랜지스터(TFT-1 ~ TFT-3)는 도 3에 도시된 제 1 내지 제 3 박막트랜지스터(TFT-1 ~ TFT-3)와 동일한 기능을 수행한다.
이때, 상기 제 2 서브픽셀(SP2)에 형성된 제 2 화소전극(310b)은 제 1 녹색 컬러필터(G1)에 대응되고 제 3 서브픽셀(SP3)에 형성된 제 3 화소전극(310c)은 제 2 녹색 컬러필터(G2)에 대응된다.
상기 제 2 게이트라인(GL2)으로 제 2 스캔신호(SP2)가 공급되고 상기 제 3 게이트라인(GL3)으로 제 1 스캔신호(SP1)가 공급되면, 상기 제 1 서브픽셀(SP1)에 형성된 제 1 및 제 2 박막트랜지스터(TFT-1, TFT-2)가 동시에 턴-온(turn-on) 되고 상기 제 1 데이터라인(DL1)으로부터 공급된 제 1 데이터 전압이 상기 제 1 화소전극(310a)에 인가된다.
이때, 상기 제 4 서브픽셀(SP4)에 형성된 제 5 및 제 6 박막트랜지스터(TFT-5, TFT-6)가 동시에 턴-온(turn-on) 되고 상기 제 2 데이터라인(DL2)으로부터 공급된 제 4 데이터 전압이 상기 제 4 화소전극(310d)에 인가된다.
이어서, 상기 제 2 게이트라인(GL2)으로 제 2 스캔신호(SP2)가 공급되고 상기 제 3 게이트라인(GL3)으로 제 1 스캔신호(SP1)가 공급되지 않으면, 상기 제 2 서브픽셀(SP2)에 형성된 제 3 박막트랜지스터(TFT-3)가 턴-온(turn-on) 되고 상기 제 1 데이터라인(DL1)으로부터 공급된 제 2 데이터 전압이 상기 제 2 화소전극(310b)에 인가된다.
이때, 상기 제 3 서브픽셀(SP3)에 형성된 제 4 박막트랜지스터(TFT-4) 또한 턴-온(turn-on) 되어 상기 제 2 데이터라인(GL2)으로부터 공급된 제 3 데이터 전압이 상기 제 3 화소전극(310c)에 인가된다.
도 8은 도 7의 액정패널에 실제로 공급되는 데이터 전압을 나타낸 도면이다.
도 4 및 도 8에 도시된 바와 같이, 상기 A 구간동안 상기 기수번째 데이터라인(DL1, DL3)으로 제 1 데이터 전압(R)이 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 1 데이터 전압(R)은 제 1 서브픽셀(SP1)로 공급된다.
동시에, 상기 우수번째 데이터라인(DL2, DL4)으로는 제 4 데이터 전압(B)이 공급되고 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 4 데이터 전압(B)은 제 4 서브픽셀(SP4)로 공급된다.
연속하여, 상기 B 구간동안 상기 기수번째 데이터라인(DL1, DL3)으로 제 2 데이터 전압(G1)이 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 2 데이터 전압(G1)은 제 2 서브픽셀(SP2)로 공급된다.
동시에, 상기 우수번째 데이터라인(DL2, DL4)으로 제 3 데이터 전압(G2)이 공급되고 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 3 데이터 전압(G2)은 제 3 서브픽셀(SP3)로 공급된다.
상기 제 2 및 제 3 데이터 전압(G1, G2)은 각각 제 2 및 제 3 서브픽셀(SP2, SP3)로 공급되고 상기 제 2 및 제 3 서브픽셀(SP2, SP3)로 공급된 제 2 및 제 3 데이터 전압(G1, G2)은 하나의 녹색 데이터 전압(G)을 표시한다.
상기 A 구간동안 공급된 제 1 및 제 4 데이터 전압(R, B)과 상기 B 구간동안 공급된 제 2 및 제 3 데이터 전압(G1, G2)은 각각 상기 제 1 내지 제 4 서브픽셀로 공급되어 하나의 계조를 표시하게 된다.
이어, 상기 C 구간동안 상기 기수번째 데이터라인(DL1, DL3)으로 제 1 데이터 전압(R)이 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 1 데이터 전압(R)은 제 1 서브픽셀(SP1)로 공급된다. 동시에 상기 우수번째 데이터라인(DL2, DL4)으로 제 4 데이터 전압(B)이 공급되고 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 4 데이터 전압(B)은 제 4 서브픽셀(SP4)로 공급된다.
연속하여, 상기 D 구간동안 상기 기수번째 데이터라인(DL1, DL3)으로 제 2 데이터 전압(G1)이 공급되고 상기 기수번째 데이터라인(DL1, DL3)으로 공급된 제 2 데이터 전압(G1)은 제 2 서브픽셀(SP2)로 공급된다. 동시에 상기 우수번째 데이터라인(DL2, DL4)으로 제 3 데이터 전압(G2)이 공급되고 상기 우수번째 데이터라인(DL2, DL4)으로 공급된 제 3 데이터 전압(G2)은 제 3 서브픽셀(SP3)로 공급된다.
상기 제 2 및 제 3 데이터 전압(G1, G2)은 각각 제 2 및 제 3 서브픽셀(SP2, SP3)로 공급되고 상기 제 2 및 제 3 서브픽셀(SP2, SP3)로 공급된 제 2 및 제 3 데이터 전압(G1, G2)은 하나의 녹색 데이터 전압(G)을 표시한다.
결국, 상기 C 구간동안 공급된 제 1 및 제 4 데이터 전압(R, B)과 상기 D 구간동안 공급된 제 2 및 제 3 데이터 전압(G1, G2)은 각각 상기 제 1 내지 제 4 서브픽셀(SP1 ~ SP4)로 공급되어 하나의 계조를 표시하게 된다.
상기 1 및 제 4 데이터 전압(R, B)은 상기 A, C 구간동안 제 1 및 제 4 서브픽셀(SP1, SP4)로 공급되고, 상기 제 2 및 제 3 데이터 전압(G1, G2)은 상기 B, D 구간동안 제 2 및 제 3 서브픽셀(SP2, SP3)로 공급된다. 상기 제 1 내지 제 4 서브 픽셀(SP1 ~ SP4)에 각각 제 1 내지 제 4 데이터 전압(R, G1, G2, B)이 공급되어 상기 액정패널(302) 상에 소정의 화상이 표시될 수 있다.
이와 같이, 본 발명에 따른 액정패널은 하나의 데이터라인을 2개의 서브픽셀이 공유함에 따라 데이터라인이 감소시키고 상기 데이터라인과 전기적으로 연결된 데이터 드라이버 IC의 출력채널 수를 감소시킬 수 있다. 상기 데이터라인 수가 감소하고 데이터 드라이버 IC의 출력 채널 수가 감소하게 됨에 따라 상기 데이터라인과 상기 데이터 드라이버 IC를 제조하는 제조비용이 절감될 수 있다.
본 발명에 따른 액정패널은 동일 데이터라인을 공유하는 제 1 및 제 2 서브픽셀과 상기 데이터라인과 인접한 데이터라인으로 정의된 제 3 서브픽셀로 하나의 화소영역을 정의함에 따라 한 화소영역당 2개의 데이터라인만을 필요로 하므로 데이터라인 수를 감소시킬 수 있다.
또한, 상기 데이터라인 수가 감소됨에 따라 상기 데이터라인과 전기적으로 연결된 데이터 드라이버 IC의 출력채널 수가 감소하여 상기 데이터라인과 상기 데이터 드라이버 IC를 제조하는 제조비용이 절감될 수 있다.
본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구 범위에 의해 정해져야 할 것이다.

Claims (37)

  1. 제 1, 제 2 및 제 3 서브픽셀;
    상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인;
    상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인; 및
    상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인;을 포함하는 것을 특징으로 하는 액정패널.
  2. 제 1항에 있어서,
    상기 제 1 서브픽셀은,
    상기 게이트라인의 제 1 스캔신호에 의해 스위칭 되는 제 1 스위치;
    상기 게이트라인에 인접한 또 다른 게이트라인의 제 2 스캔신호에 의해 스위칭 되는 제 2 스위치; 및
    상기 제 2 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  3. 제 2항에 있어서,
    상기 제 1 및 제 2 스위치는 박막트랜지스터인 것을 특징으로 하는 액정패널.
  4. 제 2항에 있어서,
    상기 또 다른 게이트라인은 상기 게이트라인의 다음단 게이트라인인 것을 특징으로 하는 액정패널.
  5. 제 2항에 있어서,
    상기 제 1 스위치는 게이트 단자가 상기 게이트라인에 연결되고 소스 단자가 상기 제 2 스위치의 게이트 단자에 연결되며 드레인 단자가 상기 또 다른 게이트라인에 연결되는 것을 특징으로 하는 액정패널.
  6. 제 2항에 있어서,
    상기 제 2 스위치는 게이트 단자가 상기 제 1 스위치의 소스 단자에 연결되고 소스 단자가 상기 전극에 연결되며 드레인 단자가 상기 제 1 데이터라인에 연결되는 것을 특징으로 하는 액정패널.
  7. 제 1항에 있어서,
    상기 제 2 서브픽셀은,
    상기 게이트라인의 제 1 신호에 의해 스위칭 되는 스위치; 및
    상기 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  8. 제 7항에 있어서,
    상기 스위치는 박막트랜지스터 인 것을 특징으로 하는 액정패널.
  9. 제 7항에 있어서,
    상기 스위치는 게이트 단자가 상기 게이트라인에 연결되고 소스 단자가 상기 전극에 연결되며 드레인 단자가 상기 제 1 데이터라인에 연결되는 것을 특징으로 하는 액정패널.
  10. 제 1항에 있어서,
    상기 제 3 서브픽셀은,
    상기 게이트라인의 제 1 스캔신호에 의해 스위칭 되는 제 1 스위치;
    상기 게이트라인에 인접한 또 다른 게이트라인의 제 2 스캔신호에 의해 스위칭 되는 제 2 스위치; 및
    상기 제 2 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  11. 제 10항에 있어서,
    상기 제 1 및 제 2 스위치는 박막트랜지스터 인 것을 특징으로 하는 액정패널.
  12. 제 10항에 있어서,
    상기 또 다른 게이트라인은 상기 게이트라안의 다음 단 게이트라인인 것을 특징으로 하는 액정패널.
  13. 제 10항에 있어서,
    상기 제 1 스위치는 게이트 단자가 상기 게이트라인에 연결되고 소스 단자가 상기 제 2 스위치의 게이트 단자에 연결되며 드레인 단자가 상기 또 다른 게이트라인에 연결되는 것을 특징으로 하는 액정패널.
  14. 제 10항에 있어서,
    상기 제 2 스위치는 게이트 단자가 상기 제 1 스위치의 소스 단자에 연결되고 소스 단자가 상기 전극에 연결되며 드레인 단자가 상기 제 2 데이터라인에 연결되는 것을 특징으로 하는 액정패널.
  15. 제 1, 제 2, 제 3 및 제 4 서브픽셀;
    상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인;
    상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인; 및
    상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함하는 것을 특징으로 하는 액정패널.
  16. 제 15항에 있어서,
    상기 제 1 서브픽셀은,
    상기 게이트라인의 제 1 스캔신호에 의해 스위칭 되는 제 1 스위치;
    상기 게이트라인에 인접한 또 다른 게이트라인의 제 2 스캔신호에 의해 스위칭 되는 제 2 스위치; 및
    상기 제 2 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  17. 제 16항에 있어서,
    상기 제 1 및 제 2 스위치는 박막트랜지스터인 것을 특징으로 하는 액정패널.
  18. 제16항에 있어서,
    상기 또 다른 게이트라인은 상기 게이트라인의 다음단 게이트라인인 것을 특징으로 하는 액정패널.
  19. 제 15항에 있어서,
    상기 제 2 서브픽셀은,
    상기 게이트라인의 제 1 신호에 의해 스위칭 되는 스위치; 및
    상기 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  20. 제 19항에 있어서,
    상기 스위치는 박막트랜지스터 인 것을 특징으로 하는 액정패널.
  21. 제 15항에 있어서,
    상기 제 3 서브픽셀은,
    상기 게이트라인의 제 1 신호에 의해 스위칭 되는 스위치; 및
    상기 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  22. 제 21항에 있어서,
    상기 스위치는 박막트랜지스터 인 것을 특징으로 하는 액정패널.
  23. 제 15항에 있어서,
    상기 제 4 서브픽셀은,
    상기 게이트라인의 제 1 스캔신호에 의해 스위칭 되는 제 1 스위치;
    상기 게이트라인에 인접한 또 다른 게이트라인의 제 2 스캔신호에 의해 스위칭 되는 제 2 스위치; 및
    상기 제 2 스위치에 연결된 전극을 포함하는 것을 특징으로 하는 액정패널.
  24. 제 23항에 있어서,
    상기 제 1 및 제 2 스위치는 박막트랜지스터 인 것을 특징으로 하는 액정패널.
  25. 제 23항에 있어서,
    상기 또 다른 게이트라인은 상기 게이트라안의 다음 단 게이트라인인 것을 특징으로 하는 액정패널.
  26. 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정패널;
    상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 게이트 드라이버; 및
    상기 제 1 및 제 2 데이터라인으로 제 1 내지 제 3 데이터 전압을 공급하는 데이터 드라이버를 포함하는 것을 특징으로 하는 액정표시장치.
  27. 제 26항에 있어서,
    상기 제 2 스캔신호는 상기 제 1 스캔신호 보다 넓은 폭을 갖도록 설정되는 것을 특징으로 하는 액정표시장치.
  28. 제 1, 제 2, 제 3 및 제 4 서브픽셀과, 상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인과, 상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정패널;
    상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 게이트 드라이버; 및
    상기 제 1 및 제 2 데이터라인으로 제 1 내지 제 4 데이터 전압을 공급하는 데이터 드라이버를 포함하는 것을 특징으로 하는 액정표시장치.
  29. 제 28항에 있어서,
    상기 제 2 스캔신호는 상기 제 1 스캔신호 보다 넓은 폭을 갖도록 설정되는 것을 특징으로 하는 액정표시장치.
  30. 제 1, 제 2 및 제 3 서브픽셀과, 상기 제 1 및 제 2 서브픽셀에 공통으로 연결된 제 1 데이터라인과, 상기 제 3 서브픽셀과 전기적으로 연결된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정표시장치에 있어서,
    상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 단계;
    상기 게이트라인의 구동에 따라 상기 제 1 및 제 2 데이터라인에 선택적으로 제 1, 제 2 및 제 3 데이터 전압을 공급하는 단계; 및
    상기 제 1, 제 2 및 제 3 데이터 전압에 해당하는 영상을 표시하는 단계를 포함하는 것을 특징으로 하는 액정표시장치의 구동방법.
  31. 제 30항에 있어서,
    상기 제 1 데이터라인은 제 1 구간동안 제 1 서브픽셀로 제 1 데이터 전압을 공급하고 상기 제 2 데이터라인은 상기 제 1 구간동안 제 3 서브픽셀로 제 3 데이터 전압을 공급하고, 상기 제 1 데이터라인은 제 2 구간동안 제 2 서브픽셀로 제 2 데이터 전압을 공급하고 상기 제 2 데이터라인은 상기 제 2 구간동안 어떠한 데이터 전압도 공급하지 않는 것을 특징으로 하는 액정표시장치의 구동방법.
  32. 제 31항에 있어서,
    상기 제 1 구간은 상기 게이트라인으로 상기 제 2 스캔신호가 공급되고 상기 게이트라인과 인접한 또 다른 게이트라인으로 상기 제 1 스캔신호가 공급되는 구간인 것을 특징으로 하는 액정표시장치의 구동방법.
  33. 제 31항에 있어서,
    상기 제 2 구간은 게이트라인으로 상기 제 2 스캔신호가 공급되고 상기 게이트라인과 인접한 또 다른 게이트라인으로 상기 제 1 스캔신호가 공급되지 않는 구간인 것을 특징으로 하는 액정표시장치의 구동방법.
  34. 제 1, 제 2, 제 3 및 제 4 서브픽셀과, 상기 제 1 및 제 2 서브픽셀 사이에 형성된 제 1 데이터라인과, 상기 제 3 및 제 4 서브픽셀 사이에 형성된 제 2 데이터라인 및 상기 제 1 및 제 2 데이터라인과 교차로 배열된 게이트라인을 포함한 액정표시장치에 있어서,
    상기 게이트라인으로 제 1 및 제 2 스캔신호를 공급하는 단계;
    상기 게이트라인의 구동에 따라 상기 제 1 및 제 2 데이터라인에 선택적으로 제 1, 제 2, 제 3 및 제 4 데이터 전압을 공급하는 단계; 및
    상기 제 1, 제 2, 제 3 및 제 4 데이터 전압에 해당하는 영상을 표시하는 단계를 포함하는 것을 특징으로 하는 액정표시장치의 구동방법.
  35. 제 34항에 있어서,
    상기 제 1 데이터라인은 제 1 구간동안 제 1 서브픽셀로 제 1 데이터 전압을 공급하고 상기 제 2 데이터라인은 상기 제 1 구간동안 제 4 서브픽셀로 제 4 데이터 전압을 공급하고, 상기 제 1 데이터라인은 제 2 구간동안 제 2 서브픽셀로 제 2 데이터 전압을 공급하고 상기 제 2 데이터라인은 상기 제 2 구간동안 제 3 서브픽셀로 제 3 데이터 전압을 공급하는 것을 특징으로 하는 액정표시장치의 구동방법.
  36. 제 35항에 있어서,
    상기 제 1 구간은 상기 게이트라인으로 상기 제 2 스캔신호가 공급되고 상기 제 1 게이트라인과 인접한 또 다른 게이트라인으로 상기 제 1 스캔신호가 공급되는 구간인 것을 특징으로 하는 액정표시장치의 구동방법.
  37. 제 35항에 있어서,
    상기 제 2 구간은 상기 게이트라인으로 상기 제 2 스캔신호가 공급되고 상기 게이트라인과 인접한 또 다른 게이트라인으로 상기 제 1 스캔신호가 공급되지 않는 구간인 것을 특징으로 하는 액정표시장치의 구동방법.
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