KR20060133792A - 칩 사이즈 패키지 - Google Patents
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Abstract
개시된 칩 사이즈 패키지는, 일측에 칩이 실장되는 기판과, 기판의 타측 상에 형성되며, 중심부가 돌출된 솔더 볼 랜드와, 솔더 볼 랜드 및 기판의 타측 표면 일부가 노출되도록 개방 영역을 가지며, 기판의 타측에 마련된 솔더 마스크 및 솔더 볼 랜드에 융착되는 솔더 볼을 포함하여, SMD 타입과 NSMD 타입이 혼합된 복합형 구조를 가짐으로서, 솔더 볼 랜드와 솔더 볼 간의 결합력을 안정되게 강화할 수 있고, SMD 타입과 NSMD 타입 각각의 장점을 보유할 수 있게 하는 효과를 제공한다.
솔더 볼, 솔더 볼 랜드
Description
도 1a는 종래의 SMD 타입 솔더 볼 랜드를 나타낸 평면도,
도 1b는 종래의 NSMD 타입 솔더 볼 랜드를 나타낸 평면도,
도 2는 본 발명의 일 실시예에 따른 칩 사이즈 패키지를 나타낸 단면도,
도 3은 도 2의 솔더 볼과 솔더 볼 랜드가 결합된 모습을 나타낸 평면도,
<도면의 주요부분에 대한 부호의 설명>
100... 칩 사이즈 패키지 110... 기판
120... 솔더 볼 랜드 121... 중심부
122... 다리 130... 솔더 마스크
131... 개방 영역 140... 솔더 볼
본 발명은 칩 사이즈 패키지에 관한 것으로서, 특히 솔더 볼이 실장되는 솔더 볼 랜드 구조가 SMD 및 NSMD 복합형으로 이루어진 칩 사이즈 패키지에 관한 것이다.
최근 전자 제품이 소형화 되면서 반도체가 실장될 공간은 더욱 줄어들고 있 는 반면, 제품은 더욱 다기능화하고 고성능화되기 때문에 이를 뒷받침해 줄 반도체의 종류 및 개수는 늘어나는 추세이며, 따라서 단위 체적당 실장 효율을 높이기 위해서 패키지(package)는 경박단소화에 부응할 수 밖에 없다. 이러한 요구로 개발되어 상용화된 것이 칩(chip) 크기와 거의 같은 크기의 패키지인 칩 사이즈 패키지(chip size package)이다.
이 칩 사이즈 패키지는 리드 프레임(lead frame) 대신 기판 하부에 마련된 솔더 볼 랜드(solder ball land)에 융착된 솔더 볼에 의하여 인쇄회로기판에 접합되는데, 솔더 볼이 융착되는 솔더 볼 랜드의 구조로 종래에는 도 1a 및 도 1b에 도시된 바와 같은 SMD 타입(solder mask defined type)과 NSMD 타입(non solder mask defined type)이 채용되고 있다.
먼저 도 1a를 참조하면, SMD 타입은 패턴 연결부(14) 및 이와 연결된 솔더 볼 랜드(10)의 외곽부(10a)가 솔더 마스크(16)에 의하여 덮여 있으며, 솔더 볼 랜드(10)의 중심부(10b)가 솔더 마스크(16)의 개방 영역(16a)에 의해 노출된다. 즉, 기판(미도시) 상에 원형 형태를 가진 구리 재질의 솔더 볼 랜드(10)가 적층되고, 솔더 볼 랜드(10)의 표면에는 솔더 볼(미도시)이 용이하게 용착되도록 니켈과 금이 차례로 도금되어 있으며, 솔더 볼 랜드(10)의 외곽부(10a)와 기판을 덮도록 솔더 마스크(16)가 적층된다.
그런데, 이와 같은 SMD 타입은 모듈 형성 시, 솔더 볼 시어(shear)값은 우수한 반면, 솔더 볼 랜드(10)와의 솔더 볼 결합력이 낮아, 열 사이클과 같은 온도 변화 하에서 솔더 볼 조인트(solder ball joint)의 신뢰성을 테스트하는 경우 솔더 볼이 솔더 볼 랜드(10)에서 쉽게 떨어지는 문제점이 있다.
다음으로 도 1b를 참조하면, NSMD 타입은 패턴 연결부(24)의 일부분(24a)이 솔더 마스크(26)에 의해 덮여 있으며, 패턴 연결부(24)의 잔여 부분(24b)과, 솔더 볼 랜드(20) 및 기판(1)의 일부분이 솔더 마스크(26)의 개방 영역(26a)에 의해 노출된다. 즉, 기판(1) 표면에 솔더 볼 랜드(20)가 적층되고, 솔더 볼 랜드(20) 및 기판(1)의 일부가 노출되도록 솔더 마스크(26)가 도포된다. 마찬가지로 솔더 볼 랜드(20)의 표면은 니켈과 금으로 차례로 도금된다.
그런데, 이와 같은 NSMD 타입은 솔더 볼 조인트의 신뢰성은 우수한 반면, 솔더 볼 랜드(20)와 연결되는 패턴 연결부(24)가 단선되는 이른바 패턴 크랙(crack) 현상이 나타나거나, 솔더 볼 랜드(20)가 기판(1)으로부터 분리되는 솔더 볼 랜드(20) 분리 현상이 나타나는 문제점이 있다.
본 발명은 상기의 문제점을 해결하기 위하여 창출된 것으로서, SMD 타입과 NSMD 타입 솔더 볼 랜드의 장점을 혼합하여, 외부의 열적, 기계적 변형에 대한 저항력을 향상시킬 수 있도록 개선된 칩 사이즈 패키지를 제공하는데 그 목적이 있다.
상기의 목적을 달성하기 위한 본 발명의 칩 사이즈 패키지는, 일측에 칩이 실장되는 기판; 상기 기판의 타측 상에 형성되며, 중심부가 돌출된 솔더 볼 랜드; 상기 솔더 볼 랜드 및 상기 기판의 타측 표면 일부가 노출되도록 개방 영역을 가지 며, 상기 기판의 타측에 마련된 솔더 마스크; 및 상기 솔더 볼 랜드에 융착되는 솔더 볼을 포함한다.
여기서, 상기 솔더 볼 랜드는 상기 돌출된 중심부의 하부에서 방사상으로 연장된 복수의 다리를 구비한 것이 바람직하다.
또한, 상기 복수의 다리는 "Y"자 형상인 것이 바람직하다.
또한, 상기 솔더 볼은 상기 솔더 볼 랜드의 중심부 전면적 및 상기 복수의 다리 일부분에 융착된 것이 바람직하다.
이하 첨부된 도면을 참조하면서 본 발명의 바람직한 실시예를 상세히 설명하기로 한다.
도 2는 본 발명의 일 실시예에 따른 칩 사이즈 패키지의 단면도를 나타낸 것이고, 도 3은 도 2의 평면도를 나타낸 것이다.
도면을 참조하면, 칩 사이즈 패키지(100)는 일측에 칩(미도시)이 실장된 기판(110)과, 기판(110) 타측에 마련된 솔더 볼 랜드(120)와, 솔더 볼 랜드(120)와 기판(110)의 타측 일부분이 노출되도록 개방 영역(131)을 가지며, 기판(110)의 타측 상에 마련된 솔더 마스크(130) 및 솔더 볼 랜드(120)에 용착되는 솔더 볼(140)을 포함한다.
기판(110) 타측에 마련되는 솔더 볼 랜드(120)는 솔더 볼(140)이 결합되는 부위로서 전체적으로 3차원 형상을 가지며, 중심부(121)가 타측 방향으로 돌출되고, 이 돌출된 중심부(121)의 하부에서 방사상으로 복수의 다리(122)가 연장된 형상을 가진다. 즉, 중심부(121)와 복수의 다리(122)는 서로 그 높이가 다르게 단을 이루는 형상이다.
복수의 다리(122)는 "Y"자 형상을 가질 수 있으며, 이 복수의 다리(122)는 솔더 볼 랜드(120)와 솔더 볼(140)과의 결합 시 접촉 면적을 넓게 해주며, 칩과 솔더 볼(140)을 전기적으로 연결시켜 준다.
이와 같은 솔더 볼 랜드(120)의 구조는, 기판(110) 중심부에 솔더 볼 랜드(120)가 마련되고, 솔더 볼 랜드(120) 및 기판(110) 상에 솔더 마스크(130)가 마련된다. 즉, 기판(110) 및 솔더 볼 랜드(120) 상에 적층된 솔더 마스크(130)의 개방 영역(131)으로 솔더 볼 랜드(120) 및 기판(110)의 일부분이 오픈된 형태이다. 이 솔더 볼 랜드(120)의 형상은 원형의 형상에서 부분적으로 에칭되어 "Y"자 형상을 가지며, 에칭된 부분으로는 기판(110)의 일부가 오픈된 형태이다. 이는 솔더 볼 랜드(120)의 구조 중 SMD 타입과 NSMD 타입이 혼합된 복합형 구조를 나타낸다. 즉, 솔더 볼 랜드(120)와 기판(110) 표면의 일부분이 오픈된 NSMD 타입과 솔더 볼 랜드(120)의 다리(122) 부분을 덮으므로서 기판(110)의 일부를 덮는 SMD 타입이 혼합된 형태이다.
솔더 볼(140)은 솔더 볼 랜드(120)에 연결되어 패키지(100)와 외부를 도통시키는 것으로, 솔더 볼 랜드(120)의 중심부(121) 전면적 및 복수의 다리(122) 일부분에 융착한다.
이와 같은 구조의 칩 사이즈 패키지는, SMD 타입과 NSMD 타입이 혼합된 복합형 구조를 가짐으로서, SMD 타입과 NSMD 타입 각각의 장점을 나타내게 된다. 즉, 솔더 볼이 솔더 마스크의 개방 영역에 노출된 솔더 볼 랜드의 중심부 전면적 및 다 리의 일부분과 결합하므로서, 솔더 볼의 결합력을 강화할 수 있게 된다.
상술한 바와 같이 본 발명의 칩 사이즈 패키지에 의하면, SMD 타입과 NSMD 타입이 혼합된 복합형 구조를 가짐으로서, 솔더 볼 랜드와 솔더 볼 간의 결합력을 안정되게 강화할 수 있고, SMD 타입과 NSMD 타입 각각의 장점을 보유할 수 있게 하는 효과를 제공한다.
본 발명은 상기에 설명되고 도면에 예시된 것에 의해 한정되는 것은 아니며, 다음에 기재되는 청구의 범위 내에서 더 많은 변형 및 변용예가 가능한 것임은 물론이다.
Claims (4)
- 일측에 칩이 실장되는 기판;상기 기판의 타측 상에 형성되며, 중심부가 돌출된 솔더 볼 랜드;상기 솔더 볼 랜드 및 상기 기판의 타측 표면 일부가 노출되도록 개방 영역을 가지며, 상기 기판의 타측에 마련된 솔더 마스크; 및상기 솔더 볼 랜드에 융착되는 솔더 볼을 포함한 것을 특징으로 하는 칩 사이즈 패키지.
- 제1항에 있어서,상기 솔더 볼 랜드는 상기 돌출된 중심부의 하부에서 방사상으로 연장된 복수의 다리를 구비한 것을 특징으로 하는 칩 사이즈 패키지.
- 제2항에 있어서,상기 복수의 다리는 "Y"자 형상인 것을 특징으로 하는 칩 사이즈 패키지.
- 제2항에 있어서,상기 솔더 볼은 상기 솔더 볼 랜드의 중심부 전면적 및 상기 복수의 다리 일부분에 융착된 것을 특징으로 하는 칩 사이즈 패키지.
Priority Applications (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020050053634A KR100701695B1 (ko) | 2005-06-21 | 2005-06-21 | 칩 사이즈 패키지 |
US11/471,079 US20060284316A1 (en) | 2005-06-21 | 2006-06-20 | Chip size package |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1020050053634A KR100701695B1 (ko) | 2005-06-21 | 2005-06-21 | 칩 사이즈 패키지 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR20060133792A true KR20060133792A (ko) | 2006-12-27 |
KR100701695B1 KR100701695B1 (ko) | 2007-03-29 |
Family
ID=37572607
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1020050053634A KR100701695B1 (ko) | 2005-06-21 | 2005-06-21 | 칩 사이즈 패키지 |
Country Status (2)
Country | Link |
---|---|
US (1) | US20060284316A1 (ko) |
KR (1) | KR100701695B1 (ko) |
Families Citing this family (3)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8604356B1 (en) | 2010-11-12 | 2013-12-10 | Amkor Technology, Inc. | Electronic assembly having increased standoff height |
JP2015056561A (ja) * | 2013-09-12 | 2015-03-23 | イビデン株式会社 | プリント配線板及びその製造方法 |
TWI669801B (zh) * | 2018-09-04 | 2019-08-21 | 頎邦科技股份有限公司 | 撓性基板 |
Family Cites Families (5)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR0149790B1 (ko) * | 1995-07-13 | 1998-12-15 | 김광호 | 돌출된 외부 접속 단자가 일면에 형성된 기판 및 그의 제조방법과 그 기판을 이용한 패키지 및 그의 제조방법 |
JPH10303252A (ja) * | 1997-04-28 | 1998-11-13 | Nec Kansai Ltd | 半導体装置 |
US6201305B1 (en) * | 2000-06-09 | 2001-03-13 | Amkor Technology, Inc. | Making solder ball mounting pads on substrates |
US6552436B2 (en) | 2000-12-08 | 2003-04-22 | Motorola, Inc. | Semiconductor device having a ball grid array and method therefor |
KR100523330B1 (ko) * | 2003-07-29 | 2005-10-24 | 삼성전자주식회사 | Smd 및 nsmd 복합형 솔더볼 랜드 구조를 가지는bga 반도체 패키지 |
-
2005
- 2005-06-21 KR KR1020050053634A patent/KR100701695B1/ko not_active IP Right Cessation
-
2006
- 2006-06-20 US US11/471,079 patent/US20060284316A1/en not_active Abandoned
Also Published As
Publication number | Publication date |
---|---|
US20060284316A1 (en) | 2006-12-21 |
KR100701695B1 (ko) | 2007-03-29 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A201 | Request for examination | ||
E902 | Notification of reason for refusal | ||
E701 | Decision to grant or registration of patent right | ||
GRNT | Written decision to grant | ||
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