KR200314765Y1 - 비.지.에이반도체패키지 - Google Patents

Abstract

비. 지. 에이(Ball Grid Array) 반도체 패키지에 관해 개시된다. 개시된 비. 지. 에이 반도체 패키지는반도체 칩이 실장 되는 기판과; 상기 기판의 중간에 설치되며,대칭되는 형태의 방사형 방열코아가 측면에 형성되고, 저면에 주름 또는 돌기가 형성되고, 상기 저면이 하부로 노출되는 방열판과; 상기 방열판의 하부에 설치되는 솔더볼;을 구비한다.

이러한 반도체 패키지에 의하면 반도체 칩의 열을 효과적으로 외부로 용이하게 방출함으로써 내부에 누적되는 열적 스트레스를 해소하여 상기 반도체 칩의 에러를 방지하며, 상기 열로 인해 발생되는 반도체 패키지의 휘어짐과 크랙 등의 반도체 패키지의 손상을 방지하여 수명을 연장하는 효과가 있다.

Description

비. 지. 에이 반도체 패키지{Ball grid array type I.C. package}

본 고안은 비. 지. 에이 반도체 패키지에 관한 것으로서, 특히 방열코아가 설치된 방열판을 삽입하여 방열성이 개선된 비. 지. 에이 반도체 패키지에 관한 것이다.

반도체 패키지는 그 구조에 따라 칩 온 보드(chip on board)형 , 리드 온 칩(lead on chip)형, 비. 지. 에이(ball grid array)형 등 여러 종류로 구분된다. 특히, 비. 지. 에이 반도체 패키지는 솔더볼(solder ball)을 이용하여 주기판과 접합되어 전기적으로 통전되는 구조를 가진다.

도 1에는 종래의 비. 지. 에이 반도체 패키지의 구성이 도시되어 있다.

도면을 참조하면, 종래의 비. 지. 에이 반도체 패키지는 레진으로 된 기판(16)과 상기 기판(16) 상에 양면 접착 테이프(미도시)로 접착된 반도체 칩(11), 상기 반도체 칩(11)의 주위에 형성된 상부 동박인쇄회로(14)와 상기 상부 동박인쇄회로(14)의 하부에 형성된 하부 동박인쇄회로(15)를 포함한다. 상기 반도체 칩(11)은 골드 등의 재질로 된 와이어(12)에 의해 상부 동박인쇄회로(14)와 본딩되고 상기 상부 동박인쇄회로(14), 반도체 칩(11), 와이어(12)는 몰드레진(13)에 의해 몰딩되어 보호된다.

상기와 같은 구조를 가진 종래의 비. 지. 에이 반도체 패키지는 다음과 같이동작한다.

먼저 미도시된 메인 회로로부터 전압이 인가되면 먼저 솔더볼(17)을 통하여 비. 티. 레진 등으로 된 기판(16)의 상, 하부에 형성된 동박인쇄회로(14)(15)로 통전되고, 이후 상기 상부 동박인쇄회로(14)로 부터 와이어 본딩된 반도체 칩(11)으로 전압이 인가된다.

이후 상기 반도체 칩(11)이 연산작업을 수행을 수행하면, 상기 반도체 칩(11) 내부의 집적회로를 구성하는 반도체에서 발열이 수반된다. 그러나, 상기한 비. 지. 에이 반도체 패키지는 상기 반도체 칩(11) 주위의 기판(16) 및 몰드레진(13) 등으로, 반도체 칩(11)으로부터 발생되는 열을 용이하게 전달하지 못하여 열 발산 효율이 떨어진다. 따라서 누적되는 열적 스트레스로 인하여 상기 반도체 칩(11)의 작동이 중단되거나 반도체 패키지가 휘어지는 등의 손상이 초래될 수 있다.

본 고안은 상기 문제점을 해결하기 위하여 안출된 것으로서, 방열코아가 형성된 방열판을 삽입함으로써 반도체 칩으로부터 발생되는 열을 용이하게 방출시키는 비. 지. 에이 반도체 패키지를 제공함에 그 목적이 있다.

도 1은 종래의 비. 지. 에이 반도체 패키지를 개략적으로 도시한 단면도이다.

도 2a 내지 도 2c는 본 고안에 따른 비. 지. 에이 반도체 패키지에 삽입되는 다양한 방열코아가 형성된 방열판을 개략적으로 도시한 평면도이다.

도 2d는 본 고안에 따른 비. 지. 에이 반도체 패키지에 삽입되는 또 다른 형태의 방열플랜지가 형성된 방열판을 개략적으로 도시한 평면도이다.

도 3은 본 고안의 제1실시 예에 따른 비. 지. 에이 반도체 패키지를 개략적으로 도시한 단면도이다.

도 4는 본 고안의 제2실시 예에 따른 비. 지. 에이 반도체 패키지를 개략적으로 도시한 단면도이다.

도 5는 본 고안의 제3실시 예에 따른 비. 지. 에이 반도체 패키지를 개략적으로 도시한 단면도이다.

< 도면의 주요 부분에 대한 부호 설명 >

11...반도체 칩12...와이어

13...몰드레진14...상부 동박인쇄회로

16...기판 17...솔더볼

38,48,58...방열판38b,48b,58b....방열코아

상기 목적을 달성하기 위하여 본 고안에 따른 비. 지. 에이 반도체 패키지 는 반도체 칩이 실장 되는 기판과;상기 기판의 중간에 설치되며, 대칭되는 형태의 방사형 방열코아가 측면에 형성되는 방열판을 특징으로 한다.

또한 상기 방열코아는 그 단면이 다각형 또는 봉 형태로 되어 다수개가 형성되는 것을 더 포함하는 것이 바람직하다. 또한 상기 방열코아는 상기 방열판의 측면 주위에 상기 방열판보다 얇은 두께로 형성되는 사각의 플랜지 형태인 것을 더 포함하는 것이 바람직하다.

이하, 첨부된 도면을 참조하여 본 고안의 바람직한 실시 예를 상세히 설명하기로 한다.

본 고안의 제1실시 예에 따른 비. 지. 에이 반도체 패키지가 도 3 에 도시되어 있다.

상기 도면을 참조하면, 본 고안에 따른 비. 지. 에이 반도체 패키지는 외부기판의 연결단자(미도시)와 표면 실장(SURFACE MOUNTING)되도록 하는 솔더볼(17), 상기 솔더볼(17)과 접합되는 기판(16), 상기 기판(16)의 중간에 설치된 하부 동박인쇄회로(15), 또한 상기 기판(16)의 상부에 설치되는 상부 동박인쇄회로(14), 상기 상부 동박인쇄회로(14)와 와이어(12)에 의한 본딩으로 연결되는 반도체 칩(11) 및 상기 반도체 칩(11)을 외포하는 몰드레진(13)을 포함한다.

상기 반도체 칩(11)의 하단에는 본 발명의 특징에 따른 방열판(38)이 설치되는 데 상기 방열판(38)은 사각형 본체(38a)의 측면에 다수개의 방사형 방열코아(38b)를 포함한다.

또한 상기 반도체 칩(11)과 상기 방열판(38) 사이에는 양면 절연 테이프(미도시)가 개재되어 상기 반도체 칩(11)을 방열판(38)에 고정하고 방열판(38)과 칩(11) 간을 절연한다.

상기 방열판(38)은 기판(16)보다 높은 열 전도성을 가지는 재료로 제작되며, 예컨데 알루미늄, 알루미늄 합금, 구리, 구리 합금, 니켈-철 합금 등의 재료로 제작되는 것이 바람직하다.

또한 상기 방열판(38) 하부의 대응되는 기판(16) 상에는 다수개의 솔더볼(17a)(17b)이 설치되는 것을 더 포함되는 것이 바람직하다.

상기와 같은 구조를 가진 본 고안의 제1실시 예에 따른 비. 지. 에이 반도체 패키지는 다음과 같이 동작한다.

먼저 미도시된 메인 회로로부터 전압이 인가되면 솔더볼(17)을 통하여 기판(16)의 상면과 내부에 형성된 동박인쇄회로(14)(15)로 통전되고, 이후 상기 상부 동박인쇄회로(14)와 와이어(12)로 본딩된 반도체 칩(11)으로 통전된다.

이후 상기 반도체 칩(11)이 연산작업을 수행시 상기 반도체 칩(11) 내부의 집적된 반도체에 의해 발열이 수반된다. 상기 열의 대부분은 방열판(38)의 본체(38a) 측으로 일차 전달된다. 이후 본체(38a) 측으로 전달된 상기 열은 열 방출의 통로 역할을 하는 방열코아(38b)를 통하여 주위의 패키지 측으로 용이하게 방출된다. 이로써 상기 반도체 칩(11)에서 발열된 열이 원활하게 배출됨으로써 반도체 칩(11) 자체의 작동이 원활하게 되고, 또한 패키지의 손상을 방지시킨다.

본 고안의 제2실시 예에 따른 비. 지. 에이 반도체 패키지가 도 4 에 도시되어 있다.

상기 도면을 참조하면, 본 고안의 비. 지. 에이 반도체 패키지는 본 고안의 특징에 따른 방열판(48)의 사각형 본체(48a) 하부가 상기 기판(16)에 외포되지 않고 노출되는 구조이다. 상기 방열판(48)의 본체(48a) 측면에 형성된 방사형 방열코아(28b)의 장착위치는 동박인쇄회로들(14)(15) 사이에 마련되도록 적의 조정되어지며, 또한 상기 하부 동박인쇄회로(15)의 중심부는 상기 방열판(48)의 본체(48a)가 관통되도록 형성된다. 기타의 구성 및 작용은 제1실시 예와 동일함으로 상세한 설명은 제외한다.

본 고안의 제3실시 예에 따른 비. 지. 에이 반도체 패키지가 도 5 에 도시되어 있다.

상기 도면을 참조하면, 본 고안의 비. 지. 에이 반도체 패키지는 본 고안의 특징에 따른 방열판(58)의 사각형 본체(58a) 저면(58c)이 상기 기판(16)에 외포되지 않고 노출되는 구조이며, 상기 저면(58c)은 돌기 또는 주름 형태로 형성된다. 상기의 돌기 등의 형태는 예컨데 단면이 삼각형 등의 형상으로 형성됨으로써 그 표면적이 증대되어 열 발산이 원활해진다.또한 상기 방열판(58)의 측면에 설치된 방사형 방열코아(58b)는 동박인쇄회로들(14)(15) 사이의 소정위치에 장착되도록 적의조정 되어지며 또한 상기 하부의 동박인쇄회로(15)의 중심부는 상기 방열판(58)이 관통되도록 형성된다.

기타의 구성 및 작용은 제1실시 예와 동일하므로 상세한 설명은 생략한다.

상기 각 실시 예의 각각의 방열판(38)(48)(58)은 그 본체(38a)(48a)(58a)의 측면에 형성된 방열코아(38b)(48b)(58b)의 부착위치와 개수 및 형태에 따라 다양하게 변화 될 수 있다.

도 2a 내지 도 2d에는 상기 방열코아(38b)(48b)(58b)의 다양한 변형 예를 상세하게 도시하고 있다.

도 2a를 참조하면 사각형 본체(28a)와 상기 본체(28a)의 측면에 방사형 방열코아(28b)가 설치된 방열판이 평면도로 도시되어 있다.

도 2b를 참조하면 중앙의 사각형 본체(28a), 상기 본체(28a)의 각 측면에 두 개가 소정간격으로 이격된 방열코아(28c)가 설치된 방열판이 평면도로 도시되어 있다.

도 2c를 참조하면 사각형의 본체(28a)와 그 모서리 부위에서 연장되는 방사형 방열코아(28d)가 설치된 방열판이 평면도로 도시되어 있다.

또한 여기서 상기 도2a 내지 도 2c의 방열코아의 단면 형상은 다각형이거나 원형인 것이 더 포함되는 것이 바람직하다.

도 2d를 참조하면 사각형 본체(28a)와 그 측면에서 연장되는 형태의 방열플랜지(28e)로 이루어진 방열판이 평면도로 도시되어 있다. 상기 방열플랜지(28e)의 두께는 본체(28a)의 두께 보다 얇게 형성되는 것이 바람직하다. 또한 도면에 도시되지는 않았지만, 상기 방열플랜지(28e)의 표면은 요철로 형성되는 것을 더 포함하는 것이 바람직하다.

본 고안에 따른 비. 지. 에이 반도체 패키지는 방열을 위한 방열코아를 형성한 방열판을 삽입함으로서,

첫째, 이를 통하여 반도체 칩의 열을 효과적으로 외부로 용이하게 방출함으로서 내부에 누적되는 열적 스트레스를 해소하여 상기 반도체 칩의 에러를 방지하며, 둘째, 열로 인해 발생되는 반도체 패키지의 휘어짐과 크랙 등의 반도체 패키지의 손상을 방지하여 수명을 연장하는 효과가 있다.

본 고안은 도면에 도시된 일 실시 예를 참고로 설명되었으나. 이는 예시적인 것에 불과하며, 당해 분야에서 통상적 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시 예들이 가능하다는 점을 이해할 것이다. 따라서, 본 고안의 진정한 기술적 보호 범위는 첨부된 등록 청구범위에 의해서 정해져야 할 것이다.

Claims (1)

1. 반도체 칩이 실장 되는 기판과;

   상기 기판의 중간에 설치되고, 대칭되는 형태의 방사형 방열코아가 측면에 형성되며 저면에 주름 또는 돌기가 형성되고, 상기 저면이 하부로 노출되는 방열판과;

   상기 방열판의 하부에 설치되는 솔더볼;을 구비하는 비. 지. 에이 반도체 패키지.