KR20020024614A - 교류 플라즈마 디스플레이 패널의 유지방전 회로 - Google Patents

교류 플라즈마 디스플레이 패널의 유지방전 회로 Download PDF

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Abstract

본 발명은 교류 플라즈마 디스플레이 패널의 X 전극과 Y 전극의 유지방전회로를 하나의 전력회수회로로 구동할 수 있도록 한 교류 플라즈마 디스플레이 패널의 유지방전회로에 관한 것으로,
본 발명은 교류 플라즈마 디스플레이 패널의 유지방전 회로에 있어서, 상기 플라즈마 디스플레이 패널의 X 전극 및 Y 전극에 전력을 회수하는 전력회수부와; 상기 전력회수부로부터 인가되는 전압에 의하여 펄스 전압원을 발생하는 인덕터와; 상기 인덕터의 펄스 전압원으로 X,Y전극을 유지방전하는 X,Y 전극 유지방전부와; 상기 X,Y전극 유지방전부에 제어펄스 전압원으로 인가하는 스위치로 구성하여서 된 것을 특징으로 한다.

Description

교류 플라즈마 디스플레이 패널의 유지방전 회로{AC plasma display panel of sustain circuit}
본 발명은 교류 플라즈마 디스플레이 패널(AC plasma display panel; PDP)의 유지방전회로에 관한 것으로, 보다 상세하게는 교류 플라즈마 디스플레이 패널의 X전극과 Y 전극을 하나의 유지방전부로 구동할 수 있도록 한 교류 플라즈마 디스플레이 패널의 유지방전회로에 관한 것이다.
일반적으로 플라즈마 디스플레이 패널은 기체방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 차세대 평판 디스플레이 장치로서, 상기 플라즈마 디스플레이 패널은 크기에 따라 수십에서 수백만개 이상의 픽셀이 매트릭스(matrix)형태로 배열되어 있다.
그리고 상기 플라즈마 디스플레이 패널은 인가되는 구동전압 파형의 형태와 방전셀의 구조에 따라 직류(DC)형과 교류(AC)형으로 구분된다.
상기 직류형과 교류형의 구조적인 가장 큰 차이는 직류형의 경우 전극이 방전공간에 그대로 노출되어 있어 전압이 인가되는 동안 방전공간에 그대로 흐르게 된다.
그러므로 전류제한을 위한 저항을 외부적으로 만들어 주어야 하는 단점이 있다. 반면에 교류형의 경우 전극을 유전체층이 덮고 있어 자연스러운 용량성 형성으로 전류가 제한되며, 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비하여 수명이 길다.
상기 교류 플라즈마 디스플레이 패널의 중요한 특성중의 하나인 메모리특성도 전극을 덮고 있는 유전체층에 의한 용량성으로부터 기인한다.
상기 교류 플라즈마 디스플레이 패널의 발광원리를 보면, X전극과 Y전극에 펄스형태의 전위차가 형성되어 방전이 일어나고, 이때 방전과정에서 생성된 진공 자외선이 적(R),녹(G),청(B)의 형광체에 각각 여기되면서 상기 각각의 형광체는 광조합에 의한 발광을 하게 된다.
상기 방전은 여러가지 파라메터(parameter)에 영향을 받게 되지만, 상기 플라즈마 디스플레이 패널 내부의 방전기체의 종류와 압력 그리고 산화마그네슘(MgO) 보호막의 이차전자 방출특성에 크게 관계하며, 전극의 구조와 구동조건에 따라 많이 달라진다.
여기서 상기 교류 플라즈마 디스플레이 패널의 구동을 위한 종래 기술을 살펴보면, 도 1 에 도시한 바와같이 L.F.Webber에 의해 발표된 SID'87 Digest, pp.92-95에 서술된 교류형 플라즈마 디스플레이 패널의 유지방전 회로도로서, 상기 교류형 플라즈마 디스플레이 패널의 구동회로는 X전극의 유지방전 회로와 Y전극의 유지방전 회로(도시되지 않음)가 각각 동일하게 구성되게 된다.
그러나 편의상 하나의 전극에 대한 유지방전 회로를 설명하면, 두개의 MOSFET 스위치(S1,S2)와 다이오드(D1,D2) 및 캐패시터(Cc)로 구성되는 전력 회수부와; 직렬 연결된 두개의 MOSFET 스위치(S3,S4)로 구성되는 유지방전부와; 상기 전력회수부의 다이오드(D1,D2)와 유지방전부의 MOSFET 스위치(S3,S4)간에는 인덕터(Lc)로 연결되고. 상기 유지방전부에는 패널인 캐패시터(Cp)를 가지는 부하가 연결된다. 이때, 기생저항은 무시한다.
상기와 같이 구성되는 종래 유지방전 회로는 도 2에 도시한 바와 같이 MOSFET 스위치(S1∼S4)의 스위칭 시퀀스(sequence)동작에 따라 4가지 모드로 동작하게 되고, 상기 스위칭 시퀀스 동작에 따라 출력전압(Vp)과 인덕터(Lc)에 흐르는 전류(IL)의 파형이 각각 나타나게 된다.
따라서 초기상태에서는 스위치1(S1)이 도통되기 직전에 스위치4(S4)가 도통되어 있어 패널의 양단 전압(Vp)은 "0"으로 유지하게 된다. 이때 전력 회수용 캐패시터(Cc)는 외부 인가전압(+Vs)의 1/2만큼의 전압(+Vs/2)이 미리 충전되어 유지방전 개시시 돌입 전류가 발생되지 않도록 한다.
상기와 같이 패널의 양단전압(Vp)을 "0"으로 유지한 상태에서 "t0" 시점이 되면, 먼저 스위치1(S1) 온(ON), 스위치2,3,4(S2,S3,S4) 오프(OFF) 되는 모드1의 동작이 시작된다.
따라서 모드1 동작 구간(t0<t<t1)에는 전력 회수용 캐패시터(Cc), 스위치1(S1), 다이오드1(D1), 인덕터(Lc) 및 패널 캐패시터(Cp)의 경로로 LC 공진회로가 형성되어, 인덕터(Lc)에 전류(IL)가 흐르고 패널 출력전압(Vp)은 증가한다.
이때 도 2에 도시한 바와 같이 인덕터(Lc)에 흐르는 전류(IL)는 기생 저항등에 의하여 서서히 감소하여 "t1"시점에서 "0"이 되고, 출력전압(Vp)은 외부 인가전압(+Vs)이 된다.
상기 모드 2 동작 구간 t1 이 시작되면 상기 스위치1,2,4(S1,S2,S4) 오프, 유지방전부의 스위치3(S3)온 되면서 모드2의 동작이 시작되게 되는데, 이때, 스위치3(S3)의 양단에 걸리는 전압은 "t1" 시점에서 "0"이므로 영전압 스위칭(zero voltage switching)을 하게 되고, 이상적으로 스위칭 손실은 "영(zero)"이 된다.
그래서, 모드 2 구간동안(t1<t<t2)에서는 도 2에 도시한 바와 같이, 외부 인가전압(+Vs)이 스위치3(S3)를 통해서 그대로 패널 캐패시터(Cp)로 흐르게 되어 패널의 출력전압(Vp)은 방전을 유지하게 된다.
상기 출력전압(Vp)의 방전을 유지한 상태에서 모드 2 구간(t1)이 완료되고 모드 3 구간(t3)이 시작되면 스위치1,3,4(S1,S3,S4)는 오프 되고 스위치2(S2)가 온되면서 모드3의 동작이 시작된다.
따라서 모드 3 구간(t2<t<t3)동작은 모드1의 반대 경로 즉, 패널 캐패시터(Cp), 인덕터(Lc), 다이오드2(D2), 스위치2(S2), 전력 회수용 캐패시터(Cc) 경로로 LC공진회로가 형성되어, 도 2 에 도시한 바와 같이 인덕터(Lc)에 공진전류(IL)가 흐르고 출력전압(Vp)은 감소하여 "t3"시점에서 인덕터(Lc)의 전류 및 출력전압(Vp)은 "0"이 된다.
이어서 상기 스위치1,2,3(S1,S2,S3)가 차단되고 유지방전부의 스위치4(S4)가 도통되면 모드4의 동작이 시작되어 스위치4(S4)의 양단에 걸리는 전압은 모드 3 "t3" 시점에서 "0"이므로 영전압 스위칭을 하게 되고, 이상적으로 스위칭 손실은 영이 된다.
그래서, 모드 4 구간 동안(t3<t<t4)은 도 2에 도시한 바와 같이, 출력전압(Vp)은 "0" 그대로 유지한다. 이 상태에서, 스위치1(S1)이 다시 도통되면 모드1의 동작으로 사이클이 반복된다.
상기와 같이 구성된 종래 교류 플라즈마 디스플레이 패널의 유지방전회로는 X 및 Y전극 모두 고려할 경우 전력회수부의 스위치수가 많아 구동회로가 복잡해지고, 고가의 MOSFET 스위치 소자들 구성에 따른 저가의 유지방전 구동회로의 구현이 어렵다.
또한, 전력회수부의 효율을 향상시키려면 전압상승 및 하강시간이 길어지는 단점이 있어, 짧은 전압 상승 및 하강시간과 우수한 전력회수부의 효율 모두를 만족시키기 어려운 문제점이 있다.
뿐만 아니라 상기 유지방전부의 기생 저항성분 및 화상에 따른 패널 캐패시턴스의 변화를 고려하면 회로를 구성하는 모든 스위치가 이상적인 영전압 스위칭 동작이 불가능하여 스위치의 턴-온(turn-on)시 스위칭손실이 매우 커진다.
그리고, 발광개시 직후 전력회수 캐패시터에 전압이 Vs/2만큼 미리 충전되어 있지 않은 상태에서는 방전유지 개시시 매우 큰 돌입전류가 발생하여 이를 제한하는 별도의 보호회로를 필요로 하게 되는 문제점이 있다.
물론 상기 웨버 방식의 유지방전회로 이외에 사까이(SAKAI)방식에 의한 전력회수 구동회로가 있으나, 상기 사까이 방식의 경우 인가전압의 상승 및 하강시간이 짧을 때 전력회수율이 낮아지는 결점이 있고, 인가 전압상승 및 하강시간은 같은 조건하에서 종래의 웨버 방식에 의한 전력회수회로와 거의 같으며, 전력회수율이 회로 특성에 따라 조금 달라지는 정도에 불과할 뿐이다.
따라서 본 발명의 목적은 교류형 플라즈마 디스플레이 패턴의 X 및 Y전극을 구동하는 각각 유지방전회로를 하나의 회로로 구성하여, 최소의 부품 구성에 의한구동으로 신뢰성을 향상하고자 하는데 있다.
본 발명은 다른 목적은 회로의 기생저항의 영향과 패널 캐패시턴스의 변화에도 모든 스위치들의 영전압 스위칭 동작을 보장함으로써 전력회수율을 향상하고, 유지방전 개시시 돌입 전류 발생을 방지하여 스위칭 손실의 저감에 따른 고효율화 시키고자 하는데 있다.
도 1은 종래 교류 플라즈마 디스플레이 패널의 유지방전 회로도
도 2는 도 1 의 동작을 설명하기 위한 파형도
도 3은 본 발명 교류 플라즈마 디스플레이 패널의 유지방전 회로도
도 4는 도 3 의 동작을 설명하기 위한 파형도.
<도면의 주요부분에 대한 부호의 설명>
21 : 전력회수부 22 : X전극 유지방전부
23 : Y전극 유지방전부 24 : 패널(부하)
Sa,S1∼S4 : MOSFET스위치 Lp : 인덕터
Cp : 캐패시터 C1,C2 : 블로킹 캐패시터
Vs : 외부인가전압
상기의 목적을 실현하기 위한 본 발명은 교류 플라즈마 디스플레이 패널의 유지방전 회로에 있어서, 상기 플라즈마 디스플레이 패널의 X 전극 및 Y 전극에 전력을 회수하는 전력회수부와; 상기 전력회수부로부터 인가되는 전압에 의하여 삼각파 전류원을 발생하는 인덕터와; 상기 인덕터의 삼각파 전류원에 따라 전압 상승및 하강시간이 제어된 제어펄스 전압원을 인가하는 스위치와; 상기 스위치로 부터 제어 펄스 전압원으로 X,Y 전극을 유지 방전하는 X,Y 전극유지방전부로 구성하여서 된 것을 특징으로 한다.
이하, 첨부한 도면들을 참조하여 본 발명의 바람직한 실시예를 상세히 기술하기로 한다.
도 3은 본 발명 교류 플라즈마 디스플레이 패널의 제어펄스 전압원 유지방전 회로도이고, 도 4는 도 3 의 동작을 설명하기 위한 파형도로서, 상기 플라즈마 디스플레이 패널(24)의 X 전극 및 Y 전극에 전력을 회수하는 전력회수부(21)와; 상기 전력회수부(21)로 부터 인가되는 전압에 의하여 삼각파 전류원을 발생하는 인덕터(Lp)와; 상기 인덕터(Lp)의 삼각파 전류원에 따라 전압 상승및 하강시간이제어된 제어펄스 전압원을 인가하는 스위치(Sa)와; 상기 스위치(Sa)의 제어 펄스 전압원으로 X,Y 전극을 유지 방전하는 X,Y 전극유지방전부(22)(23)로 구성 된다.
상기 전력회수부(21)는 외부 인가전압(Vs)이 충방전 되도록 직렬 접속되는 블로킹 캐패시터(C1,C2)로 구성된다.
상기 인덕터(Lp)는 외부 인가전압으로 펄스 전압원 발생 및 영전압 스위칭 동작을 유지하는 코일로 구성되어 상기 블로킹 캐패시터(C1)(C2)사이에 접속되게 된다.
상기 X전극 유지방전부(22)는 상기 인덕터(Lp)와 접속되어 패널의 X 전극에 인가된 전압을 방전 유지하며, 두개의 MOSFET 스위치(S1,S2)가 직렬로 구성된다.
상기 Y전극 유지방전부(23)는 상기 X 전극 유지방전부(22)와 병렬로 접속되어 패널의 Y 전극에 인가된 전압을 방전 유지하며, 두개의 MOSFET 스위치(S3,S4)가 직렬로 구성된다.
상기 스위치(Sa)는 상기 브로킹 캐패시터(C1),인덕터(Lp)와 X,Y 전극 유지방전부(22)와 접속되어 상기 X,Y 전극 전압 및 외부 인가전압(Vs)을 펄스 전압원 형태로 도통/차단하는 단일 MOSFET 스위치로 구성된다.
상기 X전극 및 Y전극 유지방전부(22,23)사이에는 캐패시터(Cp)를 가지는 부하로 정의된 패널(24)이 연결된다.
상기와 같이 구성되는 본 발명은 도 4 에 도시한 바와 같이, 스위치(Sa),스위치(S1,S4)(S2,S3)가 스위칭 시퀀스에 따라 5가지 모드로 동작한다.
초기상태에서는 스위치(Sa) "오프(OFF)"상태이고, 나머지 스위치(S1∼S4) "온(ON)"상태로 되어 있어 패널(24)의 양단 전압(Vp)은 "0"이고 인덕터(Lp)에 흐르는 전류(IL)는 양(positive)의 방향으로 흐른다.
이때, 서로 직렬 연결되어 있는 전력회수부(21)의 블로킹 캐패시터(C1,C2)는 각각 외부 인가전압(+Vs)의 1/2만큼의 전압(+Vs/2)이 걸려 있어, 처음 기동시에 돌입전류 발생을 방지한다.
이 상태에서 "t0" 시점이 되면, 스위치(Sa) "오프", X전극 유지방전부(22)의 스위치1(S1)와 Y전극 유지방전부(23)의 스위치4(S4) "온", 반면에 유지방전부(22)의 스위치2(S2)와 Y전극 유지방전부(23)의 스위치3(S3) "오프" 상태로 차단되어 모드 1의 동작이 시작된다.
이때 모드1 구간(t0<t<t1)에서는 블로킹 캐패시터(C2), 인덕터(Lp), 스위치1(S1), 패널 캐패시터(Cp), 스위치4(S4)의 경로로 LC공진회로가 형성되어, 출력전압(Vp)은 증가한다. 즉, 도 4에 도시된 바와 같이, 패널(24)의 양단전압(Vp)은 "t1"시점에서 외부 인가전압(+Vs)이 된다.
이 상태에서 인덕터(Lp)에 흐르는 전류(IL)는 상기 스위치(Sa)의 바디다이오드(body diode)를 통해 흐르고 스위치(Sa) 양단전압이 "0"이 되어 스위칭 손실 "영(zero)"으로 도 4에 보여진 바와 같이 "턴-온(turn-on)"상태로 되어 모드2의 동작이 시작된다.
이때 모드2 구간(t1<t<t3)에서는 도 4에 도시된 바와 같이, 스위치(Sa) 온, X전극 유지방전부(22)의 스위치1(S1)와 Y전극 유지방전부(23)의 스위치4(S4) "온",반면에 유지방전부(22)의 스위치2(S2)와 Y전극 유지방전부(23)의 스위치3(S3) "오프" 상태로 차단되어 상기 인덕터(Lp)의 양단전압은 블로킹 캐패시터1(C1)의 양단전압(+VC1)이 인덕터(Lp)에 흐르는 전류(IL) 반대방향으로 인가되고, 전류(IL)는 감소한다.
"t3"시점에서 인덕터(Lp)에 흐르는 전류(IL)의 극성은 반전되고 역방향으로 흐르게 되어 모드2 구간에서 패널(24)의 양단전압(Vp)은 외부 인가전압(+Vs) 그대로 유지하고 패널(24)은 방전을 유지한다.
이어서 상기 "t3" 시점이 지나게 되면 상기 스위치(Sa)가 다시 "턴-오프" 되고 X전극 유지방전부(22)의 스위치1(S1)와 Y전극 유지방전부(23)의 스위치4(S4) "온", 반면에 유지방전부(22)의 스위치2(S2)와 Y전극 유지방전부(23)의 스위치3(S3) "오프" 상태로 차단되어 모드3의 동작이 시작된다.
상기 모드3 구간(t3<t<t4)은 상기 모드1의 반대경로 즉, 음(negative)으로 흐르는 인덕터(Lp) 전류(IL)에 의해 스위치4(S4), 패널 캐패시터(Cp), 스위치1(S1), 인덕터(Lp), 블로킹 캐패시터(C2) 경로로 LC 공진회로가 형성되어, 패널 양단 전압(Vp)은 유지하고 있던 외부 인가전압(+Vs)을 감소시킨다.
즉, 도 4에 도시된 바와 같이 "t4"인 시점에서 패널 양단 전압(Vp)은 "0"이 된다. 이 상태에서, 인덕터(Lp)에 흐르는 전류(IL)는 스위치2(S2) 및 스위치3(S3)의 바디다이오드를 통해 흘러 스위치 양단에 걸리는 전압은 "0"이 되어 영의 스위칭손실로 도통하게 되어 모드4의 동작이 된다.
즉, 모드 4 에서는 상기 스위치(Sa)가 "오프" 이고, X전극 유지방전부(22)의 스위치1(S1)와 Y전극 유지방전부(23)의 스위치4(S4) "온", 유지방전부(22)의 스위치2(S2)와 Y전극 유지방전부(23)의 스위치3(S3) "온" 상태로 되어 모드4의 동작이 시작된다.
상기 모드4 구간(t4<t<t6)에서는 도 4 에 도시된 바와 같이 "t4"에서 패널 양단전압(Vp)이 "0" 이 되면, 인덕터(Lp) 양단 전압은 블로킹 캐패시터(C2)의 양단전압(+VC2)이 전류(IL)가 흐르는 반대방향으로 인가되어 전류(IL)를 증가한다.
도 4에 도시된 바와 같이, "t5"인 시점에서 전류(IL)의 극성은 양으로 반전되고 지정한 방향으로 흐르게 된다. 이때 패널 양단전압(Vp)은 "0"으로 유지된다.
이어서 모드 5 구간(t6 <t<t7)에서는 "t6"에서 스위치(Sa)와 스위치1(S1) 및 스위치4(S4)가 "오프"상태이고, 스위치2(S2) 및 스위치3(S3)이 "온" 되어, 상기 모드 5구간동안 블로킹 캐패시터(C2), 인덕터(Lp), 스위치2(S2), 패널 캐패시터(Cp) 및 스위치3(S3)의 경로로 LC공진회로가 형성되어 패널(24) 양단전압은 "0"인 상태에서 반대극성의 전압으로 감소한다.
그러므로 도4에 도시된 바와 같이, "t7"인 시점에서 패널(24)의 양단전압(Vp)은 외부인가전압(+Vs)의 반대극성의 전압(-Vs)이 된다. 이 상태에서 스위치(Sa)가 다시 "턴-온" 되고, 다른 반주기가 반복된다.
이상에서 설명한 바와 같이 본 발명은 교류형 플라즈마 디스플레이 패널의 X및 Y전극의 교류형 플라즈마 디스플레이 패턴의 X 및 Y전극을 구동하는 각각 유지방전회로를 하나의 회로로 구성함으로써, 최소의 부품 구성에 의한 구동으로 신뢰성을 향상은 물론, 회로의 스위치소자에 기생저항의 영향과 패널 캐패시턴스의 변화에도 모든 스위치들의 영전압 스위칭 동작을 보장함으로써 전력회수율을 향상하고, 유지방전 개시시 돌입 전류 발생을 방지하게 되어 스위칭 손실의 저감에 따른 고효율화 및 품질 향상을 기대할 수 있는 효과를 주게 되는 것이다.

Claims (13)

  1. 교류 플라즈마 디스플레이 패널의 유지방전 회로에 있어서, 상기 플라즈마 디스플레이 패널의 X, Y전극에 유지 방전하는 각각 유지방전회로를 하나의 유지방전회로로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  2. 제 1 항에 있어서, 상기 유지방전회로는 패널의 X 전극 및 Y 전극에 전력을 회수하는 전력회수부와; 상기 전력회수부로부터 인가되는 전압에 의하여 펄스 전압원을 발생하는 인덕터와; 상기 인덕터의 삼각파 전류원에 따라 전압 상승및 하강시간이 제어된 제어펄스 전압원을 인가하는 스위치와; 상기 스위치로 부터 제어 펄스 전압원으로 X,Y 전극을 유지 방전하는 X,Y 전극유지방전부로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  3. 제 2 항에 있어서, 상기 X전극 및 Y전극은 X,Y 전극 유지방전부 사이에 캐패시터인 부하로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  4. 제 2 항에 있어서, 상기 전력회수부는 기동시 돌입전류 발생을 방지하고, 외부 인가전압이 각각 걸려 있는 복수개의 블로킹 캐패시터로 로 구성하여서 된 것을특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  5. 제 4 항에 있어서, 상기 복수개의 블로킹 캐패시터는 초기 기동시 각각 외부인가전압의 1/2 전압이 유지되어 있도록 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  6. 제 2 항에 있어서, 상기 스위치는 M0SFET 로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전회로.
  7. 제 2 항에 있어서, 상기 X 전극 유지방전부는 상기 인덕터에 두개의 MOSFET 스위치를 직렬로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  8. 제 2 항에 있어서, 상기 Y전극 유지방전부는 직렬로 구성된 두개의 MOSFET 스위치를 상기 X 전극 유지방전부와 병렬로 구성하여서 된 것을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  9. 제 2 항에 있어서, 상기 X전극 및 Y전극 유지방전부는 각각 복수개 스위치 중 하나의 스위치를 차단시켜 공진회로를 형성하도록 하여 상기 패널 양단에 걸리는 전압을 증가시켜 외부 인가전압이 되도록 함을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  10. 제 2 항에 있어서, 상기 스위치는 패널 양단에 외부 인가전압이 걸리면 상기 인덕터를 통해 상기 스위치 양단전압을 "0"으로 유지하여 "영(zero)"의 스위칭 손실로 도통되면서 상기 패널 양단에 걸린 외부 인가전압을 유지 방전시킴을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  11. 제 10 항에 있어서, 상기 스위치에 외부 인가전압을 유지 방전 후에는 차단되면서 상기 유지 방전 시간 동안 형성된 공진회로를 반대경로의 공진회로로 형성하여 패널 양단에 걸리는 전압을 감소시켜 "0"이 되도록 함을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  12. 제 10 항에 있어서, 상기 스위치는 패널 양단에 걸리는 전압이 "0"이 되면 상기 인덕터를 통해 상기 X전극 및 Y전극 유지방전부의 차단상태인 스위치 양단에 걸리는 전압이 "0"이 되도록 하여 "영(zero)"의 스위칭 손실로 스위치를 도통시키고, 스위치의 도통으로 상기 패널 양단전압을 "0"으로 유지시킴을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
  13. 제 12 항에 있어서, 상기 패널 양단전압을 "0"전압 유지 후에는 설정된 시간 구간동안 상기 X전극 및 Y전극 유지방전부는 각각 복수개 스위치중 다른 스위치를 차단시켜 공진회로를 형성하여 상기 패널 양단에 걸리는 전압을 반대 극성의 외부 인가전압이 되도록 함을 특징으로 하는 교류 플라즈마 디스플레이 패널의 유지방전 회로.
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