KR19990087283A - 수신된 무선 주파수 신호의 디지털화및 검출을 위한 장치 및 방법 - Google Patents

수신된 무선 주파수 신호의 디지털화및 검출을 위한 장치 및 방법 Download PDF

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Abstract

제1 디지털화된 신호(115)를 생성하도록 제1 클록 레이트(111)로 제1 무선 주파수 신호(110)를 디지털화하고, 제2 디지털화된 신호(117)를 생성하도록 제2 클록 레이트(113)로 제2 무선 주파수 신호(112)를 디지털화하고, 상기 제1 디지털화된 신호(115)의 신호 품질(125)을 표시하는 제1 신호 품질 측정(124)을 실행하고, 상기 제2 디지털화된 신호(117)의 신호 품질(127)을 표시하는 제2 신호 품질 측정(126)을 실행하고, 상기 제1(125) 및 제2(127) 신호 품질 측정들(128)에 근거하여 상기 제1(115) 및 제2(117) 디지털화된 신호(131)들 중 하나를 선택하는 방법.

Description

수신된 무선 주파수 신호의 디지털화 및 검출을 위한 장치 및 방법
무선 통신 시스템에서 사용되는 종래의 광대역 수신기들에서, 소정의 다중 신호들은 단일 광대역 신호에 의해 전해진다. 이러한 광대역 수신기들은 전형적으로 수신된 신호를 상기 수신된 신호의 디지털 버젼으로 변환하는 아날로그-디지털 변환기들을 포함한다. 아날로그-디지털 변환기들에서의 고유의 비선형성들 때문에, 변환기들은 바람직하지 않은 의사(spurious) 및 다른 상호 변조(intermodulation; IM) 신호들을 생성한다. 이 IM 신호들이 소정의 신호의 주파수를 오버랩하는 주파수를 갖는다면, 상기 소정의 신호를 검출하는데 있어서 광대역 수신기의 감도 및 정확성은 열화된다(degrade). 따라서, 수신된 신호의 디지털화 및 검출을 위한 보다 정확한 방법 및 장치가 필요하다.
<발명의 요약>
이러한 필요성을 시정하기 위해서, 본 발명은 수신된 신호를 디지털화하고 검출하기 위한 방법 및 장치를 제공한다. 이 방법은 제1 클록 레이트(clock rate)로 제1 무선 주파수 신호를 디지털화하여 제1 디지털화된 신호를 생성하고, 제2 클록 레이트로 제2 무선 주파수 신호를 디지털화하여 제2 디지털화된 신호를 생성하고, 제1 디지털화된 신호의 신호 품질을 표시하는 제1 신호 품질 측정을 실행하고, 제2 디지털화된 신호의 신호 품질을 표시하는 제2 신호 품질 측정을 실행하고, 제1 및 제2 신호 품질 측정들에 근거하여 제1 및 제2 디지털화된 신호들 중 하나를 선택하는 단계들을 포함한다.
이 장치는 제1 클록 레이트로 제1 무선 주파수 신호를 디지털화하여 제1 디지털화된 신호를 생성하는 제1 아날로그-디지털 변환기, 제2 클록 레이트로 제2 무선 주파수 신호를 디지털화하여 제2 디지털화된 신호를 생성하는 제2 아날로그-디지털 변환기, 제1 디지털화된 신호의 신호 품질을 표시하는 제1 신호 품질 측정을 생성하고 제2 디지털화된 신호의 신호 품질을 표시하는 제2 신호 품질 측정을 생성하는 제1 측정 유닛, 및 제1 및 제2 신호 품질 측정들에 근거한 제1 및 제2 디지털화된 신호들 중 하나를 선택하는 비교 장치를 포함한다.
본 발명의 다른 특징에 따르면, 다중 채널 무선 주파수(RF) 수신기가 제공된다. 이 다중 채널 무선 주파수 수신기는 제1 디지타이저(digitizer), 제2 디지타이저, 제1 디지타이저에 응답하는 제1 디지털 하향 변환기(down converter), 제2 디지타이저에 응답하는 제2 디지털 하향 변환기, 및 채널 프로세서를 구비한다. 제1 디지타이저는 제1 클록 레이트로 제1 수신된 다중 캐리어(multicarrier) RF를 디지털화하여 제1 디지털화된 신호를 생성한다. 제2 디지타이저는 제2 클록 레이트로 제2 수신된 다중 캐리어(multicarrier) RF를 디지털화하여 제2 디지털화된 신호를 생성한다. 제1 디지털 하향 변환기는 제1 디지털화된 신호를 수신하고 제1 디지털 하향 변환 신호를 생성한다. 제2 디지털 하향 변환기는 제2 디지털화된 신호를 수신하고 제2 디지털 하향 변환 신호를 생성한다. 채널 프로세서는 제1 및 제2 디지털 하향 변환기들에 응답한다.
첨부한 도면들과 관련하여 취해진, 다음의 상세한 설명을 참조하여 본 발명은 의도된 이점들과 함께 가장 잘 이해될 것이다.
본 발명은 총체적으로 무선 주파수(RF) 신호들의 수신에 관한 것이고, 보다 상세하게는 수신된 RF 신호들의 디지털화 및 검출에 관한 것이다.
도 1은 수신된 신호를 디지털화하고 검출하기 위한 장치의 특정 실시예의 블록도.
도 2는 수신된 신호를 디지털화하고 검출하기 위한 장치의 다른 실시예의 블록도.
도 3은 다중 채널 무선 주파수 수신기의 실시예의 블록도.
도 4는 도 1의 장치의 동작을 예시하는 도면.
도 1을 참조하면, 수신된 신호를 디지털화하고 검출하기 위한 장치(10)가 예시된다. 이 장치(10)는 안테나(20), 무선 주파수 하향 변환기(22), 제1 아날로그-디지털(A/D) 변환기(28), 제2 아날로그-디지털(A/D) 변환기(30), 제1 디지털 하향 변환기(38), 제2 디지털 하향 변환기(40), 프로세서(36), 제1 검출기(42), 재2 검출기(44), 비교 모듈(46), 및 선택 모듈(52)을 포함하고, 상기 무선 주파수 하향 변환기는 종래의 회로, 이를테면, 혼합기들, 필터들, 증폭기들, 및 오실레이터들(보이지 않음)을 포함한다. RF 하향 변환기(22)는 안테나(20)에 응답하고 스플리터(splitter, 26)에 연결된다. 이 스플리터(26)는 제1 A/D 변환기(28) 및 제2 A/D 변환기(30)에 연결된다. 프로세서(36)는 제1 클록 소스(fclock1, 50)를 통해 제1 A/D 변환기(28)에 연결되고 제2 클록 소스(fclock2, 51)를 통해 제2 A/D 변환기(30)에 연결된다. 프로세서(36)는 또한 수치 제어 오실레이터(numerically controlled oscillator, 32)를 통해 제1 디지털 하향 변환기(38)에 연결되고 제2 수치 제어 오실레이터(NCO, 34)를 통해 제2 디지털 하향 변환기(40)에 연결된다. NCO들(32 및 34)이 독립 유닛들로 도시되었지만, NCO들(32, 34)은 선택적으로 각각의 제1 및 제2 디지털 하향 변환기들(38 및 40)에 일체로 될 수 있다. 제1 디지털 하향 변환기(38)는 제1 검출기(42)에 연결되고 제1 A/D 변환기(28)에 연결된다. 유사한 방법으로, 제2 디지털 하향 변환기(40)는 검출기(44) 및 제2 A/D 변환기(30)에 연결된다. 제1 검출기(42)는 제1 디지털 하향 변환기(38)와 비교 모듈(46)에 연결되어 있고, 제2 검출기(44)는 제2 디지털 하향 변환기(40)와 비교 모듈(46)에 연결된다. 선택 모듈(52)은 제1 DDC(38), 제2 DDC(40), 및 비교 모듈(46)에 연결된다.
동작 시, 무선 주파수(RF) 신호(21)가 안테나(20)에서 수신된다. 다음에 이 RF 신호(21)는 RF 하향 변환기(22)에 의해 주파수 하향 변환되어 스플리터(26)로 입력되는 중간 주파수(intermediate frequency; IF) 신호(23)를 생성한다. 스플리터(26)는 이 IF 신호(23)의 실질적으로 유사한 2개의 버젼들을 생성하고 IF 신호(23)의 제1 버젼을 제1 A/D 변환기(28)로 입력하고 IF 신호(23)의 제2 버젼을 제2 A/D 변환기(30)로 입력한다. 제1 A/D 변환기(28)는 바람직하게 프로세서(36)에 응답하여 제1 클록 소스(fclock1, 50)에 의해 결정된 제1 클록 레이트로 동작된다. 제2 A/D 변환기(30)는 바람직하게 프로세서(36)에 응답하여 제2 클록 소스(fclock2, 51)에 의해 결정된 제2 클록 레이트로 동작된다. 제1 A/D 변환기(28)는 IF 신호(23)를 디지털화하여 디지털화된 신호(29)를 생성하고 제2 A/D 변환기(30)는 IF 신호(23)를 디지털화하여 디지털화된 신호(31)를 생성한다. 바람직하게, 제1 및 제2 디지털화된 신호들(29 및 31), 각각은 하나 이상의 통신 채널들을 전달한다. 다음에 제1 디지털화된 신호(29)는 디지털 하향 변환기(38)에 의해 주파수 하향 변환되어 제1 디지털 하향 변환 신호(39)를 생성한다. 유사하게 제2 디지털 하향 변환기(40)는 디지털 신호(31)를 하향 변환시켜 제2 디지털 하향 변환 신호(41)를 생성한다.
검출기(42)는 제1 디지털 하향 변환 신호(39)를 수신하고 이 신호(39)의 제1 신호 품질 측정(43)을 실행한다. 이 신호 품질 측정(43)은 디지털화된 신호의 신호 품질을 표시한다. 유사하게, 검출기(44)는 제2 디지털 하향 변환 신호(41)의 제2 신호 품질 측정(45)을 실행한다. 제1 신호 품질 측정(43) 및 제2 신호 품질 측정(45)은 비교 모듈(46)에 의해 수신된다. 비교 모듈은 제1 신호 품질 측정(43) 및 제2 신호 품질 측정(45)의 비교에 근거하여 제1 디지털 하향 변환 신호(39) 또는 제2 디지털 하향 변환 신호(41)중 하나를 선택한다. 비교 모듈(46)에 응답하는 선택 모듈(52)은 그 후 선택된 디지털 하향 변환 신호(48)를 출력한다. 본 발명의 일 실시예에 따르면, 디지털 하향 변환 신호(48)는 제1 디지털 하향 변환 신호(39) 또는 제2 디지털 하향 변환 신호(41)중 하나이다. 다른 실시예에 따르면, 디지털 하향 변환 신호(48)는 제1 및 제2 디지털 하향 변환 신호들(39, 41)의 결합일 수 있다.
바람직한 실시예에서, RF 하향 변환기(22)는 Watkins Johnson의 HDMII 모델 혼합기와 같은 혼합기를 포함하고, 오실레이터(24)는 MC12073A 프리스칼라(prescalar) 집적 회로(IC)를 구비한 MC145151FN2 합성 장치 IC이고, 이들 모두는 Motorola로부터 입수할 수 있고, 소정의 주입 주파수로 설정된 전압 제어 오실레이터와 관련한다. 제1 A/D 변환기(28)는 바람직하게 61.44 ㎒의 클록 레이트로 동작하는 아날로그 디바이스 A/D 9042이다. 제2 A/D 변환기(30)는 바람직하게 61.60㎒ 클록 레이트로 동작하는 아날로그 디바이스 A/D 9042이다. 제1 및 제2 디지털 하향 변환기들(38, 40) 및 NCO들(32 및 34) 각각은 바람직하게 내부에 NCO 기능을 포함하는 Harris Corp. HSP50016 디지털 하향 변환기에 의해 공급된다. 검출기들(42 및 44)은 장치(10)의 특정 응용에 따르는 다양한 종류들일 수 있다. 예를 들어, AMPS(Advanced Mobile Phone System) 타입의 셀룰러 시스템에서, 검출기들(42 및 44)은 바람직하게 감시 오디오 톤(supervisory audio tone; SAT) 검출기들이 고, SAT 검출기들의 출력은 비교 모듈(46) 내의 SAT 비교기에 입력을 제공한다. 그러나, 시분할 다중 액세스(TDMA) 타입의 셀룰러 시스템에서, 검출기들(42 및 44)은 바람직하게 상관기(correlator) 타입의 검출기들이고, 검출기들(42 및 44)은 선택된 타임 슬롯 동안 미리 지정된 동기화 워드와 상관될 것이고, 바람직하게 각각 품질(43 및 45)을 결정하는 비트 에러 레이트 측정을 포함한다. 프로세서(36)는 바람직하게 Motorola의 MC68302이다.
주목되야 할 점은 제1 A/D 변환기(28)를 제2 A/D 변환기(30)와 다른 클록 레이트로 동작시킴으로써, 대응 디지털 하향 변환기들(38 및 40)은 바람직하게 각각 다른 주파수들로 동조되어 신호들(29 및 31)의 소정의 채널들을 수신한다. 제1 및 제2 변환기들(28, 30)을 다른 레이트(rate)로 동작시킴으로써 장치(10)는 검출된 신호(23)의 동적 범위를 증가시킨다. A/D 변환기들(28 및 30)의 다른 클록 레이트에 기인해 A/D 변환기들(28 및 30) 내의 디지털화 프로세스에 고유한 상호 변조 결과들이 출력 신호들(29 및 31)에서 주파수 쉬프트(shift)되기 때문에 검출된 신호(23)의 동적 범위가 증가된다.
이제 도 2를 참조하면, 수신된 신호를 검출하고 디지털화하기 위한 장치(100)의 다른 바람직한 실시예가 개시된다. 장치(100)는 제1 안테나(102) 및 제2 안테나(104)를 포함한다. 장치(100)는 또한 제1 RF 하향 변환기 스테이지(106) 및 제2 RF 하향 변환기 스테이지(108)를 포함한다. 제1 RF 하향 변환기 스테이지(106)는 중간 주파수 신호(107)를 생성하고, 제2 RF 하향 변환기 스테이지(108)는 제2 중간 주파수 신호(109)를 생성한다. 장치(100)는 또한 제1 및 제2 아날로그-디지털 변환기들(110, 112), 제1 및 제2 수치 제어 오실레이터들(114, 118), 제 1 및 제2 디지털 하향 변환기들(122, 120), 제1 및 제2 신호 품질 검출기들(124, 126), 프로세서(116), 신호 비교 모듈(128), 및 선택 모듈(131)을 포함한다. 통상, 장치(100)의 바람직한 실시예는 동일한 구성 요소들을 가지며, 도 1의 장치(10)에 관하여 상기 설명된 바와 같이 동작한다. 그러나, 장치(100)는 제2 안테나(104) 및 제2 RF 하향 변환기 스테이지(108)를 더 포함한다. RF 하향 변환기 스테이지(108)는 RF 하향 변환기 스테이지(106)와 실질적으로 유사하고, 혼합기, 오실레이터, 및 당업자들에게 알려진 다른 종래의 디바이스들을 포함하는 것이 바람직하다. 제2 안테나 및 제2 RF 하향 변환기 스테이지(108)를 제공함으로써, 장치(100)는 수신된 신호의 다이버시티 수신(diversity reception)을 고려한다. 다이버시티 수신은 이 기술에서 잘 알려진 바와 같이 수신기 내의 개선된 검출을 제공한다.
도 3을 참조하면, 광대역 다중 채널 수신기의 바람직한 실시예가 예시된다. 광대역 수신기(200)는, 짝수 그룹(even group)이라 불리는, 제1 그룹으로 및, 홀수 그룹(odd group)이라 불리는 제2 그룹으로 분류된 복수의 모듈들을 포함한다. 짝수 그룹은 복수의 안테나들(202), 수신기 회로들(204), 디지타이저들(206), 제1 클록 소스(208), 및 디지털 하향 변환기 모듈들(210)을 포함한다. 유사하게, 홀수 그룹은 복수의 안테나들(224), 수신기 회로들(222), 디지타이저(220), 디지털 하향 변환기들(228), 및 제2 클록 소스(226)를 포함한다. 채널 프로세서 또는 바람직하게 복수의 프로세서들(230)은 각각의 짝수 및 홀수 그룹들 내에서 각각의 디지털 하향 변환기들(210, 228)로부터 데이터를 수신한다.
제1 클록 소스(208), 바람직하게 디지타이저 인코드 클록 또는 샘플링 클록은 제2 클록(226)과 다른 레이트로 설정된다. 디지타이저(206)로부터의 데이터 출력은 디지털 하향 변환기 모듈(210) 내의 적어도 하나의 디지털 하향 변환기(DDC)로 입력되고 디지타이저(220)로부터의 데이터 출력을 DDC(228)로 입력된다. DDC 모듈들(210, 228) 내의 각 DDC는, 각각의 NCO, 이를테면 DDC(210)내의 NCO(32)에 의해 생성된 신호를 인가함으로써 각각의 디지타이저(206, 220)로부터 수신된 광대역 데이터에 내장된 소정의 채널을 기저 대역에서 디지털로 혼합한다. 각 DDC(210, 228)에 의해 실행된 다른 기능은 데시메이션(decimation)/필터링이다. 데시메이션 필터링 프로세스는 채널 필터링과 개개의 채널을 위해 필요한 레이트 감소(rate reduction)를 제공한다. 개개의 기저 대역 신호들의 대역폭은 통상적으로 광대역 스펙트럼보다 작기 때문에 더 낮은 샘플 레이트가 가능하고 종종 몇 배인 것이다. 디지타이저(206) 및 DDC(210)을 포함하는 제1 브랜치(branch)와 디지타이저(220) 및 DDC(228)을 포함하는 제2 브랜치 사이에서 광대역 데이터의 같지 않은 샘플 레이트에 기인하여, 소정의 통신 채널에 사용되는 주파수 및 데시메이션 비율은 브랜치들 사이에서 달라 소정의 채널이 모든 브랜치들에 대해 동일한 값의 샘플 레이트로 기저 대역 동등물로 변환된다. 물론 기저 대역 샘플링 레이트가 각 채널에 대해 동일할 필요는 없고, 소정의 수신 채널들의 채널 대역폭들에 근거하여 선택될 수 있다. 셀룰러 AMPS 채널들과 같은 동일한 대역폭의 다중 채널의 경우 각 채널에 대해 동일한 샘플 레이트를 갖는 것이 바람직할 것이다.
각 브랜치로부터 각 채널에 대한 기저 대역 데이터가 채널 프로세서(230)로 전달되고, 각 브랜치로부터의 채널화된 데이터는 의사 신호들로부터의 가능한 간섭에 대해 분석된다. 브랜치에 대한 특정 채널 상에서의 간섭이 검출되는 경우에, 이 브랜치는 이 채널을 위한 결합 프로세스에서 사용되지 않는다. 채널 프로세서(230)는 또한 복조, 데이터 검출, 비트 및 워드 에러 레이트 측정과 같은 기능을 실행한다.
섹터화된 안테나 응용들에 있어서, 안테나들(224)에 접속되고, 홀수 그룹 수신기들로 지정된 복수의 광대역 수신기들은 일 인코드 레이트(one encode rate)로 디지타이저들을 이용하고 한편으로 안테나들(202)에 접속되고, 짝수 그룹 수신기들로 지정된 이 수신기들은 다른 인코드 레이트의 디지타이저를 이용한다. 예로서 그리고 도 3을 참조하여, AMPS 채널들로 된 3 섹터 셀룰러 시스템을 고찰한다. 두개의 수신 안테나들이 총 6 안테나를 위한 섹터마다 사용된다. 6개 광대역 수신기 디지타이저들(220)이 안테나마다 하나씩 사용된다. 수신 디지타이저들(220) 중 3개는 홀수 안테나들(224)로 분류되고 61.44㎒의 샘플링 클록을 사용한다. 이들은 홀수 디지타이저들이라 불릴 것이다. 나머지 3개(짝수 디지타이저들)(206)는 각각 짝수 안테나들(202)에 결합되고 61.60㎒의 샘플링 클록을 사용한다. 각각의 홀수 디지타이저들(220)로부터 61.44㎒에서 광대역 데이터는 DDC(228)의 블록으로 전달된다. DDC의 수는 셀을 위한 소정의 AMPS의 수에 따른다. 각각의 DDC(228)는 적절한 디지타이저(220)로부터 61.44㎒ 데이터를 취하고, 내장된 소정의 AMPS 채널들을 상술된 단계들을 사용하는 기저 대역으로 변환시킨다. 이 프로세스에서, 다른 채널들은 여과하여 제거되고, 소정의 채널들만 남는다. AMPS 기저 대역 데이터에 대한 소정의 샘플 레이트가 80Ksamples/sec. 라면, 이 경우에 요구되는 데시메이션 비율은 61.44㎒/80㎑=768일 것이다.
유사하게, 각각의 짝수 디지타이저들(206)로부터 60.60㎒에 있는 광대역 데이터는 DDC(210)의 다른 블록으로 전달된다. 이 DDC(210)는 홀수 브랜치들에 대해 설명된 바와 같이 짝수 브랜치들에서 동일한 기능을 실행한다. 짝수 브랜치들의 기저 대역 데이터에 대한 소정의 샘플 레이트가 또한 80Ksamples/sec.라면, 데시메이션 비율은 770(61.60㎒/80㎑)이다. 각각 개별적인 DDC(210, 228)로부터의 데이터는, 각 채널에 대한 홀수 및 짝수 데이터가 간섭에 대해 분석되는 채널 프로세서(230)를 따라 전달된다. 짝수 브랜치에서의 의사 응답이 섹터로 사용되는 채널에 대한 것이면, 홀수 브랜치에 대한 채널 데이터가 선택될 것이고 의사 응답이 존재하는 한 다이버시티는 구현되지 않을 것이다. 마찬가지로, 홀수 브랜치에서 의사 응답이 검출된다면, 짝수 브랜치에 대한 채널 데이터가 선택될 것이다.
도 4를 참조하면, 일본 105 도꾜도, 미나도꾸, 도라노몬, 1-5-16에 소재한 리서치 앤드 디벨롭먼트 센터 훠 라디오 시스템즈로부터 입수할 수 있는 개인 디지털 셀룰러 원거리 통신 시스템(Personal Digital Cellular Telecommunication System) RCR STD-27D 도큐먼트에 의해 약술된 바와 같이, 디지털 이동 전화 시스템 내의 업링크(uplink) 트래픽 채널(traffic channel) 상에서 바람직한 실시예가 동작하는 예가 예시된다. 이 예에 대해서, 이 바람직한 실시예가 이용된 제품(product)은 관련된 셀룰러 시스템에서의 적당한 성능을 가능하게 하는, RCR STD-27D 도큐먼트에 의해 제정된 표준과 명세서를 만족한다고 가정된다.
검출기 블록들(42 및 44), 비교 모듈(46) 및 선택 모듈(52)에 포함된 기능들에 대한 바람직한 실시예의 상세한 설명이 제공된다. 이들 블록들(42, 44, 46 및 52)은 Motorola MC68302과 같은 마이크로프로세서에 포함될 수 있다. 당업자는 다음의 원문에 설명되는 태스크(tasks)를 실행하도록 MC68302를 프로그램할 수 있다.
브랜치 1 데이터 신호(39)는 제1 디지털 하향 변환기(DDC)(38) 출력으로 구성된다. 브랜치 2 데이터 신호(41)는 제2 디지털 하향 변환기(DDC)(40)출력으로 구성된다. 검출기 모듈(42) 내에서 브랜치 1 트래픽 채널 동기 워드는 본 발명에 참조로 일체화된 RCR STD-27D 도큐먼트에서 제정된 바와 같이 미리 정의된 동기 워드에 상관된다. 검출기 모듈(44)에서, 브랜치 2 트래픽 채널 동기 워드는 RCR STD-27D 도큐먼트에서 제정된 바와 같이 미리 정의된 동기 워드에 상관된다. 브랜치들 중 어느 한쪽에 대해서도 동기 상관 관계가 발생하지 않는다면, 그 브랜치에 대한 트래픽 채널은 더이상 유효하지 않고 또는 신호는 그 브랜치에 대한 RF 입력 신호 레벨의 간섭자(interferer)에 의해 손상된 것으로 가정되거나 또는 수신기의 감도 레벨 이하가 된다. 유효 동기 워드 상관 관계 결과들이 각각의 브랜치들로부터 수신된다면, 모든 비트래픽(nontraffic) 채널 비트들에 대해 대응하는 비트 에러 레이트(BER) 측정이 이루어질 수 있다. 브랜치 1 상관 관계 결과들은 비교 모듈(46)로 전달되고 브랜치 2로부터 수신된 상관 관계 결과들과 비교된다. 예시적인 업링크 트래픽 채널 비트 할당이 RCR STD-27D의 4.1.4.3.2절에 설명된다는 점을 주목한다. 측정 결과는, 브랜치 1 데이터로부터 수신된 정보를 브랜치 2 데이터로부터 수신된 정보에 비교하는 비교 모듈(46)에 의해 제공된다.
브랜치 1이나 2 중의 어느 브랜치 데이터가 더욱 처리되어 선택 모듈 출력(48)에 응용될 것인지를 선택하는데 사용될 수 있고, RCR STD-27D의 필요 조건들에 부합하며, 많은 판단 기준들이 있다.
적절한 선택 판단 기준의 예는 동기 워드 상관 관계가 발생하고 선정된 BER 임계값이 초과되어야만 하는 것이다. 보다 상세히, 동기 워드 상관 관계가 발생하고 BER이 양 브랜치들을 향해 전해진다면, 양 브랜치 신호들은 추가적인 프로세싱을 위해 결합될 수 있다. 도 2에서와 같이 두 안테나들이 사용된다면, 이것은 결국 다이버시티 이득(gain)이 될 것이다. 브랜치 1 동기 워드 상관 관계가 발생하고 브랜치 1 BER이 선정된 임계값에 도달하고 브랜치 2 동기 워드 상관 관계가 발생하지 않거나 또는 브랜치 2 동기 워드 상관 관계가 발생하지만 브랜치 2 BER이 미달하면, 브랜치 1 데이터가 추가적인 프로세싱을 위해 선택될 수 있다. 브랜치 2 동기 워드 상관 관계가 발생하고 브랜치 2 BER이 개개의 임계값에 도달하고 브랜치 1 동기 워드 상관 관계는 발생하지 않거나 또는 브랜치 1 동기 워드 상관 관계가 발생하지만 브랜치 1 BER이 미달하면, 브랜치 2 데이터가 추가적인 프로세싱을 위해 선택될 것이다. 특정한 선택 방법이 상술되었지만, 많은 다른 선택 방법들이 사용될 수 있다는 것을 알아야 한다.
상술된 바와 같이 수신된 RF 신호를 디지털화하고 검출하는 바람직한 방법 및 장치는 많은 이점을 갖는다. 예를 들어, 바람직한 실시예들은 달리 아날로그-디지털 변환기 내의 디지털화 프로세스에 의해 야기된 간섭과 같은 의사 간섭에 의해 제한될 수신된 주파수들의 동적 범위 레벨을 증가시킨다. 게다가, 의사 신호 감소가 다중 클록킹 레이트(multiple clocking rate)를 사용함으로써 달성되기 때문에, 의사 신호를 줄이기 위한 독립적인 디바이스의 필요성이 감소한다. 다른 이점은 수신기 브랜치들에서 이득(gain)이 감소된다는 것이다. 더욱이, 복수의 수신기 브랜치들 각각에 실질적으로 유사한 RF 회로가 사용될 수 있어 제조 비용을 줄일 수 있다.
당업자들은 상술된 장치 및 방법의 추가적인 이점들 및 변형을 용이하게 알 수 있을 것이다. 따라서, 본 발명은 넓은 관점에서, 특정한 상세한 설명, 대표적인 장치 및 상기 도시되고 설명된 실시예에 한정되지 않는다. 본 발명의 범위와 정신을 벗어나지 않고 상기 명세서에 대해 다양한 변형들 및 변화들이 존재할 수 있고, 본 발명은 모든 이러한 변형들 및 변화들이 다음의 청구항들 및 그들의 법적 균등성의 범주 내에 있다면 이들을 포함하는 것으로 간주된다.

Claims (11)

  1. 수신된 신호를 디지털화하고 검출하는 방법에 있어서,
    제1 클록 레이트로 제1 무선 주파수 신호를 디지털화하여 제1 디지털화된 신호를 생성하는 단계;
    제2 클록 레이트로 제2 무선 주파수 신호를 디지털화하여 제2 디지털화된 신호를 생성하는 단계;
    상기 제1 디지털화된 신호의 신호 품질을 표시하는 제1 신호 품질 측정을 실행하는 단계;
    상기 제2 디지털화된 신호의 신호 품질을 표시하는 제2 신호 품질 측정을 실행하는 단계; 및
    상기 제1 및 제2 신호 품질 측정들에 근거한 상기 제1 및 제2 디지털화된 신호들 중 적어도 하나를 선택하는 단계
    을 포함하는 수신된 신호를 디지털화하고 검출하는 방법.
  2. 제1항에 있어서, 상기 신호 품질 측정은 반송파 대 잡음비 측정 중 적어도 하나를 포함하는 수신된 신호를 디지털화하고 검출하는 방법.
  3. 제1항에 있어서,
    상기 제1 및 제2 무선 주파수 신호들 중 적어도 하나를 생성하도록 수신된 신호를 하향 변환하고;
    상기 제1 및 제2 신호 품질 측정들 중 하나를 실행하기에 앞서서 상기 제1 및 제2 디지털화된 신호들 중 적어도 하나를 하향 변환하고; 그리고
    상기 선택된 디지털화된 신호를 프로세싱하는 주파수 중 적어도 하나를 더 포함하는 수신된 신호를 디지털화하고 검출하는 방법.
  4. 수신된 무선 주파수, RF, 신호를 디지털화하고 검출하는 방법에 있어서,
    RF 신호를 검출하는 단계;
    제1 클록 레이트로 상기 RF 신호를 디지털화하여 제1 디지털화된 신호를 생성하는 단계;
    제2 클록 레이트로 상기 RF 신호를 디지털화하여 제2 디지털화된 신호를 생성하는 단계;
    제1 및 제2 신호 품질 측정을 실행하는 단계 - 각각의 제1 및 제2 신호 품질 측정들은 상기 각각의 제1 및 제2 디지털화된 신호들의 신호 품질을 표시함-; 및
    상기 각각의 제1 및 제2 디지털화된 신호들의 상기 제1 및 제2 신호 품질 측정들에 근거한 상기 제1 및 제2 디지털화된 신호들 중 하나를 선택하는 단계
    을 포함하는 수신된 무선 주파수, RF, 신호를 디지털화하고 검출하는 방법.
  5. 제4항에 있어서,
    상기 제1 신호 품질 측정을 임계값과 비교하고, 상기 제1 신호 품질 측정이 상기 임계값을 초과하는 경우에 상기 제1 디지털화된 신호를 프로세싱하는 단계; 및
    상기 제2 신호 품질 측정을 임계값과 비교하고, 상기 제2 신호 품질 측정이 상기 임계값을 초과하는 경우에 상기 제2 디지털화된 신호를 프로세싱하는 단계들 중 적어도 하나를 포함하는 수신된 무선 주파수, RF, 신호를 디지털화하고 검출하는 방법.
  6. 수신된 신호를 디지털화하고 검출하기 위한 장치에 있어서,
    제1 클록 레이트로 제1 무선 주파수 신호를 디지털화하여 제1 디지털화된 신호를 생성하는 제1 아날로그-디지털 변환기;
    제2 클록 레이트로 제2 무선 주파수 신호를 디지털화하여 제2 디지털화된 신호를 생성하는 제2 아날로그-디지털 변환기;
    상기 제1 디지털화된 신호의 신호 품질을 표시하는 제1 신호 품질 측정을 생성하고 상기 제2 디지털화된 신호의 신호 품질을 표시하는 제2 신호 품질 측정을 생성하는 제1 측정 유닛; 및
    상기 제1 및 제2 신호 품질 측정들에 근거한 상기 제1 및 제2 디지털화된 신호들 중 하나를 선택하는 비교 디바이스
    을 포함하는 수신된 신호를 디지털화하고 검출하기 위한 장치.
  7. 제6항에 있어서, 상기 신호 품질 측정은
    반송파 대 잡음 측정 중 적어도 하나; 및
    동기화 측정을 포함하는 수신된 신호를 디지털화하고 검출하기 위한 장치.
  8. 제6항에 있어서,
    상기 제1 및 제2 무선 주파수 신호들 중 적어도 하나를 생성하도록 수신된 신호를 하향 변환하는 RF 하향 변환기;
    제1 및 제2 아날로그-디지털 변환기들 중 적어도 하나에 응답하는 디지털 하향 변환기
    중 적어도 하나를 더 포함하는 수신된 신호를 디지털화하고 검출하기 위한 장치
  9. 제8항에 있어서, 상기 디지털 하향 변환기는 수치 제어된 오실레이터를 포함하는 수신된 신호를 디지털화하고 검출하기 위한 장치.
  10. 다중 채널 무선 주파수(RF) 수신기에 있어서,
    제1 클록 레이트로 제1 수신된 다중 캐리어 RF 신호를 디지털화하여 제1 디지털화된 신호를 생성하는 제1 디지타이저;
    제2 클록 레이트로 제2 수신된 다중 캐리어 RF 신호를 디지털화하여 제2 디지털화된 신호를 생성하는 제2 디지타이저;
    상기 제1 디지타이저에 응답하는 제1 디지털 하향 변환기 - 상기 제1 디지털 하향 변환기는 상기 제1 디지털화된 신호를 수신하고 제1 디지털방식으로 하향 변환 신호를 생성함 -;
    상기 제2 디지타이저에 응답하는 제2 디지털 하향 변환기 - 상기 제2 디지털 하향 변환기는 상기 제2 디지털화된 신호를 수신하고 제2 디지털방식으로 하향 변환 신호를 생성함 -; 및
    상기 제1 및 제2 디지털 하향 변환기들에 응답하는 채널 프로세서를 포함하는 다중 채널 무선 주파수(RF) 수신기.
  11. 제16항에 있어서, 상기 제1 디지타이저와 상기 제1 디지털 하향 변환기에 연결된 제1 클록 소스 및 상기 제2 디지타이저와 상기 제2 디지털 하향 변환기에 연결된 제2 클록 소스;
    복수의 디지타이저들 및 제1 복수의 디지털 변환기들;
    상기 제1 복수의 디지타이저들과 연결된 복수의 수신기 회로들; 및
    상기 제1 복수의 디지타이저들과 연결된 복수의 안테나들
    을 더 포함하는 다중 채널 무선 주파수(RF) 수신기
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