KR101929041B1 - 유기전계발광표시장치와 이의 구동방법 - Google Patents

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Abstract

본 발명의 실시예는, 패널; 패널을 구동하는 구동부; 구동부를 제어하는 타이밍제어부; 패널에 전원을 공급하는 전원공급부; 패널에 위치하는 제1전원배선과 그라운드배선 사이에 절연되어 형성된 가이드배선; 및 가이드배선과 폐 루프를 구성하며 가이드배선의 일단을 통해 입력 펄스를 전송하고 가이드배선의 타단을 통해 출력된 출력 펄스를 수신하며, 입력 펄스와 출력 펄스 간의 비교 결과에 따라 전원공급부를 턴오프 시키는 셧다운 신호를 출력하는 쇼트검출부를 포함하는 유기전계발광표시장치를 제공한다.

Description

유기전계발광표시장치와 이의 구동방법{Organic Light Emitting Display Device and Driving Method thereof}
본 발명은 유기전계발광표시장치와 이의 구동방법에 관한 것이다.
유기전계발광표시장치에 사용되는 유기전계발광소자는 기판 상에 위치하는 두 개의 전극 사이에 발광층이 형성된 자발광소자이다. 유기전계발광표시장치는 빛이 방출되는 방향에 따라 전면발광(Top-Emission) 방식, 배면발광(Bottom-Emission) 방식 또는 양면발광(Dual-Emission) 방식 등이 있다. 그리고, 구동방식에 따라 수동매트릭스형(Passive Matrix)과 능동매트릭스형(Active Matrix) 등으로 나누어져 있다.
유기전계발광표시패널에 배치된 서브 픽셀은 스위칭 트랜지스터, 구동 트랜지스터 및 커패시터를 포함하는 트랜지스터부와 트랜지스터부에 포함된 구동 트랜지스터에 연결된 하부전극, 유기 발광층 및 상부전극을 포함하는 유기 발광다이오드를 포함한다.
유기전계발광표시패널은 유기 발광다이오드를 통해 흐르는 전류의 양에 따라 빛의 밝기가 달라진다. 유기전계발광표시패널은 액정표시패널 대비 고전류가 요구되므로, 쇼트 발생 시 서브 픽셀에 포함된 소자에 과전류가 흐르게 된다. 쇼트는 제조공정(또는 모듈공정)시, 유기전계발광표시패널에 유입된 파티클, 크랙(Crack), 패드부의 미스얼라인, 협소한 배선 레이아웃과 같은 내부 구조적 요인은 물론 정전기와 같은 외부적 요인 등으로 원인, 위치 및 대상이 다양하다.
한편, 쇼트가 발생하면 과전류가 패널의 내부로 유입되어 고온의 열을 발생하게 되고 패널의 서브 픽셀에 포함된 소자를 연소(burnt)시킴은 물론 이로 인한 화재를 일으킬 가능성이 매우 높은바 이를 방지할 수 있는 방안이 요구된다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명은 패널에 쇼트 발생 시 서브 픽셀에 포함된 소자에 과전류가 흐르게 되면서 국부적인 연소(burnt)가 전면으로 확산(하나의 서브 픽셀에서 주변 서브 픽셀까지 연소)되는 것을 방지하여 화재로 이어질 수 있는 가능성을 제거할 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 것이다. 또한, 본 발명은 패널의 쇼트 뿐만 아니라 패드의 오픈을 검출해낼 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 것이다.
상술한 과제 해결 수단으로 본 발명의 실시예는, 패널; 패널을 구동하는 구동부; 구동부를 제어하는 타이밍제어부; 패널에 전원을 공급하는 전원공급부; 패널에 위치하는 제1전원배선과 그라운드배선 사이에 절연되어 형성된 가이드배선; 및 가이드배선과 폐 루프를 구성하며 가이드배선의 일단을 통해 입력 펄스를 전송하고 가이드배선의 타단을 통해 돌아오는 출력 펄스를 수신하며, 입력 펄스와 출력 펄스 간의 비교 결과에 따라 전원공급부를 턴오프 시키는 셧다운 신호를 출력하는 쇼트검출부를 포함하는 유기전계발광표시장치를 제공한다.
쇼트검출부는 로직로우와 로직하이가 교번하는 형태로 입력 펄스를 생성할 수 있다.
쇼트검출부는 입력 펄스와 출력 펄스 간의 위상이 다르면 셧다운 신호를 출력할 수 있다.
쇼트검출부는 입력 펄스를 생성하는 펄스 생성부와, 입력 펄스와 출력 펄스를 비교하는 펄스 비교부와, 입력 펄스와 출력 펄스 간의 비교 결과에 따라 셧다운 신호를 출력하는 셧다운 신호 생성부를 포함할 수 있다.
쇼트검출부는 펄스 생성부로부터 입력 펄스를 제공받고 가이드배선의 일단을 통해 입력 펄스를 전송하는 펄스 전송부와, 가이드배선의 타단을 통해 출력된 출력 펄스를 수신하여 펄스 비교부에 제공하는 펄스 수신부를 포함할 수 있다.
펄스 전송부는 제2전원배선에 일단이 연결되고 가이드배선의 일단에 타단이 연결된 제1저항기와, 제1저항기의 타단에 제1전극이 연결되고 그라운드배선에 제2전극이 연결되며 펄스 생성부의 단자에 게이트전극이 연결된 제1트랜지스터를 포함하고, 펄스 수신부는 제2전원배선에 일단이 연결되고 펄스 비교부의 단자에 타단이 연결된 제2저항기와, 제2저항기의 타단에 제1전극이 연결되고 그라운드배선에 제2전극이 연결되며 가이드배선의 타단에 게이트전극이 연결된 제2트랜지스터를 포함할 수 있다.
펄스 전송부는 제1저항기의 타단과 가이드배선의 일단 사이에 위치하는 다이오드를 포함하되, 다이오드는 제1저항기의 타단에 애노드전극이 연결되고 가이드배선의 일단에 캐소드전극이 연결될 수 있다.
다른 측면에서 본 발명은 패널에 영상을 표시하는 단계; 패널에 형성된 가이드배선에 제공할 입력 펄스를 생성하는 단계; 가이드배선의 일단을 통해 입력 펄스를 전송하고 가이드배선의 타단을 통해 돌아오는 출력 펄스를 수신하는 단계; 입력 펄스와 출력 펄스를 비교하는 단계; 및 입력 펄스와 출력 펄스 간의 비교 결과에 따라 패널에 전원을 공급하는 전원공급부를 턴오프 시키는 셧다운 신호를 출력하는 단계를 포함하는 유기전계발광표시장치의 구동방법을 제공한다.
입력 펄스를 생성하는 단계는 로직로우와 로직하이가 교번하는 형태로 생성할 수 있다.
셧다운 신호를 출력하는 단계는 입력 펄스와 출력 펄스 간의 위상이 다르면 셧다운 신호를 출력할 수 있다.
본 발명은 패널에 쇼트 발생 시 서브 픽셀에 포함된 소자에 과전류가 흐르게 되면서 국부적인 연소(burnt)가 전면으로 확산(하나의 서브 픽셀에서 주변 서브 픽셀까지 연소)되는 것을 방지하여 화재로 이어질 수 있는 가능성을 제거할 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 효과가 있다. 또한, 본 발명은 패널의 쇼트 뿐만 아니라 패드의 오픈을 검출해낼 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 효과가 있다.
도 1은 본 발명에 따른 유기전계발광표시장치의 개략적인 구성도.
도 2는 서브 픽셀의 회로 구성 예시도.
도 3은 본 발명의 제1실시예에 따라 타이밍제어부를 이용한 쇼트검출부의 구성도.
도 4는 입력 펄스와 출력 펄스의 예시도.
도 5는 가이드배선의 이해를 돕기 위해 도 3의 A1-A2영역을 전달한 단면도.
도 6은 타이밍제어부에 포함된 쇼트검출부의 블록도.
도 7 내지 도 9는 본 발명의 제2실시예에 따라 타이밍제어부와 연동하는 펄스 전송부 및 펄스 수신부를 이용한 쇼트 검출의 예를 설명하기 위한 도면.
도 10은 본 발명의 제3실시예에 따라 타이밍제어부와 연동하는 펄스 전송부 및 펄스 수신부의 회로 구성 예시도.
도 11은 도 10에 도시된 회로 구성에 따른 동작을 설명하기 위한 파형도.
도 12는 본 발명의 구성요소를 유기전계발광표시장치로 구성한 제1예시도.
도 13은 본 발명의 구성요소를 유기전계발광표시장치로 구성한 제2예시도.
도 14는 본 발명의 구성으로 패드 부착 시 발생되는 패드 미스얼라인 문제를 검출하는 방법을 설명하기 위한 도면.
도 15는 본 발명의 제4실시예에 따른 유기전계발광표시장치의 구동방법을 설명하기 위한 흐름도.
이하, 본 발명의 실시를 위한 구체적인 내용을 첨부된 도면을 참조하여 설명한다.
도 1은 본 발명에 따른 유기전계발광표시장치의 개략적인 구성도이고, 도 2는 서브 픽셀의 회로 구성 예시도 이다.
도 1 및 도 2에 도시된 바와 같이, 본 발명에 따른 유기전계발광표시장치에는 영상처리부(120), 전원공급부(125), 타이밍제어부(130), 데이터구동부(150), 스캔구동부(140) 및 패널(160)이 포함된다.
영상처리부(120)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK) 및 데이터신호(DATA)를 타이밍제어부(130)에 공급한다. 영상처리부(120)는 시스템보드(110)에 형성된다.
타이밍제어부(130)는 영상처리부(120)로부터 공급된 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK) 등의 타이밍신호를 이용하여 데이터구동부(150)와 스캔구동부(140)의 동작 타이밍을 제어한다. 타이밍제어부(130)는 1 수평기간의 데이터 인에이블 신호(DE)를 카운트하여 프레임기간을 판단할 수 있으므로 외부로부터 공급되는 수직 동기신호(Vsync)와 수평 동기신호(Hsync)는 생략될 수 있다. 타이밍제어부(130)에서 생성되는 제어신호들에는 스캔구동부(140)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)와 데이터구동부(150)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)가 포함된다. 게이트 타이밍 제어신호(GDC)에는 게이트 스타트 펄스, 게이트 시프트 클럭, 게이트 출력 인에이블신호 등이 포함된다. 데이터 타이밍 제어신호(DDC)에는 소스 스타트 펄스, 소스 샘플링 클럭, 소스 출력 인에이블신호 등이 포함된다.
스캔구동부(140)는 타이밍제어부(130)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 게이트 구동전압의 레벨을 시프트시키면서 스캔신호를 순차적으로 생성한다. 스캔구동부(140)는 패널(160)에 포함된 서브 픽셀들(SP)에 연결된 스캔라인들(GL)을 통해 스캔신호를 공급한다.
데이터구동부(150)는 타이밍제어부(130)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍제어부(130)로부터 공급되는 데이터신호(DATA)를 샘플링하고 래치하여 병렬 데이터 체계의 데이터로 변환한다. 데이터구동부(150)는 데이터신호(DATA)를 감마 기준전압으로 변환한다. 데이터구동부(150)는 패널(160)에 포함된 서브 픽셀들(SP)에 연결된 데이터라인들(DL)을 통해 데이터신호(DATA)를 공급한다.
패널(160)은 매트릭스형태로 배치된 서브 픽셀들(SP)을 포함한다. 서브 픽셀들(SP)에는 적색 서브 픽셀, 녹색 서브 픽셀, 청색 서브 픽셀이 포함되고 경우에 따라 백색 서브 픽셀이 포함되기도 한다. 한편, 백색 서브 픽셀이 포함된 패널(160)은 각 서브 픽셀들(SP)의 발광층이 적색, 녹색 및 청색을 발광하지 않고 백색을 발광할 수 있다. 이 경우, 백색으로 발광된 광은 RGB 컬러필터에 의해 적색, 녹색 및 청색으로 변환된다.
한편, 패널(160)에 포함된 서브 픽셀의 예를 들면 다음의 도 2와 같이 구성될 수 있다. 하나의 서브 픽셀에는 스위칭 트랜지스터(SW), 구동 트랜지스터(DR), 커패시터(Cst), 보상회로(CC) 및 유기 발광다이오드(D)가 포함된다. 스위칭 트랜지스터(SW)는 제1스캔라인(GL1)을 통해 공급된 스캔신호에 응답하여 제1데이터라인(DL1)을 통해 공급되는 데이터신호가 커패시터(Cst)에 데이터전압으로 저장되도록 스위칭 동작한다. 구동 트랜지스터(DR)는 커패시터(Cst)에 저장된 데이터전압에 따라 제1전원배선(VDD)과 그라운드배선(GND) 사이로 구동 전류가 흐르도록 동작한다. 보상회로(CC)는 구동 트랜지스터(DR)의 문턱전압 등을 보상한다. 보상회로(CC)는 하나 이상의 트랜지스터와 커패시터로 구성된다. 보상회로(CC)의 구성은 매우 다양한바 이에 대한 구체적인 예시 및 설명은 생략한다. 유기 발광다이오드(D)는 구동 트랜지스터(DR)에 의해 형성된 구동 전류에 따라 빛을 발광하도록 동작한다.
하나의 서브 픽셀은 스위칭 트랜지스터(SW), 구동 트랜지스터(DR), 커패시터(Cst) 및 유기 발광다이오드(D)를 포함하는 2T(Transistor)1C(Capacitor) 구조로 구성된다. 그러나 보상회로(CC)가 추가된 경우 3T1C, 4T2C, 5T2C 등으로 구성된다. 위와 같은 구성을 갖는 서브 픽셀은 구조에 따라 전면발광(Top-Emission) 방식, 배면발광(Bottom-Emission) 방식 또는 양면발광(Dual-Emission) 방식으로 형성된다.
전원공급부(125)는 외부로부터 공급된 외부전압을 변환하여 제1전위전압(예컨대 20V 수준), 제2전위전압(예컨대 3.3V 수준) 및 저전위전압(예컨대 0V 수준) 등을 출력한다. 제1전위전압은 제1전원배선(VDD)에 공급되는 드레인 레벨의 전압이고, 제2전위전압을 제2전원배선(VCC)에 공급되는 콜렉터 레벨의 전압이며, 저전위전압은 그라운드배선(GND)에 공급되는 베이스 레벨의 전압이다. 전원공급부(125)는 영상처리부(120)와 함께 시스템보드(110)에 형성된다. 전원공급부(125)로부터 출력된 전원은 영상처리부(120), 타이밍제어부(130), 데이터구동부(150), 스캔구동부(140) 및 패널(160)에 이용된다.
한편, 앞서 설명된 타이밍제어부(130)는 패널(160)에 입력 펄스(PLS1)를 전송하고 패널(160)로부터 돌아오는 출력 펄스(PLS2)를 수신하며, 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 비교 결과에 따라 전원공급부(125)를 턴오프 시키는 셧다운 신호(SDS)를 출력한다.
타이밍제어부(130)가 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 비교 결과에 따라 셧다운 신호(SDS)를 출력하는 이유는 패널(160)에 존재하는 쇼트 유무에 대응하여 전원공급부(125)를 턴오프 시키기 위함이다.
패널(160)은 고전류에 의해 구동되므로, 쇼트가 발생하면 과전류가 패널(160)의 내부로 유입되어 고온의 열을 발생하게 되고 패널(160)의 서브 픽셀에 포함된 소자를 연소(burnt)시킴은 물론 이로 인한 화재를 일으키기도 한다.
쇼트는 제조공정(또는 모듈공정)시, 패널(160)에 유입된 파티클, 크랙(Crack), 패드부의 미스얼라인, 협소한 배선 레이아웃과 같은 내부 구조적 요인은 물론 정전기와 같은 외부적 요인 등으로 원인, 위치 및 대상이 다양하다.
따라서, 타이밍제어부(130)는 이러한 문제를 사전에 차단할 수 있도록 전원공급부(125)를 제어하여 패널(160) 등에 화재를 일으킬 가능성을 방지하는데 이에 대한 구체적인 설명은 다음과 같다.
이하, 본 발명에 따른 유기전계발광표시장치에 대해 더욱 자세히 설명한다.
<제1실시예>
도 3은 본 발명의 제1실시예에 따라 타이밍제어부를 이용한 쇼트검출부의 구성도이고, 도 4는 입력 펄스와 출력 펄스의 예시도이며, 도 5는 가이드배선의 이해를 돕기 위해 도 3의 A1-A2영역을 전달한 단면도이다.
도 3 내지 도 5에 도시된 바와 같이, 패널(160)에는 가이드배선(GR)이 형성된다. 그리고 타이밍제어부(130)의 제1단자(IO1)는 가이드배선(GR)의 일단에 연결되고 제2단자(IO2)는 가이드배선(GR)의 타단에 연결된다. 즉, 타이밍제어부(130)는 패널(160)에 형성된 가이드배선(GR)과 일종의 폐 루프(Closed Loop)를 구성한다.
타이밍제어부(130)는 가이드배선(GR)의 일단을 통해 제1단자(IO1)로부터 출력된 입력 펄스(PLS1)를 전송하고 가이드배선(GR)의 타단을 통해 돌아오는 출력 펄스(PLS2)를 제2단자(IO2)를 통해 수신한다. 그리고 타이밍제어부(130)는 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 비교 결과에 따라 전원공급부(125)를 제어한다.
입력 펄스(PLS1)는 예컨대 도 4의 좌측과 같이 로직로우와 로직하이가 교번하는 형태로 형성된다. 따라서, 출력 펄스(PLS2)가 우측의 (a)와 같이 입력 펄스(PLS1)와 동일하거나 유사한 형태로 수신되면, 타이밍제어부(130)는 패널(160)에 쇼트가 없는 정상 상태(Normal)로 판단하고 제3단자(IO3)를 통해 셧다운 신호(SDS)를 출력하지 않는다. 이와 달리, 출력 펄스(PLS2)가 우측의 (b)와 같이 입력 펄스(PLS1)와 비동일하거나 비유사한 형태(또는 출력 펄스의 신호가 로직로우 형태)로 수신되면, 타이밍제어부(130)는 패널(160)에 쇼트가 발생한 비정상 상태(Abnormal)로 판단하고 제3단자(IO3)를 통해 셧다운 신호(SDS)를 출력한다.
한편, 앞서 설명된 가이드배선(GR)은 도 5와 같이 제1전원배선(VDD)과 그라운드배선(GND) 사이에 절연되어 형성된다. 구체적으로 설명하면 다음과 같다.
제1기판(160a) 상에는 버퍼층(161)이 형성된다. 버퍼층(161)은 제1기판(160a)에서 유출되는 알칼리 이온 등과 같은 불순물로부터 후속 공정에서 형성되는 박막 트랜지스터 등의 소자를 보호하기 위해 형성된다.
버퍼층(161) 상에는 제1전원배선(VDD)이 형성된다. 제1전원배선(VDD)은 서브 픽셀에 제1전위전압을 공급하는 배선이다. 제1전원배선(VDD)은 도시된 바와 같이 다수로 분할되어 데이터라인과 같은 방향으로 배선된다.
제1전원배선(VDD) 상에는 제1절연막(163)이 형성된다. 제1절연막(163)은 실리콘 산화막(SiOx)이나 실리콘 질화막(SiNx)으로 형성된다. 제1절연막(163)은 박막 트랜지스터의 게이트절연막일 수 있다.
제1절연막(163) 상에는 가이드배선(GR)이 형성된다. 가이드배선(GR)은 패널(160)의 비표시영역(NA)의 일부 이상, 표시영역(AA)의 일부 이상 또는 비표시영역(NA) 및 표시영역(AA)의 일부 이상에 선택적으로 형성된다. 가이드배선(GR)이 패널(160)의 비표시영역(NA)에 형성된 경우, 타이밍제어부(130)는 비표시영역(NA)에서의 쇼트 여부를 검출할 수 있게 된다. 이와 달리, 가이드배선(GR)이 패널(160)의 표시영역(AA)에 형성된 경우, 타이밍제어부(130)는 표시영역(AA)에서의 쇼트 여부를 검출할 수 있게 된다. 이와 달리, 가이드배선(GR)이 패널(160)의 비표시영역(NA) 및 표시영역(AA)에 형성된 경우, 타이밍제어부(130)는 비표시영역(NA) 및 표시영역(AA)에서의 쇼트 여부를 검출할 수 있게 된다.
이하, 쇼트검출부의 구성에 대해 설명한다.
도 6은 타이밍제어부에 포함된 쇼트검출부의 블록도이다.
도 6에 도시된 바와 같이, 타이밍제어부(130)에는 펄스 생성부(131), 펄스 비교부(133) 및 셧다운 신호 생성부(132)를 포함하는 쇼트검출부(135)가 포함된다. 쇼트검출부(135)는 기능적 설명의 용이성을 위해 펄스 생성부(131), 펄스 비교부(133) 및 셧다운 신호 생성부(132)로 구분한 것일 뿐 이들은 하나 이상이 통합될 수 있다.
펄스 생성부(131)는 입력 펄스(PLS1)를 생성하고 타이밍제어부(130)의 제1단자(IO1)를 통해 생성된 입력 펄스(PLS1)를 출력한다. 펄스 생성부(131)는 도 4의 좌측과 같이 로직로우와 로직하이가 교번하는 형태로 입력 펄스(PLS1)를 생성한다. 그러나, 입력 펄스(PLS1)가 도 4의 좌측과 같이 전송되더라도 출력 펄스(PLS2)가 입력 펄스(PLS1)와 동일하게 수신되지 않는다. 그 이유는 패널마다 기생 커패시턴스나 기생 저항 등의 다양한 요인에 따른 고유의 신호 지연값을 갖고 있기 때문이다. 이와 같이 패널마다 고유의 신호 지연값을 가지고 있기 때문에, 펄스 생성부(131)는 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 위상이 동일하거나 유사한지를 가지고 패널의 쇼트 유무를 판단한다. 이 경우, 펄스 생성부(131)는 입력 펄스(PLS1)를 로직로우와 로직하이가 교번하는 형태로 생성하거나 신호의 폭 및 주기 중 하나 이상을 가변하더라도 검출할 수 있게 된다. 그러므로, 펄스 생성부(131)는 타이밍제어부(130)의 데이터 인에이블 신호(DE)나 클럭신호(CLK) 등 다양한 신호를 이용하여 입력 펄스(PLS1)를 생성할 수 있으므로 설계의 자유도를 높이면서도 검출력 또한 보장할 수 있게 된다.
펄스 비교부(133)는 입력 펄스(PLS1)와 출력 펄스(PLS2)를 비교한다. 펄스 비교부(133)는 타이밍제어부(130)의 제2단자(IO2)를 통해 출력 펄스(PLS2)를 제공받는다. 펄스 비교부(133)는 위상비교기로 구성될 수 있다.
펄스 비교부(133)는 입력 펄스(PLS1)와 출력 펄스(PLS2)를 비교하고 두 펄스가 동일하거나 유사하면 로직로우(또는 로직하이)신호를 출력한다. 이와 달리, 펄스 비교부(133)는 두 펄스가 비동일하거나 비유사한 형태(또는 출력 펄스의 신호가 없는 형태)로 수신되면 로직하이(또는 로직로우)신호를 출력한다.
셧다운 신호 생성부(132)는 타이밍제어부(130)의 제3단자(IO3)를 통해 셧다운 신호(SDS)를 출력한다. 셧다운 신호 생성부(132)는 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 비교 결과에 따라 펄스 비교부(133)로부터 로직로우신호가 공급되면 로직로우신호의 셧다운 신호(SDS)를 출력하거나 미출력한다. 이와 달리, 셧다운 신호 생성부(132)는 입력 펄스(PLS1)와 출력 펄스(PLS2) 간의 비교 결과에 따라 펄스 비교부(133)로부터 로직하이신호가 공급되면 로직하이 신호의 셧다운 신호(SDS)를 출력한다.
본 발명에서는 펄스 생성부(131), 펄스 비교부(133) 및 셧다운 신호 생성부(132)를 포함하는 쇼트검출부(135)가 타이밍제어부(130)에 포함된 것을 일례로 하였다. 그러나 쇼트검출부(135)는 타이밍제어부(130)와 별도의 장치로 구성될 수도 있다. 이 경우, 쇼트검출부(135)는 입력 펄스(PLS1)에 해당하는 펄스 신호만 타이밍제어부(130)로부터 공급받거나 영상처리부로부터 출력되는 데이터 인에이블 신호(DE)나 클럭신호(CLK)를 입력 펄스(PLS1)로 이용하도록 구성될 수도 있다.
한편, 타이밍제어부(130)에 쇼트검출부(135)가 포함된 경우 쇼트에 의해 타이밍제어부(130)가 손상되거나 신호의 미약이 야기될 수도 있는바 이를 개선하기 위한 예를 설명하면 다음과 같다. 설명의 편의를 위해 도 6을 함께 참조한다.
<제2실시예>
도 7 내지 도 9는 본 발명의 제2실시예에 따라 타이밍제어부와 연동하는 펄스 전송부 및 펄스 수신부를 이용한 쇼트 검출의 예를 설명하기 위한 도면이다.
도 6, 도 7 내지 도 9에 도시된 바와 같이, 타이밍제어부(130)의 제1단자(IO1) 및 제2단자(IO2)에는 펄스 전송부(170)와 펄스 수신부(180)가 각각 연결된다.
펄스 전송부(170)는 펄스 생성부(131)로부터 입력 펄스(PLS1)를 제공받고 가이드배선(GR)의 일단을 통해 입력 펄스(PLS1)를 전송하는 펄스 전송용 버퍼 역할을 한다. 펄스 수신부(180)는 가이드배선(GR)의 타단을 통해 돌아오는 출력 펄스(PLS2)를 수신하여 펄스 비교부(133)에 제공하는 펄스 수신용 버퍼 역할을 한다.
도 7과 같이, 패널(160)에 쇼트 발생 요인이 없는 경우 입력 펄스(PLS1)와 출력 펄스(PLS2)는 동일하거나 유사한 형태로 수신된다. 따라서, 셧다운 신호 생성부(132)는 타이밍제어부(130)의 제3단자(IO3)를 통해 셧다운 신호(SDS)를 미출력하게 된다. 이때, 전원공급부는 도 9의 (a)와 같이 출력단(Vout)의 출력을 유지하게 된다.[정상 상태(Normal)]
도 8과 같이, 패널(160)에 쇼트 발생 요인(Short)이 있는 경우 출력 펄스(PLS2)의 신호가 없는 형태(또는 입력 펄스와 출력 펄스가 비동일하거나 비유사한 형태)로 수신된다. 따라서, 셧다운 신호 생성부(132)는 타이밍제어부(130)의 제3단자(IO3)를 통해 셧다운 신호(SDS)를 출력하게 된다. 이때, 전원공급부는 도 9의 (b)와 같이 출력단(Vout)의 출력을 차단하게 된다.[비정상 상태(Abnormal)]
이하, 앞서 설명된 펄스 전송부(170)와 펄스 수신부(180)의 회로 구성에 대한 예를 설명하면 다음과 같다.
<제3실시예>
도 10은 본 발명의 제3실시예에 따라 타이밍제어부와 연동하는 펄스 전송부 및 펄스 수신부의 회로 구성 예시도이고, 도 11은 도 10에 도시된 회로 구성에 따른 동작을 설명하기 위한 파형도이다.
도 6 및 도 10에 도시된 바와 같이, 펄스 전송부(170)에는 제1저항기(Rt) 및 제1트랜지스터(Tt)가 포함된다. 펄스 전송부(170)는 타이밍제어부(130)의 제1단자(IO1)에 연결된 펄스 생성부(131)로부터 출력된 입력 펄스(PLS1)를 가이드배선(GR)에 전송하는 역할을 한다.
이를 위해, 제1저항기(Rt)는 제2전원배선(VCC)에 일단이 연결되고 가이드배선(GR)의 일단에 타단이 연결된다. 제1트랜지스터(Tt)는 제1저항기(Rt)의 타단에 제1전극이 연결되고 그라운드배선(GND)에 제2전극이 연결되며 펄스 생성부(131)의 단자(IO1)에 게이트전극이 연결된다.
한편, 펄스 전송부(170)에는 제1저항기(Rt)의 타단과 가이드배선(GR)의 일단 사이에 위치하는 다이오드(Dt)를 포함한다. 다이오드(Dt)는 제1전원배선과 가이드배선 간의 쇼트 발생 시, 제1전원배선을 통해 흐르는 제1전위전압이 역류하는 것을 방지한다. 이를 위해, 다이오드(Dt)는 제1저항기(Rt)의 타단에 애노드전극이 연결되고 가이드배선(GR)의 일단에 캐소드전극이 연결된다.
펄스 수신부(180)에는 제2저항기(Rr) 및 제2트랜지스터(Tr)가 포함된다. 펄스 수신부(180)는 가이드배선(GR)을 통해 돌아오는 출력 펄스(PLS2)를 수신하여 타이밍제어부(130)에 포함된 펄스 비교부(133)에 공급하는 역할을 한다.
이를 위해, 제2저항기(Rr)는 제2전원배선(VCC)에 일단이 연결되고 펄스 비교부(133)의 단자(IO2)에 타단이 연결된다. 제2트랜지스터(Tr)는 제2저항기(Rr)의 타단에 제1전극이 연결되고 그라운드배선(GND)에 제2전극이 연결되며 가이드배선(GR)의 타단에 게이트전극이 연결된다.
앞서 설명된 펄스 전송부(170) 및 펄스 수신부(180)에 의해 가이드배선(GR)과 타이밍제어부(130)는 전기적으로 간접적인 연결 구조를 취하므로, 전원간의 쇼트가 발생하더라도 타이밍제어부(130)의 회로 손상은 방지된다. 한편, 위의 설명에서는 제1저항기(Rt) 및 제2저항기(Rr)의 일단이 제2전원배선(VCC)에 연결된 것을 일례로 하였다. 하지만 이는 고 전위전압을 공급하는 다른 전원배선에 연결될 수도 있다.
한편, 펄스 전송부(170) 및 펄스 수신부(180)가 위와 같은 회로로 구성된 경우, 각 테스트 포인트(TP1 ~ TP4)에서 검출되는 파형은 패널의 상태별로 다음과 같을 수 있다.
도 11의 (a)는 패널(160)에 쇼트가 없는 정상 상태일 경우 각 테스트 포인트(TP1 ~ TP4)에서 검출되는 파형을 나타낸다.
도 6, 도 10 및 도 11의 (a)에 도시된 바와 같이, 타이밍제어부(130)의 제1단자(IO1)를 통해 로직하이(H)와 로직로우(L)로 교번하는 입력 펄스(PLS1)가 출력되면, 제1테스트 포인트(TP1)에는 입력 펄스(PLS1)와 동일한 펄스가 검출된다.
입력 펄스(PLS1)가 로직하이(H)가 되면, 제1트랜지스터(Tt)는 턴온된 상태가 된다. 이와 달리, 입력 펄스(PLS1)가 로직로우(L)가 되면, 제1트랜지스터(Tt)는 턴오프된 상태가 된다. 패널(160)은 쇼트가 없는 정상 상태이므로, 제2테스트 포인트(TP2)에는 제1테스트 포인트(TP1)와 역상 관계를 갖는 로직로우(L)와 로직하이(H)의 입력 펄스(PLS1)가 검출되고, 제3테스트 포인트(TP3) 또한 제2테스트 포인트(TP2)와 동일한 출력 펄스(PLS2)가 검출된다.
출력 펄스(PLS2)가 로직로우(L)가 되면, 제2트랜지스터(Tr)는 턴오프된 상태가 된다. 이와 달리, 출력 펄스(PLS2)가 로직하이(H)가 되면, 제2트랜지스터(Tr)는 턴온된 상태가 된다. 따라서, 제4테스트 포인트(TP4)에는 제3테스트 포인트(TP3)와 역상 관계를 갖는 로직하이(H)와 로직로우(L)의 출력 펄스(PLS2)가 검출된다.
이 경우, 타이밍제어부(130)의 제2단자(IO2)에는 입력 펄스(PLS1)와 동일하거나 유사한 위상을 갖는 출력 펄스(PLS2)가 공급된다. 입력 펄스(PLS1)와 출력 펄스(PLS2)의 위상이 동일하거나 유사하다는 것은 패널(160)에 쇼트가 없는 정상 상태로 판단된다. 그러므로 타이밍제어부(130)는 제3단자(IO3)를 통해 로직로우(L)의 셧다운 신호(SDS)를 출력하게 되고, 전원공급부는 출력을 유지하게 된다.
도 11의 (b)는 패널(160)에 쇼트가 있는 비정상 상태일 경우 각 테스트 포인트(TP1 ~ TP4)에서 검출되는 파형을 나타낸다.
도 6, 도 10 및 도 11의 (b)에 도시된 바와 같이, 타이밍제어부(130)의 제1단자(IO1)를 통해 로직하이(H)와 로직로우(L)로 교번하는 입력 펄스(PLS1)가 출력되면, 제1테스트 포인트(TP1)에는 입력 펄스(PLS1)와 동일한 펄스가 검출된다.
입력 펄스(PLS1)가 로직하이(H)가 되면, 제1트랜지스터(Tt)는 턴온된 상태가 된다. 이와 달리, 입력 펄스(PLS1)가 로직로우(L)가 되면, 제1트랜지스터(Tt)는 턴오프된 상태가 된다. 패널(160)은 쇼트가 있는 비정상 상태이므로, 제2테스트 포인트(TP2)에는 지속적으로 로직로우(L)의 입력 펄스(PLS1)가 검출되고, 제3테스트 포인트(TP3) 또한 제2테스트 포인트(TP2)와 동일한 로직로우(L)의 출력 펄스(PLS2)가 검출된다.
출력 펄스(PLS2)가 로직로우(L)로 지속 되면, 제2트랜지스터(Tr)는 턴오프된 상태를 유지하게 된다. 따라서, 제4테스트 포인트(TP4)에는 제3테스트 포인트(TP3)와 역상 관계를 갖는 로직하이(H)의 출력 펄스(PLS2)가 지속적으로 검출된다.
이 경우, 타이밍제어부(130)의 제2단자(IO2)에는 입력 펄스(PLS1)와 위상 및 펄스폭이 다른 출력 펄스(PLS2)가 공급된다. 입력 펄스(PLS1)와 출력 펄스(PLS2)가 다르다는 것은 패널(160)에 쇼트가 있는 비정상 상태로 판단된다. 그러므로 타이밍제어부(130)는 제3단자(IO3)를 통해 로직하이(H)의 셧다운 신호(SDS)를 출력하게 되고, 전원공급부는 출력을 차단하게 된다.
이하, 본 발명의 구성을 유기전계발광표시장치로 구성한 예를 설명한다.
도 12는 본 발명의 구성요소를 유기전계발광표시장치로 구성한 제1예시도이고, 도 13은 본 발명의 구성요소를 유기전계발광표시장치로 구성한 제2예시도이다.
도 12에 도시된 바와 같이, 패널(160)의 표시영역(AA) 양쪽 외측인 비표시영역(NA)에는 다수의 스캔구동부(140)가 형성된다. 스캔구동부(140)는 게이트인패널(Gate-In Panel) 방식으로 서브 픽셀의 트랜지스터 공정과 함께 패널(160)에 형성된다. 데이터구동부(150)는 다수의(예컨대 4개의) IC(Integrated Circuit) 형태로 구성되고 다수의(예컨대 4개의) 제1연성기판(155)에 실장되어 FOG 방식으로 패널(160)의 패드부에 일측이 부착되고 다수의(예컨대 2개의) 소스회로보드(157)에 타측이 부착된다.
타이밍제어부(130), 펄스 전송부(170) 및 펄스 수신부(180)는 제어회로보드(134)에 형성된다. 소스회로보드(157)와 제어회로보드(134)는 제2연성기판(137)에 의해 연결된다. 영상처리부(120) 및 전원공급부(125)는 시스템보드(110)에 형성된다. 제어회로보드(134)와 시스템보드(110)는 제3연성기판(115)에 의해 연결된다.
위와 같은 구조로 유기전계발광표시장치가 구성된 경우, 전원공급부(125)로부터 출력된 제1전위전압은 제어회로보드(134)를 거쳐 패널(160)까지 형성된 제1전원배선을 통해 공급된다.
펄스 전송부(170)는 제어회로보드(134), 제2연성기판(137), 소스회로보드(157) 및 제1연성기판(155)까지 형성된 펄스 전송배선(177)을 통해 패널(160)에 형성된 가이드배선의 일단에 연결된다. 그리고 펄스 수신부(180)는 제어회로보드(134), 제2연성기판(137), 소스회로보드(157) 및 제1연성기판(155)까지 형성된 펄스 수신배선(187)을 통해 패널(160)에 형성된 가이드배선의 타단에 연결된다. 타이밍제어부(130)는 제어회로보드(134), 제3연성기판(115) 및 시스템보드(110)까지 형성된 셧 다운 신호배선(139)을 통해 전원공급부(125)에 연결된다.
도 12에서는 펄스 전송부(170) 및 펄스 수신부(180)가 제어회로보드(134)에 형성된 것을 예로 하였다. 그러나, 펄스 전송부(170) 및 펄스 수신부(180)는 도 13과 같이 소스회로보드(157)에 형성될 수 있다. 또한, 펄스 전송부(170)는 제어회로보드(134)에 형성되고 펄스 수신부(180)는 소스회로보드(157)에 형성되는 형태로 변형될 수도 있다.
한편, 위의 설명에서는 시스템보드(110)부터 패널(160)까지 전기적인 접속을 이루는데 필요한 구성으로 다양한 기판과 보드가 포함된 것을 일례로 하였으나 이들은 특정 기판과 보드가 통합되어 간소화될 수도 있다.
한편, 펄스 전송배선(177) 및 펄스 수신배선(187)은 패드를 이용한 전기적인 연결방식으로 패널(160)과 결선된다. 따라서, 본 발명은 패널(160)에 형성된 패드와 제1연성기판(155)에 형성된 패드 간의 부착 시 발생되는 패드 미스얼라인(패드 오픈)이나 패드 쇼트에 기인하는 문제 또한 검출할 수 있는데 이는 다음과 같다.
도 14는 본 발명의 구성으로 패드 부착 시 발생되는 패드 미스얼라인 문제를 검출하는 방법을 설명하기 위한 도면이다.
도 12 및 도 14에 도시된 바와 같이, 패널(160)의 패드영역(PADA)에는 제1패드(168)가 형성된다. 제1패드(168)에는 패널(160)에 포함된 서브 픽셀, 가이드배선, 제1전원배선, 그라운드배선 및 스캔구동부(140) 등에 신호나 전원을 전달하는 배선들이 결선된다. 데이터구동부(150)가 실장된 제1연성기판(155)에는 제1패드(168)와 연결되는 제2패드(158)가 형성된다. 제2패드(158)에는 패널(160)에 포함된 서브 픽셀, 가이드배선, 제1전원배선, 그라운드배선 및 스캔구동부(140) 등에 신호나 전원을 전달하는 배선들이 결선된다.
제1패드(168)와 제2패드(158)는 패드영역(PADA)에서 상호 얼라인되고 이방성 도전성 필름(ACF)에 의해 전기적으로 연결된다. 제1패드(168)와 제2패드(158)가 정확한 얼라인 상태로 부착되면 도 14의 (a)와 같이 제1패드(168)와 제2패드(158)는 상호 대응된 상태가 된다. 그러나, 제1패드(168)와 제2패드(158)가 부정확한 얼라인 상태로 부착되면 도 14의 (b)와 같이 제1패드(168)와 제2패드(158)는 상호 이격된 상태가 된다. 예컨대, 제1패드(168)와 제2패드(158)는 상호 중첩되지 않고 비 중첩된 상태가 된다.
도 14의 (a)와 같이, 제1패드(168)와 제2패드(158)가 정확한 얼라인 상태로 부착되면 제1연성기판(155)에 형성된 펄스 전송배선(177)은 패널(160)에 형성된 가이드배선에 입력 펄스를 정상적으로 공급할 수 있게 된다. 따라서, 타이밍제어부(130)는 패널(160)에 쇼트가 없는 한 정상적인 출력 펄스를 공급받게 된다.
도 14의 (b)와 같이, 제1패드(168)와 제2패드(158)가 부정확한 얼라인 상태로 부착되면(패드 미스얼라인이 발생) 제1연성기판(155)에 형성된 펄스 전송배선(177)은 패널(160)에 형성된 가이드배선에 입력 펄스를 정상적으로 공급할 수 없게 된다. 따라서, 타이밍제어부(130)는 패널(160)에 쇼트 여부와 상관없이 비정상적인 출력 펄스를 공급받게 된다. 예컨대, 타이밍제어부(130)는 도 4의 우측 (b)와 같이 신호가 없는 형태 또는 로직로우의 출력 펄스를 공급받게 된다.
도 14의 (a)와 같은 경우 타이밍제어부(130)는 패널(160)에 쇼트가 없는 셧 다운 신호배선(139)을 통해 전원공급부를 턴오프하라는 셧 다운 신호를 출력하지 않는다. 반면, 도 14의 (b)와 같은 경우 타이밍제어부(130)는 패널(160)에 쇼트가 없더라도 패드 미스얼라인이 발생하였으므로 셧 다운 신호배선(139)을 통해 전원공급부를 턴오프하라는 셧 다운 신호를 출력한다. 이로써, 제1패드(168)와 제2패드(158)를 전기적으로 연결하는 FOG 공정에서는 별도의 공정을 진행하지 않은 상태에서도 패드 간의 얼라인 상태가 정상적인지 또는 비정상적인지를 알 수 있게 된다.
한편, 본 발명은 패널(160)에 형성된 제1패드(168)와 제1연성기판(155)에 형성된 제2패드(158) 간의 패드 미스얼라인만을 언급하였다. 그러나, 펄스 전송배선(177) 및 펄스 수신배선(187)은 제어회로보드(134), 제2연성기판(137) 및 소스회로보드(157)를 지나 제1연성기판(155)까지 형성되어 있으므로 이들 중 하나 이상에서 발생된 패드 미스얼라인도 포함된다. 즉, 본 발명은 실시예의 구성을 이용하여 모듈 공정 전반에서 발생되는 쇼트나 패드 오픈을 검출할 수 있다.
이하, 본 발명에 따른 유기전계발광표시장치의 구동방법에 대해 설명한다.
도 15는 본 발명의 제4실시예에 따른 유기전계발광표시장치의 구동방법을 설명하기 위한 흐름도이다. 도 15의 구동방법은 앞서 설명된 구성 중 하나 이상을 이용한 방식을 대표하는 것일 뿐 이에 한정되지 않으며, 설명의 이해를 돕기 위해 도 1 내지 도 14를 함께 참조한다.
먼저, 패널(160)에 영상을 표시한다(S110). 다음, 패널(160)에 형성된 가이드배선(GR)에 제공할 입력 펄스(PLS1)를 생성한다.(S120). 다음, 가이드배선(GR)의 일단을 통해 입력 펄스(PLS1)를 전송하고 가이드배선(GR)의 타단을 통해 돌아오는 출력 펄스(PLS2)를 수신한다(S130). 다음, 입력 펄스(PLS1)와 출력 펄스(PLS2)를 비교한다(S140). 다음, 입력 펄스(PLS1)와 출력 펄스(PLS2)의 위상이 동일 또는 유사한지 판단한다(S150). 입력 펄스(PLS1)와 출력 펄스(PLS2)의 위상이 동일 또는 유사하면(Y) 정상동작으로 판단하고(S160), 패널(160)에 전원을 공급하는 전원공급부(125)를 턴오프 시키는 셧다운 신호(SDS)를 미출력한다. 이와 달리, 입력 펄스(PLS1)와 출력 펄스(PLS2)의 위상이 비동일 또는 비유사하면(N) 비정상동작으로 판단하고(S170), 패널(160)에 전원을 공급하는 전원공급부(125)를 턴오프 시키는 셧다운 신호(SDS)를 출력한다(S180).
위의 설명에서 입력 펄스(PLS1)를 생성하는 단계는 도 4의 좌측과 같이 로직로우(L)와 로직하이(H)가 교번하는 형태로 생성할 수 있다. 본 발명은 입력 펄스(PLS1)와 출력 펄스(PLS2)의 위상이 동일 또는 유사한지 여부를 가지고 패널(160)의 쇼트 유무를 판단한다. 따라서, 입력 펄스(PLS1)는 로직로우(L)와 로직하이(H) 또는 로직하이(H)와 로직로우(L)가 교번하는 형태만 가지면 되므로 신호의 레벨, 폭 및 주기 중 하나 이상을 가변하여 생성하더라도 무관하다.
이상 본 발명은 패널에 쇼트 발생 시 서브 픽셀에 포함된 소자에 과전류가 흐르게 되면서 국부적인 연소(burnt)가 전면으로 확산(하나의 서브 픽셀에서 주변 서브 픽셀까지 연소)되는 것을 방지하여 화재로 이어질 수 있는 가능성을 제거할 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 효과가 있다. 또한, 본 발명은 패널의 쇼트 뿐만 아니라 패드의 오픈을 검출해낼 수 있는 유기전계발광표시장치와 이의 구동방법을 제공하는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
120: 영상처리부 125: 전원공급부
130: 타이밍제어부 150: 데이터구동부
140: 스캔구동부 160: 패널
GR: 가이드배선 131: 펄스 생성부
133: 펄스 비교부 132: 셧다운 신호 생성부
135: 쇼트검출부 PLS1: 입력 펄스
PLS2: 출력 펄스 170: 펄스 전송부
Rt: 제1저항기 Tt: 제1트랜지스터
180: 펄스 수신부 Rr: 제2저항기
Tr: 제2트랜지스터

Claims (10)

  1. 패널;
    상기 패널을 구동하는 구동부;
    상기 구동부를 제어하는 타이밍제어부;
    상기 패널에 전원을 공급하는 전원공급부;
    상기 패널에 위치하는 제1전원배선과 그라운드배선 사이에 절연되어 형성된 가이드배선; 및
    상기 가이드배선과 폐 루프를 구성하며 상기 가이드배선의 일단을 통해 입력 펄스를 전송하고 상기 가이드배선의 타단을 통해 돌아오는 출력 펄스를 수신하며, 상기 입력 펄스와 상기 출력 펄스 간의 비교 결과에 따라 상기 전원공급부를 턴오프 시키는 셧다운 신호를 출력하는 쇼트검출부를 포함하는 유기전계발광표시장치.
  2. 제1항에 있어서,
    상기 쇼트검출부는
    로직로우와 로직하이가 교번하는 형태로 상기 입력 펄스를 생성하는 것을 특징으로 하는 유기전계발광표시장치.
  3. 제1항에 있어서,
    상기 쇼트검출부는
    상기 입력 펄스와 상기 출력 펄스 간의 위상이 다르면 상기 셧다운 신호를 출력하는 것을 특징으로 하는 유기전계발광표시장치.
  4. 제1항에 있어서,
    상기 쇼트검출부는
    상기 입력 펄스를 생성하는 펄스 생성부와,
    상기 입력 펄스와 상기 출력 펄스를 비교하는 펄스 비교부와,
    상기 입력 펄스와 상기 출력 펄스 간의 비교 결과에 따라 상기 셧다운 신호를 출력하는 셧다운 신호 생성부를 포함하는 유기전계발광표시장치.
  5. 제4항에 있어서,
    상기 쇼트검출부는
    상기 펄스 생성부로부터 상기 입력 펄스를 제공받고 상기 가이드배선의 일단을 통해 상기 입력 펄스를 전송하는 펄스 전송부와,
    상기 가이드배선의 타단을 통해 출력된 상기 출력 펄스를 수신하여 상기 펄스 비교부에 제공하는 펄스 수신부를 포함하는 것을 특징으로 하는 유기전계발광표시장치.
  6. 제5항에 있어서,
    상기 펄스 전송부는
    제2전원배선에 일단이 연결되고 상기 가이드배선의 일단에 타단이 연결된 제1저항기와,
    상기 제1저항기의 타단에 제1전극이 연결되고 상기 그라운드배선에 제2전극이 연결되며 상기 펄스 생성부의 단자에 게이트전극이 연결된 제1트랜지스터를 포함하고,
    상기 펄스 수신부는
    상기 제2전원배선에 일단이 연결되고 상기 펄스 비교부의 단자에 타단이 연결된 제2저항기와,
    상기 제2저항기의 타단에 제1전극이 연결되고 상기 그라운드배선에 제2전극이 연결되며 상기 가이드배선의 타단에 게이트전극이 연결된 제2트랜지스터를 포함하는 유기전계발광표시장치.
  7. 제6항에 있어서,
    상기 펄스 전송부는
    상기 제1저항기의 타단과 상기 가이드배선의 일단 사이에 위치하는 다이오드를 포함하되,
    상기 다이오드는 상기 제1저항기의 타단에 애노드전극이 연결되고 상기 가이드배선의 일단에 캐소드전극이 연결된 것을 특징으로 하는 유기전계발광표시장치.
  8. 제1항 내지 제7항 중 어느 한 항에 따른 유기전계발광표시장치를 구동하는 방법에 있어서,
    패널에 영상을 표시하는 단계;
    상기 패널에 형성된 가이드배선에 제공할 입력 펄스를 생성하는 단계;
    상기 가이드배선의 일단을 통해 입력 펄스를 전송하고 상기 가이드배선의 타단을 통해 돌아오는 출력 펄스를 수신하는 단계;
    상기 입력 펄스와 상기 출력 펄스를 비교하는 단계; 및
    상기 입력 펄스와 상기 출력 펄스 간의 비교 결과에 따라 상기 패널에 전원을 공급하는 전원공급부를 턴오프 시키는 셧다운 신호를 출력하는 단계를 포함하는 유기전계발광표시장치의 구동방법.
  9. 제8항에 있어서,
    상기 입력 펄스를 생성하는 단계는
    로직로우와 로직하이가 교번하는 형태로 생성하는 것을 특징으로 하는 유기전계발광표시장치의 구동방법.
  10. 제8항에 있어서,
    상기 셧다운 신호를 출력하는 단계는
    상기 입력 펄스와 상기 출력 펄스 간의 위상이 다르면 상기 셧다운 신호를 출력하는 것을 특징으로 하는 유기전계발광표시장치의 구동방법.
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