KR101047484B1 - Electronic printed circuit board and its manufacturing method - Google Patents
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Abstract
전자 소자 내장 인쇄회로기판 및 그 제조 방법이 개시된다. 복수의 전극이 형성된 전자 소자가 내장된 인쇄회로기판을 제조하는 방법으로서, 전자 소자의 전극을 커버하도록 전자 소자에 광경화성 수지층을 형성하는 단계, 절연층에 전자 소자를 매립하는 단계, 광경화성 수지층의 일부에 광을 조사하여, 광경화성 수지층에 전자 소자의 전극이 노출되도록 비아홀(via hole)을 형성하는 단계, 비아홀에 전도성 물질을 충전하여 비아(via)를 형성하는 단계, 및 비아와 전기적으로 연결되도록 회로 패턴을 형성하는 단계를 포함하는 전자 소자 내장 인쇄회로기판 제조 방법이 제공된다. 이와 같은 본 발명에 따르면, 비아홀의 형성에 있어 레이져를 사용하지 않으므로, 생산성을 향상시키고 제조 비용을 절감할 수 있다.An electronic device embedded printed circuit board and a method of manufacturing the same are disclosed. A method of manufacturing a printed circuit board having an electronic device having a plurality of electrodes formed thereon, the method comprising: forming a photocurable resin layer on an electronic device to cover an electrode of the electronic device, embedding the electronic device in an insulating layer, and photocurable Irradiating light to a portion of the resin layer to form a via hole so that the photocurable resin layer exposes the electrode of the electronic device, filling the via hole with a conductive material to form a via, and via Provided is a method of manufacturing an electronic device embedded printed circuit board including forming a circuit pattern to be electrically connected with the electronic device. According to the present invention, since the laser is not used to form the via holes, productivity can be improved and manufacturing costs can be reduced.
전자 소자, 광경화성 수지층, 마스크 Electronic device, photocurable resin layer, mask
Description
본 발명은 전자 소자 내장 인쇄회로기판 및 그 제조 방법에 관한 것이다.The present invention relates to an electronic device embedded printed circuit board and a method of manufacturing the same.
전자 산업의 발달에 따라, 전자 부품의 고기능화, 소형화에 대한 요구가 증가되고 있고, 이와 함께, 전자 소자가 실장된 인쇄회로기판의 박형화가 요구되고 있다.With the development of the electronic industry, there is an increasing demand for high functionalization and miniaturization of electronic components, and at the same time, there is a demand for thinning printed circuit boards on which electronic devices are mounted.
이에 인쇄회로기판의 표면에 전자 소자를 실장하는 기존의 표면 실장식(SMT, Surface Mount Technology)과는 다른 새로운 방식의 전자 소자 실장 방식이 대두되고 있다.Accordingly, a new method of mounting an electronic device, which is different from the existing surface mount technology (SMT) for mounting an electronic device on the surface of a printed circuit board, has emerged.
즉, 인쇄회로기판의 내부에, 반도체 칩과 같은 능동 부품이나 캐패시터(capacitor)와 같은 수동 부품을 매립시켜 부품의 고밀도화 및 신뢰성 향상을 추구하는 전자 소자(능동 및 수동 소자) 내장 인쇄회로기판에 대한 연구가 진행되고 있는 것이다.That is, a printed circuit board for electronic devices (active and passive devices) in which active components such as semiconductor chips or passive components such as capacitors are embedded in a printed circuit board to seek high density and reliability of components. Research is ongoing.
그러나, 종래 기술에 따른 전자 소자 내장 인쇄회로기판의 경우, 전자 소자 의 전극을 외부와 전기적으로 연결하는 비아를 형성하기 위한 비아홀 가공 공정에 있어, 레이져를 이용함으로써, 생산성이 떨어지고, 제조 비용이 증가하는 문제점이 있다.However, in the case of a printed circuit board incorporating an electronic device according to the prior art, in a via hole processing process for forming a via which electrically connects an electrode of an electronic device with the outside, productivity is reduced and manufacturing cost is increased by using a laser. There is a problem.
본 발명은, 생산성이 향상되고, 제조 비용이 절감된 전자 소자 내장 인쇄회로기판 및 그 제조 방법을 제공하는 것이다.The present invention provides an electronic device-embedded printed circuit board with improved productivity and reduced manufacturing cost, and a method of manufacturing the same.
본 발명의 일 측면에 따르면, 복수의 전극이 형성된 전자 소자가 내장된 인쇄회로기판을 제조하는 방법으로서, 전자 소자의 전극을 커버하도록 전자 소자에 광경화성 수지층을 형성하는 단계, 절연층에 전자 소자를 매립하는 단계, 광경화성 수지층의 일부에 광을 조사하여, 광경화성 수지층에 전자 소자의 전극이 노출되도록 비아홀(via hole)을 형성하는 단계, 비아홀에 전도성 물질을 충전하여 비아(via)를 형성하는 단계, 및 비아와 전기적으로 연결되도록 회로 패턴을 형성하는 단계를 포함하는 전자 소자 내장 인쇄회로기판 제조 방법이 제공된다.According to an aspect of the present invention, a method for manufacturing a printed circuit board containing an electronic device having a plurality of electrodes, comprising: forming a photocurable resin layer on the electronic device to cover the electrode of the electronic device, the electron in the insulating layer Embedding the device, irradiating light to a portion of the photocurable resin layer, forming a via hole to expose the electrode of the electronic device to the photocurable resin layer, and filling a via hole with a conductive material And forming a circuit pattern to be electrically connected to the via.
이 때. 광경화성 수지층을 형성하는 단계는, 금속박(metal foil)과 전자 소자의 전극 사이에 광경화성 수지층을 개재하여, 전자 소자의 전극이 금속박을 향하도록 금속박에 전자 소자를 적층하는 단계를 포함할 수 있다.At this time. Forming the photocurable resin layer may include laminating the electronic device on the metal foil so that the electrode of the electronic device faces the metal foil through the photocurable resin layer between the metal foil and the electrode of the electronic device. Can be.
또한, 비아홀을 형성하는 단계 이전에, 금속박에 전자 소자의 전극 위치와 각각 대응되도록 복수의 관통홀을 형성하는 단계를 더 포함하고, 비아홀을 형성하는 단계는, 관통홀을 통해 광경화성 수지층에 광을 조사하는 단계를 포함할 수 있다.Further, before forming the via hole, the method may further include forming a plurality of through holes in the metal foil so as to correspond to electrode positions of the electronic elements, and the forming of the via holes may include forming the through holes in the photocurable resin layer. Irradiating light.
그리고, 광경화성 수지층을 형성하는 단계 이전에, 캐리어(carrier)에 금속박을 형성하는 단계를 더 포함하고, 전자 소자를 매립하는 단계와 비아홀을 형성하는 단계 사이에, 캐리어를 제거하는 단계를 더 포함할 수 있다.And, before forming the photocurable resin layer, further comprising the step of forming a metal foil on the carrier (carrier), between the step of embedding the electronic device and the step of forming the via hole, further removing the carrier It may include.
또한, 전자 소자를 매립하는 단계는, 전자 소자가 매립되도록 금속박에 절연층을 적층하는 단계를 포함할 수 있다.Also, embedding the electronic device may include laminating an insulating layer on the metal foil so that the electronic device is embedded.
한편, 광경화성 수지층은, 전자 소자의 전극을 모두 커버하되, 너비가 전자 소자의 너비 이하일 수 있다.On the other hand, the photocurable resin layer covers all the electrodes of the electronic device, the width may be less than the width of the electronic device.
또한, 본 발명의 다른 측면에 따르면, 복수의 전극이 형성된 전자 소자가 내장된 인쇄회로기판으로서, 절연층, 절연층에 매립되는 전자 소자, 전자 소자의 전극을 커버하도록 전자 소자에 형성되는 광경화성 수지층, 광경화성 수지층을 관통하여 전자 소자의 전극과 접하는 비아, 및 비아와 전기적으로 연결되도록 형성되는 회로 패턴을 포함하는 전자 소자 내장 인쇄회로기판이 제공된다.In addition, according to another aspect of the present invention, a printed circuit board in which an electronic device with a plurality of electrodes is formed is embedded, an insulating layer, an electronic device embedded in the insulating layer, a photocurable formed on the electronic device to cover the electrode of the electronic device Provided is an electronic device embedded printed circuit board including a resin layer, a via penetrating through a photocurable resin layer, and a circuit pattern formed to be electrically connected to the via.
이 때, 광경화성 수지층은, 전자 소자의 전극을 모두 커버하되, 너비가 전자 소자의 너비 이하일 수 있다.In this case, the photocurable resin layer covers all the electrodes of the electronic device, but the width may be equal to or less than the width of the electronic device.
본 발명의 실시예에 따르면, 비아홀의 형성에 있어 레이져를 사용하지 않으 므로, 생산성을 향상시키고 제조 비용을 절감할 수 있다.According to the embodiment of the present invention, since the laser is not used in the formation of the via hole, the productivity can be improved and the manufacturing cost can be reduced.
본 발명에 따른 전자 소자 내장 인쇄회로기판 및 그 제조 방법의 실시예를 첨부도면을 참조하여 설명함에 있어, 동일하거나 대응하는 구성 요소는 동일한 도면번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.In describing an embodiment of an electronic device embedded printed circuit board and a method of manufacturing the same according to the present invention with reference to the accompanying drawings, the same or corresponding components will be given the same reference numerals and redundant description thereof will be omitted. .
또한, 형성 또는 적층이라 함은, 각 구성 요소 간에 물리적으로 직접 접촉되는 경우만을 뜻하는 것이 아니라, 다른 구성이 각 구성 요소 사이에 개재되어, 그 다른 구성에 구성 요소가 각각 접촉되어 있는 경우까지 포괄하는 개념으로 사용하도록 한다.In addition, the forming or lamination does not mean only the case where the components are in direct physical contact between each component, but also encompasses the case where other components are interposed between the components and the components are in contact with each other. Use it as a concept.
도 1은 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판(100) 제조 방법의 일 실시예를 나타낸 순서도이다. 도 2 내지 도 9는 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판(100) 제조 방법 일 실시예의 각 공정을 나타낸 단면도이다.1 is a flow chart showing an embodiment of a method for manufacturing an electronic device embedded
본 실시예에 따르면, 도 1에 도시된 바와 같이, 복수의 전극(132)이 형성된 전자 소자(130)가 내장된 인쇄회로기판(100)을 제조하는 방법으로서, 전자 소자(130)의 전극(132)을 커버하도록 전자 소자(130)에 광경화성 수지층(160)을 형성하는 단계, 절연층(140)에 전자 소자(130)를 매립하는 단계, 광경화성 수지층(160)의 일부에 광을 조사하여, 광경화성 수지층(160)에 전자 소자(130)의 전극(132)이 노출되도록 비아홀(via hole, 152)을 형성하는 단계, 비아홀(152)에 전도성 물질을 충전하여 비아(via, 150)를 형성하는 단계, 및 비아(150)와 전기적으로 연결되도록 회로 패턴(170)을 형성하는 단계를 포함하는 전자 소자 내장 인쇄회로기판(100) 제조 방법이 제시된다.According to the present embodiment, as shown in FIG. 1, as a method of manufacturing the printed
이와 같은 본 실시예에 따르면, 전자 소자(130)의 전극(132)을 커버하도록 전자 소자(130)에 광경화성 수지층(160)을 형성함으로써, 레이져를 사용하지 않고 비아홀(152)을 형성할 수 있으며, 이에 따라, 생산성을 향상시키고 제조 비용을 절감할 수 있다.According to the present exemplary embodiment, the
또한, 광경화성 수지층(160)을 비아홀(152)의 형성을 위하여 필요한 부분에만 국부적으로 형성함으로써, 제조 비용을 절감할 수 있다.In addition, the
이하, 도 1 내지 도 9를 참조하여, 각 공정에 대하여 보다 상세히 설명하도록 한다.Hereinafter, each process will be described in more detail with reference to FIGS. 1 to 9.
먼저, 도 2에 도시된 바와 같이, 캐리어(190)에 금속박(110)을 형성하고(S110), 금속박(110)에 전자 소자(130)의 전극(132) 위치와 각각 대응되도록 복수의 관통홀(116)을 형성한다(S120).First, as shown in FIG. 2, the
우선, 캐리어(190)와 금속박(110) 사이에 발포 수지(195)를 개재하여, 캐리어(190) 상에 금속박(110)을 형성한다. 이에 따라, 이후 공정에서 발포 수지(195)를 이용하여 캐리어(190)를 보다 용이하게 제거할 수 있다.First, the
이어서, 금속박(110)의, 전자 소자(130)의 전극(132) 위치와 대응되는 위치 에, 복수의 관통홀(116)을 각각 형성한다. 이러한 관통홀(116)은 전자 소자(130) 전극(132)의 위치 및 사이즈와 상응하도록 형성되므로, 이와 같은 관통홀(116)이 형성된 금속박(110)은, 이후 공정에서 전자 소자(130)의 전극(132)을 외부로 노출시키는 비아홀(152)을 형성하기 위한 마스크(mask)로서의 기능을 수행할 수 있다.Subsequently, a plurality of through
따라서, 비아홀(152)을 형성하기 위한 별도의 마스크가 필요치 않아, 제조 공정을 단순화하고, 제조 비용을 절감할 수 있다.Therefore, a separate mask for forming the
다음으로, 도 3에 도시된 바와 같이, 전자 소자(130)의 전극(132)을 커버하도록 전자 소자(130)에 광경화성 수지층(160)을 형성한다(S130). 전자 소자(130)에 형성된 복수의 전극(132)이 광경화성 수지층(160)에 의해 커버되도록 전자 소자(130)의 일면 상에 광경화성 수지층(160)을 형성하는 공정이다.Next, as shown in FIG. 3, the
이에 따라, 이후 공정에서, 기존의 레이져 등을 이용하지 않고, 단순히 광에 의해 일부 영역을 경화시킴으로써 비아홀(152)을 천공할 수 있으므로, 제조 비용을 현저히 절감시킬 수 있고, 생산성 역시 향상시킬 수 있다.Accordingly, in the subsequent process, since the
또한, 광경화성 수지층(160)은, 전자 소자(130)의 전극(132)을 모두 커버하되, 너비(도 9의 d1)가 전자 소자(130)의 너비(도 9의 d2) 이하가 되도록 형성될 수 있다.In addition, the
즉, 광경화성 수지층(160)은 전자 소자(130)의 일면 중, 광에 의한 패터닝에 의하여 비아홀(152)을 형성할 필요가 있는 영역, 즉, 전극(132)이 형성된 위치에 상응하는 영역만을 커버하도록 국부적으로 형성될 수 있으므로, 제조 비용을 절감할 수 있다.That is, the
이와 같은 광경화성 수지층(160)은, 광, 예를 들어, 자외선에 의해 패터닝이 가능한 수지로서, 최종 인쇄회로기판(100)에도 잔존하게 되므로, 기판 절연체로서의 특성, 즉, 강도, 내열성 및 내흡습성 등을 만족시킬 필요가 있다.Since the
본 공정은, 보다 구체적으로, 도 3에 도시된 바와 같이, 금속박(110)과 전자 소자(130)의 전극(132) 사이에 광경화성 수지층(160)을 개재하여, 전자 소자(130)의 전극(132)이 금속박(110)을 향하도록 금속박(110)에 전자 소자(130)를 적층함으로써 수행될 수 있다.In more detail, as shown in FIG. 3, the present process includes the
상술한 S120 공정에 의하여, 금속박(110)에는 전자 소자(130)의 전극(132)과 상응하는 관통홀(116)이 복수개 형성되어 있으므로, 이 관통홀(116)의 위치와 전자 소자(130)의 전극(132) 위치를 정렬시킨 후, 금속박(110)과 전자 소자(130) 사이에 광경화성 수지층(160)을 개재하여 전자 소자(130)를 금속박(110)에 적층 및 고정시키는 것이다.By the above-described S120 process, since the plurality of through
다음으로, 도 4에 도시된 바와 같이, 절연층(140)에 전자 소자(130)를 매립한다(S140). 예를 들어, 반경화 상태의 절연층(140)에 전자 소자를 매립시키는 공정으로, 이후 경화 공정을 통하여 반경화 상태의 절연층(140)을 경화시킬 수 있다.Next, as shown in FIG. 4, the
본 공정은, 보다 구체적으로, 도 4에 도시된 바와 같이, 전자 소자(130)가 매립되도록 금속박(110)에 절연층(140)을 적층함으로써 수행될 수 있다. 즉, 캐리어(190) 상의 금속박(110)에 전자 소자(130)를 커버하도록 절연층(140)을 적층하는 것이다.In more detail, as shown in FIG. 4, the present process may be performed by stacking the
다음으로, 도 5에 도시된 바와 같이, 캐리어(190)를 제거한다(S150). 금속 박(110)이 캐리어(190)에 형성된 상태에서 전술한 공정들이 수행되므로, 광경화성 수지층(160)에 비아홀(152)을 형성하기 위해서는 캐리어(190)를 제거하여야 한다.Next, as shown in FIG. 5, the
이 때, 금속박(110)과 캐리어(190) 사이에는 발포 수지(195)가 개재되어 있으므로, 이 발포 수지(195)를 이용하여 보다 용이하게 캐리어(190)를 제거할 수 있다.At this time, since the
다음으로, 도 6에 도시된 바와 같이, 광경화성 수지층(160)의 일부에 광을 조사하여, 광경화성 수지층(160)에 전자 소자(130)의 전극(132)이 노출되도록 비아홀(152)을 형성한다(S160). 상술한 바와 같이, 전자 소자(130)의 전극(132)은 광경화성 수지층(160)에 의해 커버되므로, 이 광경화성 수지층(160)의 일부에 광을 조사함으로써, 비아(150)의 형성을 위한 비아홀(152)을 천공할 수 있다.Next, as shown in FIG. 6, a portion of the
본 공정은, 보다 구체적으로, 도 6에 도시된 바와 같이, 금속박(110)에 형성된 관통홀(116)을 통해 광경화성 수지층(160)에 광을 조사함으로써 수행될 수 있다. 즉, 금속박(110)은 광경화성 수지층(160)을 패터닝(patterning)하기 위한 마스크의 기능을 수행하게 되므로, 관통홀(116)을 통하여 광경화성 수지층(160)의 비아홀(152)이 형성될 영역, 즉, 전자 소자(130)의 전극(132) 위치와 상응하는 위치에, 광, 예를 들어, 자외선(UV)을 조사하여, 이 영역을 선택적으로 제거함으로써, 별도의 마스크를 사용할 필요 없이, 전자 소자(130)의 전극(132)을 외부로 노출시키는 비아홀(152)을 형성할 수 있다.In more detail, as shown in FIG. 6, the present process may be performed by irradiating light to the
다음으로, 도 7에 도시된 바와 같이, 비아홀(152)에 전도성 물질을 충전하여 비아(150)를 형성한다(S170). 즉, 도금 등의 방식에 의하여 비아홀(152) 내부에 전 도성 물질을 충전함으로써, 비아(150)를 형성할 수 있다.Next, as shown in FIG. 7, the via 150 is filled with the conductive material to form the via 150 (S170). That is, the via 150 may be formed by filling the conductive material in the via
이 때, 비아(150)를 형성하기 위한 도금에 의하여 금속박(110)의 표면에도 도 7에 도시된 바와 같은 금속층이 형성될 수 있다. 이러한 금속층은 추후 공정에 의하여 회로 패턴(170)이 될 수 있다.In this case, a metal layer as shown in FIG. 7 may be formed on the surface of the
다음으로, 도 8에 도시된 바와 같이, 비아(150)와 전기적으로 연결되도록 회로 패턴(170)을 형성한다(S180). 전술한 공정에 의하여 비아(150)와 함께 형성된 금속층의 일부를 에칭하여 제거함으로써, 비아(150)와 전기적으로 연결되는 회로 패턴(170)을 형성할 수 있다.Next, as shown in FIG. 8, a
다음으로, 도 9에 도시된 바와 같이, 회로 패턴(170)의 일부가 노출되도록 절연층(140)에 솔더 레지스트(180)를 형성한다. 회로 패턴(170)의 일부는, 외부 장치와의 전기적 연결을 위하여 패드(pad)로서 제공되므로, 이러한 패드 영역은 외부로 노출되고, 패드 영역을 제외한 나머지 회로 패턴(170)은 솔더 레지스트(180)에 의하여 보호된다.Next, as shown in FIG. 9, a solder resist 180 is formed on the insulating
이러한 솔더 레지스트(180)는 공지된 포토 리소그래피 등의 방식에 의하여 형성될 수 있다.The solder resist 180 may be formed by a known photolithography method.
이하, 도 10 내지 도 17을 참조하여, 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판(100) 제조 방법의 변형된 실시예에 대하여 설명하도록 한다.10 to 17, a modified embodiment of a method for manufacturing an electronic device embedded printed
도 10 내지 도 17은 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판(100) 제조 방법 변형 실시예의 각 공정을 나타낸 단면도이다.10 to 17 are cross-sectional views illustrating respective processes of a method of manufacturing an electronic device-embedded printed
본 변형 실시예에 따르면, 도 10에 도시된 바와 같이, 캐리어(190)에 금속박(110)을 형성하고(S110), 전자 소자(130)의 전극(132)을 커버하도록 전자 소자(130)에 광경화성 수지층(160)을 형성한다(S130).According to the present modified embodiment, as shown in FIG. 10, the
이어서, 도 11에 도시된 바와 같이, 절연층(140)에 전자 소자(130)를 매립하고(S140), 도 12에 도시된 바와 같이, 캐리어(190)를 제거한다(S150).Subsequently, as shown in FIG. 11, the
이 후, 도 13에 도시된 바와 같이, 금속박(110)에 전자 소자(130)의 전극(132) 위치와 각각 대응되도록 복수의 관통홀(116)을 형성하고(S120), 도 14에 도시된 바와 같이, 광경화성 수지층(160)의 일부에 광을 조사하여, 광경화성 수지층(160)에 전자 소자(130)의 전극(132)이 노출되도록 비아홀(152)을 형성한다(S160).Thereafter, as illustrated in FIG. 13, a plurality of through
다음으로, 도 15에 도시된 바와 같이, 비아홀(152)에 전도성 물질을 충전하여 비아(150)를 형성하고(S170), 도 16에 도시된 바와 같이, 비아(150)와 전기적으로 연결되도록 회로 패턴(170)을 형성한 후(S180), 도 17에 도시된 바와 같이, 회로 패턴(170)의 일부가 노출되도록 절연층(140)에 솔더 레지스트(180)를 형성한다.Next, as shown in FIG. 15, the via
이와 같은 본 변형 실시예의 경우, 관통홀(116)을 형성하는 공정(S120)이 캐리어(190)를 제거하는 공정(S150)이후에 수행된다는 점 이외에는, 전술한 일 실시예와 공정의 순서 및 세부 사항이 동일 또는 유사하므로, 보다 상세한 설명은 생략하도록 한다.In this modified embodiment, except that the step (S120) of forming the through
다음으로, 도 18을 참조하여, 본 발명의 다른 측면에 따른 전자 소자 내장 인쇄회로기판(200)의 일 실시예에 대하여 설명하도록 한다.Next, referring to FIG. 18, an embodiment of an electronic device-embedded printed
도 18은 본 발명의 다른 측면에 따른 전자 소자 내장 인쇄회로기판(200)의 일 실시예를 나타낸 순서도이다.18 is a flowchart illustrating an embodiment of an electronic device-embedded printed
본 실시예에 따르면, 도 18에 도시된 바와 같이, 복수의 전극(232)이 형성된 전자 소자(230)가 내장된 인쇄회로기판(200)으로서, 절연층(240), 절연층(240)에 매립되는 전자 소자(230), 전자 소자(230)의 전극(232)을 커버하도록 전자 소자(230)에 형성되는 광경화성 수지층(260), 광경화성 수지층(260)을 관통하여 전자 소자(230)의 전극(232)과 각각 접하는 비아(250), 및 비아(250)와 전기적으로 연결되도록 형성되는 회로 패턴(270)을 포함하는 전자 소자 내장 인쇄회로기판(200)이 제시된다.According to the present exemplary embodiment, as shown in FIG. 18, the printed
이와 같은 본 실시예에 따르면, 광경화성 수지층(260)이 전자 소자(230)의 전극(232)을 커버하도록 전자 소자(230)에 형성됨으로써, 레이져를 사용하지 않고도 비아홀(252)을 형성하는 것이 가능하며, 이에 따라, 생산성이 향상되고 제조 비용이 절감된 전자 소자 내장 인쇄회로기판(200)을 구현할 수 있다.According to the present exemplary embodiment, the
또한, 광경화성 절연층(240)이 비아홀(252)의 형성을 위하여 필요한 부분에만 국부적으로 형성됨으로써, 제조 비용이 절감될 수 있다.In addition, since the
이하, 도 18을 참조하여, 각 구성에 대하여 보다 상세히 설명하도록 한다.Hereinafter, each configuration will be described in more detail with reference to FIG. 18.
전자 소자(230)는, 일면에 복수의 전극(232)이 형성되며, 절연층(240) 내부에 매립된다. 이 경우, 즉, 전자 소자(230)의 전극(232)이 형성된 일면 상에는 광 경화성 수지층(260)이 형성되며, 이 광경화성 수지층(260)도, 도 18에 도시된 바와 같이, 절연층(240)의 표면에 돌출되지 않도록 절연층(240)에 매립된다.The
이러한 전자 소자(230)는, 발포 수지를 개재하여 캐리어에 형성된 금속박(210)에 전자 소자(230)를 적층하고, 금속박(210)에 전자 소자(230)를 커버하도록 절연층(240)이 형성됨으로써, 절연층(240) 내에 매립될 수 있으며, 이에 대하여는 전술한 일 실시예에서 설명한 바 있으므로, 상세한 설명은 생략하도록 한다.In the
한편, 전자 소자(230)와 금속박(210) 사이에는, 이들의 정렬 및 고정을 위한 접착층이 개재될 수도 있으며, 이 역시 본 발명의 권리범위에 포함됨은 물론이다.On the other hand, between the
광경화성 수지층(260)은, 전자 소자(230)의 전극(232)을 커버하도록 전자 소자(230)에 형성된다. 즉, 전자 소자(230)에 형성된 복수의 전극(232)이 광경화성 수지층(260)에 의해 커버되도록 전자 소자(230)의 일면 상에 광경화성 수지층(260)이 형성되는 것이다.The
이에 따라, 기존의 레이져 등을 이용하지 않고, 단순히 광에 의해 광경화성 수지층(260)의 일부 영역을 경화시킴으로써 비아홀(252)이 형성될 수 있으므로, 제조 비용이 현저히 절감되고, 생산성 역시 향상된다.Accordingly, since the via hole 252 can be formed by simply curing a part of the
또한, 광경화성 수지층(260)은, 전자 소자(230)의 전극(232)을 모두 커버하되, 너비(d3)가 전자 소자(230)의 너비(d4) 이하가 되도록 형성될 수 있다.In addition, the
즉, 광경화성 수지층(260)은 전자 소자(230)의 일면 중, 광에 의한 패터닝에 의하여 비아홀(252)을 형성할 필요가 있는 영역, 즉, 전극(232)이 형성된 위치에 상응하는 영역에만 형성될 수 있으므로, 제조 비용을 절감할 수 있다.That is, the
이와 같은 광경화성 수지층(260)은, 광에 의해 패터닝이 가능한 수지로서, 최종 인쇄회로기판(200)에도 잔존하게 되므로, 기판 절연체로서의 특성, 즉, 강도, 내열성 및 내흡습성 등을 만족시킬 필요가 있다.Since the
이러한 광경화성 수지층(260)은, 캐리어 상에 형성된 금속박(210)과 전자 소자(230)의 전극(232) 사이에 광경화성 수지층(260)을 개재하여 금속박(210)에 전자 소자(230)를 적층함으로써, 전자 소자(230)에 형성될 수 있으며, 이에 대하여는 전술한 일 실시예에서 설명한 바 있으므로, 상세한 설명은 생략하도록 한다.The
비아(250)는, 광경화성 수지층(260)을 관통하며, 전자 소자(230)의 전극(232)과 전기적으로 연결되도록 전자 소자(230)의 전극(232)과 각각 접한다. 이러한 비아(250)는, 전자 소자(230) 전극(232)의 위치와 상응하도록 광경화성 수지층(260)에 비아홀(252)을 형성하고, 이 비아홀(252)을 충전함으로써 형성될 수 있다.The via 250 penetrates through the
즉, 이러한 비아(250)는, 캐리어에 형성된 금속박(210)에, 전자 소자(230)의 전극(232)과 상응하는 관통홀(216)을 형성하고, 이 금속박(210)을 마스크로 이용하여, 관통홀(216)을 통해 광을 조사함에 따라 비아홀(252)을 형성한 후, 도금 등에 의해 비아홀(252)을 충전함에 의하여 형성될 수 있으며, 이에 대하여는 전술한 일 실시예에서 설명한 바 있으므로, 상세한 설명은 생략하도록 한다.That is, the via 250 forms a through hole 216 corresponding to the
또한, 회로 패턴(270)은, 절연층(240)에 비아(250)와 전기적으로 연결되도록 형성된다. 즉, 전술한 비아(250)를 형성하는 공정을 통하여 금속층도 함께 형성할 수 있으므로, 이렇게 형성된 금속층의 일부를 에칭하여 제거함으로써, 비아(250)와 전기적으로 연결되는 회로 패턴(270)을 형성할 수 있다.In addition, the
한편, 회로 패턴(270)의 일부만을 노출시키는 솔더 레지스트(280)가 형성될 수도 있으며, 이는 공지된 포토 리소그래피 공정 등을 통하여 형성될 수 있다.Meanwhile, a solder resist 280 exposing only a part of the
이상, 본 발명의 일 실시예에 대하여 설명하였으나, 해당 기술 분야에서 통상의 지식을 가진 자라면 특허청구범위에 기재된 본 발명의 사상으로부터 벗어나지 않는 범위 내에서, 구성 요소의 부가, 변경, 삭제 또는 추가 등에 의해 본 발명을 다양하게 수정 및 변경시킬 수 있을 것이며, 이 또한 본 발명의 권리범위 내에 포함된다고 할 것이다.As mentioned above, although an embodiment of the present invention has been described, those of ordinary skill in the art may add, change, delete or add components within the scope not departing from the spirit of the present invention described in the claims. The present invention may be modified and changed in various ways, etc., which will also be included within the scope of the present invention.
도 1은 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판 제조 방법의 일 실시예를 나타낸 순서도.1 is a flow chart showing an embodiment of a method for manufacturing an electronic device embedded printed circuit board according to an aspect of the present invention.
도 2 내지 도 9는 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판 제조 방법 일 실시예의 각 공정을 나타낸 단면도.2 to 9 are cross-sectional views illustrating each process of the electronic device-embedded printed circuit board manufacturing method according to an aspect of the present invention.
도 10 내지 도 17은 본 발명의 일 측면에 따른 전자 소자 내장 인쇄회로기판 제조 방법 변형 실시예의 각 공정을 나타낸 단면도.10 to 17 are cross-sectional views illustrating respective processes of a method of manufacturing an electronic device-embedded printed circuit board according to an exemplary embodiment of the present invention.
도 18은 본 발명의 다른 측면에 따른 전자 소자 내장 인쇄회로기판의 일 실시예를 나타낸 순서도.18 is a flow chart illustrating an embodiment of a printed circuit board with electronic devices according to another aspect of the present invention.
<도면의 주요 부분에 대한 부호의 설명><Explanation of symbols for the main parts of the drawings>
100: 인쇄회로기판 110: 금속박100: printed circuit board 110: metal foil
116: 관통홀 130: 전자 소자116: through hole 130: electronic device
132: 전극 140: 절연층132: electrode 140: insulating layer
150: 비아 152: 비아홀150: via 152: via hole
160: 광경화성 수지층 170: 회로 패턴160: photocurable resin layer 170: circuit pattern
180: 솔더 레지스트 195: 발포 수지180: solder resist 195: foamed resin
190: 캐리어190: carrier
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