KR100953340B1 - 반도체 소자의 금속배선 형성방법 - Google Patents

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Abstract

본 발명은 반도체 소자의 금속배선 형성방법에 관한 것으로, 본 발명에 따른 반도체 소자의 금속배선 형성방법은 기판 상에 알루미늄 금속배선을 형성하는 단계와, 상기 알루미늄 금속배선 표면에 N2를 이용한 열처리공정을 수행하여 알루미늄 질화막을 형성하는 단계와, 상기 알루미늄 질화막상에 실리콘 질화막을 형성하는 단계와, 상기 실리콘 질화막 상에 실리콘 산화막으로 형성된 층간 절연막을 형성하는 단계를 포함한다.
알루미늄

Description

반도체 소자의 금속배선 형성방법{Method for forming a metal line in semiconductor device}
본 발명은 반도체 소자의 제조방법에 관한 것으로, 더욱 상세하게는 반도체 소자의 금속배선 형성방법에 관한 것이다.
일반적으로, 반도체 소자의 금속 배선은 알루미늄(Al)과 같은 재질로 형성된다. 상기 금속 배선은 순수 알루미늄 재질로 형성되거나, 상기 금속 배선의 전기적 이동(Electromigration: EM) 및 스파이킹(Spiking)을 억제하기 위해 상기 순수 알루미늄에 구리(Cu) 또는 실리콘(Si)을 첨가시킨 알루미늄 합금 재질로 형성될 수 있다. 더불어, 종래의 반도체 소자는 반도체 기판 상에 금속 배선이 형성되고, 상기 금속 배선을 포함한 반도체 기판의 전면에 층간 절연막이 적층된다.
이때, 상기 층간 절연막의 적층 전 또는 적층 후에 열처리 공정을 수행하게 되는 데, 상기와 같이 금속배선이 형성된 반도체 기판에 열처리공정을 수행하게 되면, 금속배선의 열팽창 정도와 층간 절연막의 열팽창 정도의 차이로 인해, 층간 절연막이 깨지는 현상이 발생하게 되는 문제점이 있다.
상술한 문제점을 해결하기 위한 본 발명은 금속배선과 접하는 층간 절연막에 수행되는 열처리 공정시 층간 절연막의 손상을 방지하는 반도체 소자의 금속배선 형성방법을 제공함에 있다.
상술한 목적을 달성하기 위한 본 발명에 따른 반도체 소자의 금속배선 형성방법은 기판 상에 알루미늄 금속배선을 형성하는 단계와, 상기 알루미늄 금속배선 표면에 열처리공정을 수행하여 알루미늄 질화막을 형성하는 단계와, 상기 알루미늄 질화막상에 실리콘 질화막을 형성하는 단계와, 상기 실리콘 질화막 상에 실리콘 산화막으로 형성된 층간 절연막을 형성하는 단계를 포함한다.
상기 알루미늄 금속배선을 형성하는 단계는 상기 기판 상에 알루미늄막을 형성한 후 RIE(reaction ion etching)공정으로 패터닝하여 형성하되, 표면이 알루미늄 산화막계열의 화합물로 형성된다.
상기 알루미늄 질화막을 형성하는 단계는 상기 알루미늄 금속배선의 표면에 형성된 알루미늄 산화막 계열 화합물의 산소성분에 N2를 이용한 열처리공정을 수행하여 질소성분으로 치환되면서 형성된다.
삭제
본 발명에 따른 반도체 소자의 금속배선 형성방법은 금속배선과 접하는 층간 절연막에 수행되는 열처리 공정시 층간 절연막의 손상을 방지하는 효과가 있다.
이하, 첨부된 도면 및 실시 예를 통해 본 발명의 실시 예를 구체적으로 살펴보면 다음과 같다.
도 1 내지 도 4는 본 발명에 따른 반도체 소자의 금속배선 형성방법을 도시한 공정순서도이다.
도 1에 도시된 바와 같이, 반도체 기판(10) 상에 스퍼터링 공정을 이용하여 알루미늄(Al)막을 증착한 후 사진식각공정을 통해 패터닝하여 금속배선인 알루미늄막(12)을 형성한다.
상기 금속배선인 알루미늄막(12)의 패터닝을 위한 식각 공정시 RIE(reaction ion etching)이 사용되는 데, 상기 RIE공정이 완료되면 알루미늄막(12)의 표면은 알루미늄 산화막(Al2O3)계열의 화합물이 형성된다.
이어, 도 2에 도시된 바와 같이, 금속배선(12)이 형성된 기판(10)전면에 퍼니스(furnace)에서 N2를 이용한 열처리공정을 실시하여 금속배선(12) 표면에 알루미늄 질화막(AlN:14)을 형성한다.
상기 알루미늄 질화막(14)은 상기 N2를 이용한 열처리 공정시 알루미늄막(12)의 표면에 형성된 알루미늄 산화막(Al2O3)계열 화합물의 산소성분(O3)에 질소성분(N2)이 치환되면서 형성된 막으로써, 이는 알루미늄막(12)의 부식을 방지하고 EM안정성을 향상시키게 된다.
계속, 도 3에 도시된 바와 같이, 기판(10)에 형성된 알루미늄 질화막(14) 상에 실리콘 질화막(Si2O3: 16)을 형성한다. 상기 실리콘 질화막(16)은 이후 형성될 층간 절연막인 실리콘 산화막(SiO2)막보다 상대적으로 견고한 막질이면서 동시에 N2로 표면 처리된 알루미늄 질화막(14)과의 접착력이 높고, 이후 형성될 층간 절연막인 실리콘 산화막과의 유사한 구조를 갖고 있기 때문에 이후 형성될 층간 절연막인 실리콘 산화막 형성공정시 안정적인 증착공정을 수행할 수 있게 된다.
이어 도 4에 도시된 바와 같이, 실리콘 질화막(16)이 형성된 기판(10) 전면에 층간 절연막인 실리콘 산화막(SiO2: 18)을 형성함으로써, 본 공정을 완료한다.
이상에서 설명한 본 발명은 상술한 실시 예 및 첨부된 도면에 한정되는 것이 아니고, 본 발명의 기술적 사상을 벗어나지 않는 범위 내에서 여러 가지 치환, 변형 및 변경이 가능하다는 것이 본 발명이 속하는 기술분야에서 종래의 지식을 가진 자에게 있어 명백할 것이다.
도 1 내지 도 4는 본 발명에 따른 반도체 소자의 금속배선 형성방법을 도시한 공정순서도이다.

Claims (4)

  1. 기판 상에 알루미늄 금속배선을 형성하는 단계와,
    상기 알루미늄 금속배선 표면에 열처리공정을 수행하여 알루미늄 질화막을 형성하는 단계와,
    상기 알루미늄 질화막상에 실리콘 질화막을 형성하는 단계와,
    상기 실리콘 질화막 상에 실리콘 산화막으로 형성된 층간 절연막을 형성하는 단계를 포함하는 반도체 소자의 금속배선 형성방법.
  2. 제1 항에 있어서, 상기 알루미늄 금속배선을 형성하는 단계는
    상기 기판 상에 알루미늄막을 형성한 후 RIE(reaction ion etching)공정으로 패터닝하여 형성하되, 표면이 알루미늄 산화막계열의 화합물로 형성되는 것을 특징으로 하는 반도체 소자의 금속배선 형성방법.
  3. 제1 항 또는 제2 항에 있어서, 상기 알루미늄 질화막을 형성하는 단계는
    상기 알루미늄 금속배선의 표면에 형성된 알루미늄 산화막 계열 화합물의 산소성분에 N2를 이용한 열처리공정을 수행하여 질소성분으로 치환되면서 형성되는 것을 특징으로 하는 반도체 소자의 금속배선 형성방법.
  4. 삭제
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Citations (4)

* Cited by examiner, † Cited by third party
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JPS6459938A (en) * 1987-08-31 1989-03-07 Fujitsu Ltd Manufacture of semiconductor device
JPH0382034A (ja) * 1989-08-24 1991-04-08 Miyagi Oki Denki Kk 半導体素子の製造方法
EP0260906B1 (en) * 1986-09-17 1993-03-10 Fujitsu Limited Method of producing semiconductor device and semiconductor device
KR20060074976A (ko) * 2004-12-28 2006-07-04 주식회사 하이닉스반도체 반도체 소자 제조 방법

Patent Citations (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
EP0260906B1 (en) * 1986-09-17 1993-03-10 Fujitsu Limited Method of producing semiconductor device and semiconductor device
JPS6459938A (en) * 1987-08-31 1989-03-07 Fujitsu Ltd Manufacture of semiconductor device
JPH0382034A (ja) * 1989-08-24 1991-04-08 Miyagi Oki Denki Kk 半導体素子の製造方法
KR20060074976A (ko) * 2004-12-28 2006-07-04 주식회사 하이닉스반도체 반도체 소자 제조 방법

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