KR100889149B1 - 데이터 전송 방법, 블록 동기 신호 검출 방법 및 재생장치 - Google Patents

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Abstract

본 발명은, 동기 신호와 부호 시퀀스의 식별이 가능하며, 데이터의 재생 시 혹은 수신 시에 복수의 부호어로 구성되는 블록의 선두를 인식하도록 한 블록 동기 신호의 검출을 행하는 방법으로서, 미디어(1)로부터 재생되는 재생 신호에 포함되는 동기어 및 ID 정보의 기간을 나타내는 윈도우 신호 Sync_window가 공급되는 동기어 검출기(10)에 의해, PRML 패리티 검출기(6)에 의해 검출된 비트 열에 대하여, 패리티 체크 회로(12)로부터 공급되는 패리티 OK 신호에 기초하여 생성된 윈도우 신호 Sync_window를 이용하여 동기어를 검출한다.
Figure R1020037003467
동기 신호, 부호 시퀀스, 패리티, 부호어, 데이터어, 비터비

Description

데이터 전송 방법, 블록 동기 신호 검출 방법 및 재생 장치 {DATA TRANSFER METHOD, BLOCK SYNCHRONIZING SIGNAL DETECTING METHOD, AND REPRODUCING APPARATUS}
본 발명은, 데이터 전송 방법, 블록 동기 신호 검출 방법 및 재생 장치에 관한 것으로, 더욱 상세하게는, 데이터의 전송이나 기록 매체에의 기록에 적합하도록 부호화된 데이터에 블록 동기 신호를 부가하여 이것을 송신 혹은 기록하고, 그 후 수신 혹은 재생된 블록 동기 신호를 포함하는 부호 시퀀스를 검출하는 데 적합한 데이터 전송 방법, 블록 동기 신호 검출 방법 및 재생 장치에 관한 것이다.
블록 동기 신호는, 통상적으로 데이터 송신 또는 기록 시에, 블록의 선두에 부가된다. 데이터 수신 또는 재생 시에, 이 동기 신호를 검출하여 블록의 선두를 인식한다. 여기서 말하는 블록이란, 복수의 데이터어 혹은 부호어가 모인 단위이다. 예를 들면, DAT(Digital Audio Tape)에서의 블록은, 2심볼의 ID(Identity) 데이터, 1심볼의 ID 패리티 및 32심볼의 데이터어의 계 36심볼로 구성되어 있다. 1심볼은, 기록 부호인 8/10 부호로 부호화되기 전에는 8비트, 부호화된 후에는 10비트이다. 기록 시에 블록을 구성하는 개개의 8비트 심볼은 먼저 8/10 부호화되고, 그 후 8/10 부호의 시퀀스에는 존재하지 않는 1심볼(10비트)의 동기 신호(동기어) 가 블록의 선두에 부가된다. 재생 시에는, 이 동기어를 검출하여 블록의 선두를 찾아낸 후, 부호화된 ID 데이터, 패리티 및 32심볼 데이터어의 복호가 1심볼씩 행해진다. 8/10 부호는 NRZI 기록을 전제로 작성되고 있지만, 그 NRZI 변환 후의 시퀀스에서의 동일 비트의 최대 연속 길이(이하 Tmax라고 함)는 4이며, 더구나 Tmax가 2회 이상 연속하지 않는다. 동기어에는, 부호 시퀀스에는 나타나지 않는 Tmax가 2회 연속하는 패턴이 포함되어 있으며, 이것에 의해서 부호 시퀀스와의 식별을 가능하게 하고 있다.
최근, 자기 기록의 분야에서는, TCPR(Trellis-Coded Partial Response) 방식이 활발히 연구되고 있다. 이것은, 파셜 응답 특성과 부호 특성을 일체로 생각함으로써, 전송로(기록 재생로) 출력 시퀀스 사이의 유클리드 거리(자유 제곱 유클리드 거리: d2 free)를 증대시키는 방식이다. d2 free의 증가는 신호 레벨의 증가와 등가이며, 따라서 TCPR 방식에 의해, 데이터 검출 시의 SNR(Signal to Noise Ratio)은 개선된다. TCPR 방식에서 이용되는 부호는, 일반적으로 트렐리스 부호(trellis code)라 불리고 있다.
그런데, 파셜 응답으로서 통상적으로 이용되는 확장 파셜 응답 클래스 4(이하, EPR4라 함)는, 단위 펄스 응답의 등화 파형이 샘플점(심볼 존재점)에서 (1, 1, -1, -1)이 되도록 등화하는 방식이다. EPR4의 시스템 다항식은 이하의 수학식 1과 같이 표현된다. 수학식 1에서, D는 1비트 지연 연산자이다.
Figure 112003008180947-pct00001
EPR4의 상태 천이도를 도 12에 도시함과 함께, 트렐리스선도를 도 13에 도시한다. EPR4의 트렐리스선도에 이중선으로 나타내는 최소 유클리드 거리 d2 free는,
d2 free=((+1)-(0))2+((+1)-(O))2+((-1)-(O))2+((-1)- (O))2=4
로 된다.
EPR4와 변조 부호의 제약 조건을 이용하여 최우도 복호를 행하는 트렐리스 코드화된 확장 파셜 응답 클래스 4(이하, TCEPR4라 함)에서는, 16/18 부호에 제약을 가함으로써, 제곱 유클리드 거리 d2 free가 4에서 6으로 커져서, 비터비 검출 게인을 EPR4에 대하여 1.8㏈ 확보할 수 있다.
TCEPR4용의 비터비 디코더는, 정해진 18비트를 단위로 동작하고 있기 때문에, 1비트라도 위상 어긋남을 일으키면, 전혀 다른 비트를 복호하게 된다.
따라서, 이 TCEPR4용의 비터비 디코더가 정해진 18비트마다 리세트를 걸기 위해서 동기 검출을 행할 필요가 있다. 이 동기 검출 자체는, 검출 게인이 1.8㏈ 뒤떨어져 있는 EPR4 비터비로 검출해야 한다.
여기서, 블록 동기 신호의 검출 정밀도는, 데이터의 수신 혹은 재생 품질에 크게 영향을 미친다. 예를 들면, 외란에 의해 동기 신호가 검출 불능으로 되면, 1 블록의 모든 데이터를 잃어버리게 된다. 또한, 동기 신호를 오검출하였으면, 오검 출한 시점부터 다음에 정확하게 동기 신호가 검출되기까지의 모든 데이터를 잃어버리게 된다. 또한, 예를 들면 DAT의 경우, 동기어를 오검출하면 ID 데이터도 오검출하게 된다. ID 데이터 중에는 어드레스 정보가 포함되어 있지만, 오검출 어드레스를 사용하여 메모리에의 기입이 행해지면, 다른 블록의 데이터까지도 파괴될 가능성이 있다.
본 발명의 목적은, 동기 신호와 부호 시퀀스의 식별이 가능하며, 데이터의 재생 시 혹은 수신 시에 복수의 부호어로부터 얻어지는 블록의 선두를 인식하는 것이 가능하도록 하는 것에 있다.
본 발명의 다른 목적은, EPR4로 검출하는 동기어 패턴을 강화하기 위해서, 동기어 패턴의 오류가 모든 16/18 부호에 대하여 일정한 거리를 갖도록 하고, 자기 정정함으로써 미검출 확률을 낮추는 것에 있다.
본 발명은, 복수의 부호어로 구성되는 블록의 선두에 블록 동기 신호를 부가하여 전송하는 데이터 전송 방법으로서, 블록 동기 신호는, 부호 시퀀스의 동일 비트의 최대 연속 길이를 Tmax=8로 하였을 때, 해당 블록 동기 신호 내에서 1회 이상, 동일 비트가 9개 연속한다.
본 발명은, 복수의 부호어로 구성되는 블록의 선두에 블록 동기 신호를 부가하여 전송하는 데이터 전송 방법으로서, 블록 동기 신호는, 전송로 출력 시퀀스로부터 해당 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 시변(時變) 구조를 갖는 검출 트렐리스 상에서 시점(始点)으로 하는 상태가 다른 블록 동기 신호가 상호 고유하며, 종점(終点) 상태가 동일한 상태이다.
본 발명은, 복수의 부호어로 구성되는 블록의 선두에 부가되어 전송된 블록 동기 신호를 검출하는 블록 동기 신호 검출 방법으로서, 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 시변 구조를 갖는 검출 트렐리스 상에서, 시점으로 하는 상태가 다른 블록 동기 신호가, 상호 고유하며, 종점 상태가 동일한 상태이고, 검출한 동기 신호를 가초로 한 검출창을 갖는 윈도우 신호를 이용하여 블록 동기 신호의 검출을 행한다.
본 발명은, 복수의 부호어로 구성되는 블록의 선두에 부가되어 전송된 블록 동기 신호를 검출하는 블록 동기 신호 검출 방법으로서, 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 시변 구조를 갖는 검출 트렐리스 상에서, 시점으로 하는 상태가 다른 블록 동기 신호가 상호 고유하며, 종점 상태가 동일한 상태이고, 블록 동기 신호의 검출과 함께 해당 블록 동기 신호의 고유성으로부터, 검출 트렐리스 상에서 해당 블록 동기 신호에 의해 TCPR 비터비 검출기의 시점으로 하는 상태를 검출하고, 블록 동기 신호의 검출 후에 브렌치 매트릭의 프리셋을 행한다.
본 발명은, 소정의 특성을 갖는 전송로의 출력 시퀀스로부터 전송된 동기 신호를 포함하는 부호 시퀀스를 검출하는 재생 장치로서, 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 검출하는 시불변(時不變)인 검출 수단과, 시불변인 검출 수단의 출력으로부터 블록 동기 신호를 검출하여 그 정보를 출 력하는 동기 신호 검출 수단과, 동기 신호 검출 수단이 출력하는 블록 동기 신호의 정보에 의해 초기 설정되며, 시변 구조를 갖는 검출 트렐리스를 이용하여 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 비터비 검출하는 비터비 검출 수단과, 동기 신호 검출 수단에 의해 검출한 블록 동기 신호와 비터비 검출 수단에 의한 검출 출력에 기초하여 블록 동기 신호의 검출창을 갖는 윈도우 신호를 생성하는 윈도우 신호 생성 수단을 포함하며, 동기 신호 검출 수단은, 윈도우 신호 생성 수단에 의해 생성되는 윈도우 신호를 이용하여 블록 동기 신호의 검출을 행한다.
본 발명의 또 다른 목적, 본 발명에 의해 얻어지는 구체적인 이점은, 이하에서 도면을 참조하여 설명되는 실시 형태의 설명으로부터 한층 명백해질 것이다.
도 1은 본 발명에 따른 재생 장치의 구성을 도시한 블록도.
도 2는 TCPR의 트렐리스 제약을 도시한 도면.
도 3은 본 발명에 따른 재생 장치에서의 미디어로서 사용되는 자기 테이프의 트랙 배치를 도시한 도면.
도 4는 자기 테이프의 트랙 포맷을 도시한 도면.
도 5A 내지 도 5C는 본 발명에 따른 재생 장치에서의 윈도우 신호 생성기 및 동기어 검출기의 동작을 도시한 타이밍차트.
도 6은 동기어 검출기에서의 동기어의 검출 동작을 도시한 도면.
도 7은 48비트 데이터로부터 TCEPR4의 4개의 트렐리스 제약 초기 상태의 16/18 변환된 54비트 부호와 EPR4에서의 제곱 유클리드 거리를 산출하는 36비트의 동기어 패턴을 도시한 도면.
도 8A 및 도 8B는 54비트의 16/18 부호를 1비트씩 시프트시켜 36비트 부호를 작성하고, 동기어 패턴 및 그 오류 패턴과의 제곱 유클리드 거리를 산출하는 상태를 도시한 도면.
도 9는 36비트의 동기어 패턴 및 그 오류 패턴과 그 전후에 18비트를 부가한 72 비트 신호를 1비트씩 시프트시켜서, 동기어 패턴 및 그 오류 패턴과의 EPR4에서의 제곱 유클리드 거리를 산출하는 상태를 도시한 도면.
도 10은 동기어 패턴과 EPR4의 트렐리스선도.
도 11은 동기어 패턴과 16/18(0, 7) 부호의 트렐리스선도.
도 12는 EPR4의 상태 천이도.
도 13은 EPR4의 트렐리스선도.
이하, 본 발명의 실시 형태에 대하여 도면을 참조하여 상세히 설명한다.
본 발명은, 예를 들면 도 1에 도시한 바와 같은 구성의 재생 장치(20)에 적용된다. 이 재생 장치(20)는, 시변 트렐리스 부호를 사용한 TCEPR 방식의 재생 장치이다.
여기서, 본 발명이 적용된 재생 장치(20)에서 채용하고 있는 TCEPR4에서의 16/18 변환에서는, 부호의 연결 상태에 따라서 다음의 표 1에 나타낸 바와 같은 제약을 받는다.
Figure 112003008180947-pct00002
S : ADS 개시 상태
Z : 0의 최대 연속 수
P : 1의 최대 연속 수
ZP : 01의 최대 연속 수
PZ : 10의 최대 연속 수
ZH : 부호어 선두에서의 0의 최대 연속 수
PH : 부호어 선두에서의 1의 최대 연속 수
ZPH : 부호어 선두에서의 01의 최대 연속 수
PZH : 부호어 선두에서의 10의 최대 연속 수
ZT : 부호어 말미에서의 0의 최대 연속 수
PT : 부호어 말미에서의 1의 최대 연속 수
ZPT : 부호어 말미에서의 01의 최대 연속 수
PZT : 부호어 말미에서의 10의 최대 연속 수
1≤ ADS≤ 11
또한, 도 2에 도시한 바와 같은 TCPR의 트렐리스 제약을 충족하고 있다.
이 재생 장치(20)는, 미디어(1)로부터 재생된 재생 신호가 재생 증폭기(2)를 통하여 공급되는 등화기(3), 이 등화기(3)의 출력이 표본화기(4)를 통하여 공급되는 PLL 회로(5) 및 PRML 비터비 검출기(6), 표본화기(4)의 출력이 지연 소자(7)를 통하여 공급되는 TCPR 비터비 검출기(8), 이 TCPR 비터비 검출기(8)의 출력이 공급되는 복호화기(9), PRML 비터비 검출기(6)의 출력이 공급되는 동기어 검출기(10), 복호화기(9)의 출력이 공급되는 ID 검출기(11), 이 ID 검출기(11)의 출력이 공급되는 패리티 체크 회로(12), 이 패리티 체크 회로(12)의 출력이 공급되는 윈도우 신호 생성기(13) 등으로 이루어지며, 윈도우 신호 생성기(13)의 출력이 동기어 검출기(10)에 공급되고, 이 동기어 검출기(10)의 출력이 TCPR 비터비 검출기(8)에 공급된다.
여기서, 미디어(1)는, 예를 들면 자기 테이프로서, 도 3에 트랙 배치를 도시하고 있는 바와 같이 테이프 주행 방향에 대하여 경사진 트랙에, 도 4에 도시한 바와 같은 트랙 포맷으로 정보가 기록되고 있다. 1트랙은, 각각 3블록의 프리앰블과 포스트앰블에 336블록분의 데이터 블록을 갖는다. 1블록은, 4바이트의 동기어, 8바이트의 ID 정보 및 128 바이트의 데이터로 이루어진다.
이 재생 장치(20)에서, 미디어(1)로부터 재생되고 재생 증폭기(2)에 의해 증폭된 신호는, 등화기(3)에서 소정의 파셜 응답 특성으로 등화된 후, 표본화기(4)에 의해 표본화된다. 이 표본화기(4)에 의해 표본화된 신호는, PLL 회로(5)에 공급됨과 함께, PRML 비터비 검출기(6)를 통하여 동기어 검출기(10)에 입력되고, 지연 소자(7)를 통하여 TCPR 비터비 검출기(8)에 입력된다.
PLL 회로(5)는 표본화기(4)에 의해 표본화된 신호로부터 클럭을 추출한다. 표본화기(4)나 PRML 비터비 검출기(6), TCPR 비터비 검출기(8), 복호화기(9), 동기어 검출기(10) 등은, 이 PLL 회로(5)에 의해 제공되는 클럭에 따라서 동작한다.
PRML 비터비 검출기(6)에서는, 시변 트렐리스 부호의 특성을 포함하지 않는 형태의 검출 트렐리스를 이용하여 검출이 행해진다. 이 PRML 비터비 검출기(6)에서는, 부호어의 경계를 알 필요가 없으며, 따라서 비동기로 데이터의 검출을 행할 수 있다.
동기어 검출기(10)에서는, PRML 비터비 검출기(6)에 의해 검출된 비트 열에 대하여, 윈도우 신호 생성기(13)로부터 공급되는 윈도우 신호 Sync_window를 이용하여, 동기어의 검출을 행한다. 이 동기어 검출기(10)는, 동기어의 검출 신호를 TCPR 비터비 검출기(8)에 공급함과 함께, TCPR 비터비 검출기(8)의 어떤 상태의 우도를 높게 하면 되는지를 나타내는 상태 지정 신호를 상기 TCPR 비터비 검출기(8)에 공급한다.
TCPR 비터비 검출기(8)는, 시변 부호의 특성을 포함한 형태의 검출 트렐리스를 이용하여 검출이 행해지고, 부호어의 경계를 알지 못하면 올바르게 동작하지 않는다. 따라서, 이 TCPR 비터비 검출기(8)는, 동기어 검출기(10)로부터 공급되는 상태 지정 신호에 의해 우도의 초기 설정이 행해지고, 동기어 검출 신호에 의해 그 동기가 취해지며, 그 후에 1블록의 데이터의 검출을 개시한다.
TCPR 비터비 검출기(8)에 의해 검출된 데이터는, 복호화기(9)에 입력되고, 부호어의 복호가 행해진다.
또, 지연 소자(7)는, PRML 비터비 검출기(6)와 동기어 검출기(10)의 내부 지연에 의해 동기어 검출 신호가 갖는 지연량과 동등한 지연을 표본화기(4)로부터 TCPR 비터비 검출기(8)에 입력되는 신호에 제공한다.
ID 검출기(11)는, 복호화기(9)의 출력에 포함되는 ID 정보를 검출하여 패리티 체크 회로(12)에 공급한다.
패리티 체크 회로(12)는, ID 검출기(11)에 의해 검출된 ID 정보에 대하여 패리티 체크를 행하고, ID 정보의 패리티가 정상이면, 패리티 OK 신호를 윈도우 신호 생성기(13)에 공급한다.
윈도우 신호 생성기(13)는, 패리티 체크 회로(12)로부터 공급되는 패리티 OK 신호에 기초하여, 도 5A에 도시한 바와 같이, 미디어(1)로부터 재생되는 재생 신호에 포함되는 동기어 및 ID 정보의 기간을 나타내는 윈도우 신호 Sync_window를 생성하고, 이 윈도우 신호 Sync_window를 동기어 검출기(1O)에 공급한다.
이와 같이 미디어(1)로부터 재생되는 재생 신호에 포함되는 동기어 및 ID 정보의 기간을 나타내는 윈도우 신호 Sync_window가 공급되는 동기어 검출기(1O)에서는, PRML 비터비 검출기(6)에 의해 검출된 비트 열에 대하여, 패리티 체크 회로(12)로부터 공급되는 패리티 OK 신호에 기초하여 생성된 윈도우 신호 Sync_window를 이용하여, 동기어를 검출함으로써, 도 5B에 도시한 바와 같이, 윈도우 신호 Sync_window로 나타내는 검출창 이외의 기간에 잘못하여 동기어를 검출하지 않고, 동기어를 검출할 수 없던 경우에도, 도 5C에 도시한 바와 같이, 다음의 타이밍에서 동기를 검출할 수 있다.
동기어 검출기(10)에서는, 도 6에 도시한 바와 같이, 동기어의 제곱 유클리드 거리가 4 이하의 오류를 패턴을 동기어라고 간주함으로써, 동기어에 에러가 발생했을 때에도, 그것을 허용함으로써, 동기어의 검출 확률을 높인다. 그 때, 부호어의 제곱 유클리드 거리 4의 오류와 거리 1 이상 떨어지게 함으로써, 오검출은 발생하지 않는다.
동기어의 패턴은, 다음의 조건 1) 내지 3)을 충족하도록 선택하였다.
조건 1) TCEPR4의 트렐리스 제약을 충족한다. 동기어의 전반부와 후반부의 접속부는 16/18 변환의 접속 제약을 받지 않는다. 단, 동기어와 부호어의 접속부는 16/18 변환의 접속 제약을 충족한다.
조건 2) 부호어와 거리를 취하기 위해서 Z=9, P=9를 각각 최저 1개, 합계 3개를 넣는다.
조건 3) 잘못된 위치에서 리세트가 걸리지 않도록, 4개의 초기 상태의 동기어 패턴은, 시프트했을 때 오류 패턴도 포함시켜 닮은 패턴이 되지 않도록 한다.
상기 조건 1) 내지 3)을 만족하는 동기어의 패턴으로서, 다음의 표 2에 나타내는 동기어 패턴(Sync Pattern)을 다음과 같이 하여 구하였다.
Figure 112003008180947-pct00003
먼저, 도 7에 도시한 바와 같이, 48비트 데이터로부터 TCEPR4의 4개의 트렐리스 제약 초기 상태의 16/18 변환된 54비트 부호를 생성하고, 4개의 트렐리스 제약 초기 상태의 동기어 패턴과 36비트의 모든 신호와 EPR4에서의 제곱 유클리드 거리를 산출하여, 거리 4 이내의 것을 오류 패턴으로 한다.
다음에, 동기어 패턴 및 그 오류 패턴과 모든 36비트의 16/18 부호와의 제곱유클리드 거리를 산출하여, 5 이상 있는 것을 확인하였다.
다음에, 16/18 부호가 시프트했을 때의 패턴과도 거리를 두기 위해서, 도 8A 및 도 8B에 도시한 바와 같이, 54비트의 16/18 부호를 1비트씩 시프트시켜 36비트 부호를 작성하고, 동기어 패턴 및 그 오류 패턴과의 제곱 유클리드 거리를 산출하였다.
또한, 부호어와 동기어의 조합에 의해 동기어와 닮은 패턴이 있으면 잘못된 위치에서 동기어를 검출할 가능성이 있으므로, 동기어와 부호어가 연속한 신호에 의해 잘못된 위치에서 리세트되지 않도록, 36비트의 동기어 패턴 및 그 오류 패턴과 그 전후에서 18비트를 부가한 72비트 신호를 생성하고, 도 9에 도시한 바와 같이, 1비트씩 시프트시켜서, 동기어 패턴 및 그 오류 패턴과의 EPR4에서의 제곱 유클리드 거리를 산출하여, 5 이상 있는 것을 확인하였다.
여기서, 동기어 패턴과 EPR4의 트렐리스선도를 도 10에 도시한다.
또한, 표 2에 나타낸 4개의 초기 상태에 대응하는 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 다음과 같이 된다.
즉, 초기 상태 S0의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리 드 거리는, 표 3 내지 표 5와 같이 된다.
Figure 112003008180947-pct00004
Figure 112003008180947-pct00005
Figure 112003008180947-pct00006
또한, 초기 상태 S1의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 표 6 내지 표 8과 같이 된다.
Figure 112003008180947-pct00007
Figure 112003008180947-pct00008
Figure 112003008180947-pct00009
또한, 초기 상태 S2의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 표 9 내지 표 11과 같이 된다.
Figure 112003008180947-pct00010
Figure 112003008180947-pct00011
Figure 112003008180947-pct00012
또한, 초기 상태 S3의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 표 12 내지 표 14와 같이 된다.
Figure 112003008180947-pct00013
Figure 112003008180947-pct00014
Figure 112003008180947-pct00015
동기어 패턴 및 그 오류 패턴은, 16/18 부호와 제곱 유클리드 거리가 5 이상있으며, 또한, 잘못된 위치에서 리세트가 걸리지 않는 것이 확인되었다. 따라서, 이 동기어 패턴의 제곱 유클리드 거리 4 이내의 오류 패턴을 전부 동기어라고 간주함으로써 오류를 허용한 동기어 검출을 행할 수 있어, 오검출 확률을 높이지 않고 미검출 확률을 낮출 수 있다.
또한, 동기어 패턴의 조건 1) 내지 3)에 다음의 조건 4) 내지 6)을 부가함으로써,
조건 4) 동기어 중에서 9T의 전후에 1T의 신호가 오지 않도록 한다.
조건 5) 동기어의 전후는 2T 이상으로 한다. 이것에 의해, 9T를 동기어의 전후단의 가까운 곳에 배치한다.
조건 6) 동기어의 시프트에 약하기 때문에 9T는 3회 연속하지 않는다.
초기 상태 S0과 S1, S2와 S3에서 공통의 표 15에 나타내는 2종류의 동기어를 패터닝할 수 있다.
Figure 112003008180947-pct00016
여기서, 동기어 패턴과 16/18(0, 7) 부호의 트렐리스선도를 도 11에 도시한다.
표 15에 나타낸 2종류의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 다음과 같이 된다.
즉, 초기 상태 S0, S1의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 표 16 내지 표 17과 같이 된다.
Figure 112003008180947-pct00017
Figure 112003008180947-pct00018
또한, 초기 상태 S2, S3의 동기어 패턴의 각 오류 패턴의 비트마다의 제곱 유클리드 거리는, 표 18 내지 표 19와 같이 된다.
Figure 112003008180947-pct00019
Figure 112003008180947-pct00020
상술한 바와 같이, 본 발명은, 복수의 부호어로 구성되는 블록의 선두에 부가되는 블록 동기 신호가, 부호 시퀀스의 동일 비트의 최대 연속 길이를 Tmax=8로 하였을 때, 해당 블록 동기 신호 내에서 1회 이상, 동일 비트가 9개 연속하도록 함으 로써, 블록 동기 신호와 부호 시퀀스의 식별이 가능하며, 데이터의 재생 시 혹은 수신 시에 복수의 부호어로부터 얻어지는 블록의 선두를 인식하는 것이 가능해진다.
본 발명은, 동기어 패턴의 제곱 유클리드 거리 4 이내의 오류 패턴을 전부 동기어라고 간주함으로써 오류를 허용한 동기어 검출을 행할 수 있어, 오검출 확률을 높이지 않고 미검출 확률을 낮출 수 있다.
본 발명에서는, 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 시변 구조를 갖는 검출 트렐리스 상에서, 시점으로 하는 상태가 다른 블록 동기 신호는, 상호 고유하며, 종점 상태가 동일한 상태라고 하고, 검출한 동기 신호를 기초로 한 검출창을 갖는 윈도우 신호를 이용하여, 블록 동기 신호의 검출을 행함으로써, 블록 동기 신호의 오검출 확률을 낮출 수 있다.
본 발명은, 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 시변 구조를 갖는 검출 트렐리스 상에서, 시점으로 하는 상태가 다른 블록 동기 신호는, 상호 고유하며, 종점 상태가 동일한 상태라고 하고, 상기 블록 동기 신호의 검출과 함께, 해당 블록 동기 신호의 고유성으로부터, 검출 트렐리스 상에서 해당 블록 동기 신호에 의해 TCPR 비터비 검출기의 시점으로 하는 상태를 검출하고, 상기 블록 동기 신호의 검출 후에 브렌치 매트릭의 프리셋을 행함으로써, 안정된 매트릭 검출을 행할 수 있다.

Claims (19)

  1. 복수의 부호어로 구성되는 블록의 선두에 블록 동기 신호를 부가하여 전송하는 데이터 전송 방법에 있어서,
    상기 블록 동기 신호는, 부호 시퀀스의 동일 비트의 최대 연속 길이를 Tmax=8로 하였을 때, 해당 블록 동기 신호 내에서 1회 이상, 동일 비트가 9개 연속하고, 전후에 부호어가 인접하는 경우에, 해당 블록 동기 신호 직전에 인접하는 부호어로부터 해당 블록 동기 신호에 걸쳐, 및 해당 동기 신호로부터 해당 동기 신호 직후에 인접하는 부호어에 걸쳐 동일 비트가 9개 이상 연속하지 않고, 전송로 출력 시퀀스로부터 해당 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 검출 트렐리스가 갖는 시변(時變) 구조에 따르고, 상기 검출 트렐리스 상에서 시점으로 하는 상태가 서로 다른 블록 동기 신호는, 상호 고유하며, 종점 상태가 동일한 상태인 것을 특징으로 하는 데이터 전송 방법.
  2. 삭제
  3. 삭제
  4. 제1항에 있어서,
    상기 블록 동기 신호의 길이는 18비트이고, 상기 블록 동기 신호의 길이는 부호 길이의 정수배인 것을 특징으로 하는 데이터 전송 방법.
  5. 제1항에 있어서,
    상기 블록 동기 신호의 길이는 36비트이고, 상기 블록 동기 신호의 길이는 부호 길이의 정수배인 것을 특징으로 하는 데이터 전송 방법.
  6. 제5항에 있어서,
    동일 블록 동기 신호 내에서 3회, 동일 비트가 9개 연속하는 것을 특징으로 하는 데이터 전송 방법.
  7. 제6항에 있어서,
    동일 블록 동기 신호 내에서 다른 부호의 9개의 연속의 동일 비트가 2회 연속하는 것을 특징으로 하는 데이터 전송 방법.
  8. 제7항에 있어서,
    동일 블록 동기 신호 내에서 9개 연속의 동일 비트의 전후는 2개 이상 동일 비트가 연속하는 것을 특징으로 하는 데이터 전송 방법.
  9. 제8항에 있어서,
    상기 블록 동기 신호의 시작과 끝은 연속하는 동일 비트가 8개 이하인 것을 특징으로 하는 데이터 전송 방법.
  10. 삭제
  11. 삭제
  12. 삭제
  13. 제1항에 있어서,
    상기 검출 트렐리스 상에서 시점으로 하는 상태가 서로 다른 블록 동기 신호는, ADS(Alternating Digital Sum)의 상태가 동일하면 상호 동일 블록 동기 신호인 것을 특징으로 하는 데이터 전송 방법.
  14. 복수의 부호어로 구성되는 블록의 선두에 부가되어 전송된 블록 동기 신호를 검출하는 블록 동기 신호 검출 방법에 있어서,
    상기 블록 동기 신호는, 부호 시퀀스의 동일 비트의 최대 연속 길이를 Tmax=8로 하였을 때, 해당 블록 동기 신호 내에서 1회 이상, 동일 비트가 9개 연속하고, 전후에 부호어가 인접하는 경우에, 해당 블록 동기 신호 직전에 인접하는 부호어로부터 해당 블록 동기 신호에 걸쳐, 및 해당 동기 신호로부터 해당 동기 신호 직후에 인접하는 부호어에 걸쳐 동일 비트가 9개 이상 연속하지 않고, 전송로 출력 시퀀스로부터 해당 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 검출 트렐리스가 갖는 시변(時變) 구조에 따르고, 상기 검출 트렐리스 상에서 시점으로 하는 상태가 서로 다른 블록 동기 신호는, 상호 고유하며, 종점 상태가 동일한 상태이고,
    검출한 동기 신호를 기초로 한 검출창을 갖는 윈도우 신호를 이용하여, 블록 동기 신호의 검출을 행하고,
    상기 블록 동기 신호의 검출과 함께, 해당 블록 동기 신호의 고유성으로부터, 검출 트렐리스 상에서 해당 블록 동기 신호가 시점으로 하는 상태를 검출하며, 상기 블록 동기 신호의 검출 후에 브렌치 매트릭의 프리셋을 행하는 것을 특징으로 하는 블록 동기 신호 검출 방법.
  15. 삭제
  16. 소정의 특성을 갖는 전송로의 출력 시퀀스로부터 전송된 동기 신호를 포함하는 부호 시퀀스를 검출하는 재생 장치에 있어서,
    상기 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 검출하는 시불변인 검출 수단과,
    상기 시불변인 검출 수단의 출력으로부터 블록 동기 신호를 검출하여 그 정보를 출력하는 동기 신호 검출 수단과,
    상기 동기 신호 검출 수단이 출력하는 블록 동기 신호의 정보에 의해 초기 설정되며, 시변 구조를 갖는 검출 트렐리스를 이용하여 상기 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 비터비 검출하는 비터비 검출 수단과,
    상기 동기 신호 검출 수단에 의해 검출한 블록 동기 신호와 비터비 검출 수단에 의한 검출 출력에 기초하여 블록 동기 신호의 검출창을 갖는 윈도우 신호를 생성하는 윈도우 신호 생성 수단을 포함하며,
    상기 블록 동기 신호는, 부호 시퀀스의 동일 비트의 최대 연속 길이를 Tmax=8로 하였을 때, 해당 블록 동기 신호 내에서 1회 이상, 동일 비트가 9개 연속하고, 전후에 부호어가 인접하는 경우에, 해당 블록 동기 신호 직전에 인접하는 부호어로부터 해당 블록 동기 신호에 걸쳐, 및 해당 동기 신호로부터 해당 동기 신호 직후에 인접하는 부호어에 걸쳐 동일 비트가 9개 이상 연속하지 않고, 전송로 출력 시퀀스로부터 해당 블록 동기 신호를 포함하는 부호 시퀀스를 최우도 검출할 때에 이용하는 검출 트렐리스가 갖는 시변(時變) 구조에 따르고, 상기 검출 트렐리스 상에서 시점으로 하는 상태가 서로 다른 블록 동기 신호는, 상호 고유하며, 종점 상태가 동일한 상태이고,
    상기 동기 신호 검출 수단은, 상기 윈도우 신호 생성 수단에 의해 생성되는 윈도우 신호를 이용하여 블록 동기 신호의 검출을 행하고, 상기 블록 동기 신호의 검출과 함께, 해당 블록 동기 신호의 고유성으로부터, 검출 트렐리스 상에서 해당 블록 동기 신호가 시점으로 하는 상태를 검출하며, 상기 블록 동기 신호의 검출 후에 브렌치 매트릭의 프리셋을 행하는 것을 특징으로 하는 재생 장치.
  17. 삭제
  18. 제14항에 있어서,
    상기 검출 트렐리스 상에서, 시불변(時不變)인 검출 방법을 이용하여 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 검출했을 때에, 1회의 오류 이벤트가 발생하여 생긴 오류 동기 신호도 상기 블록 동기 신호로서 검출하는 것을 특징으로 하는 블록 동기 신호 검출 방법.
  19. 제16항에 있어서,
    상기 검출 트렐리스 상에서, 시불변(時不變)인 검출 방법을 이용하여 전송로 출력 시퀀스로부터 블록 동기 신호를 포함하는 부호 시퀀스를 검출했을 때에, 1회의 오류 이벤트가 발생하여 생긴 오류 동기 신호도 상기 블록 동기 신호로서 검출하는 것을 특징으로 하는 재생 장치.
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