KR100666225B1 - 데이지 체인을 형성하는 멀티 디바이스 시스템 및 이의 구동방법 - Google Patents

데이지 체인을 형성하는 멀티 디바이스 시스템 및 이의 구동방법 Download PDF

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Abstract

데이지 체인을 형성하는 멀티 디바이스 시스템 및 이를 이용한 구동방법이 게시된다. 본 발명의 멀티 디바이스 시스템에서는, 체인 버스, 호스트 디바이스와 클라이언트 디바이스들에 의해, 오실레이션하는 데이지 체인(daisy chain)이 형성된다. 본 발명의 멀티 디바이스 시스템 및 그의 구동방법에서는, 데이터 체인의 오실레이션 주기만을 측정하여, 호스트 디바이스와 클라이언트 디바이스간의 데이터 전송지연시간이 파악될 수 있다. 그러므로, 본 발명의 멀티 디바이스 시스템 및 그의 구동방법에 의하면, 간단한 회로의 구성 및 프로토클로 호스트 디바이스와 클라이언트 디바이스간의 데이터 전송지연시간이 파악될 수 있다. 또한, 각 클라이언트 디바이스에서의 지연클락의 수도 용이하게 예측될 수 있다.
멀티 디바이스 시스템, 호스트, 클라이언트, 지연시간, 지연클락, 오실레이션, 데이지 체인, 시스템 버스

Description

데이지 체인을 형성하는 멀티 디바이스 시스템 및 이의 구동방법{MULTI DEVICE SYSTEM FORMING DAISY CHAIN AND OPERATING METHOD FOR THE SAME}
본 발명의 상세한 설명에서 사용되는 도면을 보다 충분히 이해하기 위하여, 각 도면의 간단한 설명이 제공된다.
도 1은 본 발명의 일실시예에 따른 멀티 디바이스 시스템을 나타내는 도면이다.
도 2a 및 도 2b는 각각 도 1의 클라이언트 디바이스의 예를 나타내는 도면이다.
도 3은 도 1의 멀티 디바이스 시스템의 구동방법을 나타내는 플로우챠트로서, 호스트 디바이스로부터 i번째 클라이언트 디바이스까지의 전송지연시간(tDi)를 구하는 방법을 나타낸다.
도 4는 도 1의 멀티 디바이스 시스템의 다른 구동방법을 나타내는 플로우챠트로서, 제i 클라이언트 디바이스의 지연클락의 수(tCi)를 구하는 방법을 나타낸다.
도 5는 본 발명의 다른 일실시예에 따른 멀티 디바이스 시스템를 나타내는 도면이다.
도 6은 도 2의 클라이언트 디바이스의 예를 나타내는 도면이다.
* 도면의 주요부분에 대한 부호의 설명 *
110, 510: 호스트 디바이스
120_i, 520_i: 클라이언트 디바이스
tBUF: 버퍼링 지연시간 tFLT: 플라이트 지연시간
130_i, 530_i: 구동버스 단락 140_i: 응답버스 단락
150, 550: 체인 버스
DI:구동입력단 DO:구동출력단
RI:응답입력단 RO: 응답출력단
tBUF: 버퍼링 지연시간 tFLT: 플라이트 지연시간
본 발명은 멀티 디바이스 시스템에 관한 것으로서, 특히, 호스트 디바이스와 클라이언트 디바이스들 사이에 데이지 체인(daisy chain)을 형성하는 멀티 디바이스 시스템 및 이를 이용한 구동방법에 관한 것이다.
일반적으로 멀티 디바이스 시스템은 호스트 디바이스와 클라이언트 디바이스들로 구성되며, 클라이언트 디바이스들은 상기 호스트 디바이스로부터 제공되는 신 호(또는 데이터)에 의하여 순서적으로 제어된다. 이때, 멀티 디바이스 시스템을 효과적으로 구동하기 위해서는, 호스트 디바이스 및 클라이언트 디바이스간의 데이터 전송지연시간이 예측되어야 한다.
기존의 멀티 디바이스 시스템에서는, 호스트 디바이스 및 클라이언트 디바이스간의 데이터 전송지연시간이 주로 반복적인 실험 및 측정을 통하여 이루어진다. 따라서, 기존의 멀티 디바이스 시스템에서는, 이와 같은 반복적인 실험과 측정을 위하여, 복잡한 회로가 내장되며, 또한, 이를 운용하기 위한 프로토클(protocol)이 복잡하다는 문제점이 발생한다.
본 발명의 목적은 종래기술의 문제점을 해결하기 위한 것으로서, 간단한 회로의 구성과 프로토클로 호스트 디바이스와 클라이언트 디바이스간의 지연시간을 알 수 있는 멀티 디바이스 시스템 및 이를 이용한 구동방법을 제공하는 데 있다.
상기와 같은 기술적 과제를 달성하기 위한 본 발명의 일면은 멀티 디바이스 시스템에 관한 것이다. 본 발명의 멀티 디바이스 시스템은 자신의 출력단을 통하여 데이터를 송신하며, 자신의 입력단을 통하여 데이터를 수신하는 호스트 디바이스로서, 상기 입력단의 신호가 상기 출력단으로 제공되는 상기 호스트 디바이스로서, 상기 출력단의 신호를 일정한 주기로 오실레이팅하기 위한 오실레이팅 수단을 포함 하는 상기 호스트 디바이스; 각각이 구동입력단, 구동출력단, 응답입력단 그리고, 응답출력단을 포함하는 제1 내지 제N(여기서, N은 2 이상의 자연수) 클라이언트 디바이스들; 제1 내지 제N 구동버스 단락들을 포함하는 구동 시스템 버스로서, 제1 구동버스 단락은 상기 호스트 디바이스의 출력단과 상기 제1 클라이언트 디바이스의 구동입력단을 연결하며, 제i(여기서, i는 2 내지 N) 구동버스 단락은 제(i-1) 클라이언트 디바이스의 구동출력단과 제i 클라이언트 디바이스의 구동입력단을 연결하는 상기 구동 시스템 버스; 제1 내지 제N 응답버스 단락들을 포함하는 응답 시스템 버스로서, 제1 응답버스 단락은 상기 호스트 디바이스의 입력단과 상기 제1 클라이언트 디바이스의 응답출력단을 연결하며, 제i(여기서, i는 2 내지 N) 응답버스 단락은 제(i-1) 클라이언트 디바이스의 응답입력단과 제i 클라이언트 디바이스의 응답출력단을 연결하는 상기 응답 시스템 버스; 상기 제N 클라이언트 디바이스의 구동출력단과 상기 제N 클라이언트 디바이스의 응답입력단을 연결하는 체인 버스를 구비한다.
상기와 같은 다른 기술적 과제를 달성하기 위한 본 발명의 일면은 멀티 디바이스 시스템의 구동방법에 관한 것이다. 본 발명의 일면에 따른 멀티 디바이스 시스템의 구동방법은 호스트 디바이스와 N개의 클라이언트 디바이스을 데이지 체인으로 형성하기 위하여, 상기 호스트 디바이스로부터 맨 마지막의 클라이언트 디바이스에서의 구동출력단과 응답입력단 사이에 체인 버스를 설치하는 단계로서, 상기 구동출력단은 구동 시스템 버스 상의 신호를 출력하며, 상기 응답입력단은 응답 시스템 버스 상의 데이터를 입력하는 상기 체인 버스를 설치하는 단계; 상기 호스트 디바이스가 특정되는 단자의 신호의 오실레이션 주기(tOSC)를 인식하는 단계; 및 상기 호스트 디바이스가 i번째 클라이언트 디바이스까지의 전송지연시간(tDi)를 수학식 tDi=i*tOSC/(2*(2N+1))에 의하여 지연시간을 계산하는 단계를 구비한다.
상기와 같은 다른 기술적 과제를 달성하기 위한 본 발명의 다른 일면은 멀티 디바이스 시스템의 구동방법에 관한 것이다. 본 발명의 다른 일면에 따른 멀티 디바이스 시스템의 구동방법도, 본 발명의 다른 일면에 따른 멀티 디바이스 시스템의 구동방법에서와 같이, 상기 체인 버스를 설치하는 단계를 포함한다. 또한, 본 발명의 다른 일면에 따른 멀티 디바이스 시스템의 구동방법은 상기 구동 시스템 버스의 신호를 K배 체배하도록 셋팅하여, 상기 제i 클라이언트 디바이스의 기준클락을 발생하는 단계; 및 상기 호스트 디바이스가 상기 제i 클라이언트 디바이스의 지연클락(tCi)의 수를 수학식 tCi=i*K/(2*(N+1))에 의하여 계산하는 단계를 포함한다. 이때, 상기 지연클락(tCi)의 수는, 상기 호스트 디바이스로부터 발생되는 신호가 상기 제i 클라이언트 디바이스에 도달하는 동안에, 진행될 수 있는 상기 기준클락의 최대 클락수인 상기 지연클락의 수이다.
본 발명과 본 발명의 동작상의 잇점 및 본 발명의 실시에 의하여 달성되는 목적을 충분히 이해하기 위해서는 본 발명의 바람직한 실시예를 예시하는 첨부 도면 및 첨부 도면에 기재된 내용을 참조하여야만 한다. 각 도면을 이해함에 있어서, 동일한 부재는 가능한 한 동일한 참조부호로 도시하고자 함에 유의해야 한다. 그리고, 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 공지 기능 및 구성에 대한 상세한 기술은 생략된다.
먼저, 본 발명을 설명하기에 앞서, 일반적인 클라이언트 디바이스에 대하여 살펴본다. 그러나, 이는 단지 본 발명의 이해를 돕기 위한 것이지, 본 발명의 권리범위를 한정하기 위한 것은 아니다.
일반적으로, 듀얼 인-라인 클라이언트 디바이스(DIMM: Dual In-Line Memory Module)와 같은 클라이언트 디바이스들은 복수개의 내부 디바이스들이 장착되는 작은 인쇄회로기판(printed circuit board)이다. 클라이언트 디바이스들은 인쇄회로기판의 전기적 커넥터를 통하여 억세스될 수 있는(accessible) 리드선(lead)을 가진다. 그리고, 클라이언트 디바이스은 큰 인쇄회로기판 즉, 마더보더(motherboard) 상에 결합되는 작은 소켓 커넥터에 삽입된다. 이와 같은 복수개의 클라이언트 디바이스들이 분기접속점(multi-drop connection)을 통하여 대개 전형적이고 직접적으로 호스트 디바이스에 연결된다. 상기 분기접속점은 호스트 디바이스와 커플링(coupling)되는 시스템 버스와 연결된다. 호스트 디바이스는 시스템 버스를 통하여 신호를 송수신한다. 각 클라이언트 디바이스은 다수개의 내부회로들을 포함한다.
이때, 상기 시스템 버스는 호스트 디바이스에서 클라이언트 디바이스로 신호를 전송하는 구동 시스템 버스와, 클라이언트 디바이스로부터 호스트 디바이스로 신호를 전송하는 응답 시스템 버스로 구분될 수 있다. 또한, 경우에 따라서는, 하나의 시스템 버스(본 명세서에서는, '구동 시스템 버스'로 함)를 통하여, 호스트 디바이스과 각 클라이언트 디바이스간에 신호를 송수신할 수 있다.
그리고, 상기 분기접속점은 1개 또는 2개 이상의 단자를 통하여 상기 시스템 버스의 신호를 해당하는 클라이언트 디바이스에 제공할 수 있다.
이하, 첨부한 도면을 참조하여 본 발명의 바람직한 실시예를 설명함으로써, 본 발명을 상세히 설명한다.
도 1은 본 발명의 일실시예에 따른 멀티 디바이스 시스템(100)을 나타내는 도면이다. 도 1을 참조하면, 상기 멀티 디바이스 시스템(100)은 호스트 디바이스(110), 제1 내지 제N(여기서, N은 2 이상의 자연수) 클라이언트 디바이스들(120_1, 120_2, …, 120_N), 구동 시스템 버스, 응답 시스템 버스, 그리고 체인 버스(150)를 포함한다.
상기 호스트 디바이스(110)는 자신의 출력단(COUT)을 통하여 데이터(또는 신호)를 송신하며, 자신의 입력단(CIN)을 통하여 데이터를 수신한다. 그리고, 상기 입력단(CIN)의 신호는 상기 출력단(COUT)으로 제공된다.
그리고, 상기 호스트 디바이스(110)는 상기 출력단(COUT)의 신호를 일정한 주기로 오실레이팅하기 위한 오실레이팅 수단(111)을 포함한다. 상기 오실레이팅 수단(111)에 의하여, 데이지 체인(daisy chain) 형태로 형성되는 상기 호스트 디바이스(110)와 상기 클라이언트 디바이스들(120_1, 120_2, …, 120_N)의 각 단자의 신호들이 오실레이션(oscillation)하게 된다.
바람직하기로는, 상기 오실레이팅 수단(111)은 상기 입력단(CIN)의 신호를 반전하여 상기 출력단(COUT)으로 제공하는 인버터(111a)를 포함한다.
본 실시예에서는, 호스트 디바이스(110)의 입력단(CIN)에서 출력단(COUT)까지의 데이터 전송지연시간은, 상기 오실레이팅 수단(111)에 의한 논리상태의 반전여부를 고려하여, 버퍼링 지연시간(tBUF)이다. 즉, 상기 입력단(CIN)에서의 데이터 의 하이 피크(high peak)와 상기 출력단(COUT)에서의 데이터의 로우 피크(low peak) 사이의 지연시간은 상기 버퍼링 지연시간(tBUF)으로 된다.
상기 클라이언트 디바이스들(120_1, 120_2, …, 120_N) 각각은 구동입력단(DI), 구동출력단(DO), 응답입력단(RI) 및 응답출력단(RO)을 포함한다. 상기 구동입력단(DI)을 통하여, 상기 호스트 디바이스(110) 쪽에서 제공되는 데이터가 수신된다. 그리고, 상기 구동출력단(DO)을 통하여, 호스트 디바이스(110)의 데이터가 뒷쪽(호스트 디바이스로부터 멀어지는 쪽)의 클라이언트 디바이스로 송신된다.
또한, 상기 응답입력단(RI)을 통하여, 상기 뒤쪽의 클라이언트 디바이스로부터 데이터가 수신된다. 그리고, 상기 응답출력단(RI)을 통하여, 뒤쪽의 클라이언트 디바이스의 데이터가 호스트 디바이스(110) 쪽으로 송신된다.
바람직하기로는, 상기 클라이언트 디바이스들(120_1, 120_2, …, 120_N)은 독립적으로 구동될 수 있는 메모리 소자들을 내장하는 메모리 모듈이다.
구동 시스템 버스는 제1 내지 제N 구동버스 단락들(130_1, 130_2, …, 130_N)로 구성된다. 그리고, 본 실시예에서, 상기 구동버스 단락들은 서로 분리되어 구현된다. 그러나, 상기 구동버스 단락들은 서로 연결되는 일체형으로 구현될 수도 있다. 이때, 구동버스 단락은 분기접속점 간의 시스템 버스를 칭할 수 있다.
제i 구동버스 단락은 제(i-1) 클라이언트 디바이스의 구동출력단(DO)과 제i 클라이언트 디바이스의 구동입력단(DI)을 연결한다. 여기서, 2 ≤i ≤N 이다. 그리고, 상기 제1 구동버스 단락(130_1)은 상기 호스트 디바이스(110)의 출력단(COUT)과 상기 제1 클라이언트 디바이스(120_1)의 구동입력단(DI)을 연결한다.
본 실시예에서는, 각 구동버스 단락(130_1, 130_2, …, 130_N)에서의 지연시간 즉, 앞쪽의 클라이언트 디바이스의 구동출력단(DO)으로부터 다음의 클라이언트 디바이스의 구동입력단(DI)까지의 지연시간은 플라이트 지연시간(tFLT)으로 거의 동일하도록 구현된다.
응답 시스템 버스는 제1 내지 제N 응답버스 단락들(140_1, 140_2, …, 140_N)로 구성된다. 본 실시예에서, 상기 응답버스 단락들은 서로 분리되어 구현된다. 그러나, 상기 응답버스 단락들은 서로 연결되는 일체형으로 구현될 수도 있다. 이때, 응답버스 단락은 분기접속점 간의 시스템 버스를 칭할 수 있다.
제i 응답버스 단락은 제(i-1) 클라이언트 디바이스의 응답입력단(RI)과 제i 클라이언트 디바이스의 응답출력단(RO)을 연결한다. 그리고, 상기 제1 응답버스 단락(140_1)은 상기 호스트 디바이스(110)의 입력단(CIN)과 상기 제1 클라이언트 디바이스(120_1)의 응답출력단(RO)을 연결한다.
본 실시예에서는, 각 응답버스 단락(140_1, 140_2, …, 140_N)에서의 지연시간 즉, 뒤쪽의 클라이언트 디바이스의 응답출력단(RO)으로부터 앞의 클라이언트 디바이스의 응답입력단(RI)까지의 지연시간도, 상기 구동버스 단락에서와 마찬가지로, 플라이트 지연시간(tFLT)이 되도록 구현된다.
상기 체인 버스(150)는 맨 뒤쪽의 클라이언트 디바이스 즉, 상기 제N 클라이언트 디바이스(120_N)의 구동출력단(DO)과 응답입력단(RI)을 연결한다. 본 실시예에서는, 상기 체인 버스(150)의 지연시간 즉, 상기 제N 클라이언트 디바이스(120_N)의 구동출력단(DO)으로부터 상기 제N 클라이언트 디바이스(120_N)의 응답입 력단(RI)까지의 지연시간은, 상기 구동버스 단락 및 상기 응답버스 단락에서와 마찬가지로, 플라이트 지연시간(tFLT)이 되도록 구현된다.
전술한 바와 같이, 본 발명의 멀티 디바이스 시스템은, 상기 체인 버스(150), 상기 호스트 디바이스(110)와 상기 클라이언트 디바이스들(120_1, 120_2, …, 120_N)에 의해, 오실레이션하는 데이지 체인(daisy chain)으로 형성된다.
이와 같은 경우, 상기 호스트 디바이스(110)에서의 특정되는 단자(N110)에서의 오실레이션 주기(tOSC)는 (수학식 1)과 같다.
tOSC=2*(2N+1)*(tBUF+tFLT)
그리고, tOSC가 인식(측정)되는 경우에, 상기 호스트 디바이스(110)로부터 i번째 클라이언트 디바이스(120_i)까지의 전송지연시간(tDi)은 (수학식 2)에 의하여 계산될 수 있다.
tDi=i*tOSC/(2*(2N+1))
도 2a 및 도 2b는 각각 도 1의 클라이언트 디바이스(120_1~120_N)의 예를 나타내는 도면이다. 도 2a 및 도 2b를 참조하면, 상기 클라이언트 디바이스들(120_1~120_N) 각각은 구동입력버퍼(DIB), 구동출력버퍼(DOB), 응답입력버퍼(RIB) 및 응답출력버퍼(ROB)를 더 구비한다.
상기 구동입력버퍼(DIB)는 상기 구동입력단(DI)으로 수신되는 신호를 버퍼링하며, 상기 구동출력버퍼(DOB)는 상기 구동입력버퍼(DIB)의 출력신호를 버퍼링하 여, 상기 구동출력단(DO)으로 제공한다.
상기 응답입력버퍼(RIB)는 상기 응답입력단(RI)으로 수신되는 신호를 버퍼링하며, 상기 응답출력버퍼(ROB)는 상기 응답입력버퍼(RIB)의 출력신호를 버퍼링하여, 상기 응답출력단(RO)으로 제공한다.
바람직하기로는, 상기 클라이언트 디바이스들 중 적어도 어느하나는 주파수 체배기(121)를 더 구비한다. 상기 체배기(121)은, 도 2a에서와 같이, 상기 구동입력단(DI)과 구동출력단(DO) 사이의 신호의 주파수를 K배 체배하는 방식으로 구현될 수 있다. 또한, 상기 체배기(121)은, 도 2b에서와 같이, 상기 응답입력단(RI)과 응답출력단(RO) 사이의 신호의 주파수를 K배 체배하는 방식으로 구현될 수도 있다. 바람직하기로는, 상기 체배기(121)는 PLL 회로로 구현된다.
상기 체배기(121)에서 체배되는 신호는 자신의 클라이언트 디바이스에 포함되는 각 내부회로들을 제어하는 기준클락(RCLK)으로 사용된다. 이때, 상기 K은 모드 레지스터 세트(MRS) 등의 방식으로 외부에서 프로그램될 수 있다.
이때, 상기 체배기(PLL)가 포함되는 제i 클라이언트 디바이스(120_i)에서의 지연클락의 수(tCi)는 용이하게 예측될 수 있다. 여기서, 지연클락의 수(tCi)는 상기 호스트 디바이스(110)로부터 발생되는 신호가 상기 제i 클라이언트 디바이스(120_i)에 도달하는 동안에, 진행될 수 있는 상기 기준클락(RCLK)의 최대 클락수이다.
먼저, 상기 기준클락(RCLK)의 주기(tRCLK)는 (수학식 3)과 같다.
tRCLK=tOSC/K
그러면, 지연클락의 수(tCi)는 i번째 클라이언트 디바이스(120_i)까지의 전송지연시간(tDi)를 상기 기준클락(RCLK)의 주기(tRCLK)로 나눈 것과 같다.
따라서, 상기 지연클락의 수(tCi)는 (수학식 4)에 의하여 계산될 수 있다.
tCi=tDi/tRCLK
={i*tOSC/(2*(2N+1))}/{tOSC/K}
=i*K/(2*(N+1))
이때, 상기 i, K, N은 모두 용이하게 확인될 수 있으므로, 상기 제i 클라이언트 디바이스(120_i)에서의 지연클락의 수(tCi)는 용이하게 예측될 수 있다.
도 3은 도 1의 멀티 디바이스 시스템의 구동방법을 나타내는 플로우챠트로서, 호스트 디바이스로부터 i번째 클라이언트 디바이스까지의 전송지연시간(tDi)를 구하는 방법을 나타낸다. 도 3을 참조하여, 상기 전송지연시간(tDi)를 구하는 방법을 요약하면 다음과 같다.
S310단계에서, 상기 호스트 디바이스(110)와 상기 클라이언트 디바이스들을 데이지 체인으로 형성하기 위하여, 제N 클라이언트 디바이스(120_N)에서의 구동출력단(DO)과 응답입력단(RI) 사이에 체인 버스(150)를 설치한다.
S320단계에서, 상기 호스트 디바이스(110)가 특정되는 단자의 신호의 오실레이션 주기(tOSC)를 인식한다.
S330단계에서, 상기 호스트 디바이스(110)가 i번째 클라이언트 디바이스 (120_i)까지의 전송지연시간(tDi)를 tDi=i*tOSC/(2*(2N+1))에 의하여 지연시간을 계산한다.
도 4는 도 1의 멀티 디바이스 시스템의 다른 구동방법을 나타내는 플로우챠트로서, 제i 클라이언트 디바이스의 지연클락의 수(tCi)를 구하는 방법을 나타낸다. 도 4를 참조하여, 상기 지연클락의 수(tCi)를 구하는 방법을 요약하면 다음과 같다.
S410단계에서, 상기 호스트 디바이스(110)와 상기 클라이언트 디바이스들을 데이지 체인으로 형성하기 위하여, 제N 클라이언트 디바이스(120_N)에서의 구동출력단(DO)과 응답입력단(RI) 사이에 체인 버스(150)를 설치한다.
S420단계에서, 상기 제i 클라이언트 디바이스(120_i)이 상기 구동 시스템 버스 또는 상기 응답 시스템 버스의 신호를 K배 체배하도록 셋팅하여, 기준클락(RCLK)을 발생한다.
S430단계에서, 상기 호스트 디바이스(110)가 상기 제i 클라이언트 디바이스의 지연클락의 수(tCi)를 tCi=i*K/(2*(2N+1))에 의하여 계산한다.
상기와 같은 본 발명의 멀티 디바이스 시스템 및 그의 구동방법에 의하면, 간단한 회로의 구성으로 호스트 디바이스(110)와 클라이언트 디바이스(120_1~120_N)간의 전송지연시간이 파악될 수 있다. 또한, 각 클라이언트 디바이스에서의 지연클락의 수가 용이하게 예측될 수 있다.
도 5는 본 발명의 다른 일실시예에 따른 멀티 디바이스 시스템(500)를 나타내는 도면이며, 도 6은 도 2의 클라이언트 디바이스(520_1~520_N)의 예를 나타내는 도면이다. 도 5 및 도 6의 멀티 디바이스 시스템(500)는, 도 1의 멀티 디바이스 시스템(100)에 대해, 체인 버스(550)가 맨 마지막 클라이언트 디바이스(520_N)의 구동출력단(DO)과 호스트 디바이스(510)의 입력단(CIN) 사이에 형성된다는 점에서 차이가 있을 뿐이다.
도 5의 멀티 디바이스 시스템(500)에서, 상기 호스트 디바이스(510)로부터 i번째 클라이언트 디바이스(520_i)까지의 전송지연시간(tDi)은 (수학식 5)에 의하여 계산될 수 있다.
tDi=i*tOSC/(2*(2N+1))
그러면, 지연클락의 수(tCi)는 i번째 클라이언트 디바이스(120_i)까지의 전송지연시간(tDi)를 상기 기준클락(RCLK)의 주기(tRCLK)로 나눈 것과 같다.
따라서, 상기 지연클락의 수(tCi)는 (수학식 6)에 의하여 계산될 수 있다.
tCi=tDi/tRCLK
={i*tOSC/(2*(N+1))}/{tOSC/K}
=i*K/(2*(N+1))
도 5의 멀티 디바이스 시스템(500)의 그 밖의 구성 및 작용은, 도 1의 멀티 디바이스 시스템(100)과 관련되는 기술을 참조하여, 당업자에게 용이하게 이해될 수 있을 것이다. 그러므로, 본 명세서에서는, 그에 대한 구체적인 기술은 생략된다.
본 발명은 도면에 도시된 일 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 본 기술 분야의 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 타 실시예가 가능하다는 점을 이해할 것이다. 따라서, 본 발명의 진정한 기술적 보호 범위는 첨부된 등록청구범위의 기술적 사상에 의해 정해져야 할 것이다.
상기와 같은 본 발명의 멀티 디바이스 시스템에서는, 체인 버스, 호스트 디바이스와 클라이언트 디바이스들에 의해, 오실레이션하는 데이지 체인(daisy chain)이 형성된다. 본 발명의 멀티 디바이스 시스템 및 그의 구동방법에서는, 데이터 체인의 오실레이션 주기만을 측정하여, 호스트 디바이스와 클라이언트 디바이스간의 데이터 전송지연시간이 파악될 수 있다. 그러므로, 본 발명의 멀티 디바이스 시스템 및 그의 구동방법에 의하면, 간단한 회로의 구성 및 프로토클로 호스트 디바이스와 클라이언트 디바이스간의 데이터 전송지연시간이 파악될 수 있다. 또한, 각 클라이언트 디바이스에서의 지연클락의 수도 용이하게 예측될 수 있다.

Claims (16)

  1. 멀티 디바이스 시스템에 있어서,
    자신의 출력단을 통하여 데이터를 송신하며, 자신의 입력단을 통하여 데이터를 수신하는 호스트 디바이스로서, 상기 입력단의 신호가 상기 출력단으로 제공되는 상기 호스트 디바이스로서, 상기 출력단의 신호를 일정한 주기로 오실레이팅하기 위한 오실레이팅 수단을 포함하는 상기 호스트 디바이스;
    각각이 구동입력단, 구동출력단, 응답입력단 그리고, 응답출력단을 포함하는 제1 내지 제N(여기서, N은 2 이상의 자연수) 클라이언트 디바이스들;
    제1 내지 제N 구동버스 단락들을 포함하는 구동 시스템 버스로서, 제1 구동버스 단락은 상기 호스트 디바이스의 출력단과 상기 제1 클라이언트 디바이스의 구동입력단을 연결하며, 제i(여기서, i는 2 내지 N) 구동버스 단락은 제(i-1) 클라이언트 디바이스의 구동출력단과 제i 클라이언트 디바이스의 구동입력단을 연결하는 상기 구동 시스템 버스;
    제1 내지 제N 응답버스 단락들을 포함하는 응답 시스템 버스로서, 제1 응답버스 단락은 상기 호스트 디바이스의 입력단과 상기 제1 클라이언트 디바이스의 응답출력단을 연결하며, 제i(여기서, i는 2 내지 N) 응답버스 단락은 제(i-1) 클라이언트 디바이스의 응답입력단과 제i 클라이언트 디바이스의 응답출력단을 연결하는 상기 응답 시스템 버스;
    상기 제N 클라이언트 디바이스의 구동출력단과 상기 제N 클라이언트 디바이 스의 응답입력단을 연결하는 체인 버스를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  2. 제1 항에 있어서,
    상기 클라이언트 디바이스들 중 적어도 어느하나는
    상기 구동입력단과 구동출력단 사이의 신호 및 상기 응답입력단과 응답출력단 사이의 신호 중의 적어도 어느하나를 K배로 체배하기 위한 주파수 체배기를 더 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  3. 제2 항에 있어서, 상기 K은
    외부에서 프로그램 가능한 것을 특징으로 하는 멀티 디바이스 시스템;
  4. 제1 항에 있어서,
    상기 호스트 디바이스는
    상기 입력단의 신호를 소정의 버퍼링 지연시간(tBUF)으로 상기 출력단으로 제공하기 위하여 구동되며,
    상기 클라이언트 디바이스 각각은
    상기 구동입력단의 신호를 상기 버퍼링 지연시간(tBUF) 상기 구동출력단으로 제공하고, 상기 응답입력단의 신호를 상기 버퍼링 지연시간(tBUF) 상기 응답출력단으로 제공하기 위하여 구동되며,
    상기 구동버스단락들 각각과 상기 응답버스단락들 각각은
    소정의 플라이트 지연시간(tFLT)으로 데이터를 전송하도록 구성되며,
    상기 체인 버스는 상기 플라이트 지연시간(tFLT)으로 데이터를 전송하도록 구성되는 것을 특징으로 하는 멀티 디바이스 시스템.
  5. 제1 항에 있어서, 상기 클라이언트 디바이스들 각각은
    상기 구동입력단으로 수신되는 신호를 버퍼링하기 위한 구동입력버퍼;
    상기 구동입력버퍼의 신호를 버퍼링하여, 상기 구동출력단으로 제공하기 위한 구동출력버퍼;
    상기 응답입력단으로 수신되는 신호를 버퍼링하기 위한 응답입력버퍼; 및
    상기 응답입력버퍼의 신호를 버퍼링하여, 상기 응답출력단으로 제공하기 위한 응답출력버퍼를 더 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  6. 제1 항에 있어서,
    상기 클라이언트 디바이스들은
    독립적으로 구동될 수 있는 메모리 소자들을 내장하는 메모리 모듈인 것을 특징으로 하는 멀티 디바이스 시스템.
  7. 멀티 디바이스 시스템에 있어서,
    자신의 출력단을 통하여 데이터를 송신하며, 자신의 입력단을 통하여 데이터를 수신하는 호스트 디바이스로서, 상기 입력단의 신호가 상기 출력단으로 제공되는 상기 호스트 디바이스로서, 상기 출력단의 신호를 일정한 주기로 오실레이팅하기 위한 오실레이팅 수단을 포함하는 상기 호스트 디바이스;
    각각이 구동입력단 및 구동출력단을 포함하는 제1 내지 제N(여기서, N은 2 이상의 자연수) 클라이언트 디바이스들;
    제1 내지 제N 구동버스 단락들을 포함하는 구동 시스템 버스로서, 제1 구동버스 단락은 상기 호스트 디바이스의 출력단과 상기 제1 클라이언트 디바이스의 구동입력단을 연결하며, 제i(여기서, i는 2 내지 N) 구동버스 단락은 제(i-1) 클라이언트 디바이스의 구동출력단과 제i 클라이언트 디바이스의 구동입력단을 연결하는 상기 구동 시스템 버스;
    상기 제N 클라이언트 디바이스의 구동출력단과 상기 제N 호스트 디바이스의 입력단을 연결하는 체인 버스를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  8. 제7 항에 있어서,
    상기 클라이언트 디바이스들 중 적어도 어느하나는
    상기 구동입력단과 구동출력단 사이의 신호를 K배로 체배하기 위한 주파수 체배기를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  9. 제8 항에 있어서, 상기 K은
    외부에서 프로그램 가능한 것을 특징으로 하는 멀티 디바이스 시스템.
  10. 제7 항에 있어서,
    상기 호스트 디바이스는
    상기 입력단의 신호를 소정의 버퍼링 지연시간(tBUF)으로 상기 출력단으로 제공하기 위하여 구동되며,
    상기 클라이언트 디바이스 각각은
    상기 구동입력단의 신호를 상기 버퍼링 지연시간(tBUF) 상기 구동출력단으로 제공하고, 상기 응답입력단의 신호를 상기 버퍼링 지연시간(tBUF) 상기 응답출력단으로 제공하기 위하여 구동되며,
    상기 구동버스단락들 각각과 상기 응답버스단락들 각각은
    소정의 플라이트 지연시간(tFLT)으로 데이터를 전송하도록 구성되며,
    상기 체인 버스는 상기 플라이트 지연시간(tFLT)으로 데이터를 전송하도록 구성되는 것을 특징으로 하는 멀티 디바이스 시스템.
  11. 제7 항에 있어서, 상기 클라이언트 디바이스들 각각은
    상기 구동입력단으로 수신되는 신호를 버퍼링하기 위한 구동입력버퍼; 및
    상기 구동입력버퍼의 신호를 버퍼링하여, 상기 구동출력단으로 제공하기 위한 구동출력버퍼를 더 구비하는 것을 특징으로 하는 멀티 디바이스 시스템.
  12. 제7 항에 있어서,
    상기 클라이언트 디바이스들은
    독립적으로 구동될 수 있는 메모리 소자들을 내장하는 메모리 모듈인 것을 특징으로 하는 멀티 디바이스 시스템.
  13. 호스트 디바이스 및 N개 클라이언트 디바이스들, 구동 시스템 버스 및 응답 시스템 버스를 포함하는 멀티 디바이스 시스템의 구동방법으로서, 상기 N개의 클라이언트 디바이스들은 상기 구동 시스템 버스를 통하여 상기 호스트 디바이스로부터 의 데이터를 순서적으로 전송하며, 상기 응답 시스템 버스를 통하여 상기 호스트 디바이스에 데이터를 순서적으로 전송하는 상기 멀티 디바이스 시스템의 구동방법에 있어서,
    상기 호스트 디바이스와 상기 N개의 클라이언트 디바이스을 데이지 체인으로 형성하기 위하여, 상기 호스트 디바이스로부터 맨 마지막의 클라이언트 디바이스에서의 구동출력단과 응답입력단 사이에 체인 버스를 설치하는 단계로서, 상기 구동출력단은 상기 구동 시스템 버스 상의 신호를 출력하며, 상기 응답입력단은 상기 응답 시스템 버스 상의 데이터를 입력하는 상기 체인 버스를 설치하는 단계;
    상기 호스트 디바이스가 특정되는 단자의 신호의 오실레이션 주기(tOSC)를 인식하는 단계; 및
    상기 호스트 디바이스가 i번째 클라이언트 디바이스까지의 전송지연시간(tDi)를 수학식 tDi=i*tOSC/(2*(2N+1))에 의하여 지연시간을 계산하는 단계를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템의 구동방법.
  14. 호스트 디바이스 및 N개 클라이언트 디바이스들, 구동 시스템 버스 및 응답 시스템 버스를 포함하는 멀티 디바이스 시스템의 구동방법으로서, 상기 N개의 클라이언트 디바이스들은 상기 구동 시스템 버스를 통하여 상기 호스트 디바이스로부터의 데이터를 순서적으로 전송하며, 상기 응답 시스템 버스를 통하여 상기 호스트 디바이스에 데이터를 순서적으로 전송하는 상기 멀티 디바이스 시스템의 구동방법 에 있어서,
    상기 호스트 디바이스와 상기 N개의 클라이언트 디바이스을 데이지 체인으로 형성하기 위하여, 상기 호스트 디바이스로부터 맨 마지막의 클라이언트 디바이스에서의 구동출력단과 응답입력단 사이에 체인 버스를 설치하는 단계로서, 상기 구동출력단은 상기 구동 시스템 버스 상의 신호를 출력하며, 상기 응답입력단은 상기 응답 시스템 버스 상의 데이터를 입력하는 상기 체인 버스를 설치하는 단계;
    상기 구동 시스템 버스 또는 상기 응답 시스템 버스의 신호를 K배 체배하도록 셋팅하여, 상기 제i 클라이언트 디바이스의 기준클락을 발생하는 단계; 및
    상기 호스트 디바이스가 상기 제i 클라이언트 디바이스의 지연클락의 수(tCi)를 수학식 tCi=i*K/(2*(2N+1))에 의하여 계산하는 단계로서, 상기 지연클락(tCi)의 수는, 상기 호스트 디바이스로부터 발생되는 신호가 상기 제i 클라이언트 디바이스에 도달하는 동안에, 진행될 수 있는 상기 기준클락의 최대 클락수인 상기 지연클락의 수를 계산하는 단계를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템의 구동방법.
  15. 호스트 디바이스 및 N개 클라이언트 디바이스들, 구동 시스템 버스를 포함하는 멀티 디바이스 시스템의 구동방법으로서, 상기 N개의 클라이언트 디바이스들은 상기 구동 시스템 버스를 통하여 상기 호스트 디바이스로부터의 데이터를 순서적으로 전송하는 상기 멀티 디바이스 시스템의 구동방법에 있어서,
    상기 호스트 디바이스와 상기 N개의 클라이언트 디바이스을 데이지 체인으로 형성하기 위하여, 상기 호스트 디바이스로부터 맨 마지막의 클라이언트 디바이스에서의 구동출력단과 상기 호스트 디바이스의 입력단 사이에 체인 버스를 설치하는 단계로서, 상기 구동출력단은 상기 구동 시스템 버스 상의 신호를 출력하는 상기 체인 버스를 설치하는 단계;
    상기 호스트 디바이스가 특정되는 단자의 신호의 오실레이션 주기(tOSC)를 인식하는 단계; 및
    상기 호스트 디바이스가 i번째 클라이언트 디바이스까지의 전송지연시간(tDi)를 수학식 tDi=i*tOSC/(2*(N+1))에 의하여 지연시간을 계산하는 단계를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템의 구동방법.
  16. 호스트 디바이스 및 N개 클라이언트 디바이스들, 구동 시스템 버스 및 응답 시스템 버스를 포함하는 멀티 디바이스 시스템의 구동방법으로서, 상기 N개의 클라이언트 디바이스들은 상기 구동 시스템 버스를 통하여 상기 호스트 디바이스로부터의 데이터를 순서적으로 전송하는 상기 멀티 디바이스 시스템의 구동방법에 있어서,
    상기 호스트 디바이스와 상기 N개의 클라이언트 디바이스을 데이지 체인으로 형성하기 위하여, 상기 호스트 디바이스로부터 맨 마지막의 클라이언트 디바이스에서의 구동출력단과 상기 호스트 디바이스의 입력단 사이에 체인 버스를 설치하는 단계로서, 상기 구동출력단은 상기 구동 시스템 버스 상의 신호를 출력하는 상기 체인 버스를 설치하는 단계;
    상기 구동 시스템 버스의 신호를 K배 체배하도록 셋팅하여, 상기 제i 클라이언트 디바이스의 기준클락을 발생하는 단계; 및
    상기 호스트 디바이스가 상기 제i 클라이언트 디바이스의 지연클락(tCi)의 수를 수학식 tCi=i*K/(2*(N+1))에 의하여 계산하는 단계로서, 상기 지연클락(tCi)의 수는, 상기 호스트 디바이스로부터 발생되는 신호가 상기 제i 클라이언트 디바이스에 도달하는 동안에, 진행될 수 있는 상기 기준클락의 최대 클락수인 상기 지연클락의 수를 계산하는 단계를 구비하는 것을 특징으로 하는 멀티 디바이스 시스템의 구동방법.
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