KR100443134B1 - Pdp의구동방법 - Google Patents

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Abstract

본 발명은 배경 휘도를 저감해서 콘트래스트를 높이는 것을 목적으로 하는 PDP 구동 방법을 제공한다.
행방향으로 뻗어 유전체층으로 덮인 전극(X, Y) 끼리에 의해서 면방전을 발생시키는 구조의 AC형 PDP에 의한 매트릭스 표시를 할 때에, 각 행을 획정하는 상기 전극쌍을 열방향에서의 적어도 한쪽에는 다른 군의 전극쌍이 인접하도록 제 1 및 제 2의 군으로 분류하고, 소거 어드레싱에 앞서서 화면의 전체를 대전시키는 처리로서, 제 1 및 제 2군 중의 한 쪽에 속하는 전극쌍에 대해서는 비대전 상태의 셀에서만 방전을 발생시키기 위한 제 1 전압(Prx, Pry) 및 모든 셀에서 방전을 발생시키기 위한 제 2 전압(Prs)을 차례로 인가하고, 상기 제 1 및 제 2군 중의 다른 쪽에 속하는 전극쌍에 대해서는 상기 제 2 전압(Prs)만을 인가한다.

Description

ＰＤＰ의 구동 방법
본 발명은 면방전 구조의 AC형 PDP(Plasma Display Panel:플라즈마 디스플레이 패널)의 구동 방법에 관한 것이다.
고정세의 AC형 PDP로 텔레비젼 등의 풀모션 동화 표시를 실현하기 위해서는 소위 소거 어드레싱을 행하는 구동 방법의 채용이 바람직하다. 기입 어드레싱보다도 고속성이 뛰어나기 때문이다.
컬러 표시 디바이스인 3전극 면방전 구조의 AC형 PDP가 상품화되어 있다. 이것은 매트릭스 표시의 행(라인)마다 점등 유지를 위한 한 쌍의 주전극이 배치되고, 열마다 어드레스 전극이 배치된 것이다. AC형이므로 표시를 할 때에는 주 전극을 덮는 유전체층의 메모리 기능이 이용된다. 즉, 표시 내용에 따른 대전 상태를 형성하는 어드레싱을 행하고, 그후에 모든 주전극쌍에 대해서 일제히 교번 극성의 점등 유지 전압 Vs를 인가한다. 이에 따라, 벽전하가 존재하는 셀에서만 실효 전압(셀 전압이라고도 함) Veff가 방전 개시 전압 Vf을 초과하여 기판면에 따른 면방전이 발생한다.
시계열 화상의 표시를 행할 때에는 어떤 화상의 점등 유지의 종료로부터 다음 화상의 어드레싱까지의 기간에 표시의 교란을 방지하기 위해서 화면 전체의 대전 상태를 균일화할 필요가 있다. 따라서 점등이 불필요한 셀 벽전하를 소거하는 어드레싱 형식의 경우에는 어드레싱에 앞서 화면 전체를 균등하게 대전시키게 된다.
종래에는 화면의 각 행을 획정하는 모든 주전극쌍에 대해서 방전 개시 전압Vf을 넘는 기입 전압을 일제히 인가함으로써 화면 전체에 벽전하가 형성되었다. 잔류 벽전하가 실효 전압 Veff를 강하시키도록 기입 전압의 극성을 선정하면 이전의 어드레싱에서 벽전하가 소거된 셀에서만 선택적으로 방전이 발생한다. 그리고, 새로 형성된 벽전하 또는 잔류하고 있는 벽전하를 이용해서 전체 셀에서 방전을 발생시키면 대전 분포를 보다 균등화할 수가 있다.
상술한 바와 같이 소거 어드레싱을 행하면, 어드레싱의 소요 시간을 기입 어드레싱의 경우보다도 짧게 할 수가 있다. 구체적으로는, 기입 어드레싱의 경우에는 충분한 전하를 대전시키기 위해서 1라인당 3.7μs 정도의 시간을 요하지만, 소거 어드레싱의 경우에는 전하를 소실시키기만 하면 되므로 1라인당 1.5μs 정도가 된다.
그러나 소거 어드레싱에서는 그 준비 처리인 화면 전체의 전하 형성시에 비대전 상태의 셀에서 기입 전압의 인가에 따른 강한 방전이 발생한다. 따라서, 특히 전체적으로 어두운 화상을 표시할 때에 화면의 태반을 점하는 배경 부분이 밝게 보여 콘트라스트가 저하하는 문제가 있었다. 비교적 밝은 화상의 경우에는 어드레싱 준비시의 불필요 발광은 그다지 눈에 띄지 않는다.
본 발명은 배경 휘도를 저감해서 콘트라스트를 높이는 것을 목적으로 하고 있다.
도 1은 본 발명에 따른 플라즈마 표시 장치의 구성도.
도 2는 PDP의 내부 구조를 나타내는 사시도.
도 3은 필드 구성과 기본의 구동 시퀀스를 나타내는 도면.
도 4는 본 발명에 따른 어드레싱 준비의 기본 개념을 나타내는 전압 파형도.
도 5는 전극쌍의 분류의 일례를 나타내는 도면.
도 6은 전극쌍의 분류의 다른 예를 나타내는 도면.
도 7은 구동 시퀀스를 나타내는 전압 파형도.
도 8은 구동 파형의 변형례를 나타내는 도면.
(부호의 설명)
1 PDP 17 유전체층
X, Y 서스테인 전극(전극) SC 화면
C 셀 12 전극쌍(전극의 쌍)
Q1, Q2 군 Prx, Pry 전압 펄스(제 1 전압)
Prs, Prs1 전압 펄스(제 2 전압)
본 발명에서는 일부의 행에 대해서는 전압의 인가에 의해서가 아니라 인접하는 행의 방전으로 생긴 공간 전하를 이용해서 방전을 발생시키므로, 소거 어드레싱에 앞선 화면 전체의 대전 과정에서의 방전 총수를 저감시킨다.
청구항 1의 발명의 방법은, 행방향으로 뻗어 유전체층으로 덮인 전극 끼리에 의해서 면방전을 발생시키는 구조의 AC형 PDP에 의한 매트릭스 표시를 할 때에, 화면의 전체를 대전시킨 후에 점등이 불요한 셀의 벽전하를 소거하는 어드레싱을 행하는 PDP의 구동 방법에 있어서, 각 행을 획정하는 상기 전극쌍을 열방향의 적어도 한쪽에는 다른 군의 전극쌍이 인접하도록 제 1 및 제 2 군으로 분류하고, 상기 어드레싱에 앞서서 상기 화면의 전체를 대전시키는 처리로서, 상기 제 1 및 제 2 군 중의 한 쪽에 속하는 전극쌍에 대해서는 비대전 상태의 셀에서만 방전을 발생시키기 위한 방전 개시 전압 이상의 제 1 전압 및 모든 셀에서 방전을 발생시키기 위한 방전 개시 전압 이하의 제 2 전압을 차례로 인가하고, 상기 제 1 및 제 2 군 중의 다른 쪽에 속하는 전극쌍에 대해서는 상기 제 2 전압만을 인가하는 것이다.
청구항 2의 발명의 구동 방법은 열방향의 일단측으로부터 홀수 번째의 상기 전극의 쌍을 상기 제 1 군으로 분류하고, 짝수 번째의 상기 전극의 쌍을 상기 제 2 군으로 분류하는 것이다.
청구항 3의 발명의 구동 방법은 상기 제 1 및 제 2군 중의 상기 제 1 전압을 인가하는 군과 인가하지 않는 군을 주기적으로 전환하는 것이다.
청구항 4의 발명의 구동 방법은 상기 제 1 전압을 인가하는 군에 속하는 전극쌍끼리의 사이에 다른 군에 속하는 2개의 전극쌍이 배열되도록 상기 전극의 쌍을 분류하는 것이다.
청구항 5의 발명의 구동 방법은 상기 제 1 전압을 인가하지 않는 전극쌍에 대해서는 다른 전극쌍보다도 상기 제 2 전압의 값을 크게 하는 것이다.
청구항 6의 발명의 구동 방법은 상기 제 1 전압을 인가하지 않는 전압대에 대해서는 다른 전극쌍보다도 조기에 상기 제 2 전압을 인가하는 것이다.
(발명의 실시예)
도 1은 본 발명에 의한 플라즈마 표시 장치(100)의 구성도이다.
플라즈마 구성 장치(100)는 매트릭스 형식의 컬러 표시 디바이스인 AC형 PDP(1)과 화면(스크린)(SC)을 구성하는 종횡으로 배열한 셀(C)을 선택적으로 점등시키기 위한 구동 유닛(80)으로 구성되어 있고, 벽걸이식 텔레비전 수상기, 컴퓨터 시스템의 모니터 등으로서 이용된다.
PDP(1)는 쌍을 이루는 제 1 및 제 2의 주전극인 서스테인 전극(X, Y)이 평행 배치되고, 셀(C)에서 서스테인 전극(X, Y)과 제 3의 전극인 어드레스 전극(A)이 교차하는 면방전 구조의 PDP이다. 서스테인 전극(X, Y)은 화면의 행방향(수평 방향)으로 뻗고, 한쪽 서스테인 전극(Y)은 어드레싱을 할 때에 행단위로 셀(C)을 선택하기 위한 스캔 전극으로서 이용된다. 어드레스 전극(A)은 열방향(수직 방향)으로 뻗어있고, 열단위로 셀(C)을 선택하기 위한 데이터 전극으로써 이용된다. 서스테인 전극군과 어드레싱 전극군이 교차하는 영역이 표시 영역, 즉 화면(SC)이다.
구동 유닛(80)은 컨트롤러(81), 프레임 메모리(82), 데이터 처리 회로(83), 서브필드 메모리(84), 전원 회로(85), X 드라이버(87), Y 드라이버(88) 및 어드레스 드라이버(89)를 갖고 있다. 구동 유닛(80)에는 TV 튜너, 컴퓨터 등의 외부장치로부터 R, G, B의 각색의 휘도 레벨(계조 레벨)을 나타내는 화소 단위의 필드 데이터(DF)가 각종의 동기 신호와 함께 입력된다.
필드 데이터(DF)는 프레임 메모리(82)에 일단 저장된 후에 데이터 처리 회로(83)로 보내진다. 데이터 처리 회로(83)는 후술하는 바와 같이 필드를 소정수의 서브 필드로 분할해서 계조 표시를 행하기 위한 데이터 변환 수단이고, 필드 데이터(DF)에 따른 서브필드 데이터(DSF)를 출력한다. 서브필드 데이터(DSF)는 서브필드 메모리(84)에 저장된다. 서브필드 데이터(DSF)의 각 비트의 값은 서브필드에서의 셀의 점등의 필요 여부를 나타내는 정보, 엄밀하게는 어드레스 방전의 필요 여부를 나타내는 정보이다.
X 드라이버(87)는 서스테인 전극(X)에 구동 전압을 인가하고, Y 드라이버(88)는 서스테인 전극(Y)에 구동 전압을 인가한다. 어드레스 드라이버(89)는 어드레스 전극(A)에 구동 전압을 인가한다. 이들 드라이버에는 전원 회로(85)로부터 소정의 전력이 공급된다.
도 2는 PDP의 내부 구조를 나타내는 사시도이다.
PDP(1)에서는 전면측의 유리 기판(11)의 내면에 행(L)마다 1쌍씩 서스테인 전극(X, Y)이 배열되어 있다. 행(L)은 화면에서의 수평 방향의 셀열이다. 서스테인 전극(X, Y)은 각각이 투명 도전막(41)과 금속막(버스 도체)(42)으로 이루어지고, 저융점 유리로 된 두께 30㎛ 정도의 유전체층(17)으로 피복되어 있다. 유전체층(17)의 표면에는 마그네시아(MgO)로 이루어진 두께 수천 옹스트롬의 보호막(18)이 형성되어 있다. 어드레스 전극(A)은 배면측의 유리 기판(21)의 내면을 덮는 하지층(22) 상에 배열되어 있고, 두께 10㎛ 정도의 유전체층(24)으로 피복되어 있다. 유전체층(24) 상에는 높이 150㎛의 평면시(平面視) 직선띠 형상의 격벽(29)이 각 어드fp스 전극(A) 사이에 1개씩 설치되어 있다. 이들 격벽(29)에 의해서 방전 공간(30)이 행방향으로 서브픽셀(단위 발광 영역)마다 구획되고, 또한 방전 공간(30)의 간극 치수가 규정되어 있다. 그리고, 어드레스 전극(A)의 위쪽 및 격벽(29)의 측면을 포함해서 배면측의 내면을 피복하도록 컬러 표시를 위한 R, G, B 3색의 형광체층(28R, 28G, 28B)이 형성되어 있다. 방전 공간(30)에는 주성분인 네온에 크세논을 혼합한 방전 가스가 충전되어 있고, 형광체층(28R, 28G, 28B)은 방전시에 크세논이 방사하는 자외선에 의해서 국부적으로 여기되어 발광한다. 표시의 1 픽셀(화소)은 행방향으로 배열된 3개의 서브픽셀로 구성된다. 각 서브픽셀 내의 구조체가 셀(표시 소자)(C)이다. 격벽(29)의 배치 패턴이 스트라이프 패턴이므로, 방전 공간(30) 중의 각 열에 대응한 부분은 전체 행(L)에 걸쳐서 열방향으로 연속하고 있다.
이하, 플라즈마 표시 장치(100)에서의 PDP(1)의 구동 방법을 설명한다.
도 3은 필드 구성과 기본의 구동 시퀀스를 나타내는 도면이다.
예를 들어 텔레비전 영상의 표시에 있어서는 2치의 점등 제어에 의해서 계조 재현을 행하기 위해서, 입력 화상인 시계열의 각 필드(f)(부호의 첨자는 표시 순위를 표시함)를 예를 들어 8개의 서브프레임 sf1, sf2, sf3, sf4, sf5, sf6, sf7, sf8로 분할한다. 바꾸어 말하면 프레임(F)을 구성하는 각 필드(f)를 8개의 서브프레임(sf1∼sf8)의 집합으로 치환한다. 단, 컴퓨터 출력 등의 논인터레이스형식(non-interlaced type)의 화상을 재생하는 경우에는 각 프레임을 8분할한다. 그리고, 이들 서브필드(sf1∼sf8)에서의 휘도의 상대 비율이 1: 2: 4: 8: 16: 32: 64: 128이 되도록 웨이팅을 해서 각 서브필드(sf1∼sf8)의 서스테인 방전 회수를 설정한다. 서브필드 단위의 점등/비점등의 조합으로 RGB의 각색마다 256단계의 휘도 설정을 행할 수가 있으므로, 표시 가능한 색의 수는 2563이 된다. 또한, 서브필드(sf1∼sf8)를 휘도의 웨이트 순으로 표시할 필요는 없다. 예를 들어 웨이트가 큰 서브필드(sf8)를 표시 기간의 중간에 배치하는 식으로 최적화를 행할 수가 있다.
각 서브필드(sf1∼sf8)에 할당하는 서프필드 기간(Tsf)은 화면 전체를 균일하게 대전시키는 어드레싱 준비 기간(TR), 소거 어드레싱을 행하는 기간(TA) 및 계조 레벨에 따른 휘도를 확보하기 위해서 점등 상태를 유지하는 서스테인 기간(TS)으로 이루어진다. 각 서프필드 기간(Tsf)에 있어서, 어드레싱 준비 기간(TR) 및 어드레스 기간(TA)의 길이는 휘도의 웨이트에 상관없이 일정하지만, 서스테인 기간(Ts)의 길이는 휘도의 웨이트가 클수록 길다. 즉 1개의 필드(f)에 대응하는 8개의 서브필드 기간(Tsf)의 길이는 서로 다르다.
어드레싱 준비 기간(TR)에 있어서는, 기본적으로는 서스테인 전극(X)에 정극성의 전압 펄스(Pr)를 인가하는 제 1 과정과, 서스테인 전극(X)에 정극성의 전압 펄스(Prx)를 인가하고 또한 서스테인 전극(Y)에 부극성의 전압 펄스(Pry)를 인가하는 제 2 과정에 의해서 1개 전의 서브필드에서 점등한 "전회 점등 셀" 및 점등하지 않았던 "전회 점등 셀"에 소정의 극성의 벽전하가 형성된다. 또한, 제 1 과정에서는 어드레스 전극(A)을 50∼120V 정도의 정전위로 바이어스하여, 어드레스 전극(A)과 서스테인 전극(X) 사이의 불필요한 방전을 방지한다. 제 2 과정에 이어서, 대전의 균일성을 높이기 위해 서스테인 전극(Y)에 정극성의 전압 펄스(Prs)를 인가해서 전체 셀에서 면방전을 발생시킨다. 이 면방전에 의해서 대전 극성은 반전한다. 그 후, 전하의 소실을 피하기 위해 서스테인 전극(Y)의 전위를 소정치까지 완만하게 저감시킨다.
어드레스 기간(TA)에 있어서는, 선두의 행으로부터 1행씩 차례로 각 행을 선택하고, 해당하는 서스테인 전극(Y)에 부극성의 스캔 펄스(Py)를 인가한다. 행의 선택과 동시에 비점등으로 해야 할 셀(금회 비점등 셀)에 대응한 어드레스 전극(A)에 대해서 정극성의 어드레스 펄스(Pa)를 인가한다. 선택된 행에서의 어드레스 펄스(Pa)가 인가된 셀에서는, 서스테인 전극(Y)과 어드레스 전극(A) 사이에 대향 방전이 일어나서 유전체층(17)의 벽전하가 소실된다. 어드레스 펄스(Pa)의 인가 시점에서는 서스테인 전극(X)의 근방에 정극성의 벽전하가 존재하므로, 그 벽전압으로 어드레스 펄스(Pa)가 소거되고, 서스테인 전극(X)과 어드레스 전극(A) 사이에는 방전이 발생하지 않는다. 이러한 소거 어드레싱은 기입 어드레싱과 달라서 전하의 재형성이 불필요하므로 고속화에 적합하다.
서스테인 기간(TS)에 있어서는, 불요한 방전을 방지하기 위해서 모든 어드레스 전극(A)을 정극성의 전위로 바이어스하고, 최초에 모든 서스테인 전극(X)에 정극성의 서스테인 펄스(Ps)를 인가한다. 그 후, 서스테인 전극(Y)과 서스테인 전극(X)에 대해서 교대로 서스테인 펄스(Ps)를 인가한다. 본 실시예에서는, 최종의서스테인 펄스(Ps)는 서스테인 전극(Y)에 인가된다. 서스테인 펄스(Ps)의 인가에 의해서 어드레스 기간(TA) 중에 벽전하가 잔류된 셀(금회 점등 셀)로 표시를 위한 면방전이 발생한다.
각 펄스의 파고치 및 펄스 폭의 일례를 표 1에 나타낸다.
도 4는 본 발명에 따른 어드레싱 준비의 기본 개념을 나타내는 전압 파형도이다. 동 도에서의 벽전압(Vwall) 및 실효 전압(Veff)의 극성은 서스테인 전극(Y)의 전위를 기준으로 해서 본 것이다.
어드레싱 준비 기간(TR)의 개시 시점에서, 전회 점등 셀에는 점등 유지 면방전으로 생긴 벽전하가 잔존하고 있다. 그 극성은, 상술한 대로 서스테인 기간에서의 최종 서스테인 펄스(Ps)가 서스테인 전극(Y)에 인가되므로, 서스테인 전극(X)측이 정극성이고, 서스테인 전극(Y)측이 부극성이다. 따라서, 전회 점등 셀에서는 서스테인 전극 사이(주전극 사이)에 정의 벽전압(Vwall)이 인가되어 있다. 한편, 전회 비점등 셀에서는 이전의 어드레싱으로 벽전하가 소거되어 있으므로, 벽전압(Vwall)은 0이다.
서스테인 전극(X)에 파고치가 서스테인 펄스(Ps)와 같거나 그에 가까운 전압 펄스(Pr)를 인가하면, 전회 점등 셀의 실효 전압(Veff)은 도면 중에 실선으로 나타낸 바와 같이 방전 개시 전압(Vf)을 초과한다. 이 때문에, 전회 점등 셀에서는 면방전이 생겨서, 전하가 일단 소실한 후에 재형성되고, 벽전압(Vwall)의 극성이 반전한다. 전회 비점등 셀에서는, 도면 중에 파선으로 나타낸 바와 같이, 실효 전압(Veff)이 방전 개시 전압(Vf)을 초과하지 않으므로, 방전은 발생하지 않고, 비대전 상태가 유지된다.
이어서, 인가 전압이 점등 유지 전압(서스테인 펄스(Ps)의 파고치(Vs))의 2배 정도가 되도록 파고치가 설정된 서로 극성이 다른 전압 펄스(Prx, Pry)를 인가하면, 전회 비점등 셀에서 실효 전압(Veff)이 방전 개시 전압(Vf)을 넘어서 면방전이 발생한다. 이에 따라, 전회 비점등 셀에 전회 점등 셀과 동일한 부의 벽전압(Vwall)이 인가된다. 이 때에 인가하는 전압이 본 발명의 제 1 전압이다. 한편, 전회 점등 셀에서는 벽전압(Vwall)이 인가 전압을 강하시키므로, 실효 전압(Veff)이 방전 개시 전압(Vf)을 초과하지 않는다. 따라서 전회 점등 셀의 대전 상태가 유지된다. 즉, 전회 점등 셀과 전회 비점등 셀이 마찬가지로 대전한 상태가 형성된다. 단, 대전량에 약간의 차이가 생기는 경우가 있으므로(통상은 전회 비점등 셀 쪽이 많음), 대전량을 고르게 하기 위해서 전압 펄스(Prs)를 인가해서 전회점등 셀 및 전회 비점등 셀의 양쪽에서 면방전을 발생시킨다. 이 전압 펄스(Prs)가 본 발명의 제 2 전압에 상당한다.
이와 같이 3단계의 처리로 화면 전체를 대전시킴으로써, 균일한 대전 분포가 얻어지고, 어드레싱의 신뢰성이 높아진다. 그러나, 모든 셀에 대해서 일률적으로 전압 펄스(Prx, Pry)를 인가해서 비대전 상태의 전회 비점등 셀에서 방전을 발생시키면 배경 휘도가 높아지고 만다. 따라서, 플라즈마 표시 장치(1)에서는 화면의 각 행(L)이 2개의 군으로 분류되고, 한쪽의 군에 속하는 행(L)을 획정하는 서스테인 전극(X, Y)의 쌍(이하 전극쌍이라고 함)에 대해서만 전압 펄스(Prx, Pry)가 인가된다.
도 5는 전극쌍(12)의 분류의 일례를 나타내는 도면이다.
행마다 배치된 전극쌍(12)(첨자는 배열 순위를 나타냄) 중의 배열 방향(화면의 열방향)의 일단측으로부터 헤아린 홀수 번째의 전극쌍(12)은 제 1군(Q1)으로 분류되고, 짝수 번째의 전극쌍(12)은 제 2군(Q2)으로 분류되어 있다. 이 분류 형태에서는 배열의 양단을 제외한 전극쌍(12)에 주목하면 양측에 다른 군에 속하는 전극쌍(12)이 인접한다. 예를 들어 도면 중에 검은 원으로 표시한 홀수 번째의 행의 셀에서 방전이 발생하면 공간 전하가 열방향으로 확산되고(띠상 격벽에서는 열방향으로 연장되는 가늘고 긴 방전 공간을 형성하고, 그 방전 공간 내에 각 행의 같은 순위의 셀이 배열되어 있기 때문), 프라이밍 효과로 짝수 번째의 행의 방전 개시 전압이 강하한다. 즉, 짝수 번째의 행에 전압 펄스(Prx, Pry)를 인가하지 않았다 해도, 상기 프라이밍 효과의 유효 시간내이면 제 3단계의 전압 펄스(Prs)의 인가에의해 전회 비점등 셀에서 면방전이 발생한다. 또한, 인접 셀이 전회 점등 셀인 경우에 전압 펄스(Pr)에 의한 방전 프라이밍 효과에 기여한다.
도 6은 전극쌍(12)의 분류의 다른 예를 나타내는 도면이다.
행마다 배치된 전극쌍(12) 중의 열방향의 일단측으로부터 (2+3m) 번째(m= 1 이상의 정수)의 전극쌍(12)은 제 1군(Q1)으로 분류되고, 다른 전극쌍(12)은 제 2군(Q2)으로 분류되어 있다. 이 분류 형태에서는, 제 1군(Q1)의 전극쌍(12)에 주목하면 양측에, 제 2군(Q2)의 전극쌍(12)에 주목하면 편측에 다른 군에 속하는 전극쌍(12)이 인접한다. 어떤 군(Q1, Q2)에 전압 펄스(Prx, Pry)를 인가해도 좋지만, 프라이밍 효과의 균일화 측면에서 제 1군(Q1)에 전압 펄스(Prx, Pry)를 인가하는 방전이 유리하다.
도 7은 구동 시퀀스를 나타내는 전압 파형도이다.
도 7의 예에서는 도 5의 분류 형태가 적용되어 있다. 어떤 필드(f)에서 제 1군(Q1)에 속하는 홀수 번째의 서스테인 전극(Y(1), Y(3)…)에 전압 펄스(Pry)가 인가되고, 제 2군(Q2)에 속하는 짝수 번째의 서스테인 전극(Y(2), Y(4)…)에는 전압 펄스(Pry)가 인가되지 않는다. 전압 펄스(Prx)는 모든 서스테인 전극 X(1∼N)에 인가되지만, 전압 펄스(Prx)만으로는 방전은 생기지 않는다. 다음의 필드(f)에서는 짝수 번째의 서스테인 전극(Y(2), Y(4)…)에 전압 펄스(Pry)가 인가되고, 홀수 번째의 서스테인 전극(Y(1), Y(3)…)에는 전압 펄스(Pry)가 인가되지 않는다. 즉, 필드(f)마다 전압 펄스(Pry)의 인가 대상이 전환된다. 이에 따라. 방전 미스가 일정의 행에 집중적으로 생기는 것을 막을 수가 있다. 또한, 전환의 주기는 임의이고,예를 들어 서브필드마다 전환해도 좋다.
도 8은 구동 파형의 변형례를 나타내는 도면이다.
도 8a의 예에서는, 한쪽의 군(예를 들어 제 2군(Q2))에 속하는 전극쌍(12)에 대해서는 전압 펄스(Prx) 및 전압 펄스(Pry)의 인가가 생략되고, 다른 쪽의 군(예를 들어 제 1군(Q1)에 속하는 전극쌍(12)에 인가하는 전압 펄스(Prs)보다도 파고치가 큰 전압 펄스(Prs1)가 인가된다. 파고치를 크게 하면 방전 확률이 증대하므로, 전압 펄스(Prx, Pry)의 인가를 생략해도 전회 비점등 셀에서 확실하게 방전이 발생한다.
도 8b의 예에서는, 한 쪽군(예를 들어 제 2군(Q2))에 속하는 전극쌍(12)에 대해서는, 전압 펄스(Prx) 및 전압 펄스(Pry)의 인가가 생략되고, 다른 쪽의 군(예를 들어 제 1군(Q1)에 속하는 전극쌍(12)에 인가하는 전압 펄스(Prs)보다도 일정 시간 t1 만큼 앞당기어 전압 펄스(Prs1)가 인가된다. 단, 그 인가는 프라이밍 효과를 최대한으로 이용하기 위해서, 전압 펄스(Prx, Pry)에 의한 방전으로 충분한 공간 전하가 생기는 시기에 행하여진다. 이 경우에도 방전 확률이 증대하므로, 전압 펄스(Prx, Pry)의 인가를 생략하여도 전회 비점등 셀에서 확실하게 방전이 발생한다.
상술한 실시 형태에서는, 어드레스 전극에 의한 형광체의 열화를 경감하기 위해서 어드레스 펄스(Pa)를 정극성으로 정해서 다른 펄스의 극성을 설정하고, 또 한쪽의 서스테인 전극에만 정극성의 서스테인 펄스를 인가하도록 해서 구동 회로를 간단화한 예를 들었지만, 이것에 한정되는 것은 아니다. 즉, 인가 전압의 극성의변경이 가능하다. 전하 형성에 관한 제 2 과정의 전압 펄스(Prx, Pry)에 대해서는 파고치의 할당은 임의이지만, 회로 구성 상에서는 예시한 대로 동등하게 할당하여 Vs와 -Vs의 조합으로 하는 것이 유리하다. 또한, 전압 펄스(Prx, Pry)의 인가와 같이 방전 개시 전압(Vf)을 초과하는 소위 기입 전압을 인가할 때에 전회 비점등 셀뿐만 아니라 전회 점등 셀에서도 방전을 발생시키는 것이 좋다. 이 경우에는 잔류 전하의 유무에 의존한 대전의 불균일이 생기기 쉽지만 전압 펄스(Prx, Pry)의 인가를 생략해도 생략한 셀의 인접 셀이 전회 비점등 셀이든 전회 점등 셀이든 동일한 프라이밍 효과를 기대할 수가 있다.
청구항 1 내지 청구항 6의 발명에 의하면 배경 휘도를 저감해서 콘트라스트를 높일 수가 있다.

Claims (6)

  1. 행방향으로 연장되고 유전체층으로 덮인 전극끼리에 의해서 면방전을 발생시키는 구조의 AC형 PDP에 의한 매트릭스 표시를 행할 때에, 화면 전체를 대전시킨 후에 점등이 불요한 셀의 벽전하를 소거하는 어드레싱을 행하는 PDP 구동 방법에 있어서,
    각 행을 획정하는 상기 전극의 쌍을 열방향에서의 적어도 한쪽에는 다른 군의 전극쌍이 인접하도록 제 1 및 제 2 군으로 분류하고,
    상기 어드레싱에 앞서서 상기 화면의 전체를 대전시키는 처리로서, 상기 제 1 및 제 2군 중의 한 쪽에 속하는 전극쌍에 대해서는 비대전 상태의 셀에서만 방전을 발생시키기 위한 방전 개시 전압 이상의 제 1 전압 및 모든 셀에서 방전을 발생시키기 위한 방전 개시 전압 이하의 제 2 전압을 차례로 인가하고, 상기 제 1 및 제 2 군 중의 다른 쪽에 속하는 전극쌍에 대해서는 상기 제 2 전압만을 인가하는
    것을 특징으로 하는 PDP 구동 방법.
  2. 제1항에 있어서, 열방향의 일단측으로부터 홀수 번째의 상기 전극의 쌍을 상기 제 1 군으로 분류하고, 짝수 번째의 상기 전극의 쌍을 상기 제 2 군으로 분류하는 것을 특징으로 하는 PDP 구동 방법.
  3. 제2항에 있어서, 상기 제 1 및 제 2군 중의 상기 제 1 전압을 인가하는 군과인가하지 않는 군을 주기적으로 전환하는 것을 특징으로 하는 PDP 구동 방법.
  4. 제1항에 있어서, 상기 제 1 전압을 인가하는 군에 속하는 전극쌍끼리의 사이에 다른 군에 속하는 2개의 전극쌍이 배열되도록 상기 전극쌍을 분류하는 것을 특징으로 하는 PDP 구동 방법.
  5. 제1항 내지 제4항 중 어느 한 항에 있어서, 상기 제 1 전압을 인가하지 않는 전극쌍에 대해서는 다른 전극쌍보다도 상기 제 2 전압의 값을 크게 하는 것을 특징으로 하는 PDP 구동 방법.
  6. 제1항 내지 제4항 중 어느 한 항에 있어서, 상기 제 1 전압을 인가하지 않는 전압쌍에 대해서는 다른 전극쌍보다도 조기에 상기 제 2 전압을 인가하는 것을 특징으로 하는 PDP 구동 방법.
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