KR20010037563A - 플라즈마 디스플레이 패널 및 그 구동방법 - Google Patents

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Abstract

본 발명은 고속 어드레싱을 통해 화면의 휘도를 향상시킬 수 있도록 하는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
본 발명에서는 어드레스 방전시 데이터 전극과 나란하게 형성된 보조 전극에 프라이밍 방전 펄스를 공급하여 데이터 전극과 보조 전극 간에 프라이밍 방전을 일으킨다.
이에 따라, 어드레스 방전시 어드레스 방전 펄스의 펄스폭과 전압을 감소시키더라도 프라이밍 방전에 의해 하전입자들이 충분히 생성된다. 어드레스 방전 펄스의 펄스폭을 단축시킬 수 있으므로 각 서브필드 별로 어드레스 기간이 종래에 비해 두 배 이상 획기적으로 단축될 수 있고, 그 만큼 서스테인 기간이 늘어나 화면의 휘도가 크게 향상된다.

Description

플라즈마 디스플레이 패널 및 그 구동방법{Plasma Display Panel and Method of Driving the Same}
본 발명은 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것으로, 특히 고속 어드레싱을 통해 화면의 휘도를 향상시킬 수 있도록 하는 플라즈마 디스플레이 패널 및 그 구동방법에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 함)은 가스방전에 의해 발생되는 자외선이 형광체를 여기시킬 때 형광체로부터 가시광선이 발생되는 것을 이용한 표시장치이다. PDP는 지금까지 표시수단의 주종을 이루어왔던 음극선관(Cathode Ray Tube : CRT)에 비해 두께가 얇고 가벼우며, 고선명 대형화면의 구현이 가능하다는 점등의 장점이 있다. PDP는 매트릭스 형태로 배열된 다수의 방전셀들로 구성되며, 하나의 방전셀은 화면의 한 화소를 이루게 된다.
도 1은 일반적인 교류 면방전 PDP의 방전셀 구조를 도시한 사시도이다. 도 1을 참조하면, 상판(20)과 하판(22)이 일정한 거리를 두고 평행하게 설치되어 있다. 상판(20)을 구성하는 상부기판(24)의 배면에는 교류 구동 신호가 공급되어 서스테인 면방전을 이루는 주사전극(26)과 방전유지전극(27)이 나란하게 형성된다. 주사전극(26) 및 방전유지전극(27)은 ITO(Indium Tin Oxide)로 투명하게 형성된 투명전극이다. 주사전극(26) 및 방전유지전극(27) 각각의 위에는 버스전극(30)이 나란하게 형성된다. ITO가 높은 저항값을 갖기 때문에 버스전극(30)을 통해 교류신호를 공급함으로써 각각의 방전셀에 균일한 전압이 인가되도록 하고 있다. 주사전극(26) 및 방전유지전극(27)이 형성된 상부기판의 배면에는 상부유전층(28)이 전면에 형성된다. 상부유전층(28)은 방전시 전하를 축적하는 기능을 갖는다. 상부유전층(28) 상에 전면 도포되는 보호층(31)은 방전시 스퍼터링으로부터 상부유전층(28)을 보호하여 화소셀의 수명을 연장시킴과 아울러 2차 전자의 방출효율을 높여 방전효율을 향상시킨다. 하판(22)을 구성하는 하부기판(32) 상에는 어드레스 방전을 위한 데이터전극(34)이 주사전극(26) 및 방전유지전극(27)과 상호 직각으로 교차되도록 형성된다. 하부기판(32)과 데이터전극(34) 상에는 방전시 벽전하 형성을 위한 하부유전층(36)이 전면 도포된다. 또한 상판(20)과 하판(22) 사이에는 격벽(42)이 수직으로 형성된다. 격벽(42)은 상판(20) 및 하판(22)과 함께 셀의 방전공간(38)을 형성하고, 이웃한 방전셀 간의 전기적, 광학적 상호 간섭을 차단한다. 하부유전층(36)과 격벽(42)의 표면에는 형광체(40)가 도포된다. 방전공간(38) 내에는 He+Xe 또는 Ne+Xe의 혼합가스가 충진된다.
교류 면방전 PDP의 전체적인 전극 라인 및 방전셀의 배치 구조는 도 2에 도시되는 바와 같다. 도 2를 참조하면, 데이터전극라인(X)과 주사전극라인(Y) 그리고 방전유지전극라인(Z)이 교차하는 부분마다 방전셀(44)이 위치하게 된다. 데이터전극라인(X)은 기수번째 라인들과 우수번째라인들로 분할되어 상하에서 구동되고 있다.
빛이 방출되는 과정을 간략히 설명하면, 주사전극(26)과 데이터전극(34) 간에 어드레스 방전이 일어나 상/하부 유전층(28,36)에 벽전하가 형성된다. 형성된 벽전하는 면방전에 필요한 방전전압을 낮추는 역할을 한다. 어드레스 방전에 의해 선택된 셀들에서는 주사전극(26)과 방전유지전극(27)에 교번적으로 공급되는 교류 신호에 의해 두 전극(26,27) 간에 서스테인 방전이 일어난다. 이 때 방전공간(38)에서는 방전가스가 여기된 후 천이되는 과정에서 자외선이 발생한다. 발생된 자외선은 형광체(40)를 여기시켜 가시광선을 발생시키게 되고, 이로써 PDP의 화상이 구현되어진다.
교류 면방전 PDP는 ADS(Addressing Display Separated : 이하 "ADS"라 함) 구동방법에 의해 화상을 표시한다. 도 3은 PDP에서 한 프레임의 계조를 표현하기 위한 ADS 구동방법을 나타내는 도면이다. 16.67ms 동안의 한 프레임은 계조에 따라 8 개의 서브필드(SF1 내지 SF8)로 시분할되어 구동된다. 각각의 서브필드들(SF1 내지 SF8)은 크게 화면 초기화 및 어드레스 방전이 수행되는 리셋 및 어드레스 기간과, 서스테인 방전이 수행되는 서스테인 기간으로 나뉘어진다. 각각의 서브필드에서 미리 설정된 리셋 및 어드레스 기간의 폭은 동일한 반면에 서스테인 기간의 폭은 서로 다르다. 서스테인 기간은 휘도 상대비에 따라 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가되도록 미리 설정된다.
도 4는 종래의 구동방법에 있어서 서브필드 별로 PDP의 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도이다. 도 4를 참조하면, 하나의 서브필드는 전화면을 초기화하는 프라이밍 및 리셋 기간, 전화면을 선순차 방식으로 주사하면서 데이터를 기입하는 어드레스 기간, 데이터가 기입된 셀들의 발광 상태를 유지시키는 서스테인 기간 및 유지방전을 소거시키는 소거 기간으로 나뉘어진다. 먼저 리셋 기간에는 방전셀들을 초기화하고, 어드레스 방전을 돕기 위해 주사전극라인(Y)과 방전유지전극라인(Z)에 인가되는 방전 펄스로 방전을 일으켜 각 방전셀들에 프라이밍 하전입자 및 벽전하를 형성시킨다. 어드레스 기간에는 PDP의 각 주사라인별 주사전극라인(Y)들에 주사펄스(-Vs)가 순차적으로 인가되고, 주사펄스에 동기되어 데이터펄스(Vd)가 각 데이터전극라인(X)에 공급된다. 이 때, 방전유지전극라인(Z)들에는 소정레벨의 직류전압이 공급되며, 이 직류전압은 데이터전극라인(X)과 주사전극라인(Y) 사이의 어드레스 방전이 안정적으로 일어날 수 있게 한다. 종래의 구동방법에 있어서 어드레스 방전을 일으키기 위한 방전펄스의 펄스폭(Td)은 2.5㎲ 이상으로 비교적 길다. 서스테인 기간에는 주사전극라인(Y)과 방전유지전극라인(Z)에 동일한 펄스폭과 전압을 갖는 서스테인 펄스(Vsus)가 교번적으로 인가되어 어드레스 방전에 의해 선택된 방전셀들에 서스테인 면방전을 일으킨다. 소거 기간에는 방전유지전극라인(Z)에 공급되는 소거펄스에 의해 하전입자들이 소멸되면서 유지방전이 소거된다.
이와 같이 구동되는 종래의 교류 면방전 PDP에서는 어드레스 방전시 안정된 방전 특성을 얻기 위하여 각 서브필드 별로 어드레스 방전 펄스폭(Td)을 2.5㎲ 이상으로 길게 하거나 방전 펄스의 전압 레벨을 크게 하는 방법을 사용하고 있다. 어드레스 방전 펄스의 전압 레벨을 낮게 하면 방전의 세기와 생성되는 하전입자의 양이 적어진다. 그리고, 어드레스 방전 펄스의 전압 레벨이 낮은 상태에서 펄스폭(Td)까지 짧게 하게 되면 PDP 고유의 특성인 방전 지연 현상에 의해 오방전이 발생할 우려가 있게 된다. 이러한 문제는 방전 펄스의 펄스폭(Td)를 길게 함으로써 해결될 수 있지만 어드레스 방전 펄스의 펄스폭(Td)을 2.5㎲ 이상으로 길게 할 경우에는 한 프레임의 기간이 16.67㎳로 고정되어 있는 상태에서 실제 화면의 밝기를 좌우하는 서스테인 기간이 한 프레임에서 차지하는 비율이 30% 이하로 떨어져 화면의 휘도가 저하되게 된다. 또한, 현재의 PDP 구동방법에서는 PDP가 가지고 있는 고유의 화질 열화 현상인 컨투어 노이즈(Contour Noise)를 줄이기 위해 한 프레임 동안의 서브필드 수를 종래의 8 개에서 10 ~ 12 개로 증가시키고 있다. 그런데 고정된 한 프레임의 기간동안 서브필드의 수가 증가하게 되면, 각 서브필드의 기간이 그만큼 짧아지게 된다. 이러한 경우에도 안정된 방전을 위해 각 서브필드 별로 어드레스 기간은 고정되고, 서스테인 기간만 짧아지게 됨으로 인해 화면의 휘도가 낮아지게 된다. 그리고 주사선수가 늘어나는 고해상도의 PDP에서는 서스테인 기간이 너무 짧아지게 되어 디스플레이 자체가 불가능해지게 된다. 고해상도 PDP에서는 주사라인의 수가 훨씬 더 많아지기 때문에 각 서브필드마다 주사라인들이 순차적으로 구동되는 어드레스 기간이 더 길어진다. 이에 따라 고정된 한 프레임의 기간동안에 서스테인 기간이 감소할 수 밖에 없어 휘도가 저하되게 된다. 이러한 문제를 해결하기 위하여 고속 어드레싱이 필요하게 되는데, 종래에는 패널의 주사라인을 상하로 분할하여 구동하는 방법을 사용하고 있다. 주사라인의 분할 구동 방식에서는 각 서브필드에서 어드레스 기간을 짧게 하기 위하여 주사라인들을 상하로 분할하고 서로 다른 두 개의 스캔 드라이버로써 상부 주사라인과 하부 주사라인을 별도로 동시에 주사하게 된다. 이로써 주사 기간 또는 어드레스 기간을 두 배로 단축시키고, 그 만큼 각 서브필드에서 서스테인 기간을 충분히 확보함으로써 화면의 휘도 저하를 방지하고 있다. 하지만, 종래의 분할 구동 방식에서는 스캔 및 데이터 드라이버 IC의 수가 두 배로 증가함으로써 PDP의 제조 원가가 상승되는 단점이 있다.
따라서, 본 발명의 목적은 고속 어드레싱을 통해 화면의 휘도를 향상시킬 수 있도록 하는 플라즈마 디스플레이 패널 및 그 구동방법을 제공함에 있다.
도 1은 종래의 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 2는 종래의 교류 면방전 플라즈마 디스플레이 패널의 전체적인 전극 라인 및 방전셀의 배치 구조를 도시한 평면도.
도 3은 플라즈마 디스플레이 패널에서 한 프레임의 계조를 표현하기 위한 ADS 구동방법을 나타낸 도면.
도 4는 종래의 플라즈마 디스플레이 패널의 구동방법에 있어서 서브필드 별로 플라즈마 디스플레이 패널의 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도.
도 5는 본 발명의 제 1 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 6은 본 발명의 제 1 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 전체적인 전극 배치 구조를 도시한 패널의 평면도.
도 7은 본 발명의 제 1 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 구동방법에 있어서 서브필드 별로 플라즈마 디스플레이 패널의 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도.
도 8a 및 도 8b는 본 발명의 제 2 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 전체적인 전극 배치 구조를 도시한 패널의 평면도.
도 9는 본 발명의 제 3 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널의 방전셀 구조를 도시한 사시도.
도 10은 본 발명의 제 1 내지 제 3 실시 예에 따른 교류 면방전 플라즈마 디스플레이 패널을 구동시키기 위한 구동 장치의 블록도.
＜ 도면의 주요 부분에 대한 부호의 설명 ＞
20,50 : 상판 22,52 : 하판
24,54 : 상부기판 26,56 : 주사전극
27,57 : 방전유지전극 28,58 : 상부유전층
30,60 : 버스전극 31,61 : 보호층
32,62 : 하부기판 34,63,64,69 : 데이터전극
36,66 : 하부유전층 38,68 : 방전공간
40,70 : 형광체 42,72 : 격벽
44,74 : 방전셀 46,104 : 플라즈마 디스플레이 패널
65,67,71 : 보조전극 100 : 영상 신호처리부
102 : 프레임 메모리 106 : 데이터 드라이버
108 : 스캔 드라이버 110 : 방전유지전극 드라이버
112 : 보조전극 드라이버 114 : 파형발생부
116 : 제어부 120 : 제 2 유전층
상기 목적을 달성하기 위하여 본 발명의 플라즈마 디스플레이 패널은 데이터 전극과 나란하게 형성됨과 아울러 어드레스 방전시 방전 펄스가 인가되어 데이터 전극과 함께 프라이밍 방전을 일으키는 보조 전극을 구비한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동방법은 어드레스 방전시 데이터 전극과 나란하게 형성된 보조 전극에 프라이밍 방전 펄스를 공급하여 데이터 전극과 보조 전극 간에 프라이밍 방전을 일으키는 단계를 포함한다.
상기 목적 외에 본 발명의 다른 목적 및 특징들은 첨부도면을 참조한 실시 예들에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 5 내지 도 10을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 5는 본 발명의 제 1 실시 예에 따른 교류 면방전 PDP의 방전셀 구조를 도시한 사시도이다. 도 5를 참조하면, 본 발명의 제 1 실시 예에 따른 교류 면방전 PDP는 데이터전극(64)과 나란한 방향으로 하부기판(62) 상에 형성된 보조전극(65)을 구비한다. 이 보조전극(65)은 어드레스 방전시 데이터전극(64)과 함께 보조방전을 일으켜 방전공간(68) 상에 충분한 프라이밍 하전입자들을 생성시켜주는 역할을 하게 된다. 보조전극(65)이 형성되는 것을 제외하고는 다른 구성 및 특징들은 도 1에 도시된 종래의 교류 면방전 PDP의 경우와 동일하다. 즉, 상판(50)을 구성하는 상부기판(54)의 배면에는 교류 구동 신호가 공급되어 서스테인 면방전을 이루는 주사전극(56)과 방전유지전극(57)이 나란하게 형성된다. 주사전극(56) 및 방전유지전극(57)은 ITO(Indium Tin Oxide)로 형성된 투명전극이다. 주사전극(56) 및 방전유지전극(57) 각각의 위에는 버스전극(60)이 나란하게 형성된다. 주사전극(56) 및 방전유지전극(57)이 형성된 상부기판(54)의 배면에는 상부유전층(58)이 전면에 형성된다. 상부유전층(58) 상의 전면에는 보호층(61)이 형성된다. 하판(52)을 구성하는 하부기판(62) 상에는 어드레스 방전을 위한 데이터전극(64)과 보조방전을 위한 보조전극(65)이 주사전극(56) 및 방전유지전극(57)과 직교하는 방향으로 나란하게 형성된다. 데이터전극(64)과 보조전극(65)이 형성된 하부기판(62) 상에는 하부유전층(66)이 전면 도포된다. 그리고 상판(50)과 하판(52) 사이에는 격벽(72)이 수직으로 형성된다. 하부유전층(66)과 격벽(72)의 표면에는 형광체(70)가 도포된다. 방전공간(38) 내에는 He+Xe 또는 Ne+Xe의 혼합가스가 충진된다.
도 6은 본 발명의 제 1 실시 예에 따른 PDP의 전체적인 전극 배치 구조를 도시한 패널의 평면도이다. 도 6을 참조하면, 데이터전극라인(X1내지Xm) 및 보조전극라인(A1내지Am)이 패널의 칼럼(Column) 방향으로 형성되어 있고, 주사전극라인(Y1내지Yn) 및 방전유지전극라인(Z1내지Zn)이 패널의 로우(Row) 방향으로 형성되어 있다. 그리고, 데이터전극라인(X1내지Xm)과 보조전극라인(A1내지Am)이 동일한 선폭으로 형성되어 있다. 데이터전극라인(X1내지Xm) 및 보조전극라인(A1내지Am)이 주사전극라인(Y1내지Yn) 및 방전유지전극라인(Z1내지Zn)과 교차하는 부분마다 방전셀(74)이 위치하게 된다. 데이터전극라인(X1내지Xm)은 패널의 상부에서 구동되고 보조전극라인(A1내지Am)은 패널의 하부에서 구동된다.
도 7은 본 발명의 제 1 실시 예에 따른 교류 면방전 PDP의 구동방법에 있어서 서브필드 별로 PDP의 각 전극 라인에 공급되는 구동 파형을 나타낸 파형도이다. 도 7을 참조하면, 하나의 서브필드는 종래의 경우와 마찬가지로 전화면을 초기화하는 프라이밍 및 리셋 기간, 전화면을 선순차 방식으로 주사하면서 데이터를 기입하는 어드레스 기간, 데이터가 기입된 셀들의 발광 상태를 유지시키는 서스테인 기간 및 유지방전을 소거시키는 소거 기간으로 나뉘어진다. 하지만 본 발명에서는 어드레스 기간 중의 어드레스 방전 시에 데이터전극라인(X)과 보조전극라인(A) 사이에 보조방전을 일으켜 방전공간(68) 내에 충분한 프라이밍 하전입자들을 생성시키게 된다. 먼저 리셋 기간에는 방전셀들을 초기화하고, 어드레스 방전을 돕기 위해 주사전극라인(Y)과 방전유지전극라인(Z)에 인가되는 방전 펄스로 방전을 일으켜 각 방전셀들에 하전입자 및 벽전하를 형성시킨다. 어드레스 기간에는 PDP의 각 주사라인별 주사전극라인(Y)들에 주사펄스(-Vs)를 순차적으로 인가하고, 주사펄스에 동기되게끔 데이터펄스(Vd)를 각 데이터전극라인(X)에 공급한다. 이 때, 데이터펄스(Vd)와 주사펄스(-Vs)가 동시에 존재하는 방전셀에서는 어드레스 방전이 일어난다. 그런데, 본 발명에서는 어드레스 방전이 일어나는 순간 데이터전극라인(X)과 평행한 보조전극라인(A)에 보조 방전펄스(-Va)를 공급한다. 보조 방전펄스(-Va)의 펄스폭(Ta)은 0.5㎲ 이하로 한다. 보조 방전펄스(-Va)가 공급된 방전셀들에서는 데이터전극라인(X)과 보조전극라인(A) 간에 보조 방전이 발생한다. 보조 방전시 방전셀의 방전공간에는 충분한 프라이밍 하전입자들이 생성되어 어드레스 방전을 돕게 된다. 이에 따라, 어드레스 방전시의 방전펄스의 펄스폭(Td)을 짧게 하고 전압 레벨을 낮추면서도 안정된 어드레스 방전 특성이 얻어지게 된다. 보조 방전을 통해 어드레스 방전 펄스의 펄스폭(Td)을 1㎲ 이하로 획기적으로 단축시킬 수 있다. 방전 펄스의 펄스폭과 전압 레벨이 크게 감소되지만 보조 방전을 통해 프라이밍 하전입자들이 충분히 생성되므로 방전 지연 현상 및 오방전 현상은 발생하지 않게 된다. 어드레스 방전 펄스의 펄스폭이 짧아짐에 따라 각 서브필드에서의 어드레스 기간이 종래에 비해 두 배 이상 크게 단축된다. 한편 본 발명에서 보조 방전펄스(-Va)는 데이터펄스(Vd)가 존재하는 방전셀들에만 공급한다. 이로써 어드레스 방전시의 보조 방전은 데이터가 기입된 방전셀들에서만 발생한다. 그리하여 보조 방전시 발생하는 미소 발광에 의해 화면의 콘트라스트가 저하되는 것을 방지한다. 또한 본 발명에서는 보조 방전이 데이터펄스(Vd)와 주사펄스(-Vs)가 동시에 존재하는 방전셀에서만 발생하게 됨으로 인해 어드레싱 에러는 발생하지 않는다. 서스테인 기간에는 주사전극라인(Y)과 방전유지전극라인(Z)에 서스테인 펄스(Vsus)가 교번적으로 인가되어 어드레스 방전에 의해 선택된 방전셀들에 서스테인 면방전을 일으킨다. 소거 기간에는 방전유지전극라인(Z)에 공급되는 소거펄스에 의해 하전입자들이 소멸되면서 유지방전이 소거된다.
한편, 본 발명에 따른 PDP에서 보조전극(65)의 위치나 선폭 등에 관련된 구조적인 특징은 도 5 및 도 6에 도시된 본 발명의 제 1 실시 예와 같은 경우에만 국한되지는 않는다. 방전 특성의 향상을 위해 보조전극(65)의 위치나 선폭 등이 가변될 수도 있다. 도 8a 및 도 8b는 본 발명의 제 2 실시 예에 따른 교류 면방전 PDP의 전체적인 전극 배치 구조를 도시한 패널의 평면도이다. 도 8a 및 도 8b를 참조하면, 본 발명의 제 1 실시 예의 경우와는 달리 패널의 칼럼 방향으로 하부기판(62) 상에 나란하게 형성되는 데이터전극라인과 보조전극라인이 서로 다른 선폭으로 형성되어진다. 도 8a에 도시된 것처럼 데이터전극라인(63)의 선폭을 보조전극라인(65)의 선폭보다 더 넓게 할 수도 있고, 도 8b에 도시된 것처럼 보조전극라인(71)의 선폭을 데이터전극라인(64)의 선폭보다 더 넓게 할 수도 있다. 그 밖에 다른 구조적인 특징들이나 그 구동방법은 본 발명의 제 1 실시 예의 경우와 동일하므로 이에 대한 설명은 생략하기로 한다. 어느 경우든지 본 발명의 제 1 실시 예의 경우보다 저전압 구동, 펄스폭 단축 및 방전 특성의 향상을 꾀할 수 있게 된다.
도 9는 본 발명의 제 3 실시 예에 따른 교류 면방전 PDP의 방전셀 구조를 도시한 사시도이다. 도 9를 참조하면, 본 발명의 제 3 실시 예에 따른 PDP에서는 보조전극(67)이 제 2 유전층(120)을 사이에 두고 데이터전극(69) 위에 나란하게 형성된다. 그리고, 보조전극(67)이 형성된 제 2 유전층(120) 상에는 하부유전층(66)이 형성된다. 보조전극(67)과 데이터전극(69)이 서로 다른 층에 형성되므로 부가적인 절연층으로서 제 2 유전층(120)이 필요하게 된다. 서로 다른 층에 나란하게 형성되는 보조전극(67)과 데이터전극(69)은 본 발명의 제 2 실시 예의 경우에서처럼 선폭이 서로 다르게 형성될 수도 있다. 데이터전극(69)의 선폭을 보조전극(67)의 선폭보다 더 넓게 할 수도 있으며, 그 반대의 경우도 가능하다. 본 발명의 제 3 실시 예에 따른 PDP에서는 제 2 유전층(120)의 두께를 적절히 조절하거나, 서로 다른 층에 형성되는 보조전극(67)과 데이터전극(69)의 폭을 조절함으로써 저전압 구동, 펄스폭 단축 및 방전 특성의 향상을 꾀할 수 있게 된다. 그 밖의 다른 구조적인 특징들이나 그 구동방법은 본 발명의 제 1 실시 예의 경우와 동일하므로 이에 대한 설명은 생략하기로 한다.
도 10은 본 발명의 제 1 내지 제 3 실시 예에 따른 교류 면방전 PDP를 구동시키기 위한 구동 장치의 블록도이다. 도 10을 참조하면, 본 발명에 따른 PDP의 구동장치는 영상 데이터를 처리하는 영상 신호처리부(100)와, 영상 신호처리부(100)에서 공급되는 영상 데이터를 프레임 단위로 저장하는 프레임 메모리(102)와, 프레임 메모리(102)에서 전송되는 영상 데이터(Vd)를 PDP(104)의 데이터전극라인(X)에 1 주사 라인분씩 순차적으로 공급하는 데이터 드라이버(106)와, 데이터 드라이버(106)에 동기되어 매 수평주기마다 주사펄스(-Vs)를 PDP(104)의 주사전극라인(Y)에 순차적으로 공급함과 아울러 서스테인 펄스(Vsus)를 공급하는 스캔 드라이버(108)와, 방전유지전극라인(Z)에 서스테인 펄스(Vsus)를 공급하는 방전유지전극 드라이버(110)와, 보조전극라인(A)에 보조 방전펄스(-Va)를 공급하는 보조전극 드라이버(112)를 구비한다. 또한 본 발명의 구동장치는 펄스 파형을 발생시켜 각 드라이버에 공급하는 파형 발생부(114)와, 각 전극라인에 공급되는 펄스의 인가 시점을 제어하기 위하여 프레임 메모리(102) 및 스캔 드라이버(108), 그리고 파형 발생부(114)를 제어하는 제어부(116)를 구비한다. 제어부(116)는 각 서브필드의 어드레스 기간 중에 데이터펄스(Vd)와 주사펄스(-Vs)가 동시에 존재하는 방전셀에서만 보조 전극 라인에 보조 방전 펄스(-Va)가 공급되게끔 파형 발생부(114) 및 보조전극 드라이버(112)를 제어하게 된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널 및 그 구동 방법에서는 방전셀 내에 데이터 전극과 나란한 방향으로 보조 전극을 나란하게 형성시키고, 어드레스 방전시 보조 전극에 방전 펄스를 인가하여 데이터 전극과 보조 전극 간에 보조 방전을 일으킨다. 보조 방전에 의해 어드레스 방전시 프라이밍 하전입자들이 충분하게 생성되므로 어드레스 방전 펄스의 펄스폭을 크게 단축시키고 저전압으로 구동시킬 수 있게 된다. 이에 따라, 각 서브필드 별로 어드레스 기간이 종래에 비해 두 배 이상 획기적으로 단축되고, 그 만큼 서스테인 기간이 늘어나 화면의 휘도가 크게 향상된다. 또한 본 발명에서는 패널의 주사라인들을 분할 구동시키지 않고서도 고속 어드레싱이 가능해지므로 고해상도 패널의 구동시에도 서브필드의 수를 10개 이상으로 증가시킬 수 있어 화질 저하 현상을 방지할 수 있게 된다. 그리고 분할 구동을 위해 드라이버 집적회로의 수를 늘릴 필요가 없어지므로 제조 단가를 낮출 수 있게 된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (8)

  1. 데이터 펄스가 공급되는 데이터 전극과 주사 펄스가 공급되는 주사 전극 간에 어드레스 방전이 일어나고, 상기 주사 전극 및 상기 주사 전극과 더불어 서스테인 펄스가 공급되는 방전유지전극 간에 유지 방전이 일어나는 플라즈마 디스플레이 패널에 있어서,
    상기 데이터 전극과 나란하게 형성됨과 아울러 상기 어드레스 방전시 방전 펄스가 인가되어 상기 데이터 전극과 함께 프라이밍 방전을 일으키는 보조 전극을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  2. 제 1 항에 있어서,
    상기 보조 전극은 상기 데이터 전극과 함께 하부 기판 상에 동일한 선폭으로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  3. 제 1 항에 있어서,
    상기 보조 전극은 상기 데이터 전극과 함께 하부 기판 상에 서로 다른 선폭으로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  4. 제 1 항에 있어서,
    하부 기판 상에서 상기 보조 전극이 유전층을 사이에 두고 상기 데이터 전극 위에 형성됨과 아울러 상기 데이터 전극과 동일한 선폭으로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  5. 제 1 항에 있어서,
    하부 기판 상에서 상기 보조 전극이 유전층을 사이에 두고 상기 데이터 전극 위에 형성됨과 아울러 상기 데이터 전극과는 서로 다른 선폭으로 형성되는 것을 특징으로 하는 플라즈마 디스플레이 패널.
  6. 데이터 전극에 데이터 펄스를 공급하고, 주사 전극에 주사 펄스를 공급하여 어드레스 방전을 일으키는 단계와, 상기 주사 전극과 방전 유지 전극에 서스테인 펄스를 공급하여 방전을 유지하는 단계를 포함하는 플라즈마 디스플레이 패널의 구동방법에 있어서,
    상기 어드레스 방전시 상기 데이터 전극과 나란하게 형성된 보조 전극에 프라이밍 방전 펄스를 공급하여 상기 데이터 전극과 상기 보조 전극 간에 프라이밍 방전을 일으키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  7. 제 6 항에 있어서,
    상기 프라이밍 방전 펄스는 상기 데이터 펄스와 상기 주사 펄스가 동시에 존재하는 방전셀들에만 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  8. 제 6 항에 있어서,
    상기 프라이밍 방전 펄스의 펄스폭이 0.5㎲ 이하인 것과,
    상기 데이터 펄스 및 주사 펄스의 폭이 1㎲ 이하인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
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* Cited by examiner, † Cited by third party
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KR100421477B1 (ko) * 2001-07-07 2004-03-09 엘지전자 주식회사 플라즈마 디스플레이 패널 및 그의 구동방법
KR100472367B1 (ko) * 2002-04-04 2005-03-08 엘지전자 주식회사 플라즈마 디스플레이 패널 및 그 구동방법

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