KR100378885B1 - 반도체 표시장치 - Google Patents

반도체 표시장치 Download PDF

Info

Publication number
KR100378885B1
KR100378885B1 KR1020010045395A KR20010045395A KR100378885B1 KR 100378885 B1 KR100378885 B1 KR 100378885B1 KR 1020010045395 A KR1020010045395 A KR 1020010045395A KR 20010045395 A KR20010045395 A KR 20010045395A KR 100378885 B1 KR100378885 B1 KR 100378885B1
Authority
KR
South Korea
Prior art keywords
display device
signal lines
driving circuit
substrate
signal
Prior art date
Application number
KR1020010045395A
Other languages
English (en)
Inventor
고야마준
야마자키순페이
Original Assignee
가부시키가이샤 한도오따이 에네루기 켄큐쇼
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by 가부시키가이샤 한도오따이 에네루기 켄큐쇼 filed Critical 가부시키가이샤 한도오따이 에네루기 켄큐쇼
Application granted granted Critical
Publication of KR100378885B1 publication Critical patent/KR100378885B1/ko

Links

Classifications

    • G—PHYSICS
    • G02—OPTICS
    • G02F—OPTICAL DEVICES OR ARRANGEMENTS FOR THE CONTROL OF LIGHT BY MODIFICATION OF THE OPTICAL PROPERTIES OF THE MEDIA OF THE ELEMENTS INVOLVED THEREIN; NON-LINEAR OPTICS; FREQUENCY-CHANGING OF LIGHT; OPTICAL LOGIC ELEMENTS; OPTICAL ANALOGUE/DIGITAL CONVERTERS
    • G02F1/00—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics
    • G02F1/01—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour 
    • G02F1/13—Devices or arrangements for the control of the intensity, colour, phase, polarisation or direction of light arriving from an independent light source, e.g. switching, gating or modulating; Non-linear optics for the control of the intensity, phase, polarisation or colour  based on liquid crystals, e.g. single liquid crystal display cells
    • G02F1/133—Constructional arrangements; Operation of liquid crystal cells; Circuit arrangements
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G2310/00—Command of the display device
    • G09G2310/02—Addressing, scanning or driving the display screen or processing steps related thereto
    • G09G2310/0224—Details of interlacing
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3614—Control of polarity reversal in general
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3674—Details of drivers for scan electrodes
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3685—Details of drivers for data electrodes
    • G—PHYSICS
    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G3/00—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes
    • G09G3/20—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters
    • G09G3/34—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source
    • G09G3/36—Control arrangements or circuits, of interest only in connection with visual indicators other than cathode-ray tubes for presentation of an assembly of a number of characters, e.g. a page, by composing the assembly by combination of individual elements arranged in a matrix no fixed position being assigned to or needed to be assigned to the individual characters or partial characters by control of light from an independent source using liquid crystals
    • G09G3/3611—Control of matrices with row and column drivers
    • G09G3/3685—Details of drivers for data electrodes
    • G09G3/3688—Details of drivers for data electrodes suitable for active matrices only

Landscapes

  • Physics & Mathematics (AREA)
  • Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Crystallography & Structural Chemistry (AREA)
  • Chemical & Material Sciences (AREA)
  • Theoretical Computer Science (AREA)
  • Computer Hardware Design (AREA)
  • Nonlinear Science (AREA)
  • Mathematical Physics (AREA)
  • Optics & Photonics (AREA)
  • Liquid Crystal Display Device Control (AREA)
  • Control Of Indicators Other Than Cathode Ray Tubes (AREA)
  • Liquid Crystal (AREA)
  • Shift Register Type Memory (AREA)

Abstract

매트릭스 형태로 배치된 다수의 화소를 포함하는 표시장치에, 병렬로 배치된 2개 이상의 행(行) 구동회로 및/또는 열(列) 구동회로가 제공되어 있다. 이러한 구성은, 구동회로들 각각에 의해 구동되는 행 및/또는 열 사이의 간격을 감소시켜 매트릭스의 화소가 고밀도로 배치될 수 있게 한다. 구동회로들의 이러한 병렬배치 구성으로, 비디오 신호의 라인 반전 및 도트 반전 뿐만 아니라 인터레이스 주사가 단순화되고, 구동회로의 동작 주파수가 감소될 수 있다.

Description

반도체 표시장치{A semiconductor display device}
본 발명은 일반적으로는 표시장치에 관한 것이고, 더 구체적으로는, 그 표시장치의 구동회로에 관한 것이다. 본 발명은 단순 매트릭스형 또는 액티브 매트릭스형 표시장치의 구동방법에 적용될 수 있다. 또한, 본 발명은, 음극선관(CRT)을 제외하고, 전기신호를 제어된 방법으로 인가함으로써 광투과율, 광반사율, 광굴절률, 발광량 등의 성질이 변화되는 액정표시장치(LCD) 및 전기장발광(EL)표시장치와 같은 플랫 패널(flat panel)형 표시장치에 적용될 수 있다.
매트릭스 형태로 배치된 다수의 표시소자(화소)를 포함하는 매트릭스 표시장치는 대용량 표시수단으로서 특히 플랫 패널형 표시장치에 사용된다. 종래의 공지된 매트릭스 표시장치로서는, 행열로 배치된 개개의 표시소자가 작동장치를 내장하고 있지 않는 단순 매트릭스형과, 개개의 표시소자에 트랜지스터 또는 다이오드와 같은 능동소자가 설치되어 있는 액티브 매트릭스형이 있다. 하기 설명에서, 열(列) 신호선은 비디오 신호(영상신호)를 가지는 전기신호를 전송하는 신호선을 의미하고, 행(行) 신호선은 비디오 신호을 가지지 않는 전기신호를 전송하는 신호선을 의미하는 것으로 정의한다.
어느 형태의 매트릭스 표시장치에서도, 기본 구성은, 매트릭스의 행 신호선 및 열 신호선에 신호를 공급하기 위해 어드레스 회로를 포함하는 주변 구동회로가 매트릭스의 주변에 배치되도록 되어 있다. 이들 구동회로를 각각 행 구동회로 및 열 구동회로라고 부른다. 액티브 매트릭스형 표시장치를 위한 어드레스 회로로서 시프트 레지스터를 이용하는 구성이, 예를 들어, 일본국 공개특허공고 소57-41078호의 공보에 개시되어 있고, 액티브 매트릭스형 표시장치를 위한 어드레스 회로로서 AND 게이트 및 NAND 게이트를 포함하는 디코더 회로를 이용하는 구성이, 예를 들어, 일본국 공개특허공고 소62-265696호의 공보에 개시되어 있다.
종래의 매트릭스형 표시장치의 주변 구동회로는 공지의 반도체 집적회로상에 형성되고, 테이프 자동화 실장(TAB)법과 같은 본딩(bonding) 기술을 이용하여 유리기판 상의 매트릭스에 접속된다. 최근, 매트릭스의 대용량화 및 매트릭스 면적의 축소화에 대한 요구의 증가에 따라, 각각의 행 신호선과 각각의 열 신호선 사이의 간격이 감소되었다. 이것은, 주변 구동회로를 매트릭스와 동일한 기판 상에 모놀리식(monolithic) 형태로 형성하는 것을 필요로 한다. 예를 들어, TAB법은 기계적 압착 방식이기 때문에, TAB법에 의해 배선을 100 μm 이하의 간격으로 접속하는 것은 어렵다. 이것에 대하여, 주변 구동회로가 표시소자의 매트릭스와 동일한 기판상에 형성되는 구성에서는, 포토리소그래피법을 이용하는 것이 가능하다. 이상적으로는, 포토리소그래피법은 디자인 룰(design rule) 요건과 실제적으로 동등한 정도까지 배선 간격을 감소시킬 수 있다.
그러나, 최근, 각 표시소자의 면적의 감소가 회로 구성과 관련된 문제를 야기시킬 수 있다는 것이 인식되었다. 즉, 주변 구동회로가 표시소자의 매트릭스와 동일한 기판 상에 모놀리식 형태로 형성될 때라도, 각 신호선에 전기신호를 공급하는 회로는 각 신호선 사이의 간격 이하의 선폭을 가져야 한다. 예를 들어, 주변 구동회로의 시프트 레지스터의 각 스테이지는 대략 10개의 트랜지스터를 포함하고, 이들 트랜지스터가 각 신호선의 폭내에 있도록 회로가 설계되는 것이 필요하다. 예를 들어, 5 μm 디자인 룰로 회로를 설계하는 경우, 각 신호선의 허용 가능한 최소 폭은 30 μm이고, 따라서, 각 표시소자의 면적도 최소한 30 μm×30 μm가 된다.
또한, 매트릭스형 표시장치를 위한 종래의 구동기술에서는, 그의 행 신호선이 상측 신호선으로부터 하측 신호선으로(또는, 하측 신호선으로부터 상측 신호선으로) 순차적으로 구동된다. 이것은, 종래의 매트릭스형 표시장치가 홀수번째 수평 라인 그룹과 짝수번째 수평 라인 그룹을 교대적인 수직주사로 주사하는 통상의 인터레이스(interlace) 주사에 의해 작동될 수 없다는 것을 의미한다. 매트릭스 표시장치의 이러한 제한은 빠르게 이동하는 영상을 표시할 때 불리하다. 또한, 통상의 비디오 신호 입력을 표시하기 위해 인터레이스 주사로부터 비(非)인터레이스 주사로 비디오 신호를 변환시키는 것이 필요하다.
또한, 액정표시장치는, 인접한 표시소자내의 축적 전하(즉, 영상정보) 사이의 상호간섭으로 인한 영상 열화를 방지하기 위해 라인 반전(line inversion) 또는 도트 반전(dot inversion) 표시기술을 통상 이용한다. 이것은 영상정보를 변환시키는 추가 단계를 필요로 한다.
매트릭스형 표시장치의 표시용량의 증가에 따라 고속 주사가 요구된다. 예를 들어, 비디오 그래픽 어레이(VGA) 규격(640×480 화소)은 9 MHz의 클럭을 요하고, 엔지니어링 워크스테이션(EWS) 규격은 30 MHz 이상의 클럭 주파수를 요한다. 모놀리식 형태로 형성된 매트릭스형 표시장치의 주변 구동회로가 단결정 실리콘보다 열등한 다결정 실리콘과 같은 반도체 재료를 사용하여 형성되기 때문에, 동작속도의 증가는 바람직하지 않다.
본 발명의 목적은 종래 기술의 상기한 문제점들중 적어도 하나를 해결하는데 있다.
도 1A는 본 발명의 실시예 1에 따른 매트릭스 표시장치의 블록도.
도 1B 및 도 1C는 실시예 1의 개별 표시소자를 구동하기 위한 각기 다른 회로 구성을 나타내는 개략 회로도.
도 2A는 실시예 2에 따른 매트릭스 표시장치의 블록도.
도 2B 및 도 2C는 실시예 2의 개별 표시소자를 구동하기 위한 각기 다른 회로 구성을 나타내는 개략 회로도.
도 3A는 실시예 3에 따른 매트릭스 표시장치의 블록도.
도 3B 및 도 3C는 실시예 3의 개별 표시소자를 구동하기 위한 각기 다른 회로 구성을 나타내는 개략 회로도.
도 4A는 실시예 4에 따른 매트릭스 표시장치의 블록도.
도 4B 및 도 4C는 실시예 4의 개별 표시소자를 구동하기 위한 각기 다른 회로 구성을 나타내는 개략 회로도.
도 5A는 실시예 5에 따른 매트릭스 표시장치의 블록도.
도 5B는 실시예 6에 따른 매트릭스 표시장치의 블록도.
도 6A는 실시예 7에 따른 매트릭스 표시장치의 블록도.
도 6B는 실시예 8에 따른 매트릭스 표시장치의 블록도.
도 7A는 행 구동회로 및 열 구동회로가 어드레스 회로를 구성하는 시프트 레지스터를 포함하고 있는, 본 발명의 액티브 매트릭스형 표시장치를 구동하는데 적용가능한 회로 구성을 나타내는 도면.
도 7B는 도 7A에 나타낸 시프트 레지스터들중 어느 하나 또는 모두를 대체할 수 있는 디코더 회로를 나타내는 도면.
도 8A는 실시예 9에 따른 매트릭스 표시장치의 블록도.
도 8B는 실시예 10에 따른 매트릭스 표시장치의 블록도.
도 9A∼도 9E는 실시예 11예 따라 비디오 신호의 라인 반전이 어떻게 행해지는지를 나타내는 도면.
도 10A는 실시예 11에 따른 어드레스 회로를 나타내는 회로도.
도 10B는 도 10A에 나타낸 시프트 레지스터들을 대체할 수 있는 디코더 회로를 나타내는 회로도.
도 11는 도 10B에 나타낸 디코더 회로에 입력될 수 있는 신호들을 나타내는 도면.
도 12는 어드레스 회로를 구성하기 위해 디코더 회로를 이용하는 실시예 11에 따른 매트릭스 표시장치의 블록도.
* 도면의 주요부분에 대한 부호의 설명
101: 제1 열 구동회로 102: 행 구동회로
103, 105: 출력회로 104: 제2 열 구동회로
106: 매트릭스 107, 109: 비디오 신호선
108: 클럭 신호선 110, 111: 래치 신호선
112, 113: 열 신호선 114: 행 신호선
115, 116: 표시소자(화소)
본 발명의 일 실시형태에 있어서, 표시장치는 매트릭스를 구성하기 위해 기판 상에 배치된 다수의 표시소자와, 상기 매트릭스의 각 행에 신호를 공급하기 위한 적어도 제1 및 제2 행 구동회로를 포함하며, 그들 행 구동회로가 상기 매트릭스와 동일한 기판 상에 서로 떨어져 평행하게 배치되고, 상기 제1 행 구동회로로부터 신호가 공급되는 임의의 한 행 신호선에 인접한 다른 행 신호선에는 상기 제1 행 구동회로가 아닌 다른 행 구동회로로부터 신호가 공급되는 구성을 가진다.
상기 표시장치는, 상기 행 구동회로들중 하나가 상기 매트릭스의 좌측에 위치되는 반면에, 다른 행 구동회로는 상기 매트릭스의 우측에 위치되거나, 또는 모든 행 구동회로가 상기 매트릭스의 좌측 또는 우측에 위치되도록 구성될 수 있다.
본 발명의 다른 실시형태에 있어서, 표시장치는 매트릭스를 구성하기 위해기판 상에 배치된 다수의 표시소자와, 상기 매트릭스의 각 열에 신호를 공급하기 위한 적어도 제1 및 제2 열 구동회로를 포함하며, 그들 열 구동회로가 상기 매트릭스와 동일한 기판 상에 서로 떨어져 평행하게 배치되고, 상기 제1 열 구동회로로부터 신호가 공급되는 임의의 한 열 신호선에 인접한 다른 열 신호선에는 상기 제1 열 구동회로가 아닌 다른 열 구동회로로부터 신호가 공급되는 구성을 가진다.
이 표시장치는, 상기 열 구동회로들중 하나가 상기 매트릭스의 상부 가장자리 위에 위치되는 반면에, 다른 열 구동회로는 상기 매트릭스의 하부 가장자리 아래에 위치되거나, 또는 모든 열 구동회로가 상기 매트릭스의 상부 가장자리 위 또는 하부 가장자리 아래에 위치되도록 구성될 수 있다.
상기한 어느 실시형태에 있어서도, 표시장치는, 모든 행 구동회로 및 열 구동회로가 어드레스 회로로서 이용하기 위한 시프트 레지스터를 사용하거나, 또는 모든 행 구동회로 및 열 구동회로가 어드레스 회로로서 이용하기 위한 디코더 회로를 사용하도록 구성될 수 있다. 또는, 표시장치는, 각 행 구동회로가 어드레스 회로로서 시프트 레지스터를 사용하고, 각 열 구동회로가 어드레스 회로로서 디코더 회로를 사용하도록 구성되거나, 또는 그 반대로, 각 열 구동회로가 어드레스 회로로서 시프트 레지스터를 사용하고, 각 행 구동회로가 어드레스 회로로서 디코더 회로를 사용하도록 구성될 수도 있다.
어드레스 회로로서 시프트 레지스터를 사용하는 2개 이상의 행 구동회로 또는 열 구동회로가 서로 떨어져 설치되는 경우, 표시장치는 제1 구동회로의 최종 스테이지로부터 출력되는 선택신호가 제2 구동회로의 첫번째 스테이지에 입력되도록구성될 수 있다.
어드레스 회로로서 디코더 회로를 사용하는 2개 이상의 행 구동회로 또는 열 구동회로가 서로 떨어져 설치되는 경우, 표시장치는 이들 디코더 회로가 공통의 카운터에 의해 제어되도록 구성될 수 있다.
표시장치가 2개 이상의 열 구동회로를 포함하는 경우, 그 표시장치는 매트릭스의 다수의 열의 표시소자를 구동하기 위한 신호가 각 열 신호선에 동시에 공급되도록 구성될 수 있다.
상기한 첫번째 실시형태와 두번째 실시형태중 어느 한 형태에 있어서, 구동회로의 각 스테이지(각 신호선이 접속된)의 길이방향 칫수를 감소시키는 것이 가능하다. 2개의 열 구동회로가 서로 떨어진 장소에 제공되어 있는 경우, 각 열 구동회로로부터 분지(分枝)하여 있는 열 신호선의 수가 절반으로 될 수 있다. 이것은, 만일 각 신호선의 폭이 불변이라면, 단일의 열 구동회로를 2개로 나눔으로써 2배의 열 신호선을 배치할 수 있다는 것을 의미한다. 즉, 같은 면적에 2배의 표시소자(화소)를 배치할 수 있다.
본 발명의 상기한 특징을 예로서 더 상세히 설명한다. 종래의 매트릭스 표시장치의 열 구동회로의 전체 길이가 19.2 mm이고, 640개의 열 신호선이 열 구동회로로부터 분지하여 있으면, 연속적인 열 신호선들 사이의 간격은 30 μm이다. 즉, 열 구동회로의 각 스테이지는 30 μm의 길이방향 칫수를 가진다. 동일한 신호선 간격으로 설계된 2개의 열 구동회로가 본 발명에 따라 별개의 장소에서 서로 평행하게 설치되면, 열 신호선의 수가 2배로 된다. 구체적으로는, 총 1280개의 열 신호선이 2개의 열 구동회로로부터 분지하여, 비록 각 열 구동회로로부터 분지하는 각 열 신호선 사이의 실제 간격이 여전히 30μm일지라도, 하나의 열 신호선당 전유폭은 15 μm로 된다. 어쨌든, 대규모의 매트릭스 표시장치를 형성하는 것이 가능하다.
본 발명의 한 변형예에 있어서는, 각 열 구동회로의 길이가 절반으로 될 수 있다. 각 열 구동회로에 접속될 수 있는 열 신호선의 수가 320개로 감소할지라도, 2개의 열 구동회로로부터 분지하는 열 신호선의 총 수는 여전히 640개이다. 이것은 결과적으로 화소의 미세화 및 집적화의 증가를 초래한다. 3개, 4개, 또는 그 이상의 별개의 열 구동회로를 제공하는 것에 의해, 3배, 4배, 또는 그 이상의 집적화 또는 매트릭스 대규모화를 달성할 수 있다.
상기한 설명은 행 구동회로 및 행 신호선에도 마찬가지로 적용된다.
본 발명의 또 다른 특징에 있어서는, 교대적인 수직주사로 홀수번째 및 짝수번째 수평 라인(즉, 표시소자들의 행)을 주사하여 인터레이스 주사를 행하는 것이 가능하다. 이것은, 2개의 구동회로가 어드레스 회로로서 시프트 레지스터를 사용하는 경우에, 제1 구동회로의 최종 스테이지로부터 출력되는 선택신호가 제2 구동회로의 첫번째 스테이지에 입력되도록 제1 및 제2 구동회로를 구성함으로써 달성된다. 제1 및 제2 구동회로가 어드레스 회로로서 디코더 회로를 사용하는 경우에는, 디코더 회로가 인터레이스 주사를 행하기 위해 공통의 카운터에 의해 제어되어야 한다.
또한, 3개, 4개, 또는 그 이상의 별개의 열 구동회로가 배치되고, 그들이 미리 정해진 순서로 구동되는 경우, 제2 행마다, 제3 행마다, 등을 주사하는 것도 가능하다.
한편, 다수의 열 구동회로를 실질적으로 동시에 구동함으로써 다수의 열 구동회로에 비디오 신호가 동시에 공급될 수 있다(예를 들어, 상이한 배선 길이에 의해 야기되는 불기피한 지연을 제외한 어떤 신호지연도 없다면). 이것에 의해, 각 열 구동회로의 동작 주파수를 감소시키는 것이 가능하게 된다. 예를 들어, VGA 규격(640개 수평 라인)에 일치하는 매트릭스 표시장치를 구동하기 위해 4개의 열 구동회로가 제공되어 있는 경우, 160개의 열 신호선이 각 열 구동회로에 접속되며, 각 열 구동회로의 동작 주파수가 통상의 동작 주파수의 4분의 1인 2.3 MHz로 된다.
또한, 임의의 한 열 신호선에 제1 열 구동회로로부터 신호가 공급되고, 상기 임의의 한 열 신호선에 인접한 다른 열 신호선에 제2 열 구동회로로부터 신호가 공급되는 본 발명의 상기한 다른 형태는, 라인 반전으로 동일한 화면에 정(正)의 비디오신호와 부(負)의 비디오 신호를 공급하는데 이용될 수 있다. 즉, 제1 열 구동회로로부터 정의 비디오 신호를 공급하고 제2 열 구동회로로부터 부의 비디오 신호를 공급함으로써, 인접한 열 신호선들 사이에서 비디오 신호의 극성이 서로 다른 라인 반전이 가능하다. 비디오 신호 극성의 도트 반전도 같은 방식으로 행해질 수 있다.
이하, 본 발명의 실시예에 대하여 설명한다.
실시예 1
도 1A∼도 1C는 본 실시예에 따른 매트릭스 표시장치의 회로 구성을 나타내는 것으로, 도 1A는 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치가 간략화를 위해 6행×14열의 매트릭스(106)를 이용하는 것으로 나타내어져 있으나, 본 실시예는 더욱 대규모의 매트릭스에도 적용 가능하다. 도 1A에 나타낸 바와 같이, 매트릭스를 구동하기 위해 제1 열 구동회로(101)와 제2 열 구동회로(104)가 제공되어 있다. 본 실시예에서는, 도 1A에 나타낸 바와 같이, 제1 열 구동회로(101)가 매트릭스(106)의 상부 가장자리 위에 위치되고, 제2 열 구동회로(104)는 매트릭스(106)의 하부 가장자리 아래에 위치되어 있다. 제1 및 제2 열 구동회로(101, 104)는 출력회로(103, 105)를 통해 열 신호선(112, 113)에 각각 접속되어 있다. 한편, 행 구동회로(102)는 각각의 행 신호선(114)에 구동신호를 공급한다.
도 1A를 참조하면, 비디오 신호(영상신호)가 비디오 신호선(107, 109)을 통해 제1 및 제2 열 구동회로(101, 104) 각각에 공급되고, 클럭 신호가 클럭 신호선(108)을 통해 행 구동회로(102)에 공급된다. 상세하게 나타내지 않았지만, 클럭 신호는 제1 및 제2 열 구동회로(101, 104)에도 공급된다. 각각의 출력회로(103, 105)는 각각의 행 신호선(114)에 공급되는 클럭 신호에 동기하는 래치(latch) 펄스신호에 의해 구동된다. 래치 펄스는 래치 신호선(110, 111)을 통해 출력회로(103, 105)에 각각 공급된다.
도 1B 및 도 1C는 하나의 행 신호선(114)과 3개의 열 신호선(112, 113) 사이의 접속부를 구체적으로 나타내는 각기 다른 회로도이다. 단순 매트릭스 방식을 나타내는 도 1B에서, 표시소자(화소)(115, 116)가 행 신호선(114)과 열신호선(112)의 각 교차부와 행 신호선(114)과 열 신호선(113)의 각 교차부에 각각 배치되어 있다. 각각의 열 신호선(112)에 대한 신호가 제1 열 구동회로(101)로부터 공급되고, 각각의 열 신호선(113)에 대한 신호가 제2 열 구동회로(104)로부터 공급된다.
도 1C는 능동소자로서 트랜지스터가 사용되는 액티브 매트릭스 방식을 나타낸다. 이 구조에서, 열 신호선(112, 113)과 제1 및 제2 열 구동회로(101, 104) 사이의 관계는 도 1B에 의거하여 설명한 것과 동일하다. 그러나, 도 1C에서는, 각각의 표시소자(화소)(115, 116)가 트랜지스터와 정전용량을 가지는 회로를 포함한다.
도 7A 및 도 7B는 매트릭스 표시장치를 구동하기 위한 회로 구성을 더 상세히 나타내는 회로도이다. 더 구체적으로는, 도 7A는 행 구동회로 및 열 구동회로가 어드레스 회로를 구성하는 시프트 레지스터(701, 702)를 포함하는 구성을 나타내고, 도 7B는 도 7A의 시프트 레지스터(701, 702)중 어느 하나 또는 모두를 대신하여 사용될 수 있는 디코더 회로를 나타낸다. 도 7A 및 도 7B의 회로 구성은 본 실시예 뿐만 아니라, 아래에 설명되는 다른 실시예들에도 적용 가능하다.
도 7A를 참조하면, 클럭 펄스가 클럭 신호선(703)을 통해 열 구동회로의 시프트 레지스터(701)에 공급되어, 시프트 레지스터(701)가 순차적으로 시프트하는 신호를 출력하도록 한다. 열 구동회로는 시프트 레지스터(701) 이외에도 아날로그 스위치(705)와 아날로그 메모리(706)를 포함한다. 비디오 신호선(713)을 통해 입력된 비디오 신호는 아날로그 스위치(705)에 의해 샘플링되고 각각의 아날로그 메모리(706)에 보유된다.
스위치(707)가 제어된 방식으로 래치 신호선(714)에 의해 온, 오프됨에 따라, 아날로그 버퍼(708)에 의해 증폭된 비디오 신호가 매트릭스(709)의 개개의 열 신호선(711)에 공급된다. 도 7A에 나타낸 예에서는, 매트릭스(709)는 능동소자로서 트랜지스터를 사용하는 액티브 매트릭스 방식이다.
또한, 클럭 펄스가 클럭 신호선(704)을 통해 행 구동회로의 시프트 레지스터(702)에 공급되어, 시프트 레지스터(702)가 순차적으로 시프트하는 신호를 출력하도록 한다. 시프트 레지스터(702)에 공급되는 클럭 펄스는 상기한 시프트 레지스터(701)에 공급되는 것과 다르다. 이것은 행 구동회로의 동작 주파수가 열 구동회로의 것보다 더 낮기 때문이다. 행 구동회로는 상기한 바와 같은 시프트 레지스터(702)로 구성되어 있다.
시프트 레지스터(702)로부터 출력되는 선택신호는 매트릭스(709)에 배치된 행 신호선(710)에 공급된다. 각각의 행 신호선(710)이 표시소자(화소)(712)에 배치된 트랜지스터의 게이트에 접속되어 있기 때문에, 특정한 열 신호선(711)상의 아날로그 메모리(706)에 보유된 비디오 신호가 대응하는 표시소자(화소)(712)에 공급된다.
일본국 공개특허공고 소62-265696호 공보에 개시된 것과 같은 디코더 회로를 사용하는 것이 요구되는 경우에는, 도 7B에 나타낸 회로가 도 7A에 나타낸 시프트 레지스터(701, 702)를 대신하여 사용될 수 있다. 본 실시예에서는, 열 구동회로와 행 구동회로중 어느 하나만을 대신하여 디코더 회로를 사용하는 것이 가능하다.
도 7A 및 도 7B의 매트릭스 구동회로가 아날로그 스위치(705)와 아날로그 메모리(706)를 사용하는 아날로그 방식으로 되어 있지만, 종래의 디지털 기술을 사용하여 동등한 디지털 방식의 회로를 쉽게 구성할 수도 있다.
본 실시예에서는, 총 14개의 열 신호선(112, 113)이 있고, 각각 7개의 열 신호선(112, 113)이 제1 열 구동회로(101)와 제2 열 구동회로(104) 각각에 접속되어 있다. 이와 같이 2개의 열 구동회로(101, 104)를 제공함으로써, 표시소자(화소)의 밀도를 2배로 하는 것이 가능하다.
실시예 2
도 2A∼도 2C는 본 실시예에 따른 매트릭스 표시장치의 회로 구성을 나타내는 것으로, 도 2A는 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 6행×14열의 매트릭스(206)를 이용한다. 도 2A에 나타낸 바와 같이, 매트릭스(206)를 구동하기 위해 제1 열 구동회로(201)와 제2 열 구동회로(202)가 제공되어 있다. 본 실시예에서는, 도 2A에 나타낸 바와 같이, 제1 열 구동회로(201)와 제2 열 구동회로(202) 모두가 매트릭스(206)의 상부 가장자리 위에 위치되어 있다. 제1 및 제2 열 구동회로(201, 202)는 각각 출력회로(203, 204)를 통해 개개의 열 신호선(213, 214)에 접속되어 있다. 한편, 행 구동회로(205)는 개개의 행 신호선(212)에 구동신호를 공급한다.
도 2A를 참조하면, 비디오 신호가 비디오 신호선(207, 208)들 각각을 통해 제1 및 제2 열 구동회로(201, 202)에 공급되고, 클럭 신호가 클럭 신호선(209)을 통해 행 구동회로(205)에 공급된다. 상세하게 나타내지 않았지만, 클럭 신호는 제1 및 제2 열 구동회로(201, 202)에도 공급된다. 개개의 출력회로(203, 204)는개개의 행 신호선(212)에 공급되는 클럭 신호에 동기하는 래치 펄스 신호에 의해 구동된다. 래치 펄스는 래치 신호선(210, 211)들 각각을 통해 출력회로(203, 204)에 공급된다.
도 2B 및 도 2C는 하나의 행 신호선(212)과 3개의 열 신호선(213, 214) 사이의 접속부를 구체적으로 나타내는 각기 다른 회로도이다. 단순 매트릭스 방식을 나타내는 도 2B에서, 표시소자(화소)(215, 216)가 행 신호선(212)과 열 신호선(213)의 각 교차부와 행 신호선(212)과 열 신호선(214)의 각 교차부에 각각 배치되어 있다. 열 신호선(214)에 대한 신호가 제1 열 구동회로(201)로부터 공급되고, 열 신호선(213)에 대한 신호가 제2 열 구동회로(202)로부터 공급된다.
도 2C는 능동소자로서 트랜지스터가 사용되는 액티브 매트릭스 방식을 나타낸다. 이러한 구조에서, 열 신호선(213, 214)과 열 구동회로(201, 202) 사이의 관계는 도 2B에 의거하여 설명한 것과 동일하다. 그러나, 도 2C에서는, 각각의 표시소자(화소)(215, 216)가 트랜지스터와 정전용량을 가지는 회로를 포함한다.
실시예 3
도 3A∼도 3C는 본 실시예에 따른 매트릭스 표시장치의 회로 구성을 나타내는 것으로, 도 3A는 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 11행×7열의 매트릭스(305)를 이용한다. 도 3A에 나타낸 바와 같이, 매트릭스(305)를 구동하기 위해 제1 행 구동회로(303)와 제2 행 구동회로(304)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(303)가 매트리스(305)의 좌측에 위치되고, 제2 행 구동회로(304)가 매트릭스(305)의 우측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(303, 304)로부터 개개의 행 신호선(312, 311)에 공급된다. 한편, 열 구동회로(301)는 각각의 출력회로(302)를 통해 각각의 열 신호선(310)에 비디오 신호를 공급한다.
도 3A를 참조하면, 비디오 신호가 비디오 신호선(306)을 통해 열 구동회로(301)에 공급되고, 클럭 신호가 클럭 신호선(307, 308)을 통해 제1 및 제2 행 구동회로(303, 304) 각각에 공급된다. 이러한 구성에 의해, 클럭 신호선(307, 308)을 통해 공급되는 클럭 펄스의 타이밍을 제어함으로써, 단일 수직주사(비(非)인터레이스 주사)에서 모든 연속적인 행(즉, 수평 라인)을 순차적으로 주사할 것인지 또는 교대적인 수직주사(인터레이스 주사)로 홀수번째 및 짝수번째 수평 라인을 주사할 것인지를 선택하는 것이 보다 용이하게 된다. 상세하게 나타내지 않았지만, 클럭 신호는 열 구동회로(301)에도 공급된다. 각각의 출력회로(302)는 래치 펄스 신호에 의해 구동된다. 래치 펄스는 래치 신호선(309)을 통해 출력회로(302)에 공급된다.
도 3B 및 도 3C는 하나의 열 신호선(310) 및 3개 행 신호선(311, 312) 사이의 접속부를 구체적으로 나타내는 각기 다른 회로도이다. 단순 매트릭스 방식을 나타내는 도 3B에서, 표시소자(화소)(313, 314)가 열 신호선(310)과 행 신호선(311)의 각 교차부와 열 신호선(310)과 행 신호선(312)의 각 교차부에 각각 배치되어 있다. 행 신호선(312)에 대한 신호가 제1 행 구동회로(303)로부터 공급되고, 행 신호선(311)에 대한 신호가 제2 행 구동회로(304)로부터 공급된다.
도 3C는 능동소자로서 트랜지스터가 사용되는 액티브 매트릭스 방식을 나타낸다. 이 구조에서, 행 신호선(311, 312)과 제1 및 제2 행 구동회로(303, 304) 사이의 관계는 도 3B에 의거하여 설명한 것과 동일하다. 그러나, 도 3C에서는, 각각의 표시소자(화소)(313, 314)가 트랜지스터와 정전용량을 가지는 회로를 포함한다.
실시예 4
도 4A∼도 4C는 본 실시예에 따른 매트릭스 표시장치의 회로 구성을 나타내는 것으로, 도 4A는 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 11행×7열의 매트릭스(405)를 이용한다. 도 4A에 나타낸 바와 같이, 매트릭스(405)를 구동하기 위해 제1 행 구동회로(403)와 제2 행 구동회로(404)가 제공되어 있다. 본 실시예에서는, 도 4A에 나타낸 바와 같이, 제1 행 구동회로(403)와 제2 행 구동회로(404) 모두가 매트릭스(405)의 좌측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(403, 404)들 각각으로부터 개개의 행 신호선(411, 412)에 공급된다. 한편, 열 구동회로(401)는 각각의 출력회로(402)를 통해 각각의 열 신호선(410)에 비디오 신호를 공급한다.
도 4A를 참조하면, 비디오 신호가 비디오 신호선(406)을 통해 열 구동회로(401)에 공급되고, 클럭 신호가 클럭 신호선(407, 408) 각각을 통해 제1 및 제2 행 구동회로(403, 404)에 공급된다. 이러한 구성에 의해, 클럭 신호선(407, 408)을 통해 공급되는 클럭 펄스의 타이밍을 제어함으로써, 단일 수직주사(비인터레이스 주사)로 모든 연속적인 행(즉, 수평 라인)을 순차적으로 주사할 것인지 또는 교대적인 수직주사(인터레이스 주사)로 홀수번째 및 짝수번째 수평 라인을 주사할 것인지를 선택하는 것이 보다 용이하게 된다. 상세하게 나타내지 않았지만, 클럭 신호는 열 구동회로(401)에도 공급된다. 각각의 출력회로(402)는 래치 펄스 신호에 의해 구동된다. 래치 펄스는 래치 신호선(409)을 통해 출력회로(402)에 공급된다.
도 4B 및 도 4C는 하나의 열 신호선(410)과 3개 행 신호선(411, 412) 사이의 접속부를 구체적으로 나타내는 각기 다른 회로도이다. 단순 매트릭스 방식을 나타내는 도 4B에서, 표시소자(화소)(413, 414)가 열 신호선(410)과 행 신호선(411)의 각 교차부와 열 신호선(410)과 행 신호선(412)의 각 교차부에 각각 배치되어 있다. 행 신호선(411)에 대한 신호가 제1 행 구동회로(403)로부터 공급되고, 행 신호선(412)에 대한 신호가 제2 행 구동회로(404)로부터 공급된다.
도 4C는 능동소자로서 트랜지스터가 사용되는 액티브 매트릭스 방식을 나타넨다. 이 구조에서, 행 신호선(411, 412)과 제1 및 제2 행 구동회로(403, 404) 사이의 관계는 도 4B에 의거하여 설명한 것과 동일하다. 그러나, 도 4C에서는, 각 표시소자(화소)(413, 414)가 트랜지스터와 정전용량을 가지는 회로를 포함한다.
실시예 5
도 5A는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 8행×14열의 매트릭스(505)를 이용한다. 도 5A에 나타낸 바와 같이, 매트릭스(505)를 구동하기 위해 제1 행 구동회로(502)와 제2 행 구동회로(503)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(502)가 매트릭스(505)의 좌측에 위치되고, 제2 행 구동회로(503)가 매트릭스(505)의 우측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(502, 503)로부터 각각의 행신호선에 공급된다. 한편, 제1 열 구동회로(501) 및 제2 열 구동회로(504)가 각각의 출력회로를 통해 개개의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 제1 열 구동회로(501)가 매트릭스(505)의 상부 가장자리 위에 위치되고, 제2 열 구동회로(504)가 매트릭스(505)의 하부 가장자리 아래에 위치되어 있다. 이런 방식으로 각각 2개씩의 행 구동회로(502, 503) 및 열 구동회로(501, 504)를 분리하여 제공함으로써, 표시소자(화소)의 밀도가 4배로 될 수 있다.
실시예 6
도 5B는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 8행×14열의 매트릭스(510)를 이용한다. 도 5B에 나타낸 바와 같이, 매트릭스(510)를 구동하기 위해 제1 행 구동회로(508)와 제2 행 구동회로(509)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(508)가 매트릭스(510)의 좌측에 위치되고, 제2 행 구동회로(509)가 매트릭스(510)의 우측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(508, 509)로부터 각각의 행 신호선에 공급된다. 한편, 제1 열 구동회로(506)와 제2 열 구동회로(507)가 각각의 출력회로를 통해 각각의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 제1 열 구동회로(506)와 제2 열 구동회로(507) 모두가 매트릭스(510)의 상부 가장자리 위에 위치되어 있다.
실시예 7
도 6A는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 8행×14열의 매트릭스(605)를 이용한다. 도6A에 나타낸 바와 같이, 매트릭스(605)를 구동하기 위해 제1 행 구동회로(602)와 제2 행 구동회로(603)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(602)와 제2 행 구동회로(603) 모두가 매트릭스(605)의 좌측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(602, 603)로부터 각각의 행 신호선에 공급된다. 한편, 제1 열 구동회로(601)와 제2 열 구동회로(604)가 각각의 출력회로를 통해 각각의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 제1 열 구동회로(601)가 매트릭스(605)의 상부 가장자리 위에 위치되고, 제2 열 구동회로(604)는 매트릭스(605)의 하부 가장자리 아래에 위치되어 있다.
실시예 8
도 6B는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 8행×14열의 매트릭스(610)를 이용한다. 도 6B에 나타낸 바와 같이, 매트릭스(610)를 구동하기 위해 제1 행 구동회로(608)와 제2 행 구동회로(609)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(608)와 제2 행 구동회로(609) 모두가 매트릭스(610)의 좌측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(608, 609)로부터 각각의 행 신호선에 공급된다. 한편, 제1 열 구동회로(606)와 제2 열 구동회로(607)가 각각의 출력회로를 통해 각각의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 제1 열 구동회로(606)와 제2 열 구동회로(607) 모두가 매트릭스(610)의 상부 가장자리 위에 위치되어 있다.
실시예 9
도 8A는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의매트릭스 표시장치는 간략화를 위해 11행×27열의 매트릭스(806)를 이용한다. 도 8A에 나타낸 바와 같이, 매트릭스(806)를 구동하기 위해 제1 행 구동회로(804)와 제2 행 구동회로(805)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(804)가 매트릭스(806)의 좌측에 위치되고, 제2 행 구동회로(805)가 매트릭스(806)의 우측에 위치되어 있다. 신호는 제1 및 제2 행 구동회로(804, 805)로부터 각각의 행 신호선에 공급된다. 한편, 제1 열 구동회로(801), 제2 열 구동회로(802) 및 제3 열 구동회로(803)가 각각의 출력회로(도시되지 않음)를 통해 각각의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 모든 열 구동회로(801∼803)가 매트릭스(806)의 상부 가장자리 위에 위치되어 있다. 이러한 회로 구성에 따라, 각각의 열 구동회로(801∼803)의 동작 주파수는, 3개의 열 구동회로(801∼803)를 동시에 구동시키고 각기 다른 비디오 신호를 그들 회로 각각에 공급하는 것에 의해 통상의 동작 주파수의 3분의 1로 될 수 있다.
실시예 10
도 8B는 본 실시예에 따른 매트릭스 표시장치의 블록도이다. 본 실시예의 매트릭스 표시장치는 간략화를 위해 11행×27열의 매트릭스(813)를 이용한다. 도 8B에 나타낸 바와 같이, 매트릭스(813)를 구동하기 위해 제1 행 구동회로(809)와 제2 행 구동회로(810)가 제공되어 있다. 본 실시예에서는, 제1 행 구동회로(809)가 매트릭스(813)의 좌측에 위치되고, 제2 행 구동회로(810)가 매트릭스(813)의 우측에 위치되어 있다. 신호는 제1 및 제2 행구동회로(809, 810)로부터 각각의 행 신호선에 공급된다. 한편, 제1 열 구동회로(807), 제2 열 구동회로(808), 제3 열구동회로(811) 및 제4 열 구동회로(812)가 각각의 출력회로(도시되지 않음)를 통해 각각의 열 신호선에 비디오 신호를 공급한다. 본 실시예에서는, 제1 열 구동회로(807)와 제2 열 구동회로(808)가 매트릭스(813)의 상부 가장자리 위에 위치되고, 제3 열 구동회로(811)와 제4 열 구동회로(812)가 매트릭스(813)의 하부 가장자리 아래에 위치되어 있다. 이러한 회로 구성에 따라, 각각의 열 구동회로(807, 808, 811, 812)의 동작 주파수는, 4개의 열 구동회로(807, 808, 811, 812)를 동시에 구동시키고 각기 다른 비디오 신호를 그들 회로 각각에 공급하는 것에 의해 통상의 동작 주파수의 4분의 1로 될 수 있다.
실시예 11
도 9∼도 12를 참조하여, 본 발명에 따른 라인 반전방법에 관하여 설명한다. 도 9A는 매트릭스 표시장치의 특정 행에 대한 비디오 신호를 나타낸다. 비교적 특징이 없는 패턴을 가지는 이러한 형태의 비디오 신호 입력의 라인 반전에 사용되는 종래기술은, 도 9B에 나타낸 바와 같이 극성이 교대로 반전되도록 비디오 신호 입력을 변환시키는 단계를 포함한다. 비디오 신호의 순차적으로 변하는 값이 매트릭스 어드레스 회로에 공급되고, 열(a∼z)에 순차로 분배된다. 본 발명은 극성 반전 동작을 현저하게 단순화시킨다.
본 실시예에 따르면, 매트릭스 표시장치의 단일 행에 대한 비디오 신호가 원래 길이의 절반으로 압축된다(즉, 그 비디오 신호의 시간이 절반으로 단축된다). 정규 극성의 이러한 압축된 비디오 신호는 반전된 동일 비디오 신호와 결합되어, 도 9C에 나타낸 바와 같이, 후자가 전자의 바로 뒤를 잇게 한다.
도 9C에 나타낸 합성 비디오 신호 입력이 특정 시점에서 샘플링된 때, 도 9D에 나타낸 신호가 얻어진다. 그렇게 하여 얻어진 입력신호는, 예를 들어, 도 10A에 나타낸 바와 같이, 매트릭스 표시장치의 연속적인 열에 개개의 값의 비디오 신호를 분배하도록 구성된 시프트 레지스터에 공급된다. 도 10A에 나타낸 매트릭스 표시장치는 간략화를 위해 16열(a∼p)만을 가지는 것으로 되어 있지만, 예를 들어, 26열(a∼z)을 포함하도록 확장될 수도 있다. 도 10A의 회로 구성에서 주목해야 할 것은, 제1 시프트 레지스터(SR1)의 최종 스테이지(o열)로부터의 선택신호 출력이 제2 시프트 레지스터(SR2)의 첫번째 스테이지(b열)에 공급된다는 것이다.
도 10A를 참조하면, 매트릭스 표시장치가 연속적인 열(a, b, c, d, e ....)을 포함하지만, 제1 시프트 레지스터(SR1)와 제2 시프트 레지스터(SR2)가 이들 열에 교대로 접속되어 있다. 따라서, 이러한 회로에서, 도 9D에 나타낸 비디오 신호의 개개의 값이 제1 시프트 레지스터(SR1) 및 제2 시프트 레지스터(SR2)의 연속적인 스테이지에 분배되면, 매트릭스의 주어진 행에 공급되는 신호는 도 9E에 나타낸 것과 같이 된다. 이것은 종래의 라인 반전기술에 의해 얻어지는 것과 동일하다. 본 실시예의 상기 설명으로부터, 라인 반전 동작이 본 발명에 의해 현저하게 단순화된다는 것을 알 수 있다.
상기한 설명은 어드레스 회로를 구성하기 위해 시프트 레지스터(SR1, SR2)를 사용하는 도 10A의 회로도에 의거하였지만, 도 10B에 나타낸 바와 같이, 시프트 레지스터(SR1, SR2)를 대신하여 디코더(DC1, DC2)를 사용할 수도 있다. 도 10B의 회로를 위한 카운터는 16열에 신호를 전송하도록 4개의 디지털값, 즉, 20∼23으로 나타내어지는 4개 비트를 출력하는 것으로 되어 있지만, 이것은 회로도를 간략화하기 위한 것이다. 1개 이상의 비트를 취급할 수 있도록 도 10B의 회로를 확장시킴으로써, 26열의 매트릭스 표시장치를 구동하는 것이 가능하다.
도 11에 나타낸 신호가 도 10B의 회로의 각 비트 라인(20∼23)에 공급되면, 제1 디코더(DC1)가 열 a, c, e, g, I, k, m, o에 대한 신호를 순차적으로 출력하고, 그 다음, 제2 디코더(DC2)가 열 b, d, f, h, j, l, n, p에 대한 신호를 순차적으로 출력한다. 이것은, 제1 및 제2 디코더(DC1, DC2)가 도 10A에 나타낸 제1 및 제2 시프트 레지스터(SR1, SR2)와 동일한 기능을 수행한다는 것을 의미한다.
도 12는 상기한 라인 반전동작에 의거한 매트릭스 표시장치의 블록도이다. 2개의 디코더(1201, 1202)가 제공되어 있지만, 그들은 하나의 카운터(1203)에 의해 구동된다. 도 12의 매트릭스 표시장치 구동회로는, 비디오 신호를 비디오 콘트롤러(1204)로부터 매트릭스(1205)에 공급함으로써 라인 반전 동작이 행해지는 것에 특징이 있다.
본 발명에 의하면, 화소가 대규모화 및 집적화되고, 인터레이스 방식의 표시가 가능하고, 라인 반전이 용이하며, 열 구동회로의 동작 주파수를 저감시킬 수 있다는 효과가 얻어지는 것이다.

Claims (36)

  1. 삭제
  2. 삭제
  3. 삭제
  4. 삭제
  5. 삭제
  6. 삭제
  7. 삭제
  8. 삭제
  9. 기판 위에 형성된 다수의 제1 신호선;
    상기 기판 위에 형성되고, 다수의 화소가 획정(劃定)되도록 상기 다수의 제1 신호선을 가로질러 연장하는 다수의 제2 신호선;
    각각의 상기 화소에 제공되고, 상기 제2 신호선들중 대응하는 신호선에 게이트가 접속된 적어도 하나의 박막트랜지스터;
    상기 다수의 제1 신호선들중 홀수번째 신호선들에 제1 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제1 시프트 레지스터를 포함하는 제1 구동회로;
    상기 다수의 제1 신호선들중 짝수번째 신호선들에 제2 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제2 시프트 레지스터를 포함하는 제2 구동회로; 및
    상기 다수의 제2 신호선들을 선택하기 위해 상기 기판 위에 형성된 제3 구동회로를 포함하고;
    상기 제1 시프트 레지스터의 최종 스테이지로부터의 선택신호 출력이 상기 제2 시프트 레지스터의 첫번째 스테이지에 입력되어 라인 반전을 행하는 것을 특징으로 하는 반도체 표시장치.
  10. 제 9 항에 있어서, 상기 반도체 표시장치가 액정 표시장치인 것을 특징으로 하는 반도체 표시장치.
  11. 제 9 항에 있어서, 상기 반도체 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 반도체 표시장치.
  12. 제 9 항에 있어서, 상기 반도체 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 반도체 표시장치.
  13. 기판 위에 형성된 다수의 제1 신호선;
    상기 기판 위에 형성되고, 다수의 화소가 획정되도록 상기 다수의 제1 신호선을 가로질러 연장하는 다수의 제2 신호선;
    각각의 상기 화소에 제공되고, 상기 제2 신호선들중 대응하는 신호선에 게이트가 접속된 적어도 하나의 박막트랜지스터;
    상기 다수의 제1 신호선들에 비디오 신호를 공급하기 위해 상기 기판 위에 형성된 제1 구동회로;
    상기 다수의 제2 신호선들중 홀수번째 신호선들을 선택하기 위해 상기 기판 위에 형성되고, 제1 시프트 레지스터를 포함하는 제2 구동회로; 및
    상기 다수의 제2 신호선들중 짝수번째 신호선들을 선택하기 위해 상기 기판 위에 형성되고, 제2 시프트 레지스터를 포함하는 제3 구동회로를 포함하고;
    상기 제1 시프트 레지스터의 최종 스테이지로부터의 선택신호 출력이 상기 제2 시프트 레지스터의 첫번째 스테이지에 입력되어 인터레이스(interlace) 주사를 행하는 것을 특징으로 하는 반도체 표시장치.
  14. 제 13 항에 있어서, 상기 반도체 표시장치가 액정 표시장치인 것을 특징으로 하는 반도체 표시장치.
  15. 제 13 항에 있어서, 상기 반도체 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 반도체 표시장치.
  16. 제 13 항에 있어서, 상기 반도체 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 반도체 표시장치.
  17. 기판 위에 형성된 다수의 제1 신호선;
    상기 기판 위에 형성되고, 다수의 화소가 획정되도록 상기 다수의 제1 신호선을 가로질러 연장하는 다수의 제2 신호선;
    각각의 상기 화소에 제공되고, 상기 제2 신호선들중 대응하는 신호선에 게이트가 접속된 적어도 하나의 박막트랜지스터;
    상기 다수의 제1 신호선들중 홀수번째 신호선들에 제1 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제1 시프트 레지스터를 포함하는 제1 구동회로;
    상기 다수의 제1 신호선들중 짝수번째 신호선들에 제2 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제2 시프트 레지스터를 포함하는 제2 구동회로; 및
    상기 다수의 제2 신호선들을 선택하기 위해 상기 기판 위에 형성된 제3 구동회로를 포함하고;
    상기 제1 시프트 레지스터의 최종 스테이지로부터의 선택신호 출력이 상기 제2 시프트 레지스터의 첫번째 스테이지에 입력되어 라인 반전을 행하고,
    상기 제1 구동회로가 상기 제2 구동회로의 대하여 상기 화소들의 반대측에 제공된 것을 특징으로 하는 반도체 표시장치.
  18. 제 17 항에 있어서, 상기 반도체 표시장치가 액정 표시장치인 것을 특징으로 하는 반도체 표시장치.
  19. 제 17 항에 있어서, 상기 반도체 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 반도체 표시장치.
  20. 제 17 항에 있어서, 상기 반도체 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 반도체 표시장치.
  21. 기판 위에 형성된 다수의 제1 신호선;
    상기 기판 위에 형성되고, 다수의 화소가 획정되도록 상기 다수의 제1 신호선을 가로질러 연장하는 다수의 제2 신호선;
    각각의 상기 화소에 제공되고, 상기 제2 신호선들중 대응하는 신호선에 게이트가 접속된 적어도 하나의 박막트랜지스터;
    상기 다수의 제1 신호선들에 비디오 신호를 공급하기 위해 상기 기판 위에 형성된 제1 구동회로;
    상기 다수의 제2 신호선들중 홀수번째 신호선들을 선택하기 위해 상기 기판 위에 형성되고, 제1 시프트 레지스터를 포함하는 제2 구동회로; 및
    상기 다수의 제2 신호선들중 짝수번째 신호선들을 선택하기 위해 상기 기판 위에 형성되고, 제2 시프트 레지스터를 포함하는 제3 구동회로를 포함하고;
    상기 제1 시프트 레지스터의 최종 스테이지로부터의 선택신호 출력이 상기 제2 시프트 레지스터의 첫번째 스테이지에 입력되어 인터레이스 주사를 행하고,
    상기 제2 구동회로가 상기 제3 구동회로의 대하여 상기 화소들의 반대측에 제공된 것을 특징으로 하는 반도체 표시장치.
  22. 제 21 항에 있어서, 상기 반도체 표시장치가 액정 표시장치인 것을 특징으로 하는 반도체 표시장치.
  23. 제 21 항에 있어서, 상기 반도체 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 반도체 표시장치.
  24. 제 21 항에 있어서, 상기 반도체 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 반도체 표시장치.
  25. 기판 위에 형성된 다수의 제1 신호선;
    상기 기판 위에 형성되고, 다수의 화소가 획정되도록 상기 다수의 제1 신호선을 가로질러 연장하는 다수의 제2 신호선;
    각각의 상기 화소에 제공되고, 상기 제2 신호선들중 대응하는 신호선에 게이트가 접속된 적어도 하나의 박막트랜지스터;
    상기 다수의 제1 신호선들중 홀수번째 신호선들에 제1 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제1 시프트 레지스터를 포함하는 제1 구동회로;
    상기 다수의 제1 신호선들중 짝수번째 신호선들에 제2 비디오 신호를 공급하기 위해 상기 기판 위에 형성되고, 제2 시프트 레지스터를 포함하는 제2 구동회로; 및
    상기 다수의 제2 신호선들을 선택하기 위해 상기 기판 위에 형성된 제3 구동회로를 포함하고;
    상기 제1 비디오 신호가 상기 제1 구동회로에 입력되는 원래의 비디오 신호의 시간 길이의 절반으로 단축되고,
    상기 제2 비디오 신호가 상기 제1 비디오 신호의 반전된 파형과 동일한 파형을 가지며,
    상기 제1 시프트 레지스터의 최종 스테이지로부터의 선택신호 출력이 상기 제2 시프트 레지스터의 첫번째 스테이지에 입력되어 라인 반전을 행하는 것을 특징으로 하는 반도체 표시장치.
  26. 제 25 항에 있어서, 상기 반도체 표시장치가 액정 표시장치인 것을 특징으로 하는 반도체 표시장치.
  27. 제 25 항에 있어서, 상기 반도체 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 반도체 표시장치.
  28. 제 25 항에 있어서, 상기 반도체 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 반도체 표시장치.
  29. 삭제
  30. 삭제
  31. 기판;
    제1 데이터 구동회로;
    제2 데이터 구동회로;
    상기 기판 위에 제공되고, 상기 제1 데이터 구동회로로부터 분지(分枝)하여 있으며, 홀수번째 열(列)들에 각각 배치된 다수의 홀수번째 데이터 신호선; 및
    상기 기판 위에 제공되고, 상기 제2 데이터 구동회로로부터 분지하여 있으며, 짝수번째 열들에 각각 배치된 다수의 짝수번째 데이터 신호선을 포함하고;
    행(行)에 배치된 화소들에 대한 제1 비디오 신호들이 그 제1 비디오 신호의 시간 길이의 절반으로 단축된 제2 비디오 신호들로 처리되고,
    그 제2 비디오 신호들이 상기 홀수번째 데이터 신호선들에 분배되며,
    상기 제2 비디오 신호의 반전된 파형과 동일한 파형을 가지고 상기 제2 비디오 신호와 반대의 극성을 가지는 제3 비디오 신호들이 상기 짝수번째 데이터 신호선들에 분배되는 것을 특징으로 하는 표시장치.
  32. 기판;
    적어도 제1 시프트 레지스터를 포함하는 제1 데이터 구동회로;
    적어도 제2 시프트 레지스터를 포함하는 제2 데이터 구동회로;
    상기 기판 위에 제공되고, 상기 제1 데이터 구동회로로부터 분지하여 있으며, 홀수번째 열들에 각각 배치된 다수의 홀수번째 데이터 신호선; 및
    상기 기판 위에 제공되고, 상기 제2 데이터 구동회로로부터 분지하여 있으며, 짝수번째 열들에 각각 배치된 다수의 짝수번째 데이터 신호선을 포함하고;
    행에 배치된 화소들에 대한 제1 비디오 신호들이 그 제1 비디오 신호의 시간 길이의 절반으로 단축된 제2 비디오 신호들로 처리되고,
    그 제2 비디오 신호들이 상기 홀수번째 데이터 신호선들에 분배되며,
    상기 제2 비디오 신호의 반전된 파형과 동일한 파형을 가지고 상기 제2 비디오 신호와 반대의 극성을 가지는 제3 비디오 신호들이 상기 짝수번째 데이터 신호선들에 분배되는 것을 특징으로 하는 표시장치.
  33. 기판;
    상기 기판 위에 제공되고, 적어도 제1 시프트 레지스터를 포함하는 제1 데이터 구동회로;
    상기 기판 위에 제공되고, 적어도 제2 시프트 레지스터를 포함하는 제2 데이터 구동회로;
    상기 기판 위에 제공되고, 상기 제1 데이터 구동회로로부터 분지하여 있으며, 홀수번째 열들에 각각 배치된 다수의 홀수번째 데이터 신호선; 및
    상기 기판 위에 제공되고, 상기 제2 데이터 구동회로로부터 분지하여 있으며, 짝수번째 열들에 각각 배치된 다수의 짝수번째 데이터 신호선을 포함하고;
    행에 배치된 화소들에 대한 제1 비디오 신호들이 그 제1 비디오 신호의 시간 길이의 절반으로 단축된 제2 비디오 신호들로 처리되고,
    그 제2 비디오 신호들이 상기 제1 시프트 레지스터를 통해 상기 홀수번째 데이터 신호선들에 분배되고,
    상기 제2 비디오 신호의 반전된 파형과 동일한 파형을 가지고 상기 제2 비디오 신호와 반대의 극성을 가지는 제3 비디오 신호들이 상기 제2 시프트 레지스터를 통해 상기 짝수번째 데이터 신호선들에 분배되며,
    상기 제1 데이터 구동회로가 상기 제2 데이터 구동회로의 대하여 상기 화소들의 반대측에 제공된 것을 특징으로 하는 표시장치.
  34. 제 31 항 내지 제 33 항 중 어느 한 항에 있어서, 상기 표시장치가 액정 표시장치인 것을 특징으로 하는 표시장치.
  35. 제 31 항 내지 제 33 항 중 어느 한 항에 있어서, 상기 표시장치가 전기장 발광 표시장치인 것을 특징으로 하는 표시장치.
  36. 제 31 항 내지 제 33 항 중 어느 한 항에 있어서, 상기 표시장치가 플랫 패널형 표시장치인 것을 특징으로 하는 표시장치.
KR1020010045395A 1995-11-29 2001-07-27 반도체 표시장치 KR100378885B1 (ko)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
JPJP-P-1995-00336054 1995-11-29
JP33605495A JP3597287B2 (ja) 1995-11-29 1995-11-29 表示装置及びその駆動方法

Related Parent Applications (1)

Application Number Title Priority Date Filing Date
KR1019960061461A Division KR100323913B1 (ko) 1995-11-29 1996-11-29 반도체장치

Publications (1)

Publication Number Publication Date
KR100378885B1 true KR100378885B1 (ko) 2003-04-07

Family

ID=18295232

Family Applications (2)

Application Number Title Priority Date Filing Date
KR1019960061461A KR100323913B1 (ko) 1995-11-29 1996-11-29 반도체장치
KR1020010045395A KR100378885B1 (ko) 1995-11-29 2001-07-27 반도체 표시장치

Family Applications Before (1)

Application Number Title Priority Date Filing Date
KR1019960061461A KR100323913B1 (ko) 1995-11-29 1996-11-29 반도체장치

Country Status (3)

Country Link
US (1) US6380919B1 (ko)
JP (1) JP3597287B2 (ko)
KR (2) KR100323913B1 (ko)

Families Citing this family (36)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6437766B1 (en) 1998-03-30 2002-08-20 Sharp Kabushiki Kaisha LCD driving circuitry with reduced number of control signals
JP2000075836A (ja) * 1998-09-02 2000-03-14 Sharp Corp 有機ｅｌ発光装置とその駆動方法
JP2000258748A (ja) * 1999-03-10 2000-09-22 Nec Corp 液晶表示装置
JP2000258750A (ja) * 1999-03-11 2000-09-22 Toshiba Corp 液晶表示装置
JP2002123228A (ja) * 2000-10-17 2002-04-26 Seiko Epson Corp 電気光学パネル、その駆動方法および電子機器
JP3696512B2 (ja) * 2001-02-13 2005-09-21 シャープ株式会社 表示素子駆動装置およびそれを用いた表示装置
KR100803163B1 (ko) * 2001-09-03 2008-02-14 삼성전자주식회사 액정표시장치
JP3811644B2 (ja) * 2001-12-12 2006-08-23 株式会社日立製作所 液晶表示装置
KR100831302B1 (ko) * 2001-12-22 2008-05-22 엘지디스플레이 주식회사 액정표시장치를 이용한 휴대 정보 단말기
KR100860239B1 (ko) * 2002-04-08 2008-09-25 삼성전자주식회사 액정표시장치
JP3757899B2 (ja) 2002-05-07 2006-03-22 株式会社豊田自動織機 駆動用半導体装置及び表示装置ならびに輝度バランス調整方法
US6809719B2 (en) * 2002-05-21 2004-10-26 Chi Mei Optoelectronics Corporation Simultaneous scan line driving method for a TFT LCD display
CN100440287C (zh) * 2002-11-04 2008-12-03 伊菲雷知识产权公司 用于对电致发光显示器进行灰阶伽马校正的方法和设备
JP2005005227A (ja) * 2003-06-16 2005-01-06 Hitachi Displays Ltd 有機ｅｌ発光表示装置
TWI268468B (en) * 2004-04-12 2006-12-11 Himax Tech Ltd Liquid crystal on silicon panel and driving method thereof
CN1942917A (zh) * 2004-04-13 2007-04-04 罗姆股份有限公司 有机el显示装置
KR101055203B1 (ko) * 2004-08-19 2011-08-08 엘지디스플레이 주식회사 액정 표시 장치
JP4196924B2 (ja) * 2004-10-07 2008-12-17 セイコーエプソン株式会社 電気光学装置、その駆動方法および電子機器
TWI348139B (en) * 2006-08-24 2011-09-01 Wintek Corp A lcd scan lines driving method
KR101337256B1 (ko) * 2007-02-14 2013-12-05 삼성디스플레이 주식회사 표시 장치의 구동 장치 및 이를 포함하는 표시 장치
JP4943505B2 (ja) * 2007-04-26 2012-05-30 シャープ株式会社 液晶表示装置
CN101669163B (zh) * 2007-04-27 2012-11-07 夏普株式会社 液晶显示装置
JP5245292B2 (ja) * 2007-05-30 2013-07-24 カシオ計算機株式会社 シフトレジスタ回路及び表示装置
JP2009037165A (ja) * 2007-08-03 2009-02-19 Sony Corp 表示装置および表示方法
TWI406234B (zh) * 2008-05-07 2013-08-21 Au Optronics Corp 基於具資料寫入同步控制機制之雙源極驅動電路的液晶顯示裝置及相關驅動方法
CN101762915B (zh) * 2008-12-24 2013-04-17 北京京东方光电科技有限公司 Tft-lcd阵列基板及其驱动方法
CN101847379B (zh) * 2009-03-27 2012-05-30 北京京东方光电科技有限公司 液晶显示器的驱动电路和驱动方法
TWI406249B (zh) * 2009-06-02 2013-08-21 Sitronix Technology Corp 液晶點反轉驅動電路
JP2011232568A (ja) * 2010-04-28 2011-11-17 Seiko Epson Corp 電気光学装置及び電子機器
US20120081347A1 (en) * 2010-09-30 2012-04-05 Apple Inc. Low power inversion scheme with minimized number of output transitions
KR101310004B1 (ko) * 2011-04-08 2013-09-24 샤프 가부시키가이샤 주사 신호선 구동 회로 및 그것을 구비한 표시 장치
JP5887973B2 (ja) * 2012-02-13 2016-03-16 セイコーエプソン株式会社 電気光学装置、電気光学装置の駆動方法および電子機器
US20150138176A1 (en) * 2012-05-11 2015-05-21 Sharp Kabushiki Kaisha Scanning signal line drive circuit and display device provided with same
KR20130129009A (ko) 2012-05-18 2013-11-27 삼성디스플레이 주식회사 표시 장치
KR102064152B1 (ko) 2013-11-08 2020-02-12 삼성디스플레이 주식회사 표시 장치 및 그것의 구동 방법
US10685614B2 (en) 2016-03-17 2020-06-16 Semiconductor Energy Laboratory Co., Ltd. Display device, display module, and electronic device

Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0378726A (ja) * 1989-08-22 1991-04-03 Asahi Glass Co Ltd 画像表示装置

Family Cites Families (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4338600A (en) * 1980-07-14 1982-07-06 Texas Instruments Incorporated Liquid crystal display system having temperature compensation
JPS5741078A (en) 1980-08-22 1982-03-06 Seiko Epson Corp Synchronizing circuit of matrix television
US4745485A (en) * 1985-01-28 1988-05-17 Sanyo Electric Co., Ltd Picture display device
EP0241562B1 (en) * 1985-10-16 1992-06-24 Sanyo Electric Co., Ltd Liquid crystal display device
JPH0766252B2 (ja) 1986-05-13 1995-07-19 三洋電機株式会社 画像表示装置の駆動回路
JPH0766256B2 (ja) 1986-09-17 1995-07-19 三洋電機株式会社 画像表示装置
CA1294075C (en) 1986-05-13 1992-01-07 Toshiaki Hayashida Driving circuit for image display apparatus
US4870493A (en) * 1986-08-01 1989-09-26 Hitachi, Ltd. Solid-state matrix array imaging device controlled by vertical scanning registers for read-out and for photo-sensitivity control
US4822142A (en) * 1986-12-23 1989-04-18 Hosiden Electronics Co. Ltd. Planar display device
JP2852042B2 (ja) * 1987-10-05 1999-01-27 株式会社日立製作所 表示装置
US4922240A (en) * 1987-12-29 1990-05-01 North American Philips Corp. Thin film active matrix and addressing circuitry therefor
JP2957799B2 (ja) * 1992-03-31 1999-10-06 シャープ株式会社 表示装置の表示駆動用サンプルホールド回路
US5781164A (en) * 1992-11-04 1998-07-14 Kopin Corporation Matrix display systems
JPH0766252A (ja) 1993-08-25 1995-03-10 Tokyo Electron Ltd プローブカード
JP3341378B2 (ja) 1993-08-25 2002-11-05 富士通株式会社 シリコン結晶中の水素濃度測定方法及びシリコン結晶の製造方法
TW277129B (ko) * 1993-12-24 1996-06-01 Sharp Kk
US5844538A (en) * 1993-12-28 1998-12-01 Sharp Kabushiki Kaisha Active matrix-type image display apparatus controlling writing of display data with respect to picture elements
US5642129A (en) * 1994-03-23 1997-06-24 Kopin Corporation Color sequential display panels

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0378726A (ja) * 1989-08-22 1991-04-03 Asahi Glass Co Ltd 画像表示装置

Also Published As

Publication number Publication date
JP3597287B2 (ja) 2004-12-02
JPH09152574A (ja) 1997-06-10
US6380919B1 (en) 2002-04-30
KR100323913B1 (ko) 2002-06-24

Similar Documents

Publication Publication Date Title
KR100378885B1 (ko) 반도체 표시장치
EP0275140B1 (en) Method and circuit for scanning capacitive loads
US7508479B2 (en) Liquid crystal display
US6630920B1 (en) Pel drive circuit, combination pel-drive-circuit/pel-integrated device, and liquid crystal display device
KR100268817B1 (ko) 액티브매트릭스형액정표시장치
KR100468562B1 (ko) 고선명 액정 표시 장치
US6323871B1 (en) Display device and its driving method
US8411027B2 (en) Image display apparatus
KR100887039B1 (ko) 표시 장치
US7015886B2 (en) Scanning line driver circuits, electrooptic apparatuses, electronic apparatuses and semiconductor devices
JPH1010546A (ja) 表示装置およびその駆動方法
JPH06148680A (ja) マトリクス型液晶表示装置
US6507332B1 (en) Active-matrix-type image display and a driving method thereof
US4816819A (en) Display panel
US20030063048A1 (en) Active matrix display device and data line switching circuit, switching section drive circuit, and scanning line drive circuit thereof
KR100302829B1 (ko) 액정전기광학장치
US7746306B2 (en) Display device having an improved video signal drive circuit
EP1814099A1 (en) System for providing dual resolution control of display panels
KR100710416B1 (ko) 시프트 레지스터 블록 및 이를 구비한 데이터 신호선구동회로와 표시장치
US20040008173A1 (en) Signal line drive circuit and display device using the same
KR100391734B1 (ko) 블랭킹 기간 중에 블랭킹 데이터가 기입되는 표시 장치
US20020154083A1 (en) Display device and method of driving same
US20030063109A1 (en) Flat-panel display device
JP3202345B2 (ja) 液晶表示装置
US7193603B2 (en) Display device having an improved video signal drive circuit

Legal Events

Date Code Title Description
A107 Divisional application of patent
A201 Request for examination
E902 Notification of reason for refusal
E902 Notification of reason for refusal
E701 Decision to grant or registration of patent right
GRNT Written decision to grant
FPAY Annual fee payment

Payment date: 20130219

Year of fee payment: 11

FPAY Annual fee payment

Payment date: 20140220

Year of fee payment: 12

LAPS Lapse due to unpaid annual fee