JPWO2019224655A5 - - Google Patents

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Claims (3)

  1. 画素と、第1の回路と、を有する表示装置であって、
    前記画素と前記第1の回路とは電気的に接続され、
    前記第1の回路は、第1のトランジスタと、第2のトランジスタと、第3のトランジスタと、第1の容量素子と、を有し、
    前記第1のトランジスタ、前記第2のトランジスタおよび前記第3のトランジスタは表示領域外に設けられ、
    前記第1の容量素子と前記画素とは表示領域内に設けられ、
    前記第1の回路は、第1のデータおよび第2のデータを加算して第3のデータを生成する機能を有し、
    前記画素は、前記第3のデータを保持する機能、および前記第3のデータに応じて表示を行う機能を有し、
    前記第1のトランジスタのソースまたはドレインの一方は、前記画素と前記第1の容量素子の一方の電極と電気的に接続され、
    前記第1の容量素子の他方の電極は、前記第2のトランジスタのソースまたはドレインの一方、および前記第3のトランジスタのソースまたはドレインの一方と電気的に接続され、
    前記第1のトランジスタのソースまたはドレインの他方は、前記第2のトランジスタのソースまたはドレインの他方と電気的に接続され、
    前記第1の容量素子は、複数の第2の容量素子を有し、複数の前記第2の容量素子は並列接続されている表示装置。
  2. 請求項1において、
    前記第1のトランジスタのチャネル幅、前記第2のトランジスタのチャネル幅、および、前記第3のトランジスタのチャネル幅は、前記画素が有するトランジスタのチャネル幅よりも大きい表示装置。
  3. 請求項1または請求項2に記載の表示装置と、カメラと、を有する電子機器。
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