JPS64867B2 - - Google Patents

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Publication number
JPS64867B2
JPS64867B2 JP58204035A JP20403583A JPS64867B2 JP S64867 B2 JPS64867 B2 JP S64867B2 JP 58204035 A JP58204035 A JP 58204035A JP 20403583 A JP20403583 A JP 20403583A JP S64867 B2 JPS64867 B2 JP S64867B2
Authority
JP
Japan
Prior art keywords
image signal
shading distortion
analog image
distortion correction
coefficient data
Prior art date
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Expired
Application number
JP58204035A
Other languages
English (en)
Other versions
JPS6096077A (ja
Inventor
Mitsuo Togashi
Shinichi Sato
Toshiaki Watanabe
Noritoku Ooshima
Tatsu Nakamura
Kazuyoshi Ariga
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electronics Corp
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electronics Corp, Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electronics Corp
Priority to JP58204035A priority Critical patent/JPS6096077A/ja
Publication of JPS6096077A publication Critical patent/JPS6096077A/ja
Publication of JPS64867B2 publication Critical patent/JPS64867B2/ja
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Description

【発明の詳細な説明】
産業上の利用分野 本発明は、フアクシミリ装置の原稿読取部等に
用いられるシエーデイング歪み補正装置に関す
る。 従来例の構成とその問題点 フアクシミリ装置の原稿読取部等に用いられる
スキヤナによつて原稿を走査して得られるアナロ
グ画信号は、一般に、原稿照明光源の光量ムラ、
光学系の光量ムラ、イメージセンサの感度バラツ
キ等による歪み(以下、これ等の歪みをシエーデ
イング歪みと総称する)を受けている。そこで、
フアクシミリ装置の原稿読取部等においては、ス
キヤナの後段にシエーデイング歪み補正装置を置
き、画信号のシエーデイング歪みを補正するよう
にしている。 さて、このような従来のシエーデイング歪み補
正装置は、一般に、スキヤナから入力されるアナ
ログ画信号を、A/D変換器によつてバイナリコ
ードに変換して補正演算を実行するように構成さ
れているが、しばしば補正動作が不安定になると
いう問題があつた。 発明者はその原因について実験・検討を重ねた
結果、その問題はA/D変換器における所謂グリ
ツチ現象によつて起こつていることを突きとめ
た。即ち、アナログ画信号の微小レベル変動時
に、A/D変換器出力であるバイナリコードはそ
の値が確定するまでの間、各ビツトの変化速度の
バラツキにより最終的な値と大きく相違する値
(中間値)をとるが、この中間値が補正演算部に
取り込まれることがあり、その場合に補正演算結
果がエラーとなつて補正動作が不安定になつてい
たのである。 従つて、アナログ画信号の微小レベル変動が生
じる位相を予測し、A/D変換器から中間値のバ
イナリコードを取り込まないように補正演算部の
データ取込みタイミングを制御することで、上述
の問題に対処することが考えられる。しかし、こ
のような方法では、位相予測の困難なアナログ画
信号の不規則な微小レベル変動に対しては対処で
きず、また、タイミング制御に関連して装置構成
が複雑化するという問題がある。 発明の目的 本発明は上記従来の問題点を解消するもので、
アナログ画信号の微小レベル変動が不規則に生じ
た場合でも安定なシエーデイング歪み補正が可能
で、かつ従来装置に比較し構成が格別複雑化しな
いシエーデイング歪み補正装置を提供することを
目的とする。 発明の構成 本発明は、アナログ画信号をデイジタル化する
手段としては、グレーコード出力型のA/D変換
手段を用いることにより、上述の目的を達成せん
とするものである。 実施例の説明 以下、図面を参照し本発明の実施例につき説明
する。 図は本発明の一実施例によるシエーデイング歪
み補正装置の概略ブロツク図であり、スキヤナの
概略構成も同時に示している。この図において、
1はシエーデイング歪み補正装置、2はスキヤナ
である。 スキヤナ2について説明すれば、3は原稿4ま
たは白基準板5を照明するためのランプであり、
このランプ3によつて照明された原稿4または白
基準板5の画像は、レンズ6を介してCCDイメ
ージセンサ7の受光面に結像され、CCDイメー
ジセンサ7によりアナログ画信号に光電変換され
る。原稿4または白基準板5に対する読取走査の
主走査はCCDイメージセンサ7により行われ、
副走査は原稿移動により行われる(白基準板5に
対する副走査は行われない)。CCDイメージセン
サ7から出力されるアナログ画信号は、増幅器8
によつて増幅されたのち、シエーデイング歪み補
正装置1に入力される。 シエーデイング歪み補正装置1の構成を説明す
れば、9はグレーコード出力型のA/D変換器で
あり、スキヤナ2から入力されるアナログ画信号
を量子化しグレーコードに変換する。10は
ROM、11はRAM、12はデイジタル演算器
である。A/D変換器9の出力信号(グレーコー
ド)は、ROM10にアドレス信号として入力さ
れ、またデイジタル演算器12に一方のオペラン
ドデータとして入力される。ROM10から出力
されるバイナリコード(補正係数データ)は
RAM11に書き込みデータとして入力され、
RAM11から読み出されるバイナリコード(補
正係数データ)は演算器12に他方のオペランド
データとして入力される。 次に動作を説明する。 原稿読取に先だつて、スキヤナ2により白基準
板5の読取走査が行われる。この時にスキヤナ2
より出力されるアナログ画信号はA/D変換器9
によつてグレーコードに変換されるが、このグレ
ーコードで指定されるROM10のアドレスか
ら、次の式(1)で決まる補正係数データMが読み出
され、RAM11の画素対応のアドレスに書き込
まれる。 Vin×M/2n=C ……(1) ここでVinはアナログ画信号の値、nは量子化
ビツト数、Cは定数である。このCはシエーデイ
ング歪みの補正範囲の下限値に相当する。たとえ
ば、C=1.25ボルト、n=8とし、Vin=5ボル
トの時、M=64となる(16進法で表現すればM=
40となる)。 このようにして画素毎の補正係数データが順次
求められ、RAM11に格納されて行き、最終的
に1ライン分の補正係数データがRAM11に蓄
積される。白基準板走査によつて得られるアナロ
グ画信号は、その時点におけるスキヤナ2の状態
で決まるシエーデイング歪みを受けており、従つ
てRAM11内の補正係数データはそのシエーデ
イング歪みを反映している。 その後、原稿4が読取位置に搬送され、原稿4
の読取走査が開始し、スキヤナ2から原稿に対応
したアナログ画信号がシエーデイング歪み補正装
置1に入力される。この時は、RAM11は読出
モードで動作し、読取走査と同期して補正係数デ
ータを出力する。この補正係数データと、A/D
変換器9から出力されるグレーコード(アナログ
画信号のデイジタル化データ)との乗算がデイジ
タル演算器12で実行され、シエーデイング歪み
補正を施された画信号データ(バイナリコード)
が演算器12より出力される。 一般にスキヤナ2のシエーデイング歪み特性
は、ランプ3の点灯直後における光量変動の大き
い期間は、時間とともに相当大幅に変動する傾向
があるため、ランプ3の光量が安定した定常状態
におけるシエーデイング歪み特性に合わせて求め
た補正係数データを用いたのでは、ランプ3の点
灯直後において正常な補正動作を期待できない。
しかし本実施例においては、RAM11内の補正
係数データは、上述のように原稿読取の開始直前
におけるスキヤナ2のシエーデイング歪み特性を
忠実に反映しているから、ランプ点灯直後から正
常なシエーデイング歪み補正が為される。 ここで、グレーコード出力型のA/D変換器9
を用いた効果を説明する。 表1はアナログ画信号のレベル(16レベルとし
てある)と、それに対するグレーコードおよびバ
イナリコードの対応表である。ただし、コード長
を4ビツトとしてある。
【表】 この表から明らかなように、アナログ画信号の
1レベル変化に対し、グレーコードは1ビツトし
か変化しないが、バイナリコードは最大4ビツト
変化する。たとえば、アナログ画信号レベルがレ
ベル7,8間で変化した場合、バイナリコードは
全ビツトが変化し、各ビツトの変化速度のバラツ
キがあると、変化の中間状態で様々の値をとり、
所謂グリツチ現象を発生する。これに対しグレー
コードは、各ビツトの変化速度が相違しても、そ
のような中間状態とはなり得ず、グリツチ現象は
発生しない。このことは、他のレベル間において
アナログ画信号レベルが微小に変動した場合につ
いても同様である。従つて、従来装置においてグ
リツチ現象に起因して起こつていた補正動作の異
常は解消される。 なお、グレーコード長は4ビツトに限定されな
いことは勿論である。 発明の効果 上述のように本発明によれば、アナログ画信号
のデイジタル化手段としてグレーコード出力型の
A/D変換手段を用いるから、アナログ画信号の
レベルが雑音等によつて不規則に微小変動した場
合でもシエーデイング歪み補正動作が安定で、ま
た複雑なタイミング制御も行わないから構成も簡
易な優れたシエーデイング歪み補正装置を提供で
きるという効果を得られる。
【図面の簡単な説明】
図は本発明の一実施例によるシエーデイング歪
み補正装置をスキヤナとともに示す概略ブロツク
図である。 1…シエーデイング歪み補正装置、2…スキヤ
ナ、3…ランプ、4…原稿、5…白基準板、6…
レンズ、7…CCDイメージセンサ、8…増幅器、
9…グレーコード出力型A/D変換器、10…
ROM、11…RAM、12…デイジタル演算器。

Claims (1)

    【特許請求の範囲】
  1. 1 外部から入力されるアナログ画信号をグレー
    コードに変換し出力するA/D変換手段と、補正
    係数データを記憶する記憶手段と、上記A/D変
    換手段より出力されるグレーコードと上記記憶手
    段より読み出される補正係数データとの特定の演
    算を行いシエーデイング歪み補正を施した画信号
    のデータを出力するデイジタル演算手段とを有す
    るシエーデイング歪み補正装置。
JP58204035A 1983-10-31 1983-10-31 シエ−デイング歪み補正装置 Granted JPS6096077A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP58204035A JPS6096077A (ja) 1983-10-31 1983-10-31 シエ−デイング歪み補正装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP58204035A JPS6096077A (ja) 1983-10-31 1983-10-31 シエ−デイング歪み補正装置

Publications (2)

Publication Number Publication Date
JPS6096077A JPS6096077A (ja) 1985-05-29
JPS64867B2 true JPS64867B2 (ja) 1989-01-09

Family

ID=16483669

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Application Number Title Priority Date Filing Date
JP58204035A Granted JPS6096077A (ja) 1983-10-31 1983-10-31 シエ−デイング歪み補正装置

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* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH01276416A (ja) * 1988-04-26 1989-11-07 Mitsubishi Electric Corp 磁気記録再生装置の回転ヘツドアセンブリを組立てる方法

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JPS6096077A (ja) 1985-05-29

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